JP5221387B2 - 取り外し可能な部品を用いた電子アセンブリ - Google Patents
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Description
Claims (41)
- 複数の部品から構成される部品群と、
基板と、
前記基板と前記部品とを電気的に連結するように設定された異方性導電材料層と、
を備え、
前記部品は、外部インターフェースとしてのコンタクトアレイと、該コンタクトアレイに連結された1セットの導電性パッドと、を有し、
前記基板は、前記部品のコンタクトアレイに合わせて設定された1セットのランドパターンと、前記部品の前記導電性パッドのセットに合わせて設定され、前記基板上において前記ランドパターンのセットに連結された1セットの導電性パッドと、を有し、
電源又はグランドに電気的に接続される一連の導電路において、前記基板の導電性パッドと、前記部品群における前記部品の対応する前記導電性パッドとを、前記異方性導電材料層を通じて、相互に連結するアライメントチェーンを、さらに備える、
ことを特徴とする電子アセンブリ。 - 前記導電性パッドは、前記部品の表面領域から別の表面領域へ信号を伝えるように設定された前記導電路に連結される、
請求項1に記載の電子アセンブリ。 - 前記導電性パッドは、前記部品において、さらにラッチに連結される、
請求項2に記載の電子アセンブリ。 - 前記基板の前記導電性パッドのセットの1つは、前記基板における前記ランドパターン上の前記異方性導電材料層を通じて、前記部品の前記コンタクトアレイの整合性を監視するように、前記部品上の前記導電性パッドのセットの対応する1つに連結されており、
前記部品上の導電性パッドはアライメントマークに、前記基板上の前記導電性パッドはリファレンスマークに、それぞれ相当する、
請求項1乃至3のいずれか一項に記載の電子アセンブリ。 - 前記コンタクトアレイは、外部インターフェースとして前記部品上に設けられた1セットの導電性パッドである、
請求項1乃至4のいずれか一項に記載の電子アセンブリ。 - 前記異方性導電材料層は、前記部品上にラミネートされ、前記部品が前記基板から分離可能であるように設定されている、
請求項1乃至5のいずれか一項に記載の電子アセンブリ。 - 前記異方性導電材料は、前記基板の表面領域にラミネートされている、
請求項1乃至6のいずれか一項に記載の電子アセンブリ。 - 前記部品の熱消散をするように設定された少なくとも1つのサーマルメンブレンを、さらに備える、
請求項1乃至7のいずれか一項に記載の電子アセンブリ。 - 前記部品群は、当該電子アセンブリ内に複数のアライメントチェーンを形成するように、さらにより小さな部品群に分割可能である、
請求項1乃至8のいずれか一項に記載の電子アセンブリ。 - 前記アライメントチェーンは、前記異方性導電材料層越しに、前記基板上における前記部品群の位置及び導電性のステータスを診断するように設定されている、
請求項1乃至9のいずれか一項に記載の電子アセンブリ。 - 前記アライメントチェーンの整合性を監視するための1セットのアクセス領域を、さらに備える、
請求項1乃至10のいずれか一項に記載の電子アセンブリ。 - 前記基板上に、前記部品の位置を維持するように設定された保護構造体を含む、
請求項1乃至11のいずれか一項に記載の電子アセンブリ。 - 前記保護構造体は、前記基板上に配置された前記部品の高さプロファイルに合わせて設定された内面を有する一乃至複数のカバーから構成される、
請求項12に記載の電子アセンブリ。 - 前記保護構造体は、前記部品及び前記基板の配置を維持するためのハウジングを有し、
前記ハウジングは、1セットの上面ノッチを有する上面カバーと、1セットの底面ノッチを有する底面カバーと、を備え、
前記底面ノッチは、前記上面ノッチに連結し、協働して前記ハウジングを保持するように設定されている、
請求項12又は13に記載の電子アセンブリ。 - 前記保護構造体は、前記部品及び前記基板を保持するための折りたたみ式のハウジングを備え、
前記ハウジングは、
上面ノッチに連結される上面プレートと、
前記上面ノッチと連結されるように設定された底面ノッチに連結される底面プレートと、
前記上面プレート及び前記底面プレートを一緒に保持するように適用されるよう設定されたクランプと、
を備える、
請求項12乃至14のいずれか一項に記載の電子アセンブリ。 - 相互連結層として異方性導電膜を使用する前記部品の配置を容易にするように設定された少なくとも1つの取付具を、さらに備える、
請求項1乃至15のいずれか一項に記載の電子アセンブリ。 - 前記取付具は、前記基板上に配置された前記部品の物理的外形に合った複数の開口を備える、
請求項16に記載の電子アセンブリ。 - 前記取付具は、前記部品と前記基板との間の信号ルーティングを容易にするための相互連結回路を有し、一乃至複数の相互連結層を備える、
請求項16又は17に記載の電子アセンブリ。 - 前記取付具は、複数の組込み受動部品を備える、
請求項16乃至18のいずれか一項に記載の電子アセンブリ。 - 前記取付具は、前記基板の表面でエンボスされている、
請求項16乃至19のいずれか一項に記載の電子アセンブリ。 - 前記取付具は、異方性導電膜により、前記基板の表面上に連結されている、
請求項16乃至20のいずれか一項に記載の電子アセンブリ。 - 前記取付具は、異方性導電膜により、前記基板の表面上に連結され、硬化されている、
請求項16乃至21のいずれか一項に記載の電子アセンブリ。 - 前記取付具は、半田ペーストにより、前記基板の表面上に半田付けされている、
請求項16乃至22のいずれか一項に記載の電子アセンブリ。 - 前記基板上の取付具の位置を維持すべく、1セットのマウンティングシリンダに合わせるように1セットのマウンティングホールを組み込むことにより、前記取付具が、前記基板のアライメント面に機械的に連結される、
請求項16乃至23のいずれか一項に記載の電子アセンブリ。 - 前記基板上の取付具の位置を維持すべく、前記基板の表面に刻みを入れることにより、前記取付具が、前記基板のアライメント面と機械的に連結される、
請求項16乃至24のいずれか一項に記載の電子アセンブリ。 - 前記取付具は、前記基板上における前記取付具の配置の整合性を検出するために、前記基板において1セットの導電性パッドをアライメントするように設定された1セットの導電性パッドを備える、
請求項16乃至25のいずれか一項に記載の電子アセンブリ。 - 前記基板において導電路と連結される前記導電性パッドに、前記取付具において導電路と連結された前記導電性パッドを、異方性導電材料を通じて、連結するアライメントチェーンをさらに備える、
請求項26に記載の電子アセンブリ。 - 当該電子アセンブリは、
基板上において一乃至複数のメモリデバイスにアクセスするためのメモリバスを通じて信号を受信する一乃至複数のメモリデバイスと、
異方性導電材料を相互連結層として、前記基板上に一乃至複数のメモリデバイスを配置するように設定された少なくとも1つの取付具(1セットの開口を含む)と、
前記基板上に一乃至複数のメモリデバイスを保持するための保護構造体と、
から構成されるメモリモジュールである、
請求項1乃至27のいずれか一項に記載の電子アセンブリ。 - 基板上において一乃至複数のロジックデバイスにアクセスするためのメモリバスを通じて制御信号を受信する一乃至複数のロジックデバイスを、さらに備える、
請求項28に記載の電子アセンブリ。 - 前記メモリデバイスは、
DRAM(Dynamic Random Access Memory)デバイス、
SRAM(Static Random Access Memory)デバイス、
フラッシュメモリデバイス、
電気的に書換可能なメモリ(Electric Erasable Programmable Memory)デバイス、
プログラマブルロジックデバイス、
強磁性メモリ(ferromagnetic memory)デバイス、及び
これらデバイスの任意の組み合わせ、
のいずれか1つである、
請求項28又は29に記載の電子アセンブリ。 - 前記メモリデバイスの配置の整合性を診断するためのアライメントチェーンを、さらに備える、
請求項28乃至30のいずれか一項に記載の電子アセンブリ。 - 前記部品は複数の部品を含み得る、
請求項1乃至31のいずれか一項に記載の電子アセンブリ。 - 前記複数の部品からなる部品群は、前記基板の一乃至複数の表面に配置され得る、
請求項1乃至32のいずれか一項に記載の電子アセンブリ。 - 前記基板は複数の基板から構成される、
請求項1乃至33のいずれか一項に記載の電子アセンブリ。 - 前記異方性導電材料層は異方性導電膜を有する、
請求項1乃至34のいずれか一項に記載の電子アセンブリ。 - 前記異方性導電材料層は異方性導電ペーストを有する、
請求項1乃至35のいずれか一項に記載の電子アセンブリ。 - 外部インターフェースとしてのコンタクトアレイと、該コンタクトアレイに連結された1セットの導電性パッドと、を有する複数の部品から構成される部品群と、
前記部品のコンタクトアレイに合わせて設定された1セットのランドパターンと、前記部品の前記導電性パッドのセットに合わせて設定され、前記ランドパターンのセットに連結された1セットの導電性パッドと、を有する基板と、
前記基板の表面上に連結された異方性導電材料層と、
当該電子アセンブリにおいて、前記部品群を構成する各部品の前記コンタクトアレイが、前記異方性導電材料層越しに、前記基板上の対応するランドパターンに対してアライメントされるように、前記部品群を位置決めする手段と、
を備え、
電源又はグランドに電気的に接続される一連の導電路において、前記基板の導電性パッドと、前記部品群における前記部品の対応する前記導電性パッドとを、前記異方性導電材料層を通じて、相互に連結するアライメントチェーンを、さらに備える、
ことを特徴とする電子アセンブリ。 - 少なくとも1つの基板がその基板上に1セットの導電性パッドを有する複数の基板と、
開口位置を有する複数の取付具と、
複数の異方性導電材料膜と、
前記開口位置において異方性導電材料を通じて相互に連結され、少なくとも1つの部品が、前記基板の前記導電性パッドのセットに合わせて設定された1セットの導電性パッドを有する複数の部品と、
電源又はグランドに電気的に接続される一連の導電路において、前記複数の基板の少なくとも1つの導電性パッドと、前記複数の部品の少なくとも1つの対応する前記導電性パッドとを、前記複数の異方性導電材料膜の少なくとも1つを通じて、相互に連結するアライメントチェーンと、
を備える、
ことを特徴とするスタック型電子アセンブリ。 - 前記異方性導電材料膜、前記基板、前記取付具、及び前記異方性導電材料で相互に連結された部品は、前記取付具の前記開口位置に配置され、MFS(Membrane-Fixture-Substrate)構築ブロックを形成し、複数のMFS構築ブロックが相互連結要素により連結されて縦列にスタック化されるように、設定されている、
請求項38に記載の電子アセンブリ。 - 前記相互連結要素は、前記部品をその上面から底面にかけて接続する導電路である、
請求項39に記載の電子アセンブリ。 - 前記相互連結要素は、当該平面受動素子をその上面から底面にかけて接続する1セットの導電路を有する平面受動素子である、
請求項39又は40に記載の電子アセンブリ。
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