JP5164331B2 - 表示装置、表示モジュール、および電子機器 - Google Patents
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Landscapes
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Description
本発明の表示装置の他の構成は、電流源と、第1の配線と、第2の配線と、第1の発光素子と、第1のトランジスタを有し、第1のトランジスタのソースとドレインのうち一方、及びゲートが第1の配線を介して電流源と電気的に接続され、第1のトランジスタのソースとドレインのうち他方が、第2の配線、及び第1の発光素子の一方の電極に電気的に接続されることを特徴とする。
また、本発明の表示装置の他の構成は、電流源と、第1の配線と、第2の配線と、デジタルアナログ変換回路と、第1の発光素子と、第1のトランジスタを有し、デジタルアナログ変換回路は第1の配線と電気的に接続され、また、第2の配線と電気的に接続され、第1のトランジスタのソースとドレインのうち一方が第1の配線を介して前記電流源と電気的に接続され、第1のトランジスタのソースとドレインのうち他方、及びゲートが第2の配線、及び第1の発光素子の一方の電極に電気的に接続されることを特徴とする。
また、本発明の表示装置の他の構成は、電流源と、第1の配線と、第2の配線と、第3の配線と、第1のサンプリング回路と、第2のサンプリング回路と、デジタルアナログ変換回路と、第1の発光素子と、第2の発光素子と、第1のトランジスタと、第2のトランジスタを有し、第1のサンプリング回路は第1の配線、および第3の配線と電気的に接続され、第2のサンプリング回路は第2の配線と電気的に接続され、デジタルアナログ変換回路は第1のサンプリング回路、および第2のサンプリング回路と電気的に接続され、第1のトランジスタのソースとドレインのうち一方が第1の配線を介して電流源と電気的に接続され、第1のトランジスタのソースとドレインのうち他方、及びゲートが第2の配線、及び第1の発光素子の一方の電極に電気的に接続され、第2のトランジスタのソースとドレインのうち一方が第3の配線に電気的に接続され、第2のトランジスタのソースとドレインのうち他方が第2の発光素子の一方の電極に電気的に接続されることを特徴とする。
また、本発明の表示装置の他の構成は、電流源と、第1の配線と、第2の配線と、第3の配線と、第1の発光素子と、第2の発光素子と、ソースとドレインのうち一方が第1の配線を介して電流源と電気的に接続され、ソースとドレインのうち他方、及びゲートが第2の配線、及び第1の発光素子の一方の電極に電気的に接続された第1のトランジスタと、ソースとドレインのうち一方が第3の配線に電気的に接続され、ソースとドレインのうち他方が第2の発光素子の一方の電極に電気的に接続された第2のトランジスタと、第1の配線の電位を一定期間保持し、第3の配線に供給する第1のサンプリング回路と、第2の配線の電位を一定期間保持する第2のサンプリング回路と、第1のサンプリング回路に保持された電位と、第2のサンプリング回路に保持された電位とによって最小出力となる電位、及び最大出力となる電位が決定されるデジタルアナログ変換回路と、デジタルアナログ変換回路の出力に応じた信号を第2のトランジスタのゲートに供給する回路と、第1のサンプリング回路の出力に応じた電位を第3の配線に供給する回路と、を有することを特徴とする。
また、本発明の表示装置の他の構成は、電流源と、第1の配線と、第2の配線と、第3の配線と、第4の配線と、第5の配線と、第1の発光素子と、第2の発光素子と、ソースとドレインのうち一方が第1の配線を介して電流源と電気的に接続され、ソースとドレインのうち他方、及びゲートが第2の配線、及び第1の発光素子の一方の電極に電気的に接続された第1のトランジスタと、ソースとドレインのうち一方が第3の配線に電気的に接続され、ソースとドレインのうち他方が第2の発光素子の一方の電極に電気的に接続された第2のトランジスタと、ソースとドレインのうち一方が第4の配線に電気的に接続され、ソースとドレインのうち他方が第2のトランジスタのゲートに電気的に接続され、ゲートが第5の配線に電気的に接続された第3のトランジスタと、第1の配線の電位を一定期間保持し、第3の配線に供給する第1のサンプリング回路と、第2の配線の電位を一定期間保持する第2のサンプリング回路と、第1のサンプリング回路に保持された電位と、第2のサンプリング回路に保持された電位とによって最小出力となる電位、及び最大出力となる電位が決定されるデジタルアナログ変換回路と、デジタルアナログ変換回路の出力に応じた信号を第4の配線に供給するソースドライバと、選択信号を第5の配線に供給するゲートドライバと、第1のサンプリング回路の出力に応じた電位を第3の配線に供給する回路と、を有することを特徴とする。
また、上記構成において、第1のトランジスタと、第1の発光素子の動作点、及び第2のトランジスタと、第2の発光素子の動作点は、それぞれ、第1のトランジスタの飽和領域及び第2のトランジスタの飽和領域であっても良い。また、第1の発光素子の構造は、第2の発光素子の構造と同一であっても良い。また、第1のトランジスタはノーマリーオフ型であっても良い。
即ち、第1のトランジスタのゲートの電位は、表示画素領域の複数の画素の最大輝度時の電位として信号線へフィードバックする。モニタ画素電源線の電位は、表示画素領域の複数の画素の非発光時の電位として画素の信号線と画素の電源線とへフィードバックする。こうして、常に最大輝度時に、第2のトランジスタをピンチオフ点付近で動作させるこができる。
本発明は、複数のモニタ画素と、複数の画素と、第1の配線と、第2の配線と、第3の配線と、第4の配線と、第5の配線と、第6の配線と、定電流源と、第1のサンプリング回路と、第2のサンプリング回路と、デジタルアナログ変換回路と、ソースドライバと、ゲートドライバとを有する表示装置である。複数のモニタ画素それぞれは、Pチャネル型の第1のトランジスタと、一対の電極を有する第1の発光素子とを有し、複数の画素それぞれは、Pチャネル型の第2のトランジスタと、第3のトランジスタと、一対の電極を持つ容量素子と、一対の電極を持つ第2の発光素子とを有する。定電流源は第1の配線と接続される。第1の配線は第1のトランジスタのソースとドレインのうち一方と接続される。第1のトランジスタのソースとドレインのうち他方は第1の発光素子の一方の電極、及び第2の配線、及び第1のトランジスタのゲートと接続される。第1の配線は第1のサンプリング回路の入力と接続される。第2の配線は第2のサンプリング回路の入力と接続される。第1のサンプリング回路の出力はデジタルアナログ変換回路の電源、及び第4の配線と接続される。第2のサンプリング回路の出力はデジタルアナログ変換回路の電源と接続される。第3の配線はデジタルアナログ変換回路の入力と接続され、デジタルのビデオ信号が入力される。デジタルアナログ変換回路の出力はソースドライバにビデオ信号として入力される。第4の配線は第2のトランジスタのソースとドレインのうち一方と接続される。第2のトランジスタのソースとドレインのうち他方は第2の発光素子の一方の電極と接続される。第2のトランジスタのゲートは容量素子の一方の電極、及び第3のトランジスタのソースとドレインのうち一方と接続される。第3のトランジスタの他方は第5の配線と接続される。容量素子の他方の電極は第4の配線と接続される。第3のトランジスタのゲートは第6の配線と接続される。第5の配線はソースドライバの出力、第6の配線はゲートドライバの出力に接続されている。第1の配線、及び第2の配線により得られる電位を第1のサンプリング回路、及び第2のサンプリング回路によりサンプリングする。第1のサンプリング回路及び第2のサンプリング回路それぞれの出力をデジタルアナログ変換回路の電源として用い、それにより得られる電位をビデオ信号としてソースドライバを介して第5の配線から出力することを特徴とする。
本発明は、複数のモニタ画素と、複数の画素と、第1の配線と、第2の配線と、第3の配線と、第4の配線と、第5の配線と、第6の配線と、定電流源と、第1のサンプリング回路と、第2のサンプリングス回路と、ソースドライバと、ゲートドライバとを有する表示装置である。複数のモニタ画素それぞれは、Pチャネル型の第1のトランジスタと、一対の電極を有する第1の発光素子とを有する。複数画素それぞれは、Pチャネル型の第2のトランジスタと、第3のトランジスタと、一対の電極を持つ容量素子と、一対の電極を持つ第2の発光素子とを有する。定電流源は第1の配線と接続される。第1の配線は第1のトランジスタのソースとドレインのうち一方と接続される。第1のトランジスタのソースとドレインのうち他方は第1の発光素子の一方の電極、及び第2の配線、及び第1のトランジスタのゲートと接続される。第1の配線は第1のサンプリング回路の入力と接続される。第2の配線は第2のサンプリング回路の入力と接続される。第1のサンプリング回路の出力はソースドライバのバッファ部の電源、及びソースドライバのレベルシフタ部の電源、及び第4の配線と接続される。第2のサンプリング回路の出力はソースドライバのバッファ部の電源、及びソースドライバのレベルシフタ部の電源と接続される。当該バッファ部と当該レベルシフタ部は、ソースドライバにおける各信号線への出力直前のバッファ部とレベルシフタ部である。第3の配線はソースドライバにビデオ信号を入力する。第4の配線は第2のトランジスタのソースとドレインのうち一方と接続される。第2のトランジスタのソースとドレインのうち他方は第2の発光素子の一方の電極と接続される。第2のトランジスタのゲートは容量素子の一方の電極、及び第3のトランジスタのソースとドレインのうち一方と接続される。第3のトランジスタの他方は第5の配線と接続される。容量素子の他方の電極は第4の配線と接続される。第3のトランジスタのゲートは第6の配線と接続される。第5の配線はソースドライバの出力、第6の配線はゲートドライバの出力に接続されている。第1の配線、及び第2の配線により得られる電位を第1のサンプリング回路、及び第2のサンプリング回路によりサンプリングする。第1のサンプリング回路及び第2のサンプリング回路それぞれの出力をソースドライバのバッファ部、及びソースドライバのレベルシフタ部の電源として用い、それにより得られる電位をビデオ信号として、第5の配線から出力することを特徴とする。
第1の構成の表示装置について、図4を用いて説明する。
Vds=Vgs−Vth
(Vds:ソースとドレインの間の電圧、Vgs:ソースとゲートの間の電圧、Vth:しきい値電圧)
また、飽和領域では以下の式を満たす。
Vds<Vgs−Vth
また、線形領域では以下の式を満たす。
Vds>Vgs−Vth
第2の構成の表示装置について、図5を用いて説明する。
Vds=Vgs−Vth
(Vds:ソースとドレインの間の電圧、Vgs:ソースとゲートの間の電圧、Vth:しきい値電圧)
また、飽和領域では以下の式を満たす。
Vds<Vgs−Vth
また、線形領域では以下の式を満たす。
Vds>Vgs−Vth
402 TFT
403 容量素子
404 発光素子
405 対向電極
406 ソース信号線
407 ゲート信号線
408 ノードVm
409 ソースドライバ
410 ゲートドライバ
411 TFT
412 発光素子
413 対向電極
414 電源線
415 サンプリング線
416 定電流源
417 サンプリング回路
418 サンプリング回路
419 デジタルアナログ変換回路
420 電源線
421 モニタ画素領域
422 表示画素領域
423 ビデオ信号
Claims (6)
- 電流源と、第1乃至第3の配線と、デジタルアナログ変換回路と、モニタ素子及び表示素子と、第1及び第2のトランジスタとを有し、
前記モニタ素子の形状は、前記表示素子の形状と同一、もしくはその近傍であり、
前記第1のトランジスタの極性は、前記第2のトランジスタの極性と同じであり、
前記第1のトランジスタのチャネル幅、及びチャネル長は、前記第2のトランジスタのチャネル幅、及びチャネル長と同一、もしくはその近傍であり、
前記第1のトランジスタのソースとドレインのうち一方は、前記第1の配線を介して前記電流源と電気的に接続され、
前記第1のトランジスタのソースとドレインのうち他方は、前記第2の配線と電気的に接続され、
前記第1のトランジスタのゲートは、前記第1のトランジスタのドレインと電気的に接続され、
前記モニタ素子の一方の端子は、前記第1のトランジスタのソースとドレインのうち他方と電気的に接続され、
前記第2のトランジスタのソースとドレインのうち一方は、前記第3の配線と電気的に接続され、
前記第2のトランジスタのソースとドレインのうち他方は、前記表示素子の一方の端子と電気的に接続され、
前記表示素子の他方の端子は、前記モニタ素子の他方の端子と電気的に接続され、
前記電流源から、前記モニタ素子に電流を供給したとき、前記第1及び第2の配線に現れる電位が前記デジタルアナログ変換回路に入力され、
前記電流源から、前記モニタ素子に電流を供給したとき、前記第1の配線に現れる電位に応じて決定された電位が、前記第3の配線に供給され、
前記デジタルアナログ変換回路において、前記第1の配線に現れる電位と、前記第2の配線に現れる電位とを、それぞれ最大出力、最小出力とする信号が生成され、前記第2のトランジスタのゲートに入力されることを特徴とする表示装置。 - 電流源と、第1乃至第3の配線と、サンプリング回路と、デジタルアナログ変換回路と、モニタ素子及び表示素子と、第1及び第2のトランジスタとを有し、
前記モニタ素子の形状は、前記表示素子の形状と同一、もしくはその近傍であり、
前記第1のトランジスタの極性は、前記第2のトランジスタの極性と同じであり、
前記第1のトランジスタのチャネル幅、及びチャネル長は、前記第2のトランジスタのチャネル幅、及びチャネル長と同一、もしくはその近傍であり、
前記第1のトランジスタのソースとドレインのうち一方は、前記第1の配線を介して前記電流源と電気的に接続され、
前記第1のトランジスタのソースとドレインのうち他方は、前記第2の配線と電気的に接続され、
前記第1のトランジスタのゲートは、前記第1のトランジスタのドレインと電気的に接続され、
前記モニタ素子の一方の端子は、前記第1のトランジスタのソースとドレインのうち他方と電気的に接続され、
前記第2のトランジスタのソースとドレインのうち一方は、前記第3の配線と電気的に接続され、
前記第2のトランジスタのソースとドレインのうち他方は、前記表示素子の一方の端子と電気的に接続され、
前記表示素子の他方の端子は、前記モニタ素子の他方の端子と電気的に接続され、
前記電流源から、前記モニタ素子に電流を供給したとき、前記第1及び第2の配線に現れる電位が前記サンプリング回路に保持され、
前記サンプリング回路に保持された、前記第1の配線に現れる電位に応じて決定された電位が、前記第3の配線に供給され、
前記サンプリング回路に保持された、前記第1及び第2の配線に現れる電位が前記デジタルアナログ変換回路に入力され、
前記デジタルアナログ変換回路において、前記第1の配線に現れる電位と、前記第2の配線に現れる電位とを、それぞれ最大出力、最小出力とする信号が生成され、前記第2のトランジスタのゲートに入力されることを特徴とする表示装置。 - 請求項1または請求項2において、
前記第1及び第2のトランジスタは、前記モニタ素子及び前記表示素子と同一基板上に形成されていることを特徴とする表示装置。 - 請求項1乃至請求項3のいずれか一において、
前記モニタ素子及び前記表示素子は、発光素子を有することを特徴とする表示装置。 - 請求項1乃至請求項4のいずれか一に記載の表示装置を具備していることを特徴とする表示モジュール。
- 請求項5に記載の表示モジュールと、操作キーとを具備したことを特徴とする電子機器。
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