JP5066164B2 - 半導体素子の製造方法 - Google Patents
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Description
上記基板上かつ上記触媒金属下に第1導電型の半導体コアを形成する半導体コア形成工程と、
上記第1導電型の半導体コアの先端面および側面に第2導電型の半導体層を形成する半導体層形成工程とを備え、
上記半導体層形成工程では、
上記触媒金属を除去した後、上記第1導電型の半導体コアの先端面および側面に第1導電型の半導体層を形成してから、上記第2導電型の半導体層を形成することを特徴としている。
上記触媒金属を残した状態で上記第1導電型の半導体コアの先端面および側面に第2導電型の半導体層を形成する。
上記触媒金属を除去してから、上記第1導電型の半導体コアの先端面および側面に第2導電型の半導体層を形成する。
上記触媒金属を除去した後、上記第1導電型の半導体コアの先端面および側面に第1導電型の半導体層を形成してから、上記第2導電型の半導体層を形成する。
上記第1導電型の半導体コアの先端面を覆う部分の厚さが上記第1導電型の半導体コアの側面を覆う部分の厚さよりも厚い。
異方性エッチングを行って、上記第2導電型の半導体層のうちの上記第1導電型の半導体コアの先端面と上記半導体コアの側面とを覆う被覆部を残すと共に、上記第2導電型の半導体層のうちの上記半導体コアの側面を覆う部分から上記半導体基板に沿って延在している延在部分を除去すると共に上記延在部分下の上記半導体基板を或る深さ寸法だけ除去して、上記半導体コアおよび上記半導体層の被覆部下に連なる上記半導体基板の段部を残す。
上記半導体コアを、上記半導体コアの先端面と側面を覆う上記半導体層の被覆部および上記半導体コア下に連なる上記半導体基板の段部と共に上記半導体基板から切り離す。
上記基板上に成長穴を有する成長マスクを形成する工程と、
上記成長穴内の上記基板上に触媒金属を形成する工程とを含み、
上記半導体コア形成工程では、上記成長穴内の上記基板上かつ上記触媒金属下に上記成長マスク上に突出した第1導電型の半導体コアを形成し、
上記半導体形成工程では、上記触媒金属を残した状態で上記成長マスクよりも上に突出した上記第1導電型の半導体コアの表面に第2導電型の半導体層を形成し、
さらに、上記半導体形成工程の後に上記成長マスクを除去して上記半導体コアの側面を露出させる工程を有する。
上記第1導電型の半導体コアの一端部側の端面と側面を被覆すると共に上記半導体コアの他端部側の端面と側面を露出させる第2導電型の半導体層とを備え、
上記第2導電型の半導体層は、
上記半導体コアの一端部側の端面を覆う部分の厚さが上記半導体コアの側面を覆う部分の厚さよりも厚い。
図1〜図14はこの発明の第1実施形態の半導体素子の製造方法を順に示す工程図である。この実施形態では、Siをドープしたn型GaNとMgをドープしたp型GaNとを用いるが、GaNにドーピングする不純物はこれに限らない。
図15〜図20はこの発明の第2実施形態の半導体素子の製造方法を順に示す工程図である。この第2実施形態では、まず、触媒金属形成工程で、図15に示すように、n‐GaN基板21上に触媒金属22を蒸着(デポジション)させる。この触媒金属22としては、例えば、Ni、Feなどを採用できる。
図21〜図25はこの発明の第3実施形態の半導体素子の製造方法を順に示す工程図である。この第3実施形態では、まず、触媒金属形成工程で、図21に示すように、n型GaNからなる基板31上に、成長穴32Aを有するマスク層32を形成する。このマスク層32には、酸化シリコン(SiO2)あるいは窒化シリコン(Si3N4)など半導体コアおよび半導体層に対して選択的にエッチング可能な材料を用いることができる。上記成長穴32Aの形成は、通常の半導体プロセスに使用する公知のリソグラフィー法とドライエッチング法が利用できる。この際、成長する半導体コアの径は上記マスク32の成長穴32Aのサイズに依存する。
図27A〜図27Eはこの発明の第4実施形態の半導体素子の製造方法を順に示す工程図である。この第4実施形態では、まず、触媒金属形成工程で、図27Aに示すように、n‐GaN基板51上に触媒金属52を蒸着(デポジション)させる。この触媒金属52としては、例えば、Ni、Feなどを採用できる。
図28A〜図28Eはこの発明の第5実施形態の半導体素子の製造方法を順に示す工程図である。この第5実施形態では、まず、触媒金属形成工程で、図28Aに示すように、n‐GaN基板61上に触媒金属62を蒸着(デポジション)させる。この触媒金属62としては、例えば、Ni、Feなどを採用できる。
次に、この発明の第6実施形態の棒状構造発光素子を備えた発光装置、バックライト、照明装置および表示装置について説明する。この第6実施形態では、上記第1〜第3実施形態において上記切り離し工程を有する場合に作製した棒状構造発光素子を絶縁性基板に配列する。この棒状構造発光素子の配列は、本出願人が特願2007−102848(特開2008−260073号公報)で出願した「微細構造体の配列方法及び微細構造体を配列した基板、並びに集積回路装置及び表示素子」の発明の技術を用いて行う。
2 n−GaN層
3、32 マスク層
5 レジスト層
6、22、33 触媒金属
7、23、35 n−GaN半導体コア
8 多重量子井戸層
10、25、36 p−GaN半導体層
11 導電膜
12 発光素子
21、31 n−GaN基板
26、37 棒状構造発光素子
32A 成長穴
600 絶縁性基板
601,602 金属電極
610 棒状構造発光素子
611 IPA
700 表示装置
701 表示部
702,703,704,705 論理回路部
710 絶縁性基板
Claims (7)
- 基板上に触媒金属を形成する触媒金属形成工程と、
上記基板上かつ上記触媒金属下に第1導電型の半導体コアを形成する半導体コア形成工程と、
上記第1導電型の半導体コアの先端面および側面に第2導電型の半導体層を形成する半導体層形成工程と
を備え、
上記半導体層形成工程では、
上記触媒金属を除去した後、上記第1導電型の半導体コアの先端面および側面に第1導電型の半導体層を形成してから、上記第2導電型の半導体層を形成することを特徴とする半導体素子の製造方法。 - 請求項1に記載の半導体素子の製造方法において、
上記第1導電型の半導体コアを上記第2導電型の半導体層と共に上記基板から切り離す切り離し工程を備えることを特徴とする半導体素子の製造方法。 - 基板上に触媒金属を形成する触媒金属形成工程と、
上記基板上かつ上記触媒金属下に第1導電型の半導体コアを形成する半導体コア形成工程と、
上記第1導電型の半導体コアの先端面および側面に第2導電型の半導体層を形成する半導体層形成工程と
を備え、
上記基板は、第1導電型の半導体基板であり、
異方性エッチングを行って、上記第2導電型の半導体層のうちの上記第1導電型の半導体コアの先端面と上記半導体コアの側面とを覆う被覆部を残すと共に、上記第2導電型の半導体層のうちの上記半導体コアの側面を覆う部分から上記半導体基板に沿って延在している延在部分を除去すると共に上記延在部分下の上記半導体基板を或る深さ寸法だけ除去して、上記半導体コアおよび上記半導体層の被覆部下に連なる上記半導体基板の段部を残すことを特徴とする半導体素子の製造方法。 - 請求項3に記載の半導体素子の製造方法において、
上記半導体コアを、上記半導体コアの先端面と側面を覆う上記半導体層の被覆部および上記半導体コア下に連なる上記半導体基板の段部と共に上記半導体基板から切り離すことを特徴とする半導体素子の製造方法。 - 基板上に触媒金属を形成する触媒金属形成工程と、
上記基板上かつ上記触媒金属下に第1導電型の半導体コアを形成する半導体コア形成工程と、
上記第1導電型の半導体コアの先端面および側面に第2導電型の半導体層を形成する半導体層形成工程と
を備え、
上記触媒金属形成工程は、
上記基板上に成長穴を有する成長マスクを形成する工程と、
上記成長穴内の上記基板上に触媒金属を形成する工程とを含み、
上記半導体コア形成工程では、上記成長穴内の上記基板上かつ上記触媒金属下に上記成長マスク上に突出した第1導電型の半導体コアを形成し、
上記半導体形成工程では、上記触媒金属を残した状態で上記成長マスクよりも上に突出した上記第1導電型の半導体コアの表面に第2導電型の半導体層を形成し、
さらに、上記半導体形成工程の後に上記成長マスクを除去して上記半導体コアの側面を露出させる工程を有することを特徴とする半導体素子の製造方法。 - 請求項5に記載の半導体素子の製造方法において、
上記半導体層形成工程で形成する上記第2導電型の半導体層は、
上記第1導電型の半導体コアの先端面を覆う部分の厚さが上記第1導電型の半導体コアの側面を覆う部分の厚さよりも厚いことを特徴とする半導体素子の製造方法。 - 請求項1から6のいずれか1つに記載の半導体素子の製造方法において、
上記第1導電型の半導体コアを覆うと共に上記第2導電型の半導体層で覆われる量子井戸層を形成する工程を有することを特徴とする半導体素子の製造方法。
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