JP5047662B2 - 表示装置 - Google Patents
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Description
120 電源回路
120a 電圧検出回路
121 VDD生成回路
130 ソースドライバ
140 ゲートドライバ
150 メモリ回路
PNL 液晶表示パネル
DL 映像線(ソース線またはドレイン線)
GL 走査線(またはゲート線)
TFT 薄膜トランジスタ
PX 画素電極
CT 対向電極
LC 液晶容量
Cadd 保持容量
SUB 第1のガラス基板
DRV 駆動回路
FPC フレキシブル配線基板
PM1、PM2、PM21、PM22 p型MOSトランジスタ
NM21、NM22 n型MOSトランジスタ
TN1,TN2 PNPトランジスタ
R 抵抗
Claims (6)
- 表示パネルと、
前記表示パネルの各画素を駆動する駆動回路とを備え、
前記駆動回路には、インターフェース用電源電圧と、前記インターフェース用電源電圧以上の内部回路用電源電圧が入力される表示装置であって、
前記インターフェース用電源電圧が入力された状態を検出するレベルセンス回路と、
前記駆動回路をリセットするリセット回路と、
前記内部回路用電源電圧が一定電圧を超えたとき検出信号を出力する電圧検出回路とを有し、
前記レベルセンス回路は、前記内部回路用電源電圧を電源電圧とし、前記インターフェース用電源電圧と、前記検出信号とが入力し、
前記レベルセンス回路において、前記検出信号と前記インターフェース用電源電圧が入力された状態を検出した後に、前記リセット回路にリセット解除信号を出力することを特徴とする表示装置。 - 前記レベルセンス回路は、前記内部回路用電源電圧が安定したことを示す検出信号と、前記インターフェース用電源電圧とが入力するナンド回路の出力にインバータ回路を設けたものであることを特徴とする請求項1に記載の表示装置。
- 前記レベルセンス回路は前記インターフェース用電源電圧が入力していない場合に前記内部回路用電源電圧を前記インバータ回路の入力に出力することを特徴とする請求項2に記載の表示装置。
- 表示パネルと、
前記表示パネルの各画素を駆動する駆動回路と、
外部から前記駆動回路に電源電圧を供給するフレキシブル基板とを備え、
前記駆動回路には、前記フレキシブル基板を介してインターフェース用電源電圧と、前記インターフェース用電源電圧以上の内部回路用電源電圧が入力される表示装置であって、
前記駆動回路は、
前記インターフェース用電源電圧が入力された状態を検出するレベルセンス回路と、
前記駆動回路をリセットするリセット回路と、
前記内部回路用電源電圧が一定電圧を超えたとき検出信号を出力する電圧検出回路とを有し、
前記レベルセンス回路は、前記内部回路用電源電圧を電源電圧とし、前記インターフェース用電源電圧と、前記検出信号とが入力し、
前記レベルセンス回路において、前記検出信号と前記インターフェース用電源電圧が入力された状態を検出した後に、前記リセット回路にリセット解除信号を出力することを特徴とする表示装置。 - 前記レベルセンス回路は、前記内部回路用電源電圧が安定したことを示す検出信号と、前記インターフェース用電源電圧とが入力するナンド回路の出力にインバータ回路を設けたものであることを特徴とする請求項4に記載の表示装置。
- 前記レベルセンス回路は前記インターフェース用電源電圧が入力していない場合に前記内部回路用電源電圧を前記インバータ回路の入力に出力することを特徴とする請求項5に記載の表示装置。
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