JP5041844B2 - Pcr補正回路 - Google Patents
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Description
前記ビットレート変換部は、ビット幅の拡張が施され前記基準カウンタ値が付加されたTSパケット形態のままバッファメモリに記憶し、前記PCR補正カウンタ値算出部は、前記ビットレート変換部よりバッファメモリに記憶されたTS信号が読み出される際、前記TS信号の拡張ビット幅領域に付加された前記基準カウンタ値を抽出することで前記入力時刻基準カウンタ値を求め、そして、前記PCR置換部における前記レート変換後のTS信号よりその中に含まれるPCRカウンタ値を検出するPCR検出回路は、全てのTSパケットのヘッダ情報内のアダプテーションフィールドフラグを参照し、このフラグがアダプテーションフィールドの存在を示し、且つ、アダプテーションフィールド内のアダプテーションフィールドレングスを参照しこの値が有限長である事を示し、且つ、アダプテーションフィールド内のPCRフラグを参照し、このPCRフラグがPCRカウンタ値の記述があることを示す場合にのみ、このTSパケットのアダプテーションフィールドからPCRカウンタ値を抽出するPCR補正回路である。
また、前記PCR補正用基準カウンタ部2を動作させる為のシステムクロック(27MHz)は、MPEG2−TS規格においては±30ppmとなっており、高い精度が求められているが、しかしながら、従来方式のようにPLL回路によりシステムクロックを再生するのは、処理が複雑になり回路規模が増えるというデメリットがある。また、複数のプログラムが多重されたTS信号に対しては、上記PLL回路を複数個持つことで対応可能であるが、しかしながら、それでは回路の実装スペース等の問題でPCR補正可能なプログラム数に制限が出てくることになる。
PCR2'= PCR2 + ΔPCR2
次に、PCR補正カウンタ値算出部5について詳細に説明する。レート変換部4よりのレート変換後のTS信号eが出力される際、前記ビット拡張部分に付加されたバッファメモリに書き込まれる時の前記基準カウンタ値bを抽出し、もって、入力時刻基準カウンタ値を得る。同時に、その時の前記PCR補正用基準カウンタ部2よりの前記基準カウンタ値bを抽出して、出力時刻基準カウンタ値を得る。こうして得られた入力時刻基準カウンタ値と出力時刻基準カウンタ値の差分を算出することで、PCR補正カウンタ値fを得ることが可能となる。なお、本PCR補正カウンタ値fが、レート変換部4におけるバッファリングの際に生じる時間的な揺らぎ(遅延時間)であり、即ち、前記で述べたΔPCR1及びΔPCR2の値である。本処理は、本来、PCRカウンタ情報を含んだTSパケットに対してのみ行うことで十分であるが、しかしながら、回路の簡略化の為、レート変換後のTS信号eの全パケットに対して行うこととする。
次に、図9を用いて、システムクロック周波数差検出部7−1〜7−nについて詳細に説明する。
システムクロック周波数差検出部は、入力TS信号cに多重されたプログラム数1〜n個分の同一回路を持つ。PCR検出部1は、入力TS信号cに含まれるプログラムの中の所定符号器に対応したPCRカウンタ値uのみを検出し、同時にPCR検出フラグvを出力する。STCカウンタ9は、前記システムクロック用水晶発振器1からのシステムクロックaに同期したカウンタであり、PCRカウンタ値uと同じ構成(33bit)を持つ。本カウンタは、前記PCR検出部1からのPCR検出フラグvを検出すると、同時に入力される前記PCRカウンタ値uを初期値としてロードし、次のPCRカウンタ値uが検出されるまでカウントアップするカウンタである。
周波数オフセット補正値算出部10は、前記PCR検出フラグvと共に入力されるPCRカウンタ値uと、STCカウンタ9からのカウンタ値wを基に所定の符号器のシステムクロックと前記システムクロック用水晶発振器1からのシステムクロックaとの周波数差を算出し、周波数補正オフセット補正値tを出力する。
この値がPCR1からPCR2が到達するまでに生じた、本発明のPCR補正回路にて用いるシステムクロックaに対する所定の符号器のシステムクロックとの周波数差である。また該PCR1からPCR2が到達するまでの時間(ΔPCR1−2)は、次式で求められる。
ΔPCR1−2 = PCR2a − PCR1
以上述べたΔPCR2a、ΔPCR1−2を、周波数オフセット補正値tとして用いる。
100ms < 2^5 bit×1/(27MHz×±30ppm)
次に、基準カウンタ値付加部3について詳しく説明する。図12は、前記図3にて説明した基準カウンタ値付加部3において、8ビットの拡張ビット領域に付加した前記基準カウンタ値bの後に、前記周波数補正オフセット補正値tを新たに付加するようにしたものである。
(α=1+ΔPCR2a/ΔPCR1−2)
ここで、αの符号はΔPCR2aの最上位ビット付加した符号ビットで定義する。こうして、新たなPCR補正カウンタ値f'を得ることが可能となる。また、求めたPCR補正カウンタ値f'は、1つの水晶発振器からの基準システムクロックのカウント値(バッファメモリの入力から出力までのカウント差)でもって補正した値に対し、更に前記基準とする水晶発振器のシステムクロックと元々の多重された符号器のシステムクロックとの周波数差をも補正することで、より高精度なPCR補正カウンタ値であると言える。
PCR置換部6では、本発明の図1にて説明のPCR補正回路と同様、レート変換後のTS信号eに対し、前記PCR補正カウンタ値fの代わりに新たな高精度のPCR補正カウンタ値f’を補正されたPCRカウンタ値として置き換えを行う。
Claims (4)
- 複数プログラムが多重されたTS信号をメモリを介して異なったビットレートに変換する際に生じるPCR基準時刻情報の揺らぎを補正するPCR補正回路において、
PCR補正用の基準クロックとなる水晶発振器と、それに同期したPCR補正用の基準カウンタ値を生成するPCR補正用基準カウンタ部と、ビットレート変換前のTS信号に前記基準カウンタ値を付加する基準カウンタ値付加部と、前記基準カウンタ値を付加したTS信号を一時バッファメモリに蓄えた後、出力ビットレートに変換して出力するレート変換部と、前記レート変換部からの出力TS信号が入力された時の入力時刻基準カウンタ値を該出力TS信号に付加された基準カウンタ値より抽出し、同時に、該TS信号を出力した時の出力時刻基準カウンタ値を前記PCR補正用基準カウンタ部より取得し、該入力時刻基準カウンタ値と出力時刻基準カウンタ値の差分値を算出してPCR補正カウンタ値を求めるPCR補正カウンタ値算出部と、前記レート変換部からの出力TS信号よりその中に含まれるPCRカウンタ値を検出し、該検出したPCRカウンタ値に対し前記算出したPCR補正カウンタ値を加算して新たなPCRカウンタ値として付け替えるPCR置換部とを具備すると共に、
前記基準カウンタ値付加部は、前記TS信号に対しビット幅の拡張を施し、該拡張されたビット領域に前記基準カウンタ値を付加し、
前記ビットレート変換部は、ビット幅の拡張が施され前記基準カウンタ値が付加されたTSパケット形態のままバッファメモリに記憶し、
前記PCR補正カウンタ値算出部は、前記ビットレート変換部よりバッファメモリに記憶されたTS信号が読み出される際、前記TS信号の拡張ビット幅領域に付加された前記基準カウンタ値を抽出することで前記入力時刻基準カウンタ値を求め、そして、
前記PCR置換部における前記レート変換後のTS信号よりその中に含まれるPCRカウンタ値を検出するPCR検出回路は、全てのTSパケットのヘッダ情報内のアダプテーションフィールドフラグを参照し、このフラグがアダプテーションフィールドの存在を示し、且つ、アダプテーションフィールド内のアダプテーションフィールドレングスを参照しこの値が有限長である事を示し、且つ、アダプテーションフィールド内のPCRフラグを参照し、このPCRフラグがPCRカウンタ値の記述があることを示す場合にのみ、このTSパケットのアダプテーションフィールドからPCRカウンタ値を抽出することを特徴とするPCR補正回路。 - 請求項1記載のPCR補正回路において、
前記入力時刻基準カウンタ値と前記出力時刻基準カウンタ値との前記差分値から算出された前記PCR補正カウンタ値を加算した前記新たなPCR補正カウンタ値に対し、前記レート変換部からの前記出力TS信号に含まれる前記複数プログラム毎に独立した符号器のシステムクロックとの周波数オフセット値を個別に検出した該周波数オフセット値を用いて補正することを特徴とするPCR補正回路。 - 請求項2記載のPCR補正回路において、
前記PCR補正回路が補正動作を開始した後の所定時間以内の伝送断状態では、前記新たなPCR補正カウンタ値を継続して用いることを特徴とするPCR補正回路。 - 請求項3記載のPCR補正回路において、前記伝送断状態がn回検知された場合には、前記新たなPCR補正値に代えて、前記周波数オフセット値を用いて補正することを特徴とするPCR補正回路。
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