JP5040520B2 - 2線式伝送器 - Google Patents
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Description
外部電源の正電極に接続される正電源端子と、
一端が前記正電源端子に接続される電流検出抵抗と、
センサの測定値に対応する第1及び第2の設定差動信号電流を出力するとともに回路コモン電圧に接続される電流設定回路と、
前記正電源端子の電圧から前記第1の設定差動信号電流により電圧降下した電圧と、前記電流検出抵抗の他端の電圧から前記第2の設定差動信号電流により電圧降下した電圧との差動電圧に応じて、出力電流を出力するとともに前記電流検出抵抗に流れる電流を一定に制御する電流制御回路と、
前記外部電源の負電極及び前記回路コモン電圧に接続される負電源端子と、を備える。
前記電流設定回路は、
前記第1の設定差動信号電流を出力する第1の電流源と、
前記第2の設定差動信号電流を出力する第2の電流源と、を備え、
前記電流制御回路は、
一端が前記正電源端子に接続され他端が第1の電流源に接続される第1の抵抗と、
一端が前記電流検出抵抗の他端に接続され他端が第2の電流源に接続される第2の抵抗と、
前記第1の抵抗の他端が非反転入力に接続され、前記第2の抵抗の他端が反転入力に接続され、正電源入力が前記電流検出抵抗の他端に接続され、前記非反転入力及び前記反転入力の電圧の差分電圧を増幅して出力する演算増幅器と、
前記電流検出抵抗の他端及び前記演算増幅器の負電源入力に接続される定電圧部と、
前記演算増幅器の出力電圧に応じて、前記電流検出抵抗から出力された電流を調整し前記出力電流として出力するトランジスタと、
前記演算増幅器の負電源入力及び前記トランジスタの出力に接続される定電流部と、を備える。
前記電流制御回路は、
一端が前記第1の抵抗の他端に接続され他端が前記演算増幅器の負電源入力に接続される第3の抵抗と、
一端が前記第2の抵抗の他端に接続され他端が前記演算増幅器の負電源入力に接続される第4の抵抗と、を備える。
前記定電流部の出力は、前記トランジスタの出力、2線式伝送器内部の負荷、外部機器又は前記回路コモン電圧に接続される。
Vp=Vin−R1・Ip …(1)
Vn=Vin−Rs・Is−R2・In …(2)
ここで、R=R1=R2≫Rsとし、上述のようにVp−Vn=0の条件を満たすものとすると、次式(3),(4)が得られる。
Vin−R・Ip=Vin−Rs・Is−R・In …(3)
∴Is=R/Rs・(Ip−In) …(4)
式(4)が示すとおり、電流Isは、設定差動信号電流Ipと設定差動信号電流Inとの差電流(Ip−In)に比例して制御される。
Iout=Ip+Is …(5)
このため、設定差動信号電流Ipが既知あるいは一定であるならば、出力電流Ioutは、式(4)の関係で制御することができる。
ierr=C・dVin/dt …(6)
図3を参照して、上記実施の形態の変形例を説明する。図3に、本変形例の電流制御回路10Aの内部構成を示す。
101,102,103 端子
104,105,106,107,108,109,110 ノード
10,10A 電流制御回路
31,32 抵抗
33 定電圧ダイオード
34 演算増幅器
35 MOSFET
36 接合FET
11 定電圧ダイオード
12 電流検出抵抗
61,62 抵抗
2 伝送器主機能部
20 電流設定回路
21 DAコンバータ
22 通信パルス発生回路
23 マイクロプロセッサ
3 外部電源
4 遠隔機器
7 2線式伝送器
701,702 端子
70 電流制御回路
71 抵抗
72 トランジスタ
73,74,75,76,77 抵抗
78 演算増幅器
79 トランジスタ
81 定電圧ダイオード
82 内部回路
Claims (4)
- 外部電源の正電極に接続される正電源端子と、
一端が前記正電源端子に接続される電流検出抵抗と、
センサの測定値に対応する第1及び第2の設定差動信号電流を出力するとともに回路コモン電圧に接続される電流設定回路と、
前記正電源端子の電圧から前記第1の設定差動信号電流により電圧降下した電圧と、前記電流検出抵抗の他端の電圧から前記第2の設定差動信号電流により電圧降下した電圧との差動電圧に応じて、出力電流を出力するとともに前記電流検出抵抗に流れる電流を一定に制御する電流制御回路と、
前記外部電源の負電極及び前記回路コモン電圧に接続される負電源端子と、を備える2線式伝送器。 - 前記電流設定回路は、
前記第1の設定差動信号電流を出力する第1の電流源と、
前記第2の設定差動信号電流を出力する第2の電流源と、を備え、
前記電流制御回路は、
一端が前記正電源端子に接続され他端が第1の電流源に接続される第1の抵抗と、
一端が前記電流検出抵抗の他端に接続され他端が第2の電流源に接続される第2の抵抗と、
前記第1の抵抗の他端が非反転入力に接続され、前記第2の抵抗の他端が反転入力に接続され、正電源入力が前記電流検出抵抗の他端に接続され、前記非反転入力及び前記反転入力の電圧の差分電圧を増幅して出力する演算増幅器と、
前記電流検出抵抗の他端及び前記演算増幅器の負電源入力に接続される定電圧部と、
前記演算増幅器の出力電圧に応じて、前記電流検出抵抗から出力された電流を調整し前記出力電流として出力するトランジスタと、
前記演算増幅器の負電源入力に接続される定電流部と、を備える請求項1に記載の2線式伝送器。 - 前記電流制御回路は、
一端が前記第1の抵抗の他端に接続され他端が前記演算増幅器の負電源入力に接続される第3の抵抗と、
一端が前記第2の抵抗の他端に接続され他端が前記演算増幅器の負電源入力に接続される第4の抵抗と、を備える請求項2に記載の2線式伝送器。 - 前記定電流部の出力は、前記トランジスタの出力、2線式伝送器内部の負荷、外部機器又は前記回路コモン電圧に接続される請求項2に記載の2線式伝送器。
Priority Applications (1)
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JP2007211786A JP5040520B2 (ja) | 2007-08-15 | 2007-08-15 | 2線式伝送器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2007211786A JP5040520B2 (ja) | 2007-08-15 | 2007-08-15 | 2線式伝送器 |
Publications (2)
Publication Number | Publication Date |
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JP2009048290A JP2009048290A (ja) | 2009-03-05 |
JP5040520B2 true JP5040520B2 (ja) | 2012-10-03 |
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ID=40500466
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2007211786A Expired - Fee Related JP5040520B2 (ja) | 2007-08-15 | 2007-08-15 | 2線式伝送器 |
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JPS611517Y2 (ja) * | 1978-02-27 | 1986-01-18 | ||
JPS6142239Y2 (ja) * | 1978-06-20 | 1986-12-01 | ||
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2007
- 2007-08-15 JP JP2007211786A patent/JP5040520B2/ja not_active Expired - Fee Related
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