JP4992394B2 - Printed wiring board - Google Patents

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Description

本発明は、グランド層、絶縁層、電源層が積層されてなるプリント配線板に関し、特に、アナログ回路とディジタル回路が混載されるプリント配線板に関する。   The present invention relates to a printed wiring board in which a ground layer, an insulating layer, and a power supply layer are laminated, and more particularly to a printed wiring board on which an analog circuit and a digital circuit are mixedly mounted.

プリント配線板にディジタル回路とアナログ回路を実装する場合には、ディジタル回路とアナログ回路との干渉を考慮する必要がある。このようなディジタル回路とアナログ回路との干渉問題は、回路設計者の設計の自由度を狭めることが多く、この干渉を防止するために、各回路の配置を工夫し、互いの電磁的な離隔を確保するなどの工夫が必要であった(例えば特許文献1参照)。   When a digital circuit and an analog circuit are mounted on a printed wiring board, it is necessary to consider interference between the digital circuit and the analog circuit. Such interference problems between digital circuits and analog circuits often reduce the degree of design freedom of circuit designers, and in order to prevent this interference, the arrangement of each circuit is devised and the electromagnetic separation between each other is improved. It is necessary to devise such as securing the above (see, for example, Patent Document 1).

また一方では、電源ノイズの空間へのノイズ放出を抑える構成として、プリント配線板の中央部と周辺部とで、絶縁層の誘電率を高めたり(特許文献2参照)、低めたり(特許文献3参照)する技術が開示されている。しかしながら、これらの技術では、その効果を得るために、必ず周囲を取り囲んで、異なる絶縁層を配置しなければならず、部品の搭載位置などにも制限を及ぼしていた。
特開平3−214486号公報 特開2005−129618号公報 特開平9−0077331号公報
On the other hand, as a configuration for suppressing noise emission to the space of the power supply noise, the dielectric constant of the insulating layer is increased (refer to Patent Document 2) or decreased at the center portion and the peripheral portion of the printed wiring board (Patent Document 3). Technology) is disclosed. However, in these techniques, in order to obtain the effect, the surroundings must be surrounded and different insulating layers must be disposed, and the mounting positions of components are limited.
Japanese Patent Laid-Open No. 3-214486 JP 2005-129618 A JP-A-9-0077331

しかしながら、例えば特許文献1による方法では、新たに専用の金属ケースを設ける必要があり、実装設計に大きな制限を与えるものとなっていた。   However, for example, in the method according to Patent Document 1, it is necessary to newly provide a dedicated metal case, which greatly restricts mounting design.

また、ディジタル回路とアナログ回路との干渉を防止するために、金属ケースのように周囲を覆う構造ではないが、一部に電磁シールドを施す目的で金属などの導電性材料からなるシールド部材、例えばついたて、カバー等を追加したり、ディジタル回路とアナログ回路の各グランドを分離して設けるなどの構成は、文献を挙げるまでもなく、広く使われている技術である。   Further, in order to prevent interference between the digital circuit and the analog circuit, it is not a structure covering the periphery like a metal case, but a shield member made of a conductive material such as metal for the purpose of providing an electromagnetic shield on a part, for example, Therefore, a configuration such as adding a cover or the like, and separately providing each ground of the digital circuit and the analog circuit is a widely used technique, not to mention literature.

いうまでもなく、上述のようなシールド部材の追加はプリント配線板の実装設計に多くの制限を与え、グランドの分離は、電子機器内部のグランド配線系統を複雑にするなど、やはり、設計の自由度を狭めるものであった。   Needless to say, the addition of the shielding member as described above places many restrictions on the mounting design of the printed wiring board, and the separation of the ground complicates the ground wiring system inside the electronic device. It was something that narrowed the degree.

また、特許文献2や特許文献3は他の目的で考案された技術であり、本発明が掲げる問題解決のためには、異なる絶縁体の実装位置の制約などが絡み、効果的に利用できるものではなかった。   Patent Document 2 and Patent Document 3 are technologies devised for other purposes, and in order to solve the problems posed by the present invention, there are restrictions on the mounting position of different insulators and the like, which can be used effectively. It wasn't.

お互いの電磁的な干渉を避けたい回路、例えばアナログ回路とディジタル回路とを同一のプリント配線板上に混載する場合には、電磁シールドの配置、グランドの分離などの技術が用いられていた。しかしながら、これらはプリント配線板の実装設計に制限を与えたり、設計を困難にしたりするものであった。   When a circuit that is desired to avoid mutual electromagnetic interference, for example, an analog circuit and a digital circuit are mounted on the same printed wiring board, techniques such as placement of electromagnetic shields and ground separation have been used. However, these limit the mounting design of the printed wiring board and make the design difficult.

そこで、本発明は、簡素な構造で、任意の電源層の電源から他の電源層の電源に伝わる電磁ノイズを低減し、プリント配線板の設計の自由度を向上することができるプリント配線板を提供することを目的とする。   Therefore, the present invention provides a printed wiring board that has a simple structure, reduces electromagnetic noise transmitted from the power supply of an arbitrary power supply layer to the power supply of another power supply layer, and can improve the degree of freedom of design of the printed wiring board. The purpose is to provide.

上述した目的を達成するため、本発明に係るプリント配線板は、直流的に独立した複数の電源層と、これら電源層に対向して配置されたグランド層と、電源層とグランド層との間に各電源層にそれぞれ対応して設けられた複数の絶縁層とを備える。そして、複数の絶縁層のうち、他の電源層からの電磁干渉を低く抑えたい任意の電源層に対応する絶縁層の誘電率が、他の電源層に対応する絶縁層よりも大きいIn order to achieve the above-described object, a printed wiring board according to the present invention includes a plurality of power supply layers independent from each other in direct current, a ground layer disposed to face these power supply layers, and between the power supply layer and the ground layer. And a plurality of insulating layers provided corresponding to the respective power supply layers. Of the plurality of insulating layers , the dielectric constant of the insulating layer corresponding to an arbitrary power source layer for which electromagnetic interference from the other power source layer is desired to be kept lower than that of the insulating layer corresponding to the other power source layer .

以上のように構成されたプリント配線板によれば、複数の電源層のうち、他の電源層からの電磁干渉を低く抑えたい任意の電源層に対応する絶縁層の誘電率を、他の電源層に対応する絶縁層の誘電率に比べて大きくすることで、任意の電源層に発生している電磁ノイズが、他の電源層の電源に伝わるのが抑えられる。 According to the printed wiring board configured as described above, among the plurality of power supply layers, the dielectric constant of the insulating layer corresponding to any power supply layer for which electromagnetic interference from other power supply layers is desired to be kept low can be reduced. By making it larger than the dielectric constant of the insulating layer corresponding to the layer, it is possible to suppress the electromagnetic noise generated in any power supply layer from being transmitted to the power supply of another power supply layer.

また、本発明に係るプリント配線板が備える複数の絶縁層は、任意の前記電源層に対応する絶縁層の誘電率が最も大きくされ、この絶縁層から順に誘電率が小さくされてもよい。   The plurality of insulating layers included in the printed wiring board according to the present invention may have the dielectric constant of the insulating layer corresponding to any of the power supply layers being maximized, and the dielectric constant may be decreased in order from the insulating layer.

また、本発明に係るプリント配線板が備える複数の絶縁層は、任意の電源層に対応する絶縁層のみが、他の前記絶縁層よりも誘電率が大きくされてもよい。   Moreover, as for the several insulating layer with which the printed wiring board which concerns on this invention is equipped, only the insulating layer corresponding to arbitrary power supply layers may make a dielectric constant larger than the said other insulating layer.

また、本発明に係るプリント配線板が備える複数の電源層は、ディジタル回路用の電源層と、アナログ回路用の電源層とを有する構成において、良好な効果が得られる。   Further, the plurality of power supply layers provided in the printed wiring board according to the present invention can obtain a good effect in a configuration including a power supply layer for digital circuits and a power supply layer for analog circuits.

本発明によれば、直流的に独立した複数の電源層を備える構成において、任意の電源層に対応する絶縁層の誘電率を、他の電源層に対応する絶縁層の誘電率に比べて大きくすることで、任意の電源層に発生している電磁ノイズが、他の電源層の電源に伝わるのを抑えることができる。すなわち、本発明によれば、簡素な構造で、任意の電源層の電源から他の電源層の電源に伝わる電磁ノイズを低減することを可能にし、プリント配線板の設計の自由度を確保することができる。 According to the present invention, in a configuration including a plurality of DC independent power supply layers, the dielectric constant of an insulating layer corresponding to an arbitrary power supply layer is larger than the dielectric constant of an insulating layer corresponding to another power supply layer. By doing so, it is possible to prevent electromagnetic noise generated in an arbitrary power supply layer from being transmitted to the power supply of another power supply layer. That is, according to the present invention, it is possible to reduce electromagnetic noise transmitted from a power source of an arbitrary power source layer to a power source of another power source layer with a simple structure, and to secure a degree of freedom in designing a printed wiring board. Can do.

以下、本発明の具体的な実施形態について、図面を参照して説明する。   Hereinafter, specific embodiments of the present invention will be described with reference to the drawings.

図1(a),(b)に、本実施形態のプリント配線板の層構成を説明するための模式図を示す。図2に、本実施形態のプリント配線板の平面図を示す。図2では、本発明の要部である絶縁層と電源層の構成を示し、グランド層の図示を省略している。   1A and 1B are schematic views for explaining the layer configuration of the printed wiring board of the present embodiment. In FIG. 2, the top view of the printed wiring board of this embodiment is shown. In FIG. 2, the structure of the insulating layer and the power supply layer, which are the main parts of the present invention, is shown, and the ground layer is not shown.

図1(a)および図1(b)に示すように、第1の実施形態のプリント配線板は、電源(不図示)を有する電源層6と、電源層6に対向して配置されて電源を接地するためのグランド層(接地層)7と、これら電源層6とグランド層7との間に配置される絶縁層8とを備え、いわゆる多層プリント基板として構成されている。   As shown in FIGS. 1 (a) and 1 (b), the printed wiring board of the first embodiment is provided with a power supply layer 6 having a power supply (not shown) and a power supply layer 6 facing the power supply layer 6. A ground layer (ground layer) 7 for grounding and an insulating layer 8 disposed between the power supply layer 6 and the ground layer 7 are configured as a so-called multilayer printed board.

また、このプリント配線板には、ディジタル回路11およびアナログ回路12が実装されており、電源層6が、直流的に互いに独立した電源を有するディジタル回路用の電源層6aと、アナログ回路用の電源層6bとに分割されている。   In addition, a digital circuit 11 and an analog circuit 12 are mounted on the printed wiring board, and the power supply layer 6 includes a power supply layer 6a for a digital circuit having power supplies independent of each other in terms of DC, and a power supply for an analog circuit. Divided into layers 6b.

ディジタル回路用の電源層6aおよびアナログ回路用の電源層6bは矩形状にそれぞれ形成されており、主面の四隅のコーナ部に、後述する電源デカップリングコンデンサがそれぞれ配置されている。また、各電源層6a,6b上には、図示しないが、各電源に電気的に接続された信号配線層が設けられている。   The power supply layer 6a for the digital circuit and the power supply layer 6b for the analog circuit are each formed in a rectangular shape, and power supply decoupling capacitors (to be described later) are arranged at the corners of the four corners of the main surface. On each power supply layer 6a, 6b, although not shown, a signal wiring layer electrically connected to each power supply is provided.

絶縁層8は、図2に示すように、各電源層6a,6bにそれぞれ対応する位置に、ディジタル回路用の絶縁層8aと、アナログ回路用の絶縁層8bとに分割されて配置されている。   As shown in FIG. 2, the insulating layer 8 is divided into a digital circuit insulating layer 8a and an analog circuit insulating layer 8b at positions corresponding to the power supply layers 6a and 6b. .

そして、本実施形態のプリント配線板では、ディジタル回路用の絶縁層8aの誘電率が、アナログ回路用の絶縁層8bの誘電率よりも小さく形成されている。具体的には、絶縁層8a,8bからなる絶縁層は、異なる誘電率を有するそれぞれ単一の絶縁体が、プリント配線板上で、複数種が組み合わされた構成からなる。   In the printed wiring board of this embodiment, the dielectric constant of the insulating layer 8a for digital circuits is smaller than the dielectric constant of the insulating layer 8b for analog circuits. Specifically, the insulating layer composed of the insulating layers 8a and 8b has a configuration in which a plurality of types of single insulators having different dielectric constants are combined on a printed wiring board.

以上のように構成された実施形態のプリント配線板について、ディジタル回路11によるノイズがアナログ回路12に及ぼす影響が抑制される作用について説明する。   With respect to the printed wiring board according to the embodiment configured as described above, an operation of suppressing the influence of noise caused by the digital circuit 11 on the analog circuit 12 will be described.

(作用)
電磁波の波長λに対して、伝搬距離rが大きくなる条件、つまり遠方界においては、電界強度Eは、次式で表される。
(Function)
In a condition where the propagation distance r is larger with respect to the wavelength λ of the electromagnetic wave, that is, in the far field, the electric field strength E is expressed by

Figure 0004992394
Figure 0004992394

ここに、Hは磁界強度、μは透磁率、εは誘電率、μSは比透磁率、εSは比誘電率とする。 Here, H is the magnetic field strength, μ is the magnetic permeability, ε is the dielectric constant, μ S is the relative magnetic permeability, and ε S is the relative dielectric constant.

ここで、ディジタル回路の電源層とグランド層との間の絶縁体における比誘電率をεDとし、アナログ回路の電源層とグランド層との間の絶縁体における比誘電率をεAとするとき、双方の絶縁体の比透磁率を1とした場合に、ディジタル回路における電源層とグランド層との間の電界強度をED、磁界強度をHA、アナログ回路における電源層とグランド層との間の電界強度をEA、磁界強度をHAとすると、それぞれの電源層とグランド層との間における電界強度は(式1)より、次式で表される。 Here, when the relative permittivity of the insulator between the power supply layer and the ground layer of the digital circuit is ε D and the relative permittivity of the insulator between the power supply layer and the ground layer of the analog circuit is ε A When the relative permeability of both insulators is 1, the electric field strength between the power supply layer and the ground layer in the digital circuit is E D , the magnetic field strength is H A , and the power supply layer and the ground layer in the analog circuit are the electric field intensity E a between, the magnetic field strength and H a, the electric field strength between the respective power supply layer and a ground layer than (equation 1), is expressed by the following equation.

Figure 0004992394
Figure 0004992394

Figure 0004992394
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(式1)および(式2)より、比誘電率εDとεAを変えることで、電界強度と磁界強度の比、つまりは空間インピーダンスが変化することがわかる。また、本発明の特徴である、比誘電率εD、εAの関係をεD<εAに規定することで、ディジタル回路における電源層とグランド層との間の空間インピーダンスがアナログ回路におけるその空間インピーダンスよりも高くなることがわかる。 From (Equation 1) and (Equation 2), it can be seen that the ratio of the electric field strength to the magnetic field strength, that is, the spatial impedance is changed by changing the relative permittivity ε D and ε A. Further, by defining the relationship between the relative dielectric constants ε D and ε A , which is a feature of the present invention, as ε DA , the spatial impedance between the power supply layer and the ground layer in the digital circuit is the same as that in the analog circuit. It can be seen that it is higher than the spatial impedance.

また、誘電率を変えることによる影響は、電界強度に大きく現れるので、上式を比較すると、電界強度ED、EAの関係はED>EAと表すことができる。 Moreover, since the influence by changing the dielectric constant appears greatly in the electric field strength, the relationship between the electric field strengths E D and E A can be expressed as E D > E A when the above equations are compared.

ここで、次式の(式4)により、電界強度Eと電圧Vの関係が示されるが、電源層とグランド層との間の距離dに変化がなければ、電源層とグランド層との間の電圧Vは、上述のディジタル回路の電源電圧に比べてアナログ回路の電源電圧が低くなることが導かれる。   Here, the relationship between the electric field intensity E and the voltage V is shown by the following equation (Equation 4). If there is no change in the distance d between the power supply layer and the ground layer, the relationship between the power supply layer and the ground layer is shown. It is derived that the power supply voltage of the analog circuit is lower than the power supply voltage of the digital circuit described above.

Figure 0004992394
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一方で、電磁波の波長λに対して、伝搬距離rが十分に小さい距離である、つまりは低周波を対象として、この極限状態として考えられる直流の場合には、(式1)が成り立たず、誘電率εを変えたとしても、その両端の電圧には影響を及ぼさない。   On the other hand, when the propagation distance r is a sufficiently small distance with respect to the wavelength λ of the electromagnetic wave, that is, in the case of direct current that can be considered as this extreme state for low frequencies, (Equation 1) does not hold, Even if the dielectric constant ε is changed, the voltage across the both ends is not affected.

これは丁度、コンデンサの両端に電圧をかけた場合に、直流では電圧の低減は起こらず、高周波では電圧の低減が発生することからも容易に理解できる。   This can be easily understood from the fact that when a voltage is applied across the capacitor, the voltage does not decrease at DC and the voltage decreases at high frequency.

したがって、2つの異なる電源層を、それぞれ異なる誘電率の材料からなる絶縁層を介してグランド層に対向して配置する構造とすることによって、それぞれの電源層とグランド層との間に挟まれた絶縁体の中にある空間インピーダンスには違いが生じる。   Therefore, two different power supply layers are sandwiched between the power supply layer and the ground layer by arranging the two power supply layers so as to face the ground layer via insulating layers made of materials having different dielectric constants. There is a difference in the spatial impedance in the insulator.

結果として、電界強度に違いが生じることで、電源層とグランド層との間の高周波電圧には違いが生じるものの、直流電圧には影響を及ぼさずに、作用としては、所望の直流電源を供給しながら、高周波ノイズの伝搬を制御することが可能となる。   As a result, the difference in electric field strength causes a difference in the high-frequency voltage between the power supply layer and the ground layer, but it does not affect the DC voltage, but as a function, it supplies the desired DC power supply. However, the propagation of high frequency noise can be controlled.

上述したように、本実施形態のプリント配線板によれば、ディジタル回路11における絶縁層8aの誘電率を、アナログ回路12における絶縁層8bの誘電率に比べて小さくすることで、ディジタル回路11の電源に発生している電磁ノイズが、アナログ回路12の電源に伝わるのを抑えることができる。すなわち、本実施形態によれば、ディジタル回路11の電源からアナログ回路12の電源に伝わる電磁ノイズを低減することができる。   As described above, according to the printed wiring board of the present embodiment, the dielectric constant of the insulating layer 8 a in the digital circuit 11 is made smaller than the dielectric constant of the insulating layer 8 b in the analog circuit 12. Electromagnetic noise generated in the power supply can be prevented from being transmitted to the power supply of the analog circuit 12. That is, according to the present embodiment, electromagnetic noise transmitted from the power supply of the digital circuit 11 to the power supply of the analog circuit 12 can be reduced.

したがって、本実施形態によれば、ディジタル回路11がアナログ回路12に干渉するのを抑えるために特別に配慮することなく設計することが可能になり、プリント配線板の設計の自由度を確保することができる。   Therefore, according to the present embodiment, the digital circuit 11 can be designed without special consideration to suppress interference with the analog circuit 12, and the degree of freedom in designing the printed wiring board can be ensured. Can do.

(他の実施形態)
他の実施形態において、上述した実施形態と同一部材には同一符号を付して説明を省略する。図3に、図2と同様の方向から他の実施形態を示す。
(Other embodiments)
In other embodiments, the same members as those in the above-described embodiments are denoted by the same reference numerals and description thereof is omitted. FIG. 3 shows another embodiment from the same direction as FIG.

図3に示すように、本実施形態のプリント配線板では、アナログ回路12がプリント配線板の主面上の角部に偏って配置されている点が、上述の実施形態と異なっている。   As shown in FIG. 3, the printed wiring board of the present embodiment is different from the above-described embodiment in that the analog circuit 12 is arranged so as to be biased to the corners on the main surface of the printed wiring board.

そして、本実施形態のプリント配線板も、上述の実施形態と同様に、ディジタル回路用の絶縁層8aの誘電率が、アナログ回路用の絶縁層8bの誘電率よりも小さくされている。具体的には、絶縁層は、異なる誘電率を有するそれぞれ単一の絶縁体が、プリント配線板上で、複数種が組み合わされてなる。   Also in the printed wiring board of the present embodiment, the dielectric constant of the insulating layer 8a for digital circuits is made smaller than the dielectric constant of the insulating layer 8b for analog circuits, as in the above-described embodiment. Specifically, the insulating layer is formed by combining a plurality of types of single insulators having different dielectric constants on a printed wiring board.

なお、本実施形態と同様に、アナログ回路用の電源層と、ディジタル回路用の電源層とが分離して配置される構成であれば、図2および図3に示した形態にかかわらず、他の配置が採られてもよく、それぞれの電源層に対応する各絶縁層が、電磁ノイズを分離したい領域毎に分割されていればよい。   As in the present embodiment, the power supply layer for the analog circuit and the power supply layer for the digital circuit are separated from each other regardless of the form shown in FIGS. This arrangement may be adopted as long as each insulating layer corresponding to each power supply layer is divided for each region where electromagnetic noise is desired to be separated.

また、図1、図2、図3に示したアナログ回路用の電源層6bが、アナログ回路の代わりに、ディジタル回路用の電源層6aでの供給電圧と異なる供給電圧を持ったディジタル回路用の電源層であってもよく、特に一方のディジタル回路が比較的に高電圧であり、他方のディジタル回路が比較的に低電圧である場合(他方の回路が一方の回路よりも電磁ノイズの影響を受けやすいとき)には、絶縁層8aの誘電率を絶縁層8bの誘電率よりも小さくし、図中の電源層6aを高電圧用の電源層、電源層6bを低電圧用の電源層としても、電磁ノイズの干渉を低減するという効果が得られる。   Further, the analog circuit power supply layer 6b shown in FIGS. 1, 2 and 3 is used for a digital circuit having a supply voltage different from the supply voltage of the digital circuit power supply layer 6a instead of the analog circuit. It may be a power supply layer, especially when one digital circuit has a relatively high voltage and the other digital circuit has a relatively low voltage (the other circuit is more susceptible to electromagnetic noise than one circuit). When it is easy to receive), the dielectric constant of the insulating layer 8a is made smaller than the dielectric constant of the insulating layer 8b, and the power supply layer 6a in the figure is used as a high voltage power supply layer and the power supply layer 6b is used as a low voltage power supply layer. However, the effect of reducing the interference of electromagnetic noise can be obtained.

なお、上述した実施形態のプリント配線板では、2つの電源層を備える構成に適用されたが、直流的に独立した更に他の電源層を備える構成に適用されてもよいことは勿論である。このような構成の場合、特に他の電源回路からの電磁干渉を低く抑えたい任意の電源層に対応する絶縁層の誘電率が最も大きく設定され、残りの電源層に対応する絶縁層の誘電率が小さく設定される。また、このとき、残りの複数の電源層も同様に、絶縁層の誘電率が順に小さくなるように異ならして設定されてもよい。   Note that the printed wiring board of the above-described embodiment is applied to a configuration including two power supply layers, but may be applied to a configuration including another power supply layer independent of DC. In such a configuration, the dielectric constant of the insulating layer corresponding to any power supply layer where the electromagnetic interference from other power supply circuits is to be kept low is set to be the highest, and the dielectric constant of the insulating layer corresponding to the remaining power supply layers is set. Is set smaller. At this time, the remaining plurality of power supply layers may also be set differently so that the dielectric constant of the insulating layer sequentially decreases.

同様に、実施形態のプリント配線基板は、電源層の近傍に信号配線が設けられた構成の場合、この信号配線からの電磁干渉を低減したい任意の電源層に対応する絶縁層の誘電率が最も大きく設定され、残りの電源層に対応する絶縁層の誘電率が小さく設定される。また、このとき、残りの複数の電源層も同様に、絶縁層の誘電率が順に小さくなるように異ならして設定されてもよい。   Similarly, when the printed wiring board of the embodiment has a configuration in which signal wiring is provided in the vicinity of the power supply layer, the dielectric constant of the insulating layer corresponding to an arbitrary power supply layer for which electromagnetic interference from the signal wiring is to be reduced is the highest. The dielectric constant of the insulating layer corresponding to the remaining power supply layer is set small. At this time, the remaining plurality of power supply layers may also be set differently so that the dielectric constant of the insulating layer sequentially decreases.

また、上述した実施形態では、ディジタル回路とアナログ回路とに電源層が分割された構成が採られたが、基本周波数が異なる複数のアナログ回路のそれぞれに対応して設けられた電源層毎に分割された構成や、動作電圧が異なるディジタル回路のそれぞれに対応して設けられた電源層毎に分割される構成が用いられてもよい。   In the above-described embodiment, the power supply layer is divided into the digital circuit and the analog circuit. However, the power supply layer is divided for each power supply layer provided corresponding to each of the plurality of analog circuits having different fundamental frequencies. Alternatively, a configuration that is divided for each power supply layer provided corresponding to each of digital circuits having different operating voltages may be used.

続いて、更に具体的な実施例として、第1の実施例におけるノイズを低減する効果について、電界強度レベルの計算結果を参照して説明する。   Subsequently, as a more specific embodiment, the effect of reducing noise in the first embodiment will be described with reference to the calculation result of the electric field strength level.

図4は、ディジタル回路で発生したノイズがアナログ回路にどのような影響を与えるかについて、実施例と従来例を比較して説明するための図である。図4(a)に従来例における電界強度レベルの平面分布の結果を示し、図4(b)に実施例における電界強度レベルの平面分布の結果を示している。図4(a),図4(b)には、電界強度レベルの平面分布を等高線で示しており、電界レベルが高くなるほど濃度が薄い色(白色)で示し、電界レベルが低くなるほど濃度が濃い色(黒色)で示している。図4(c),図4(d)に、実施例のプリント配線板の計算モデルを示している。なお、図4(a),図4(b)に示す電界強度レベルの平面分布は、図4(c),図4(d)に示す配置条件で、代表例として900MHzの周波数で給電した場合に電磁界シミュレーションで計算した結果である。   FIG. 4 is a diagram for explaining how the noise generated in the digital circuit affects the analog circuit in comparison with the embodiment and the conventional example. FIG. 4A shows the result of the planar distribution of the electric field strength level in the conventional example, and FIG. 4B shows the result of the planar distribution of the electric field strength level in the example. 4 (a) and 4 (b), the planar distribution of the electric field intensity level is shown by contour lines, and the density is shown in lighter color (white) as the electric field level is higher, and the density is higher as the electric field level is lower. The color (black) is shown. FIG. 4C and FIG. 4D show calculation models of the printed wiring board of the example. The planar distribution of the electric field intensity levels shown in FIGS. 4 (a) and 4 (b) is a case where power is supplied at a frequency of 900 MHz as a representative example under the arrangement conditions shown in FIGS. 4 (c) and 4 (d). It is the result calculated by electromagnetic field simulation.

図4(c),図4(d)に示すように、プリント配線板には、ディジタル回路用の電源層6aおよびアナログ回路用の電源層6bと、グランド層7との間に絶縁層6a、6bがそれぞれ配置されている。   As shown in FIGS. 4C and 4D, the printed wiring board includes an insulating layer 6a between the power layer 6a for the digital circuit and the power layer 6b for the analog circuit and the ground layer 7. 6b are respectively arranged.

また、プリント配線板は、各電源層6a、6aとグランド層7との間には、一般的に用いられる電源デカップリングコンデンサ15が4隅にそれぞれ配置されている。また、ノイズ源16が、ディジタル回路11における電源層6aとグランド層7との間に配置し、このノイズがアナログ回路12における電源層6bとグランド層7との間に伝搬する状態を、電源層6a、6bとグランド層7との中間地点での電界強度として電磁界シミュレーションによる計算を行った。   Further, in the printed wiring board, generally used power supply decoupling capacitors 15 are arranged at four corners between the power supply layers 6a and 6a and the ground layer 7, respectively. In addition, the noise source 16 is disposed between the power supply layer 6 a and the ground layer 7 in the digital circuit 11, and the state in which this noise propagates between the power supply layer 6 b and the ground layer 7 in the analog circuit 12 is represented by the power supply layer. Calculation by electromagnetic field simulation was performed as the electric field strength at the intermediate point between 6a and 6b and the ground layer 7.

従来例の構成では、図4(a)に示すように、ディジタル回路における絶縁層の比誘電率εDを「4」に設定し、アナログ回路における絶縁層の比誘電率εAも「4」に設定している。つまり、従来例として、ディジタル回路およびアナログ回路の各絶縁層に同一材料をそれぞれ用いた構成における結果を示している。 In the configuration of the conventional example, as shown in FIG. 4A, the dielectric constant ε D of the insulating layer in the digital circuit is set to “4”, and the dielectric constant ε A of the insulating layer in the analog circuit is also “4”. Is set. That is, as a conventional example, a result in a configuration in which the same material is used for each insulating layer of a digital circuit and an analog circuit is shown.

一方、本実施例による電界強度分布は、図4(b)に示すように、ディジタル回路における絶縁層8aの比誘電率εDを「4」に設定し、アナログ回路の絶縁層8bにおける比誘電率εAを「10」に設定している。すなわち、本実施例では、本発明の特徴であるεD<εAの関係を満たしている。 On the other hand, as shown in FIG. 4B, the electric field intensity distribution according to this example is set such that the relative dielectric constant ε D of the insulating layer 8a in the digital circuit is set to “4” and the relative dielectric constant in the insulating layer 8b of the analog circuit. The rate ε A is set to “10”. That is, in this embodiment, the relationship of ε DA that is a feature of the present invention is satisfied.

図4(a)、(b)に示す結果の比較から明らかなように、図4(a)、(b)中の右側の白線囲み部分に示したアナログ回路12における電源層6bとグランド層7との間の電界強度が低減され、(式4)を参照して説明したように、結果として、電源ノイズの電圧を低減することができた。   As is clear from the comparison of the results shown in FIGS. 4A and 4B, the power supply layer 6b and the ground layer 7 in the analog circuit 12 shown in the white line encircled portion on the right side in FIGS. 4A and 4B. As described with reference to (Equation 4), the voltage of the power supply noise can be reduced as a result.

次に、第2の実施例として、プリント配線板に近接して配置された配線にノイズ源が接続されている構成について、ノイズを低減する効果について説明する。   Next, as a second embodiment, an effect of reducing noise will be described for a configuration in which a noise source is connected to a wiring arranged close to a printed wiring board.

図5は、図4と同様であるが、電源層に近接して配置された配線に流れる電流をノイズと見なし、その影響の度合いを、実施例と従来例とで比較して説明するための図である。図5(a)に従来例における電界強度レベルの平面分布の結果を示し、図5(b)に実施例における電界強度レベルの平面分布の結果を示している。図5(c),図5(d)に、実施例のプリント配線板の計算モデルを示している。なお、図5(a),図5(b)に示す電界強度レベルの平面分布は、図5(c),図5(d)に示す配置条件で、代表例として900MHzの周波数で給電した場合に電磁界シミュレーションで計算した結果である。   FIG. 5 is the same as FIG. 4 except that the current flowing in the wiring arranged close to the power supply layer is regarded as noise, and the degree of the influence is compared between the example and the conventional example. FIG. FIG. 5A shows the result of the planar distribution of the electric field intensity level in the conventional example, and FIG. 5B shows the result of the planar distribution of the electric field intensity level in the example. FIG. 5C and FIG. 5D show calculation models of the printed wiring board of the example. The planar distribution of the electric field intensity levels shown in FIGS. 5 (a) and 5 (b) is a case where power is supplied at a frequency of 900 MHz as a representative example under the arrangement conditions shown in FIGS. 5 (c) and 5 (d). It is the result calculated by electromagnetic field simulation.

図5(c),図5(d)に示すように、プリント配線板の電源層には、ノイズ源16が接続されている配線17が近接して配置されている。   As shown in FIGS. 5C and 5D, the wiring 17 to which the noise source 16 is connected is disposed close to the power supply layer of the printed wiring board.

従来例では、図5(a)に示すように、ディジタル回路における電源層とグランド層との間に生じる電界強度と、アナログ回路における電源層とグランド層との間に生じる電界強度とに差はない。   In the conventional example, as shown in FIG. 5A, there is a difference between the electric field intensity generated between the power supply layer and the ground layer in the digital circuit and the electric field intensity generated between the power supply layer and the ground layer in the analog circuit. Absent.

一方、本実施例は、図5(b)に示すように、アナログ回路12における電源層6bとグランド層7との間の電界強度が明らかに低減されており、図5(a)に示した従来例と比べて明らかに改善している。また、ディジタル回路11における電源層6aとグランド層7との間の電界強度のレベルも若干ではあるが、低減された。このように、本実施例によれば、微弱な信号を扱っているアナログ回路12への電源ノイズの結合を抑制することができた。   On the other hand, in this embodiment, as shown in FIG. 5 (b), the electric field strength between the power supply layer 6b and the ground layer 7 in the analog circuit 12 is clearly reduced, as shown in FIG. 5 (a). It is clearly improved compared to the conventional example. In addition, the level of the electric field strength between the power supply layer 6a and the ground layer 7 in the digital circuit 11 is slightly reduced. Thus, according to the present embodiment, it was possible to suppress the coupling of power supply noise to the analog circuit 12 handling a weak signal.

上述したように、プリント配線板に近接して配置された配線17からノイズが結合すると考えられる場合に、本実施例の構成を採ることで、配線17による電源ノイズの結合が抑えられ、配線17によるアナログ回路12への影響を低減し、従来例と比較して、改善が図られた。   As described above, when it is considered that noise is coupled from the wiring 17 arranged close to the printed wiring board, the configuration of the present embodiment is adopted, so that the coupling of the power supply noise by the wiring 17 is suppressed, and the wiring 17 As a result, the influence on the analog circuit 12 is reduced and an improvement is achieved as compared with the conventional example.

これは特に、微弱な信号を扱うアナログ回路において、配線17等の外部からのノイズの侵入を抑え、アナログ回路の安定動作、つまりはS/N比(信号対雑音比)を高く保つことを目的とした場合に効果的である。   In particular, in an analog circuit that handles a weak signal, the purpose is to suppress the intrusion of noise from the outside such as the wiring 17 and to maintain a stable operation of the analog circuit, that is, a high S / N ratio (signal to noise ratio). Is effective.

なお、上述した実施形態の多層構造のプリント配線板では、電源層6a,6bとグランド層7、絶縁層8a,8bを備える構成として説明したが、実際には更に信号配線層を備えて構成される4層からなるプリント配線板を想定しており、このような構成でも同様の効果が得られる。   Although the multilayer printed wiring board according to the above-described embodiment has been described as having the power supply layers 6a and 6b, the ground layer 7, and the insulating layers 8a and 8b, it is actually configured to further include a signal wiring layer. A four-layer printed wiring board is assumed, and the same effect can be obtained even with such a configuration.

ただし、電源層とグランド層との関係についてのこれまでの説明は、更に他の層を有する多層プリント配線板にも適用でき、また、電源層と信号配線層が1つの層に混在する2層基板(両面基板)にも適用できることは、勿論である。   However, the description so far regarding the relationship between the power supply layer and the ground layer can also be applied to a multilayer printed wiring board having other layers, and two layers in which the power supply layer and the signal wiring layer are mixed in one layer. Of course, the present invention can also be applied to a substrate (double-sided substrate).

なお、本発明に係るプリント配線板は、例えば、微弱信号を扱うアナログ回路と、一般のディジタル回路とが混載される構成に適用されるが、ディジタル回路、アナログ回路に限らず、高電圧回路と低電圧回路が混載されるプリント配線板での利用にも適している。また、本発明に係るプリント配線板は、例えば無線、有線の通信機器などの、信号対雑音比(S/N比)の改善が性能に影響を及ぼす電子機器に用いられて好適である。   The printed wiring board according to the present invention is applied to, for example, a configuration in which an analog circuit that handles a weak signal and a general digital circuit are mixedly mounted. It is also suitable for use with printed wiring boards in which low-voltage circuits are mounted. Moreover, the printed wiring board according to the present invention is suitable for use in electronic devices such as wireless and wired communication devices, where improvement in signal-to-noise ratio (S / N ratio) affects performance.

本実施形態のプリント配線板の層構成を説明するために示す模式図である。It is a schematic diagram shown in order to demonstrate the layer structure of the printed wiring board of this embodiment. 本実施形態のプリント配線板における各電源層と各絶縁層の対応を示す模式図である。It is a schematic diagram which shows a response | compatibility of each power supply layer and each insulating layer in the printed wiring board of this embodiment. 他の実施形態のプリント配線板における各電源層と各絶縁層の構成を示す模式図である。It is a schematic diagram which shows the structure of each power supply layer and each insulating layer in the printed wiring board of other embodiment. ディジタル回路がアナログ回路に干渉して生じるノイズを低減する効果を説明するための図である。It is a figure for demonstrating the effect which reduces the noise produced when a digital circuit interferes with an analog circuit. 電源層に近接する位置に配置された配線による影響を低減する効果を説明するための図である。It is a figure for demonstrating the effect which reduces the influence by the wiring arrange | positioned in the position close | similar to a power supply layer.

符号の説明Explanation of symbols

6a ディジタル回路の電源層
6b アナログ回路用の電源層
7 グランド層
8a ディジタル回路の絶縁層
8b アナログ回路用の絶縁層
11 ディジタル回路
12 アナログ回路
15 電源デカップリングコンデンサ
16 ノイズ源
17 配線
6a Power supply layer for digital circuit 6b Power supply layer for analog circuit 7 Ground layer 8a Insulation layer for digital circuit 8b Insulation layer for analog circuit 11 Digital circuit 12 Analog circuit 15 Power supply decoupling capacitor 16 Noise source 17 Wiring

Claims (4)

直流的に独立した複数の電源層と、前記電源層に対向して配置されたグランド層と、前記電源層と前記グランド層との間に前記各電源層にそれぞれ対応して設けられた複数の絶縁層とを備え、
複数の前記絶縁層のうち、他の電源層からの電磁干渉を低く抑えたい任意の電源層に対応する絶縁層の誘電率が、前記他の電源層に対応する絶縁層よりも大きいことを特徴とするプリント配線板。
A plurality of power supply layers independent in direct current, a ground layer disposed to face the power supply layer, and a plurality of power supply layers provided corresponding to the power supply layers between the power supply layer and the ground layer, respectively. With an insulating layer,
Among the plurality of insulating layers, the dielectric constant of an insulating layer corresponding to an arbitrary power source layer for which electromagnetic interference from other power source layers is desired to be low is larger than that of the insulating layer corresponding to the other power source layer. Printed wiring board.
複数の前記絶縁層は、前記任意の電源層に対応する前記絶縁層から順に誘電率が小さくされている請求項1に記載のプリント配線板。 A plurality of said insulating layer, a printed wiring board as set forth in the insulating layer corresponding to the arbitrary power layer to claim 1 having a dielectric constant in the order is small. 複数の前記絶縁層は、前記任意の電源層に対応する前記絶縁層のみが、他の前記絶縁層よりも誘電率が大きくされている請求項1に記載のプリント配線板。 The plurality of the insulating layer, wherein only the insulating layer, the printed wiring board according to claim 1, the dielectric constant is larger than the other of the insulating layer corresponding to the arbitrary power layer. 複数の前記電源層は、ディジタル回路用の電源層と、アナログ回路用の電源層とを有する請求項1ないし3のいずれか1項に記載のプリント配線板。   The printed wiring board according to any one of claims 1 to 3, wherein the plurality of power supply layers include a power supply layer for a digital circuit and a power supply layer for an analog circuit.
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