JP4911355B2 - テストシステム - Google Patents
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被試験対象を試験するテストシステムにおいて、
前記被試験対象に電気的に接続すると共に、場所を特定するための場所情報回路が少なくとも1つ設けられるプローブカードと、
このプローブカードと電気的に接続し、前記場所情報回路と電気的に接続するICテスタと
を備え、前記ICテスタは、前記場所情報回路により、前記プローブカードの方向を検出することを特徴とするものである。
請求項2記載の発明は、請求項1記載の発明であって、
場所情報回路が場所を示す抵抗値を有する抵抗であることを特徴とするものである。
請求項3記載の発明は、請求項1または2記載の発明であって、
プローブカードを自動搬送するプローバを設けたことを特徴とするものである。
R1〜R4 抵抗
2 プローバ
3 テストヘッド
Claims (3)
- 被試験対象を試験するテストシステムにおいて、
前記被試験対象に電気的に接続すると共に、場所を特定するための場所情報回路が少なくとも1つ設けられるプローブカードと、
このプローブカードと電気的に接続し、前記場所情報回路と電気的に接続するICテスタと
を備え、前記ICテスタは、前記場所情報回路により、前記プローブカードの方向を検出することを特徴とするテストシステム。 - 場所情報回路が場所を示す抵抗値を有する抵抗であることを特徴とする請求項1記載のテストシステム。
- プローブカードを自動搬送するプローバを設けたことを特徴とする請求項1または2記載のテストシステム。
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JP2007138580A JP4911355B2 (ja) | 2007-05-25 | 2007-05-25 | テストシステム |
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JP2008292332A JP2008292332A (ja) | 2008-12-04 |
JP4911355B2 true JP4911355B2 (ja) | 2012-04-04 |
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