JP4734450B2 - 認証モジュール、電子機器及びインタリーブ信号の復元方法 - Google Patents
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Description
(リモコン装置の構成)
(テレビジョン受信機の構成)
本実施形態のテレビジョン受信機10は、リモコン装置20から送信された無線電波に乗ったインタリーブ信号を復元する機能を有するものであり、図1の例では、無線信号受信部11、認証モジュール12、コマンド実行部13、制御対象部14等を備えている。
10 テレビジョン受信機(インタリーブ信号受信機)
11 無線信号受信部
12 認証モジュール
121 共通復元部(復元モジュール)
121a メモリ部(メモリ手段)
121b メモリアクセス制御部(メモリアクセス制御手段)
122 エラー判定部(エラー判定手段)
122a 信号フォーマット(A)用のエラー判定部
122b 信号フォーマット(B)用のエラー判定部
123 ID判定部(ID判定手段)
123a 信号フォーマット(A)用のID判定部
123b 信号フォーマット(B)用のID判定部
124 コマンド判定部(コマンド判定手段)
125 レジスタ
13 コマンド実行部
14 制御対象部
141 表示部
142 音声出力部
143 電源部
20 リモコン装置(インタリーブ信号送信機)
21 操作入力部
22 環境検知部
23 インタリーブ信号生成部
24 無線信号送信部
25 電源部
Claims (9)
- 入力されたインタリーブ信号を構成する各構成データの書き込み及び読み出しが行われるメモリ手段と、
前記インタリーブ信号が入力された場合、当該入力されたインタリーブ信号の各構成データを、前記インタリーブ信号の異なる信号フォーマット間で共通に設定されている特定の書き込み順のアドレス情報に従って前記メモリ手段に順次書き込む処理を行うとともに、前記メモリ手段に書き込まれた各構成データを、前記異なる信号フォーマット間で共通に設定されている特定の読み出し順のアドレス情報に従って前記メモリ手段から順次読み出す処理を行い、前記読み出し処理により読み出した複数の構成データを復元信号として出力する制御を行うメモリアクセス制御手段と、
を備えたことを特徴とする認証モジュール。 - 前記メモリ手段は、1ビット単位の前記各構成データを記憶する1ビット単位のメモリセルを行と列の2次元格子状に配置して構成されており、
前記メモリアクセス制御手段は、
前記入力されたインタリーブ信号の各構成データを、所定数の構成データ毎に、前記行又は列のいずれか一方向の所定数のメモリセル単位で順次書き込む処理を繰り返し行い、
全ての構成データの書き込みが終了した後、前記メモリセルに書き込まれた各構成データを、前記一方向とは異なる他方向の所定数のメモリセル単位で順次読み出す処理を繰り返し行うことを特徴とする請求項1に記載の認証モジュール。 - 前記複数種類のインタリーブ信号は、インタリーブされる前の信号を、異なる信号フォーマット間で共通に設定されている特定のデータ並び替え規則に従って並び替えされた信号であることを特徴とする請求項1又は2に記載の認証モジュール。
- 復元モジュールから出力された復元信号を入力した場合、所定のレジスタ手段の設定に基づき、当該入力した復元信号に対して前記信号フォーマット別のエラー判定処理を実行するエラー判定手段と、
前記エラー判定手段の判定により、正しいデータが得られたと判定された場合、前記レジスタ手段の設定に基づき、前記復元信号に含まれるIDデータに対して前記信号フォーマット別のID判定処理を実行するID判定手段と、
前記ID判定手段の判定により、正規のIDであると判定された場合、前記復元信号に含まれるコマンドデータに対してコマンド判定処理を実行するコマンド判定手段と、
を更に有することを特徴とする請求項1〜3のいずれか一項に記載の認証モジュール。 - 入力されたインタリーブ信号を構成する各構成データの書き込み及び読み出しが行われるメモリ手段と、
前記インタリーブ信号が入力された場合、当該入力されたインタリーブ信号の各構成データを、前記インタリーブ信号の異なる信号フォーマット間で共通に設定されている特定の書き込み順のアドレス情報に従って前記メモリ手段に順次書き込む処理を行うとともに、前記メモリ手段に書き込まれた各構成データを、前記異なる信号フォーマット間で共通に設定されている特定の読み出し順のアドレス情報に従って前記メモリ手段から順次読み出す処理を行い、前記読み出し処理により読み出した複数の構成データを復元信号として出力する制御を行うメモリアクセス制御手段と、
を備えた認証モジュールと、
前記認証モジュールから出力される信号に基づいて制御される制御対象部と、
を備えたことを特徴とする電子機器。 - 前記メモリ手段は、1ビット単位の前記各構成データを記憶する1ビット単位のメモリセルを行と列の2次元格子状に配置して構成されており、
前記メモリアクセス制御手段は、
前記入力されたインタリーブ信号の各構成データを、所定数の構成データ毎に、前記行又は列のいずれか一方向の所定数のメモリセル単位で順次書き込む処理を繰り返し行い、
全ての構成データの書き込みが終了した後、前記メモリセルに書き込まれた各構成データを、前記一方向とは異なる他方向の所定数のメモリセル単位で順次読み出す処理を繰り返し行うことを特徴とする請求項5に記載の電子機器。 - 前記複数種類のインタリーブ信号は、インタリーブされる前の信号を、異なる信号フォーマット間で共通に設定されている特定のデータ並び替え規則に従って並び替えされた信号であることを特徴とする請求項5又は6に記載の電子機器。
- 復元モジュールから出力された復元信号を入力した場合、所定のレジスタ手段の設定に基づき、当該入力した復元信号に対して前記信号フォーマット別のエラー判定処理を実行するエラー判定手段と、
前記エラー判定手段の判定により、正しいデータが得られたと判定された場合、前記レジスタ手段の設定に基づき、前記復元信号に含まれるIDデータに対して前記信号フォーマット別のID判定処理を実行するID判定手段と、
前記ID判定手段の判定により、正規のIDであると判定された場合、前記復元信号に含まれるコマンドデータに対してコマンド判定処理を実行するコマンド判定手段と、
を更に有することを特徴とする請求項5〜7のいずれか一項に記載の電子機器。 - 入力されたインタリーブ信号を復元する処理を行う認証モジュールで実行されるインタリーブ復元方法であって、
前記認証モジュールは、
無線信号受信部で受信した無線電波から抽出されたインタリーブ信号を構成する各構成データを記憶するメモリ手段と、前記メモリ手段に対する前記構成データの書き込み及び読み出しを行うメモリアクセス制御手段を備え、
前記認証モジュールが、前記無線信号受信部を介して前記インタリーブ信号を入力する入力工程と、
メモリアクセス制御手段が、前記入力工程により入力されたインタリーブ信号の各構成データを、前記インタリーブ信号の異なる信号フォーマット間で共通に設定されている特定の書き込み順のアドレス情報に従って前記メモリ手段に順次書き込む処理を行うとともに、前記メモリ手段に書き込まれた各構成データを、前記異なる信号フォーマット間で共通に設定されている特定の読み出し順のアドレス情報に従って前記メモリ手段から順次読み出す処理を行うメモリアクセス制御工程と、
メモリアクセス制御手段が、前記メモリアクセス制御工程により順次読み出された複数の構成データを復元信号として出力する復元信号出力工程と、
を含むことを特徴とするインタリーブ信号の復元方法。
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