JP4681785B2 - アクティブマトリクスエレクトロルミネッセンス表示装置 - Google Patents

アクティブマトリクスエレクトロルミネッセンス表示装置 Download PDF

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Description

【０００１】
(技術分野)
本発明は、エレクトロルミネッセンス表示画素のアレーを具えるアクティブマトリクスエレクトロルミネッセンス表示装置に関するものである。
【０００２】
(背景技術)
エレクトロルミネッセンス発光表示素子を用いるマトリクス表示装置は公知である。表示素子は、例えばポリマ材料を用いる有機薄膜エレクトロルミネッセンス素子、又は伝統的なIII−Ｖ半導体化合物を用いる発光ダイオード（ＬＥＤ）を具えるものとすることができる。有機エレクトロルミネッセンス材料、特にポリマ材料の最近の開発によりこれらの材料はビデオ表示装置に実用可能であることが証明されている。これらの材料は代表的には一対の電極間に挟まれた１以上のエレクトロルミネッセンス材料の層、例えば半導電性共役ポリマの層を具え、一方の電極は透明にし、他方の電極はポリマ層に正孔又は電子を注入するのに好適な材料で形成する。ポリマ材料層はＣＶＤプロセスにより、又は簡単に可溶性共役ポリマの溶液を用いてスピンコーティング技術により製造することができる。
【０００３】
有機エレクトロルミネッセンス材料はダイオードのようなＩ−Ｖ特性を示すため、これらの材料は表示機能とスイッチング機能の両方を提供することができるので、パッシブ形の表示装置に使用することができる。
【０００４】
しかし、本発明は、各画素がエレクトロルミネッセンス（ＥＬ）表示素子と該表示素子を流れる電流を制御するスイッチング装置を具えるアクティブマトリクス表示装置に関する。アクティブマトリクスエレクトロルミネッセンス表示装置の種々の例がＥＰ-Ａ-０６５３７４１及びＥＰ-Ａ-０７１７４４６に開示されている。表示素子が容量性であるために実際上電流を流さず、駆動信号電圧をキャパシタに全フレーム期間に亘って蓄積することができるアクティブマトリクス液晶表示装置と異なり、エレクトロルミネッセンス表示素子は光を発生するためには連続的に電流を流す必要がある。画素の駆動装置は通常ＴＦＴ（薄膜トランジスタ）を具え、表示素子を流れる電流を制御する必要がある。表示素子の輝度はそれを流れる電流により決まる。画素のアドレス期間中に、その画素にその表示素子からの所要の出力を決定する駆動（データ）信号が供給され、その電流制御駆動装置に接続された蓄積キャパシタに蓄積され、キャパシタに蓄積された電圧が電流制御駆動装置の動作を制御して、その画素が再びアドレスされるまで、フレーム期間に相当する期間中スイッチング装置を表示素子に電流を供給する動作状態に維持する。
【０００５】
既知の有機エレクトロルミネッセンス材料、特にポリマ材料に対する問題は、これらの材料は安定性が悪く、エージング効果を被るので、所定の駆動電流に対する光出力が動作期間中に減少する点にある。所定の用途ではこのようなエージング効果は臨界的でないが、画素化表示装置においては画素からの光出力の僅かな変化が観察者に容易に知覚されるのでその結果は重大になり得る。
【０００６】
本発明の目的は、この問題を少なくともある程度克服したアクティブマトリクスエレクトロルミネッセンス表示装置を提供することにある。
【０００７】
(発明の開示)
本発明は、表示画素のアレーを具え、各画素がエレクトロルミネッセンス表示素子と、駆動期間内に該表示素子を流れる電流を、駆動期間前のアドレス期間中に画素に供給され且つ蓄積キャパシタンスに電圧として蓄積された駆動信号に基づいて制御する駆動装置とを具えるアクティブマトリクスエレクトロルミネッセンス表示装置において、各画素が帰還調整手段を含み、該手段が駆動期間における表示素子の両端間の電位差に応答し、それに応じてアドレス期間にキャパシタンスに蓄積された電圧を調整するよう構成されていることを特徴とする。
【０００８】
ＥＬ表示素子は時間の経過とともに劣化するので、そのインピーダンス及びそのアノード−カソード間の電位差が増大する。この電位差の変化の値は表示素子の光出力/駆動電流特性に関して表示素子の状態の正当な指示を与える。従って、アドレス後の表示素子駆動電流を決定する蓄積キャパシタンスに蓄積された電圧を、表示素子の光出力特性を表わす表示素子の両端間の電位差に従って正帰還により調整することによって、表示素子のエージング効果に対する適切な補償を表示素子の駆動において行なうことができるため、所定の供給駆動信号に対する所望の光出力がアレー内の各表示素子の駆動電流レベル/光出力レベル特性の可能な経時変化と無関係に維持される。
【０００９】
本発明は、表示素子がポリマＬＥＤ材料である装置に特に有利であるが、エレクトロルミネッセンス材料が同様にエージング効果を受け、動作期間に亘って所定の駆動電流に対する光出力の低下を生ずる如何なるエレクトロルミネッセンス装置にも有利に適用することができること勿論である。
【００１０】
帰還調整手段内に、アドレス期間において表示素子に電流が流れるのを阻止し次の駆動期間において表示素子に電流を流れさせるスイッチング装置を含めるのが好ましい。このスイッチング装置によれば、アドレス期間の終了時及び駆動期間の開始時における表示素子の両端間の電位が既知のレベル、即ち０ボルトになるとともに、蓄積キャパシタンスへの駆動信号の蓄積が、さもなければこの時点で表示素子を流れる駆動電流により影響されることがなくなる。
【００１１】
好適実施例では、帰還調整手段は駆動期間の開始時における表示素子両端間の過渡電位差増大に応答するようにする。この目的のためには、表示素子に接続され、その両端間の電圧の上昇に応答してこの電圧上昇に応じた出力を発生し、蓄積電圧の調整を制御する高域通過フィルタ回路を用いるのが好都合である。この回路は、その出力で動作し、所定の電位源を蓄積キャパシタンスに接続して補足充電を行なう他のスイッチング装置を含むことができる。
【００１２】
(発明を実施するための最良の形態)
以下、図面を参照して本発明をアクティブマトリクスエレクトロルミネッセンス表示装置の一実施例につき詳細に説明する。各図は略図である。また、各図において同一の符号は同一又は類似の部分を示す。
図１は既知のアクティブマトリクスエレクトロルミネッセンス表示装置の簡略構成図であり、このアクティブマトリクスエレクトロルミネッセンス表示装置はブロック１０で示す等間隔配置の画素の行列マトリクスアレーを有するパネルを具え、各画素は交差する一群の行（選択）及び列（データ）アドレス導体１２及び１４の交点に位置するエレクトロルミネッセンス表示素子及び該表示素子を流れる電流を制御する関連の駆動装置を具える。図を簡単にするために少数の画素のみを示す。画素１０は周辺駆動回路により行及び列アドレス導体を介してアドレスされ、この駆動回路は走査信号を行導体に順々に供給する行（走査）駆動回路１６と、データ信号を列導体に供給しそれぞれの画素の表示素子からの表示出力を決定する列（データ）駆動回路１８を具える。
【００１３】
各画素行は回路１６により該当する行導体１２に供給される選択信号によって各行アドレス期間に順々にアドレスされ、当該行の画素に、回路１８により列導体群に並列に供給されるそれぞれのデータ信号に従ってそれぞれの駆動信号を負荷する。各行がアドレスされるたびに、これに適切に同期して回路１８により適切なデータ信号が供給される。
【００１４】
図２は既知の装置の数個の代表的な画素の回路を示す。各画素１０は１対の電極の間に１以上の有機エレクトロルミネッセンス材料の活性層を挟んでなる発光有機エレクトロルミネッセンス表示素子２０（ここではダイオード素子（ＬＥＤ）として示す）を含む。この特定の実施例では、エレクトロルミネッセンス材料はポリマＬＥＤ材料とするが、他の有機エレクトロルミネッセンス材料、例えば所謂低分子量材料を使用することもできる。アレーの表示素子はアクティブマトリクス回路と一緒に絶縁性支持基板の表面上に支持される。表示素子のカソード又はアノードの何れかが透明導電材料からなる。支持基板はガラスのような透明材料からなり、且つ基板に最も近い表示素子２０の電極はＩＴＯのような透明導電材料からなり、エレクトロルミネッセンス層により発生された光はこれらの電極及び支持基板を透過して支持基板の反対側で観察者が見ることができる。あるいは又、光出力はパネルの上方から見ることもでき、この場合には表示素子のアノードはアレー内の全ての表示素子に共通の供給ラインを構成する連続ＩＴＯ層の一部となる。表示素子のカソードはカルシウム又はマグネシウム銀合金のような低い仕事関数を有する金属で形成する。使用し得る適切な有機共役ポリマ材料の例はＷＯ９６/３６９５９に開示されている。他の低分子量有機材料の例はＥＰ-Ａ-０７１７４４６に記載されている。
【００１５】
各画素１０は、表示素子２０を流れる電流、従って表示素子の動作を画素に供給されるデータ信号電圧に基づいて制御するＴＦＴ２２の形態の駆動装置を含む。各画素の信号電圧は各列の画素に共通の列導体１４から供給される。列導体１４はアドレスＴＦＴ２６を経て電流制御駆動トランジスタ２２のゲートに結合される。一行の画素のアドレスＴＦＴ２６のゲートは共通の行導体１２に結合される。
【００１６】
各行の画素１０は、通常全画素に共通の連続電極として設けられる共通電圧供給ライン３０も共有するとともに、各共通電流ライン３２も共有する。表示素子２０及び駆動装置２２は電圧供給ライン３０と共通電流ライン３２との間に直列に接続され、電流供給ライン３２は電圧供給ライン３０に対し正電位にあり、表示素子２０を流れる電流のための電流ドレインとして作用する。表示素子２０を流れる電流はスイッチング装置２２により制御され、トランジスタ２２のゲート電圧の関数であり、このゲート電圧は列導体１４に供給されるデータ信号により決まる蓄積制御信号に依存する。
【００１７】
行駆動回路１６により選択パルスを各行導体１２に供給して各行の画素のＴＦＴ２６をスイッチオンすることにより各行の画素が各行アドレス期間において選択され、アドレスされる。ビデオ情報から得られた電圧レベルが駆動回路１８により列導体１４に供給され、アドレスＴＦＴ２６により駆動トランジスタ２２のゲートに転送される。各行の画素が行導体１２を介してアドレスされてない期間中、アドレスＴＦＴ２６はターンオフされるが、駆動トランジスタ２２のゲートの電圧は駆動トランジスタ２２のゲートと共通電流ライン３２との間に接続された画素蓄積キャパシタ３６により維持される。駆動トランジスタ２２のゲートと共通電流ライン３２との間の電圧はアドレス期間直後の駆動期間において画素１０の表示素子２０を流れる電流を決定する。従って、表示素子を流れる電流は駆動トランジスタ２２のゲート−ソース電圧の関数になる（トランジスタ２２のソースは共通電流ライン３２に接続され、トランジスタ２２のドレインは表示素子２０に接続される）。この電流が次に画素の光出力レベル（グレースケール）を制御する。
【００１８】
スイッチングトランジスタ２２は飽和状態で動作するように構成して、ドレイン−ソース電圧と無関係にゲート−ソース電圧がトランジスタを流れる電流を決定するようにする。その結果、ドレイン電圧の僅かな変化は表示素子２０を流れる電流に影響を及ぼさない。これがため、電圧供給ライン３０の電圧は画素の正しい動作に対し臨界的でない。
【００１９】
各画素行を各行アドレス期間にて順々にアドレスし、各行の画素にそれぞれの駆動信号を順々に供給して各行の画素を次にアドレスされるまで駆動（フレーム）期間中所望の出力を発生するように設定する。
【００２０】
この既知の画素回路では、キャパシタ３６に蓄積される電圧は供給データ信号電圧により実質的に決まり、この電圧が次に駆動トランジスタ２２、従って表示素子２０を流れる電流を制御するので、得られる表示素子の光出力レベルはいつでも表示素子の現在の電流/光出力レベル特性に依存することが分かる。表示素子のエレクトロルミネッセンス材料は動作期間中に劣化してエージング効果を生じ、その結果として所定の駆動電流レベルに対する光出力レベルの低下を生ずる。従って、長期間（又は強く）駆動された画素は低下した輝度を示し、表示が不均一になる。ポリマＬＥＤ材料の場合にはこのようなエージング効果が顕著になり得る。
【００２１】
所定の電流を流す表示素子が劣化するにつれて、そのインピーダンス及びそのアノードとカソードとの間の電位差が増大することが確かめられた。表示素子２０は固有のキャパシタンスを有する。図３は表示素子の一般的なエージング効果を、表示素子のターンオン時の充電期間における表示素子両端間の電圧（Ｖde）対時間（ｔ）特性に関して、グラフで示すものであり、曲線Ｉは初期状態の場合を示し、曲線IIは例えば数千時間の動作後の場合を示す。これから明らかなように、この電圧はΔＶだけ増大し、その量はエージングの程度に従って変化する。一般に、ΔＶは時間の経過につれて増大する。
【００２２】
図４は一定の駆動電流で長い動作期間Ｔ、例えば数千時間に亘って動作させた場合の表示素子の輝度Ｌと表示素子両端間の電圧Ｖdeとの関係をグラフで示すものである。これから明らかのように、この電圧は表示素子の動作寿命の初期の段階では著しく増大し、平坦域になると相当長い期間に亘ってほぼ一定に維持され、次いで表示素子の寿命の終りに向って増大する。逆に、輝度の変化は、表示素子の寿命の初期段階では著しく低下し、次いでほぼ一定レベルに維持され、次いで再び低下する。
【００２３】
本発明では、各画素に、表示素子の両端間の電位差を検出し、その値を帰還変量として用いて表示素子の駆動を自動的に調整してこのようなエージング効果を少なくともある程度補償する手段を設け、これにより所定のデータ信号レベルに対する表示素子の所要の光出力レベルを維持する。
【００２４】
図５には、光出力低下エージング効果を少なくともある程度克服するよう構成された本発明表示装置の一実施例の代表的画素の等価回路が示されている。各画素１０内には、表示素子２０が再び電流ライン３２と電圧供給ライン３０（ここでは全画素に共通の共通電極層で構成される）との間に駆動トランジスタ２２と直列に接続されている。アドレストランジスタ２６のゲート及びソースは関連する行及び列導体１２及び１４にそれぞれ接続する。蓄積キャパシタ３６も同様に駆動トランジスタ２２のゲートとトランジスタ２６のドレイン及び電流ライン３２との間に接続する。
【００２５】
画素は、更に、表示素子２０と制御ＴＦＴ２２との間に直列に接続された、同様にＴＦＴ形態の、他のスイッチ装置４０を含み、そのゲートは行導体１２に接続する。更に、別のＴＦＴ、即ち帰還ＴＦＴ４５を設け、その両電流端子を駆動ＴＦＴ２２のゲートと、例えばカソード電位に対応する所定の低レベルの電位源Ｖdとの間に接続する。ＴＦＴ４５のゲートはキャパシタ４７を経て表示素子のアノードとＴＦＴ４０との接続点に接続するとともに、抵抗４８を経て表示素子のカソード電圧供給ライン３０にも接続する。抵抗４８とキャパシタ４７は相俟って受動微分器として作用する受動高域通過フィルタ回路を構成し、その出力を帰還ＴＦＴ４５のゲートに供給する。
ＴＦＴ２６及び２２はｐ形ＴＦＴであり、ＴＦＴ４０及び４５はｎ形ＴＦＴである。
【００２６】
前に述べて様に、画素の動作は２つのフェーズ、即ち画素を供給データ信号に応じて所望の表示出力を出力するようにセットするアドレスフェーズと、次いでそれらの表示素子をそれらが例えば次のフレーム期間において再びアドレスされるまで所要の表示出力を発生するように駆動する駆動フェーズを有する。代表的には、行アドレス期間は約３０マイクロ秒、駆動(フレーム)期間は約１６ミリ秒にすることができる。アドレスフェーズでは、該当する行導体の電圧は行駆動回路１６により発生される選択信号Ｖsにより行アドレス期間に対応する期間中低レベルにされ、これによりｐ形アドレスＴＦＴ２６がターンオンし、列駆動回路１８により列導体１４に供給されたデータ電圧を蓄積キャパシタ３６に蓄積するとともにＴＦＴ２２をターンオンする。この選択期間中、ｎ形ＴＦＴ４０はオフに維持されるため、この時間には電流は表示素子を流れない。フレーム期間内の各画素の光出力を変化させるために(すなわちグレースケール)、供給データ信号電圧レベルを増大することによりアドレス期間中のＴＦＴ２２のゲートノードの電荷を適切に調整する。
【００２７】
選択信号Ｖsの終了時に対応する行アドレス期間の終了時に、行導体１２の電圧は高レベルに戻り、ＴＦＴ２６をターンオフさせ、キャパシタ３６の一端を列導体１４から切り離す。同時に，ＴＦＴ４０をターンオンする。このとき、駆動電流が直列接続のＴＦＴ２２及び４０を経て表示素子２０に流れ、この電流のレベルはキャパシタ３６に蓄積された電圧に従ってＴＦＴ２２により決定される。
【００２８】
行アドレス期間の終了時では、表示素子２０の両端間の電位は零ボルトである。その直後にＴＦＴ２２及び４０が導通し、表示素子２０が充電及び導通し始めるので、表示素子２０の両端間の電位は増大し始める。充電期間は駆動期間の比較的小さな初期部分、代表的には１０−２０マイクロ秒を占めるだけである。この初期期間における表示素子両端間の増大する電位はキャパシタンス４７と抵抗４８からなる高域通過フィルタに至り、過渡ゲート−ソース電圧を帰還ＴＦＴ４５に供給し、ＴＦＴ４５をターンオンしてそのドレインとＴＦＴ２２のゲート及びキャパシタ３６のノードとの間の接続を経て蓄積キャパシタ３６の過渡充電を生ずる。得られるキャパシタ３６の比較的小さな補足充電は駆動期間のこの初期段階における表示素子両端間の検出電圧に依存し、駆動ＴＦＴ２２を表示素子２０を流れる電流がそれに応じて僅かに増大するよう制御するのに有効である。補足充電の量は表示素子両端間の検出電位差のレベルに応じて変化し、代表的には全蓄積電荷の１０％以下程度である。
【００２９】
表示素子が時間の経過とともに劣化するにつれて、その両端間の導通電圧は増大し、その結果として高域通過フィルタ及び帰還ＴＦＴ４５によるキャパシタ３６の補足充電がこれに応じて増大し、これにより駆動ＴＦＴ２２が適切に制御され、ＴＦＴ２２により表示素子を流れる駆動電流のレベルが増大してこのエージング効果に対するある程度の補正が達成される。その結果として、表示素子の劣化が画素回路のデータ信号電圧/光出力特性に及ぼす影響が減少し、駆動フェーズにおいて所定の供給データ信号に対し表示素子により発生される光量は所望のレベルに維持されるようになる。
【００３０】
この目的を達成するためには、帰還回路を正しく調整することが重要である。この点で、この調整は所定の電位Ｖdの値を対応して変化させることにより行なうことができる。ＴＦＴ４５の動作を制御するＲ−Ｃ高域通過フィルタ４７、４８の出力は実際上表示素子のアノード電圧の微分である。高域通過フィルタ４７、４８は一定電流でのＥＬ表示素子の電圧上昇時間特性に調整する。好ましくは、フィルタ回路を(その構成要素値の適切な選択により)フィルタ回路の電圧出力が充電期間中の表示素子のアノード電圧に追従するように調整する。所定の電位Ｖdは大地電位にすることができ、また表示素子のカソード電位が大地電位でない場合にはこのカソード電位にすることもでき、またＴＦＴ４５が必要な時にターンオンするならば若干異なる値にすることもできる。この電位Ｖdは全画素に共通であり、画素アレー内に形成した導電格子パターンにより都合よく各画素に供給することができる。
【００３１】
画素回路の帰還動作は表示素子のエージング特性の初期寿命部分、即ち図３のＸで示す特性曲線の部分において最も有効であるが、全寿命に亘って有用である。
【００３２】
図６は、帰還ＴＦＴ４５のゲート電圧Ｖgの時間ｔに対する変化を、アドレスフェーズの直後の時点tdにて開始する駆動フェーズ内の充電期間における表示素子のアノード電圧特性Ｖdeに関連してグラフで示すものである。図３と同様に、２組の曲線Ｉ及びIIは表示素子の寿命の初期段階と数千時間動作後におけるこれらの関係を示す。適切に調整された高域通過フィルタ回路の場合には、ゲート電圧Ｖg曲線は電位差レベルＶdeの受動微分にだいたい対応する。ＶthはＴＦＴ４５のしきい値電圧であり、図から分かるように、ＴＦＴ４５のゲート電圧の大きさは時間の経過とともに表示素子アノード電圧の増大に従って増大し、この電圧がＴＦＴしきい値電圧Ｖthを超える持続時間tgも僅かに増大する。
【００３３】
上述したように各画素行が（図５に選択信号Ｖsの相対的なタイミングで示すように）各アドレス期間において順々にアドレスされ、それらの画素の光出力がそれらの帰還回路の動作により適切に調整され、次のフィールドで再びアドレスされるまで維持される。
【００３４】
画素回路のアクティブマトリクス素子はすべて絶縁性基板の上に薄膜素子（ＴＦＴ、キャパシタ及び導電性相互接続）として容易に製造することができる。同様に、電位検出及び帰還回路の追加の素子、即ち追加のＴＦＴ４０及び４５、キャパシタ４７及び抵抗４８も同一のプロセスを用いて基板上に同時に製造することができ、ＴＦＴがポリシリコン形のＴＦＴである場合には抵抗は例えばドープポリシリコンで構成することができる。或は又、アモルファスシリコン技術を用いつこともできる。
【００３５】
上述した実施例のＴＦＴはｎ及びｐチャネル形ＭＯＳＴＦＴを具えている。反対の形のＴＦＴを使用することもでき、この場合には表示素子２０の極性及び駆動電圧の極性を逆にし、選択信号Ｖsは正電圧パルスを具えるものとする。
【００３６】
上述の実施例では電流ライン３２は行方向に延在し、各行の画素に共通であるが、これらの電流ラインは列方向に延在させ、各電流ラインを各列の画素に共通にすることもできる。
【００３７】
本発明は上述した実施例のように電圧駆動信号を用いるのではなく電流駆動(データ)信号を用いる種類のＥＬ表示装置にも使用することができる。このような装置の例はＷＯ９９/６５０１２に開示され、これを参照されたい。これに記載された装置では、各画素は駆動ＴＦＴ２２のゲートノードと電流ライン３２とアドレスＴＦＴ２６の出力との間に相互接続されたカレントミラー回路を構成する２つの追加のＴＦＴを含んでいる。このカレントミラー回路の動作が駆動ＴＦＴ２２のしきい値電圧の変化によりアレーの画素に生ずる問題を克服する。この装置では、列導体１４を流れる画素入力データ電流をＴＦＴ２６でサンプルし、駆動ＴＦＴで鏡影して比例電流を生成し表示素子に流す。電流が安定すると、蓄積キャパシタの電圧はこの電流を生成するのに必要なＴＦＴ２２のゲート電圧に等しくなる。素子４５、４７及び４８からなる帰還回路を上述したように同様に使用して駆動期間における蓄積電圧を調整することができる。
【００３８】
従って、要約すれば、駆動期間内に各画素内のＥＬ表示素子を流れる駆動電流が、その前のアドレス期間に画素に供給され関連する蓄積キャパシタに電圧として蓄積された駆動信号に基づいて駆動装置により制御されるアクティブマトリクスＥＬ表示装置を記載している。所定の駆動信号レベルに対する表示素子の光出力が時間の経過とともに低下する表示素子のエージング効果を抑えるために、各画素は帰還回路を含み、該帰還回路がエージングの程度を表わす駆動期間の初期部分における表示素子両端間の電位差に応答し、それに応じて蓄積キャパシタに蓄積された電圧を調整するよう構成されている。
【００３９】
以上の説明を読めば、当業者は他の種々の変更が考えられる。これらの変更には、アクティブマトリクスエレクトロルミネッセンス表示装置及びその構成要素の分野において既知であって、上述した構成要件の代わりに又は加えて使用し得る他の構成要件も含むものとする。
【図面の簡単な説明】
【図１】 画素のアレーを具える既知のアクティブマトリクスエレクトロルミネッセンス表示装置の簡略構成図である。
【図２】 図１のアドレスマトリクスエレクトロルミネッセンス表示装置の数個の代表的画素の等価回路図を示す。
【図３】 表示素子のエージング効果を示すグラフである。
【図４】 表示素子の他のエージング効果を示すグラフである。
【図５】 本発明によるアクティブマトリクスエレクトロルミネッセンス表示装置の一実施例内の数個の代表的な画素の等価回路を示す。
【図６】 図５の装置内の画素の動作の効果を示すグラフである。

Claims (4)

  1. 表示画素のアレーを具え、各画素がエレクトロルミネッセンス表示素子と、駆動期間において該表示素子を流れる電流を、駆動期間前のアドレス期間中に画素に供給され且つ蓄積キャパシタンスに電圧として蓄積された駆動信号に基づいて制御する駆動装置とを具えるアクティブマトリクスエレクトロルミネッセンス表示装置において、各画素は帰還調整手段を含み、該手段は駆動期間における表示素子の両端間の電位差に応答し、アドレス期間にキャパシタンスに蓄積された電圧をこの電位差に応じて調整するよう構成され、前記帰還調整手段が、表示素子に接続され、アドレス期間直後の表示素子両端間の電圧の上昇に応答してこの電圧上昇に応じた出力を発生し、この出力で蓄積キャパシタンスに蓄積される電圧の調整を制御する高域通過フィルタ回路を具えることを特徴とするアクティブマトリクスエレクトロルミネッセンス表示装置。
  2. 各画素が、アドレス期間において表示素子に電流が流れるのを阻止するように動作し、駆動期間において表示素子に電流が流れるのを許すように動作するスイッチング装置を含むことを特徴とする請求項１記載のアクティブマトリクスエレクトロルミネッセンス表示装置。
  3. 前記帰還調整手段が、駆動期間の開始時における表示素子両端間の過渡電位差増大に応答することを特徴とする請求項１又は２記載のアクティブマトリクスエレクトロルミネッセンス表示装置。
  4. 前記高域通過フィルタの出力が蓄積キャパシタンスと所定の電位との間に接続された他のスイッチング装置を制御し、これを動作させて蓄積キャパシタンスの補足充電を行なうことを特徴とする請求項１記載のアクティブマトリクスエレクトロルミネッセンス表示装置。
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