JP4658821B2 - ベジェ曲線生成回路 - Google Patents
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第一の乗算器1により、n−iとn−iとの乗算を行う。次に第一のビットシフト回路2により、この乗算の結果の値を右に10ビットシフトさせ、14ビットの信号とする。次に第二の乗算器3により、この14ビットの信号とn−iとの乗算を行う。次に第二のビットシフト回路4により、この乗算の結果の値を右に12ビットシフトさせ、14ビットの信号とする。次に第3の乗算器5により、この14ビットの信号とPx(0)との乗算を行う。
2 第一のビットシフト回路
3 第二の乗算器
4 第二のビットシフト回路
5 第三の乗算器
6 第一の乗算器
7 第一のビットシフト回路
8 第二の乗算器
9 第二のビットシフト回路
10 第三の乗算器
11 第一の乗算器
12 第一のビットシフト回路
13 第二の乗算器
14 第二のビットシフト回路
15 第三の乗算器
16 第一の乗算器
17 第一のビットシフト回路
18 第二の乗算器
19 第二のビットシフト回路
20 第三の乗算器
21 加算器
22 第三のビットシフト回路
31 第一の演算回路
32 第二の演算回路
33 第三の演算回路
34 第四の演算回路
Claims (1)
- ベジェ曲線の分割数までの整数値を持つ複数の複数ビット信号を入力して乗算を行う第一の乗算器と、前記第一の乗算器による前記複数ビット信号の乗算の演算結果をビットシフトする第一のビットシフト回路と、前記第一のビットシフト回路でビットシフトした整数値の信号と整数値を持つ複数ビット信号とあるいは所定の定数の整数値の信号を入力して乗算を行う第二の乗算器と、前記第二の乗算器による乗算の演算結果をビットシフトする第二のビットシフト回路と、前記第二のビットシフト回路でビットシフトした整数値の信号と制御点の整数値を持つ座標値の信号とを入力して乗算を行う第三の乗算器とからなる複数の演算回路と、
前記複数の演算回路の出力を加算する加算器と、
前記加算器の加算結果をビットシフトする第三のビットシフト回路と、
を備え、
前記複数の演算回路の前記第一の乗算器に前記分割数までの増加する整数値及び前記分割数から減少する整数値のうちのいずれかの複数の整数値の信号を入力し、
前記複数の演算回路の第二の乗算器に前記第一のビットシフト回路でビットシフトした整数値の信号と前記分割数までの増加する整数値及び前記分割数から減少する整数値のうちのいずれかの整数値の信号とあるいは所定の定数の整数値の信号とを入力し、
前記複数の演算回路の前記第三の乗算器に複数の制御点の整数値を持つ座標値の信号を入力して、乗算と加算とビットシフトの演算処理を繰り返し、ベジェ曲線のx座標及びy座標を得て第三のビットシフト回路から出力することを特徴とするベジェ曲線生成回路。
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JP2006024537A JP4658821B2 (ja) | 2006-02-01 | 2006-02-01 | ベジェ曲線生成回路 |
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---|---|---|---|---|
JPH02281385A (ja) * | 1989-04-21 | 1990-11-19 | Ricoh Co Ltd | 曲線の直線近似化装置 |
JPH05334448A (ja) * | 1992-05-28 | 1993-12-17 | Matsushita Electric Ind Co Ltd | ベツィエ曲線生成装置 |
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Patent Citations (2)
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JPH05334448A (ja) * | 1992-05-28 | 1993-12-17 | Matsushita Electric Ind Co Ltd | ベツィエ曲線生成装置 |
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