JP4653250B2 - プラズマディスプレイ装置及びその駆動方法 - Google Patents
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Description
図1は、本発明の第1の実施形態によるプラズマディスプレイ装置の構成例を示す図である。参照番号3はプラズマディスプレイパネル、参照番号4はX駆動回路、参照番号5はY(スキャン)駆動回路、参照番号6はアドレス駆動回路、参照番号7は制御回路である。
図8は、本発明の第2の実施形態によるアドレス電極AjのアドレスパルスとY電極Yiのスキャンパルスを示す図であり、図7と比べて2段アドレスパルスのタイミングが異なる。例として、Y電極Y3のスキャンパルスに対応するアドレス電極A3のアドレスパルスを説明する。Y電極Y3のスキャンパルスが立ち下がると、アドレスパルスはグランドGNDから電圧Va/2に立ち上がり、その電圧Va/2を維持する。その後、アドレスパルスは電圧Va/2から電圧Vaに立ち上がり、電圧Vaを維持する。その後、アドレスパルスが電圧Vaから電圧Va/2に立ち下がると、Y電極Y3のスキャンパルスが立ち上がる。その後、アドレスパルスは電圧Va/2からグランドGNDに立ち下がる。すなわち、Y電極Y3のスキャンパルスの1つ後のY電極Y4のスキャンパルスの期間T2において、アドレスパルスは電圧Va/2を維持し、グランドGNDに立ち下がる。
図9は、本発明の第3の実施形態によるアドレス電極AjのアドレスパルスとY電極Yiのスキャンパルスを示す図であり、図7と比べて2段アドレスパルスの電圧が異なる。図7では、アドレスパルスは立ち上がり及び立ち下がりが2段階であり、その最低電圧GNDの1段上の電圧Va/2はその最高電圧Vaの略1/2である。本実施形態では、アドレスパルスは立ち上がり及び立ち下がりが2段階であり、その最低電圧GNDの1段上の電圧Va/4はその最高電圧Vaの1/2未満である。
図10は、本発明の第4の実施形態によるアドレス電極AjのアドレスパルスとY電極Yiのスキャンパルスを示す図であり、図8と比べて2段アドレスパルスの電圧が異なる。図8では、アドレスパルスは立ち上がり及び立ち下がりが2段階であり、その最低電圧GNDの1段上の電圧Va/2はその最高電圧Vaの略1/2である。本実施形態では、アドレスパルスは立ち上がり及び立ち下がりが2段階であり、その最低電圧GNDの1段上の電圧Va/4はその最高電圧Vaの1/2未満である。
図11は、本発明の第5の実施形態によるアドレス電極AjのアドレスパルスとY電極Yiのスキャンパルスを示す図であり、図7と比べて3段アドレスパルスである点が異なる。図7ではアドレスパルスは立ち上がり及び立ち下がりが2段階であるが、本実施形態ではアドレスパルスは立ち上がり及び立ち下がりが3段階である。
図12は、本発明の第6の実施形態によるアドレス電極AjのアドレスパルスとY電極Yiのスキャンパルスを示す図であり、図11と比べて3段アドレスパルスのタイミングが異なる。図11ではアドレスパルスの立ち上がり時を1つ前のスキャンパルスに重なるようにしたが、本実施形態ではアドレスパルスの立ち下がり時を1つ後のスキャンパルスに重なるようにする。
図13は、本発明の第7の実施形態によるアドレス電極AjのアドレスパルスとY電極Yiのスキャンパルスを示す図であり、図11と比べて3段アドレスパルスのタイミングが異なる。図11ではアドレスパルスの立ち上がり期間T11がY電極Y2のスキャンパルスに重なるようにしたが、本実施形態ではアドレス電極A3のアドレスパルスがその最低電圧GNDから1段上がった電圧Va/3を維持する期間T13はそれに対応するY電極Y3のスキャンパルスの1つ前のY電極Y2のスキャンパルスに重なるようにする。
図14は、本発明の第8の実施形態によるアドレス電極AjのアドレスパルスとY電極Yiのスキャンパルスを示す図であり、図12と比べて3段アドレスパルスのタイミングが異なる。図12ではアドレスパルスの立ち下がり期間T12がY電極Y4のスキャンパルスに重なるようにしたが、本実施形態ではアドレス電極A3のアドレスパルスがその最低電圧GNDの1段上の電圧Va/3を維持する期間T14はそれに対応するY電極Y3のスキャンパルスの1つ後のY電極Y4のスキャンパルスに重なるようにする。
図15は、本発明の第9の実施形態によるアドレス電極AjのアドレスパルスとY電極Yiのスキャンパルスを示す図であり、図7と比べてアドレスパルスの立ち下がりが1段である点が異なる。本実施形態では、最高電圧Vaから最低電圧GNDに1段で立ち下がる。期間T15は、図7ではアドレスパルスの電圧がVa/2であった期間に相当し、本実施形態ではアドレス電極A3をハイインピーダンス状態にする。ハイインピーダンス状態にすることにより、アドレスパルスはアドレス電源電圧Va/2にならず、電圧Vaを維持することができる。その詳細は、後に図18(A)及び(B)を参照しながら説明する。
図16(A)及び(B)は、本発明の第10の実施形態を示す図である。図16(A)は第1〜第4の実施形態のアドレスパルスを生成するためのアドレス駆動回路6(図1)の構成例を示す回路図、図16(B)はその回路動作を説明するためのタイミングチャートである。なお、図16(B)は、第1及び第2の実施形態のアドレスパルスの例を示す。
図17(A)及び(B)は、本発明の第11の実施形態を示す図である。図17(A)は第5〜第8の実施形態のアドレスパルスを生成するためのアドレス駆動回路6(図1)の構成例を示す回路図、図17(B)はその回路動作を説明するためのタイミングチャートである。
図18(A)及び(B)は、本発明の第12の実施形態を示す図である。図18(A)は第9の実施形態のアドレスパルスを生成するためのアドレス駆動回路6(図1)の構成例を示す回路図、図18(B)はその回路動作を説明するためのタイミングチャートである。図18(A)の回路構成は、図16(A)のものと同じである。電圧Va1=Va2=Va/2である。
スキャンパルスを順次スキャンして印加する複数のスキャン電極と、
前記スキャンパルスに対応してアドレスパルスを印加することにより表示画素を選択するアドレス電極と、
前記スキャンパルスを生成するスキャン駆動回路と、
前記アドレスパルスを生成するアドレス駆動回路とを有し、
前記アドレスパルスはn段階(nは2以上の整数)で立ち上がり、その最低電圧から最高電圧に至るまでの所定の期間はそれに対応するスキャンパルスの1つ前のスキャンパルスに重なるプラズマディスプレイ装置。
(付記2)
前記所定の期間は、その最低電圧から1段上がった電圧を維持する期間である付記1記載のプラズマディスプレイ装置。
(付記3)
前記アドレスパルスは、その最低電圧からその最高電圧の1段低い電圧まで立ち上がって維持する期間はそれに対応するスキャンパルスの1つ前のスキャンパルスに重なる付記2記載のプラズマディスプレイ装置。
(付記4)
前記アドレスパルスは2段階で立ち上がり、その最低電圧から1段上がった電圧はその最高電圧の略1/2である付記1記載のプラズマディスプレイ装置。
(付記5)
前記アドレスパルスは2段階で立ち上がり、その最低電圧から1段上がった電圧はその最高電圧の1/2未満である付記1記載のプラズマディスプレイ装置。
(付記6)
前記アドレスパルスは、その最低電圧からその最高電圧までn段階で立ち上がる際に、その最低電圧及びその最高電圧の差電圧の1/nずつn段階で立ち上がる付記1記載のプラズマディスプレイ装置。
(付記7)
前記アドレスパルスは、その立ち上がる各段の変化電圧が異なる付記1記載のプラズマディスプレイ装置。
(付記8)
前記アドレスパルスは、その立ち上がる各段の変化電圧が一部同じであり、一部が異なる付記1記載のプラズマディスプレイ装置。
(付記9)
前記アドレスパルスは、その最低電圧から1段立ち上がる変化電圧が他段の変化電圧よりも低い付記1記載のプラズマディスプレイ装置。
(付記10)
前記アドレスパルスは1段で立ち下がる付記1記載のプラズマディスプレイ装置。
(付記11)
前記アドレスパルスはn段階で立ち下がり、その最高電圧の1段低い電圧を維持してそこからその最低電圧まで立ち下がる期間はそれに対応するスキャンパルスに重なる付記1記載のプラズマディスプレイ装置。
(付記12)
スキャンパルスを順次スキャンして印加する複数のスキャン電極と、
前記スキャンパルスに対応してアドレスパルスを印加することにより表示画素を選択するアドレス電極と、
前記スキャンパルスを生成するスキャン駆動回路と、
前記アドレスパルスを生成するアドレス駆動回路とを有し、
前記アドレスパルスはn段階(nは2以上の整数)で立ち下がり、その最高電圧から最低電圧に至るまでの所定の期間はそれに対応するスキャンパルスの1つ後のスキャンパルスに重なるプラズマディスプレイ装置。
(付記13)
前記所定の期間は、その最低電圧の1段上の電圧を維持する期間である付記12記載のプラズマディスプレイ装置。
(付記14)
前記アドレスパルスは、その最高電圧の1段低い電圧を維持してそこからその最低電圧まで立ち下がる期間はそれに対応するスキャンパルスの1つ後のスキャンパルスに重なる付記13記載のプラズマディスプレイ装置。
(付記15)
前記アドレスパルスは2段階で立ち下がり、その最低電圧の1段上の電圧はその最高電圧の略1/2である付記12記載のプラズマディスプレイ装置。
(付記16)
前記アドレスパルスは2段階で立ち下がり、その最低電圧の1段上の電圧はその最高電圧の1/2未満である付記12記載のプラズマディスプレイ装置。
(付記17)
前記アドレスパルスは、その最高電圧からその最低電圧までn段階で立ち下がる際に、その最低電圧及びその最高電圧の差電圧の1/nずつn段階で立ち下がる付記12記載のプラズマディスプレイ装置。
(付記18)
前記アドレスパルスは、その立ち下がる各段の変化電圧が異なる付記12記載のプラズマディスプレイ装置。
(付記19)
前記アドレスパルスは、その立ち下がる各段の変化電圧が一部同じであり、一部が異なる付記12記載のプラズマディスプレイ装置。
(付記20)
前記アドレスパルスは、その最低電圧の1段上からその最低電圧まで立ち下がる変化電圧が他段の変化電圧よりも低い付記12記載のプラズマディスプレイ装置。
(付記21)
前記アドレスパルスはn段階で立ち上がり、その最低電圧からその最高電圧の1段低い電圧まで立ち上がって維持する期間はそれに対応するスキャンパルスに重なる付記12記載のプラズマディスプレイ装置。
(付記22)
スキャンパルスを順次スキャンして印加する複数のスキャン電極と、前記スキャンパルスに対応してアドレスパルスを印加することにより表示画素を選択するアドレス電極とを有するプラズマディスプレイ装置の駆動方法であって、
前記スキャンパルスを生成するスキャン駆動ステップと、
前記アドレスパルスを生成するアドレス駆動ステップとを有し、
前記アドレスパルスはn段階(nは2以上の整数)で立ち上がり、その最低電圧から最高電圧に至るまでの所定の期間はそれに対応するスキャンパルスの1つ前のスキャンパルスに重なるプラズマディスプレイ装置の駆動方法。
(付記23)
スキャンパルスを順次スキャンして印加する複数のスキャン電極と、前記スキャンパルスに対応してアドレスパルスを印加することにより表示画素を選択するアドレス電極とを有するプラズマディスプレイ装置の駆動方法であって、
前記スキャンパルスを生成するスキャン駆動ステップと、
前記アドレスパルスを生成するアドレス駆動ステップとを有し、
前記アドレスパルスはn段階(nは2以上の整数)で立ち下がり、その最高電圧から最低電圧に至るまでの所定の期間はそれに対応するスキャンパルスの1つ後のスキャンパルスに重なるプラズマディスプレイ装置の駆動方法。
2 背面ガラス基板
3 パネル
4 X駆動回路
5 Y駆動回路
6 アドレス駆動回路
7 制御回路
13、16 誘電体層
14 保護層
17 隔壁
18〜20 蛍光体
21〜30 サブフィールド
31 リセット期間
32 アドレス期間
33 サステイン期間
Claims (4)
- スキャンパルスを順次スキャンして印加する複数のスキャン電極と、
前記スキャンパルスに対応してアドレスパルスを印加することにより表示画素を選択するアドレス電極と、
前記スキャンパルスを生成して前記スキャン電極に印加するスキャン駆動回路と、
前記アドレスパルスを生成して前記アドレス電極に印加するアドレス駆動回路とを有し、
前記アドレスパルスは2段階で立ち下がり、その最高電圧から1段下がった中間電圧を維持する期間はそれに対応するスキャンパルスの1つ後のスキャンパルスに重なると共に、前記中間電圧は前記アドレスパルスの最高電圧の1/2であるプラズマディスプレイ装置。 - 前記アドレスパルスは2段階で立ち上がり、その最低電圧から1段上がった電圧は前記中間電圧であって、前記中間電圧を維持してからその最高電圧に立ち上がるまでの期間はそれに対応するスキャンパルスに重なる請求項1記載のプラズマディスプレイ装置。
- スキャンパルスを順次スキャンして印加する複数のスキャン電極と、前記スキャンパルスに対応してアドレスパルスを印加することにより表示画素を選択するアドレス電極とを有するプラズマディスプレイ装置の駆動方法であって、
前記スキャンパルスを生成して前記スキャン電極に印加するスキャン駆動ステップと、
前記アドレスパルスを生成して前記アドレス電極に印加するアドレス駆動ステップとを有し、
前記アドレスパルスは2段階で立ち下がり、その最高電圧から1段下がった中間電圧を維持する期間はそれに対応するスキャンパルスの1つ後のスキャンパルスに重なると共に、前記中間電圧は前記アドレスパルスの最高電圧の1/2であるプラズマディスプレイ装置の駆動方法。 - 前記アドレスパルスは2段階で立ち上がり、その最低電圧から1段上がった電圧は前記中間電圧であって、前記中間電圧を維持してからその最高電圧に立ち上がるまでの期間はそれに対応するスキャンパルスに重なる請求項3記載のプラズマディスプレイ装置の駆動方法。
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