JP4544631B2 - トランジスタモデル生成装置、および、トランジスタモデル生成方法 - Google Patents
トランジスタモデル生成装置、および、トランジスタモデル生成方法 Download PDFInfo
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Description
DL=(拡散層10の周囲長)/2−W
と計算される。
DL’=(拡散層11の周囲長)/2−W’
と計算される。ここでは、W’は多結晶シリコン層13により形成されるトランジスタのゲート幅を示す。
移動度パラメータfmu(DL):
fmu(DL)=fmu(DL=DL1)*W1/(W1+W2+ … +Wn)+fmu(DL=DL2)*W2/(W1+W2+ … +Wn)+ …
+fmu(DL=DLn)*Wn/(W1+W2+ … +Wn)
閾値電圧パラメータfvth(DL):
fvth(DL)=fvth(DL=DL1)*W1/(W1+W2+ … +Wn)+fvth(DL=DL2)*W2/(W1+W2+ … +Wn)+ …
+fvth(DL=DLn)*Wn/(W1+W2+ … +Wn)
トランジスタモデル名:NENHHP_m (m≧2)
Wn=(ゲート領域と認識層2を含む拡散層に接するエッジ長)/2
DLn=(認識層2を含む拡散層の周囲長/2)−Wn
MN011 GND IN0 net1 GND nenhhp_2 l=0.1u w=0.48u ad=0.0813069p as=0.12p
pd=0.813435u ps=1.46u $w1=0.48u $dl1=0.98u $w2=0.35u $dl2=0.6u
MN012 net2 net1 GND GND nenhhp_2 l=0.1u w=0.83u ad=0.2075p as=0.140593p
pd=2.16u ps=1.40656u $w1=0.48u $dl1=0.98u $w2=0.35u $dl2=0.6u
MN013 GND net2 net3 GND nenhhp_2 l=0.1u w=0.9u ad=0.134664p as=0.225p
pd=1.2785u ps=2.3u $w1=0.9u $dl1=0.98u $w2=0.34u $dl2=0.53u
MN014 net4 net3 GND GND nenhhp_2 l=0.1u w=1.24u ad=0.31p as=0.185536p
pd=2.98u ps=1.7615u $w1=0.9u $dl1=0.98u $w2=0.34u $dl2=0.53u
MN011 GND IN0 net1 GND nenhhp_2_1 l=0.1u w=0.48u ad=0.0813069p as=0.12p
pd=0.813435u ps=1.46u $w1=0.48u $dl1=0.98u $w2=0.35u $dl2=0.6u
MN012 net2 net1 GND GND nenhhp_2_1 l=0.1u w=0.83u ad=0.2075p as=0.140593p
pd=2.16u ps=1.40656u $w1=0.48u $dl1=0.98u $w2=0.35u $dl2=0.6u
MN013 GND net2 net3 GND nenhhp_2_2 l=0.1u w=0.9u ad=0.134664p as=0.225p
pd=1.2785u ps=2.3u $w1=0.9u $dl1=0.98u $w2=0.34u $dl2=0.53u
MN014 net4 net3 GND GND nenhhp_2_2 l=0.1u w=1.24u ad=0.31p as=0.185536p
pd=2.98u ps=1.7615u $w1=0.9u $dl1=0.98u $w2=0.34u $dl2=0.53u
fmu(DL)=fmu(DL=DL1)*W1/(W1+W2+ … +Wn)+fmu(DL=DL2)*W2/(W1+W2+ … +Wn)+ …
+fmu(DL=DLn)*Wn/(W1+W2+ … +Wn)
fvth(DL)=fvth(DL=DL1)*W1/(W1+W2+ … +Wn)+fvth(DL=DL2)*W2/(W1+W2+ … +Wn)+ …
+fvth(DL=DLn)*Wn/(W1+W2+ … +Wn)
11 非矩形拡散層
11a、11b 個別トランジスタ拡散層
11−1、11−2 矩形分割拡散層
12、13 多結晶シリコン層
31 マスクレイアウトデータ
33 トランジスタ抽出処理
34 矩形分割処理
35 マスクレイアウトデータ関連付け処理
36 矩形領域サイズ計算処理
37 補正値計算処理
38 トランジスタモデル登録処理
39 トランジスタモデル
41 CPU
42 記憶部
43 入力部
44 出力部
K1〜K6 拡散領域の頂点
W11〜W14、W21〜W24 ゲート領域の頂点
Claims (23)
- 半導体集積回路のマスクレイアウトデータに基づいて、非矩形の拡散層領域に重なるゲート領域を有するトランジスタを抽出するトランジスタ抽出処理部と、
前記トランジスタのゲート長方向に分割線を設定して前記非矩形の拡散層領域を複数の矩形拡散層領域に分割する矩形分割処理部と、
前記非矩形の拡散層領域と前記複数の矩形拡散層領域とを前記マスクレイアウトデータに関連付けるマスクレイアウトデータ関連付け処理部と、
前記複数の矩形拡散層領域の各々の大きさを示すサイズ情報を算出するサイズ計算処理部と、
前記サイズ情報に基づいて前記複数の矩形拡散層領域の各々の拡散層長依存パラメータを計算する補正値計算処理部と、前記拡散層長依存パラメータは前記拡散層領域における拡散層長に依存して値が変化する移動度パラメータと閾値電圧パラメータとを含み、
前記拡散層長依存パラメータに基づいて回路シミュレーションに用いられる前記トランジスタのトランジスタモデルを登録するトランジスタモデル登録部と
を具備する
トランジスタモデル生成装置。 - 前記トランジスタ抽出処理部は、前記非矩形の拡散層領域の頂点の数に基づいて非矩形であることを判定する
請求項1に記載のトランジスタモデル生成装置。 - 前記分割線は、
前記ゲート領域の頂点の位置を示す座標に基づいて方向を設定され、
前記非矩形の拡散層の頂点のうち凹部を示す頂点を一方の端点とし、
前記一方の端点から前記方向に延長する延長線上で、前記非矩形の拡散層領域の前記方向に垂直な辺に交差する位置を他方の端点とする
請求項1または請求項2に記載のトランジスタモデル生成装置。 - 前記矩形分割処理部は、
前記非矩形の拡散層領域を、分割される領域であることを示す第1認識層に割り当て、
前記複数の矩形拡散層領域の各々を、前記非矩形の拡散層領域が分割された矩形領域であることを示す第2認識層に割り当てる
請求項1から請求項3のいずれかに記載のトランジスタモデル生成装置。 - 前記矩形分割処理部は、前記第1認識層と前記第2認識層とを図形処理するための異なる未使用の処理層に割り当てる
請求項4に記載のトランジスタモデル生成装置。 - 前記第2認識層は、複数の処理層を備え、
前記複数の矩形拡散層領域の各々は、前記複数の処理層に重複せずに割り当てられる
請求項4または請求項5に記載のトランジスタモデル生成装置。 - 前記トランジスタモデルは、前記複数の矩形拡散層領域の数を示す第1識別子を備える
請求項1から請求項6のいずれかに記載のトランジスタモデル生成装置。 - 前記トランジスタモデル登録部は、同一の前記第1識別子を備える前記トランジスタモデルに生成順序を示す第2識別子を付与して登録する
請求項7に記載のトランジスタモデル生成装置。 - 前記補正値計算処理部は、前記複数の矩形拡散層領域のうちn番目の領域の拡散層長をDLn、ゲート幅をWnとするとき、移動度パラメータfmu(DL)を、
fmu(DL)=fmu(DL=DL1)*W1/(W1+W2+ … +Wn)+fmu(DL=DL2)*W2/(W1+W2+ … +Wn)+ …
+fmu(DL=DLn)*Wn/(W1+W2+ … +Wn)
により計算し、閾値電圧パラメータfvth(DL)を、
fvth(DL)=fvth(DL=DL1)*W1/(W1+W2+ … +Wn)+fvth(DL=DL2)*W2/(W1+W2+ … +Wn)+ …
+fvth(DL=DLn)*Wn/(W1+W2+ … +Wn)
により計算する
請求項1から請求項8のいずれかに記載のトランジスタモデル生成装置。 - 請求項1から請求項9のいずれかに記載のトランジスタモデル生成装置により生成されたトランジスタモデルに基づいて、非矩形の拡散層領域に重なるゲート領域を有するトランジスタを含む回路をシミュレートする
回路シミュレーション装置。 - 処理装置と記憶部と入力部と出力部とを備えるトランジスタモデル生成装置がプログラムを実行することにより、マスクレイアウトデータから回路シミュレーションに用いられるトランジスタモデルを生成するトランジスタモデル生成方法であって、
前記処理装置が前記記憶部から読み出した半導体集積回路のマスクレイアウトデータに基づいて、非矩形の拡散層領域に重なるゲート領域を有するトランジスタを抽出するトランジスタ抽出処理ステップと、
前記処理装置が前記トランジスタのゲート長方向に分割線を設定して前記非矩形の拡散層領域を複数の矩形拡散層領域に分割する矩形分割処理ステップと、
前記処理装置が前記非矩形の拡散層領域と前記複数の矩形拡散層領域とを前記マスクレイアウトデータに関連付けるマスクレイアウトデータ関連付け処理ステップと、
前記処理装置が前記複数の矩形拡散層領域の各々の大きさを示すサイズ情報を算出するサイズ計算処理ステップと、
前記処理装置が前記サイズ情報に基づいて前記複数の矩形拡散層領域の各々の拡散層長依存パラメータを計算する補正値計算処理ステップと、前記拡散層長依存パラメータは前記拡散層領域における拡散層長に依存して値が変化する移動度パラメータと閾値電圧パラメータとを含み、
前記処理装置が前記拡散層長依存パラメータに基づいて回路シミュレーションに用いられる前記トランジスタのトランジスタモデルを登録するトランジスタモデル登録ステップと
を具備する
トランジスタモデル生成方法。 - 前記トランジスタ抽出処理ステップは、前記非矩形の拡散層領域の頂点の数に基づいて非矩形であることを判定するステップを備える
請求項11に記載のトランジスタモデル生成方法。 - 前記分割線は、
前記ゲート領域の頂点の位置を示す座標に基づいて方向を設定され、
前記非矩形の拡散層の頂点のうち凹部を示す頂点を一方の端点とし、
前記一方の端点から前記方向に延長する延長線上で、前記非矩形の拡散層領域の前記方向に垂直な辺に交差する位置を他方の端点とする
請求項11または請求項12に記載のトランジスタモデル生成方法。 - 前記矩形分割処理ステップは、
前記非矩形の拡散層領域を、分割される領域であることを示す第1認識層に割り当てるステップと、
前記複数の矩形拡散層領域の各々を、前記非矩形の拡散層領域が分割された矩形領域であることを示す第2認識層に割り当てるステップと
を備える
請求項11から請求項13のいずれかに記載のトランジスタモデル生成方法。 - 前記矩形分割処理ステップは、前記第1認識層と前記第2認識層とを図形処理するための異なる未使用の処理層に割り当てるステップを備える
請求項14に記載のトランジスタモデル生成方法。 - 前記第2認識層は、複数の処理層を備え、
前記複数の矩形拡散層領域の各々は、前記複数の処理層に重複せずに割り当てられる
請求項14または請求項15に記載のトランジスタモデル生成方法。 - 前記トランジスタモデルは、前記複数の矩形拡散層領域の数を示す第1識別子を備える
請求項11から請求項16のいずれかに記載のトランジスタモデル生成方法。 - 前記トランジスタモデル登録ステップは、同一の前記第1識別子を備える前記トランジスタモデルに生成順序を示す第2識別子を付与して登録するステップを備える
請求項17に記載のトランジスタモデル生成方法。 - 前記補正値計算処理ステップは、前記複数の矩形拡散層領域のうちn番目の領域の拡散層長をDLn、ゲート幅をWnとするとき、移動度パラメータfmu(DL)を、
fmu(DL)=fmu(DL=DL1)*W1/(W1+W2+ … +Wn)+fmu(DL=DL2)*W2/(W1+W2+ … +Wn)+ …
+fmu(DL=DLn)*Wn/(W1+W2+ … +Wn)
により計算し、閾値電圧パラメータfvth(DL)を、
fvth(DL)=fvth(DL=DL1)*W1/(W1+W2+ … +Wn)+fvth(DL=DL2)*W2/(W1+W2+ … +Wn)+ …
+fvth(DL=DLn)*Wn/(W1+W2+ … +Wn)
により計算するステップを備える
請求項11から請求項18のいずれかに記載のトランジスタモデル生成方法。 - 請求項11から請求項19のいずれかに記載のトランジスタモデル生成方法により生成されるトランジスタモデルを用いて、非矩形の拡散層領域に重なるゲート領域を有するトランジスタを含む回路を回路シミュレーション装置によってシミュレートする
回路シミュレーション方法。 - 半導体集積回路のマスクレイアウトデータに基づいて、非矩形の拡散層領域に重なるゲート領域を有するトランジスタを抽出するトランジスタ抽出処理ステップと、
前記トランジスタのゲート長方向に分割線を設定して前記非矩形の拡散層領域を複数の矩形拡散層領域に分割する矩形分割処理ステップと、
前記非矩形の拡散層領域と前記複数の矩形拡散層領域とを前記マスクレイアウトデータに関連付けるマスクレイアウトデータ関連付け処理ステップと、
前記複数の矩形拡散層領域の各々の大きさを示すサイズ情報を算出するサイズ計算処理ステップと、
前記サイズ情報に基づいて前記複数の矩形拡散層領域の各々の拡散層長依存パラメータを計算する補正値計算処理ステップと、前記拡散層長依存パラメータは移動度パラメータと閾値電圧パラメータとを備え、
前記拡散層長依存パラメータに基づいて回路シミュレーションに用いられる前記トランジスタのトランジスタモデルを登録するトランジスタモデル登録ステップと
をコンピュータに実行させるためのトランジスタモデル生成プログラム。 - 前記補正値計算ステップは、前記複数の矩形拡散層領域のうちn番目の領域の拡散層長をDLn、ゲート幅をWnとするとき、移動度パラメータfmu(DL)を、
fmu(DL)=fmu(DL=DL1)*W1/(W1+W2+ … +Wn)+fmu(DL=DL2)*W2/(W1+W2+ … +Wn)+ …
+fmu(DL=DLn)*Wn/(W1+W2+ … +Wn)
により計算し、閾値電圧パラメータfvth(DL)を、
fvth(DL)=fvth(DL=DL1)*W1/(W1+W2+ … +Wn)+fvth(DL=DL2)*W2/(W1+W2+ … +Wn)+ …
+fvth(DL=DLn)*Wn/(W1+W2+ … +Wn)
により計算する
請求項21に記載のトランジスタモデル生成プログラム。 - 請求項21または請求項22に記載のトランジスタモデル生成プログラムを含み、
非矩形の拡散層領域に重なるゲート領域を有するトランジスタを有する回路をシミュレートする処理をコンピュータに実行させるための回路シミュレーションプログラム。
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