JP4380334B2 - Manufacturing method of electronic device - Google Patents
Manufacturing method of electronic device Download PDFInfo
- Publication number
- JP4380334B2 JP4380334B2 JP2004006669A JP2004006669A JP4380334B2 JP 4380334 B2 JP4380334 B2 JP 4380334B2 JP 2004006669 A JP2004006669 A JP 2004006669A JP 2004006669 A JP2004006669 A JP 2004006669A JP 4380334 B2 JP4380334 B2 JP 4380334B2
- Authority
- JP
- Japan
- Prior art keywords
- groove
- lead frame
- wiring board
- wiring
- layers
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
- H01L2224/491—Disposition
- H01L2224/4912—Layout
- H01L2224/49171—Fan-out arrangements
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/181—Encapsulation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
- H01L2924/191—Disposition
- H01L2924/19101—Disposition of discrete passive components
- H01L2924/19105—Disposition of discrete passive components in a side-by-side arrangement on a common die mounting substrate
Landscapes
- Structure Of Printed Boards (AREA)
Description
本発明は、配線基板とリード端子とが導電性接合部材を介して接合されてなる電子装置の製造方法に関する。 The present invention relates to a method for manufacturing a wiring board and an electronic device and the lead terminals, which are bonded via a conductive bonding member.
配線基板とリード端子とを電気的に接合する従来技術として、ワイヤボンドがある。これは、配線基板とリード端子との間をワイヤによって結線する技術であるが、ワイヤを張る領域が必要となるため、大型になってしまうという問題が生じている。 As a conventional technique for electrically bonding a wiring board and a lead terminal, there is a wire bond. This is a technique for connecting a wiring board and a lead terminal with a wire. However, since a region where the wire is stretched is required, there is a problem that the size becomes large.
これを解消する方法として、配線基板とリード端子とを直接、導電性接合材を介して接合する手法があるが、配線基板に部品を搭載する工程や樹脂モールドを行う成形工程などで、接着部分に応力が加わり接着部にクラック等が発生することがある。 As a method for solving this problem, there is a technique in which the wiring board and the lead terminal are directly joined via a conductive bonding material. However, in the process of mounting components on the wiring board or the molding process of resin molding, In some cases, stress is applied and cracks or the like occur in the bonded portion.
この対応策として、従来より、配線基板とリード端子とを直接、導電性接合材を介して接合した後、さらに、接合部に補強用の樹脂を塗布するものが提案されている(たとえば、特許文献1参照)。 As countermeasures for this, there has conventionally been proposed a method in which a wiring board and a lead terminal are directly bonded via a conductive bonding material, and then a reinforcing resin is applied to the bonding portion (for example, a patent) Reference 1).
また、配線基板とリード端子とを直接、導電性接合材を介して接合した後、さらに、絶縁性テープを用いてリード端子の固定部を補強する手法が提案されている(たとえば、特許文献2参照)。
しかしながら、上記したように、配線基板とリード端子とを直接、導電性接合材を介して接合した後、さらに、接合部を樹脂や絶縁性テープにより補強する方法では、これら樹脂や絶縁性テープを配設する工程が必要であり、配線基板とリード端子との接合において工程の増加を招く。 However, as described above, in the method in which the wiring board and the lead terminal are directly bonded via the conductive bonding material, and the method of further reinforcing the bonding portion with the resin or the insulating tape, the resin or the insulating tape is used. A process of disposing is necessary, and the number of processes is increased in joining the wiring board and the lead terminal.
本発明は、上記問題に鑑み、配線基板とリード端子とが導電性接合部材を介して接合されてなる電子装置において、リード端子と配線基板との接合において工程数の増加を招くことなく、当該接合強度を強固なものにすることを目的とする。 In view of the above problems, the present invention provides an electronic device in which a wiring board and a lead terminal are bonded via a conductive bonding member, without increasing the number of steps in bonding the lead terminal and the wiring board. The purpose is to increase the bonding strength.
上記目的を達成するため、請求項1に記載の発明では、複数の層(11、12、13、14)が積層されてなる積層基板からなる配線基板(10)とリード端子(30)とが導電性接合部材(40)を介して接合されてなる電子装置を製造する製造方法であって、以下の各工程を有することを特徴としている。 In order to achieve the above object, according to the first aspect of the present invention, there is provided a wiring board (10) composed of a laminated board in which a plurality of layers (11, 12, 13, 14) are laminated, and a lead terminal (30). A manufacturing method for manufacturing an electronic device bonded through a conductive bonding member (40), the method including the following steps.
・配線基板(10)の周辺部にて、リード端子(30)との接合部に対応した位置に、溝(15)を形成する工程と、リード端子(30)における配線基板(10)との接続端部を、導電性接合部材(40)を介して溝(15)にはめ込むことにより、配線基板(10)とリード端子(30)とを接合する工程とを備えること。 A step of forming a groove (15) at a position corresponding to a joint portion with the lead terminal (30) at a peripheral portion of the wiring substrate (10), and a wiring substrate (10) in the lead terminal (30) A step of joining the wiring substrate (10) and the lead terminal (30) by fitting the connecting end portion into the groove (15) via the conductive joining member (40).
・溝(15)を形成する工程では、配線基板(10)を構成する複数の層(11〜14)のうち外面側に位置する層(11、12)に対して斜め方向から複数回、異なる角度で打ち抜き加工を行うことにより、当該層(11、12)を貫通するとともに打ち抜き加工が行われた層(11、12)において一面側の開口寸法よりも他面側の開口寸法の方が大きい貫通溝(15)を形成すること。本発明はこれらの点を特徴としている。 The step of forming the groove (15) differs from the layers (11, 12) located on the outer surface side among the plurality of layers (11-14) constituting the wiring substrate (10), a plurality of times from the oblique direction. By punching at an angle, the opening dimension on the other surface side is larger than the opening dimension on the one surface side in the layer (11, 12) that penetrates the layer (11, 12) and is punched. Forming a through groove (15); The present invention is characterized by these points.
それによれば、上記請求項3の発明のように、リード端子(30)を溝(15)に圧入する構成における当該溝(15)を適切に形成することができる。 Accordingly, the groove (15) in the configuration in which the lead terminal (30) is press-fitted into the groove (15) as in the third aspect of the invention can be appropriately formed.
ここで、請求項2に記載の発明のように、請求項1に記載の電子装置の製造方法においては、前記打ち抜き加工は、パンチングによって行うことができる。
Here, as in the invention described in claim 2 , in the method for manufacturing the electronic device described in
また、請求項3に記載の発明のように、請求項1に記載の電子装置の製造方法においては、前記打ち抜き加工は、レーザ照射によって行うことができる。
Further, as in the invention described in claim 3 , in the method of manufacturing the electronic device described in
なお、上記各手段の括弧内の符号は、後述する実施形態に記載の具体的手段との対応関係を示す一例である。 In addition, the code | symbol in the bracket | parenthesis of each said means is an example which shows a corresponding relationship with the specific means as described in embodiment mentioned later.
以下、本発明の実施形態について図に基づいて説明する。なお、以下の各図相互において、互いに同一もしくは均等である部分には、説明の簡略化を図るべく、図中、同一符号を付してある。 Hereinafter, embodiments of the present invention will be described with reference to the drawings. In the following drawings, parts that are the same or equivalent to each other are given the same reference numerals in the drawings for the sake of simplicity.
[全体構成等]
図1は、本発明の実施形態に係る電子装置S1の概略構成を示す図であり、(a)は概略平面図、(b)は(a)中のA−A線に沿った概略断面図である。
[Overall structure, etc.]
FIG. 1 is a diagram illustrating a schematic configuration of an electronic device S1 according to an embodiment of the present invention, where (a) is a schematic plan view, and (b) is a schematic cross-sectional view along the line AA in (a). It is.
図1に示される電子装置S1において、配線基板10は、セラミック基板、プリント基板などからなるものであり、また、単層基板であっても、積層基板(多層基板)であってもよい。本例では、配線基板10としては、一般的に知られているセラミック積層基板を採用している。
In the electronic device S1 shown in FIG. 1, the
このセラミック積層基板としての配線基板10は、たとえばアルミナなどからなる複数のセラミック層11、12、13、14が積層されたものである。なお、図1では、配線基板10は4層のセラミック層11〜14からなるものであるが、2層以上であればよく、もちろん5層以上であってもかまわない。
The
また、図1には示さないが、この配線基板10の表面(図1(b)中、上面)、内部、裏面(図1(b)中、下面)には、それぞれ、表面配線、内層配線、裏面配線が形成されている。
Although not shown in FIG. 1, the front surface wiring and inner layer wiring are respectively provided on the front surface (upper surface in FIG. 1B), inside, and back surface (lower surface in FIG. 1B) of the
ここで、これら配線は、配線基板10の表面、裏面や各セラミック層11〜14の間に設けられたたとえば導体ペーストを印刷してなる導体パターンであり、さらに各セラミック層11〜14に設けられたビアホールなどにより、当該各配線は互いに電気的に接続されている。
Here, these wirings are conductive patterns formed by printing, for example, a conductive paste provided between the front and back surfaces of the
また、配線基板10の表面には、半導体チップ等からなる能動素子20、抵抗やコンデンサ等の受動素子21が搭載されている。
On the surface of the
これら能動素子20および受動素子21は、配線基板10の表面上に銀ペーストや半田などの接合材を介して固定されている。また、能動素子20はボンディングワイヤ22により、配線基板10と結線され電気的に接続されている。
The
また、図示しないが、配線基板10の裏面には、たとえば厚膜抵抗体などの実装部品が実装されている。そして、配線基板10の表面に搭載されている各素子20、21や裏面の実装部品、さらには上記した表面配線、内層配線、裏面配線等の各配線により、配線基板10における回路が構成されている。
Although not shown, a mounting component such as a thick film resistor is mounted on the back surface of the
ここで、配線基板10の表面側には、リード端子としてのリードフレーム30が導電性接合部材40を介して接続されている。
Here, a
図1に示されるように、配線基板10の周辺部には、リードフレーム30との接合部に対応した位置に、溝15が形成されている。そして、リードフレーム30における配線基板10との接続端部が、導電性接合部材40を介して溝15にはめ込まれることにより、配線基板10とリードフレーム30との接合がなされている。
As shown in FIG. 1, a
ここで、溝15は、配線基板10において積層された複数のセラミック層11〜14のうち外面側に位置する層の一部が除去されたものとして構成されている。図1に示される例では、配線基板10の表面側の2層11、12が、その端部から一部除去されて切り欠き部を形成しており、この切り欠き部により溝15が形成されている。
Here, the
そして、図1に示される例では、配線基板10の表面側から3層目(図1(b)の上から3層目)のセラミック層13に形成された配線13aが、溝15内に露出し、リードフレーム30との接合電極となっている。そして、この配線13aとリードフレーム30とが導電性接合部材40を介して電気的に接続されている。
In the example shown in FIG. 1, the
ここで、導電性接合部材40としては、配線基板10とリードフレーム30とを電気的・機械的に適切に接合できるものであれば、特に限定されないが、たとえば、はんだ、銀ペースト、樹脂に金属などの導電性のフィラーが含有されてなる導電性接着剤、あるいは、ろう材などを採用することができる。
Here, the
そして、図1に示されるように、電子装置S1においては、配線基板10、配線基板10上の素子および実装部品、さらには配線基板10とリードフレーム30との接合部が、モールド樹脂50により包み込まれ、封止されている。
As shown in FIG. 1, in the electronic device S <b> 1, the
[製法等]
次に、本実施形態の電子装置S1の製造方法について、図2、図3、図4を参照して説明する。
[Production method]
Next, a method for manufacturing the electronic device S1 of the present embodiment will be described with reference to FIGS.
本製造方法は、大きくは、配線基板10の周辺部にて、リードフレーム30との接合部に対応した位置に溝15を形成する工程と、リードフレーム30における配線基板10との接続端部を、導電性接合部材40を介して溝15にはめ込むことにより、配線基板10とリードフレーム30とを接合する工程と、樹脂封止工程とからなる。
In this manufacturing method, roughly, a step of forming a
図2は、本製造方法における配線基板10の製造工程を示す概略断面図、図3は、配線基板10とリードフレーム30との接合工程を示す図であり、(a)、(c)、(e)は概略断面図、(b)、(d)は接合部の拡大斜視図である。また、図4は、配線基板10の溝15へのリードフレーム30の接合方法の種々の例を示す概略断面図である。
2 is a schematic cross-sectional view showing a manufacturing process of the
まず、図2(a)に示されるように、各セラミック層11〜14となるグリーンシート11g、12g、13g、14gに、上記したビアホールや表面配線、内層配線、裏面配線となる導体パターンを形成する。これらの形成方法は、一般的な積層基板における方法に準じて行うことができる。
First, as shown in FIG. 2A, the above-described via holes, surface wiring, inner layer wiring, and back surface wiring are formed on the
そして、溝15となる切り欠き部を形成するために、配線基板10の表面側の層の一部を除去する。図2(a)では、上記図1に示される例に対応して、上側の2層のグリーンシート11g、12gの端部の一部を、レーザーやパンチなどによりカッティングして除去する。
Then, in order to form a notch to be the
次に、図2(b)、(c)に示されるように、各グリーンシート11g〜14gを積層し、この積層体を焼成する。これにより、周辺部に溝15が形成された配線基板10ができあがる。
Next, as shown in FIGS. 2B and 2C, the green sheets 11g to 14g are stacked, and the stacked body is fired. As a result, the
なお、この配線基板10においては、必要に応じ、ICなどの実装性を確保するため表面配線や裏面配線にメッキ処理を施したり、裏面に厚膜抵抗体などを印刷・焼成にて形成する。また、必要に応じて保護ガラスを形成したり、抵抗値の調整のため、レーザトリミングを行ったりする。
In this
ここで、図2に示される例では、配線基板10の表面側から3層目(図1(b)の上から3層目)のセラミック層13に形成された配線13aが、リードフレーム30との接合電極として溝15内に露出している。なお、上記したグリーンシートのカッティングは、上側から第1層のみであったり、第3層までであったり、必要な溝15の深さに応じて、どの層でもかまわない。
Here, in the example shown in FIG. 2, the
次に、配線基板10とリードフレーム30とを接合する工程を行う。
Next, a step of bonding the
まず、図3(a)、(b)に示されるように、配線基板10の溝15内に導電性接合部材40を配設する。この導電性接合部材40の配設は、リードフレーム30側に行ってもよい。その配設方法としては、特に限定するものではないが、印刷やディスペンスなどを採用することができる。
First, as shown in FIGS. 3A and 3B, the
ここで、印刷によって導電性接合部材40の配設を行う場合、リードフレーム30側に導電性接合部材40を配することが好ましい。なぜなら、溝15のような凹みのある配線基板10上に印刷する場合、溝15内にうまく導電性接合部材40が入らないことがあるためである。
Here, when the
そして、図3(c)、(d)に示されるように、リードフレーム30における配線基板10との接続端部を、導電性接合部材40を介して溝15にはめ込む。このとき、図4に示されるような各種の接合治具を用いて、リードフレーム30の溝15へのはめ込みを行うことができる。
Then, as shown in FIGS. 3C and 3D, the connection end portion of the
図4(a)では、リードフレーム30は、紙面垂直方向へ複数本配列している。この接合治具900は、台910に搭載された配線基板10に対して、複数本のリードフレーム30を一括して押さえることにより、複数本のリードフレーム30を溝15へ同時にはめ込むものである。
In FIG. 4A, a plurality of lead frames 30 are arranged in the direction perpendicular to the paper surface. The joining
このとき、リードフレーム30の溝15へのはめ込み時においては、配線基板10の表面に素子20、21などが搭載されている場合がある。そのような場合、接合治具がこれら表面の素子などに接触しないようにすることが好ましい。
At this time, when the
そういった観点から、図4(b)に示されるような接合治具901を採用することが好ましい。これは、図4(a)に示される接合治具900において、配線基板10の表面上の部分を取り去ったものである。
From such a viewpoint, it is preferable to employ a joining
また、個々のリードフレーム30に対する接合治具の押さえ方としては、図4(c)、(d)に示されるような方法を採用することができる。
Moreover, as a method of pressing the joining jig with respect to each
たとえば、図4(c)に示される接合治具902では、リードフレーム30を押さえる突起が設けられている。それによって、リードフレーム30の厚さが、溝15の深さよりも低いような場合に、上記接合治具902の突起によって溝15の底までリードフレーム30を押さえ込むことができる。
For example, the joining
また、図4(d)に示される接合治具903では、個々のリードフレーム30を挟み付ける部位が設けられている。それによって、個々のリードフレーム30がずれないように保持されるため、溝15内へのはめ込みを確実に行うことができる。
Further, in the joining
こうして、上記図3(c)、(d)に示されるように、リードフレーム30における配線基板10との接続端部を、導電性接合部材40を介して溝15にはめ込んだ後、導電性接合部材40の硬化を行うことにより、配線基板10とリードフレーム30とが電気的・機械的に接合される。
Thus, as shown in FIGS. 3C and 3D, the connection end of the
続いて、この配線基板10の表面に、上記の能動素子20および受動素子21を銀ペーストや半田などの接合材を介して搭載・固定し、また、能動素子20にワイヤボンディングを行ってボンディングワイヤ22を形成し、能動素子20と配線基板10とを電気的に接続する。
Subsequently, the
なお、この能動素子20および受動素子21の配線基板10への搭載・固定およびワイヤボンディングは、リードフレーム30と配線基板10とを接合する前において、行うようにしてもかまわない。
The mounting and fixing of the
しかる後、金型を用いたトランスファーモールド法などにより、樹脂封止工程を行うことにより、配線基板10、配線基板10上の素子および実装部品、さらには配線基板10とリードフレーム30との接合部をモールド樹脂50により封止する。
Thereafter, by performing a resin sealing process by a transfer molding method using a mold, etc., the
なお、ここまでの状態では、図示しないが、リードフレーム30は個々のリードフレーム30がタイバーなどでフレーム部に一体に連結されている。そこで、モールド樹脂50による樹脂封止の後に、リードフレーム30の切り離しを行う。こうして、上記電子装置S1ができあがる。
In the state so far, although not shown, each
[効果等]
ところで、本実施形態によれば、配線基板10とリード端子としてのリードフレーム30とが導電性接合部材40を介して接合されてなる電子装置S1において、配線基板10の周辺部にて、リードフレーム30との接合部に対応した位置に溝15が形成されており、リードフレーム30における配線基板10との接続端部が、導電性接合部材40を介して溝15にはめ込まれることにより、配線基板10とリードフレーム30との接合がなされていることを特徴とする電子装置S1が提供される。
[Effects]
By the way, according to the present embodiment, in the electronic device S <b> 1 in which the
それによれば、リードフレーム30が、配線基板10の溝15にはめ込まれて接合されているので、従来に比べて配線基板10とリードフレーム30との結合を強固なものにできる。
According to this, since the
また、この溝15は、上述したように、配線基板10を作製する際に同時に形成することができるため、リードフレーム30と配線基板10との接合において工程数の増加を招くことは無い。
Further, as described above, since the
よって、本実施形態によれば、リード端子としてのリードフレーム30と配線基板10との接合において工程数の増加を招くことなく、当該接合強度を強固なものにすることができる。
Therefore, according to the present embodiment, the bonding strength can be increased without increasing the number of steps in bonding the
特に、上記した本実施形態の例では、配線基板10はセラミック基板であり、しかも、複数のセラミック層11〜14が積層されてなるセラミック積層基板であった。そして、溝15は、積層された複数の層11〜14のうち外面側に位置する層11、12の一部が除去されたものとして構成されていた。
In particular, in the example of the present embodiment described above, the
ここで、上述したように、本実施形態の配線基板10としては、単層基板でもよいが、この場合にも、基板周辺部の一部をカットしたりプレスしたりすることで、同様に溝を形成することができる。
Here, as described above, the
[好ましい例]
次に、本実施形態の種々の好ましい形態について述べておく。
[Preferred example]
Next, various preferred embodiments of the present embodiment will be described.
図5(a)〜(d)、図6(a)〜(d)は、リードフレーム30と溝15とが、リードフレーム30の長手方向への移動を防止するように互いに引っかかる形状を有するものとした種々の例を示す図である。
5 (a) to 5 (d) and FIGS. 6 (a) to 6 (d) have a shape in which the
ここで、図5(a)〜(d)は平面図、図6(a)、(d)は断面図、図6(b)、(c)は、リードフレーム30の斜視図である。
5A to 5D are plan views, FIGS. 6A and 6D are cross-sectional views, and FIGS. 6B and 6C are perspective views of the
図5(a)〜(d)に示される例では、リードフレーム30および溝15の幅方向において、リードフレーム30および溝15に段差や凹凸を設けた形状としている。具体的には、図5において、(a)はリードフレーム30および溝15を台形状とし、(b)は菱形とし、(c)は鍵形とし、(d)はT字型としている。
In the example shown in FIGS. 5A to 5D, the
また、図6(a)、(d)に示される例では、リードフレーム30の厚み方向すなわち溝15の深さ方向において、リードフレーム30および溝15の一方に凸部30a、15aを設け、他方に凹部30b、15bを設けることにより、これらの凹部と凸部とのかみ合わせるようにしている。
In the example shown in FIGS. 6A and 6D, in the thickness direction of the
これらリードフレーム30および溝15の凸部や凹部は、プレスやハーフエッチングなどにより、形成することができる。
The convex portions and concave portions of the
なお、図6(b)、(c)は、リードフレーム30の凹部30bの種々の例を示すもので、図6(b)に示されるように、リードフレーム30の凹部30bは、ハーフエッチングにより形成されたされた窪み部であってもよいし、図6(c)に示されるように、プレス形成された貫通穴であってもよい。
6B and 6C show various examples of the
また、図7は、リード端子としてのリードフレーム30を溝15に圧入する構成を説明するための図である。図7において、(a)は平面図、(b)、(c)、(d)はリードフレームの接続端部の断面図、(e)、(f)は溝15の断面図である。
FIG. 7 is a view for explaining a configuration in which a
図7(a)に示されるように、リードフレーム30の接続端部よりも溝15の開口寸法を小さくすることにより、リードフレーム30の溝15への圧入による固定が可能となる。それにより、リードフレーム30と溝15との接合強度をより強固なものにすることができ、好ましい。
As shown in FIG. 7A, by making the opening size of the
また、図7(e)、(f)は、当該圧入に適した溝15の形状の例を示している。また、リードフレーム30の接続端部についても、図7(b)〜(d)に示されるような形状とすれば、当該圧入固定に適用して好ましい。
Moreover, FIG.7 (e), (f) has shown the example of the shape of the groove |
これら図7(b)〜(d)に示されるリードフレーム30では、リードフレーム30における薄肉となった出っ張り部が圧入によって変形したり、溝15に引っかかったりするため、溝15との固定が強固になる。
In the
なお、図7(b)〜(d)に示されるリードフレーム30は、プレスやエッチングにより形成することができる。また、図7(e)、(f)に示されるような圧入に適した溝15の形状は、図8(a)、(b)に示されるようなパンチ加工、レーザ穴あけ加工により形成することができる。
Note that the
この図8に示されるような溝15の製造方法は、配線基板10が複数の層11〜14が積層されてなる積層基板であるがゆえに、適用できるものである。
The manufacturing method of the
まず、図8(a)に示される方法は、溝15を形成する工程において、配線基板10を構成する複数の層11〜14のうち外面側に位置する層(本例では層11または層12)に対して、グリーンシートの状態で、斜め方向から複数回、異なる角度でパンチ920による打ち抜き加工を行う。
First, in the method shown in FIG. 8A, in the step of forming the
そのことにより、当該打ち抜きがなされた層11または12を貫通するとともに打ち抜き加工が行われた層11または12において一面側の開口寸法よりも他面側の開口寸法の方が大きい貫通溝15を形成する。
As a result, a through-
そして、この貫通溝15が形成された層を、貫通溝15における開口寸法の大きい方の開口部がリードフレーム30がはめ込まれる方の開口部となるように、配線基板10に組み込めば、上記図7(f)に示されるような溝15ができあがる。
Then, if the layer in which the through
また、このような貫通溝15が形成された層を2層、積層させれば、上記図7(e)に示されるような溝15ができあがる。
Further, if two layers having such through
また、上記したパンチング以外にも、レーザ照射によっても溝15が形成できる。図8(b)では、溝15が形成されるべき層11または12に、レーザ照射装置のノズル930からレーザ光931を照射する。すると、穴が熱伝導によって広がった形状となるため、上記図7(e)や(f)に示されるような溝15を形成することができる。
In addition to the above punching, the
また、このレーザ照射による打ち抜き加工においても、上記パンチングによる打ち抜き加工と同様に、層に対して斜め方向から複数回、異なる角度で打ち抜き加工を行うようにしてもよい。それにより、上記図7(e)や(f)に示されるような溝15を形成することができる。
Also in the punching process by laser irradiation, the punching process may be performed at a different angle a plurality of times from an oblique direction with respect to the layer, similarly to the punching process by the punching. Thereby, the
また、図9は、本実施形態の溝15におけるリードフレーム30との接合電極の変形例を示す概略断面図である。
FIG. 9 is a schematic cross-sectional view showing a modification of the bonding electrode with the
上記図1に示される例では、配線基板10の表面側から3層目(図1(b)の上から3層目)のセラミック層13に形成された配線13aが、溝15内に露出し、リードフレーム30との接合電極となっている。
In the example shown in FIG. 1, the
この構成の場合、配線基板10上のすべて溝15において、リードフレーム30との接合電極が、配線基板10の表面側から3層目のセラミック層13における配線13aとなる。つまり、当該接合電極の引き出される層が同一に決まってしまう。
In this configuration, in all the
それに対して、図9に示される例では、溝15は、積層された複数の層11、12、13、14のうち外面側に位置する3層11、12、13の一部が除去されたものとして構成されている。
On the other hand, in the example shown in FIG. 9, the
そして、そのうちの所定の2層12、13の間に位置する配線17から溝15内へ引き出された電極16が設けられており、この電極16とリードフレーム30とが導電性接合部材40を介して電気的に接続されている。
An
つまり、この図9に示されるような構成では、溝15は、積層された複数の層11〜14のうち外面側に位置する2以上の層11〜13の一部が除去されたものとして構成し、当該一部が除去された2以上の層11〜13のうちの所定の2層12、13の間から溝15内へ電極16を引き出し、この電極16とリードフレーム30とを導電性接合部材40を介して接合するものである。
That is, in the configuration as shown in FIG. 9, the
それによれば、リードフレーム30との接合電極を、配線基板10上のそれぞれの溝15で同一の層から引き出す必要はなく、たとえば、ある溝15では第2層から、ある溝15では第4層から引き出すというように、幅広い適用が可能となる。この図9に示される構成の形成方法は、図10に示される。
According to this, it is not necessary to lead out the joining electrode with the
この図9に示される構成は、図10(a)、(b)に示されるように、溝15に露出するセラミック層11、12、13の端面にメッキを施すことによって、所定の2層12、13の間に位置する配線17につながるように電極16を形成することで、作製することができる。
In the configuration shown in FIG. 9, as shown in FIGS. 10A and 10B, the end surfaces of the
また、図11は、上記図9に示される変形例をさらに変形した構成を示す概略断面図である。 FIG. 11 is a schematic sectional view showing a configuration obtained by further modifying the modification shown in FIG.
図11に示される例では、上記図9において、電極16へつながる配線17を挟む所定の2層12、13のうちの1層12の一部が、タングステン(W)やモリブデン(Mo)などの金属体18に置き換えられたものである。
In the example shown in FIG. 11, in FIG. 9, a part of one
そして、金属体18は、電極16と熱的および電気的に接続されている。なお、上記所定の2層12、13のうちの両方の一部が、この金属体18に置き換えられたものであってもよい。
The
それによれば、配線基板10の熱を、金属体18から電極16を介してリードフレーム30に逃がしやすくできるとともに、電極16と金属体18とが電気的に導通することにより、電極16に流れる電流を大きくすることができる。つまり、放熱性の向上および大電流化にとって好ましいものとなる。
According to this, the heat of the
なお、このように積層基板のセラミックの一部を金属体に置き換えることは、一般に知られていることであり、対象となるセラミック層をパンチングなどで打ち抜いてそこへ金属体18をはめ込めばよい。この金属体は「トラフ」とも呼ばれることがある。
Replacing a part of the ceramic of the multilayer substrate with a metal body is generally known, and the target ceramic layer is punched out by punching or the like, and the
図12は、導電性接合部材40のはみ出し防止に好ましい構成の例を示す概略断面図である。
FIG. 12 is a schematic cross-sectional view illustrating an example of a preferable configuration for preventing the
図12に示されるように、溝15は、深さ方向に段差15dを有することにより開口部側の開口寸法は底部側の開口寸法よりも大きくなっている。それによれば、本例の溝15は、その開口部側が底部側よりも大径部となる。
As shown in FIG. 12, the
本例では、図12に示されるように、溝15内に導電性接合部材40を配設して、図12(b)に示されるように、リードフレーム30を溝15にはめ込んだ際に、導電性接合部材40は、スペースの大きい開口部側の大径部の部分に溜められる。
In this example, as shown in FIG. 12, when the
そのため、溝15の外への導電性接合部材40のはみ出しを抑制しやすくなる。このことは、隣り合うリードフレーム30間の短絡を防止することにもつながり、リードフレーム30の間隔が狭い場合にも対応でき、リードフレーム30の多ピン化に伴う高密度実装に対応することができる。
Therefore, it becomes easy to suppress the protrusion of the
(他の実施形態)
なお、配線基板に搭載される素子や部品は、上記した実施形態に記載されているものに特に限定されるものではない。
(Other embodiments)
The elements and components mounted on the wiring board are not particularly limited to those described in the above-described embodiment.
また、配線基板に溝を形成し、この溝にリード端子をはめ込むことで配線基板とリード端子との接合を行うことは、この溝にリード端子が入り込む分、従来よりもリード端子と配線基板の面とを同じ高さに近いものにできるという利点もある。 In addition, forming a groove in the wiring board and fitting the lead terminal into the groove to join the wiring board and the lead terminal means that the lead terminal and the wiring board are inserted into the groove as much as conventional. There is also an advantage that the surface can be close to the same height.
さらには、配線基板からの熱を直接リード端子を介して放熱することができるという点も、この配線基板とリード端子とが導電性接合部材を介して接合されてなる電子装置における特徴点である。 Furthermore, the fact that the heat from the wiring board can be directly radiated through the lead terminal is also a characteristic point in the electronic device in which the wiring board and the lead terminal are joined through the conductive joining member. .
以上のことから、本発明は、上記実施形態に示した構成以外にも、配線基板とリード端子とが導電性接合部材を介して接合されてなる電子装置であれば、適用可能であることはもちろんである。 From the above, the present invention can be applied to any electronic device in which the wiring board and the lead terminal are bonded via the conductive bonding member in addition to the configuration shown in the above embodiment. Of course.
10…配線基板、11、12、13、14…配線基板のセラミック層、
15…配線基板の溝、16…電極、18…金属体、
30…リード端子としてのリードフレーム、40…導電性接合部材。
10 ... Wiring board, 11, 12, 13, 14 ... Ceramic layer of the wiring board,
15 ... groove of wiring board, 16 ... electrode, 18 ... metal body,
30 ... Lead frame as a lead terminal, 40 ... Conductive joining member.
Claims (3)
前記配線基板(10)の周辺部にて、前記リード端子(30)との接合部に対応した位置に、溝(15)を形成する工程と、
前記リード端子(30)における前記配線基板(10)との接続端部を、前記導電性接合部材(40)を介して前記溝(15)にはめ込むことにより、前記配線基板(10)と前記リード端子(30)とを接合する工程とを備え、
前記溝(15)を形成する工程では、前記配線基板(10)を構成する複数の層(11〜14)のうち外面側に位置する層(11、12)に対して斜め方向から複数回、異なる角度で打ち抜き加工を行うことにより、
当該層(11、12)を貫通するとともに前記打ち抜き加工が行われた層(11、12)において一面側の開口寸法よりも他面側の開口寸法の方が大きい貫通溝(15)を形成することを特徴とする電子装置の製造方法。 An electronic device in which a wiring substrate (10) made of a laminated substrate in which a plurality of layers (11, 12, 13, 14) are laminated and a lead terminal (30) are joined via a conductive joining member (40). A manufacturing method for manufacturing
Forming a groove (15) at a position corresponding to a joint portion with the lead terminal (30) at a peripheral portion of the wiring board (10);
By fitting the connection end of the lead terminal (30) with the wiring board (10) into the groove (15) through the conductive bonding member (40), the wiring board (10) and the lead are connected. Joining the terminal (30),
In the step of forming the groove (15), a plurality of times from the oblique direction with respect to the layers (11, 12) located on the outer surface side among the plurality of layers (11-14) constituting the wiring substrate (10), By punching at different angles,
A through groove (15) is formed which penetrates the layer (11, 12) and has a larger opening dimension on the other side than the opening dimension on the one side in the punched layer (11, 12). A method for manufacturing an electronic device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004006669A JP4380334B2 (en) | 2004-01-14 | 2004-01-14 | Manufacturing method of electronic device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004006669A JP4380334B2 (en) | 2004-01-14 | 2004-01-14 | Manufacturing method of electronic device |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2005203487A JP2005203487A (en) | 2005-07-28 |
JP4380334B2 true JP4380334B2 (en) | 2009-12-09 |
Family
ID=34820565
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004006669A Expired - Fee Related JP4380334B2 (en) | 2004-01-14 | 2004-01-14 | Manufacturing method of electronic device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4380334B2 (en) |
Families Citing this family (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4238864B2 (en) | 2005-11-02 | 2009-03-18 | ソニー株式会社 | Semiconductor device and manufacturing method of semiconductor device |
JP4711823B2 (en) * | 2005-12-22 | 2011-06-29 | 京セラ株式会社 | Electronic component storage package and electronic device |
JP5454226B2 (en) * | 2010-03-01 | 2014-03-26 | パナソニック株式会社 | Heat dissipation board and manufacturing method thereof |
JP2011249575A (en) * | 2010-05-27 | 2011-12-08 | Kyocera Corp | Wiring board and electronic apparatus |
JP5743561B2 (en) * | 2010-08-31 | 2015-07-01 | 京セラ株式会社 | Wiring board |
JP2012089745A (en) * | 2010-10-21 | 2012-05-10 | Kyocera Corp | Lead terminal and insulating substrate with lead terminal and package for housing element |
-
2004
- 2004-01-14 JP JP2004006669A patent/JP4380334B2/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP2005203487A (en) | 2005-07-28 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4270095B2 (en) | Electronic equipment | |
US6760227B2 (en) | Multilayer ceramic electronic component and manufacturing method thereof | |
JP2006073763A (en) | Manufacturing method for multilayer board | |
WO2009005108A1 (en) | Resistor | |
JP4265607B2 (en) | Laminated electronic component and mounting structure of laminated electronic component | |
JP4380334B2 (en) | Manufacturing method of electronic device | |
WO2007138771A1 (en) | Semiconductor device, electronic parts module, and method for manufacturing the semiconductor device | |
JP4590961B2 (en) | Electronic equipment | |
JP2007234749A (en) | Manufacturing method of chip-shape solid electrolytic capacitor | |
JP5388601B2 (en) | Electronic component storage package | |
JP2008205253A (en) | Circuit device and method of manufacturing the same | |
JP4942452B2 (en) | Circuit equipment | |
JP5011879B2 (en) | Manufacturing method of semiconductor device and lead frame assembly | |
JP5104020B2 (en) | Mold package | |
JP4946959B2 (en) | Manufacturing method of semiconductor device | |
JPH077033A (en) | Manufacture of semiconductor packaging device | |
JP4655300B2 (en) | Lead frame | |
JP2001284800A (en) | Substrate for output semiconductor module having through contact by solder and method for manufacturing substrate | |
JP6898560B2 (en) | Electronic component bonding board | |
JPH09214093A (en) | Mounting circuit device and manufacture of the same | |
JP4062432B2 (en) | Circuit board and manufacturing method thereof | |
JP2003243562A (en) | Resin sealed board and its manufacturing method, intermediate product of board and its manufacturing method | |
JP3889710B2 (en) | Hybrid integrated circuit device | |
JP4388168B2 (en) | Resin molded substrate | |
JPH08213743A (en) | Board for mounting electronic device |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20060213 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20070906 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20070918 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20071112 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20081118 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20081217 |
|
A911 | Transfer of reconsideration by examiner before appeal (zenchi) |
Free format text: JAPANESE INTERMEDIATE CODE: A911 Effective date: 20090126 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20090901 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20090914 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121002 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121002 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121002 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20131002 Year of fee payment: 4 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
LAPS | Cancellation because of no payment of annual fees |