JP4193453B2 - Electronic component mounting substrate, electro-optical device, electronic component mounting substrate manufacturing method, electro-optical device manufacturing method, and electronic apparatus - Google Patents
Electronic component mounting substrate, electro-optical device, electronic component mounting substrate manufacturing method, electro-optical device manufacturing method, and electronic apparatus Download PDFInfo
- Publication number
- JP4193453B2 JP4193453B2 JP2002255253A JP2002255253A JP4193453B2 JP 4193453 B2 JP4193453 B2 JP 4193453B2 JP 2002255253 A JP2002255253 A JP 2002255253A JP 2002255253 A JP2002255253 A JP 2002255253A JP 4193453 B2 JP4193453 B2 JP 4193453B2
- Authority
- JP
- Japan
- Prior art keywords
- substrate
- inspection
- terminals
- pair
- electro
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/11—Printed elements for providing electric connections to or between printed circuits
- H05K1/118—Printed elements for providing electric connections to or between printed circuits specially for flexible printed circuits, e.g. using folded portions
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
- H01L2224/73203—Bump and layer connectors
- H01L2224/73204—Bump and layer connectors the bump connector being embedded into the layer connector
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K2201/00—Indexing scheme relating to printed circuits covered by H05K1/00
- H05K2201/09—Shape and layout
- H05K2201/09209—Shape and layout details of conductors
- H05K2201/09372—Pads and lands
- H05K2201/09381—Shape of non-curved single flat metallic pad, land or exposed part thereof; Shape of electrode of leadless component
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K2201/00—Indexing scheme relating to printed circuits covered by H05K1/00
- H05K2201/09—Shape and layout
- H05K2201/09209—Shape and layout details of conductors
- H05K2201/09372—Pads and lands
- H05K2201/09409—Multiple rows of pads, lands, terminals or dummy patterns; Multiple rows of mounted components
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K2201/00—Indexing scheme relating to printed circuits covered by H05K1/00
- H05K2201/09—Shape and layout
- H05K2201/09209—Shape and layout details of conductors
- H05K2201/09654—Shape and layout details of conductors covering at least two types of conductors provided for in H05K2201/09218 - H05K2201/095
- H05K2201/09727—Varying width along a single conductor; Conductors or pads having different widths
Landscapes
- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Liquid Crystal (AREA)
- Printing Elements For Providing Electric Connections Between Printed Circuits (AREA)
- Combinations Of Printed Boards (AREA)
- Wire Bonding (AREA)
Description
【0001】
【発明の属する技術分野】
本発明は、プリント回路基板(Printed Circuit Board:PCB)およびフレキシブルプリント基板(Flexible Printed Circuit:FPC)を利用する電子部品の実装基板に関する。また、本発明は、その実装基板を用いて構成される電気光学装置および電子機器に関する。
【0002】
【背景技術】
一般に、液晶表示装置、EL(Electro Luminescence)装置等といった電気光学装置は、液晶、EL等といった電気光学物質を基板上に配置してパネル構造を形成し、さらに、適宜の電子回路を搭載した回路基板を、そのパネル構造に接続することによって形成される。また、その回路基板上には、電解コンデンサ等といったチップ部品やICチップ等が実装されることが多い(例えば特許文献1参照)。
【0003】
回路基板上に電子部品、特にチップ部品を実装する方式として、SMT(Surface Mount Technology:表面実装技術)に基づく実装方式があることは広く知られている。このSMTに基づく実装方式は、基本的には、リフロー半田付け処理を利用した実装方式である。例えば、この方式は、半田が載せられた基板上に電子部品をマウントし、その後に半田を加熱して電子部品を基板に半田付けするという工程を有する実装方式である。
【0004】
近年、このSMTに基づく実装方式において、リフロー半田付け処理によって実装する電子部品、例えば、電解コンデンサ等といったチップ部品に加えて、基板上にICチップを実装する、要するに、COF(Chip on Film)に基づく実装方式の必要性も高まっている。
【0005】
上述した実装方式の基板形態は、例えば、チップ部品実装領域にリフロー半田付け処理によってチップ部品を実装したSMT方式部分と、ICチップ実装領域に熱圧着処理によってICチップを実装するCOF方式部分を兼ね備えたタイプ等がある。
【0006】
リフロー半田付けに適したチップ部品以外にICチップも実装する場合は、一般的に、ICチップをACF(Anisotropic Conductive Film:異方性導電膜)等といった接着要素を用いて熱圧着、すなわち加圧および加熱、によって基板上に実装した後、チップ部品を実装するためのリフロー半田付け処理を実施している。
【0007】
このように、様々なICチップや電子部品を実装する必要がある場合、それぞれの性質に応じた基板を利用することが想定できる。例えば、各々がICや電子部品などを実装したPCB基板とFPC基板とを電気的に接続して装置を構成することが考えられる。
【0008】
【特許文献1】
特開2002−32030号公報
【0009】
【発明が解決しようとする課題】
上述した電子部品の実装基板の接合工程、要するに、COF方式によりドライバICチップを実装したFPC基板と、SMT方式によりチップ部品を実装したPCB基板との接続後に行われる基板間の電気的接続の検査工程は、通常、外観検査により実施されることが多い。
【0010】
一般的に、FPC基板とPCB基板の接続要素としては、ACFが用いられることが多い。ACFは、通常、導電粒子と接着剤から構成されている。その接続は、基本的には圧力による接続であり、導電粒子が電気接続を、接着剤が圧接状態を保持する機能を分担する。要するに、ACF接続による導通の機能を果たすのは導電粒子である。導電粒子は、その種類にも左右されるが、一般的には、相対する電極間に約20個程度確保すれば信頼性が保てると言われている。これらの導電粒子が、十分に圧接され、また、十分な個数を確保できれば、その電気的接続は、良好であるといえる。
【0011】
上記FPC基板と上記PCB基板の接続部分における導電粒子の観察は、基板が透明でないために、顕微鏡観察を実施することは困難である。そのため、ACFによる接合工程に対する電気的接続の検査は、以下のように行われる。
【0012】
検査方法の1つとして、ACF接続の評価を行う場合、PCB基板とFPC基板を剥がし、導電粒子の顕微鏡観察を実施する方法が考えられる。しかし、この場合、評価に用いた基板は、分解されることになる。
【0013】
一方、接続した基板を分解しない検査方法としては以下のようなものがある。
【0014】
1つめは、接合工程による圧着時のACF染み出し状態を外観評価するという方法である。この方法により、圧着領域に十分な圧力が均一にかかっているかかどうか評価することができる。
【0015】
2つめは、基板圧着領域における表面の凹凸性を観察する方法である。接合工程において、基板圧着領域に、十分な圧力が均一にかかっている場合、基板表面の凹凸は、大きく、明確である。これは、基板配線材料として用いられているCu(銅)配線の膜厚が、10数μmから30μmあるため、その厚みが、基板表面に現れるのである。しかし、十分な圧力がかかっていない場合、基板表面の凹凸は、小さく、平坦である。
【0016】
しかし、上述したように、これらの外観検査は、定量的な検査ではなく、目視評価になってしまうため、精度の均一化が難しい。したがって、ACFの接続不良が発生していたとしても、接続不良基板と判定されない場合もあり、検査の信頼性に欠ける傾向がある。
【0017】
本発明は、以上説明した内容を鑑みてなされたものであり、ACFを利用して基板上の端子間を電気的に接続する際に、接続状態を容易かつ定量的に検出することを目的とする。
【0018】
【課題を解決するための手段】
本発明の1つの観点では、電子部品の実装基板において、第1の基板に設けられた端子と第2の基板に設けられた端子とがACFによって電気的に接続されるように、前記第1の基板と前記第2の基板とを接合した電子部品の実装基板であって、前記第1の基板には、前記第1の基板と前記第2の基板とを接合したときに互いに導通する少なくとも一対の検査用端子が設けられ、前記第2の基板には、前記第1の基板と前記第2の基板とを接合したときに前記一対の検査用端子を互いに導通させる検査用導通端子が設けられ、前記検査用導通端子が前記検査用端子と重なる領域において、前記第2の基板と前記検査用導通端子とに連通するスルーホールが設けられていることが好ましい。
【0019】
上記電子部品の実装基板において、上記検査用端子は、上記一方の基板における両端部に配置されていることが好ましい。実装時に、加圧ヘッドが傾いている等の理由により、圧力の均一性が取れていない場合がある。このとき、圧力不足が顕著に現れるのは、基板上の両端に配置された端子である。要するに、基板上の両端に設けられている端子は、電気的に導通が取れていないなどの接続不良が発生しやすい箇所となる。したがって、上記検査用端子を、基板の両端部に配置することによって、電子部品の実装基板は、効率的に、接続不良を検出することができる。
【0020】
上記電子部品の実装基板の他の一態様では、上記検査用端子は、上記検査用端子が設けられた基板上の上記複数の端子の外側に設けられていることが好ましい。
【0021】
上記電子部品の実装基板のさらに他の一態様では、上記一対の基板のうち、上記検査用端子が設けられた基板と異なる方の基板には、上記検査用端子に電気的に接続されて上記検査用端子を導通する検査用導通端子を備えることが好ましい。
【0022】
上記電子部品の実装基板のさらに他の一態様では、上記検査用導通端子は、上記検査用端子と重なる位置において、上記検査用端子に接触することを可能とするスルーホールを有することが好ましい。上記スルーホールを設けることにより、例えば、抵抗測定用の他の設計パターンを作製する必要もなくなる。
【0023】
上記電子部品の実装基板のさらに他の一態様では、上記一対の基板は、ACFにより接合され、上記スルーホールは、上記ACFが設けられていない位置に設けられていることが好ましい。
【0024】
上記電子部品の実装基板のさらに他の一態様では、上記一対の基板のうちの一方の基板は、半導体素子を実装したフレキシブルプリント基板とすることができ、上記一対の基板のうちの他方の基板は、他の半導体素子を実装したフレキシブルプリント基板とすることができる。
【0025】
上記の電子部品の実装基板のさらに他の一態様では、上記一対の基板のうちの一方の基板は、半導体素子を実装したフレキシブルプリント基板とすることができ、上記一対の基板のうちの他方の基板は、プリント回路基板とすることができる。
【0026】
電気光学装置は、電気光学パネルと、上記電子部品の実装基板と、を備えることができる。上記一対の基板のうち一方の基板が、上記電気光学パネルに取り付けられていることができる。
【0027】
上記電気光学パネルは液晶パネルであり、上記半導体素子は、上記液晶パネルの駆動用IC(ドライバIC)としてもよい。上記液晶パネルは、STN(Super Twisted Nematic)モード、TFT−LCD(Thin Film Transistor-Liquid Crystal Display)およびTFD−LCD(Thin Film Dynode-Liquid Crystal Display)などを用いてもよい。
【0028】
さらに、本発明は、上記の電気光学装置を表示部として備えることにより、電子機器を構成することができる。
【0029】
本発明の他の観点では、電子部品の実装基板の製造方法において、第1の基板と第2の基板とを接合したときに互いに導通する少なくとも一対の検査用端子が設けられた該第1の基板と、該第1の基板と該第2の基板とを接合したときに該一対の検査用端子を互いに導通させる検査用導通端子が設けられた該第2の基板とを、該第1の基板に設けられた端子と該第2の基板に設けられた端子とがACFによって電気的に接続されるように接合する工程を有する電子部品の実装基板の製造方法であって、前記検査用導通端子が前記検査用端子と重なる領域に、前記第2の基板と前記検査用導通端子とに連通するスルーホールが設けられ、前記スルーホールを介してプローバを前記検査用端子に接触させて前記一対の検査用端子間の抵抗を測定することにより、前記一対の基板の電気的接続を検査する検査工程と、を有する。上記一対の基板を接合する工程は、例えば、ACFなどの接着要素を挟んで、熱圧着工程を実施してもよい。
【0030】
本発明の他の観点では、電気光学装置の製造方法において、第1の基板と第2の基板とを接合したときに互いに導通する少なくとも一対の検査用端子が設けられた該第1の基板と、該第1の基板と該第2の基板とを接合したときに該一対の検査用端子を互いに導通させる検査用導通端子が設けられた該第2の基板とを、該第1の基板に設けられた端子と該第2の基板に設けられた端子とがACFによって電気的に接続されるように接合する工程と、前記第1の基板と前記第2の基板のうちの一方の基板に電気光学パネルを取り付ける工程と、を有する電気光学装置の製造方法であって、前記検査用導通端子が前記検査用端子と重なる領域に、前記第2の基板と前記検査用導通端子とに連通するスルーホールが設けられ、
前記スルーホールを介してプローバを前記検査用端子に接触させて前記一対の検査用端子間の抵抗を測定することにより、前記一対の基板の電気的接続を検査する検査工程と、を有する。上記一対の基板を接合する工程は、例えば、ACFなどの接着要素を挟んで、熱圧着工程を実施してもよい。また、上記一対の基板いずれか一方に対して、電気光学パネルを接合する工程は、例えば、ACFなどの接着要素を挟んで、熱圧着工程を実施してもよい。
【0031】
【発明の実施の形態】
以下、図面を参照して本発明の好適な実施の形態について説明する。
【0032】
[第1実施形態]
本実施形態は、COF方式によるFPC基板に配置された配線端子と、SMT方式によるPCB基板に配置された配線端子とが、熱圧着によって電気的に接続され、その接続部における配線端子に、検査測定用パッドのパターンを設けたことを特徴とする。
【0033】
(構成)
図1は、本発明に係るCOF方式によるFPC基板とSMT方式によるPCB基板とを実装した液晶表示装置の例を示す。また、図2に、図1に示した液晶表示装置100のA−A’の断面図を示す。
【0034】
液晶パネル102においては、ガラスやプラスチックなどの絶縁基板である第1基板1aと第2基板1bの表面に透明電極膜2a、2bがそれぞれ形成されると共に、液晶分子を一定の方向に配向させる図示しない配向膜がさらに設けられている。第1基板1aと第2基板1bは、図示しないスペーサにより一定の間隔を保持しながら、上述の透明電極2a、2bが対向するように、その周囲をシール材により貼り合わせする。第1基板1aと第2基板1bの隙間に液晶材料が注入されることにより、液晶層4が第1基板1aと第2基板1bにより挟持される。さらに、第1基板1aと第2基板1bの外側には、それぞれ偏光板3a、3bが設けられ、これらにより、液晶パネル102が形成されている。この対向する透明電極膜2a、2bに電圧が印加されることにより、その間に挟持されている液晶分子の配列が変化し、偏光板3a、3bの吸収軸の方向と共に図示していないバックライトユニットからの光の透過および不透過が制御され、所望の表示を得ることができる。
【0035】
この液晶パネル102の電極端子部分は、FPC基板103と接続するため、熱圧着部105を有している。ACF(Anisotropic Conductive Film:異方性導電膜)5aは、導電粒子を含んだ接着剤を用いており、これを液晶パネル102の配線端子である透明導電膜2bとFPC基板103の配線端子11a間に挟み、熱圧着部105の領域にて、加熱・加圧し、熱圧着する。これにより、ACF5a内の導電粒子が、それぞれの電極間を電気的に接続する。前述したFPC基板103には、ICチップ部品6を、ACF5bを用いて、熱圧着によって配置している。このFPC基板103には、ICチップ部品6のバンプに導電接続されるリード7が形成されている。
【0036】
また、ACF5cを、FPC基板103の配線端子11bとPCB基板104の配線端子12間に挟み、熱圧着部106の領域にて、加熱・加圧する。これにより、ACF5c内の導電粒子が、それぞれの基板上の電極端子間を電気的に接続している。PCB基板104には、電子部品であるチップ部品8を半田9によって配置している。このPCB基板104には、チップ部品8の端子が半田付けされる端子10が形成されている。
【0037】
(配線端子設計例)
図3(a)は、本実施形態のFPC基板103とPCB基板104の連結部B−B’の拡大図を示す。これは、図1における紙面上方から、図2における上方からの観察図になる。また、図3(b)は、FPC基板103とPCB基板104の連結部B−B’の断面図を示す。
【0038】
FPC基板103の配線端子11bは、例えば、主材料としてCu(銅)配線が用いられている。また、PCB基板104の配線端子12も、例えば、主材料としてCu(銅)配線が用いられている。
【0039】
FPC基板103上には、各々が電子部品に接続された複数の配線端子11bが形成されている。また、FPC基板103の両端部には、電子部品に接続されていない2本の配線端子が相互に導通してコの字型端子13の設計パターンを有するように形成されている。即ち、コの字型端子13は、FPC基板上に配置された複数の配線端子11bの両端に位置する。
【0040】
一方、PCB基板104上にも、各々が電子部品に接続された複数の配線端子12が形成されている。また、PCB基板104の両端部の各々には、電子部品に接続されていない2本の配線端子が形成され、それらはそれぞれ圧着領域と逆側の端部に検査測定用パッド14a〜14dを有する。検査測定用パッド14a〜14dは、ACF5cを介して、コの字型端子13と電気的に接続されており、PCB基板104上に配置された複数の配線端子12の両端に位置する。
【0041】
コの字型端子13と検査測定用パッド14は、それぞれの基板上に配置された複数の配線端子の両端に位置する。FPC基板103とPCB基板104の接合工程は、ACF装着後、加熱されたヘッドを熱圧着領域に押し付ける工程を有する。上記ヘッドにおいて、圧力の均一性が取れていなかった場合、圧力不足が顕著に現れるのは、それぞれの基板上の両端に配置された配線端子になる。したがって、基板の両端に位置する配線端子は、電気的に導通が取れていないなどの接続不良が発生しやすい箇所である。上述した理由により、コの字型端子13と検査測定用パッド14は、複数の配線端子の外側、即ち基板の両端部に位置するのが、好ましい。
【0042】
但し、本発明ではコの字型端子13と検査用測定パット14が基板の両端部に設けられていなくても、両基板がACFによって電気的に接続されているか否かの検査を実施することは可能である。また、検査測定用パッド14の形状は、図3(a)において、四角形状を示しているが、円状または楕円形状などの他の形状であっても良い。また、上記の例とは逆に、コの字型端子13がPCB基板104上に設けられ、検査測定用パッド14がFPC基板103上に設けられていても良い。
【0043】
(検査方法)
本実施形態における検査方法では、PCB基板104に配置された検査測定用パッド14に対し、検査者が2本のプローバを検査測定用パッド14aと14bに接触させ、それらの間の抵抗値を測定する。このとき、ACF5c中に存在する導電粒子が十分に圧接され、また、十分な個数を確保できているならば、コの字型端子13を介して、測定される抵抗値は数Ωと低い値を示す。しかし、基板接合工程において、十分な圧力、および圧力の均一性が施されていなければ、電気的な接合は不十分となり、測定される抵抗値は高い値を示す。検査用測定パット14cと14dにおいても同様に実施することが可能である。
【0044】
従来の方法では、上述したように目視検査を実施していたため、定量的に、検査を実施することができず、明確にACFによる接続不良基板の抽出を実施することが困難であった。しかし、本実施形態を用いることによって、定量的に接続不良基板の抽出が可能となり、検査工程の信頼性は向上する。
【0045】
[第2実施形態]
本実施形態は、COF方式によるFPC基板に配置された配線端子と、SMT方式によるPCB基板に配置された配線端子とが、熱圧着によって電気的に接続され、その接続部における配線端子に、検査測定用のスルーホールを設けたことを特徴とする。
【0046】
(構成)
液晶表示装置の基本的な構成は、上述した第1実施形態と同様である。即ち、FPC基板103とPCB基板104とが、ACF5cを介して接合されている。但し、以下に説明するように、配線端子の構成は第1実施形態とは異なっている。
【0047】
(配線端子設計例)
図4(a)は、本実施形態のFPC基板103とPCB基板104の連結部B−B’の拡大図を示す。図1における紙面上方、図2における上方からの観察図になる。また、図4(b)は、FPC基板103とPCB基板104の連結部B−B’の断面図を示す。
【0048】
FPC基板103の配線端子11bは、例えば、主材料としてCu(銅)配線が用いられている。また、PCB基板104の配線端子12も、例えば、主材料としてCu(銅)配線が用いられている。
【0049】
FPC基板103上には、各々が電子部品に接続された複数の配線端子11bが形成されている。また、FPC基板103の両端部には、電子部品に接続されていない2本の配線端子が相互に導通してコの字型端子15の設計パターンを有するように形成されている。即ち、コの字型端子15は、FPC基板上に配置された複数の配線端子11bの両端に位置する。
【0050】
一方、PCB基板104上にも、各々が電子部品に接続された複数の配線端子12が形成されている。また、PCB基板104の両端部の各々には、電子部品に接続されていない配線端子12a〜12dが形成されている。上記、電子部品に接続されていない配線端子12a〜12dは、ACF5cを介して、コの字型端子15と電気的に接続されており、PCB基板104上に配置された複数の配線端子12の両端に位置する。
【0051】
上記コの字型端子15には、連結部において、各端子に1つのスルーホール16a〜16dを有している。また、FPC基板103とPCB基板104の間に接着要素として設けられたACF5cが存在する。しかし、スルーホール16a〜16dの下には、ACF5cを設けず、直接PCB基板上に配置された、電子部品等に接続されていない配線端子12a〜12dが存在する。つまり、スルーホール16の位置とACF5cの位置は一致しない。
【0052】
スルーホール16a〜16dを有したコの字型端子15は、FPC基板103上に配置された複数の配線端子11bの両端に位置する。FPC基板103とPCB基板104の接合工程は、ACF装着後、加熱されたヘッドを熱圧着領域に押し付ける工程を有する。上記ヘッドにおいて、圧力の均一性が取れていなかった場合、圧力不足が顕著に現れるのは、それぞれの基板上の両端に配置された配線端子になる。したがって、基板の両端に位置する配線端子は、電気的に導通が取れていないなどの接続不良が発生しやすい箇所である。上述した理由により、コの字型端子15は、複数の配線端子の外側、即ち、基板の両端部に位置するのが、好ましい。
【0053】
但し、本発明では、スルーホール16a〜16dを有したコの字型端子15が基板の両端部に設けられていなくても、両基板がACFによって電気的に接合されているか否かの検査を実施することは可能である。また、検査測定は、抵抗値を測定するため、スルーホール16の下には、ACFが設けられていない方が、好ましい。
【0054】
なお、本実施形態では、ACFが存在する場合でも、若干抵抗値は高い値を示すが、抵抗値に基づいて検査を実施することは可能である。また、上記の例とは逆に、スルーホール16a〜16dを有したコの字型端子15がPCB基板104上に設けられていても同様の原理で抵抗測定を実施することができる。
【0055】
(検査方法)
本実施形態における検査方法は、FPC基板103に配置されたスルーホール16において、2本のプローバを、スルーホール16aと16bに配置させ、PCB基板104に配置された配線端子12aと12bに接触させ、抵抗値を測定する。このとき、ACF5c中に存在する導電粒子が、十分に圧接され、また、十分な個数を確保できているならば、コの字型端子15を介して、測定する抵抗値は、数Ωと低い値を示す。しかし、基板接合工程において、十分な圧力、および圧力の均一性が施されていなければ、電気的な接合は、不十分となり、測定する抵抗値は、高い値を示す。
【0056】
スルーホール16cと16dにおいても同様に実施することが可能である。
【0057】
従来の方法では、上述したように目視検査を実施していたため、定量的に、検査を実施することができず、明確に接続不良基板の抽出を実施することが困難であった。しかし、本実施形態を用いることによって、定量的に接続不良基板の抽出が可能となり、検査工程の信頼性は向上する。
(製造方法例)
図5は、第1及び第2実施形態による、図1に示す液晶表示装置100の製造フローチャートを示す。
【0058】
図5に示すように、COF方式によるFPC基板作製工程Paでは、工程Pa1において、ACF接着処理が実施されて、ACF5bがFPC基板103に装着される。このACF5bは、接着剤中に多数の導電粒子を分散させることによって構成される。このACF5bは、樹脂によって物体間の接着を行うと共に、対向しない端子間を絶縁しつつ対向する端子間を導電粒子によって、導電接続する、という機能を持つ。
【0059】
ACF5bをFPC基板103へ装着した後、工程Pa2においてICチップ部品6のマウント処理が実施される。具体的には、ICチップ部品6の個々の出力、すなわちバンプが、FPC基板103に設けられているリード7に対応するようにICチップ部品6を、ACF5bを介して設置する。
【0060】
次に、工程Pa3では、加熱されたヘッドによってICチップ部品6をFPC基板103へ押し付ける。これにより、ICチップ部品6は加圧されると共に加熱され、ACF5bによって、ICチップ部品6の全体がFPC基板103に接着され、さらにICチップ部品6のバンプが位置的に対応するリード7に導電粒子によって導電接続される。以上の工程により、COF方式によるFPC基板103が作製される。
【0061】
次に、FPC基板103と液晶パネル102の接合工程Pbが行われる。液晶パネル102の電極端子部分は、FPC基板103を熱圧着する熱圧着部105を有している。したがって、この工程Pb1では、液晶パネル102とFPC基板103の電極間にACF5aを装着する。次に、工程Pb2では、加熱されたヘッドを、熱圧着部105に押し付ける。これにより、熱圧着部105は加圧されると共に加熱され、ACF5aによって、FPC基板103と液晶パネル102が接合される。こうして、ACF5a内の導電粒子が、それぞれの電極間を電気的に接続する。
【0062】
また、SMT方式によるPCB基板作製工程Pcでは、工程Pc1において、半田印刷が行われる。次に、工程Pc2において、チップ部品8のマウント処理が実施され、PCB基板104には、例えば、電解コンデンサなどといったチップ部品8が載せられる。次に工程Pc3において、リフロー処理が実施される。これは、チップ部品が載せられたPCB基板104をリフロー炉の中に搬送し、そのリフロー炉の中でPCB基板104のチップ部品8が載せられた側に熱風を供給するという処理である。これにより、半田9が溶融して複数のチップ部品8が複数の端子10に一括して半田付けされる。
【0063】
次に、工程Pdでは、液晶パネル102と接合されたFPC基板103と、PCB基板104の接合工程が実施される。工程Pd1では、FPC基板103とPCB基板104の電極間にACF5cを装着する。次に、工程Pd2では、加熱されたヘッドを熱圧着領域106に押し付ける。これにより、熱圧着部106は加圧されると共に加熱され、ACF5cによって、FPC基板103とPCB基板104が接合される。要するに、ACF5c内の導電粒子が、それぞれの電極間を電気的に接続する。次に、工程Pd3では、ACF接続による接続不良について抵抗測定検査を実施する。
【0064】
したがって、本発明により、定量的に接続不良基板の抽出が可能となり、検査工程の信頼性は向上する。
【0065】
[その他の実施形態]
以上、好ましい実施形態を挙げて本発明を説明したが、本発明はその実施形態に限定されるものではなく、請求項の範囲に記載した発明の範囲内で種々に改変できる。
【0066】
例えば、本発明は、FPC基板とPCB基板の組み合わせについて、記載しているが、FPC基板とFPC基板の組み合わせ、ガラス基板とFPC基板の組み合わせ、プラスチック基板とFPC基板の組み合わせなどでも良い。
【0067】
[液晶表示装置の製造方法]
次に、図1および図2に示した液晶表示装置100の製造方法の例について、図6を参照して説明する。
【0068】
まず、図6の工程A1において、ガラスやプラスチックなどの絶縁基板である大判の第1基板1aに対して、透明電極2aである第1電極を形成する。具体的には、ITOを材料として周知のパターン形成法、例えばフォトリソグラフィー法によって、図示していない端子などを形成する。
【0069】
次に、工程A2において、透明電極膜2a上に図示しないポリイミド樹脂などからなる配向膜を形成し、工程A3において、ラビング処理などを施す。
【0070】
一方、工程B1において、大判の第2基板1b上に、同様の方法で透明電極膜2bを形成する。さらに、工程B2において、透明電極膜2b上に図示しない配向膜を形成し、工程B3において、ラビング処理などを施す。
【0071】
さらに、工程A4において、基板1a上に、例えばエポキシ樹脂等を材料としてシール材を第1基板に形成し、工程A5において、スペーサを分散する。
【0072】
以上により、形成された第1基板1aと第2基板1bが製作された後、工程C1において、第1基板1aと第2基板1bとをシール材を挟んで互いに重ね合わせ、さらに圧着すること、すなわち加熱下で加圧することにより、両基板をたがいに貼り合せる。この貼り合わせにより、図1の液晶セル101を複数個含む大きさの大判構造(即ち、母基板)が形成される。
【0073】
以上のようにして、母基板が製作された後、工程C2において、第1ブレイク工程を実施する。これにより、図示していない液晶注入口が、外部へ露出した状態の液晶パネル部分が複数個含まれる中判のパネル構造、いわゆる短冊状の中判パネル構造が複数個切り出される。
【0074】
そして、工程C3は、図示していない液晶注入口を通して、液晶パネル部分の内側に液晶を注入し、注入完了後に、その液晶注入口を樹脂によって封止し、液晶層4を形成する。
【0075】
さらに、工程C4は、中判パネル構造に対して、第2ブレイク工程を実施している。具体的には、中判パネル構造を構成している基板1aと基板1bを切断し、これにより、図1の液晶セル101が、1つずつ分断される。
【0076】
その後、工程C5において、FPC基板103が、液晶セル101の電極端子上の熱圧着部105の表面に、ACF5aを介して実装される。更に、液晶セル101に接続されたFPC基板103の熱圧着部106の表面に、PCB基板104が、ACF5cを介して、実装される。
【0077】
次に、工程C6および工程C7において、FPC基板103およびPCB基板104を実装した液晶セル101の第1基板1aと第2基板1bの外側上に、位相差板や偏光板などを必要に応じて、取り付けることによって、図1および図2に示す液晶表示装置100が完成する。
【0078】
[電子機器]
図7は、本実施形態の全体構成を示す概略構成図である。ここに示す電子機器は、上記の液晶表示装置100と、これを制御する制御手段110を有する。ここでは、液晶表示装置100を、パネル構造体100Aと、半導体ICなどで構成される駆動回路100Bとに概念的に分けて描いてある。また、制御手段110は、表示情報出力源111と、表示情報処理回路112と、電源回路113と、タイミングジェネレータ114と、を有する。
【0079】
表示情報出力源111は、ROM(Read Only Memory)やRAM(Random Access Memory)などからなるメモリと、磁気記録ディスクや光記録ディスクなどからなるストレージユニットと、デジタル画像信号を同調出力する同調回路とを備え、タイミングジェネレータ114によって生成された各種のクロック信号に基づいて、所定フォーマットの画像信号などの形で表示情報を表示情報処理回路112に供給するように構成されている。
【0080】
表示情報処理回路112は、シリアル−パラレル変換回路、増幅・反転回路、ローテーション回路、ガンマ補正回路、クランプ回路などの周知の各種回路を備え、入力した表示情報の処理を実行して、その画像情報をクロック信号CLKとともに駆動回路100Bへ供給する。駆動回路100Bは、走査線駆動回路、データ線駆動回路及び検査回路を含む。また、電源回路113は、上述の各構成要素にそれぞれ所定の電圧を供給する。
【0081】
次に、本発明に係る液晶表示装置を適用可能な電子機器の具体例について図8を参照して説明する。
【0082】
まず、本発明に係る液晶表示装置を、可搬型のパーソナルコンピュータ(いわゆるノート型パソコン)の表示部に適用した例について説明する。図8(a)は、このパーソナルコンピュータの構成を示す斜視図である。同図に示すように、パーソナルコンピュータ210は、キーボード211を備えた本体部212と、本発明に係る液晶表示装置を適用した表示部213とを備えている。
【0083】
続いて、本発明に係る液晶表示装置を、携帯電話機の表示部に適用した例について説明する。図8(b)は、この携帯電話機の構成を示す斜視図である。同図に示すように、携帯電話機220は、複数の操作ボタン221のほか、受話口222、送話口223とともに、本発明に係る液晶表示装置を適用した表示部224を備える。
【0084】
なお、本発明に係る液晶表示パネルを適用可能な電子機器としては、図8(a)に示したパーソナルコンピュータや図8(b)に示した携帯電話機の他にも、液晶テレビ、ビューファインダ型・モニタ直視型のビデオテープレコーダ、カーナビゲーション装置、ページャ、電子手帳、電卓、ワードプロセッサ、ワークステーション、テレビ電話、POS端末、ディジタルスチルカメラなどが挙げられる。
【0085】
[変形例]
また、本発明の電気光学装置は、パッシブマトリクス型の液晶表示パネルだけではなく、アクティブマトリクス型の液晶表示パネル(例えば、TFT(薄膜トランジスタ)やTFD(薄膜ダイオード)をスイッチング素子として備えた液晶表示パネル)にも同様に適用することが可能である。また、液晶表示パネルだけでなく、エレクトロルミネッセンス装置、有機エレクトロルミネッセンス装置、プラズマディスプレイ装置、電気泳動ディスプレイ装置、フィールド・エミッション・ディスプレイ(電界放出表示装置)などの各種の電気光学装置においても本発明を同様に適用することが可能である。
【図面の簡単な説明】
【図1】本発明の実施形態による実装基板を利用した液晶表示装置を平面的に示した図である。
【図2】本発明の実施形態による実装基板を利用した液晶表示装置の断面図である。
【図3】(a)本発明の実施形態による実装基板の接続部を示す拡大図である。
(b)本発明の実施形態による実装基板の接続部を示す断面図である。
【図4】(a)本発明の実施形態による実装基板の接続部を示す拡大図である。
(b)本発明の実施形態による実装基板の接続部を示す断面図である。
【図5】本発明の実施形態による実装基板の製造方法を示すフローチャートである。
【図6】図1および図2に示す液晶表示装置の製造方法を示すフローチャートである。
【図7】本発明を適用した液晶表示装置を利用する電子機器の構成を示す。
【図8】本発明を適用した液晶表示装置を備えた電子機器の例を示す。
【符号の説明】
1a 第1基板
1b 第2基板
2a、2b 透明電極膜
3、3a、3b 偏光板
4 液晶層
5a、5b、5c ACF
6 ICチップ部品
7 リード
8 チップ部品
9 半田
10 端子
11a,11b ,12,12a,12b,12c,12d 配線端子
13,15 コの字型端子
14,14a,14b,14c,14d 検査測定用パッド
16,16a,16b,16c,16d スルーホール
100 液晶表示装置
101 液晶セル
102 液晶パネル
103 フレキシブルプリント(FPC)基板
104 プリント回路(PCB)基板[0001]
BACKGROUND OF THE INVENTION
The present invention relates to an electronic component mounting board using a printed circuit board (PCB) and a flexible printed circuit (FPC). The present invention also relates to an electro-optical device and an electronic apparatus configured using the mounting substrate.
[0002]
[Background]
In general, an electro-optical device such as a liquid crystal display device or an EL (Electro Luminescence) device is a circuit in which an electro-optical material such as a liquid crystal or EL is arranged on a substrate to form a panel structure, and an appropriate electronic circuit is mounted. Formed by connecting the substrate to its panel structure. In addition, chip components such as electrolytic capacitors, IC chips, and the like are often mounted on the circuit board (see, for example, Patent Document 1).
[0003]
It is widely known that there is a mounting method based on SMT (Surface Mount Technology) as a method for mounting electronic components, particularly chip components, on a circuit board. This mounting method based on SMT is basically a mounting method using reflow soldering processing. For example, this method is a mounting method that includes a step of mounting an electronic component on a substrate on which solder is placed and then heating the solder to solder the electronic component to the substrate.
[0004]
In recent years, in this mounting method based on SMT, in addition to electronic components mounted by reflow soldering processing, for example, chip components such as electrolytic capacitors, an IC chip is mounted on a substrate. In short, COF (Chip on Film) There is also a growing need for an implementation method based on it.
[0005]
The above-described mounting method substrate form includes, for example, an SMT method part in which chip components are mounted in a chip component mounting area by reflow soldering processing and a COF method part in which IC chips are mounted in an IC chip mounting area by thermocompression processing. There are other types.
[0006]
When mounting an IC chip in addition to a chip component suitable for reflow soldering, generally, the IC chip is thermocompression-bonded, that is, pressed using an adhesive element such as an ACF (Anisotropic Conductive Film). And after mounting on a board | substrate by heating, the reflow soldering process for mounting a chip component is implemented.
[0007]
Thus, when it is necessary to mount various IC chips and electronic components, it can be assumed that a substrate corresponding to each property is used. For example, it is conceivable that a device is configured by electrically connecting a PCB board and an FPC board, each of which is mounted with an IC or an electronic component.
[0008]
[Patent Document 1]
Japanese Patent Laid-Open No. 2002-32020
[0009]
[Problems to be solved by the invention]
The above-described electronic component mounting substrate bonding process, in other words, inspection of electrical connection between substrates performed after the connection of the FPC substrate on which the driver IC chip is mounted by the COF method and the PCB substrate on which the chip component is mounted by the SMT method The process is usually carried out by visual inspection.
[0010]
In general, ACF is often used as a connecting element between an FPC board and a PCB board. ACF is usually composed of conductive particles and an adhesive. The connection is basically a connection by pressure, and the conductive particles share the electrical connection and the adhesive maintains the pressure contact state. In short, it is the conductive particles that perform the conduction function by the ACF connection. Although it depends on the type of conductive particles, it is generally said that reliability can be maintained if about 20 conductive particles are secured between opposing electrodes. If these conductive particles are sufficiently pressed and a sufficient number can be secured, the electrical connection can be said to be good.
[0011]
The observation of the conductive particles at the connection portion between the FPC board and the PCB board is difficult to perform with a microscope because the board is not transparent. Therefore, the inspection of electrical connection for the joining process by ACF is performed as follows.
[0012]
As one of the inspection methods, when evaluating the ACF connection, a method of peeling the PCB substrate and the FPC substrate and observing the conductive particles under a microscope can be considered. However, in this case, the substrate used for evaluation is disassembled.
[0013]
On the other hand, there are the following inspection methods that do not disassemble the connected substrate.
[0014]
The first is a method of evaluating the appearance of the ACF oozing state during pressure bonding in the joining process. By this method, it is possible to evaluate whether or not sufficient pressure is uniformly applied to the crimping region.
[0015]
The second is a method of observing the unevenness of the surface in the substrate crimping region. In the bonding process, when sufficient pressure is uniformly applied to the substrate crimping region, the unevenness of the substrate surface is large and clear. This is because the thickness of the Cu (copper) wiring used as the substrate wiring material is 10 to 30 μm, and the thickness appears on the substrate surface. However, when sufficient pressure is not applied, the unevenness of the substrate surface is small and flat.
[0016]
However, as described above, these visual inspections are not quantitative inspections but visual evaluations, and it is difficult to make the accuracy uniform. Therefore, even if an ACF connection failure has occurred, it may not be determined as a connection failure substrate, and the inspection reliability tends to be lacking.
[0017]
The present invention has been made in view of the above-described contents, and an object thereof is to easily and quantitatively detect a connection state when electrically connecting terminals on a substrate using an ACF. To do.
[0018]
[Means for Solving the Problems]
In one aspect of the present invention, in an electronic component mounting substrate,An electronic component in which the first substrate and the second substrate are joined so that a terminal provided on the first substrate and a terminal provided on the second substrate are electrically connected by an ACF. A mounting substrate, wherein the first substrate is provided with at least a pair of inspection terminals that are electrically connected to each other when the first substrate and the second substrate are joined to each other. Is a region in which an inspection conduction terminal is provided for electrically connecting the pair of inspection terminals to each other when the first substrate and the second substrate are joined, and the inspection conduction terminal overlaps with the inspection terminal. A through hole communicating with the second substrate and the inspection conduction terminal is provided.Is preferred.
[0019]
In the electronic component mounting substrate, it is preferable that the inspection terminals are arranged at both ends of the one substrate. At the time of mounting, the pressure uniformity may not be achieved due to the inclination of the pressure head. At this time, the pressure shortage appears remarkably at the terminals arranged at both ends on the substrate. In short, the terminals provided at both ends of the substrate are places where poor connection such as electrical continuity is likely to occur. Therefore, by disposing the inspection terminals at both ends of the substrate, the electronic component mounting substrate can efficiently detect a connection failure.
[0020]
In another aspect of the electronic component mounting substrate, the inspection terminal is preferably provided outside the plurality of terminals on the substrate on which the inspection terminal is provided.
[0021]
In still another aspect of the electronic component mounting substrate, the substrate that is different from the substrate provided with the inspection terminal in the pair of substrates is electrically connected to the inspection terminal, and It is preferable to provide a test conduction terminal that conducts the test terminal.
[0022]
In still another aspect of the electronic component mounting substrate, it is preferable that the inspection conduction terminal has a through-hole that can contact the inspection terminal at a position overlapping the inspection terminal. By providing the through hole, for example, it is not necessary to produce another design pattern for resistance measurement.
[0023]
In still another aspect of the electronic component mounting substrate, it is preferable that the pair of substrates is joined by ACF, and the through hole is provided at a position where the ACF is not provided.
[0024]
In still another aspect of the electronic component mounting substrate, one of the pair of substrates may be a flexible printed circuit board on which a semiconductor element is mounted, and the other of the pair of substrates. Can be a flexible printed circuit board on which other semiconductor elements are mounted.
[0025]
In yet another aspect of the electronic component mounting substrate, one of the pair of substrates may be a flexible printed circuit board on which a semiconductor element is mounted, and the other of the pair of substrates. The substrate can be a printed circuit board.
[0026]
The electro-optical device can include an electro-optical panel and a mounting substrate for the electronic component. One of the pair of substrates may be attached to the electro-optical panel.
[0027]
The electro-optical panel may be a liquid crystal panel, and the semiconductor element may be a driving IC (driver IC) for the liquid crystal panel. The liquid crystal panel may use STN (Super Twisted Nematic) mode, TFT-LCD (Thin Film Transistor-Liquid Crystal Display), TFD-LCD (Thin Film Dynode-Liquid Crystal Display), or the like.
[0028]
Furthermore, according to the present invention, an electronic apparatus can be configured by providing the electro-optical device as a display unit.
[0029]
In another aspect of the present invention, in a method for manufacturing an electronic component mounting substrate,The first substrate provided with at least a pair of inspection terminals that are electrically connected to each other when the first substrate and the second substrate are joined, and the first substrate and the second substrate are joined. Sometimes the second substrate provided with the inspection conduction terminals for electrically connecting the pair of inspection terminals to each other, the terminals provided on the first substrate, and the terminals provided on the second substrate; Is a method of manufacturing an electronic component mounting substrate having a step of joining so as to be electrically connected by an ACF, wherein the inspection conductive terminal overlaps the inspection terminal, and the second substrate and the A through hole communicating with the inspection conduction terminal is provided, and a prober is brought into contact with the inspection terminal through the through hole to measure a resistance between the pair of inspection terminals. Inspection process for checking electrical connectionsAnd having. In the step of bonding the pair of substrates, for example, a thermocompression bonding step may be performed with an adhesive element such as ACF interposed therebetween.
[0030]
In another aspect of the present invention, in a method for manufacturing an electro-optical device,The first substrate provided with at least a pair of inspection terminals that are electrically connected to each other when the first substrate and the second substrate are joined, and the first substrate and the second substrate are joined. Sometimes the second substrate provided with the inspection conduction terminals for electrically connecting the pair of inspection terminals to each other, the terminals provided on the first substrate, and the terminals provided on the second substrate; And a step of attaching the electro-optic panel to one of the first substrate and the second substrate, and a method of manufacturing the electro-optic device. In the region where the inspection conduction terminal overlaps with the inspection terminal, a through hole communicating with the second substrate and the inspection conduction terminal is provided,
The electrical connection of the pair of substrates is inspected by measuring the resistance between the pair of inspection terminals by bringing a prober into contact with the inspection terminals through the through holes.And an inspection process. In the step of bonding the pair of substrates, for example, a thermocompression bonding step may be performed with an adhesive element such as ACF interposed therebetween. Further, the step of bonding the electro-optical panel to either one of the pair of substrates may be performed by a thermocompression bonding step with an adhesive element such as ACF interposed therebetween.
[0031]
DETAILED DESCRIPTION OF THE INVENTION
Preferred embodiments of the present invention will be described below with reference to the drawings.
[0032]
[First embodiment]
In this embodiment, the wiring terminals arranged on the FPC board by the COF method and the wiring terminals arranged on the PCB substrate by the SMT method are electrically connected by thermocompression bonding. A measurement pad pattern is provided.
[0033]
(Constitution)
FIG. 1 shows an example of a liquid crystal display device on which a COF type FPC substrate and an SMT type PCB substrate according to the present invention are mounted. FIG. 2 is a cross-sectional view taken along line A-A ′ of the liquid
[0034]
In the
[0035]
The electrode terminal portion of the
[0036]
Further, the
[0037]
(Wiring terminal design example)
FIG. 3A shows an enlarged view of a connecting portion B-B ′ between the
[0038]
For the
[0039]
On the
[0040]
On the other hand, a plurality of
[0041]
The
[0042]
However, in the present invention, even if the
[0043]
(Inspection method)
In the inspection method in the present embodiment, an inspector brings two probers into contact with the
[0044]
In the conventional method, since the visual inspection is performed as described above, the inspection cannot be performed quantitatively, and it is difficult to clearly perform the connection defect substrate extraction by the ACF. However, by using this embodiment, it is possible to quantitatively extract poorly connected substrates and improve the reliability of the inspection process.
[0045]
[Second Embodiment]
In this embodiment, the wiring terminals arranged on the FPC board by the COF method and the wiring terminals arranged on the PCB substrate by the SMT method are electrically connected by thermocompression bonding. A through hole for measurement is provided.
[0046]
(Constitution)
The basic configuration of the liquid crystal display device is the same as that of the first embodiment described above. That is, the
[0047]
(Wiring terminal design example)
FIG. 4A shows an enlarged view of a connecting portion B-B ′ between the
[0048]
For the
[0049]
On the
[0050]
On the other hand, a plurality of
[0051]
The
[0052]
The
[0053]
However, in the present invention, even if the
[0054]
In the present embodiment, even when an ACF is present, the resistance value is slightly high, but it is possible to perform an inspection based on the resistance value. Contrary to the above example, even if the
[0055]
(Inspection method)
In the inspection method in the present embodiment, in the through hole 16 arranged in the
[0056]
The same can be applied to the through
[0057]
In the conventional method, since the visual inspection is performed as described above, the inspection cannot be performed quantitatively, and it is difficult to clearly extract the poorly connected substrate. However, by using this embodiment, it is possible to quantitatively extract poorly connected substrates and improve the reliability of the inspection process.
(Example of manufacturing method)
FIG. 5 shows a manufacturing flowchart of the liquid
[0058]
As shown in FIG. 5, in the FPC board manufacturing process Pa by the COF method, the ACF bonding process is performed in the
[0059]
After mounting the
[0060]
Next, in step Pa3, the
[0061]
Next, a bonding process Pb between the
[0062]
Further, in the PCB substrate manufacturing process Pc by the SMT method, solder printing is performed in the process Pc1. Next, in the process Pc2, the
[0063]
Next, in the process Pd, a bonding process of the
[0064]
Therefore, according to the present invention, it becomes possible to quantitatively extract defective connection substrates, and the reliability of the inspection process is improved.
[0065]
[Other embodiments]
The present invention has been described with reference to the preferred embodiments. However, the present invention is not limited to the embodiments, and various modifications can be made within the scope of the invention described in the claims.
[0066]
For example, although the present invention describes a combination of an FPC board and a PCB board, a combination of an FPC board and an FPC board, a combination of a glass board and an FPC board, a combination of a plastic board and an FPC board, or the like may be used.
[0067]
[Method of manufacturing liquid crystal display device]
Next, an example of a manufacturing method of the liquid
[0068]
First, in step A1 of FIG. 6, a first electrode that is a transparent electrode 2a is formed on a large first substrate 1a that is an insulating substrate such as glass or plastic. Specifically, a terminal or the like (not shown) is formed by a known pattern forming method such as photolithography using ITO as a material.
[0069]
Next, in step A2, an alignment film made of polyimide resin or the like (not shown) is formed on the transparent electrode film 2a, and in step A3, rubbing treatment or the like is performed.
[0070]
On the other hand, in step B1, the transparent electrode film 2b is formed on the large
[0071]
Further, in step A4, a sealing material is formed on the first substrate using, for example, an epoxy resin or the like on the substrate 1a, and spacers are dispersed in step A5.
[0072]
After the first substrate 1a and the
[0073]
After the mother substrate is manufactured as described above, the first breaking step is performed in step C2. As a result, a plurality of medium-sized panel structures including so-called strip-shaped medium-sized panel structures are cut out.
[0074]
In step C3, liquid crystal is injected inside the liquid crystal panel through a liquid crystal injection port (not shown). After the injection is completed, the liquid crystal injection port is sealed with resin to form the liquid crystal layer 4.
[0075]
Furthermore, the process C4 has implemented the 2nd break process with respect to the medium format panel structure. Specifically, the substrate 1a and the
[0076]
Thereafter, in step C5, the
[0077]
Next, in steps C6 and C7, a retardation plate, a polarizing plate, or the like is provided on the outside of the first substrate 1a and the
[0078]
[Electronics]
FIG. 7 is a schematic configuration diagram showing the overall configuration of the present embodiment. The electronic apparatus shown here includes the liquid
[0079]
The display
[0080]
The display
[0081]
Next, specific examples of electronic devices to which the liquid crystal display device according to the present invention can be applied will be described with reference to FIG.
[0082]
First, an example in which the liquid crystal display device according to the present invention is applied to a display unit of a portable personal computer (so-called notebook personal computer) will be described. FIG. 8A is a perspective view showing the configuration of this personal computer. As shown in the figure, the
[0083]
Next, an example in which the liquid crystal display device according to the present invention is applied to a display unit of a mobile phone will be described. FIG. 8B is a perspective view showing the configuration of this mobile phone. As shown in the figure, the
[0084]
Note that as an electronic device to which the liquid crystal display panel according to the present invention can be applied, in addition to the personal computer shown in FIG. 8A and the mobile phone shown in FIG. Monitor direct-view video tape recorders, car navigation devices, pagers, electronic notebooks, calculators, word processors, workstations, videophones, POS terminals, digital still cameras, etc.
[0085]
[Modification]
The electro-optical device of the present invention is not limited to a passive matrix type liquid crystal display panel, but also an active matrix type liquid crystal display panel (for example, a TFT (thin film transistor) or a TFD (thin film diode)) as a switching element. ) Can be applied in the same manner. In addition to the liquid crystal display panel, the present invention is applied to various electro-optical devices such as an electroluminescence device, an organic electroluminescence device, a plasma display device, an electrophoretic display device, and a field emission display (field emission display device). It is possible to apply similarly.
[Brief description of the drawings]
FIG. 1 is a plan view of a liquid crystal display device using a mounting substrate according to an embodiment of the present invention.
FIG. 2 is a cross-sectional view of a liquid crystal display device using a mounting substrate according to an embodiment of the present invention.
FIG. 3A is an enlarged view showing a connection portion of a mounting board according to an embodiment of the present invention.
(B) It is sectional drawing which shows the connection part of the mounting board | substrate by embodiment of this invention.
FIG. 4A is an enlarged view showing a connection portion of a mounting board according to an embodiment of the present invention.
(B) It is sectional drawing which shows the connection part of the mounting board | substrate by embodiment of this invention.
FIG. 5 is a flowchart illustrating a method of manufacturing a mounting board according to an embodiment of the present invention.
6 is a flowchart showing a method for manufacturing the liquid crystal display device shown in FIGS. 1 and 2. FIG.
FIG. 7 illustrates a structure of an electronic device using a liquid crystal display device to which the present invention is applied.
FIG. 8 illustrates an example of an electronic device including a liquid crystal display device to which the present invention is applied.
[Explanation of symbols]
1a First substrate
1b Second substrate
2a, 2b Transparent electrode film
3, 3a, 3b Polarizing plate
4 Liquid crystal layer
5a, 5b, 5c ACF
6 IC chip parts
7 Lead
8 Chip parts
9 Solder
10 terminals
11a, 11b, 12, 12a, 12b, 12c, 12d Wiring terminal
13,15 U-shaped terminal
14, 14a, 14b, 14c, 14d Inspection and measurement pads
16, 16a, 16b, 16c, 16d Through hole
100 Liquid crystal display device
101 liquid crystal cell
102 LCD panel
103 Flexible Printed (FPC) Board
104 Printed Circuit (PCB) Board
Claims (11)
前記第1の基板には、前記第1の基板と前記第2の基板とを接合したときに互いに導通する少なくとも一対の検査用端子が設けられ、
前記第2の基板には、前記第1の基板と前記第2の基板とを接合したときに前記一対の検査用端子を互いに導通させる検査用導通端子が設けられ、
前記検査用導通端子が前記検査用端子と重なる領域において、前記第2の基板と前記検査用導通端子とに連通するスルーホールが設けられていることを特徴とする電子部品の実装基板。 An electronic component in which the first substrate and the second substrate are joined so that a terminal provided on the first substrate and a terminal provided on the second substrate are electrically connected by an ACF. A mounting board,
The first substrate is provided with at least a pair of inspection terminals that are electrically connected to each other when the first substrate and the second substrate are joined together .
The second substrate is provided with a conduction terminal for inspection that connects the pair of inspection terminals to each other when the first substrate and the second substrate are bonded to each other.
A mounting board for electronic parts, wherein a through-hole communicating with the second substrate and the inspection conduction terminal is provided in a region where the inspection conduction terminal overlaps with the inspection terminal .
請求項1乃至6のいずれか一項に記載の電子部品の実装基板と、を備え、
前記一対の基板のうちの一方の基板が前記電気光学パネルに取り付けられていることを特徴とする電気光学装置。An electro-optic panel;
A mounting board for an electronic component according to any one of claims 1 to 6 ,
An electro-optical device, wherein one of the pair of substrates is attached to the electro-optical panel.
前記検査用導通端子が前記検査用端子と重なる領域に、前記第2の基板と前記検査用導通端子とに連通するスルーホールが設けられ、
前記スルーホールを介してプローバを前記検査用端子に接触させて前記一対の検査用端子間の抵抗を測定することにより、前記一対の基板の電気的接続を検査する検査工程を有することを特徴とする電子部品の実装基板の製造方法。 The first substrate provided with at least a pair of inspection terminals that are electrically connected to each other when the first substrate and the second substrate are joined, and the first substrate and the second substrate are joined. Sometimes the second substrate provided with the inspection conduction terminals for electrically connecting the pair of inspection terminals to each other, the terminals provided on the first substrate, and the terminals provided on the second substrate; Is a method of manufacturing a mounting board of an electronic component, which includes a step of joining so as to be electrically connected by an ACF,
In the region where the inspection conduction terminal overlaps with the inspection terminal, a through hole communicating with the second substrate and the inspection conduction terminal is provided,
A test step of inspecting the electrical connection of the pair of substrates by contacting a prober with the test terminal through the through hole and measuring a resistance between the pair of test terminals; A method of manufacturing a mounting board for electronic components.
前記第1の基板と前記第2の基板のうちの一方の基板に電気光学パネルを取り付ける工程と、を有する電気光学装置の製造方法であって、
前記検査用導通端子が前記検査用端子と重なる領域に、前記第2の基板と前記検査用導通端子とに連通するスルーホールが設けられ、
前記スルーホールを介してプローバを前記検査用端子に接触させて前記一対の検査用端子間の抵抗を測定することにより、前記一対の基板の電気的接続を検査する検査工程を有することを特徴とする電気光学装置の製造方法。 The first substrate provided with at least a pair of inspection terminals that are electrically connected to each other when the first substrate and the second substrate are joined, and the first substrate and the second substrate are joined. Sometimes the second substrate provided with the inspection conduction terminals for electrically connecting the pair of inspection terminals to each other, the terminals provided on the first substrate, and the terminals provided on the second substrate; Bonding so that ACFs are electrically connected by ACF;
Attaching an electro-optical panel to one of the first substrate and the second substrate , and a method of manufacturing an electro-optical device,
In the region where the inspection conduction terminal overlaps with the inspection terminal, a through hole communicating with the second substrate and the inspection conduction terminal is provided,
A test step of inspecting the electrical connection of the pair of substrates by contacting a prober with the test terminal through the through hole and measuring a resistance between the pair of test terminals; A method for manufacturing an electro-optical device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002255253A JP4193453B2 (en) | 2002-08-30 | 2002-08-30 | Electronic component mounting substrate, electro-optical device, electronic component mounting substrate manufacturing method, electro-optical device manufacturing method, and electronic apparatus |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002255253A JP4193453B2 (en) | 2002-08-30 | 2002-08-30 | Electronic component mounting substrate, electro-optical device, electronic component mounting substrate manufacturing method, electro-optical device manufacturing method, and electronic apparatus |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2004095872A JP2004095872A (en) | 2004-03-25 |
JP4193453B2 true JP4193453B2 (en) | 2008-12-10 |
Family
ID=32060814
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2002255253A Expired - Fee Related JP4193453B2 (en) | 2002-08-30 | 2002-08-30 | Electronic component mounting substrate, electro-optical device, electronic component mounting substrate manufacturing method, electro-optical device manufacturing method, and electronic apparatus |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4193453B2 (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN105517337A (en) * | 2015-11-25 | 2016-04-20 | 武汉光迅科技股份有限公司 | High-reliability flexible plate and assembling system thereof |
CN110111682A (en) * | 2019-04-10 | 2019-08-09 | 深圳市华星光电技术有限公司 | Flip chip and display device |
Families Citing this family (15)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100634674B1 (en) | 2005-03-14 | 2006-10-13 | 엘지전자 주식회사 | Method of detecting defect of a panel and luminescnet device employed in the same |
US7528327B2 (en) | 2005-04-28 | 2009-05-05 | Semiconductor Energy Laboratory Co., Ltd. | Inspection method and semiconductor device |
JP2007053248A (en) | 2005-08-18 | 2007-03-01 | Tdk Corp | Flexible substrate, mounting structure, display unit and portable electronic device |
KR101234415B1 (en) * | 2006-02-03 | 2013-02-18 | 엘지디스플레이 주식회사 | Test system of LCD |
TWI301201B (en) | 2006-03-15 | 2008-09-21 | Au Optronics Corp | Display circuits |
CN100414574C (en) * | 2006-03-23 | 2008-08-27 | 友达光电股份有限公司 | Display circuit |
JP2009224564A (en) * | 2008-03-17 | 2009-10-01 | Panasonic Corp | Wiring board, electronic device using the same and incorrect connection detector therefor |
JP2010225922A (en) * | 2009-03-24 | 2010-10-07 | Denso Corp | Electronic device |
CN201657501U (en) * | 2010-01-29 | 2010-11-24 | 比亚迪股份有限公司 | Circuit board golden finger |
JP5797805B2 (en) * | 2014-04-23 | 2015-10-21 | 株式会社ジャパンディスプレイ | Display device |
JP6415854B2 (en) | 2014-05-23 | 2018-10-31 | 株式会社ジャパンディスプレイ | Substrate unit and electronic device |
CN104360509B (en) * | 2014-11-21 | 2018-02-13 | 京东方科技集团股份有限公司 | Lighting test method and device |
CN107203075B (en) * | 2017-05-22 | 2020-02-07 | 京东方科技集团股份有限公司 | Touch display panel and liquid crystal display device |
CN110505751B (en) | 2019-08-29 | 2021-04-13 | 武汉天马微电子有限公司 | Flexible circuit board, display panel, display device and test method |
CN111025130B (en) * | 2020-01-07 | 2021-07-16 | 电子科技大学 | SMT detection method for multilayer interconnected FPC |
-
2002
- 2002-08-30 JP JP2002255253A patent/JP4193453B2/en not_active Expired - Fee Related
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN105517337A (en) * | 2015-11-25 | 2016-04-20 | 武汉光迅科技股份有限公司 | High-reliability flexible plate and assembling system thereof |
CN105517337B (en) * | 2015-11-25 | 2018-03-27 | 武汉光迅科技股份有限公司 | A kind of high reliability flexible board and its assembly system |
CN110111682A (en) * | 2019-04-10 | 2019-08-09 | 深圳市华星光电技术有限公司 | Flip chip and display device |
CN110111682B (en) * | 2019-04-10 | 2021-06-01 | Tcl华星光电技术有限公司 | Chip on film and display device |
Also Published As
Publication number | Publication date |
---|---|
JP2004095872A (en) | 2004-03-25 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4193453B2 (en) | Electronic component mounting substrate, electro-optical device, electronic component mounting substrate manufacturing method, electro-optical device manufacturing method, and electronic apparatus | |
US7535522B2 (en) | Liquid crystal display and method of inspecting the same | |
US9277669B2 (en) | Plastic panel and flat panel display device using the same | |
US7919782B2 (en) | Bonding structure of circuit substrate and instant circuit inspection method thereof | |
KR100640208B1 (en) | Bump structure for testing tft-lcd | |
US6300998B1 (en) | Probe for inspecting liquid crystal display panel, and apparatus and method for inspecting liquid crystal display panel | |
KR100324283B1 (en) | Tape Carrier Package and Method of Fabricating the same | |
JP5239428B2 (en) | Electro-optical device and electronic apparatus | |
KR20050044183A (en) | Liquid crystal display device and meothd for inspecting a bonding state with driving circuit | |
JP2004138704A (en) | Display body structure, method for manufacturing the same and electronic equipment | |
KR101543020B1 (en) | Method of testing for connection condition between display panel and pcb and liquid crystal display device using the same | |
US20070235888A1 (en) | Film type package and display apparatus having the same | |
KR100909417B1 (en) | Pad structure for inspection of liquid crystal display panel | |
JP2004087940A (en) | Electronic component mounted board, electro-optical device, method of manufacturing the same, and electronic apparatus | |
JP3985634B2 (en) | Electronic component mounting substrate, electro-optical device, electro-optical device manufacturing method, and electronic apparatus | |
KR101491161B1 (en) | Method of testing for connection condition between display panel and driver ic and display device using the same | |
US20090201456A1 (en) | Liquid crystal display device and inspection method thereof | |
JP2002217237A (en) | Planar display device | |
JP2005115129A (en) | Liquid crystal display and its inspection method | |
JPH0643473A (en) | Liquid crystal display device | |
JPH10301137A (en) | Liquid crystal display device | |
KR101034683B1 (en) | liquid crystal display device | |
JP2001005016A (en) | Liquid crystal device and method for inspecting it | |
JPH11237642A (en) | Active matrix type liquid crystal display device | |
KR100924494B1 (en) | TCP structure for output test on PCB |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20050614 |
|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20070402 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20080206 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20080212 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20080410 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20080902 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20080915 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20111003 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121003 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121003 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20131003 Year of fee payment: 5 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
LAPS | Cancellation because of no payment of annual fees |