JP3878601B2 - デジタルオーディオ放送受信装置及びその動作方法 - Google Patents
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Description
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{a1、a3、a2、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースする(並べ替える)のが好適である。
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{0、a3、a2、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースするのが好適である。
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{0、0、0、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースするのが好適である。
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{0、a3、0、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースするのが好適である。
また、各々のFFTモードに対して同一の構造の高速フーリエ変換装置を具現することにより、高速フーリエ変換の動作の制御が簡単になるという効果を奏する。
(1)FFTを行なうための各種の入力データモードである2048、1024、256、及び512に対し一律にRadix−4方式の演算を行なうことで高速フーリエ変換装置の演算部の具現を簡単にした。
(2)各種のFFTモードに対しRadix−4方式の演算を行なうために、アドレス発生部は4096個のアドレスを発生する。
(3)4096個のアドレスを発生させることによる高速フーリエ変換装置のメモリの大きさの増大を抑えるために、FFTの双対性(Duality)を用いて、各種のFFTモードの入力データの個数である2048、1024、256、及び512の4096への補間を行なう。
(4)補間された4096個のデータを用いてRadix−4方式で演算を行なった後、FFTモードの各々に対応するデジットリバース方式を適用してデジットリバースを行なう。
入力データをx(n)で表し、x(n)の高速フーリエ変換の結果をX(m)で表すとき、x(n)とX(m)との関係は、次の式(1)のように表すことができる。
図8は、4096個のデータに対する高速フーリエ変換をRadix−4の演算構造で具現する場合におけるデジットリバースの過程を示す図である。ここで、{a11、a10、a9、a8、a7、a6、a5、a4、a3、a2、a1、a0}は、アドレス発生部300で発生する12桁の読出アドレスであって、例えば、a2は、読出アドレスの第3bitの値になる。
300 アドレス発生部
400 高速フーリエ変換(FFT)部
410 メモリ
430 演算部
450 メモリ制御部
Claims (16)
- 伝送されるデータの大きさに応じて各種のFFTモードを有するデジタルオーディオ放送受信装置において、
4096個の記録アドレス及び読出アドレスを発生するアドレス発生部と、
前記FFTモードの各々のデータを繰り返して4096個のデータを生成し、前記4096個のデータを用いて高速フーリエ変換を行なう高速フーリエ変換部と、
前記高速フーリエ変換部の動作に対応して前記記録アドレス及び前記読出アドレスを発生すべく前記アドレス発生部を制御する制御部とを含み、
前記高速フーリエ変換部は、
前記FFTモードの各々のデータを繰り返して前記4096個のデータを生成するメモリ制御部と、
2048個のデータを記録可能な大きさを有するメモリと、
前記4096個のデータを用いてRadix−4方式で演算を行なう演算部とを含み、
前記読出アドレスが発生すると、前記メモリ制御部は、前記メモリのアドレスを前記読出アドレスに対応してデジットリバースすること、
を特徴とするデジタルオーディオ放送受信装置。 - 前記メモリ制御部は、
前記演算部が前記Radix−4方式で演算を行なうことができるように、前記メモリに記録される前記2048個のデータ以外のデータを記録する仮想メモリを有すること、
を特徴とする請求項1に記載のデジタルオーディオ放送受信装置。 - 前記演算部は、前記Radix−4方式で演算を行い、
これにより、前記仮想メモリには、前記FFTモードに対応して‘0’データがブロック化して記録されること、
を特徴とする請求項2に記載のデジタルオーディオ放送受信装置。 - 前記メモリ制御部は、
前記Radix−4方式で演算され、前記メモリに記録されたデータを前記FFTモードに対応してデジットリバースすること、
を特徴とする請求項1に記載のデジタルオーディオ放送受信装置。 - 前記メモリ制御部は、
前記FFTモードが2048である場合において、
前記読出アドレスの上位ビットから下位ビットの配列が{a11、a10、a9、a8、a7、a6、a5、a4、a3、a2、a1、a0}であるときは、
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{a1、a3、a2、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースすること、
を特徴とする請求項1に記載のデジタルオーディオ放送受信装置。 - 前記メモリ制御部は、
前記FFTモードが1024である場合において、
前記読出アドレスの上位ビットから下位ビットの配列が{a11、a10、a9、a8、a7、a6、a5、a4、a3、a2、a1、a0}であるときは、
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{0、a3、a2、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースすること、
を特徴する請求項1に記載のデジタルオーディオ放送受信装置。 - 前記メモリ制御部は、
前記FFTモードが256である場合において、
前記読出アドレスの上位ビットから下位ビットの配列が{a11、a10、a9、a8、a7、a6、a5、a4、a3、a2、a1、a0}であるときは、
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{0、0、0、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースすること、
を特徴とる請求項1に記載のデジタルオーディオ放送受信装置。 - 前記メモリ制御部は、
前記FFTモードが512である場合において、
前記読出アドレスの上位ビットから下位ビットの配列が{a11、a10、a9、a8、a7、a6、a5、a4、a3、a2、a1、a0}である場合ときは、
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{0、a3、0、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースすること、
を特徴とする請求項1に記載のデジタルオーディオ放送受信装置。 - 伝送されるデータの大きさに応じて各種のFFTモードを有するデジタルオーディオ放送受信装置の動作方法において、
4096個の記録アドレスを発生するステップと、
前記4096個の記録アドレスに対応して前記FFTモードの各々のデータを繰り返して4096個のデータを生成し、前記4096個のデータを用いて高速フーリエ変換を行なう高速フーリエ変換ステップと、
前記高速フーリエ変換ステップの動作が終了すると、読出アドレスを発生するステップとを含み、
前記高速フーリエ変換ステップは、
前記FFTモードの各々のデータを繰り返して前記4096個のデータを生成するステップと、
前記4096個のデータを用いてRadix−4方式で演算し、メモリのアドレスに対応して前記メモリに記録する演算ステップと、
前記読出アドレスが発生すると、前記読出アドレスに対応する前記メモリのアドレスにデジットリバースを行なうデジットリバースステップとを含むこと、
を特徴とするデジタルオーディオ放送受信装置の動作方法。 - 前記Radix−4方式で演算するために、前記演算ステップで繰り返された前記4096個のデータを、前記メモリ及び仮想メモリに記録するステップを更に含むこと、
を特徴とする請求項9に記載のデジタルオーディオ放送受信装置の動作方法。 - 前記演算ステップでは、前記Radix−4方式で演算を行い、
これにより、前記仮想メモリに前記FFTモードに対応して‘0’データがブロック化して記録されること、
を特徴とする請求項10に記載のデジタルオーディオ放送受信装置の動作方法。 - 前記デジットリバースステップでは、
前記Radix−4方式で演算され、前記メモリに記録されたデータを前記FFTモードに対応してデジットリバースすること、
を特徴とする請求項9に記載のデジタルオーディオ放送受信装置の動作方法。 - 前記デジットリバースステップでは、
前記FFTモードが2048である場合において、
前記読出アドレスの上位ビットから下位ビットの配列が{a11、a10、a9、a8、a7、a6、a5、a4、a3、a2、a1、a0}であるときは、
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{a1、a3、a2、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースすること、
を特徴とする請求項9に記載のデジタルオーディオ放送受信装置の動作方法。 - 前記デジットリバースステップでは、
前記FFTモードが1024である場合において、
前記読出アドレスの上位ビットから下位ビットの配列が{a11、a10、a9、a8、a7、a6、a5、a4、a3、a2、a1、a0}であるときは、
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{0、a3、a2、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースすること、
を特徴とする請求項9に記載のデジタルオーディオ放送受信装置の動作方法。 - 前記デジットリバースステップでは、
前記FFTモードが256である場合において、
前記読出アドレスの上位ビットから下位ビットの配列が{a11、a10、a9、a8、a7、a6、a5、a4、a3、a2、a1、a0}であるときは、
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{0、0、0、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースすること、
を特徴とする請求項9に記載のデジタルオーディオ放送受信装置の動作方法。 - 前記デジットリバースステップでは、
前記FFTモードが512である場合において、
前記読出アドレスの上位ビットから下位ビットの配列が{a11、a10、a9、a8、a7、a6、a5、a4、a3、a2、a1、a0}であるときは、
これに対応して前記メモリアドレスの上位ビットから下位ビットの配列を{0、a3、0、a5、a4、a7、a6、a9、a8、a11、a10}にデジットリバースすること、
を特徴とする請求項9に記載のデジタルオーディオ放送受信装置の動作方法。
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