JP3498773B2 - 出力電力制御方法及び出力電力システム - Google Patents
出力電力制御方法及び出力電力システムInfo
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- H04W52/04—TPC
- H04W52/18—TPC being performed according to specific parameters
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- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Mobile Radio Communication Systems (AREA)
- Transmitters (AREA)
- Transceivers (AREA)
Description
【０００１】
【発明の属する技術分野】本発明は、無線通信に関し、
特にCDMAセルラ電話における出力電力制御に関する。
特にCDMAセルラ電話における出力電力制御に関する。
【０００２】
【従来の技術】種々の業界の標準が、携帯移動局、自動
車電話を含めあらゆる種類のCDMAセルラ電話の設計及び
動作を規制している。これらの標準は、当業者には理解
されているものと見て良いであろう。本発明に係わりの
ある標準の一例はTIA/EIA/IS-95 デュアルモード広帯域
拡散スペクトル・セルラ・システムのための移動局−基
地局整合性標準（TIA/EIA/IS-95 Mobil Station-Base S
tation Compatibility Standard for Dual-Mode Wideba
nd Spread Spectrum Cellular System）及びTIA/EIA/IS
-98, デュアルモード広帯域拡散スペクトルセルラ移動
局のための推奨最小性能標準（TIA/EIA/IS-98, Recomme
nded Miminum Performance Standards forDual-Mode Wi
deband Spread Spectrum Cellular Mobile Stations）
である。
車電話を含めあらゆる種類のCDMAセルラ電話の設計及び
動作を規制している。これらの標準は、当業者には理解
されているものと見て良いであろう。本発明に係わりの
ある標準の一例はTIA/EIA/IS-95 デュアルモード広帯域
拡散スペクトル・セルラ・システムのための移動局−基
地局整合性標準（TIA/EIA/IS-95 Mobil Station-Base S
tation Compatibility Standard for Dual-Mode Wideba
nd Spread Spectrum Cellular System）及びTIA/EIA/IS
-98, デュアルモード広帯域拡散スペクトルセルラ移動
局のための推奨最小性能標準（TIA/EIA/IS-98, Recomme
nded Miminum Performance Standards forDual-Mode Wi
deband Spread Spectrum Cellular Mobile Stations）
である。
【０００３】移動局の電力を正確に制御することは、CD
MAセルラ電話システムを適切かつ効率的に動作させるた
めにとても重要である。移動局が最も近い基地局から遠
く離れているときは、最適の通信リンクを保つため、移
動局は最大の電力で信号の送信をしなければならない。
しかし、CDMA移動局が基地局に近付くにつれ、通信を続
けるに必要な移動局出力電力は低下する。さらに、その
ような出力電力の低減は、移動局間の干渉を減らすため
に必要である。かくして、バッテリーの消耗を抑えるた
めだけではなく、移動局出力電力を小さくして、常に強
固な通信リンクを保証することは、CDMAセルラ電話シス
テムの適切な動作のために必要である。
MAセルラ電話システムを適切かつ効率的に動作させるた
めにとても重要である。移動局が最も近い基地局から遠
く離れているときは、最適の通信リンクを保つため、移
動局は最大の電力で信号の送信をしなければならない。
しかし、CDMA移動局が基地局に近付くにつれ、通信を続
けるに必要な移動局出力電力は低下する。さらに、その
ような出力電力の低減は、移動局間の干渉を減らすため
に必要である。かくして、バッテリーの消耗を抑えるた
めだけではなく、移動局出力電力を小さくして、常に強
固な通信リンクを保証することは、CDMAセルラ電話シス
テムの適切な動作のために必要である。
【０００４】上記の標準によれば、CDMA移動局は出力電
力調整のための２つの独立した手段を有しなければなら
ない。一つが開ループ制御であり、これは移動局内で完
結する動作である。もう一つは閉ループ補正であり、移
動局と基地局とにより行なわれる。開ループ利得制御シ
ステムは基地局からの受信信号の強さを検出し、この値
を用いて移動局の出力電力を逆に制御する。従って、開
ループ利得制御システムでは、受信信号強度が高まるに
つれ（移動局が基地局に近付くにつれ）、出力電力が小
さくされる。典型的な開ループ利得制御システムは、受
信信号強度を受け、この値を用いて利得可調整送信増幅
器を制御し、この増幅器はこれにより無線送信信号に加
えられる利得を変化させる従来の自動利得制御システム
を有する。かくして、開ループ利得制御システムは、基
地局から送信され、移動局で受信された信号の強度に基
づいて行なわれる移動局内の動作である。
力調整のための２つの独立した手段を有しなければなら
ない。一つが開ループ制御であり、これは移動局内で完
結する動作である。もう一つは閉ループ補正であり、移
動局と基地局とにより行なわれる。開ループ利得制御シ
ステムは基地局からの受信信号の強さを検出し、この値
を用いて移動局の出力電力を逆に制御する。従って、開
ループ利得制御システムでは、受信信号強度が高まるに
つれ（移動局が基地局に近付くにつれ）、出力電力が小
さくされる。典型的な開ループ利得制御システムは、受
信信号強度を受け、この値を用いて利得可調整送信増幅
器を制御し、この増幅器はこれにより無線送信信号に加
えられる利得を変化させる従来の自動利得制御システム
を有する。かくして、開ループ利得制御システムは、基
地局から送信され、移動局で受信された信号の強度に基
づいて行なわれる移動局内の動作である。
【０００５】閉ループ利得制御システムには移動局及び
基地局の双方が関与する。閉ループ利得制御システムに
おいては、移動局からの信号を基地局で受信し、これに
基づき移動局に対し電力の増減を指示する。移動局は基
地局からの制御データ（典型的には電力の増加又は減少
を指示する単一のビット）を常に分析して、出力電力を
増加すべきか減少すべきを決める。閉ループ利得制御シ
ステムは典型的には、移動局モデム特定用途向け集積回
路（MSM ASIC）内のパルス密度変調器（pulsedensity m
odulator)に機能的に結合され閉ループ電力制御レジス
タを用いて、レジスタ内に記憶された値のアナログ出力
表現を与えることにより、実現される。このアナログ表
現は開ループ利得制御システムからの出力と組合せられ
て調整可能な送信増幅器の制御に用いられる。レジスタ
値及び可調整送信増幅器はまた通常逆の関係を有し、レ
ジスタ値が増加する（典型的には基地局から"１"を受け
ることにより）と、全体的電力が減少する。
基地局の双方が関与する。閉ループ利得制御システムに
おいては、移動局からの信号を基地局で受信し、これに
基づき移動局に対し電力の増減を指示する。移動局は基
地局からの制御データ（典型的には電力の増加又は減少
を指示する単一のビット）を常に分析して、出力電力を
増加すべきか減少すべきを決める。閉ループ利得制御シ
ステムは典型的には、移動局モデム特定用途向け集積回
路（MSM ASIC）内のパルス密度変調器（pulsedensity m
odulator)に機能的に結合され閉ループ電力制御レジス
タを用いて、レジスタ内に記憶された値のアナログ出力
表現を与えることにより、実現される。このアナログ表
現は開ループ利得制御システムからの出力と組合せられ
て調整可能な送信増幅器の制御に用いられる。レジスタ
値及び可調整送信増幅器はまた通常逆の関係を有し、レ
ジスタ値が増加する（典型的には基地局から"１"を受け
ることにより）と、全体的電力が減少する。
【０００６】単一の移動局内に開及び閉ループ利得制御
システムを備えた出力電力制御システムを適切に動作さ
せようとすると特別の困難に遭遇する。そのような元々
独立の２つのシステムを組合せることにより当然予想さ
れる困難の他に、上記の標準による要求により別個の問
題が生じる。即ち、全電力出力及びスプリアス発射レベ
ルに制限があり、開ループ推定値を中心とし、閉ループ
制御を行なう必要があり、基地局からの指示に対する応
答の時間についての要求がある。まず、フル・レート通
信における移動局を用いたとき、最大電力における実効
的放射電力は上限が３０dBm、下限が２３dBmである。従
って、最大電力において移動局は少なくとも２３dBmで
放射し、多くとも３０dBmで放射する。最大出力電力に
おける実効的放射電力は実際には２８dBm程度である。
これは最大のスプリアス発射レベルを決める第２の要求
のためである。全出力電力スケールの下端においては、
出力電力が最小に設定されたとき移動局の平均制御出力
電力は−５０dBmでなければならない。従って、業界の
標準仕様によれば、移動局は−５０dBmから３０dBmまで
の範囲の出力電力を出すことができるのが望ましい。
システムを備えた出力電力制御システムを適切に動作さ
せようとすると特別の困難に遭遇する。そのような元々
独立の２つのシステムを組合せることにより当然予想さ
れる困難の他に、上記の標準による要求により別個の問
題が生じる。即ち、全電力出力及びスプリアス発射レベ
ルに制限があり、開ループ推定値を中心とし、閉ループ
制御を行なう必要があり、基地局からの指示に対する応
答の時間についての要求がある。まず、フル・レート通
信における移動局を用いたとき、最大電力における実効
的放射電力は上限が３０dBm、下限が２３dBmである。従
って、最大電力において移動局は少なくとも２３dBmで
放射し、多くとも３０dBmで放射する。最大出力電力に
おける実効的放射電力は実際には２８dBm程度である。
これは最大のスプリアス発射レベルを決める第２の要求
のためである。全出力電力スケールの下端においては、
出力電力が最小に設定されたとき移動局の平均制御出力
電力は−５０dBmでなければならない。従って、業界の
標準仕様によれば、移動局は−５０dBmから３０dBmまで
の範囲の出力電力を出すことができるのが望ましい。
【０００７】以上の要求に加え、閉ループ利得制御シス
テムは、開ループ推定値を中心に上下に少なくとも２４
dBmの利得制御範囲を持たなければならない。言換えれ
ば、開ループ推定値が−５０dBmから３０dBmの範囲のど
こに全出力電力を位置させようとも、開ループ推定値か
ら上方又は下方に、全出力電力を少なくとも２４dB増加
または減少させる閉ループ利得制御システムが必要であ
る。閉ループ利得制御システムの一つの例では、閉ルー
プ範囲が、利得の１dB単位に対応するメモリ増分により
表わされる等しいステップに分割される。従って、基地
局が移動局に電力の増加又は減少を指示すると、閉ルー
プ利得制御システムは全出力電力を１dBずつ増加又は減
少させようとする。
テムは、開ループ推定値を中心に上下に少なくとも２４
dBmの利得制御範囲を持たなければならない。言換えれ
ば、開ループ推定値が−５０dBmから３０dBmの範囲のど
こに全出力電力を位置させようとも、開ループ推定値か
ら上方又は下方に、全出力電力を少なくとも２４dB増加
または減少させる閉ループ利得制御システムが必要であ
る。閉ループ利得制御システムの一つの例では、閉ルー
プ範囲が、利得の１dB単位に対応するメモリ増分により
表わされる等しいステップに分割される。従って、基地
局が移動局に電力の増加又は減少を指示すると、閉ルー
プ利得制御システムは全出力電力を１dBずつ増加又は減
少させようとする。
【０００８】
【発明が解決しようとする課題】明らかに、全出力電力
及び閉ループ利得制御に関するこれらの要求は、相反す
る可能性を持つ。言換えれば、もし開ループ推定値が最
大出力電力の２４dB以内である（例えば理想的な３０dB
のシステムにおいて６dBより上である）とすれば、閉ル
ープシステムが飽和状態に入る可能性がある。例えば、
移動局が基地局から遠く離れているときは、基地局は移
動局に対し、その出力電力が最大になった後も、電力を
増加するよう指示を与え続けるかも知れない。そのよう
な状況では、閉ループシステムは移動局の最大出力能力
の少なくとも２４ステップ上であり、従って、電力を下
げるときには、基地局は少なくとも２４回連続して電力
を下げる指示を出し、その後にはじめて実際に移動局の
出力電力が下がり始める。不幸にして、この結果は上記
標準の他の要求、即ち閉ループの応答性についての要求
により許容できない。この応答性に関する要求によれ
ば、移動局が基地局から電力減少指示を受けた後、移動
局は短い定められた時間内に電力の減少を開始しなけれ
ばならない。フル・レートで通信しているときには、こ
の時間は２．５msである。フル・レートでは基地局から
の電力制御指示は、１．２５ms毎に到着するのであるか
ら、移動局は、２つの後続の有効な電力制御指示が届く
までに全出力電力の減少を始めなければならない。上記
のように、閉ループシステムを飽和状態から引戻すため
に２４以上のステップを要するので、従来の電力制御シ
ステムは閉ループ応答性要求を満たすことができないか
も知れない。
及び閉ループ利得制御に関するこれらの要求は、相反す
る可能性を持つ。言換えれば、もし開ループ推定値が最
大出力電力の２４dB以内である（例えば理想的な３０dB
のシステムにおいて６dBより上である）とすれば、閉ル
ープシステムが飽和状態に入る可能性がある。例えば、
移動局が基地局から遠く離れているときは、基地局は移
動局に対し、その出力電力が最大になった後も、電力を
増加するよう指示を与え続けるかも知れない。そのよう
な状況では、閉ループシステムは移動局の最大出力能力
の少なくとも２４ステップ上であり、従って、電力を下
げるときには、基地局は少なくとも２４回連続して電力
を下げる指示を出し、その後にはじめて実際に移動局の
出力電力が下がり始める。不幸にして、この結果は上記
標準の他の要求、即ち閉ループの応答性についての要求
により許容できない。この応答性に関する要求によれ
ば、移動局が基地局から電力減少指示を受けた後、移動
局は短い定められた時間内に電力の減少を開始しなけれ
ばならない。フル・レートで通信しているときには、こ
の時間は２．５msである。フル・レートでは基地局から
の電力制御指示は、１．２５ms毎に到着するのであるか
ら、移動局は、２つの後続の有効な電力制御指示が届く
までに全出力電力の減少を始めなければならない。上記
のように、閉ループシステムを飽和状態から引戻すため
に２４以上のステップを要するので、従来の電力制御シ
ステムは閉ループ応答性要求を満たすことができないか
も知れない。
【０００９】この問題に対する効率的かつ信頼性のある
解決し、すべての状況で所望の結果を出し、かつ諸々の
要求を満たすことは容易ではない。困難の原因の一つ
は、最大出力電力に達した後に開ループシステムもまた
増加し続けることである。さらに、ビルのような大きな
一時的な障害物のため出力電力の変更ないし修正が必要
である。かくして、急速に変化する条件下で、業界の標
準仕様を満たすシステムが必要である。最後に、製造及
び他のバラつきにおける許容誤差を補償するため、閉ル
ープの範囲がプラス・マイナス２４dBよりも大きいこと
が要求される。不幸にして、範囲を広げることによりこ
れらの必要に答えることは閉ループ利得制御システムの
飽和をより大きくする危険を孕んでいる。
解決し、すべての状況で所望の結果を出し、かつ諸々の
要求を満たすことは容易ではない。困難の原因の一つ
は、最大出力電力に達した後に開ループシステムもまた
増加し続けることである。さらに、ビルのような大きな
一時的な障害物のため出力電力の変更ないし修正が必要
である。かくして、急速に変化する条件下で、業界の標
準仕様を満たすシステムが必要である。最後に、製造及
び他のバラつきにおける許容誤差を補償するため、閉ル
ープの範囲がプラス・マイナス２４dBよりも大きいこと
が要求される。不幸にして、範囲を広げることによりこ
れらの必要に答えることは閉ループ利得制御システムの
飽和をより大きくする危険を孕んでいる。
【００１０】従って、当業界では、上記の問題等を解決
することのできる方法及び装置が求められている。
することのできる方法及び装置が求められている。
【００１１】従って、本発明の一つの目的は、閉ループ
利得制御システムの応答性を維持する方法及び装置を提
供することである。
利得制御システムの応答性を維持する方法及び装置を提
供することである。
【００１２】本発明の他の目的は、開ループ及び閉ルー
プ利得制御システムを有する無線電話の飽和防止方法及
び装置を提供することである。
プ利得制御システムを有する無線電話の飽和防止方法及
び装置を提供することである。
【００１３】本発明のさらに他の目的は、基地局から電
力減少命令を受けた後特定の時間内出力電力の減少を開
始する出力電力制御システムを提供することである。
力減少命令を受けた後特定の時間内出力電力の減少を開
始する出力電力制御システムを提供することである。
【００１４】本発明のさらに他の目的は、閉ループ電力
制御レジスタを修正して、応答時間飽和を防止し、出力
電力を制限する無線電話出力電力制御システムを提供す
ることである。
制御レジスタを修正して、応答時間飽和を防止し、出力
電力を制限する無線電話出力電力制御システムを提供す
ることである。
【００１５】本発明のさらに他の目的は、RF出力電力が
出力電力トリガーレベルを超えたかどうかを連続的に示
すRF出力検出器及びRF出力比較器を提供することであ
る。
出力電力トリガーレベルを超えたかどうかを連続的に示
すRF出力検出器及びRF出力比較器を提供することであ
る。
【００１６】本発明のさらに他の目的は、閉ループ電力
制御レジスタの従来の閉ループ利得制御システムに取っ
て代るための根拠として演算増幅器出力比較器を有する
飽和防止システムを提供することである。
制御レジスタの従来の閉ループ利得制御システムに取っ
て代るための根拠として演算増幅器出力比較器を有する
飽和防止システムを提供することである。
【００１７】本発明のさらに他の目的は、閉ループ電力
制御レジスタの従来の閉ループ利得制御システムに取っ
て代るための根拠として出力検出器及びA/D変換器を有
する飽和防止システムを提供することである。
制御レジスタの従来の閉ループ利得制御システムに取っ
て代るための根拠として出力検出器及びA/D変換器を有
する飽和防止システムを提供することである。
【００１８】本発明のさらに他の目的は、しきい値を超
えた状態を検出したとき出力電力を自動的に減少させる
飽和防止システムを提供することである。
えた状態を検出したとき出力電力を自動的に減少させる
飽和防止システムを提供することである。
【００１９】本発明のさらに他の目的は、絶対値電力及
びスプリアス発射要求を満たす無線電話の出力電力を制
限する飽和防止システムを提供することである。
びスプリアス発射要求を満たす無線電話の出力電力を制
限する飽和防止システムを提供することである。
【００２０】本発明のさらに他の目的は、閉ループ電力
制御レジスタを修正するに当り、受信信号強度を評価す
る飽和防止システムを提供することである。
制御レジスタを修正するに当り、受信信号強度を評価す
る飽和防止システムを提供することである。
【００２１】本発明のさらに他の目的は、出力電力が出
力電力トリガーレベルを超えたときに飽和防止処理を開
始し、該飽和防止処理がディジタルメモリ素子の修正に
より全出力電力を徐々に減少させるものである飽和防止
システムを提供することである。
力電力トリガーレベルを超えたときに飽和防止処理を開
始し、該飽和防止処理がディジタルメモリ素子の修正に
より全出力電力を徐々に減少させるものである飽和防止
システムを提供することである。
【００２２】本発明のさらに他の目的は、出力電力が出
力電力トリガーレベルを超えたときに飽和防止処理を開
始し、該飽和防止処理が基地局から受信された閉ループ
電力制御情報を無視することを含むものである飽和防止
システムを提供することである。
力電力トリガーレベルを超えたときに飽和防止処理を開
始し、該飽和防止処理が基地局から受信された閉ループ
電力制御情報を無視することを含むものである飽和防止
システムを提供することである。
【００２３】本発明のさらに他の目的は、出力電力が出
力電力トリガーレベルを超えたときに飽和防止処理を開
始し、該飽和防止処理が、受信信号強度が低下しない限
り閉ループ電力制御レジスタを一定値に維持し、受信信
号強度が低下したときは開ループ成分の増加を補償する
ことを含むものである飽和防止システムを提供すること
である。
力電力トリガーレベルを超えたときに飽和防止処理を開
始し、該飽和防止処理が、受信信号強度が低下しない限
り閉ループ電力制御レジスタを一定値に維持し、受信信
号強度が低下したときは開ループ成分の増加を補償する
ことを含むものである飽和防止システムを提供すること
である。
【００２４】
【課題を解決するための手段】簡潔に言えば、本発明は
無線電話における閉ループ利得制御システムの応答性を
維持する方法及び装置を含む。第１の好ましい実施の形
態によれば、本発明の装置は、移動局モデム（MSM）ASI
Cと方向性結合器（送信信号線上の無線周波数（RF）電
力増幅器の後段に配置されている）の間に結合された出
力検出器（９４）と出力比較器（９２）とを含む。出力
検出器（９４）は、無線電話の全出力電力のDC表現を発
生し、このDC表現は出力比較器（９２）内の演算増幅器
において一定のDC値と連続的に比較され、全出力が出力
電力トリガーレベルを超えて最大出力電力レベルに達し
たかどうかが判定される。この連続的比較の結果がMSM
ASICに読み込み可能(readable)I/Oポートを介して入力
される。該I/Oポートが特別にプログラムされたCPUによ
り１．２５ms毎に調べられる。
無線電話における閉ループ利得制御システムの応答性を
維持する方法及び装置を含む。第１の好ましい実施の形
態によれば、本発明の装置は、移動局モデム（MSM）ASI
Cと方向性結合器（送信信号線上の無線周波数（RF）電
力増幅器の後段に配置されている）の間に結合された出
力検出器（９４）と出力比較器（９２）とを含む。出力
検出器（９４）は、無線電話の全出力電力のDC表現を発
生し、このDC表現は出力比較器（９２）内の演算増幅器
において一定のDC値と連続的に比較され、全出力が出力
電力トリガーレベルを超えて最大出力電力レベルに達し
たかどうかが判定される。この連続的比較の結果がMSM
ASICに読み込み可能(readable)I/Oポートを介して入力
される。該I/Oポートが特別にプログラムされたCPUによ
り１．２５ms毎に調べられる。
【００２５】本発明の第１の好ましい実施の形態によれ
ば、無線電話の全出力電力が出力電力トリガーレベルよ
りも小さい間は、全出力電力は従来の方法で決められ
る。この第１のモードにおいては、開ループ利得制御シ
ステム及び閉ループ利得制御システムが組合せて用いら
れる。この閉ループ利得制御システムにおいては、基地
局から受信された閉ループ電力制御情報により従来の方
法で制御されるMSM ASIC内に配置された閉ループ電力制
御レジスタからのパルス密度変調出力が用いられる。し
かし、全出力電力が出力電力トリガーレベルよりも大き
くなると、CPUはMSM ASICのI/Oポートを介してこれを検
知し、第２の（飽和防止）モードでの動作を開始する。
この飽和防止モードでは、閉ループ電力制御レジスタ
が、基地局から受信された閉ループ電力制御情報によっ
てではなく、CPUにより制御される。
ば、無線電話の全出力電力が出力電力トリガーレベルよ
りも小さい間は、全出力電力は従来の方法で決められ
る。この第１のモードにおいては、開ループ利得制御シ
ステム及び閉ループ利得制御システムが組合せて用いら
れる。この閉ループ利得制御システムにおいては、基地
局から受信された閉ループ電力制御情報により従来の方
法で制御されるMSM ASIC内に配置された閉ループ電力制
御レジスタからのパルス密度変調出力が用いられる。し
かし、全出力電力が出力電力トリガーレベルよりも大き
くなると、CPUはMSM ASICのI/Oポートを介してこれを検
知し、第２の（飽和防止）モードでの動作を開始する。
この飽和防止モードでは、閉ループ電力制御レジスタ
が、基地局から受信された閉ループ電力制御情報によっ
てではなく、CPUにより制御される。
【００２６】第２の（飽和防止）モードにおいてMSM AS
IC内に配置された閉ループ電力制御レジスタを制御する
一つの好ましい方法は、全出力電力が出力電力トリガー
レベルよりも小さくなるまで、閉ループ電力制御レジス
タを修正し、全出力電力を減少させることを含む。出力
比較器が、MSM ASIC I/Oポートを介して、全出力電力が
出力電力トリガーレベルを超えて最大レベルに達したこ
とを示している限り、CPUは閉ループ電力制御レジスタ
を減少させ続ける。（全出力の開ループ成分が変化する
ので、"最大電力"と言う語は、出力電力トリガーレベル
よりも上の出力電力レベルの極めて小さい範囲のもので
あると理解されるべきである。）このようにして、CPU
は、閉ループ制御情報を評価することなく閉ループ電力
制御レジスタを減少させるとともに、そのような情報の
効果を不能にすることにより、基地局から受信された閉
ループ電力制御情報を無視する。さらに、一貫性と信頼
性がある解決のため全出力電力が連続的に検出され、CP
Uにより連続的に調べられており、開ループ利得制御シ
ステムにおける変化は直ちに考慮される。全出力電力が
出力電力トリガーレベルよりも小さくなると、本発明の
電力制御システムは第１のモードによる、閉ループ電力
制御レジスタの従来の閉ループ制御に戻る。以後、本発
明の第１の好ましい実施の形態の電力制御システムは、
全出力電力が最大出力レベルに達したか、それより小さ
くなったかに応じて、第１のモードと第２のモードを交
替させる。
IC内に配置された閉ループ電力制御レジスタを制御する
一つの好ましい方法は、全出力電力が出力電力トリガー
レベルよりも小さくなるまで、閉ループ電力制御レジス
タを修正し、全出力電力を減少させることを含む。出力
比較器が、MSM ASIC I/Oポートを介して、全出力電力が
出力電力トリガーレベルを超えて最大レベルに達したこ
とを示している限り、CPUは閉ループ電力制御レジスタ
を減少させ続ける。（全出力の開ループ成分が変化する
ので、"最大電力"と言う語は、出力電力トリガーレベル
よりも上の出力電力レベルの極めて小さい範囲のもので
あると理解されるべきである。）このようにして、CPU
は、閉ループ制御情報を評価することなく閉ループ電力
制御レジスタを減少させるとともに、そのような情報の
効果を不能にすることにより、基地局から受信された閉
ループ電力制御情報を無視する。さらに、一貫性と信頼
性がある解決のため全出力電力が連続的に検出され、CP
Uにより連続的に調べられており、開ループ利得制御シ
ステムにおける変化は直ちに考慮される。全出力電力が
出力電力トリガーレベルよりも小さくなると、本発明の
電力制御システムは第１のモードによる、閉ループ電力
制御レジスタの従来の閉ループ制御に戻る。以後、本発
明の第１の好ましい実施の形態の電力制御システムは、
全出力電力が最大出力レベルに達したか、それより小さ
くなったかに応じて、第１のモードと第２のモードを交
替させる。
【００２７】本発明の第２の好ましい実施の形態によれ
ば、MSM ASIC I/Oポートは最初にエッジ・トリガー割込
みポートとして構成される。この、エッジ・トリガー割
込みポートとしての構成において、CPUはMSM ASIC I/O
ポートを連続的に調べることをしない。全出力電力が出
力電力トリガーレベルよりも大きくなったことが出力検
出器及び出力比較器により検出され示されるまで、出力
比較器信号は、CPUにより基本的に無視される（CPU資源
を節約できる）。全出力電力が出力電力トリガーレベル
よりも大きくなったことが検出されると、CPUにより割
込みサービスルーチンが始められる。閉ループ電力制御
レジスタの制御は、MSM ASICによる従来の閉ループ制御
から、CPUによる飽和防止制御に移行する。閉ループ電
力制御レジスタは、全出力電力を１ステップ小さくすべ
く修正され、MSM I/Oポートは読み込み可能ポートとし
て再構成される。その後、第１の好ましい実施の形態の
方法と同様、全出力電力が出力電力トリガーレベルより
も上である限り、CPUは閉ループ電力制御レジスタを修
正を続けて、全出力電力を減少させる。これは全出力電
力が出力電力トリガーレベルよりも小さくなるまで続
く。全出力電力が出力電力トリガーレベルよりも小さく
なると、MSM I/Oポートが再びエッジ・トリガー割込み
ポートとして構成され、割込みサービスルーチンが終
り、閉ループ電力制御レジスタの従来の閉ループ制御が
可能にされる。可能なら、別個のMSM ASICを用いて割込
み及び読み込みを行なうこととしても良い。
ば、MSM ASIC I/Oポートは最初にエッジ・トリガー割込
みポートとして構成される。この、エッジ・トリガー割
込みポートとしての構成において、CPUはMSM ASIC I/O
ポートを連続的に調べることをしない。全出力電力が出
力電力トリガーレベルよりも大きくなったことが出力検
出器及び出力比較器により検出され示されるまで、出力
比較器信号は、CPUにより基本的に無視される（CPU資源
を節約できる）。全出力電力が出力電力トリガーレベル
よりも大きくなったことが検出されると、CPUにより割
込みサービスルーチンが始められる。閉ループ電力制御
レジスタの制御は、MSM ASICによる従来の閉ループ制御
から、CPUによる飽和防止制御に移行する。閉ループ電
力制御レジスタは、全出力電力を１ステップ小さくすべ
く修正され、MSM I/Oポートは読み込み可能ポートとし
て再構成される。その後、第１の好ましい実施の形態の
方法と同様、全出力電力が出力電力トリガーレベルより
も上である限り、CPUは閉ループ電力制御レジスタを修
正を続けて、全出力電力を減少させる。これは全出力電
力が出力電力トリガーレベルよりも小さくなるまで続
く。全出力電力が出力電力トリガーレベルよりも小さく
なると、MSM I/Oポートが再びエッジ・トリガー割込み
ポートとして構成され、割込みサービスルーチンが終
り、閉ループ電力制御レジスタの従来の閉ループ制御が
可能にされる。可能なら、別個のMSM ASICを用いて割込
み及び読み込みを行なうこととしても良い。
【００２８】本発明の他の好ましい実施の形態では、最
初にMSM ASIC I/Oポートがレベル・トリガー割込みポー
トとして構成される。全出力電力が最大レベルに達した
ことを出力比較器が示すと、レベル・トリガー割込みポ
ートにより出力比較器の新たなレベルが検出され、CPU
により割込みサービスルーチンが開始される。このルー
チンの間、割込みポートの付加的サービスは不能にさ
れ、閉ループ電力制御レジスタの飽和防止制御が行なわ
れる。すると、全出力電力を１ステップ減少させるべく
閉ループ電力制御レジスタが修正され、その後閉ループ
電力制御レジスタは従来の閉ループ電力制御に戻る。そ
の後の遅延時間経過後、割込みポートの付加的サービス
が再び可能にされ、割込みサービスルーチンが終る。閉
ループ電力制御レジスタの飽和防止制御は極めて短い持
続時間を有するので、基地局からのすべての電力制御情
報が閉ループ電力制御レジスタに影響を与える。従っ
て、次の遅延時間中に移動局により受信された基地局か
らの電力制御情報が電力の増加を要求するものであると
きは、割込みサービスルーチンがトリガーされる可能性
が高い。これは全出力電力の開ループ成分の変化に依存
する。
初にMSM ASIC I/Oポートがレベル・トリガー割込みポー
トとして構成される。全出力電力が最大レベルに達した
ことを出力比較器が示すと、レベル・トリガー割込みポ
ートにより出力比較器の新たなレベルが検出され、CPU
により割込みサービスルーチンが開始される。このルー
チンの間、割込みポートの付加的サービスは不能にさ
れ、閉ループ電力制御レジスタの飽和防止制御が行なわ
れる。すると、全出力電力を１ステップ減少させるべく
閉ループ電力制御レジスタが修正され、その後閉ループ
電力制御レジスタは従来の閉ループ電力制御に戻る。そ
の後の遅延時間経過後、割込みポートの付加的サービス
が再び可能にされ、割込みサービスルーチンが終る。閉
ループ電力制御レジスタの飽和防止制御は極めて短い持
続時間を有するので、基地局からのすべての電力制御情
報が閉ループ電力制御レジスタに影響を与える。従っ
て、次の遅延時間中に移動局により受信された基地局か
らの電力制御情報が電力の増加を要求するものであると
きは、割込みサービスルーチンがトリガーされる可能性
が高い。これは全出力電力の開ループ成分の変化に依存
する。
【００２９】本発明のさらに他の好ましい実施の形態に
おいては、第１の好ましい実施の形態の出力比較器の代
りにA/D変換器が用いられる。第１の好ましい実施の形
態のように、演算増幅器において全出力電力の検出され
たDC表現を一定のDCレベルと比較する代りに、出力検出
器からの出力を連続的にサンプルする。このディジタル
サンプルは直接CPUに入力され、出力電力トリガーレベ
ルの記憶された表現と比較される。第１の好ましい実施
の形態と同様、全出力電力が出力電力トリガーレベルよ
りも大きくなるまでは、閉ループ電力制御レジスタは、
従来の閉ループ利得制御モードにより制御される。同様
に、全出力電力が高過ぎる（出力電力トリガーレベルよ
りも大きい）と判定されると、CPUは飽和防止モードに
入り、閉ループ電力制御レジスタの制御を行ない、全出
力電力を減少させるべくレジスタを修正する。これは、
全出力電力が出力電力トリガーレベルよりも小さくなる
まで続く。
おいては、第１の好ましい実施の形態の出力比較器の代
りにA/D変換器が用いられる。第１の好ましい実施の形
態のように、演算増幅器において全出力電力の検出され
たDC表現を一定のDCレベルと比較する代りに、出力検出
器からの出力を連続的にサンプルする。このディジタル
サンプルは直接CPUに入力され、出力電力トリガーレベ
ルの記憶された表現と比較される。第１の好ましい実施
の形態と同様、全出力電力が出力電力トリガーレベルよ
りも大きくなるまでは、閉ループ電力制御レジスタは、
従来の閉ループ利得制御モードにより制御される。同様
に、全出力電力が高過ぎる（出力電力トリガーレベルよ
りも大きい）と判定されると、CPUは飽和防止モードに
入り、閉ループ電力制御レジスタの制御を行ない、全出
力電力を減少させるべくレジスタを修正する。これは、
全出力電力が出力電力トリガーレベルよりも小さくなる
まで続く。
【００３０】最後の２つの好ましい実施の形態では、閉
ループ電力制御レジスタを修正するために、受信信号強
度の測定値を一つの因子として用いる。この２つの実施
の形態間の主な違いは、全出力電力が出力電力トリガー
レベルよりも大きくなったことを検出する手段に関係す
る。一つの実施の形態は、第１の好ましい実施の形態と
同様の出力検出器及び出力比較器が用いる。他方の実施
の形態は、先に述べた好ましい実施の形態と同様A/D変
換器を用いる。両実施の形態において、全出力電力が出
力電力トリガーレベルを超えたと判定された後、移動局
が、全出力電力を下げることを要求する基地局からの電
力制御命令を受けるまで、維持飽和防止処理が行なわれ
る。この維持飽和防止モードにおいて、受信信号強度が
落ちた（全出力電力における開ループ成分の増加をもた
らす）ことが検出されない限り、閉ループ電力制御レジ
スタは一定レベルに維持される。受信信号強度の低下が
検出されると、受信信号強度の相対的低下が計算され、
閉ループ電力制御レジスタにより補償が行なわれ、開ル
ープ利得制御システムが電力制御システムを飽和状態に
押上げるのを防止し、一方閉ループ電力制御レジスタは
その他の点では、一定の値に維持される。移動局が最後
に基地局から全出力電力を下げることを要求する電力制
御情報を受けない場合、閉ループ電力制御レジスタは、
全出力電力を、最後の受信信号強度比較結果プラス付加
的な１ステップに従って、全出力電力を減少させるべく
修正される。遅延時間の経過後、閉ループ電力制御レジ
スタは、従来の閉ループ制御に戻る。
ループ電力制御レジスタを修正するために、受信信号強
度の測定値を一つの因子として用いる。この２つの実施
の形態間の主な違いは、全出力電力が出力電力トリガー
レベルよりも大きくなったことを検出する手段に関係す
る。一つの実施の形態は、第１の好ましい実施の形態と
同様の出力検出器及び出力比較器が用いる。他方の実施
の形態は、先に述べた好ましい実施の形態と同様A/D変
換器を用いる。両実施の形態において、全出力電力が出
力電力トリガーレベルを超えたと判定された後、移動局
が、全出力電力を下げることを要求する基地局からの電
力制御命令を受けるまで、維持飽和防止処理が行なわれ
る。この維持飽和防止モードにおいて、受信信号強度が
落ちた（全出力電力における開ループ成分の増加をもた
らす）ことが検出されない限り、閉ループ電力制御レジ
スタは一定レベルに維持される。受信信号強度の低下が
検出されると、受信信号強度の相対的低下が計算され、
閉ループ電力制御レジスタにより補償が行なわれ、開ル
ープ利得制御システムが電力制御システムを飽和状態に
押上げるのを防止し、一方閉ループ電力制御レジスタは
その他の点では、一定の値に維持される。移動局が最後
に基地局から全出力電力を下げることを要求する電力制
御情報を受けない場合、閉ループ電力制御レジスタは、
全出力電力を、最後の受信信号強度比較結果プラス付加
的な１ステップに従って、全出力電力を減少させるべく
修正される。遅延時間の経過後、閉ループ電力制御レジ
スタは、従来の閉ループ制御に戻る。
【００３１】本発明の他の目的、特徴、及び利点は、添
付の図面を参照してなされる以下の説明から明らかとな
ろう。
付の図面を参照してなされる以下の説明から明らかとな
ろう。
【００３２】
【発明の実施の形態】図面のうち、幾つかの図におい
て、同じ符号は同様の構成要素ないし回路を示す。図１
は本発明の第１の実施の形態によるCDMA拡散スペクトラ
ムセルラ電話の一部を示すブロック図である。選択され
た受信機及び送信機の回路素子は、ベースバンドASIC２
０、移動局モデム（MSM）ASIC２２、及び中央処理装置
（CPU）２４（MSM ASIC２２にアドレス／データバス２
３により接続されている）に接続されている。本発明の
第１の好ましい実施の形態によれば、ベースバンドASIC
２０は慣用手段により低周波数アナログ処理及びディジ
タル信号への或いはディジタルからの変換を行なって、
MSM ASIC２２とのインターフェイスを行なう。特に、ベ
ースバンドASIC２０の機能は中間周波数（IF）からベー
スバンドへの変換（及びその逆）、ベースバンド及びIF
フィルタリング、ベースバンド信号直交分離及び合成、
ベースバンド・アナログ−ディジタル変換及びディジタ
ル−アナログ変換、ベースバンドDCオフセット制御、局
部発振器直交発生、クロック振幅調整を含む。さらに、
本発明の第１の好ましい実施の形態によれば、MSM ASIC
２２は従来と同じく復調ユニット、復号ユニット、イン
ターリービング／ディインターリービング（deinterlea
ving)ユニットを介して大部分の物理レイヤー信号発生
を行なう。他の機能部材のうち、復調ユニットはマルチ
プル・パス及び検索受信機と信号合成回路とを有し、復
号ユニットはビタビ（viterbi)復号器及びデータ品質検
査(verification)手段を含み、インターリービング／デ
ィインターリービングユニットは、畳込み(convolution
al)符号化器、インターリーバー、ディインターリーバ
ー、疑似乱数（ＰＮ）列拡散器（spreader)、データ・
バースト・ランダム化器（randomoizer)、有限インパル
ス応答（ＦＩＲ）フィルターを含む。慣用メモリ及び支
持回路に加え、CPU２４は従来公知のスタティックＣＭ
ＯＳ高集積（complementary-symmetry metal-oxide-sem
iconductor)マイクロプロセッサと、汎用レジスタ、セ
グメントレジスタ、ベース・レジスタ、インデックス・
レジスタ、状態レジスタ、及び制御レジスタを備えてい
る。
て、同じ符号は同様の構成要素ないし回路を示す。図１
は本発明の第１の実施の形態によるCDMA拡散スペクトラ
ムセルラ電話の一部を示すブロック図である。選択され
た受信機及び送信機の回路素子は、ベースバンドASIC２
０、移動局モデム（MSM）ASIC２２、及び中央処理装置
（CPU）２４（MSM ASIC２２にアドレス／データバス２
３により接続されている）に接続されている。本発明の
第１の好ましい実施の形態によれば、ベースバンドASIC
２０は慣用手段により低周波数アナログ処理及びディジ
タル信号への或いはディジタルからの変換を行なって、
MSM ASIC２２とのインターフェイスを行なう。特に、ベ
ースバンドASIC２０の機能は中間周波数（IF）からベー
スバンドへの変換（及びその逆）、ベースバンド及びIF
フィルタリング、ベースバンド信号直交分離及び合成、
ベースバンド・アナログ−ディジタル変換及びディジタ
ル−アナログ変換、ベースバンドDCオフセット制御、局
部発振器直交発生、クロック振幅調整を含む。さらに、
本発明の第１の好ましい実施の形態によれば、MSM ASIC
２２は従来と同じく復調ユニット、復号ユニット、イン
ターリービング／ディインターリービング（deinterlea
ving)ユニットを介して大部分の物理レイヤー信号発生
を行なう。他の機能部材のうち、復調ユニットはマルチ
プル・パス及び検索受信機と信号合成回路とを有し、復
号ユニットはビタビ（viterbi)復号器及びデータ品質検
査(verification)手段を含み、インターリービング／デ
ィインターリービングユニットは、畳込み(convolution
al)符号化器、インターリーバー、ディインターリーバ
ー、疑似乱数（ＰＮ）列拡散器（spreader)、データ・
バースト・ランダム化器（randomoizer)、有限インパル
ス応答（ＦＩＲ）フィルターを含む。慣用メモリ及び支
持回路に加え、CPU２４は従来公知のスタティックＣＭ
ＯＳ高集積（complementary-symmetry metal-oxide-sem
iconductor)マイクロプロセッサと、汎用レジスタ、セ
グメントレジスタ、ベース・レジスタ、インデックス・
レジスタ、状態レジスタ、及び制御レジスタを備えてい
る。
【００３３】以下の説明は本発明の第１の好ましい実施
の形態に用い得る回路に関するものである。ここに記載
する内部構成の変形（プログラミング等）を除き、従来
例の使用可能なCPU２４、MSM ASIC２２、及びベースバ
ンドASIC２０は、それぞれカリフォルニア州、サニーベ
イル（Sunnyvale, CA)のアドバンスト・マイクロ・デバ
イセズ（Advanced Micro Devices)から入手可能な８０
Ｃ１８６マイクロプロセッサ、カリフォルニア州、サン
ディエゴ（San Diego, CA)のカルコム・インコーポレテ
ィッド（Qualcomm, Inc)から入手可能なＱ５３１０１−
１Ｓ２ベースバンドASIC、及び同じくカルコム・インコ
ーポレティッド（Qualcomm, Inc)から入手可能なＱ５２
５０１−１Ｓ２MSMである。さらに、図１に示された無
線電話の一部は、セルラ電話全体の選択された部分のみ
を示すものであり、セルラ電話全体の中には他の回路の
ホストを含む。該ホストは図面には示されていないが、
各回路の動作及び必要性に関し、当業者には容易に理解
されるものである。さらに、回路ブロックは、名称が意
味する機能のほか、慣用のフィルタリング、ノイズリダ
クション、バイアス回路が含まれていることが理解され
るべきである。
の形態に用い得る回路に関するものである。ここに記載
する内部構成の変形（プログラミング等）を除き、従来
例の使用可能なCPU２４、MSM ASIC２２、及びベースバ
ンドASIC２０は、それぞれカリフォルニア州、サニーベ
イル（Sunnyvale, CA)のアドバンスト・マイクロ・デバ
イセズ（Advanced Micro Devices)から入手可能な８０
Ｃ１８６マイクロプロセッサ、カリフォルニア州、サン
ディエゴ（San Diego, CA)のカルコム・インコーポレテ
ィッド（Qualcomm, Inc)から入手可能なＱ５３１０１−
１Ｓ２ベースバンドASIC、及び同じくカルコム・インコ
ーポレティッド（Qualcomm, Inc)から入手可能なＱ５２
５０１−１Ｓ２MSMである。さらに、図１に示された無
線電話の一部は、セルラ電話全体の選択された部分のみ
を示すものであり、セルラ電話全体の中には他の回路の
ホストを含む。該ホストは図面には示されていないが、
各回路の動作及び必要性に関し、当業者には容易に理解
されるものである。さらに、回路ブロックは、名称が意
味する機能のほか、慣用のフィルタリング、ノイズリダ
クション、バイアス回路が含まれていることが理解され
るべきである。
【００３４】無線信号がアンテナ２６を介して受信され
ると、デュープレクサ２８はこの信号を無線（RF）受信
増幅器３０に導き、該無線受信増幅器３０は受信された
信号を増幅した後ダウンコンバータ回路３２に供給す
る。このダウンコンバータ回路３２は増幅されたRF信号
をより低い周波数のIF信号に変換する。IF信号は、IF受
信増幅回路３８によりさらに増幅された後、IF入力線３
９を介してベースバンドASIC２０に供給される。ベース
バンドASIC２０はまた送信IF信号をIF出力線４１を介し
てIF送信増幅回路４０に供給する。増幅の後、送信信号
はアップコンバータ４２により、より高いIF周波数に変
換され、次に利得可調整IF信号増幅回路４４により、調
整可能に増幅される。次にアップコンバータ４６がIF信
号をRF信号に変換し、このRF信号はRF増幅回路４８によ
り増幅される。方向性結合器４０はRF信号を通過させて
デュープレクサ２８に導き、該デュープレクサ２８はRF
送信出力信号をアンテナ２６に送り、該アンテナ２６に
より送信される。
ると、デュープレクサ２８はこの信号を無線（RF）受信
増幅器３０に導き、該無線受信増幅器３０は受信された
信号を増幅した後ダウンコンバータ回路３２に供給す
る。このダウンコンバータ回路３２は増幅されたRF信号
をより低い周波数のIF信号に変換する。IF信号は、IF受
信増幅回路３８によりさらに増幅された後、IF入力線３
９を介してベースバンドASIC２０に供給される。ベース
バンドASIC２０はまた送信IF信号をIF出力線４１を介し
てIF送信増幅回路４０に供給する。増幅の後、送信信号
はアップコンバータ４２により、より高いIF周波数に変
換され、次に利得可調整IF信号増幅回路４４により、調
整可能に増幅される。次にアップコンバータ４６がIF信
号をRF信号に変換し、このRF信号はRF増幅回路４８によ
り増幅される。方向性結合器４０はRF信号を通過させて
デュープレクサ２８に導き、該デュープレクサ２８はRF
送信出力信号をアンテナ２６に送り、該アンテナ２６に
より送信される。
【００３５】利得可調整IF受信増幅回路３４の増幅量の
連続的調整により、受信IF信号はその変動が小さな範囲
に抑えられ、ベースバンドASIC２０の入力として許容し
得るものとなる。利得可調整IF受信増幅回路３４の制御
は、自動利得制御回路（AGC）６０により行なわれる。A
GC検出回路６２はAGC入力線６３を介して代表的なIF信
号を受ける。以下に詳述するように、受信された信号の
強さを表わすDC信号がAGC検出回路６２からAGC検出出力
線６４上に出力される。AGC積分回路６６はDC信号を、M
SM ASIC２２からAGC基準線６７を介して供給される比較
的一定のAGC基準信号と比較して、両者の差を積分す
る。２つの信号の差の積分値は、開ループ出力線６８に
出力され、該開ループ出力線６８は線形インバータ７０
に接続されている。この線形インバータ７０はAGC制御
信号を受信増幅制御線７２を介して利得可調整IF受信増
幅回路３４に供給する。線形インバータ７０は、開ルー
プ出力線６８を介して供給された信号を反転し、これに
より受信された信号の強さと利得可調整IF受信増幅回路
３４による増幅量とが逆の関係になるようにする。従っ
て、例えば受信された信号の強さが低下するに従い、利
得可調整IF受信増幅回路３４の増幅量が大きくなる。
連続的調整により、受信IF信号はその変動が小さな範囲
に抑えられ、ベースバンドASIC２０の入力として許容し
得るものとなる。利得可調整IF受信増幅回路３４の制御
は、自動利得制御回路（AGC）６０により行なわれる。A
GC検出回路６２はAGC入力線６３を介して代表的なIF信
号を受ける。以下に詳述するように、受信された信号の
強さを表わすDC信号がAGC検出回路６２からAGC検出出力
線６４上に出力される。AGC積分回路６６はDC信号を、M
SM ASIC２２からAGC基準線６７を介して供給される比較
的一定のAGC基準信号と比較して、両者の差を積分す
る。２つの信号の差の積分値は、開ループ出力線６８に
出力され、該開ループ出力線６８は線形インバータ７０
に接続されている。この線形インバータ７０はAGC制御
信号を受信増幅制御線７２を介して利得可調整IF受信増
幅回路３４に供給する。線形インバータ７０は、開ルー
プ出力線６８を介して供給された信号を反転し、これに
より受信された信号の強さと利得可調整IF受信増幅回路
３４による増幅量とが逆の関係になるようにする。従っ
て、例えば受信された信号の強さが低下するに従い、利
得可調整IF受信増幅回路３４の増幅量が大きくなる。
【００３６】開ループ出力線６８は加算反転回路８０に
対する入力を伝える。加算反転回路８０は送信増幅制御
線８２を介して利得可調整IF送信増幅回路４４を制御す
る。このようにして、開ループ出力線６８は全出力電力
制御の開ループ成分を提供し、これによりAGC積分回路
６６及びAGC検出回路６２もまた開ループ利得制御に寄
与する。加算反転回路８０の機能の一つ、即ち受信信号
の強さと増幅との間に逆の関係をつくる機能は、線形イ
ンバータ回路７０の機能と同様である。従って、例えば
閉ループ効果に関係なく、受信信号の強さが低下するに
従い、利得可調整IF送信増幅回路４４の増幅量が大きく
なる。閉ループ制御に関し、加算反転回路８０はまたMS
M ASIC２２から送信利得調整線９０を介して直接入力を
受ける。上記のように、送信利得調整線９０上の送信利
得調整信号は、全出力電力制御のうちの閉ループ利得制
御部分を表わすアナログ信号であり、これは送信増幅制
御線８２上の送信増幅制御信号により規定される。本発
明は主としてこの、送信利得調整線９０上の送信利得調
整信号の発生の方法に関わる。
対する入力を伝える。加算反転回路８０は送信増幅制御
線８２を介して利得可調整IF送信増幅回路４４を制御す
る。このようにして、開ループ出力線６８は全出力電力
制御の開ループ成分を提供し、これによりAGC積分回路
６６及びAGC検出回路６２もまた開ループ利得制御に寄
与する。加算反転回路８０の機能の一つ、即ち受信信号
の強さと増幅との間に逆の関係をつくる機能は、線形イ
ンバータ回路７０の機能と同様である。従って、例えば
閉ループ効果に関係なく、受信信号の強さが低下するに
従い、利得可調整IF送信増幅回路４４の増幅量が大きく
なる。閉ループ制御に関し、加算反転回路８０はまたMS
M ASIC２２から送信利得調整線９０を介して直接入力を
受ける。上記のように、送信利得調整線９０上の送信利
得調整信号は、全出力電力制御のうちの閉ループ利得制
御部分を表わすアナログ信号であり、これは送信増幅制
御線８２上の送信増幅制御信号により規定される。本発
明は主としてこの、送信利得調整線９０上の送信利得調
整信号の発生の方法に関わる。
【００３７】送信利得調整線９０上の送信利得調整信号
はMSM２２内部の処理並びにベースバンドASIC２０、CPU
２４、及び出力比較回路９２からの入力に応じてMSM AS
IC２２により発生される。出力比較回路９２は出力検出
回路９４から入力を受ける。出力検出回路９４は方向性
結合器５０から入力を受ける。出力検出回路９４は無線
電話の全出力電力を表わすDC信号を発生する。このDC信
号は、出力電力トリガー・レベルを表わすものとしてMS
M ASIC２２により発生される線９５上の一定の比較器し
きい値電圧と、出力比較回路９２内で比較される。この
連続的比較の結果は、出力比較回路からライン９７を介
してMSM ASIC２２に供給される。
はMSM２２内部の処理並びにベースバンドASIC２０、CPU
２４、及び出力比較回路９２からの入力に応じてMSM AS
IC２２により発生される。出力比較回路９２は出力検出
回路９４から入力を受ける。出力検出回路９４は方向性
結合器５０から入力を受ける。出力検出回路９４は無線
電話の全出力電力を表わすDC信号を発生する。このDC信
号は、出力電力トリガー・レベルを表わすものとしてMS
M ASIC２２により発生される線９５上の一定の比較器し
きい値電圧と、出力比較回路９２内で比較される。この
連続的比較の結果は、出力比較回路からライン９７を介
してMSM ASIC２２に供給される。
【００３８】図２は、図１の一部をより詳細に示す図で
ある。方向性結合器５０はRF増幅器４８からの出力信号
の一部を端子OUT２に導く。端子OUT２から出力された信
号は出力検出器９４で受信され、出力検出器９４は無線
電話の全出力電力を表わすDC信号を発生する。AC結合コ
ンデンサ１００は方向性結合器５０からの信号のDC成分
を取除く。バイアス抵抗１０２、１０４及びコイル１０
６によるフィルタリング及び調整を受けた後、残りのAC
信号は半波整流器として作用するダイオード１０８によ
り半波整流信号とされる。ダイオード１０８からの出力
は、コンデンサ１１０、１１４及び抵抗器１１２、１１
６、１１８により、平滑され、出力比較回路９２に入力
するのに適したように調整される。
ある。方向性結合器５０はRF増幅器４８からの出力信号
の一部を端子OUT２に導く。端子OUT２から出力された信
号は出力検出器９４で受信され、出力検出器９４は無線
電話の全出力電力を表わすDC信号を発生する。AC結合コ
ンデンサ１００は方向性結合器５０からの信号のDC成分
を取除く。バイアス抵抗１０２、１０４及びコイル１０
６によるフィルタリング及び調整を受けた後、残りのAC
信号は半波整流器として作用するダイオード１０８によ
り半波整流信号とされる。ダイオード１０８からの出力
は、コンデンサ１１０、１１４及び抵抗器１１２、１１
６、１１８により、平滑され、出力比較回路９２に入力
するのに適したように調整される。
【００３９】出力比較回路９２は出力検出回路９４から
の全出力電力を表わすDC信号を受ける。このDC信号は演
算増幅器１２０によりMSM ASIC２２により設定される一
定の信号と連続的に比較される。この一定の信号はMSM
ASIC２２の比較器しきい値（COMP THRESH）出力１３１
から出力された後、演算増幅器１２０の非反転入力への
入力のためフィルタリング及び調整を受ける。このCOMP
THRESH信号はMSM ASIC２２内に配置された比較しきい
値レジスタ１３０内の値（表現）のパルス密度変調した
形態のもので、同様に配置されたパルス密度変調器（PD
M）１３２により発生する。PDM１３２は基本的に比較し
きい値レジスタ１３０、即ちデジタル・メモリ素子内に
表わされる一定の値をディジタル−アナログ変換する。
の全出力電力を表わすDC信号を受ける。このDC信号は演
算増幅器１２０によりMSM ASIC２２により設定される一
定の信号と連続的に比較される。この一定の信号はMSM
ASIC２２の比較器しきい値（COMP THRESH）出力１３１
から出力された後、演算増幅器１２０の非反転入力への
入力のためフィルタリング及び調整を受ける。このCOMP
THRESH信号はMSM ASIC２２内に配置された比較しきい
値レジスタ１３０内の値（表現）のパルス密度変調した
形態のもので、同様に配置されたパルス密度変調器（PD
M）１３２により発生する。PDM１３２は基本的に比較し
きい値レジスタ１３０、即ちデジタル・メモリ素子内に
表わされる一定の値をディジタル−アナログ変換する。
【００４０】出力検出回路９４の出力は演算増幅器１２
０の非反転入力に導かれるので、出力検出回路９４の出
力がMSM ASIC２２のCOMP THRESH出力からのフィルタリ
ングされ、調整された一定出力よりも低い限り、演算増
幅器は高レベルの信号をMSMASIC２２の入力／出力（I/
O）ポート１３３に出力する。この状態は、無線電話の
全出力電力が出力電力トリガーレベルよりも低い状態に
対応する。無線電話の全出力電力が出力電力トリガーレ
ベルよりも大きくなると、出力比較回路９２の出力が高
レベルから低レベルへ遷移する。この出力は、出力検出
回路９４の出力が再びフィルタリングされ調整されたCO
MP THRESHレベルよりも下になるまで、即ち無線電話の
全出力電力が出力電力トリガーレベルよりも下に落ちる
まで、低レベルのままである。
０の非反転入力に導かれるので、出力検出回路９４の出
力がMSM ASIC２２のCOMP THRESH出力からのフィルタリ
ングされ、調整された一定出力よりも低い限り、演算増
幅器は高レベルの信号をMSMASIC２２の入力／出力（I/
O）ポート１３３に出力する。この状態は、無線電話の
全出力電力が出力電力トリガーレベルよりも低い状態に
対応する。無線電話の全出力電力が出力電力トリガーレ
ベルよりも大きくなると、出力比較回路９２の出力が高
レベルから低レベルへ遷移する。この出力は、出力検出
回路９４の出力が再びフィルタリングされ調整されたCO
MP THRESHレベルよりも下になるまで、即ち無線電話の
全出力電力が出力電力トリガーレベルよりも下に落ちる
まで、低レベルのままである。
【００４１】以下に詳述する方法により、MSM ASIC２２
及びCPU２４は、出力比較器９２から検出される信号レ
ベルを利用して、MSM ASIC２２内に配置されている閉ル
ープ電力制御レジスタ（CL PWR CTRL REG）１４０（内
に記憶されている値）を変更ないし修正する。比較しき
い値レジスタ１３０及びPDM１３２と同様、PDM１４２は
閉ループ電力制御レジスタ１４０内に記憶されている値
のアナログ表現を提供する。このアナログ表現はMSM AS
ICの送信利得調整（TX GAIN ADJ）出力１５０を介して
送信利得調整線９０に出力される。この送信利得調整線
９０は、図１に示される加算反転回路８０に接続されて
いる。AGC基準線６７にAGC基準信号を供給するAGC基準
出力１５２も示されている。MSM ASIC２２はまた、MSM
ASIC２２メモリの領域に配置された制御ビット（CB）１
４３を有する。MSM ASIC２２メモリはCPU２４により書
込み可能であり、従来の閉ループ電力制御技術により、
MSMASIC２２が閉ループ電力制御レジスタ１４０を制御
するか、CPU２４が閉ループ電力制御レジスタ１４０を
制御するかを制御する。
及びCPU２４は、出力比較器９２から検出される信号レ
ベルを利用して、MSM ASIC２２内に配置されている閉ル
ープ電力制御レジスタ（CL PWR CTRL REG）１４０（内
に記憶されている値）を変更ないし修正する。比較しき
い値レジスタ１３０及びPDM１３２と同様、PDM１４２は
閉ループ電力制御レジスタ１４０内に記憶されている値
のアナログ表現を提供する。このアナログ表現はMSM AS
ICの送信利得調整（TX GAIN ADJ）出力１５０を介して
送信利得調整線９０に出力される。この送信利得調整線
９０は、図１に示される加算反転回路８０に接続されて
いる。AGC基準線６７にAGC基準信号を供給するAGC基準
出力１５２も示されている。MSM ASIC２２はまた、MSM
ASIC２２メモリの領域に配置された制御ビット（CB）１
４３を有する。MSM ASIC２２メモリはCPU２４により書
込み可能であり、従来の閉ループ電力制御技術により、
MSMASIC２２が閉ループ電力制御レジスタ１４０を制御
するか、CPU２４が閉ループ電力制御レジスタ１４０を
制御するかを制御する。
【００４２】ベースバンドASIC２０は、受信IF信号を受
信IF出力（RX IF OUT）から、AGC入力線６３を介して、
AGC検出器６２に供給する。受信IF信号はAGC検出器６２
により調べられ、受信信号強度のDC成分をAGC検出出力
線６４に生じさせる。コンデンサ１７０は、AGC入力線
６３上のDC成分を阻止する。バイアス素子１７２、１７
４、１７６、１７８、及び１８０はバイポーラトランジ
スタ１９０を能動増幅領域に置くようなバイアスを与え
るように値が定められており、これにより、バイポーラ
トランジスタ１９０のベース・コレクタ間に一定の利得
が与えられる。バイポーラトランジスタ１９０は増幅線
１９２に接続されており、該増幅線１９２はコンデンサ
２００に接続されており、このコンデンサ２００はダイ
オード２０２にカソード及びダイオード２０４のアノー
ドに接続されている。ダイオード２０２のアノードは接
地されている。ダイオード２０４のカソードは抵抗２０
６（一端が接地されている）及び抵抗２１０に接続さ
れ、該抵抗２１０はAGC検出出力線６４及びコンデンサ
２１２（一方の電極が接地されている）に接続されてい
る。コンデンサ２００は後の素子と直列に接続され（AC
結合され）ているので、コンデンサ２００はAGC入力信
号からDC成分を除去し、またダイオード２０２及び２０
４と協働して、入力AC信号レベルに線形的に比例するAC
成分に、新たなDCレベルを付加する。AC信号レベルが上
昇すると、コンデンサ２００が充電され、AC信号レベル
が落ちると、ダイオード２０２がオンし、上方向の電圧
シフトが起きる。レジスタ２１０及びコンデンサ２１２
はロー・パス・フィルタとして動作し、残っているAC成
分を除去し、DC信号を残す。このDC信号は、AGC入力信
号のAC信号レベルに線形的に比例する。さらに、抵抗２
１０は平均化手段として働き、コンデンサ２１２の充電
を遅くする。これによりAGC出力線６４上のAGC出力信号
は平均化された線形の出力となる。さらに、抵抗２０６
及び２１０は互に値が略等しいことが望ましい。
信IF出力（RX IF OUT）から、AGC入力線６３を介して、
AGC検出器６２に供給する。受信IF信号はAGC検出器６２
により調べられ、受信信号強度のDC成分をAGC検出出力
線６４に生じさせる。コンデンサ１７０は、AGC入力線
６３上のDC成分を阻止する。バイアス素子１７２、１７
４、１７６、１７８、及び１８０はバイポーラトランジ
スタ１９０を能動増幅領域に置くようなバイアスを与え
るように値が定められており、これにより、バイポーラ
トランジスタ１９０のベース・コレクタ間に一定の利得
が与えられる。バイポーラトランジスタ１９０は増幅線
１９２に接続されており、該増幅線１９２はコンデンサ
２００に接続されており、このコンデンサ２００はダイ
オード２０２にカソード及びダイオード２０４のアノー
ドに接続されている。ダイオード２０２のアノードは接
地されている。ダイオード２０４のカソードは抵抗２０
６（一端が接地されている）及び抵抗２１０に接続さ
れ、該抵抗２１０はAGC検出出力線６４及びコンデンサ
２１２（一方の電極が接地されている）に接続されてい
る。コンデンサ２００は後の素子と直列に接続され（AC
結合され）ているので、コンデンサ２００はAGC入力信
号からDC成分を除去し、またダイオード２０２及び２０
４と協働して、入力AC信号レベルに線形的に比例するAC
成分に、新たなDCレベルを付加する。AC信号レベルが上
昇すると、コンデンサ２００が充電され、AC信号レベル
が落ちると、ダイオード２０２がオンし、上方向の電圧
シフトが起きる。レジスタ２１０及びコンデンサ２１２
はロー・パス・フィルタとして動作し、残っているAC成
分を除去し、DC信号を残す。このDC信号は、AGC入力信
号のAC信号レベルに線形的に比例する。さらに、抵抗２
１０は平均化手段として働き、コンデンサ２１２の充電
を遅くする。これによりAGC出力線６４上のAGC出力信号
は平均化された線形の出力となる。さらに、抵抗２０６
及び２１０は互に値が略等しいことが望ましい。
【００４３】図３はAGC積分回路６６、線形インバータ
７０及び加算反転回路８０を示す。AGC検出出力線６４
はバイアス抵抗２２０を介して演算増幅器２２２の非反
転入力に信号を供給する。該入力は、バイアス素子２２
０、２２６及び２２８にも接続されている。AGC REF線
６７は比較的一定のAGC信号を、バイアス素子２３０、
２３２、２３４及び２３６の回路網を介して演算増幅器
２２２の反転入力に供給する。演算増幅器２２２の反転
入力と出力とはコンデンサ２３８を介して接続され、演
算増幅器２２２は開ループ積分器として働き、開ループ
出力線６８上に利得制御信号を発生する。この利得制御
信号は、AGC検出出力線６４及びAGC REF線６７上の信号
レベル相互間の差に等しい。線形インバータ７０は開ル
ープ出力線６８上の利得制御信号を受け、受信増幅制御
線７２を介して出力を発生する。開ループ出力線６８
は、抵抗２５０を介して演算増幅器２５２の反転入力に
接続されている。抵抗２５４が演算増幅器２５２の出力
及び反転入力相互間に接続されている。演算増幅器２５
２の非反転入力はバイアス素子２５７、２５８及び２５
９の回路網を介して接地されている。このようにして、
演算増幅器は、過度に複雑な構成を取ることなく、線形
に動作する反転増幅器として機能する。
７０及び加算反転回路８０を示す。AGC検出出力線６４
はバイアス抵抗２２０を介して演算増幅器２２２の非反
転入力に信号を供給する。該入力は、バイアス素子２２
０、２２６及び２２８にも接続されている。AGC REF線
６７は比較的一定のAGC信号を、バイアス素子２３０、
２３２、２３４及び２３６の回路網を介して演算増幅器
２２２の反転入力に供給する。演算増幅器２２２の反転
入力と出力とはコンデンサ２３８を介して接続され、演
算増幅器２２２は開ループ積分器として働き、開ループ
出力線６８上に利得制御信号を発生する。この利得制御
信号は、AGC検出出力線６４及びAGC REF線６７上の信号
レベル相互間の差に等しい。線形インバータ７０は開ル
ープ出力線６８上の利得制御信号を受け、受信増幅制御
線７２を介して出力を発生する。開ループ出力線６８
は、抵抗２５０を介して演算増幅器２５２の反転入力に
接続されている。抵抗２５４が演算増幅器２５２の出力
及び反転入力相互間に接続されている。演算増幅器２５
２の非反転入力はバイアス素子２５７、２５８及び２５
９の回路網を介して接地されている。このようにして、
演算増幅器は、過度に複雑な構成を取ることなく、線形
に動作する反転増幅器として機能する。
【００４４】加算反転回路８０は、それぞれ開ループ出
力線６８及び送信利得調整線９０を介して開及び閉ルー
プ信号を受ける。素子２７０、２７２、２７４、２８
０、及び２８４で構成されるバイアス／フィルター回路
網を通った後、開ループ出力線６８及び送信利得調整線
９０からの信号は演算増幅器３００の反転入力において
合成される。バイアス フィルター回路網（２７０〜２
８４）は安定な動作を確保するために適切な時定数遅延
を有する。本発明の第１の好ましい実施の形態によれ
ば、この遅延時間は、開ループ出力線６８に対しおよそ
３０msであり、送信利得調整線９０に対しおよそ０．５
msである。演算増幅器３００は、素子３０２、３０４、
３０６、３０８、３２０及び３２２によりバイアスされ
て、２つの入力信号の和を増幅し、反転して、送信増幅
制御線８２上に出力を提供する。このように、演算増幅
器３００により、閉ループ利得制御及び開ループ利得制
御成分が合成されて、無線電話の全出力電力の制御に用
いられる。
力線６８及び送信利得調整線９０を介して開及び閉ルー
プ信号を受ける。素子２７０、２７２、２７４、２８
０、及び２８４で構成されるバイアス／フィルター回路
網を通った後、開ループ出力線６８及び送信利得調整線
９０からの信号は演算増幅器３００の反転入力において
合成される。バイアス フィルター回路網（２７０〜２
８４）は安定な動作を確保するために適切な時定数遅延
を有する。本発明の第１の好ましい実施の形態によれ
ば、この遅延時間は、開ループ出力線６８に対しおよそ
３０msであり、送信利得調整線９０に対しおよそ０．５
msである。演算増幅器３００は、素子３０２、３０４、
３０６、３０８、３２０及び３２２によりバイアスされ
て、２つの入力信号の和を増幅し、反転して、送信増幅
制御線８２上に出力を提供する。このように、演算増幅
器３００により、閉ループ利得制御及び開ループ利得制
御成分が合成されて、無線電話の全出力電力の制御に用
いられる。
【００４５】図４は、本発明の１実施の形態における、
図１の示された素子の電力制御処理をフローチャートで
表わしたものである。主として図４を参照し、さらに図
１及び図２を参照し、ステップ４００で処理が始まった
後、I/Oポート１３３は、ステップ４０２において、CPU
２４により読み込み可能な、汎用I/Oポートとなるよう
に構成される。但し、すでにそのように構成されていれ
ばその限りではない。次に、ステップ４０４において、
CPU２４により、MSM ASIC２２による閉ループ電力制御
レジスタ１４０の従来の閉ループ制御が開始される。本
発明のこの第１の好ましい実施の形態によれば、ステッ
プ４０４の処理には、制御ビット１４３を、閉ループ電
力制御レジスタの通常のMSM ASIC２２制御を可能にする
状態への初期化が含まれる。次にステップ４０６におい
て、CPU２４によりI/Oポート１３３が読まれる。I/Oポ
ート１３３が高レベル（例えば＋５Ｖ）の信号を受けて
いることが検出されると、ステップ４０８の判定結果
が"NO"であり、ステップ４１０において、従来の公知の
閉ループ電力制御レジスタ１４０の閉ループ制御が維持
される（即ち制御ビット１４３は変更されない）。次に
遅延ステップ４１２において、所定の遅延時間経過後、
ステップ４０６に戻る。本発明のこの第１の好ましい実
施の形態によれば、この遅延は、基地局からの閉ループ
電力制御情報の受信相互間の周期であり、例えば１．２
５msである。このようにして、I/Oポート１３３が高レ
ベル（無線電話の全出力電力が出力電力トリガーレベル
よりも低いことを示す）の間、第１のモードの動作が維
持される。本発明における遅延の他の理由は、再びI/O
ポート１３３を読み込む前に、電力制御の効果が現われ
るのを待つことである。
図１の示された素子の電力制御処理をフローチャートで
表わしたものである。主として図４を参照し、さらに図
１及び図２を参照し、ステップ４００で処理が始まった
後、I/Oポート１３３は、ステップ４０２において、CPU
２４により読み込み可能な、汎用I/Oポートとなるよう
に構成される。但し、すでにそのように構成されていれ
ばその限りではない。次に、ステップ４０４において、
CPU２４により、MSM ASIC２２による閉ループ電力制御
レジスタ１４０の従来の閉ループ制御が開始される。本
発明のこの第１の好ましい実施の形態によれば、ステッ
プ４０４の処理には、制御ビット１４３を、閉ループ電
力制御レジスタの通常のMSM ASIC２２制御を可能にする
状態への初期化が含まれる。次にステップ４０６におい
て、CPU２４によりI/Oポート１３３が読まれる。I/Oポ
ート１３３が高レベル（例えば＋５Ｖ）の信号を受けて
いることが検出されると、ステップ４０８の判定結果
が"NO"であり、ステップ４１０において、従来の公知の
閉ループ電力制御レジスタ１４０の閉ループ制御が維持
される（即ち制御ビット１４３は変更されない）。次に
遅延ステップ４１２において、所定の遅延時間経過後、
ステップ４０６に戻る。本発明のこの第１の好ましい実
施の形態によれば、この遅延は、基地局からの閉ループ
電力制御情報の受信相互間の周期であり、例えば１．２
５msである。このようにして、I/Oポート１３３が高レ
ベル（無線電話の全出力電力が出力電力トリガーレベル
よりも低いことを示す）の間、第１のモードの動作が維
持される。本発明における遅延の他の理由は、再びI/O
ポート１３３を読み込む前に、電力制御の効果が現われ
るのを待つことである。
【００４６】一方、全出力電力が出力電力トリガーレベ
ルを上回るときは、出力比較器９２はI/Oポート１３３
に低レベルの信号を出力する。この場合、ステップ４０
８の判定結果は"YES"となり、ステップ４１４に進み、
電力制御飽和を防止し、無線電話の最大出力電力を制限
する第２のモードが始まる。ステップ４１４においてCP
U２４は制御ビット１４３を変更し、閉ループ電力制御
レジスタ１４０の飽和防止制御を可能にし、そのレジス
タの従来の閉ループ電力制御を不能にする。次にCPU２
４は自動的に閉ループ電力制御レジスタ１４０を修正し
て、無線電話の全出力電力を１ステップ小さくする。本
発明のこの好ましい実施の形態では、この処理には、閉
ループ電力制御レジスタ１４０に記憶されている値を１
ステップ大きくすることが含まれる。これは、出力電力
の１dBの低下に対応する。本発明の好ましい実施の形態
の一例では、閉ループ電力制御レジスタは、８ビットの
レジスタの７つのＭＳＢを含み、従って全部で１２８の
制御ステップ（開ループ推定値より上で６４ビット、そ
れより下で６４ビット）を有する。このように、閉ルー
プ制御の範囲を大きくすることで、製造のばらつき等を
吸収することができる。
ルを上回るときは、出力比較器９２はI/Oポート１３３
に低レベルの信号を出力する。この場合、ステップ４０
８の判定結果は"YES"となり、ステップ４１４に進み、
電力制御飽和を防止し、無線電話の最大出力電力を制限
する第２のモードが始まる。ステップ４１４においてCP
U２４は制御ビット１４３を変更し、閉ループ電力制御
レジスタ１４０の飽和防止制御を可能にし、そのレジス
タの従来の閉ループ電力制御を不能にする。次にCPU２
４は自動的に閉ループ電力制御レジスタ１４０を修正し
て、無線電話の全出力電力を１ステップ小さくする。本
発明のこの好ましい実施の形態では、この処理には、閉
ループ電力制御レジスタ１４０に記憶されている値を１
ステップ大きくすることが含まれる。これは、出力電力
の１dBの低下に対応する。本発明の好ましい実施の形態
の一例では、閉ループ電力制御レジスタは、８ビットの
レジスタの７つのＭＳＢを含み、従って全部で１２８の
制御ステップ（開ループ推定値より上で６４ビット、そ
れより下で６４ビット）を有する。このように、閉ルー
プ制御の範囲を大きくすることで、製造のばらつき等を
吸収することができる。
【００４７】ステップ４１６の後、遅延ステップ４１２
により遅延を行なった後、ステップ４０６に戻る。これ
により、I/Oポート１３３はCPU２４により連続的に読ま
れる。ステップ４０８の判定結果が"YES"である限り、
飽和防止モードが続き、閉ループ電力制御レジスタ１４
０は連続的に増加する（全出力電力は減少する）。これ
は、全出力電力が出力電力トリガーレベルよりも小さく
なるまで続く。全出力電力が出力電力トリガーレベルよ
りも小さくなると、ステップ４０８の判定結果が"NO"と
なり、ステップ４１０における、従来の閉ループ動作に
復帰する。多くの場合、ステップ４０８で"YES"と判定
され、それにより処理（ステップ４１４、４１６）が１
ループ行なわれると、次のループでは、ステップ４０８
の判定が"NO"になる。しかし、全出力電力に対する開ル
ープ利得制御システムの寄与も大きくなるかも知れない
ので、ステップ４０８における判定結果が"YES"となる
ループが続くこともあり、この場合、全出力電力は出力
電力トリガーレベルよりも小さくなるまで、連続的に小
さくされる。
により遅延を行なった後、ステップ４０６に戻る。これ
により、I/Oポート１３３はCPU２４により連続的に読ま
れる。ステップ４０８の判定結果が"YES"である限り、
飽和防止モードが続き、閉ループ電力制御レジスタ１４
０は連続的に増加する（全出力電力は減少する）。これ
は、全出力電力が出力電力トリガーレベルよりも小さく
なるまで続く。全出力電力が出力電力トリガーレベルよ
りも小さくなると、ステップ４０８の判定結果が"NO"と
なり、ステップ４１０における、従来の閉ループ動作に
復帰する。多くの場合、ステップ４０８で"YES"と判定
され、それにより処理（ステップ４１４、４１６）が１
ループ行なわれると、次のループでは、ステップ４０８
の判定が"NO"になる。しかし、全出力電力に対する開ル
ープ利得制御システムの寄与も大きくなるかも知れない
ので、ステップ４０８における判定結果が"YES"となる
ループが続くこともあり、この場合、全出力電力は出力
電力トリガーレベルよりも小さくなるまで、連続的に小
さくされる。
【００４８】図５は、本発明の第２の好ましい実施の形
態における、図１の回路のための電力制御処理を示すフ
ローチャートである。ステップ４２０により処理を開始
した後、この第２の電力制御方法においては、I/Oポー
ト１３３を、汎用割込みポートではなく、エッジ・トリ
ガー(edge triggered)割込みポートとして構成する。こ
の、エッジ・トリガー割込みポートの構成においては、
CPU２４によるMSM ASICI/Oポート１３３の連続的検出は
行なわれず、代りに、出力比較器９２から出力される信
号が、高レベルから低レベルへ変化し、無線電話の全出
力電力が出力電力トリガーレベルよりも大きくなったこ
とが示されると、これをMSM ASIC２２がCPU２４に知ら
せる。かくして、全出力電力が出力電力トリガーレベル
よりも小さい限り、I/Oポート１３３における出力比較
器信号は、CPUにより無視される（CPU資源を節約でき
る）。ステップ４２４及び４２６に示されるように、閉
ループ電力制御レジスタ１４０の従来の閉ループ制御が
可能にされた後、閉ループ電力制御の第１の従来のモー
ドの間、CPU２４は他の処理を続行する。
態における、図１の回路のための電力制御処理を示すフ
ローチャートである。ステップ４２０により処理を開始
した後、この第２の電力制御方法においては、I/Oポー
ト１３３を、汎用割込みポートではなく、エッジ・トリ
ガー(edge triggered)割込みポートとして構成する。こ
の、エッジ・トリガー割込みポートの構成においては、
CPU２４によるMSM ASICI/Oポート１３３の連続的検出は
行なわれず、代りに、出力比較器９２から出力される信
号が、高レベルから低レベルへ変化し、無線電話の全出
力電力が出力電力トリガーレベルよりも大きくなったこ
とが示されると、これをMSM ASIC２２がCPU２４に知ら
せる。かくして、全出力電力が出力電力トリガーレベル
よりも小さい限り、I/Oポート１３３における出力比較
器信号は、CPUにより無視される（CPU資源を節約でき
る）。ステップ４２４及び４２６に示されるように、閉
ループ電力制御レジスタ１４０の従来の閉ループ制御が
可能にされた後、閉ループ電力制御の第１の従来のモー
ドの間、CPU２４は他の処理を続行する。
【００４９】ステップ４２８において、I/Oポート１３
３における高レベルから低レベルへの遷移が検地される
と、CPU２４において割込みサービスルーチンが始めら
れる。すると、閉ループ電力制御レジスタ１４０の制御
は、ステップ４３０において、MSM ASIC２２による従来
の閉ループ制御から、CPU２４による飽和防止制御に移
行する。次に、ステップ４３２において、閉ループ電力
制御レジスタ１４０が修正されて、出力電力を１ステッ
プ（１dB）小さくされ、その後I/Oポート１３３が読み
込み可能ポートとして構成される（ステップ４３４）。
もちろん、余裕があれば、割込み及び読み込みの機能性
のため、別個のMSM ASICポートを利用することもでき
る。次に、第１の好ましい実施の形態の方法におけるよ
うに、ステップ４３６〜４４４において全出力電力が出
力電力トリガーレベルよりも大きい限り、全出力電力の
減少のため、CPU２４が閉ループ電力制御レジスタ１４
０の修正を続ける。これは全出力電力が出力電力トリガ
ーレベルよりも小さくなるまで続けられる。全出力電力
が出力電力トリガーレベルよりも小さくなったことがス
テップ４３８で検知されると、割込みサービスルーチン
が終り、I/Oポート１３３が再びエッジ・トリガー割込
みポートとして構成され、閉ループ電力制御レジスタ１
４０の従来の閉ループ制御が可能にされる。
３における高レベルから低レベルへの遷移が検地される
と、CPU２４において割込みサービスルーチンが始めら
れる。すると、閉ループ電力制御レジスタ１４０の制御
は、ステップ４３０において、MSM ASIC２２による従来
の閉ループ制御から、CPU２４による飽和防止制御に移
行する。次に、ステップ４３２において、閉ループ電力
制御レジスタ１４０が修正されて、出力電力を１ステッ
プ（１dB）小さくされ、その後I/Oポート１３３が読み
込み可能ポートとして構成される（ステップ４３４）。
もちろん、余裕があれば、割込み及び読み込みの機能性
のため、別個のMSM ASICポートを利用することもでき
る。次に、第１の好ましい実施の形態の方法におけるよ
うに、ステップ４３６〜４４４において全出力電力が出
力電力トリガーレベルよりも大きい限り、全出力電力の
減少のため、CPU２４が閉ループ電力制御レジスタ１４
０の修正を続ける。これは全出力電力が出力電力トリガ
ーレベルよりも小さくなるまで続けられる。全出力電力
が出力電力トリガーレベルよりも小さくなったことがス
テップ４３８で検知されると、割込みサービスルーチン
が終り、I/Oポート１３３が再びエッジ・トリガー割込
みポートとして構成され、閉ループ電力制御レジスタ１
４０の従来の閉ループ制御が可能にされる。
【００５０】図６は、本発明のさらに他の好ましい実施
の形態における、図１の回路のための電力制御処理を示
すフローチャートである。ステップ４６０により処理を
開始した後、ステップ４６２においてI/Oポート１３３
がレベル・トリガー(level-triggered)割込みポートと
して構成される。この種の割込みポートは、入力信号が
トリガーレベルに達するまで（図示の回路の場合には、
出力比較器９２からの信号が低レベルである間は）基本
的に無視される。ステップ４６４で、閉ループ電力制御
レジスタ１４０の従来の閉ループ制御を可能にした後、
CPU２４はステップ４６６において他の処理を続行す
る。これは、レベル・トリガー割込み信号がI/Oポート
１３３から発生され、ステップ４６８で検知されるまで
続けられる。レベル・トリガー割込み信号が検知される
と割込みサービスルーチンが開始される。ステップ４７
２で、閉ループ電力制御レジスタ１４０の飽和防止制御
が始まる。閉ループ電力制御レジスタ１４０は修正され
て、全出力電力を１ステップ減少させ、その後ステップ
４７６における、閉ループ電力制御レジスタ１４０が従
来の閉ループ制御への復帰が行なわれる。次に、ステッ
プ４７８における遅延を行なった後、割込みサービスル
ーチンが終り、処理はステップ４６６に戻る。閉ループ
電力制御レジスタ１４０の飽和防止制御はきわめて短い
持続時間を有するので、先に説明した方法とは異なり、
基地局からのすべての電力制御情報が閉ループ電力制御
レジスタ１４０に影響を与える。従って、無線電話が遅
延時間中に受信した次の基地局制御情報がやはり電力増
加を命令するものである場合、割込みサービスルーチン
はステップ４７８の直後に始められる可能性が高い。但
し、これは全出力電力の開ループ成分の変化に依存す
る。
の形態における、図１の回路のための電力制御処理を示
すフローチャートである。ステップ４６０により処理を
開始した後、ステップ４６２においてI/Oポート１３３
がレベル・トリガー(level-triggered)割込みポートと
して構成される。この種の割込みポートは、入力信号が
トリガーレベルに達するまで（図示の回路の場合には、
出力比較器９２からの信号が低レベルである間は）基本
的に無視される。ステップ４６４で、閉ループ電力制御
レジスタ１４０の従来の閉ループ制御を可能にした後、
CPU２４はステップ４６６において他の処理を続行す
る。これは、レベル・トリガー割込み信号がI/Oポート
１３３から発生され、ステップ４６８で検知されるまで
続けられる。レベル・トリガー割込み信号が検知される
と割込みサービスルーチンが開始される。ステップ４７
２で、閉ループ電力制御レジスタ１４０の飽和防止制御
が始まる。閉ループ電力制御レジスタ１４０は修正され
て、全出力電力を１ステップ減少させ、その後ステップ
４７６における、閉ループ電力制御レジスタ１４０が従
来の閉ループ制御への復帰が行なわれる。次に、ステッ
プ４７８における遅延を行なった後、割込みサービスル
ーチンが終り、処理はステップ４６６に戻る。閉ループ
電力制御レジスタ１４０の飽和防止制御はきわめて短い
持続時間を有するので、先に説明した方法とは異なり、
基地局からのすべての電力制御情報が閉ループ電力制御
レジスタ１４０に影響を与える。従って、無線電話が遅
延時間中に受信した次の基地局制御情報がやはり電力増
加を命令するものである場合、割込みサービスルーチン
はステップ４７８の直後に始められる可能性が高い。但
し、これは全出力電力の開ループ成分の変化に依存す
る。
【００５１】図７は本発明の他の好ましい実施の形態に
おける無線電話の一部を示すブロック図である。図７の
回路はMSM ASIC２２'及びCPU２４'のプログラミング及
びメモリ構成を除き、図１のものと同一である。ただ
し、図１の出力比較器９２が省略され、CPU２４と直接
通信のための出力比較器９４とアドレス／バス２３の間
に接続されたA/D変換器５００が設けられている点で図
１と異なる。閉ループ電力制御レジスタ１４０及び制御
ビット１４３（図２）はMSM ASIC２２'にも存在する
が、第１の好ましい実施の形態の比較しきい値レジスタ
１３０並びにこれに関連するPDM１３２及び出力ポート
１３３は設けられていない。さらに、第１の好ましい実
施の形態におけるように、演算増幅器により検出された
全出力電力のDC表現を一定のDCレベルと連続的に比較す
るのではなく、図７の無線電話は出力電力をA/D変換器
５００により連続的にサンプルし、ディジタルサンプル
が、ＣＰＵ２４’に直接入力され、記憶されている出力
電力トリガーレベルのDC表現と比較される。
おける無線電話の一部を示すブロック図である。図７の
回路はMSM ASIC２２'及びCPU２４'のプログラミング及
びメモリ構成を除き、図１のものと同一である。ただ
し、図１の出力比較器９２が省略され、CPU２４と直接
通信のための出力比較器９４とアドレス／バス２３の間
に接続されたA/D変換器５００が設けられている点で図
１と異なる。閉ループ電力制御レジスタ１４０及び制御
ビット１４３（図２）はMSM ASIC２２'にも存在する
が、第１の好ましい実施の形態の比較しきい値レジスタ
１３０並びにこれに関連するPDM１３２及び出力ポート
１３３は設けられていない。さらに、第１の好ましい実
施の形態におけるように、演算増幅器により検出された
全出力電力のDC表現を一定のDCレベルと連続的に比較す
るのではなく、図７の無線電話は出力電力をA/D変換器
５００により連続的にサンプルし、ディジタルサンプル
が、ＣＰＵ２４’に直接入力され、記憶されている出力
電力トリガーレベルのDC表現と比較される。
【００５２】図８は、図７の無線電話の電力制御処理を
示すフローチャートである。ステップ５２０〜５３０に
関し、本発明の第１の好ましい実施の形態と同様、全出
力電力が出力電力トリガーレベルよりも小さいときは、
閉ループ電力制御レジスタ１４０は従来の閉ループ利得
制御モードで制御される。ステップ５３２及び５３４を
参照し、全出力電力が高過ぎる（出力電力トリガーレベ
ルよりも高い）と判定されたときはCPU２４'は飽和防止
モードに入り、閉ループ電力制御レジスタ１４０の制御
を始め、閉ループ電力制御レジスタ１４０を修正して全
出力電力を減少させる。これは全出力電力が出力電力ト
リガーレベルよりも小さくなるまで行なわれる。A/D変
換器５００としては、カリフォルニア州サニーベイル
（Sunnyvale, CA)のマキシム・インテグレイテッド・プ
ロダクツ（Maximum Integrated Produces)から入手可能
なＭＡＸ１５３を用い得る。
示すフローチャートである。ステップ５２０〜５３０に
関し、本発明の第１の好ましい実施の形態と同様、全出
力電力が出力電力トリガーレベルよりも小さいときは、
閉ループ電力制御レジスタ１４０は従来の閉ループ利得
制御モードで制御される。ステップ５３２及び５３４を
参照し、全出力電力が高過ぎる（出力電力トリガーレベ
ルよりも高い）と判定されたときはCPU２４'は飽和防止
モードに入り、閉ループ電力制御レジスタ１４０の制御
を始め、閉ループ電力制御レジスタ１４０を修正して全
出力電力を減少させる。これは全出力電力が出力電力ト
リガーレベルよりも小さくなるまで行なわれる。A/D変
換器５００としては、カリフォルニア州サニーベイル
（Sunnyvale, CA)のマキシム・インテグレイテッド・プ
ロダクツ（Maximum Integrated Produces)から入手可能
なＭＡＸ１５３を用い得る。
【００５３】本発明のさらに他の好ましい実施の形態が
図９及び図１０に示されている。図９のブロック図は図
１の類似の無線電話を示す。異なるのは、受信信号強度
指示（RSSI)検出器５５２を付加したことである。このR
SSI検出器５５２はRSSI入力線５５０を介して開ループ
出力線６８に接続されている。RSSI検出器５５２の一例
は、上記のA/D変換器５００の一例として上記したもの
と同じである。MSM ASIC２２"及びCPU２４"は出力電力
制御における一つの因子としてRSSI検出器５５２を利用
するために変形されている。図１０の処理は、図４の処
理と類似であり、ステップ５６０〜５７２はステップ４
００〜４０８と同一である。I/Oポート１３３における
信号が低レベルであるときは、ステップ５７４で遅延が
行なわれ、次にステップ５７０に戻る。そうでなく、ス
テップ５７２における判定結果が"YES"であれば、次に
ステップ５８０において閉ループ電力制御レジスタ１４
０の飽和防止制御が可能にされる。次に、ステップ５８
２で、受信信号強度指示値がRSSI検出器５５２により受
信され、CPU２４"により記憶される。
図９及び図１０に示されている。図９のブロック図は図
１の類似の無線電話を示す。異なるのは、受信信号強度
指示（RSSI)検出器５５２を付加したことである。このR
SSI検出器５５２はRSSI入力線５５０を介して開ループ
出力線６８に接続されている。RSSI検出器５５２の一例
は、上記のA/D変換器５００の一例として上記したもの
と同じである。MSM ASIC２２"及びCPU２４"は出力電力
制御における一つの因子としてRSSI検出器５５２を利用
するために変形されている。図１０の処理は、図４の処
理と類似であり、ステップ５６０〜５７２はステップ４
００〜４０８と同一である。I/Oポート１３３における
信号が低レベルであるときは、ステップ５７４で遅延が
行なわれ、次にステップ５７０に戻る。そうでなく、ス
テップ５７２における判定結果が"YES"であれば、次に
ステップ５８０において閉ループ電力制御レジスタ１４
０の飽和防止制御が可能にされる。次に、ステップ５８
２で、受信信号強度指示値がRSSI検出器５５２により受
信され、CPU２４"により記憶される。
【００５４】次にステップ５８４で、無線電話に対し出
力電力を下げるよう要求する基地局からの閉ループ制御
情報が送られるのを待つ。そのような電力減少命令が受
信されるまでは、ステップ５８４の判定結果は"NO"であ
り、ステップ５９０に進む。ステップ５９０は、１命令
周期（例えば１．２５ms）の内部遅延時間を有し、現在
のRSSIをステップ５８２で記憶されたRSSIと連続的に比
較し、それに伴い必要に応じてMSM ASIC２２"内の閉ル
ープ電力制御レジスタ１４０を修正する。このループの
間、受信信号強度が減少しなければ、閉ループ電力制御
レジスタ１４０に対し修正は加えられない。もし、RSSI
が減少した場合、これを補償するために閉ループ電力制
御レジスタ１４０は修正される。言換えれば、もし全出
力電力の開ループ成分が上昇すれば、閉ループ電力制御
レジスタは補償のため用いられる。この処理は、閉ルー
プ電力制御レジスタ１４０をどれだけ修正するかを決め
るに当り、CPU２４"により行なわれる相対的ルックアッ
プテーブルを利用する。他の方法として、相対的差を求
めるのではなく、受信信号強度の絶対的関数として、ル
ックアップテーブルにより閉ループ電力制御レジスタ１
４０のために適切な値を決めることとしても良い。
力電力を下げるよう要求する基地局からの閉ループ制御
情報が送られるのを待つ。そのような電力減少命令が受
信されるまでは、ステップ５８４の判定結果は"NO"であ
り、ステップ５９０に進む。ステップ５９０は、１命令
周期（例えば１．２５ms）の内部遅延時間を有し、現在
のRSSIをステップ５８２で記憶されたRSSIと連続的に比
較し、それに伴い必要に応じてMSM ASIC２２"内の閉ル
ープ電力制御レジスタ１４０を修正する。このループの
間、受信信号強度が減少しなければ、閉ループ電力制御
レジスタ１４０に対し修正は加えられない。もし、RSSI
が減少した場合、これを補償するために閉ループ電力制
御レジスタ１４０は修正される。言換えれば、もし全出
力電力の開ループ成分が上昇すれば、閉ループ電力制御
レジスタは補償のため用いられる。この処理は、閉ルー
プ電力制御レジスタ１４０をどれだけ修正するかを決め
るに当り、CPU２４"により行なわれる相対的ルックアッ
プテーブルを利用する。他の方法として、相対的差を求
めるのではなく、受信信号強度の絶対的関数として、ル
ックアップテーブルにより閉ループ電力制御レジスタ１
４０のために適切な値を決めることとしても良い。
【００５５】この処理は基地局からの電力減少命令（ス
テップ５８４の判定結果を"YES"とすることを指示す
る）が受信されるまで続く。ステップ５９２の処理は、
ステップ５９０の動作（actions)（但し、内部遅延を除
く）と電力減少命令という付加的因子を含む。従って、
ステップ５９２における閉ループ電力制御レジスタ１４
０の修正は、電力減少命令による付加的な１ステップ
（１．０dB）の出力電力の減少を含む。MSM ASIC２２"
に対する付加的要求は、基地局閉ループ電力制御命令が
CPU２４"に供給可能であることである。この点はカルコ
ム（Qualcomm)社の従来のMSM ASIC２２はこの要求を満
たさない。従って、本発明はその例からそのように変形
されたMSM ASIC２２"を必要とする。この好ましい実施
の形態及び先に説明した他の好ましい実施の形態の方法
に対する代替方法は、他の別個のMSMASIC（CPU２４の関
与なくして開示された処理のいずれかを内部で行ない得
るもの）を用いることである。ステップ５９２の後に、
ステップ５９４において閉ループ電力制御レジスタ１４
０の従来の閉ループ制御が可能にされ、ステップ５９６
において遅延が行なわれ、その後ステップ５７０に戻
る。
テップ５８４の判定結果を"YES"とすることを指示す
る）が受信されるまで続く。ステップ５９２の処理は、
ステップ５９０の動作（actions)（但し、内部遅延を除
く）と電力減少命令という付加的因子を含む。従って、
ステップ５９２における閉ループ電力制御レジスタ１４
０の修正は、電力減少命令による付加的な１ステップ
（１．０dB）の出力電力の減少を含む。MSM ASIC２２"
に対する付加的要求は、基地局閉ループ電力制御命令が
CPU２４"に供給可能であることである。この点はカルコ
ム（Qualcomm)社の従来のMSM ASIC２２はこの要求を満
たさない。従って、本発明はその例からそのように変形
されたMSM ASIC２２"を必要とする。この好ましい実施
の形態及び先に説明した他の好ましい実施の形態の方法
に対する代替方法は、他の別個のMSMASIC（CPU２４の関
与なくして開示された処理のいずれかを内部で行ない得
るもの）を用いることである。ステップ５９２の後に、
ステップ５９４において閉ループ電力制御レジスタ１４
０の従来の閉ループ制御が可能にされ、ステップ５９６
において遅延が行なわれ、その後ステップ５７０に戻
る。
【００５６】図１１及び図１２は本発明のさらに他の好
ましい実施の形態に関する。この好ましい実施の形態と
図９及び図１０の好ましい実施の形態との主たる違い
は、全出力電力が出力電力トリガーレベルよりも上にな
ったことを検出する手段に関する。先に説明した好まし
い実施の形態（図９及び図１０）は、第１の好ましい実
施の形態と同様の出力検出器９４及び出力比較器９４を
利用している。これに対し、この好ましい実施の形態
（図１１及び図１２）は、マルチプレキサ６０２を介し
て出力検出器９４及び開ループ出力線６８の双方にRSSI
/出力検出器６００を利用している。マルチプレキサ選
択制御線６０１を介して制御されるマルチプレキサ６０
２を介して、RSSI/出力検出器６００は、CPU２４"'と協
働して、図７のA/D変換器５００及び図９のRSSI検出器
５５２の双方の機能を果すことができる。従って、図１
２に示すように、この好ましい実施の形態の処理動作
は、出力電力決定のためにA/Dサンプリング源を用いた
ことによる変更点を除き、図１０のものと略同じであ
る。
ましい実施の形態に関する。この好ましい実施の形態と
図９及び図１０の好ましい実施の形態との主たる違い
は、全出力電力が出力電力トリガーレベルよりも上にな
ったことを検出する手段に関する。先に説明した好まし
い実施の形態（図９及び図１０）は、第１の好ましい実
施の形態と同様の出力検出器９４及び出力比較器９４を
利用している。これに対し、この好ましい実施の形態
（図１１及び図１２）は、マルチプレキサ６０２を介し
て出力検出器９４及び開ループ出力線６８の双方にRSSI
/出力検出器６００を利用している。マルチプレキサ選
択制御線６０１を介して制御されるマルチプレキサ６０
２を介して、RSSI/出力検出器６００は、CPU２４"'と協
働して、図７のA/D変換器５００及び図９のRSSI検出器
５５２の双方の機能を果すことができる。従って、図１
２に示すように、この好ましい実施の形態の処理動作
は、出力電力決定のためにA/Dサンプリング源を用いた
ことによる変更点を除き、図１０のものと略同じであ
る。
【００５７】最後に、開ループ電力の変動に鑑み、「最
大電力」と言う語及び同様の語は出力電力トリガーレベ
ルより上の全出力電力レベルの小さい範囲内のものであ
る。同様に、本発明の範囲には、種々の通信モードに基
づく複数の出力電力トリガーレベルを有する付加的な好
ましい実施の形態を含む。例えば、ある通信モードで
は、従来の閉ループ制御ステップが１．０dBよりも大き
くても良い。従って、そのモードにおける通信において
出力電力を適切に制限するためにしきい値は低くする必
要がある。
大電力」と言う語及び同様の語は出力電力トリガーレベ
ルより上の全出力電力レベルの小さい範囲内のものであ
る。同様に、本発明の範囲には、種々の通信モードに基
づく複数の出力電力トリガーレベルを有する付加的な好
ましい実施の形態を含む。例えば、ある通信モードで
は、従来の閉ループ制御ステップが１．０dBよりも大き
くても良い。従って、そのモードにおける通信において
出力電力を適切に制限するためにしきい値は低くする必
要がある。
【００５８】本発明の実施の形態のうち、好ましい実施
の形態を開示したが、他の実施の形態は当業者には本開
示に基づき容易に着想されよう。従って、本発明の精神
と範囲に従って、変形及び修正が可能であることが理解
されよう。さらに、特許請求の範囲における機能的表現
で記載した手段及びステップの均等物には特許請求の範
囲に記載した機能を果すすべての構造、物質、動作が含
まれる。
の形態を開示したが、他の実施の形態は当業者には本開
示に基づき容易に着想されよう。従って、本発明の精神
と範囲に従って、変形及び修正が可能であることが理解
されよう。さらに、特許請求の範囲における機能的表現
で記載した手段及びステップの均等物には特許請求の範
囲に記載した機能を果すすべての構造、物質、動作が含
まれる。
【００５９】
【発明の効果】以上のように、本発明によれば、閉ルー
プ利得制御システムの応答性を維持することができる。
また、開ループ及び閉ループ利得制御システムを有する
無線電話の飽和を防止することができる。
プ利得制御システムの応答性を維持することができる。
また、開ループ及び閉ループ利得制御システムを有する
無線電話の飽和を防止することができる。
【図１】 本発明の第１の好ましい実施の形態による無
線電話の一部を示すブロック図である。
線電話の一部を示すブロック図である。
【図２】 図１の一部を詳細に示す図である。
【図３】 図１の他の一部を詳細に示す図である。
【図４】 本発明の一つの好ましい実施の形態におけ
る、図１の回路の電力制御処理を示すフローチャートで
ある。
る、図１の回路の電力制御処理を示すフローチャートで
ある。
【図５】 本発明の他の好ましい実施の形態における、
図１の回路の電力制御処理を示すフローチャートであ
る。
図１の回路の電力制御処理を示すフローチャートであ
る。
【図６】 本発明のさらに他の好ましい実施の形態にお
ける、図１の回路の電力制御処理を示すフローチャート
である。
ける、図１の回路の電力制御処理を示すフローチャート
である。
【図７】 本発明の他の好ましい実施の形態による無線
電話の一部を示すブロック図である。
電話の一部を示すブロック図である。
【図８】 本発明の一つの好ましい実施の形態におけ
る、図７の回路の電力制御処理を示すフローチャートで
ある。
る、図７の回路の電力制御処理を示すフローチャートで
ある。
【図９】 本発明の他の好ましい実施の形態による無線
電話の一部を示すブロック図である。
電話の一部を示すブロック図である。
【図１０】 本発明の一つの好ましい実施の形態におけ
る、図９の回路の電力制御処理を示すフローチャートで
ある。
る、図９の回路の電力制御処理を示すフローチャートで
ある。
【図１１】 本発明の他の好ましい実施の形態による無
線電話の一部を示すブロック図である。
線電話の一部を示すブロック図である。
【図１２】 本発明の一つの好ましい実施の形態におけ
る、図１１の回路の電力制御処理を示すフローチャート
である。
る、図１１の回路の電力制御処理を示すフローチャート
である。
２２：ＭＳＭ ＡＳＩＣ ２４：ＣＰＵ ４４：可
調整ＩＦ増幅器 ４６：アップコンバータ ４８：
ＲＦ増幅器 ６２：ＡＧＣ検出器 ６８：ＡＧＣ積
分器 ８０：加算反転回路 ９２：出力比較器
９４：出力検出器 １３０：比較しきい値レジスタ
１３２：ＰＤＭ １４０：閉ループ電力制御レジス
タ １４２：ＰＤＭ
調整ＩＦ増幅器 ４６：アップコンバータ ４８：
ＲＦ増幅器 ６２：ＡＧＣ検出器 ６８：ＡＧＣ積
分器 ８０：加算反転回路 ９２：出力比較器
９４：出力検出器 １３０：比較しきい値レジスタ
１３２：ＰＤＭ １４０：閉ループ電力制御レジス
タ １４２：ＰＤＭ
─────────────────────────────────────────────────────
フロントページの続き
(73)特許権者 000000295
沖電気工業株式会社
東京都港区虎ノ門１丁目７番12号
(72)発明者 王 禾豊
東京都港区虎ノ門１丁目７番12号 沖電
気工業株式会社内
(72)発明者 山崎 豊
アメリカ合衆国 イリノイ州 60030
グレイ レイク カントリー ドライブ
1811 アパートメント 104
(72)発明者 アンソニー ビー ウォルドループ
アメリカ合衆国 ニュージャージ州
07601 ハッケンサック スリー ユニ
バーシィティ プラザ（番地なし） オ
キアメリカ・インコーポレイティッド内
(56)参考文献 特表 平８−510614（ＪＰ，Ａ)
(58)調査した分野(Int.Cl.7，ＤＢ名)
H04B 7/24 - 7/26
H04Q 7/00 - 7/38
Claims (50)
- 【請求項１】基地局と通信する無線電話の出力電力を制
御する方法であって、出力電力トリガーレベルを定める
ステップと、開ループ自動利得制御システム及び上記基
地局から受信された電力制御情報に応答する閉ループ制
御システムの双方により決められた上記出力電力により
定められた第１のモードにおいて上記出力電力を初期的
に制御するステップと、上記無線電話の無線周波数（R
F）送信電力増幅器の出力レベルを検出することによ
り、出力電力をモニターするステップと、上記出力電力
と上記出力電力トリガーレベルの関係を判定するステッ
プと、上記出力電力が上記出力電力トリガーレベルより
も大きいと判定されたときに、上記開ループ自動利得制
御システム及び飽和防止制御システムの双方により決め
られた出力により定められる第２のモードにより上記出
力電力を制御するステップとを有し、上記飽和防止制御
システムは、上記出力電力の上記閉ループ制御システム
部分を自動的に減らすことにより、上記基地局からの電
力制御情報を無視することにより、上記閉ループ制御シ
ステムに取って代るものであり、さらに、上記出力電力
が上記出力電力トリガーレベルよりも大きい状態の後、
上記出力電力トリガーレベルよりも小さくなったと判定
されたときに、上記出力電力を再び上記第１のモードで
制御し、これにより、上記出力電力と上記出力電力トリ
ガーレベルの交互に変化する関係の判定結果に応じて、
上記第１のモードと上記第２のモードとの交互実施を開
始するステップを有することを特徴とする基地局と通信
する無線電話の出力電力制御方法。 - 【請求項２】上記出力電力をモニターするステップは、
上記出力電力のAC成分を表わす整流されたDC電圧を連続
的に発生するステップを含むことを特徴とする請求項１
に記載の方法。 - 【請求項３】上記出力電力と上記出力電力トリガーレベ
ルの関係を判定するステップは、上記整流されたDC電圧
を上記出力電力トリガーレベルを表わす電圧を演算増幅
器で連続的に比較するステップを含み、上記演算増幅器
は、上記出力電力が上記出力電力トリガーレベルよりも
大きいか小さいかを表わす比較出力を提供するよう構成
されていることを特徴とする請求項２に記載の方法。 - 【請求項４】上記出力電力と上記出力電力トリガーレベ
ルの関係を判定するステップはさらに、上記演算増幅器
の上記比較出力を汎用入力手段により連続的に調べるス
テップを含むことを特徴とする請求項３に記載の方法。 - 【請求項５】上記出力電力と上記出力電力トリガーレベ
ルの関係を判定するステップはさらに、上記出力電力が
上記出力電力トリガーレベルよりも小さく、上記出力電
力が上記出力電力トリガーレベルよりも大きくなるまで
の間、エッジ・トリガー割込み手段により、上記演算増
幅器の上記比較出力を無視するステップと、上記出力電
力が上記出力電力トリガーレベルよりも大きく、上記出
力電力が上記出力電力トリガーレベルよりも小さくなる
までの間、汎用入力手段により演算増幅器の比較出力を
連続的に調べるステップとを含むことを特徴とする請求
項３に記載の方法。 - 【請求項６】上記出力電力と上記出力電力トリガーレベ
ルの関係を判定するステップはさらに、上記出力電力を
上記出力電力トリガーレベルと連続的に比較して、上記
出力電力が上記出力電力トリガーレベルよりも大きいか
小さいかを示す比較出力を提供するステップと、汎用入
力手段により、上記比較出力を連続的に調べるステップ
とを含むことを特徴とする請求項１に記載の方法。 - 【請求項７】上記出力電力と上記出力電力トリガーレベ
ルの関係を判定するステップはさらに、上記出力電力を
上記出力電力トリガーレベルと連続的に比較して、上記
出力電力が上記出力電力トリガーレベルよりも大きいか
小さいかを示す比較出力を提供するステップと、上記出
力電力が上記出力電力トリガーレベルよりも小さく、上
記出力電力が上記出力電力トリガーレベルよりも大きく
なるまでの間、エッジ・トリガー割込み手段により上記
比較出力を無視するステップと、上記出力電力が上記出
力電力トリガーレベルよりも大きく、上記出力電力が上
記出力電力トリガーレベルよりも小さくなるまでの間、
汎用入力手段により上記比較出力を連続的に調べるステ
ップとを含むことを特徴とする請求項１に記載の方法。 - 【請求項８】上記出力電力と上記出力電力トリガーレベ
ルの関係を判定するステップはさらに、上記出力電力を
上記出力電力トリガーレベルと連続的に比較して、上記
出力電力が上記出力電力トリガーレベルよりも大きいか
小さいかを示す比較出力を提供するステップと、上記出
力電力が上記出力電力トリガーレベルよりも小さく、上
記出力電力が上記出力電力トリガーレベルよりも大きく
なるまでの間、レベル・トリガー割込み手段により上記
比較出力を無視するステップと、上記出力電力が上記出
力電力トリガーレベルよりも大きく、上記出力電力が上
記出力電力トリガーレベルよりも小さくなるまでの間、
上記レベル・トリガー割込み手段により上記比較出力を
連続的に調べるステップとを含むことを特徴とする請求
項１に記載の方法。 - 【請求項９】上記出力電力をモニターするステップは、
全出力電力レベルを表わす整流されたDC電圧をディジタ
ル的にサンプルして、上記出力電力を表わすディジタル
サンプルを提供するステップを含むことを特徴とする請
求項１に記載の方法。 - 【請求項１０】上記出力電力と上記出力電力トリガーレ
ベルの関係を判定するステップはさらに、上記ディジタ
ルサンプルを上記出力電力トリガーレベルのディジタル
的表現と比較するステップを含むことを特徴とする請求
項９に記載の方法。 - 【請求項１１】上記出力電力を上記第２のモードで制御
するステップは、上記出力電力の上記閉ループ制御シス
テム部分を、上記出力電力を上記出力電力トリガーレベ
ルよりも小さくするために必要な回数、減少させるステ
ップを含むことを特徴とする請求項１に記載の方法。 - 【請求項１２】上記減少させるステップは、上記出力電
力の上記閉ループ制御システム部分を、１．２５ms毎に
約１dBずつ連続的に減少させるステップを含むことを特
徴とする請求項１１に記載の方法。 - 【請求項１３】上記第１のモードで上記出力電力を制御
するステップは、上記基地局から受信された上記電力制
御情報に応じてディジタルメモリ素子を連続的に調整し
て、上記電力制御情報に応じて上記出力電力の上記閉ル
ープ制御システム部分を連続的に調整するステップを含
み、上記第２のモードで上記出力電力を制御するステッ
プは、上記ディジタルメモリ素子を調整して、上記出力
電力の上記閉ループ制御システム部分を減少させるステ
ップを含むことを特徴とする請求項１に記載の方法。 - 【請求項１４】上記第２のモードで上記出力電力を制御
するステップは、上記出力電力が上記出力電力トリガー
レベルよりも小さくなるまで、上記基地局から受信され
たすべての電力制御情報を無視し、上記ディジタルメモ
リ素子を連続的に調整して、上記出力電力の上記閉ルー
プ制御システム部分を連続的に減少させるステップを含
むことを特徴とする請求項１３に記載の方法。 - 【請求項１５】上記第２のモードで上記出力電力を制御
するステップは、上記第２のモードでの動作を続けなが
ら、上記ディジタルメモリ素子を調整し、その後ディジ
タルメモリ素子の制御を閉ループ制御システムに戻すス
テップを含み、これにより上記出力電力の上記閉ループ
制御システム部分の自動的減少が、上記基地局から受信
された先の電力制御情報を無視して起こる一方、上記基
地局から受信されたすべての電力制御情報は、なおも上
記出力電力の上記閉ループ制御システム部分の変化をも
たらすことを特徴とする請求項１３に記載の方法。 - 【請求項１６】上記第２のモードで上記出力電力を制御
するステップは、 上記第２のモードに入ったとき初期受信信号強度指示値
を判定するステップと、 上記閉ループ制御システムからの上記ディジタルメモリ
素子の制御を不能にして、上記基地局から受信されたす
べての電力制御情報を上記ディジタルメモリ素子に対し
て無効とするステップと、 上記基地局からの上記電力制御情報をモニターするステ
ップと、 上記基地局からの、電力の減少を求める電力制御情報を
検出したときに、その後の受信信号強度指示値を判定す
るステップと、 上記初期の受信信号強度指示値と上記後の受信信号強度
指示値とを分析して、上記開ループ補正値を決定するス
テップと、 上記開ループ補正値を一つの因子として用いて上記ディ
ジタルメモリ素子を調整するステップと、 上記ディジタルメモリ素子の制御を上記閉ループ制御シ
ステムに戻すステップとを含むことを特徴とする請求項
１３に記載の方法。 - 【請求項１７】上記第２のモードで上記出力電力を制御
するステップは、上記ディジタルメモリ素子を調整する
に当り、上記受信信号強度指示値を一つの因子として利
用するステップを含むことを特徴とする請求項１３に記
載の方法。 - 【請求項１８】上記第２のモードで上記出力電力を制御
するステップは、上記出力電力の上記閉ループ制御シス
テム部分をどれだけ減少させるかを決定するに当り、上
記受信信号強度指示値を一つの因子として利用するステ
ップを含むことを特徴とする請求項１に記載の方法。 - 【請求項１９】上記第２のモードで上記出力電力を制御
するステップは、上記開ループ自動利得制御システムか
らの出力の変化による出力電力の変化を補償することを
含むことを特徴とする請求項１に記載の方法。 - 【請求項２０】基地局と通信する無線電話の出力電力を
制御するシステムであって、 無線送信信号に対し調整可能な増幅を行なって、増幅さ
れた無線周波数（RF）出力信号を発生する可調整増幅手
段と、 利得調整信号を発生し、これを上記可調整増幅手段に与
えて、上記無線送信信号の増幅度を制御することによ
り、上記無線電話の出力電力を制御する利得調整信号発
生手段とを有し、 上記利得調整信号発生手段は、 受信信号強度に基づいて開ループ自動利得制御信号を発
生する手段と、 上記基地局から受信された電力制御情報に基づいて閉ル
ープ制御信号を発生する手段と、 上記開ループ自動利得制御信号と上記閉ループ制御信号
とを合成して上記利得調整信号を発生する手段とを有
し、 さらに、出力電力トリガーレベルを定める手段と、 上記増幅されたRF出力信号を上記出力電力トリガーレベ
ルと比較する手段と、 上記比較手段に応じて上記閉ループ制御信号を選択的に
変更して、上記無線電話の上記出力電力を制御する変更
手段とを有することを特徴とする出力電力システム。 - 【請求項２１】上記可調整増幅手段は、可調整中間周波
数（IF）増幅を上記無線送信信号に与えて、増幅された
IF信号を発生する手段と、上記IF増幅手段に結合され、
上記増幅されたIF信号を混合してRF信号を発生する手段
と、上記混合手段に結合され、RF電力増幅を上記RF信号
に与えて増幅されたRF出力信号を発生する手段とを有す
ることを特徴とする請求項２０に記載のシステム。 - 【請求項２２】上記閉ループ信号発生手段は、メモリ値
を記憶する記憶手段と、上記閉ループ制御信号を、上記
記憶手段に記憶されている上記メモリ値表現として発生
する手段と、出力電力修正のための基地局命令を受信し
て、分析する手段と、上記基地局命令に応じて上記記憶
手段に記憶されている上記メモリ値を変化させる手段と
を有することを特徴とする請求項２０に記載のシステ
ム。 - 【請求項２３】上記記憶手段は、ディジタルメモリ素子
を有し、上記発生手段は上記ディジタルメモリ素子に記
憶された値を、アナログ値に変換する手段を有すること
を特徴とする請求項２２に記載のシステム。 - 【請求項２４】上記変更手段は、上記増幅されたRF出力
信号が上記出力電力トリガーレベルよりも高くなったと
きに上記記憶手段に記憶されている上記メモリ値を修正
する修正手段を有することを特徴とする請求項２２に記
載のシステム。 - 【請求項２５】上記修正手段は、増幅されたRF出力信号
が出力電力トリガレベル以下となるまで、上記記憶手段
に記憶されている上記メモリ値を連続的に修正する手段
を有することを特徴とする請求項２４に記載のシステ
ム。 - 【請求項２６】上記連続的に修正する手段は、上記基地
局命令に応じて上記記憶手段に記憶されている上記メモ
リ値を変化させる手段に取って代る手段を有することを
特徴とする請求項２５に記載のシステム。 - 【請求項２７】上記修正手段は、受信信号強度を、上記
記憶手段に記憶されている上記メモリ値を修正するため
の一つの因子として分析する手段を有することを特徴と
する請求項２４に記載のシステム。 - 【請求項２８】上記閉ループ信号発生手段は、移動局モ
デムASIC内に形成されていることを特徴とする請求項２
２に記載のシステム。 - 【請求項２９】上記比較手段は、上記増幅されたRF出力
信号のAC成分を表わす整流されたDC電圧を発生する手段
と、演算増幅器により、上記整流されたDC電圧を上記出
力電力トリガーレベルを表わすものと連続的に比較する
手段とを有し、上記演算増幅器は、上記出力電力が上記
出力電力トリガーレベルよりも大きいか小さいかを表わ
す比較出力を提供することを特徴とする請求項２０に記
載のシステム。 - 【請求項３０】上記比較手段は、上記増幅されたRF信号
をディジタル的表現を発生する手段と、上記増幅された
RF信号をディジタル的に表わすものを上記出力電力トリ
ガーレベルとディジタル的に比較する手段とを有するこ
とを特徴とする請求項２０に記載のシステム。 - 【請求項３１】上記比較手段は、比較指示信号を発生す
る手段を有し、上記変更手段は上記比較指示信号を分析
する手段を有することを特徴とする請求項２０に記載の
システム。 - 【請求項３２】上記変更手段は、上記実際の比較指示信
号に関係なく汎用入力手段で、上記比較指示信号を連続
的に分析する手段を有することを特徴とする請求項３１
に記載のシステム。 - 【請求項３３】上記変更手段は、 上記増幅されたRF出力信号が上記出力電力トリガーレベ
ルよりも小さいことを上記比較指示信号が示している間
は、エッジ・トリガー割込み手段により比較指示信号を
無視する手段と、 上記増幅されたRF出力信号が上記出力電力トリガーレベ
ルよりも大きいことを上記比較指示信号が示している間
は、汎用入力手段により上記比較指示信号を連続的に分
析する手段とを有することを特徴とする請求項３１に記
載のシステム。 - 【請求項３４】上記変更手段は、上記増幅されたRF出力
信号が上記出力電力トリガーレベルよりも大きくなって
から、上記増幅されたRF出力信号が上記出力電力トリガ
ーレベルよりも小さくなるまでの間、上記閉ループ制御
信号を減少させる手段を有することを特徴とする請求項
２０に記載のシステム。 - 【請求項３５】上記減少手段は、上記基地局命令に応じ
て上記記憶手段に記憶されている上記メモリ値を変化さ
せる手段に取って代る手段を有することを特徴とする請
求項３４に記載のシステム。 - 【請求項３６】上記変更手段は、受信信号強度を上記閉
ループ制御信号を変更するための因子として分析する手
段を有することを特徴とする請求項２０に記載のシステ
ム。 - 【請求項３７】上記変更手段はさらに、上記無線電話の
出力電力の新たな減少を要求する電力制御情報を上記基
地局から受けたとき、上記閉ループ制御信号を減少させ
る減少手段を有することを特徴とする請求項２０に記載
のシステム。 - 【請求項３８】上記減少手段は、上記受信信号強度を考
慮する手段を有することを特徴とする請求項３７に記載
のシステム。 - 【請求項３９】上記変更手段は上記閉ループ制御システ
ムの応答性を維持する手段を有することを特徴とする請
求項２０に記載のシステム。 - 【請求項４０】上記変更手段は、上記閉ループ制御信号
を、１．２５ms毎に約１dBずつ連続的に減少させること
を特徴とする請求項２０に記載のシステム。 - 【請求項４１】調整可能な送信増幅を提供して、全体的
出力電力を制御する提供手段と、 利得調整信号により上記提供手段を制御する制御手段
と、 上記制御手段は、 受信信号強度に基づいて開ループ自動利得制御表現を発
生する手段と、 上記基地局から受信された電力制御情報に基づいて閉ル
ープ利得制御表現を発生する発生手段と、 上記開ループ自動利得制御表現と上記閉ループ利得制御
表現とを合成して利得調整信号を発生する手段とを有
し、 さらに、上記全体的出力電力に基づいて上記閉ループ利
得制御表現を制御する更なる制御手段を有することを特
徴とする出力電力システム。 - 【請求項４２】上記提供手段は可調整送信増幅回路を有
し、該増幅回路は、可調整中間周波数（IF）増幅器と、
上記可調整IF増幅器に結合された無線周波数（RF）混合
器と、上記RF混合器に結合されたRF電力増幅器とを有す
ることを特徴とする請求項４１に記載のシステム。 - 【請求項４３】上記出力電力システムは、基地局と通信
する無線電話の出力電力を制御するシステムであって、 上記発生手段は、 ディジタルメモリ素子を有する、メモリ値を記憶する手
段と、 上記ディジタルメモリ素子に記憶されている値をアナロ
グ信号に変換することにより、上記記憶手段に記憶され
ている値を、閉ループ利得制御表現に変換する手段と、 出力電力修正のための基地局命令を受信して分析する手
段と、 上記基地局命令に応じて上記記憶手段に記憶されている
メモリ値を変化させる手段とを有することを特徴とする
請求項４１に記載のシステム。 - 【請求項４４】上記更なる制御手段は、出力電力トリガ
ーレベルを定める手段と、上記全体的出力電力を上記出
力電力トリガーレベルと比較する手段と、上記比較手段
に応じて、上記閉ループ利得制御表現を選択的に変更し
て上記全体的出力電力を制御する手段とを有することを
特徴とする請求項４１に記載のシステム。 - 【請求項４５】上記更なる制御手段は、受信信号強度
を、上位閉ループ利得制御表現を変更するための因子と
して分析する手段を有することを特徴とする請求項４４
に記載のシステム。 - 【請求項４６】上記比較手段は、上記全体的出力電力を
表わす整流されたDC電圧を発生する手段と、演算増幅器
回路において、上記整流されたDC電圧を、上記出力電力
トリガーレベルを表わすものと連続的に比較する手段と
を有し、上記演算増幅器回路は、上記全体的出力電力が
上記出力電力トリガーレベルよりも大きいか小さいかを
示す比較出力を提供するよう構成されていることを特徴
とする請求項４４に記載のシステム。 - 【請求項４７】上記比較手段は、上記全体的出力電力の
ディジタル表現を発生する手段と、上記全体的出力電力
のディジタル表現を上記出力電力トリガーレベルとディ
ジタル的に比較する手段とを有することを特徴とする請
求項４４に記載のシステム。 - 【請求項４８】上記更なる制御手段は、１．２５ms毎に
約１dBずつ上記閉ループ利得制御表現を連続的に減少さ
せる手段を有することを特徴とする請求項４１に記載の
システム。 - 【請求項４９】第１の送信信号に対し調整可能な増幅を
行なって、増幅された第２の送信信号を出力する可調整
送信増幅器と、 上記可調整送信増幅器に結合され、受信信号強度に基づ
いて、開ループ自動利得制御信号を発生する第１の発生
手段と受信された電力制御情報に基づいて閉ループ利得
制御信号を発生する第２の発生手段とを有し、この開ル
ープ自動利得制御信号とこの閉ループ利得制御信号とを
合成した利得調整信号を上記可調整送信増幅器に与え上
記第２の送信信号の増幅度を制御する可調整利得制御器
と、 上記可調整送信増幅器に結合され、第２の送信信号の電
力を検出して電力検出信号を出力する出力電力検出器
と、 上記出力電力検出器に結合され、上記電力検出信号とト
リガーレベルとを比較する出力電力トリガーレベル比較
器と、 上記出力電力比較器及び上記可調整利得制御器の上記第
２の発生手段に結合され、上記出力電力トリガーレベル
比較器の比較結果に応じて上記第２の送信信号の増幅度
を減少させる減少器とを有する出力電力システム。 - 【請求項５０】上記可調整送信増幅器は、可調整中間周
波数（IF）増幅器と、上記可調整IF増幅器に結合された
無線周波数（RF）混合器と、上記RF混合器に結合された
RF電力増幅器とを有することを特徴とする請求項４９に
記載のシステム。
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