JP3452590B2 - システムメモリからネットワークへのパケットに配列されるデータのフローを制御するネットワークアダプタおよびデータのフローを制御する方法 - Google Patents
システムメモリからネットワークへのパケットに配列されるデータのフローを制御するネットワークアダプタおよびデータのフローを制御する方法Info
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/90—Buffering arrangements
- H04L49/9031—Wraparound memory, e.g. overrun or underrun detection
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L47/00—Traffic control in data switching networks
- H04L47/50—Queue scheduling
- H04L47/52—Queue scheduling by attributing bandwidth to queues
- H04L47/521—Static queue service slot or fixed bandwidth allocation
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L47/00—Traffic control in data switching networks
- H04L47/50—Queue scheduling
- H04L47/62—Queue scheduling characterised by scheduling criteria
- H04L47/6215—Individual queue per QOS, rate or priority
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/90—Buffering arrangements
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- H—ELECTRICITY
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- Data Exchanges In Wide-Area Networks (AREA)
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- Computer And Data Communications (AREA)
Description
【０００１】
【関連の出願への総合参照】この出願はこの発明の譲渡
人により所有され、かつこれとともに同じ日付に出願さ
れる次の同時係属出願に関するものである。
人により所有され、かつこれとともに同じ日付に出願さ
れる次の同時係属出願に関するものである。
【０００２】１） フィルーツマン（Firoozmand）の
「フレキシブルバッファ管理を有するＦＤＤＩコントロ
ーラ」（FDDI CONTROLLER HAVING FLEXIBLE BUFFER MAN
AGEMENT ）連続番号０７／５２９，３６４、 ２） フィルーツマンの「メモリ管理システムおよび方
法」（MEMORY MANAGEMENT SYSTEM AND METHOD ）連続番
号０７／５２９，３６２。
「フレキシブルバッファ管理を有するＦＤＤＩコントロ
ーラ」（FDDI CONTROLLER HAVING FLEXIBLE BUFFER MAN
AGEMENT ）連続番号０７／５２９，３６４、 ２） フィルーツマンの「メモリ管理システムおよび方
法」（MEMORY MANAGEMENT SYSTEM AND METHOD ）連続番
号０７／５２９，３６２。
【０００３】
３） フィルーツマン、他の「ＦＤＤＩネットワークに
おける多重レベルの非同期式優先順位実現と、するため
の方法およびシステム」（METHOD OFAND SYSTEM FOR IM
PLEMENTING MULTIPLE LEVELS OF ASYNCHRONOUS PRIORIT
Y IN FDDI NETWORKS ）連続番号０７／５２９，３６
５。、 ４） フィルーツマンの「多重優先順位待ち行列を単一
物理ＦＩＦＯを用いて多重論理ＦＩＦＯに転送するため
の方法およびシステム」（METHOD OFAND SYSTEM FOR TR
ANSFERRING MULTIPLE PRIORITY QUES INTO MULTIPLE LO
GICAL FIFOs USING A SINGLE PHYSICAL FIFO ）連続番
号０７／５２９，３６６。
おける多重レベルの非同期式優先順位実現と、するため
の方法およびシステム」（METHOD OFAND SYSTEM FOR IM
PLEMENTING MULTIPLE LEVELS OF ASYNCHRONOUS PRIORIT
Y IN FDDI NETWORKS ）連続番号０７／５２９，３６
５。、 ４） フィルーツマンの「多重優先順位待ち行列を単一
物理ＦＩＦＯを用いて多重論理ＦＩＦＯに転送するため
の方法およびシステム」（METHOD OFAND SYSTEM FOR TR
ANSFERRING MULTIPLE PRIORITY QUES INTO MULTIPLE LO
GICAL FIFOs USING A SINGLE PHYSICAL FIFO ）連続番
号０７／５２９，３６６。
【０００４】
【技術分野】この発明は一般的にはデータ操作、および
より特定的にはフレームに配列されるデータをネットワ
ークアダプタのバッファを介して通過させるための方法
およびシステムに関するものである。この発明は特定的
には、完全なフレームがバッファにストアされる前に、
データをシステムとネットワークとの間に転送すること
により、ネットワークアダプタのデータスループットを
増加させることに関するものである。この発明の１つの
利用は、ファイバ分布されたデータインタフェース（Ｆ
ＤＤＩ）である。
より特定的にはフレームに配列されるデータをネットワ
ークアダプタのバッファを介して通過させるための方法
およびシステムに関するものである。この発明は特定的
には、完全なフレームがバッファにストアされる前に、
データをシステムとネットワークとの間に転送すること
により、ネットワークアダプタのデータスループットを
増加させることに関するものである。この発明の１つの
利用は、ファイバ分布されたデータインタフェース（Ｆ
ＤＤＩ）である。
【０００５】
【背景技術】フレーム（あるフレーミングまたは「ハウ
スキーピング」ビットを含むデータのパケットまたはバ
ーストは「フレーム」として規定され、フレームの形で
送られるデータは「フレーム化されたデータ」と称され
る）に配列されるデータのパケットを処理するデータ操
作システムにおいて、しばしばデータのフレームをシス
テムとネットワークの別の位置との間に転送する必要が
ある。データのフレームは同じまたは異なるレベルの優
先順位を呈示する待ち行列に配列されてもよい。
スキーピング」ビットを含むデータのパケットまたはバ
ーストは「フレーム」として規定され、フレームの形で
送られるデータは「フレーム化されたデータ」と称され
る）に配列されるデータのパケットを処理するデータ操
作システムにおいて、しばしばデータのフレームをシス
テムとネットワークの別の位置との間に転送する必要が
ある。データのフレームは同じまたは異なるレベルの優
先順位を呈示する待ち行列に配列されてもよい。
【０００６】ローカルシステムおよびネットワークとの
間にあるインタフェース回路は「ネットワークコントロ
ーラ」と称される。システムとネットワークとの間の時
間不一致を補償するためにデータをバッファすること、
何らかの必要なプロトコル変換を与えること、およびコ
ントローラを通過するデータにビットを加え、またはそ
こからビットを取ることにより“ハウスキーピング”を
実行することを含み、ネットワークコントローラはシス
テムとネットワークとの間のデータフローを管理する。
種々のタイプのネットワークコントローラアーキテクチ
ャは、用いられるネットワーク動作システム、および他
の考慮すべき事柄に基づいて実現される。
間にあるインタフェース回路は「ネットワークコントロ
ーラ」と称される。システムとネットワークとの間の時
間不一致を補償するためにデータをバッファすること、
何らかの必要なプロトコル変換を与えること、およびコ
ントローラを通過するデータにビットを加え、またはそ
こからビットを取ることにより“ハウスキーピング”を
実行することを含み、ネットワークコントローラはシス
テムとネットワークとの間のデータフローを管理する。
種々のタイプのネットワークコントローラアーキテクチ
ャは、用いられるネットワーク動作システム、および他
の考慮すべき事柄に基づいて実現される。
【０００７】たとえば、ここで参照することにより援用
する前の同時係属出願（１）「フレキシブルバッファ管
理を有するＦＤＤＩコントローラ」に対して説明される
タイプのネットワークにおいて、バスマスタアーキテク
チャを含むネットワークコントローラがあり、ネットワ
ークに対する伝送のためフレーム化されたデータの待ち
行列は、システムメモリにおいて確立されるバッファか
ら出力バッファにおいて論理ＦＩＦＯにより形成される
対応する領域に転送される。システムメモリと出力バッ
ファとの間には出力バッファへの途中、一時的にフレー
ム化されたデータをストアするための予め定められた記
憶容量、たとえば３２バイトを有する物理ＦＩＦＯがあ
る。物理ＦＩＦＯの１つの目的は、システムおよびネッ
トワーククロックのクロック速度における差の結果必要
とされるデータのバッファリングを与えることである。
する前の同時係属出願（１）「フレキシブルバッファ管
理を有するＦＤＤＩコントローラ」に対して説明される
タイプのネットワークにおいて、バスマスタアーキテク
チャを含むネットワークコントローラがあり、ネットワ
ークに対する伝送のためフレーム化されたデータの待ち
行列は、システムメモリにおいて確立されるバッファか
ら出力バッファにおいて論理ＦＩＦＯにより形成される
対応する領域に転送される。システムメモリと出力バッ
ファとの間には出力バッファへの途中、一時的にフレー
ム化されたデータをストアするための予め定められた記
憶容量、たとえば３２バイトを有する物理ＦＩＦＯがあ
る。物理ＦＩＦＯの１つの目的は、システムおよびネッ
トワーククロックのクロック速度における差の結果必要
とされるデータのバッファリングを与えることである。
【０００８】「トークン」を受けてネットワークへ伝送
するための要求（ＦＤＤＩにおいては、ネットワークは
光学媒体から構成される）と、伝送に利用可能なデータ
とに応答して、ＦＤＤＩネットワークコントローラによ
り処理されるデータの待ち行列は、一度に１つのフレー
ムずつシステムメモリにおけるバッファ領域から出力バ
ッファに転送される。データの待ち行列は出力バッファ
において「論理ＦＩＦＯ」によって形成される対応する
待ち行列にストアされる。
するための要求（ＦＤＤＩにおいては、ネットワークは
光学媒体から構成される）と、伝送に利用可能なデータ
とに応答して、ＦＤＤＩネットワークコントローラによ
り処理されるデータの待ち行列は、一度に１つのフレー
ムずつシステムメモリにおけるバッファ領域から出力バ
ッファに転送される。データの待ち行列は出力バッファ
において「論理ＦＩＦＯ」によって形成される対応する
待ち行列にストアされる。
【０００９】同じ優先順位を有する付加的なデータが伝
送のために利用可能でなくなり、またはトークンの受信
の間終了していないトークンを保持する時間（ＴＨＴ）
がその優先順位に対するしきい値よりも小さくなるま
で、データは最も高いもので始まる優先順で転送され
る。このプロトコルについての詳細はここで参照するこ
とにより援用する前の同時係属出願（３）の「ＦＤＤＩ
ネットワークにおける多重レベルの非同期式優先順位を
実現するための方法およびシステム」に与えられる。
送のために利用可能でなくなり、またはトークンの受信
の間終了していないトークンを保持する時間（ＴＨＴ）
がその優先順位に対するしきい値よりも小さくなるま
で、データは最も高いもので始まる優先順で転送され
る。このプロトコルについての詳細はここで参照するこ
とにより援用する前の同時係属出願（３）の「ＦＤＤＩ
ネットワークにおける多重レベルの非同期式優先順位を
実現するための方法およびシステム」に与えられる。
【００１０】システムメモリから物理ＦＩＦＯを介して
出力バッファへのフレーム化されたデータの各々の転送
に続いて、同じ優先順位を有する付加的なデータを物理
ＦＩＦＯに転送し、その後同じ出力バッファの待ち行列
に転送するか、または異なる優先順位を有するデータを
物理ＦＩＦＯに転送し、もし付加的なデータが利用可能
であれば、その後別の出力バッファの待ち行列に転送す
るかのどちらかの決定がなされる。ここで参照すること
により援用される同時係属出願（４）「単一の物理ＦＩ
ＦＯを用いて多重優先順位待ち行列を多重論理ＦＩＦＯ
に転送するための方法およびシステム」は、いかにして
ＦＩＦＯの「ロックアップ」を防ぐかを説明する。書込
まれるべき特定の待ち行列を含む論理ＦＩＦＯにおいて
利用できる残っている記憶の量が、物理ＦＩＦＯの記憶
容量よりも少ないときロックアップは起こる。この状態
で、物理ＦＩＦＯはバッファにおける論理ＦＩＦＯにア
ンロードできない。
出力バッファへのフレーム化されたデータの各々の転送
に続いて、同じ優先順位を有する付加的なデータを物理
ＦＩＦＯに転送し、その後同じ出力バッファの待ち行列
に転送するか、または異なる優先順位を有するデータを
物理ＦＩＦＯに転送し、もし付加的なデータが利用可能
であれば、その後別の出力バッファの待ち行列に転送す
るかのどちらかの決定がなされる。ここで参照すること
により援用される同時係属出願（４）「単一の物理ＦＩ
ＦＯを用いて多重優先順位待ち行列を多重論理ＦＩＦＯ
に転送するための方法およびシステム」は、いかにして
ＦＩＦＯの「ロックアップ」を防ぐかを説明する。書込
まれるべき特定の待ち行列を含む論理ＦＩＦＯにおいて
利用できる残っている記憶の量が、物理ＦＩＦＯの記憶
容量よりも少ないときロックアップは起こる。この状態
で、物理ＦＩＦＯはバッファにおける論理ＦＩＦＯにア
ンロードできない。
【００１１】ネットワークコントローラを特徴付ける重
要なパラメータはそのデータスループットの速度、また
は単に「スループット」であり、これはコントローラが
システムとネットワークとの間で両方向にデータを転送
できる速度である。コントローラスループットは通常
は、データがネットワークに転送され得る最高速度を決
定するので、コントローラのスループットはできるだけ
高くなるべきである。ネットワークコントローラの第２
に重要なパラメータはその待ち時間、つまり、ネットワ
ークコントローラに初めに「与えられる」データと、デ
ータがネットワークに「現われる」時間（または逆も同
様である）との間の時間遅延である。
要なパラメータはそのデータスループットの速度、また
は単に「スループット」であり、これはコントローラが
システムとネットワークとの間で両方向にデータを転送
できる速度である。コントローラスループットは通常
は、データがネットワークに転送され得る最高速度を決
定するので、コントローラのスループットはできるだけ
高くなるべきである。ネットワークコントローラの第２
に重要なパラメータはその待ち時間、つまり、ネットワ
ークコントローラに初めに「与えられる」データと、デ
ータがネットワークに「現われる」時間（または逆も同
様である）との間の時間遅延である。
【００１２】ネットワークコントローラのスループット
においては自然の制限がある。たとえば、システムおよ
びネットワーククロック速度はデータがコントローラを
通過し得る速度を制限するであろう。ネットワークスル
ープットを制限する傾向のある別の要因は、システムと
ネットワークとの間で転送されているデータについて実
行されなければならない「ハウスキーピング」の量であ
る。
においては自然の制限がある。たとえば、システムおよ
びネットワーククロック速度はデータがコントローラを
通過し得る速度を制限するであろう。ネットワークスル
ープットを制限する傾向のある別の要因は、システムと
ネットワークとの間で転送されているデータについて実
行されなければならない「ハウスキーピング」の量であ
る。
【００１３】待ち時間の例に対しては、フレームまたは
パケットの形式のデータが、システムとネットワークと
の間で大きいバッファメモリを有するネットワークコン
トローラを介して転送されるとき、待ち時間は増加され
る傾向がある。これはシステムから伝送データフレーム
を受けるバッファが、ネットワークへのデータの転送を
開始する前に完全なフレームが受けられるまで待つであ
ろうからである。データのストリングにおけるデータの
各フレームまたはパケットの長さは変わってもよい。伝
送データは十分なデータが受けられるとすぐにバッファ
から転送されることが望ましい。もしフレームが長けれ
ば、「アンダーラニング」として知られる状態を防ぐた
めに、コントローラはバッファにより十分なバイトが受
取られるとネットワークへのデータの転送を開始するべ
きであり、「アンダーラニング」とは、バッファが伝送
データを使い果たさないようにするぐらい早く、システ
ムがバッファを一杯にできない状態である。完全なフレ
ームよりも少ない伝送データをネットワークに転送しな
いことが重要である、なぜならば、不完全なフレームは
その目的地に到達しないであろうし、かつネットワーク
帯域幅を無駄にするであろうからである。
パケットの形式のデータが、システムとネットワークと
の間で大きいバッファメモリを有するネットワークコン
トローラを介して転送されるとき、待ち時間は増加され
る傾向がある。これはシステムから伝送データフレーム
を受けるバッファが、ネットワークへのデータの転送を
開始する前に完全なフレームが受けられるまで待つであ
ろうからである。データのストリングにおけるデータの
各フレームまたはパケットの長さは変わってもよい。伝
送データは十分なデータが受けられるとすぐにバッファ
から転送されることが望ましい。もしフレームが長けれ
ば、「アンダーラニング」として知られる状態を防ぐた
めに、コントローラはバッファにより十分なバイトが受
取られるとネットワークへのデータの転送を開始するべ
きであり、「アンダーラニング」とは、バッファが伝送
データを使い果たさないようにするぐらい早く、システ
ムがバッファを一杯にできない状態である。完全なフレ
ームよりも少ない伝送データをネットワークに転送しな
いことが重要である、なぜならば、不完全なフレームは
その目的地に到達しないであろうし、かつネットワーク
帯域幅を無駄にするであろうからである。
【００１４】一方、データをネットワークに転送し始め
るために、完全なフレームがバッファによって受けられ
るまで待つ必要はない。システムおよびネットワークの
待ち時間によっては、時々完全なフレームがシステムか
ら受けられる前にデータの転送をバッファからネットワ
ークに開始することが可能であろう。これはもし、十分
な量の伝送データがバッファにあれば、少なくともその
一部分がまだバッファにあり、かつフレームがネットワ
ークに転送されている間、フレームは完全になるであろ
うからである。ワークに転送されているからである。言
換えれば、バッファに入ってくるデータはフレームが伝
送される前に、そこにある前のデータに「追いつく」で
あろう。
るために、完全なフレームがバッファによって受けられ
るまで待つ必要はない。システムおよびネットワークの
待ち時間によっては、時々完全なフレームがシステムか
ら受けられる前にデータの転送をバッファからネットワ
ークに開始することが可能であろう。これはもし、十分
な量の伝送データがバッファにあれば、少なくともその
一部分がまだバッファにあり、かつフレームがネットワ
ークに転送されている間、フレームは完全になるであろ
うからである。ワークに転送されているからである。言
換えれば、バッファに入ってくるデータはフレームが伝
送される前に、そこにある前のデータに「追いつく」で
あろう。
【００１５】データスループットを最大にするために、
（１）完全なフレームの伝送データがバッファに受けら
れたとき、または（２）バッファにおけるデータがネッ
トワークに転送されている間フレームが完全になること
を可能にさせるのに十分な、完全なフレームより少ない
量の伝送データをバッファが含むときのどちらかの場
合、どちらが少なくとも、ネットワークへの完全なフレ
ームの伝送データの転送を開始することが望ましいとい
うことを発明者は発見した。
（１）完全なフレームの伝送データがバッファに受けら
れたとき、または（２）バッファにおけるデータがネッ
トワークに転送されている間フレームが完全になること
を可能にさせるのに十分な、完全なフレームより少ない
量の伝送データをバッファが含むときのどちらかの場
合、どちらが少なくとも、ネットワークへの完全なフレ
ームの伝送データの転送を開始することが望ましいとい
うことを発明者は発見した。
【００１６】ネットワークからデータが受けられると、
完全なフレームがバッファにより受けられるまで待つこ
とは必要でない、なぜならば、残りの部分のフレームは
必ずその後到達するであろうからである。理想的には、
受信データは第１のバイトが受けられると、できるだけ
すぐにバッファからシステムに転送されるべきである。
しかしながら、いくつかの受信フレームはネットワーク
コントローラによって受けられなくてもよい。フレーム
はシステムへアドレスされないので、またはフレームは
いくつかのほかの態様においては不十分であるため、フ
レームはコントローラによって「流され（flushed ）」
てもよい。受信データは一部分のフレームが受けられる
とすぐに、コントローラによって評価されることができ
ない。したがって少なくとも予め定められた量のデータ
が受けられた後にのみ、バッファからの受信データをア
ンロードし始めることが望ましい。
完全なフレームがバッファにより受けられるまで待つこ
とは必要でない、なぜならば、残りの部分のフレームは
必ずその後到達するであろうからである。理想的には、
受信データは第１のバイトが受けられると、できるだけ
すぐにバッファからシステムに転送されるべきである。
しかしながら、いくつかの受信フレームはネットワーク
コントローラによって受けられなくてもよい。フレーム
はシステムへアドレスされないので、またはフレームは
いくつかのほかの態様においては不十分であるため、フ
レームはコントローラによって「流され（flushed ）」
てもよい。受信データは一部分のフレームが受けられる
とすぐに、コントローラによって評価されることができ
ない。したがって少なくとも予め定められた量のデータ
が受けられた後にのみ、バッファからの受信データをア
ンロードし始めることが望ましい。
【００１７】
【発明の開示】この発明の目的はフレームに配列される
伝送、および受信データをストアするためのバッファを
有するネットワークコントローラのデータスループット
を改良することである。
伝送、および受信データをストアするためのバッファを
有するネットワークコントローラのデータスループット
を改良することである。
【００１８】この発明の別の目的は、バスマスタアーキ
テクチュアを有するネットワークコントローラにおける
フレーム化されたデータのスループットを改良すること
である。
テクチュアを有するネットワークコントローラにおける
フレーム化されたデータのスループットを改良すること
である。
【００１９】別の目的は、データがバッファからネット
ワークに転送されている間システムからバッファに伝送
データを読出すことにより、バッファを有するネットワ
ークコントローラにおけるフレーム化されたデータのス
ループットを改良することである。
ワークに転送されている間システムからバッファに伝送
データを読出すことにより、バッファを有するネットワ
ークコントローラにおけるフレーム化されたデータのス
ループットを改良することである。
【００２０】この発明のさらなる目的は、データがネッ
トワークから入ってくる間、データをバッファからシス
テムに転送することにより、バッファを有するネットワ
ークコントローラにおけるフレーム化されたデータのス
ループットを改良することである。
トワークから入ってくる間、データをバッファからシス
テムに転送することにより、バッファを有するネットワ
ークコントローラにおけるフレーム化されたデータのス
ループットを改良することである。
【００２１】またさらなる目的は、システムおよびネッ
トワークバス待ち時間に従ってシステムまたはネットワ
ークに対するデータの転送を開始することにより、ネッ
トワークコントローラにおけるフレーム化されたデータ
のスループットを改良することである。
トワークバス待ち時間に従ってシステムまたはネットワ
ークに対するデータの転送を開始することにより、ネッ
トワークコントローラにおけるフレーム化されたデータ
のスループットを改良することである。
【００２２】また、さらなる目的は、完全なフレームお
よびバッファにより受けられるデータの量の両方に基づ
いてバッファからのデータの転送を開始することによ
り、ネットワークコントローラにおけるフレーム化され
たデータのデータ処理を改良することである。
よびバッファにより受けられるデータの量の両方に基づ
いてバッファからのデータの転送を開始することによ
り、ネットワークコントローラにおけるフレーム化され
たデータのデータ処理を改良することである。
【００２３】この発明の別の目的は、完全なフレームお
よびバッファにおいて構成される論理ＦＩＦＯにストア
されるＦＤＤＩパケットデータの量の両方に基づいて、
データをバッファからネットワークまたはシステムに転
送することにより、ＦＤＤＩネットワークコントローラ
におけるデータスループットを改良することである。
よびバッファにおいて構成される論理ＦＩＦＯにストア
されるＦＤＤＩパケットデータの量の両方に基づいて、
データをバッファからネットワークまたはシステムに転
送することにより、ＦＤＤＩネットワークコントローラ
におけるデータスループットを改良することである。
【００２４】またこの発明の別の目的は、データがＦＩ
ＦＯに受けられている間、そこからのデータの転送を開
始することにより、フレーム化されたデータの待ち行列
をストアする論理ＦＩＦＯを有するＦＤＤＩネットワー
クコントローラにおけるデータスループットを改良する
ことである。
ＦＯに受けられている間、そこからのデータの転送を開
始することにより、フレーム化されたデータの待ち行列
をストアする論理ＦＩＦＯを有するＦＤＤＩネットワー
クコントローラにおけるデータスループットを改良する
ことである。
【００２５】この発明の別の目的は、完全なフレームお
よびＦＩＦＯにストアされるデータの量の両方に基づい
て、対応する論理ＦＩＦＯへの、およびそこからの待ち
行列に配列されるＦＤＤＩパケットデータのフローを制
御することにより、ＦＤＤＩネットワークコントローラ
によるデータ処理を改良することである。この発明の上
のおよび他の目的は、システムメモリからネットワーク
へのパケットに配列されるデータのフローを制御するネ
ットワークアダプタにより満たされる。コントローラ
は、伝送および受信データをストアするための論理先入
先出メモリとして構成されるバッファメモリと、ネット
ワークに対するデータの伝送に対する要求を検出するた
めの手段とを含む。ネットワークへの伝送に対する要求
に応答して、データは一度に１つのパケットずつ、シス
テムメモリから伝送ＦＩＦＯに転送され、かつそれから
データがまだネットワークから入ってくる間、伝送ＦＩ
ＦＯからネットワークに転送される。これは完全なフレ
ームが受けられる前にＦＩＦＯがネットワークへ伝送す
ることを可能にさせる。この発明の別の局面に従って、
パケット検出手段は伝送ＦＩＦＯにおいてネットワーク
に伝送されるべき少なくとも１つのデータのフレームの
存在を検出する。データがシステムから受けられている
間、フレーム検出手段がＦＩＦＯにおける完全なフレー
ムの伝送データの存在を検出するとき、データは伝送Ｆ
ＩＦＯからネットワークに転送される。
よびＦＩＦＯにストアされるデータの量の両方に基づい
て、対応する論理ＦＩＦＯへの、およびそこからの待ち
行列に配列されるＦＤＤＩパケットデータのフローを制
御することにより、ＦＤＤＩネットワークコントローラ
によるデータ処理を改良することである。この発明の上
のおよび他の目的は、システムメモリからネットワーク
へのパケットに配列されるデータのフローを制御するネ
ットワークアダプタにより満たされる。コントローラ
は、伝送および受信データをストアするための論理先入
先出メモリとして構成されるバッファメモリと、ネット
ワークに対するデータの伝送に対する要求を検出するた
めの手段とを含む。ネットワークへの伝送に対する要求
に応答して、データは一度に１つのパケットずつ、シス
テムメモリから伝送ＦＩＦＯに転送され、かつそれから
データがまだネットワークから入ってくる間、伝送ＦＩ
ＦＯからネットワークに転送される。これは完全なフレ
ームが受けられる前にＦＩＦＯがネットワークへ伝送す
ることを可能にさせる。この発明の別の局面に従って、
パケット検出手段は伝送ＦＩＦＯにおいてネットワーク
に伝送されるべき少なくとも１つのデータのフレームの
存在を検出する。データがシステムから受けられている
間、フレーム検出手段がＦＩＦＯにおける完全なフレー
ムの伝送データの存在を検出するとき、データは伝送Ｆ
ＩＦＯからネットワークに転送される。
【００２６】この発明の別の局面は、ネットワークに伝
送されるべき少なくとも予め定められた量のデータの伝
送ＦＩＦＯにおける存在を検出するための伝送データし
きい値検出手段を提供する。データしきい値検出手段が
伝送ＦＩＦＯにおいて、少なくとも予め定められた伝送
データの存在を検出したとき、データは伝送ＦＩＦＯか
らネットワークに転送される。システムおよびネットワ
ーク待ち時間、ならびに別の要因に基づいて選択された
予め定められた量の伝送データは、ＦＩＦＯからネット
ワークへのデータの転送の間データ「アンダーラニン
グ」を防ぐのに十分な伝送ＦＩＦＯにストアされるデー
タの量である。
送されるべき少なくとも予め定められた量のデータの伝
送ＦＩＦＯにおける存在を検出するための伝送データし
きい値検出手段を提供する。データしきい値検出手段が
伝送ＦＩＦＯにおいて、少なくとも予め定められた伝送
データの存在を検出したとき、データは伝送ＦＩＦＯか
らネットワークに転送される。システムおよびネットワ
ーク待ち時間、ならびに別の要因に基づいて選択された
予め定められた量の伝送データは、ＦＩＦＯからネット
ワークへのデータの転送の間データ「アンダーラニン
グ」を防ぐのに十分な伝送ＦＩＦＯにストアされるデー
タの量である。
【００２７】好ましくは、データしきい値検出手段およ
びフレーム検出手段の両方は、完全なフレームがＦＩＦ
Ｏにストアされるか、または少なくとも予め定められた
量のデータがストアされるかのどちらかの場合、データ
が伝送ＦＩＦＯからネットワークに転送されるようにコ
ントローラに組込まれる。
びフレーム検出手段の両方は、完全なフレームがＦＩＦ
Ｏにストアされるか、または少なくとも予め定められた
量のデータがストアされるかのどちらかの場合、データ
が伝送ＦＩＦＯからネットワークに転送されるようにコ
ントローラに組込まれる。
【００２８】この発明のさらなる局面に従って、受信デ
ータしきい値検出手段は、受信ＦＩＦＯにおいてネット
ワークから受けられる少なくとも予め定められた量のデ
ータの存在を検出する。少なくとも予め定められた量の
受信データがＦＩＦＯにあるとき、受信ＦＩＦＯにスト
アされるデータはシステムに転送される。受信しきい値
は、受けられたデータが流されるべきではないというこ
とを確実にするのに十分なデータの量である。
ータしきい値検出手段は、受信ＦＩＦＯにおいてネット
ワークから受けられる少なくとも予め定められた量のデ
ータの存在を検出する。少なくとも予め定められた量の
受信データがＦＩＦＯにあるとき、受信ＦＩＦＯにスト
アされるデータはシステムに転送される。受信しきい値
は、受けられたデータが流されるべきではないというこ
とを確実にするのに十分なデータの量である。
【００２９】好ましくは、ＦＩＦＯにストアされる伝送
および受信データは、各々がタッグビットによりマーク
付けされない１つの終わりを有するパケットの形であ
り、前記アダプタはさらにパケットの終わりを検出する
タッグビットに応答する手段を含む。
および受信データは、各々がタッグビットによりマーク
付けされない１つの終わりを有するパケットの形であ
り、前記アダプタはさらにパケットの終わりを検出する
タッグビットに応答する手段を含む。
【００３０】この発明の別の局面に従って、伝送ＦＩＦ
ＯはＳＴＡＲＴおよびＥＮＤポインタによって規定さ
れ、かつそれぞれ、ＦＩＦＯにデータを読出し、かつＦ
ＩＦＯからデータを書込むためのＲＥＡＤポインタおよ
びＷＲＩＴＥポインタを含む。ＳＨＡＤＯＷ ＷＲＩＴ
Ｅポインタは伝送ＦＩＦＯにストアされる完全なフレー
ムの終わりを指す。ＳＨＡＤＯＷ ＷＲＩＴＥポインタ
がＲＥＡＤポインタを超えるとき伝送しきい値は検出さ
れる。好ましくは、伝送しきい値はＲＥＡＤとＷＲＩＴ
Ｅポインタとの間の差と比較して、レジスタから読出さ
れる。
ＯはＳＴＡＲＴおよびＥＮＤポインタによって規定さ
れ、かつそれぞれ、ＦＩＦＯにデータを読出し、かつＦ
ＩＦＯからデータを書込むためのＲＥＡＤポインタおよ
びＷＲＩＴＥポインタを含む。ＳＨＡＤＯＷ ＷＲＩＴ
Ｅポインタは伝送ＦＩＦＯにストアされる完全なフレー
ムの終わりを指す。ＳＨＡＤＯＷ ＷＲＩＴＥポインタ
がＲＥＡＤポインタを超えるとき伝送しきい値は検出さ
れる。好ましくは、伝送しきい値はＲＥＡＤとＷＲＩＴ
Ｅポインタとの間の差と比較して、レジスタから読出さ
れる。
【００３１】この発明の好ましい実施例は、各々が複数
個の異なる待ち行列に配列されるデータのフレームをス
トアするためのシステムメモリ手段を有する、複数個の
プロセッサを有するファイバ分布されたデータインタフ
ェース（ＦＤＤＩ）にある。インタフェースの出力バッ
ファメモリはそれぞれ、媒体に伝送されるべきフレーム
化されたデータの複数個の待ち行列をストアするための
複数個の論理先入先出（ＦＩＦＯ）メモリ領域を有する
ように構成される。出力バッファメモリの論理ＦＩＦＯ
メモリ領域にストアされるフレーム化されたデータは媒
体に伝送される。
個の異なる待ち行列に配列されるデータのフレームをス
トアするためのシステムメモリ手段を有する、複数個の
プロセッサを有するファイバ分布されたデータインタフ
ェース（ＦＤＤＩ）にある。インタフェースの出力バッ
ファメモリはそれぞれ、媒体に伝送されるべきフレーム
化されたデータの複数個の待ち行列をストアするための
複数個の論理先入先出（ＦＩＦＯ）メモリ領域を有する
ように構成される。出力バッファメモリの論理ＦＩＦＯ
メモリ領域にストアされるフレーム化されたデータは媒
体に伝送される。
【００３２】システムは予め定められた状態に応答して
トークンを捕獲すると、光学媒体にアクセスすることに
より光学媒体とインタフェースされる。応じて、（ａ）
優先順に一度に１つの待ち行列ずつフレーム化されたデ
ータをシステムメモリ手段からバッファメモリにおける
対応する論理ＦＩＦＯに伝送することにより、かつ
（ｂ）データが前記システムメモリ手段から論理ＦＩＦ
Ｏに入ってくる間、論理ＦＩＦＯにストアされるフレー
ム化されたデータを媒体に伝送することにより、フレー
ム化されたデータは媒体に転送される。この発明の特定
的な局面に従って、ＦＩＦＯにおける完全なフレームの
データ、または少なくとも予め定められた量のデータの
どちらかが検出されるとすぐに、伝送データの論理ＦＩ
ＦＯから媒体への転送を開始することにより、ネットワ
ークへの待ち時間は減少される。
トークンを捕獲すると、光学媒体にアクセスすることに
より光学媒体とインタフェースされる。応じて、（ａ）
優先順に一度に１つの待ち行列ずつフレーム化されたデ
ータをシステムメモリ手段からバッファメモリにおける
対応する論理ＦＩＦＯに伝送することにより、かつ
（ｂ）データが前記システムメモリ手段から論理ＦＩＦ
Ｏに入ってくる間、論理ＦＩＦＯにストアされるフレー
ム化されたデータを媒体に伝送することにより、フレー
ム化されたデータは媒体に転送される。この発明の特定
的な局面に従って、ＦＩＦＯにおける完全なフレームの
データ、または少なくとも予め定められた量のデータの
どちらかが検出されるとすぐに、伝送データの論理ＦＩ
ＦＯから媒体への転送を開始することにより、ネットワ
ークへの待ち時間は減少される。
【００３３】インタフェースのスループットはデータが
媒体から入ってくる間、受信ＦＩＦＯに受けられるデー
タを転送することによりさらに増加される。この発明の
この局面に従ってより特定的には、システムメモリ手段
にストアされるべき媒体から入ってくるデータは検出さ
れ、かつデータは媒体から受信ＦＩＦＯに転送される。
受信ＦＩＦＯにストアされる予め定められた量、つま
り、データが流されるべきかどうかを決定するのに十分
な量のデータが検出されるとすぐに、データは受信ＦＩ
ＦＯから前記システムメモリ手段に転送される。
媒体から入ってくる間、受信ＦＩＦＯに受けられるデー
タを転送することによりさらに増加される。この発明の
この局面に従ってより特定的には、システムメモリ手段
にストアされるべき媒体から入ってくるデータは検出さ
れ、かつデータは媒体から受信ＦＩＦＯに転送される。
受信ＦＩＦＯにストアされる予め定められた量、つま
り、データが流されるべきかどうかを決定するのに十分
な量のデータが検出されるとすぐに、データは受信ＦＩ
ＦＯから前記システムメモリ手段に転送される。
【００３４】この発明のまた他の目的および利点は、こ
の発明を実行するように熟考されたベストモードの例示
によって簡単に、この発明の好ましい実施例のみが示さ
れ、かつ説明される次の詳細な説明より当業者にはすぐ
に明らかになるであろう。認識されるであろうように、
この発明はすべてこの発明から逸脱することなく、ほか
のおよび異なる実施例が可能であり、かつそのいくつか
の詳細は種々の明白な点において修正が可能である。し
たがって、図面および説明は事実上例示的であり、かつ
制限的でないようにみなされるべきである。
の発明を実行するように熟考されたベストモードの例示
によって簡単に、この発明の好ましい実施例のみが示さ
れ、かつ説明される次の詳細な説明より当業者にはすぐ
に明らかになるであろう。認識されるであろうように、
この発明はすべてこの発明から逸脱することなく、ほか
のおよび異なる実施例が可能であり、かつそのいくつか
の詳細は種々の明白な点において修正が可能である。し
たがって、図面および説明は事実上例示的であり、かつ
制限的でないようにみなされるべきである。
【００３５】
【好ましい実施例の詳細な説明】この発明はフレーム化
された、またはパケットデータ操作の分野における一般
的な適応性を有するが、熟考された特定的な利用はＦＤ
ＤＩネットワークにおいてある。したがって、この発明
の開示はＦＤＤＩの分野においてなされるであろうが、
この発明はそれほど制限されるべきではないということ
が理解されるべきである。
された、またはパケットデータ操作の分野における一般
的な適応性を有するが、熟考された特定的な利用はＦＤ
ＤＩネットワークにおいてある。したがって、この発明
の開示はＦＤＤＩの分野においてなされるであろうが、
この発明はそれほど制限されるべきではないということ
が理解されるべきである。
【００３６】
【ＦＤＤＩ；概略】その環境における発明の理解を得る
のに役立つＦＤＤＩについてのいくつかの背景情報は今
提供される。
のに役立つＦＤＤＩについてのいくつかの背景情報は今
提供される。
【００３７】ファイバ光学成分およびシステムに基づい
て、かつアメリカンナショナルスタンダーズインスティ
チュート（American National Standards Institute
（ANSI） x3T9.5 Committee ）によって開発される「フ
ァイバ分布されたデータインタフェース」（ＦＤＤＩ）
は２重の逆回転する物理的リングを実現する１秒あたり
１００メガビットの時間決めされたトークンプロトコー
ルを規定する。図１は種々のステーションタイプを構成
するＦＤＤＩリングの簡略化されたブロック図である。
時々「２重アタッチメントステーション」と称されるク
ラスＡステーションはネットワークの一次リングおよび
二次リングの両方に接続される。矢印で示されるように
２つのリング上でデータは反対方向に流れる。クラスＡ
ステーションはいくつかの単一アタッチメント、または
クラスＢステーションをリングに接続するのに役立つ配
線コンセントレータとして動作し得る。図１において
は、ステーション２はステーション３、４、および５の
ための配線コンセントレータであり、コンセントレータ
はネットワーク管理装置に多数のステーションのための
１つのメンテナンスポインタを設ける。ステーションの
間で転送されるデータはフレーム化されたパケットの形
である。
て、かつアメリカンナショナルスタンダーズインスティ
チュート（American National Standards Institute
（ANSI） x3T9.5 Committee ）によって開発される「フ
ァイバ分布されたデータインタフェース」（ＦＤＤＩ）
は２重の逆回転する物理的リングを実現する１秒あたり
１００メガビットの時間決めされたトークンプロトコー
ルを規定する。図１は種々のステーションタイプを構成
するＦＤＤＩリングの簡略化されたブロック図である。
時々「２重アタッチメントステーション」と称されるク
ラスＡステーションはネットワークの一次リングおよび
二次リングの両方に接続される。矢印で示されるように
２つのリング上でデータは反対方向に流れる。クラスＡ
ステーションはいくつかの単一アタッチメント、または
クラスＢステーションをリングに接続するのに役立つ配
線コンセントレータとして動作し得る。図１において
は、ステーション２はステーション３、４、および５の
ための配線コンセントレータであり、コンセントレータ
はネットワーク管理装置に多数のステーションのための
１つのメンテナンスポインタを設ける。ステーションの
間で転送されるデータはフレーム化されたパケットの形
である。
【００３８】ＦＤＤＩパケットのフォーマットは図２に
示される。パケットは最小限の１６アイドルコントロー
ル記号（プリアンブル）により先行される。パケットは
技術において周知の４Ｂ／５ＢコードのＪおよびＫコン
トロール記号から構成されるスタートデリミタ（ＳＤ）
で始まる。これはパケットのタイプを識別する２−デー
タ記号のフレームコントロール（ＦＣ）フィールドによ
り続けられる。目的地アドレス（ＤＡ）はパケットの意
図された受信者を識別する。同様にソースアドレス（Ｓ
Ａ）はパケットの送信者を識別する。アドレスは長さに
おいて２６または４８ビットのどちらかになり得る。Ｄ
Ａフィールドは単一ステーション、グループのステーシ
ョン、またはリング上のすべてのステーションを指すこ
とができる。
示される。パケットは最小限の１６アイドルコントロー
ル記号（プリアンブル）により先行される。パケットは
技術において周知の４Ｂ／５ＢコードのＪおよびＫコン
トロール記号から構成されるスタートデリミタ（ＳＤ）
で始まる。これはパケットのタイプを識別する２−デー
タ記号のフレームコントロール（ＦＣ）フィールドによ
り続けられる。目的地アドレス（ＤＡ）はパケットの意
図された受信者を識別する。同様にソースアドレス（Ｓ
Ａ）はパケットの送信者を識別する。アドレスは長さに
おいて２６または４８ビットのどちらかになり得る。Ｄ
Ａフィールドは単一ステーション、グループのステーシ
ョン、またはリング上のすべてのステーションを指すこ
とができる。
【００３９】ＳＡに続くのは可変長情報フィールドであ
る。フレームチェックシーケンス（ＦＣＳ）フィールド
は４バイトのデータを含む。これらのデータは３２ビッ
トオートディン（Ａｕｔｏｄｉｎ）ＩＩ周期冗長検査多
項式の結果である。ＦＣＳはＦＣ、ＤＡ、ＳＡ、ＩＮＦ
ＯおよびＰＣＳフィールドのデータ完全性を確実にす
る。
る。フレームチェックシーケンス（ＦＣＳ）フィールド
は４バイトのデータを含む。これらのデータは３２ビッ
トオートディン（Ａｕｔｏｄｉｎ）ＩＩ周期冗長検査多
項式の結果である。ＦＣＳはＦＣ、ＤＡ、ＳＡ、ＩＮＦ
ＯおよびＰＣＳフィールドのデータ完全性を確実にす
る。
【００４０】ＦＣＳフィールドに続いて、Ｔ記号により
形成されるエンドデリミタ（ＥＤ）は伝送される。フレ
ーム状態（ＦＳ）フィールドはパケットがエラーを有し
て受けられていたか、アドレスが認められていたか、ま
たはパケットがコピーされていたかどうかを決定する記
号のために用いられる。
形成されるエンドデリミタ（ＥＤ）は伝送される。フレ
ーム状態（ＦＳ）フィールドはパケットがエラーを有し
て受けられていたか、アドレスが認められていたか、ま
たはパケットがコピーされていたかどうかを決定する記
号のために用いられる。
【００４１】パケットは親ステーションによりＦＤＤＩ
から除去される。「ストリッピング」と称され、かつ図
３（ａ）および（ｂ）に示されるこのプロセスにおいて
は、媒体アクセスコントローラ（ＭＡＣ）２０はリング
上の伝送のためのＩＤＬＥコントロール記号のソースを
選択する。スタートデリミタが到達したとき、コントロ
ーラはリピート経路に切換える。パケットは監視され、
もし要求されればコピーされ、かつ同時にリピートされ
る。媒体アクセスコントローラ２０はまたそれ自身のパ
ケットをソースに切換え、またはトークンを出すことが
できる。
から除去される。「ストリッピング」と称され、かつ図
３（ａ）および（ｂ）に示されるこのプロセスにおいて
は、媒体アクセスコントローラ（ＭＡＣ）２０はリング
上の伝送のためのＩＤＬＥコントロール記号のソースを
選択する。スタートデリミタが到達したとき、コントロ
ーラはリピート経路に切換える。パケットは監視され、
もし要求されればコピーされ、かつ同時にリピートされ
る。媒体アクセスコントローラ２０はまたそれ自身のパ
ケットをソースに切換え、またはトークンを出すことが
できる。
【００４２】トークンパッシングにおいて、ステーショ
ンはそれを受けるステーションに伝送する権利を割当て
る特別のビットパターンである「トークン」をを循環す
ることにより、媒体に伝送する権利を分布させる。伝送
することを願うステーションは、それが前のステーショ
ンからのトークンパッシングの順序でトークンを受ける
まで、待つ。ステーションがトークンを受けると、それ
はそのデータを伝送し、それからトークンを次のステー
ションに通過させる。
ンはそれを受けるステーションに伝送する権利を割当て
る特別のビットパターンである「トークン」をを循環す
ることにより、媒体に伝送する権利を分布させる。伝送
することを願うステーションは、それが前のステーショ
ンからのトークンパッシングの順序でトークンを受ける
まで、待つ。ステーションがトークンを受けると、それ
はそのデータを伝送し、それからトークンを次のステー
ションに通過させる。
【００４３】伝送することを待つＦＤＤＩステーション
はまず、ストリッピング動作を実行することによりトー
クンを「捕獲」しなければならない。トークンＳＤフィ
ールドのみがリング上でリピートされる。トークンが一
旦捕獲されると、ステーションはパケットを伝送し始め
ることができる。最後のパケットが送られたときステー
ションはすぐに新しいトークンを出すことによって続け
られる。
はまず、ストリッピング動作を実行することによりトー
クンを「捕獲」しなければならない。トークンＳＤフィ
ールドのみがリング上でリピートされる。トークンが一
旦捕獲されると、ステーションはパケットを伝送し始め
ることができる。最後のパケットが送られたときステー
ションはすぐに新しいトークンを出すことによって続け
られる。
【００４４】トークンを捕獲するための規則、およびデ
ータ伝送のために割当てられた時間の量はＦＤＤＩ仕様
において規定され、かつここで参照することにより援用
された前の同時係属出願（３）において要約される「時
間決めされたトークンプロトコル」によって制御され
る。プロトコルは最大トークン回転時間（ＴＲＴ）を確
実にするために設計されて、初期設定についてのクレー
ムプロセスの間ステーションの中の命令プロセスにおい
て決定される。命令プロセスはトークン到達の間の最も
速い時間を必要とするステーションが、リングのため目
標トークン回転時間（ＴＴＲＴ）を命令することを許容
する。
ータ伝送のために割当てられた時間の量はＦＤＤＩ仕様
において規定され、かつここで参照することにより援用
された前の同時係属出願（３）において要約される「時
間決めされたトークンプロトコル」によって制御され
る。プロトコルは最大トークン回転時間（ＴＲＴ）を確
実にするために設計されて、初期設定についてのクレー
ムプロセスの間ステーションの中の命令プロセスにおい
て決定される。命令プロセスはトークン到達の間の最も
速い時間を必要とするステーションが、リングのため目
標トークン回転時間（ＴＴＲＴ）を命令することを許容
する。
【００４５】時間決めされたトークンプロトコルは伝送
サービスの２つのタイプ、すなわち同期サービスおよび
非同期サービスを提供する。ステーションには同期サー
ビスにより各トークン回転上に予め定められた量の伝送
帯域幅が与えられ、残りのリング帯域幅は非同期サービ
スを用いてステーションの中で共有される。トークンサ
ービスが予想されていたよりも早く到達したとき、ステ
ーションは非同期伝送を送ることを許容される。非同期
伝送のために割当てられた時間の量は、トークンによる
到達の現実の時間と予想されていたトークンの到達時間
との間の差に制限される。非同期伝送のための帯域幅の
割当は、同期伝送のためのどの用いられていない帯域幅
もトークン回転上の非同期伝送のために自動的に再び割
当てられて、ダイナミックである。
サービスの２つのタイプ、すなわち同期サービスおよび
非同期サービスを提供する。ステーションには同期サー
ビスにより各トークン回転上に予め定められた量の伝送
帯域幅が与えられ、残りのリング帯域幅は非同期サービ
スを用いてステーションの中で共有される。トークンサ
ービスが予想されていたよりも早く到達したとき、ステ
ーションは非同期伝送を送ることを許容される。非同期
伝送のために割当てられた時間の量は、トークンによる
到達の現実の時間と予想されていたトークンの到達時間
との間の差に制限される。非同期伝送のための帯域幅の
割当は、同期伝送のためのどの用いられていない帯域幅
もトークン回転上の非同期伝送のために自動的に再び割
当てられて、ダイナミックである。
【００４６】図４を参照すると、前の同時係属出願
（２）においてより詳細に説明されたタイプのＦＤＤＩ
インタフェースにおいて、一般的に１１６として示され
るバスマスタアーキテクチュアはシステム、またはユー
ザバスとネットワークとの間にファイバ光学媒体の形で
設けられる。バスマスタアーキテクチュア１１６の主コ
ンポーネントはデータフレームをコントローラ１２０か
ら受け、かつデータを並列から直列フォーマットに変換
する前にフレームの適当な符号化を実行するエンコーダ
／デコーダ（ＥＮＤＥＣ）１３２を介して媒体にアクセ
スし、かつＦＤＤＩ要求を満たすためにほかの「ハウス
キーピング」機能を実行する媒体アクセスコントローラ
（ＭＡＣ）１２０を含む。ネットワークＤＭＡ（直接メ
モリアクセス）コントローラ１２４は、システムバス上
の少なくとも１つのシステムメモリ（図示されず）と少
なくとも１つのＦＩＦＯ（先入先出）メモリを有するよ
うに構成され、ネットワークＤＭＡコントローラと媒体
アクセスコントローラとの間に接続される出力バッファ
１２６との間のデータの転送を制御する。媒体アクセス
コントローラ１２０はフレームストリッピング、エラー
チェッキングおよびバスアービトレーションのような何
らかの要求されるハウスキーピング機能を実行する間デ
ータのフレームを受け、かつ伝送する適切なネットワー
クアクセスプロトコルを実現する。ネットワークＤＭＡ
コントローラ１２４は、フロントエンドバスマスタとし
て動作し、ホストまたはノードプロセッサと一緒に通信
し、メモリにおけるデータの動きを最小にしながらシス
テムメモリからバッファにデータを分散し、かつ収集す
る。
（２）においてより詳細に説明されたタイプのＦＤＤＩ
インタフェースにおいて、一般的に１１６として示され
るバスマスタアーキテクチュアはシステム、またはユー
ザバスとネットワークとの間にファイバ光学媒体の形で
設けられる。バスマスタアーキテクチュア１１６の主コ
ンポーネントはデータフレームをコントローラ１２０か
ら受け、かつデータを並列から直列フォーマットに変換
する前にフレームの適当な符号化を実行するエンコーダ
／デコーダ（ＥＮＤＥＣ）１３２を介して媒体にアクセ
スし、かつＦＤＤＩ要求を満たすためにほかの「ハウス
キーピング」機能を実行する媒体アクセスコントローラ
（ＭＡＣ）１２０を含む。ネットワークＤＭＡ（直接メ
モリアクセス）コントローラ１２４は、システムバス上
の少なくとも１つのシステムメモリ（図示されず）と少
なくとも１つのＦＩＦＯ（先入先出）メモリを有するよ
うに構成され、ネットワークＤＭＡコントローラと媒体
アクセスコントローラとの間に接続される出力バッファ
１２６との間のデータの転送を制御する。媒体アクセス
コントローラ１２０はフレームストリッピング、エラー
チェッキングおよびバスアービトレーションのような何
らかの要求されるハウスキーピング機能を実行する間デ
ータのフレームを受け、かつ伝送する適切なネットワー
クアクセスプロトコルを実現する。ネットワークＤＭＡ
コントローラ１２４は、フロントエンドバスマスタとし
て動作し、ホストまたはノードプロセッサと一緒に通信
し、メモリにおけるデータの動きを最小にしながらシス
テムメモリからバッファにデータを分散し、かつ収集す
る。
【００４７】図５に示され、かつ後により詳細に説明さ
れる媒体アクセスコントローラ１２０は、データバス１
３４およびアドレスバス１３６を介してバッファメモリ
１２６にインタフェースされ、かつデータバス１３４を
介してネットワークＤＭＡコントローラ１２４にインタ
フェースされる。媒体へのおよび媒体からのデータの動
きを制御するために、ハンドシェイキングはコントロー
ラ１２４および１２０の間のバス１４０で実行される。
れる媒体アクセスコントローラ１２０は、データバス１
３４およびアドレスバス１３６を介してバッファメモリ
１２６にインタフェースされ、かつデータバス１３４を
介してネットワークＤＭＡコントローラ１２４にインタ
フェースされる。媒体へのおよび媒体からのデータの動
きを制御するために、ハンドシェイキングはコントロー
ラ１２４および１２０の間のバス１４０で実行される。
【００４８】ネットワークＤＭＡコントローラ１２４
は、共有されるデータバス１４４ならびにアドレスおよ
びコントロールバス１４６、１４８を含むホストバス１
４２にある。ネットワークＤＭＡコントローラ１２４に
対する制御信号はバス要求および肯定応答線１５０でホ
ストにインタフェースされる。媒体アクセスおよびネッ
トワークＤＭＡコントローラ１２０ならびに１２４は出
力バッファメモリ１２６と一緒に協働して、後で説明さ
れ、かつより詳細にはここで参照することによって援用
される前の同時係属出願（１）において説明され、示さ
れる種々のバス上でネットワークインタフェース動作を
実行する。
は、共有されるデータバス１４４ならびにアドレスおよ
びコントロールバス１４６、１４８を含むホストバス１
４２にある。ネットワークＤＭＡコントローラ１２４に
対する制御信号はバス要求および肯定応答線１５０でホ
ストにインタフェースされる。媒体アクセスおよびネッ
トワークＤＭＡコントローラ１２０ならびに１２４は出
力バッファメモリ１２６と一緒に協働して、後で説明さ
れ、かつより詳細にはここで参照することによって援用
される前の同時係属出願（１）において説明され、示さ
れる種々のバス上でネットワークインタフェース動作を
実行する。
【００４９】図６のブロック図を参照すると、図７にお
いて詳細に示され、かつ後により詳細に説明される出力
バッファ１２６は、媒体から受けられるデータの待ち行
列を含む受信ＦＩＦＯ１７５、および少なくとも１つ、
好ましくは４つの各々が媒体に与えられるべきデータの
待ち行列を含む伝送ＦＩＦＯ１７７を有するように構成
される。図７において示される４つの待ち行列は、１つ
の同期待ち行列およびＦＤＤＩ仕様に従う３つの異なる
割当てられたレベルの優先順位を有するデータを含む待
ち行列を呈示する。好ましくはスタティックランダムア
クセスメモリ（ＳＲＡＭ）である出力バッファ１２６
は、各々が異なる優先順位のデータ待ち行列を含む４つ
のＦＩＦＯを有するようにファームウェアによってプロ
グラムされ、特定的には各ＦＩＦＯは後に詳細に説明さ
れるような「ポインタ」を用いて規定される。
いて詳細に示され、かつ後により詳細に説明される出力
バッファ１２６は、媒体から受けられるデータの待ち行
列を含む受信ＦＩＦＯ１７５、および少なくとも１つ、
好ましくは４つの各々が媒体に与えられるべきデータの
待ち行列を含む伝送ＦＩＦＯ１７７を有するように構成
される。図７において示される４つの待ち行列は、１つ
の同期待ち行列およびＦＤＤＩ仕様に従う３つの異なる
割当てられたレベルの優先順位を有するデータを含む待
ち行列を呈示する。好ましくはスタティックランダムア
クセスメモリ（ＳＲＡＭ）である出力バッファ１２６
は、各々が異なる優先順位のデータ待ち行列を含む４つ
のＦＩＦＯを有するようにファームウェアによってプロ
グラムされ、特定的には各ＦＩＦＯは後に詳細に説明さ
れるような「ポインタ」を用いて規定される。
【００５０】媒体から受けられたデータはネットワーク
ＤＭＡコントローラ１２４によりリンクリスト待ち行列
１７８を介してシステムメモリに与えられ、かつ同様
に、同期および３つのレベルの非同期優先順位に対応す
るリンクリスト待ち行列１８０を介してシステムメモリ
から媒体にデータは伝送される。このシステムにおいて
実現されるバッファメモリ管理についての説明のため、
ここにおいて参照することにより援用された前出の同時
係属出願（２）の参照はここにおいてなされる。
ＤＭＡコントローラ１２４によりリンクリスト待ち行列
１７８を介してシステムメモリに与えられ、かつ同様
に、同期および３つのレベルの非同期優先順位に対応す
るリンクリスト待ち行列１８０を介してシステムメモリ
から媒体にデータは伝送される。このシステムにおいて
実現されるバッファメモリ管理についての説明のため、
ここにおいて参照することにより援用された前出の同時
係属出願（２）の参照はここにおいてなされる。
【００５１】出力バッファ１２６を含むいかなる動作よ
りも先に、ノードプロセッサはバッファにすべての待ち
行列のエンドアドレスをロードしなければならない。待
ち行列ポインタは図７に示される順序、つまりポインタ
はまず特定のフレーム領域の終りを規定しそれから、待
ち行列を受け、かつ次に３つのレベルの優先順位を有す
る非同期待ち行列によって従われる同期待ち行列の順序
で待ち行列を伝送する。またノードプロセッサによって
プログラムされるのは、図７の右側の欄に示されるよう
な用いられるすべての待ち行列の読出し／書込みポイン
タであり、エンドアドレスポインタは図面の左側の欄に
示される。
りも先に、ノードプロセッサはバッファにすべての待ち
行列のエンドアドレスをロードしなければならない。待
ち行列ポインタは図７に示される順序、つまりポインタ
はまず特定のフレーム領域の終りを規定しそれから、待
ち行列を受け、かつ次に３つのレベルの優先順位を有す
る非同期待ち行列によって従われる同期待ち行列の順序
で待ち行列を伝送する。またノードプロセッサによって
プログラムされるのは、図７の右側の欄に示されるよう
な用いられるすべての待ち行列の読出し／書込みポイン
タであり、エンドアドレスポインタは図面の左側の欄に
示される。
【００５２】より特定的には、図７に示されるＦＩＦＯ
の各待ち行列は、接頭語「ＥＡ」を有する「アドレスの
エンド」により特徴付けられる。たとえば、ＳＰＥＣＩ
ＡＬＦＲＡＭＥ ＡＲＥＡを無視する。同期データを含
む同期待ち行列はアドレスのエンドポインタ「ＥＡＳ」
によって特徴付けられ、３つの非同期待ち行列はアドレ
スのエンドポインタ「ＥＡＡ０−ＥＡＡ２」により特徴
付けられる。さらに各待ち行列は、従来の態様ではそこ
からデータが読出され、かつそこにデータが書込まれる
位置を指すＲＥＡＤ、ＷＲＩＴＥポインタにより規定さ
れる。ＲＥＡＤおよびＷＲＩＴＥポインタの間の差は待
ち行列にストアされるデータの量を呈示する。たとえ
ば、図７においては、ＲＰＲおよびＲＰＸＡ０−ＲＰＸ
Ａ２は、ＦＤＤＩ標準に従って同期および３つのレベル
の非同期データ待ち行列のためのＲＥＡＤポインタを呈
示する。すべてのこれらのＲＥＡＤポインタはそれぞれ
の待ち行列の上にある。ポインタＷＰＸＳおよびＷＰＸ
Ａ０−ＷＰＸＡ２は、それぞれの待ち行列の終りにおい
て同期および３つのレベルの非同期データのためのＷＲ
ＩＴＥポインタを呈示する。
の各待ち行列は、接頭語「ＥＡ」を有する「アドレスの
エンド」により特徴付けられる。たとえば、ＳＰＥＣＩ
ＡＬＦＲＡＭＥ ＡＲＥＡを無視する。同期データを含
む同期待ち行列はアドレスのエンドポインタ「ＥＡＳ」
によって特徴付けられ、３つの非同期待ち行列はアドレ
スのエンドポインタ「ＥＡＡ０−ＥＡＡ２」により特徴
付けられる。さらに各待ち行列は、従来の態様ではそこ
からデータが読出され、かつそこにデータが書込まれる
位置を指すＲＥＡＤ、ＷＲＩＴＥポインタにより規定さ
れる。ＲＥＡＤおよびＷＲＩＴＥポインタの間の差は待
ち行列にストアされるデータの量を呈示する。たとえ
ば、図７においては、ＲＰＲおよびＲＰＸＡ０−ＲＰＸ
Ａ２は、ＦＤＤＩ標準に従って同期および３つのレベル
の非同期データ待ち行列のためのＲＥＡＤポインタを呈
示する。すべてのこれらのＲＥＡＤポインタはそれぞれ
の待ち行列の上にある。ポインタＷＰＸＳおよびＷＰＸ
Ａ０−ＷＰＸＡ２は、それぞれの待ち行列の終りにおい
て同期および３つのレベルの非同期データのためのＷＲ
ＩＴＥポインタを呈示する。
【００５３】この発明の局面に従って、ＳＨＡＤＯＷ
ＷＲＩＴＥポインタ（ＳＷＰ）は最もおそく待ち行列に
ストアされたフレームの終わりを指す。待ち行列が空で
あるとき初めは、ＳＨＡＤＯＷ ＷＲＩＴＥポインタは
待ち行列の上にあるＲＥＡＤおよびＷＲＩＴＥポインタ
に等しい。データが待ち行列の上に書込まれるので、Ｓ
ＨＡＤＯＷ ＷＲＩＴＥポインタはＲＥＡＤポインタに
等しいままである。フレームの終わりが待ち行列に書込
まれ、図９と関連して後に説明される「タッグ」ビット
により検出されるとき、ＳＨＡＤＯＷ ＷＲＩＴＥポイ
ンタは今待ち行列にストアされたフレームの終わりにジ
ャンプすることにより更新する。もし完全なフレームよ
りも少ないものが待ち行列にあれば、ＳＨＡＤＯＷ Ｗ
ＲＩＴＥポインタはＲＥＡＤポインタに等しい。逆に、
もし少なくとも１つの完全なフレームのデータが待ち行
列にストアされれば、ＦＩＦＯのＳＨＡＤＯＷＷＲＩＴ
ＥおよびＲＥＡＤポインタは互いに等しくない。
ＷＲＩＴＥポインタ（ＳＷＰ）は最もおそく待ち行列に
ストアされたフレームの終わりを指す。待ち行列が空で
あるとき初めは、ＳＨＡＤＯＷ ＷＲＩＴＥポインタは
待ち行列の上にあるＲＥＡＤおよびＷＲＩＴＥポインタ
に等しい。データが待ち行列の上に書込まれるので、Ｓ
ＨＡＤＯＷ ＷＲＩＴＥポインタはＲＥＡＤポインタに
等しいままである。フレームの終わりが待ち行列に書込
まれ、図９と関連して後に説明される「タッグ」ビット
により検出されるとき、ＳＨＡＤＯＷ ＷＲＩＴＥポイ
ンタは今待ち行列にストアされたフレームの終わりにジ
ャンプすることにより更新する。もし完全なフレームよ
りも少ないものが待ち行列にあれば、ＳＨＡＤＯＷ Ｗ
ＲＩＴＥポインタはＲＥＡＤポインタに等しい。逆に、
もし少なくとも１つの完全なフレームのデータが待ち行
列にストアされれば、ＦＩＦＯのＳＨＡＤＯＷＷＲＩＴ
ＥおよびＲＥＡＤポインタは互いに等しくない。
【００５４】たとえば、図７におけるポインタＳＷＰＲ
は、ＲＥＣＥＩＶＥ待ち行列のためのＳＨＡＤＯＷ Ｗ
ＲＩＴＥポインタである。ＳＷＰＸＳおよびＳＷＰＡ０
−ＳＷＰＡ２は伝送データの同期および非同期待ち行列
のためのＳＨＡＤＯＷ ＷＲＩＴＥポインタである。各
待ち行列における少なくとも１つのデータのフレームは
ストアされるべきと考えられるので、ＳＨＡＤＯＷ Ｗ
ＲＩＴＥポインタはＲＥＡＤおよびＷＲＩＴＥポインタ
の中間にあるように示される。空の待ち行列（図示せ
ず）は待ち行列に対するすべての３つのポインタが互い
に等しいことにより特徴付けられるであろう。１つのデ
ータの完全なフレームよりも少ないものを含む空でない
待ち行列は、等しいＲＥＡＤおよびＷＲＩＴＥ ＳＨＡ
ＤＯＷポインタならびに等しくないＷＲＩＴＥポインタ
により特徴付られる。
は、ＲＥＣＥＩＶＥ待ち行列のためのＳＨＡＤＯＷ Ｗ
ＲＩＴＥポインタである。ＳＷＰＸＳおよびＳＷＰＡ０
−ＳＷＰＡ２は伝送データの同期および非同期待ち行列
のためのＳＨＡＤＯＷ ＷＲＩＴＥポインタである。各
待ち行列における少なくとも１つのデータのフレームは
ストアされるべきと考えられるので、ＳＨＡＤＯＷ Ｗ
ＲＩＴＥポインタはＲＥＡＤおよびＷＲＩＴＥポインタ
の中間にあるように示される。空の待ち行列（図示せ
ず）は待ち行列に対するすべての３つのポインタが互い
に等しいことにより特徴付けられるであろう。１つのデ
ータの完全なフレームよりも少ないものを含む空でない
待ち行列は、等しいＲＥＡＤおよびＷＲＩＴＥ ＳＨＡ
ＤＯＷポインタならびに等しくないＷＲＩＴＥポインタ
により特徴付られる。
【００５５】スタックを形成すると共にバッファメモリ
１２６において構成されるＦＩＦＯは「閉じている」の
で、ポインタはバッファの終りを「ラップアラウンド」
し、かつポインタがＦＩＦＯスタックの終りに到達した
とき再循環するであろう。
１２６において構成されるＦＩＦＯは「閉じている」の
で、ポインタはバッファの終りを「ラップアラウンド」
し、かつポインタがＦＩＦＯスタックの終りに到達した
とき再循環するであろう。
【００５６】これらの２つの原理、すなわち、（１）待
ち行列におけるデータの量がＲＥＡＤおよびＷＲＩＴＥ
ポインタの間の差に等しい、かつ（２）ＳＨＡＤＯＷ
ＷＲＩＴＥおよびＲＥＡＤポインタが等しくなければ、
少なくとも１つの完全なデータのフレームが待ち行列に
おいてあるというこれらの２つの原理は、データがネッ
トワークからバッファに入ってくる間、またはデータが
システムによってバッファに与えられている間、バッフ
ァ１２６からのデータを転送するためにこの発明におい
て実現される。完全なフレームのデータがバッファにあ
る時か、または入ってくるデータを能動化するのに十分
なデータがバッファにあるいずれかの場合、アンダーラ
ニングを防ぐためにバッファにあるデータに「追いつ
く」ために、かつ伝送フレームを完全にするために、シ
ステムおよびネットワークバス待ち時間を考慮して、伝
送データはバッファ１２６からネットワークに転送され
る。システムによって受けられるように、またはそれが
処理され得る形でないため「流される」ようにのいずれ
かのため、データを能動化させるのに十分なデータがバ
ッファにあるとき、受信データはバッファ１２６からシ
ステムに転送される。
ち行列におけるデータの量がＲＥＡＤおよびＷＲＩＴＥ
ポインタの間の差に等しい、かつ（２）ＳＨＡＤＯＷ
ＷＲＩＴＥおよびＲＥＡＤポインタが等しくなければ、
少なくとも１つの完全なデータのフレームが待ち行列に
おいてあるというこれらの２つの原理は、データがネッ
トワークからバッファに入ってくる間、またはデータが
システムによってバッファに与えられている間、バッフ
ァ１２６からのデータを転送するためにこの発明におい
て実現される。完全なフレームのデータがバッファにあ
る時か、または入ってくるデータを能動化するのに十分
なデータがバッファにあるいずれかの場合、アンダーラ
ニングを防ぐためにバッファにあるデータに「追いつ
く」ために、かつ伝送フレームを完全にするために、シ
ステムおよびネットワークバス待ち時間を考慮して、伝
送データはバッファ１２６からネットワークに転送され
る。システムによって受けられるように、またはそれが
処理され得る形でないため「流される」ようにのいずれ
かのため、データを能動化させるのに十分なデータがバ
ッファにあるとき、受信データはバッファ１２６からシ
ステムに転送される。
【００５７】データがバッファ１２６からネットワーク
またはシステムのどちらかに「早く」転送されるため、
インタフェースのデータスループットは増加させられ
る。この動作は図１１および図１４と関連して後により
詳細に説明されるであろう。
またはシステムのどちらかに「早く」転送されるため、
インタフェースのデータスループットは増加させられ
る。この動作は図１１および図１４と関連して後により
詳細に説明されるであろう。
【００５８】ネットワークアクセスおよびネットワーク
ＤＭＡコントローラ１２０、１２４がバッファメモリ１
２６と一緒に協働して、いかにして示される種々のバス
上のネットワークインタフェース動作を実行するかが後
に説明されるはずである。さしあたりインタフェースの
主コンポーネント、すなわちネットワークＤＭＡコント
ローラ１２４、媒体アクセスコントローラ１２０および
出力バッファ１２６のより詳細な説明が今与えられるで
あろう。
ＤＭＡコントローラ１２０、１２４がバッファメモリ１
２６と一緒に協働して、いかにして示される種々のバス
上のネットワークインタフェース動作を実行するかが後
に説明されるはずである。さしあたりインタフェースの
主コンポーネント、すなわちネットワークＤＭＡコント
ローラ１２４、媒体アクセスコントローラ１２０および
出力バッファ１２６のより詳細な説明が今与えられるで
あろう。
【００５９】
【ネットワークＤＭＡコントローラ１２４】図８に詳細
に示されるネットワークＤＭＡコントローラ１２４は、
媒体アクセスコントローラ１２０とネットワークＤＭＡ
コントローラ１２４との間に接続されるインタフェース
回路１５０を含む。インタフェース１５０は少なくとも
１つの、かつ好ましくは４つのＦＩＦＯ１５２を含む伝
送セクションと、ＦＩＦＯを含む受信セクション１５４
と、パケットバッファ管理回路１５６と通信する。イン
タフェース１５０はデータをバッファ１２６から受信セ
クション１５４に転送すると同様に伝送セクション１５
２にストアされるデータをバッファメモリ１２６に転送
する。ネットワークのデータはシステムに利用可能であ
り、少なくとも予め定められた量のバッファにおける受
信データの受信を含むほかの状態が満たされたとき、バ
ッファ１２６から受信セクション１５４へのデータの転
送は媒体アクセスコントローラ１２０によるコマンドで
なされる。システムメモリからのデータが伝送セクショ
ンにおいて利用可能で、そこのデータ待ち行列がアンロ
ックされ、かつ少なくとも完全なフレームか、または少
なくとも予め定められた量のバッファにストアされる伝
送データを含むほかの状態が満たされたとき、伝送セク
ション１５２からのデータの転送は実行される。
に示されるネットワークＤＭＡコントローラ１２４は、
媒体アクセスコントローラ１２０とネットワークＤＭＡ
コントローラ１２４との間に接続されるインタフェース
回路１５０を含む。インタフェース１５０は少なくとも
１つの、かつ好ましくは４つのＦＩＦＯ１５２を含む伝
送セクションと、ＦＩＦＯを含む受信セクション１５４
と、パケットバッファ管理回路１５６と通信する。イン
タフェース１５０はデータをバッファ１２６から受信セ
クション１５４に転送すると同様に伝送セクション１５
２にストアされるデータをバッファメモリ１２６に転送
する。ネットワークのデータはシステムに利用可能であ
り、少なくとも予め定められた量のバッファにおける受
信データの受信を含むほかの状態が満たされたとき、バ
ッファ１２６から受信セクション１５４へのデータの転
送は媒体アクセスコントローラ１２０によるコマンドで
なされる。システムメモリからのデータが伝送セクショ
ンにおいて利用可能で、そこのデータ待ち行列がアンロ
ックされ、かつ少なくとも完全なフレームか、または少
なくとも予め定められた量のバッファにストアされる伝
送データを含むほかの状態が満たされたとき、伝送セク
ション１５２からのデータの転送は実行される。
【００６０】ＦＩＦＯ仕様に従うデータの優先順位によ
る適当な待ち行列でバッファメモリをロードするため、
パケットバッファ管理回路１５６は媒体アクセスコント
ローラ１２０に、どのタイプのデータが伝送セクション
にあるかを示す。もし待ち行列が一杯になれば、インタ
フェース１５０はパケットバッファ管理回路１５６に、
現在のＦＩＦＯを空にし終えるために、その待ち行列を
ロックし、かつその待ち行列を中断するように信号す
る。もし転送が不完全であれば、インタフェース１５０
がその待ち行列がアンロックされたと信号するまで、回
路１５６はほかの起ころうとする転送を続ける。そのと
きには、どの中断された転送も続けられる。もし伝送お
よび受信データがセクション１５２および１５４におけ
るＦＩＦＯから同時に要求されれば、インタフェース１
５０は予め定められた伝送および受信優先順に従って、
イベントの順序に基づいてこれらの転送を優先付ける。
る適当な待ち行列でバッファメモリをロードするため、
パケットバッファ管理回路１５６は媒体アクセスコント
ローラ１２０に、どのタイプのデータが伝送セクション
にあるかを示す。もし待ち行列が一杯になれば、インタ
フェース１５０はパケットバッファ管理回路１５６に、
現在のＦＩＦＯを空にし終えるために、その待ち行列を
ロックし、かつその待ち行列を中断するように信号す
る。もし転送が不完全であれば、インタフェース１５０
がその待ち行列がアンロックされたと信号するまで、回
路１５６はほかの起ころうとする転送を続ける。そのと
きには、どの中断された転送も続けられる。もし伝送お
よび受信データがセクション１５２および１５４におけ
るＦＩＦＯから同時に要求されれば、インタフェース１
５０は予め定められた伝送および受信優先順に従って、
イベントの順序に基づいてこれらの転送を優先付ける。
【００６１】パケットバッファ管理回路１５６は、コマ
ンドワードコードをデコードし、伝送し、明白なエラー
コマンドを要求し、かつ伝送セクション１５２と同様シ
ステムメモリインタフェース１６０に適当な情報を送
る。パケットバッファ管理回路１５６はコマンド要求Ｆ
ＩＦＯ１５２からの伝送要求、およびＦＩＦＯ１５４か
らの受信要求を優先付ける。管理回路１５６はそれか
ら、システムメモリインタフェース１６０にコマンドを
出して伝送、または受信のいずれかを認めるのか、もし
くはコマンドのうちの１つを処理し、かつＣＰＵインタ
フェース１６１を介してシステムにインタフェースされ
る。
ンドワードコードをデコードし、伝送し、明白なエラー
コマンドを要求し、かつ伝送セクション１５２と同様シ
ステムメモリインタフェース１６０に適当な情報を送
る。パケットバッファ管理回路１５６はコマンド要求Ｆ
ＩＦＯ１５２からの伝送要求、およびＦＩＦＯ１５４か
らの受信要求を優先付ける。管理回路１５６はそれか
ら、システムメモリインタフェース１６０にコマンドを
出して伝送、または受信のいずれかを認めるのか、もし
くはコマンドのうちの１つを処理し、かつＣＰＵインタ
フェース１６１を介してシステムにインタフェースされ
る。
【００６２】伝送セクション１５２はすべての伝送待ち
行列を維持し、かつ予め定められた優先順位における動
作を優先付ける。ＦＩＦＯ１５２はバイトを順序付け、
かつデータを収集することを実行し、かつ媒体アクセス
コントローラ１２０によって処理されるべきＦＩＦＯ配
向されたパケットにデータをフォーマット化する。伝送
セクション１５２における種々の伝送待ち行列は、バッ
ファメモリ１２６が待ち行列を一杯にしたとき待ち行列
の切換えが実行されるように制御される。待ち行列がア
ンロックされたとき動作が再開し得るように、ロックさ
れた待ち行列のためのすべての必要な情報はストアされ
る。
行列を維持し、かつ予め定められた優先順位における動
作を優先付ける。ＦＩＦＯ１５２はバイトを順序付け、
かつデータを収集することを実行し、かつ媒体アクセス
コントローラ１２０によって処理されるべきＦＩＦＯ配
向されたパケットにデータをフォーマット化する。伝送
セクション１５２における種々の伝送待ち行列は、バッ
ファメモリ１２６が待ち行列を一杯にしたとき待ち行列
の切換えが実行されるように制御される。待ち行列がア
ンロックされたとき動作が再開し得るように、ロックさ
れた待ち行列のためのすべての必要な情報はストアされ
る。
【００６３】伝送セクション１５２に含まれるＦＩＦＯ
はまた、システムメモリインタフェース１６０とネット
ワークアクセスコントローラインタフェース１５０との
間のデータバッファリングおよび速度調整のために用い
られる。システムメモリバス、およびネットワークのデ
ータ転送速度が独立しているので、バッファリングがネ
ットワークＤＭＡコントローラ１３８において要求され
る。
はまた、システムメモリインタフェース１６０とネット
ワークアクセスコントローラインタフェース１５０との
間のデータバッファリングおよび速度調整のために用い
られる。システムメモリバス、およびネットワークのデ
ータ転送速度が独立しているので、バッファリングがネ
ットワークＤＭＡコントローラ１３８において要求され
る。
【００６４】受信セクション１５４は出力バッファメモ
リ１２６からのＦＩＦＯ配向されたフレームを受け、か
つそれらをシステムメモリにおける受信バッファに分散
させる。受信バッファは記述リングによって指される。
セクション１５４はさらに、伝送ＦＩＦＯ１５２と同じ
態様で、ネットワークおよびシステムメモリの間の速度
調整を与えるためにＦＩＦＯを含む。
リ１２６からのＦＩＦＯ配向されたフレームを受け、か
つそれらをシステムメモリにおける受信バッファに分散
させる。受信バッファは記述リングによって指される。
セクション１５４はさらに、伝送ＦＩＦＯ１５２と同じ
態様で、ネットワークおよびシステムメモリの間の速度
調整を与えるためにＦＩＦＯを含む。
【００６５】システムメモリインタフェース（ＳＭＩ）
１６０はシステムメモリのため高速プログラマブルバス
インタフェースと、アドレス生成回路と、記憶装置とを
含む。インタフェース１６０はまた、システムメモリに
おけるバッファ管理のためのリングの端検出回路と、シ
ステムメモリインタフェースのための主コントロール状
態機械とを含む。
１６０はシステムメモリのため高速プログラマブルバス
インタフェースと、アドレス生成回路と、記憶装置とを
含む。インタフェース１６０はまた、システムメモリに
おけるバッファ管理のためのリングの端検出回路と、シ
ステムメモリインタフェースのための主コントロール状
態機械とを含む。
【００６６】回線１６３においてシステムメモリインタ
フェース１６０からシステムに与えられる信号は、シス
テムクロックＳＣＬＫ（図示せず）と同期している。こ
れらの信号は外部アービタ（図示せず）からの１つのシ
ステムメモリのアクセスを要求する。別の信号はネット
ワークＤＭＡコントローラ１２４に、システムメモリに
アクセスする権利を認める。ＳＭＩ１６０の出力におけ
るアドレスバスは、すべてのシステムメモリアクセスを
アドレスし、かつシステムメモリ読出し／書込み線は、
データがシステムメモリからコントローラ１２４に転送
されているのか、またはコントローラからシステムメモ
リに転送されているのかどうかを示す。ＳＭＩ１６０の
出力におけるほかの信号は、システムメモリの状態を示
し、エラーを示し、かつシステムメモリに対する読出し
および書込みの間のバスコンテンションを防ぐために外
部データバッファを能動化し、または不能化する。別の
ＳＭＩ信号は、書込み動作のためシステムメモリにデー
タをラッチするためにＳＭＩにおけるラッチを活性化す
る。
フェース１６０からシステムに与えられる信号は、シス
テムクロックＳＣＬＫ（図示せず）と同期している。こ
れらの信号は外部アービタ（図示せず）からの１つのシ
ステムメモリのアクセスを要求する。別の信号はネット
ワークＤＭＡコントローラ１２４に、システムメモリに
アクセスする権利を認める。ＳＭＩ１６０の出力におけ
るアドレスバスは、すべてのシステムメモリアクセスを
アドレスし、かつシステムメモリ読出し／書込み線は、
データがシステムメモリからコントローラ１２４に転送
されているのか、またはコントローラからシステムメモ
リに転送されているのかどうかを示す。ＳＭＩ１６０の
出力におけるほかの信号は、システムメモリの状態を示
し、エラーを示し、かつシステムメモリに対する読出し
および書込みの間のバスコンテンションを防ぐために外
部データバッファを能動化し、または不能化する。別の
ＳＭＩ信号は、書込み動作のためシステムメモリにデー
タをラッチするためにＳＭＩにおけるラッチを活性化す
る。
【００６７】ＣＰＵインタフェース１６１における信号
線は、ネットワークＤＭＡコントローラ１２４がメモリ
からのコマンドを読出さなければならないということを
示し、かつコントローラにメモリアクセスを実行するよ
うに指示する信号を含む。別の線はネットワークＤＭＡ
コントローラがメモリにおける新しい状態ワードを書込
んだということをＣＰＵに信号し、かつ別のものは割込
みを解除する。
線は、ネットワークＤＭＡコントローラ１２４がメモリ
からのコマンドを読出さなければならないということを
示し、かつコントローラにメモリアクセスを実行するよ
うに指示する信号を含む。別の線はネットワークＤＭＡ
コントローラがメモリにおける新しい状態ワードを書込
んだということをＣＰＵに信号し、かつ別のものは割込
みを解除する。
【００６８】インタフェース１５０の出力においては、
媒体アクセスコントローラ１２０を介してバッファメモ
リ１２６にアクセスするために符号化された要求を含む
ホスト要求バスがある。ホスト要求バスに搬送されるコ
ードによって、バッファメモリ１２６は４つの伝送待ち
行列のうちのいずれかにおいてデータを読出し、または
データを書込むためにアクセスされる。読出し要求はバ
ッファ１２６から受信パケットを検索し、かつそれらを
システムメモリにストアする。書込み要求は伝送のため
バッファメモリにパケットを転送する。またインタフェ
ース１５０の出力においては、ネットワークＤＭＡコン
トローラ１２４の現在の書込み、または読出し要求が媒
体アクセスコントローラ１２０によって認められている
ということを示す信号を搬送するホスト肯定線がある。
この信号と一緒に、バッファメモリ１２６は能動化さ
れ、かつ後（図１７）で説明されるようにデータはデー
タバス、データパリティバスおよびデータタグバスにあ
る。媒体アクセスコントローラ１２０がバッファメモリ
１２６からＤＭＡコントローラにデータを読出すとき、
インタフェースはまたデータをネットワークＤＭＡコン
トローラ１２４にラッチするために読出し出力を与え
る。受けられたデータ線は、受けられたデータがバッフ
ァ１２６にあり、かつシステムメモリに転送される準備
が整っているということを示す。後で説明されるほかの
線は、バッファ１２６において現在アクセスされた伝送
待ち行列の状態を示す。
媒体アクセスコントローラ１２０を介してバッファメモ
リ１２６にアクセスするために符号化された要求を含む
ホスト要求バスがある。ホスト要求バスに搬送されるコ
ードによって、バッファメモリ１２６は４つの伝送待ち
行列のうちのいずれかにおいてデータを読出し、または
データを書込むためにアクセスされる。読出し要求はバ
ッファ１２６から受信パケットを検索し、かつそれらを
システムメモリにストアする。書込み要求は伝送のため
バッファメモリにパケットを転送する。またインタフェ
ース１５０の出力においては、ネットワークＤＭＡコン
トローラ１２４の現在の書込み、または読出し要求が媒
体アクセスコントローラ１２０によって認められている
ということを示す信号を搬送するホスト肯定線がある。
この信号と一緒に、バッファメモリ１２６は能動化さ
れ、かつ後（図１７）で説明されるようにデータはデー
タバス、データパリティバスおよびデータタグバスにあ
る。媒体アクセスコントローラ１２０がバッファメモリ
１２６からＤＭＡコントローラにデータを読出すとき、
インタフェースはまたデータをネットワークＤＭＡコン
トローラ１２４にラッチするために読出し出力を与え
る。受けられたデータ線は、受けられたデータがバッフ
ァ１２６にあり、かつシステムメモリに転送される準備
が整っているということを示す。後で説明されるほかの
線は、バッファ１２６において現在アクセスされた伝送
待ち行列の状態を示す。
【００６９】
【媒体アクセスコントローラ１２０】図５により詳細に
示される媒体アクセスコントローラ１２０は、ＦＤＤ
ＩＭＡＣプロトコルを処理するためのコア媒体アクセス
コントローラ（ＭＡＣ）１６２を含む。ＭＡＣ１６２の
データ入出力ポートは、伝送および受信ＦＩＦＯ１６４
および１６６に接続される。ネットワークから受けられ
るデータは受信ＦＩＦＯ１６６により外部バッファメモ
リ１２６に与えられ、ネットワークに与えられるべき外
部バッファからのデータは伝送ＦＩＦＯ１６４にストア
される。ＦＩＦＯコントロール回路１６８は、メモリア
ービタ１７０によってなされるメモリアービトレーショ
ン決定に基づいて伝送および受信ＦＩＦＯ１６４および
１６６のローディングならびにアンローディングを調整
する。
示される媒体アクセスコントローラ１２０は、ＦＤＤ
ＩＭＡＣプロトコルを処理するためのコア媒体アクセス
コントローラ（ＭＡＣ）１６２を含む。ＭＡＣ１６２の
データ入出力ポートは、伝送および受信ＦＩＦＯ１６４
および１６６に接続される。ネットワークから受けられ
るデータは受信ＦＩＦＯ１６６により外部バッファメモ
リ１２６に与えられ、ネットワークに与えられるべき外
部バッファからのデータは伝送ＦＩＦＯ１６４にストア
される。ＦＩＦＯコントロール回路１６８は、メモリア
ービタ１７０によってなされるメモリアービトレーショ
ン決定に基づいて伝送および受信ＦＩＦＯ１６４および
１６６のローディングならびにアンローディングを調整
する。
【００７０】ネットワークまたはノードプロセッサのど
ちらがバッファメモリにアクセスできるかどうかを決定
するアービタのアクセス決定に基づいて、アドレス生成
器１７２は要求される外部バッファメモリアドレスをア
ドレスバス１３６に与える。そのデータ入力がゲート１
７３を介してアドレス生成器１７２によって制御される
ノードプロセッサインタフェース１７４は、ノードプロ
セッサからの命令をデコードし、チップ状態を収集し、
かつコントローラ１２４を通じて制御情報を分布する。
ちらがバッファメモリにアクセスできるかどうかを決定
するアービタのアクセス決定に基づいて、アドレス生成
器１７２は要求される外部バッファメモリアドレスをア
ドレスバス１３６に与える。そのデータ入力がゲート１
７３を介してアドレス生成器１７２によって制御される
ノードプロセッサインタフェース１７４は、ノードプロ
セッサからの命令をデコードし、チップ状態を収集し、
かつコントローラ１２４を通じて制御情報を分布する。
【００７１】媒体アクセスコントローラ１２０とオン−
チップの伝送および受信ＦＩＦＯ１６４ならびに１６６
は、ネットワークＤＭＡコントローラ１２４の伝送およ
び受信セクション１５２ならびに１５４に類似する態様
で、主にシステムバスの待ち時間およびバーストの長さ
によって多数のデータパケットをストアする。
チップの伝送および受信ＦＩＦＯ１６４ならびに１６６
は、ネットワークＤＭＡコントローラ１２４の伝送およ
び受信セクション１５２ならびに１５４に類似する態様
で、主にシステムバスの待ち時間およびバーストの長さ
によって多数のデータパケットをストアする。
【００７２】
【バッファメモリ１２６】図６に一般的に、かつ図７に
より詳細に示される出力バッファメモリ１２６は、ネッ
トワークから受けられたデータの待ち行列を含む受信Ｆ
ＩＦＯ１７５および、少なくとも１つの、好ましくは４
つの各々がネットワークに与えられるべきデータの待ち
行列を含む、伝送ＦＩＦＯ１７７を有するように構成さ
れる。前に説明された４つの待ち行列は図７に示され、
１つの同期待ち行列およびＦＤＤＩ仕様に従ってデータ
の３つのレベルの非同期優先順位を含む待ち行列を呈示
する。いかにしてデータ優先順位が互いに関連付けら
れ、かつネットワークに与えられるかは、ここで参照す
ることにより援用された前の同時係属出願（３）および
（４）において説明される。
より詳細に示される出力バッファメモリ１２６は、ネッ
トワークから受けられたデータの待ち行列を含む受信Ｆ
ＩＦＯ１７５および、少なくとも１つの、好ましくは４
つの各々がネットワークに与えられるべきデータの待ち
行列を含む、伝送ＦＩＦＯ１７７を有するように構成さ
れる。前に説明された４つの待ち行列は図７に示され、
１つの同期待ち行列およびＦＤＤＩ仕様に従ってデータ
の３つのレベルの非同期優先順位を含む待ち行列を呈示
する。いかにしてデータ優先順位が互いに関連付けら
れ、かつネットワークに与えられるかは、ここで参照す
ることにより援用された前の同時係属出願（３）および
（４）において説明される。
【００７３】図９に示される伝送フレームのフォーマッ
トは、ビット位置０−３１におけるデータとタッグビッ
トとを含み、かつ記述ワードによって続けられる。記述
ワードと同様に各フレームの最後のワードは、「１」に
セットされるタッグビットを有し、フレームの終わりを
マーク付けしない。伝送されるべきパケットはホストま
たはノードプロセッサにより、システムメモリにセット
アップされる。ＲＥＡＤ、ＳＨＡＤＯＷ ＷＲＩＴＥ、
ＷＲＩＴＥおよびＥＮＤ ＯＦ ＡＤＤＲＥＳＳポイン
タは示されるように位置決めされる。
トは、ビット位置０−３１におけるデータとタッグビッ
トとを含み、かつ記述ワードによって続けられる。記述
ワードと同様に各フレームの最後のワードは、「１」に
セットされるタッグビットを有し、フレームの終わりを
マーク付けしない。伝送されるべきパケットはホストま
たはノードプロセッサにより、システムメモリにセット
アップされる。ＲＥＡＤ、ＳＨＡＤＯＷ ＷＲＩＴＥ、
ＷＲＩＴＥおよびＥＮＤ ＯＦ ＡＤＤＲＥＳＳポイン
タは示されるように位置決めされる。
【００７４】
【バッファメモリにおける伝送フレームのローディン
グ】伝送順序は図１０における概観図に示される。シス
テムメモリにおけるデータのセットアップに続いて、ス
テップ１８２において、もし出力バッファ１２６におけ
る現在の伝送待ち行列が「ほとんど一杯」でないと決定
されれば、前の同時係属出願（４）に従ってネットワー
クＤＭＡコントローラ１２４はデータをシステムメモリ
から図８に示される内部伝送ＦＩＦＯ１５２に転送する
（ステップ１８４）。データは次に、伝送ＦＩＦＯ１５
２から（外部）出力バッファメモリ１２６に転送される
（ステップ１８６）。
グ】伝送順序は図１０における概観図に示される。シス
テムメモリにおけるデータのセットアップに続いて、ス
テップ１８２において、もし出力バッファ１２６におけ
る現在の伝送待ち行列が「ほとんど一杯」でないと決定
されれば、前の同時係属出願（４）に従ってネットワー
クＤＭＡコントローラ１２４はデータをシステムメモリ
から図８に示される内部伝送ＦＩＦＯ１５２に転送する
（ステップ１８４）。データは次に、伝送ＦＩＦＯ１５
２から（外部）出力バッファメモリ１２６に転送される
（ステップ１８６）。
【００７５】より詳述すれば、図９に示される伝送フレ
ームはホストおよびネットワークＤＭＡコントローラ１
２４により、媒体アクセスコントローラ１２０の管理下
でバッファメモリ１２６にロードされる。これはデータ
をバッファ１２６に要求されている特定の待ち行列に基
づいて、符号化された書込むためのネットワークＤＭＡ
コントローラ１２４による要求に応答して実行される。
下の図１１と関連して説明されるように、好ましくはバ
ス利用効率を最大にし、かつオーバランまたはアンダー
ラン状態を避けるためにバッファはネットワークに対す
る伝送のためにアンロードされているのと同時に、パケ
ットはバッファ１２６にロードされる。
ームはホストおよびネットワークＤＭＡコントローラ１
２４により、媒体アクセスコントローラ１２０の管理下
でバッファメモリ１２６にロードされる。これはデータ
をバッファ１２６に要求されている特定の待ち行列に基
づいて、符号化された書込むためのネットワークＤＭＡ
コントローラ１２４による要求に応答して実行される。
下の図１１と関連して説明されるように、好ましくはバ
ス利用効率を最大にし、かつオーバランまたはアンダー
ラン状態を避けるためにバッファはネットワークに対す
る伝送のためにアンロードされているのと同時に、パケ
ットはバッファ１２６にロードされる。
【００７６】
【バッファメモリからの伝送フレームのアンローディン
グ】フレームがバッファメモリ１２６にロードされた
後、フレーム全体がロードされたということ、またはメ
モリに書込まれるフレームのワードの数が伝送しきい値
を超えたということのどちらかが、媒体アクセスコント
ローラ１２４により確認されたとき、フレームはネット
ワークに対する伝送の準備が整う。
グ】フレームがバッファメモリ１２６にロードされた
後、フレーム全体がロードされたということ、またはメ
モリに書込まれるフレームのワードの数が伝送しきい値
を超えたということのどちらかが、媒体アクセスコント
ローラ１２４により確認されたとき、フレームはネット
ワークに対する伝送の準備が整う。
【００７７】ネットワークに対する伝送がシステムに利
用できるとき、つまり、ＦＤＤＩネットワーク上のトー
クンが待ち行列を伝送するために捕獲され、かつその待
ち行列に対する伝送状態が満たされれば、伝送は始ま
り、かつ論理「１」タッグビットによって特徴付けられ
るフレームの終りが遭遇されるまで、フレームは媒体ア
クセスコントローラ１２４によって読出される。このと
きバッファが空にされる前に、データのフレームは後続
の伝送のためにバッファに既に読出されている。つまり
伝送が進行中である間、かつフレームの完全な伝送の
後、完全なフレームがバッファにあるか、またはバッフ
ァの内容が伝送しきい値を超えれば、媒体アクセスコン
トローラ１２４は伝送のためＦＩＦＯの選択された待ち
行列からオンチップ伝送ＦＩＦＯ１６４に、より多くの
データを取出す。もしいずれの状態も満たされなけれ
ば、媒体アクセスコントローラ１２４はほかの待ち行列
を優先順に伝送のために検査する。
用できるとき、つまり、ＦＤＤＩネットワーク上のトー
クンが待ち行列を伝送するために捕獲され、かつその待
ち行列に対する伝送状態が満たされれば、伝送は始ま
り、かつ論理「１」タッグビットによって特徴付けられ
るフレームの終りが遭遇されるまで、フレームは媒体ア
クセスコントローラ１２４によって読出される。このと
きバッファが空にされる前に、データのフレームは後続
の伝送のためにバッファに既に読出されている。つまり
伝送が進行中である間、かつフレームの完全な伝送の
後、完全なフレームがバッファにあるか、またはバッフ
ァの内容が伝送しきい値を超えれば、媒体アクセスコン
トローラ１２４は伝送のためＦＩＦＯの選択された待ち
行列からオンチップ伝送ＦＩＦＯ１６４に、より多くの
データを取出す。もしいずれの状態も満たされなけれ
ば、媒体アクセスコントローラ１２４はほかの待ち行列
を優先順に伝送のために検査する。
【００７８】待ち行列からの伝送は待ち行列が空にされ
たとき完了される。しかしながら、もし伝送ＦＩＦＯ１
６４がフレームの途中で空になれば、アンダーラン状態
は暗示されかつ現在のフレームは打切られる。
たとき完了される。しかしながら、もし伝送ＦＩＦＯ１
６４がフレームの途中で空になれば、アンダーラン状態
は暗示されかつ現在のフレームは打切られる。
【００７９】少なくとも１つの完全なフレーム、または
少なくとも予め定められた量の伝送データがバッファ１
２６にあるとき、いかにしてシステムからネットワーク
へのデータの伝送が実行されるかは図１１を参照して今
より詳細に説明される。
少なくとも予め定められた量の伝送データがバッファ１
２６にあるとき、いかにしてシステムからネットワーク
へのデータの伝送が実行されるかは図１１を参照して今
より詳細に説明される。
【００８０】ステップ１８６ａにおいて、そこからデー
タが初めに伝送されるべき待ち行列は、同時係属出願
（４）に説明されるように、待ち行列がロックされたか
どうかを決定するために検査する。もし待ち行列がロッ
クされれば、プロセッサは別の待ち行列に対して続けら
れ、ステップ１８６ｇを実行する。もし待ち行列がロッ
クされなければ、その待ち行列に対するＳＨＡＤＯＷ
ＷＲＩＴＥおよびＲＥＡＤポインタの値をテストするこ
とにより、ステップ１８６ｂは完全なフレームが待ち行
列にあるかどうかを決定する。もし２つのポインタが互
いに等しくなければ、少なくとも１つの完全なフレーム
がバッファ１２６にあるので、プログラムはネットワー
クに対する伝送を開始するためにステップ１８６ｅにジ
ャンプする。もしＳＨＡＤＯＷ ＷＲＩＴＥおよびＲＥ
ＡＤポインタが互いに等しければ、プログラムは次に待
ち行列の内容をテストし、それが少なくともしきい値量
のデータを含むかどうかを決定する。これはステップ１
８６ｄにおいて、待ち行列におけるデータの量を呈示す
るＲＥＡＤおよびＷＲＩＴＥポインタの値の間の差と、
伝送データのしきい値ＸＴＨＲを比較することによりな
される。
タが初めに伝送されるべき待ち行列は、同時係属出願
（４）に説明されるように、待ち行列がロックされたか
どうかを決定するために検査する。もし待ち行列がロッ
クされれば、プロセッサは別の待ち行列に対して続けら
れ、ステップ１８６ｇを実行する。もし待ち行列がロッ
クされなければ、その待ち行列に対するＳＨＡＤＯＷ
ＷＲＩＴＥおよびＲＥＡＤポインタの値をテストするこ
とにより、ステップ１８６ｂは完全なフレームが待ち行
列にあるかどうかを決定する。もし２つのポインタが互
いに等しくなければ、少なくとも１つの完全なフレーム
がバッファ１２６にあるので、プログラムはネットワー
クに対する伝送を開始するためにステップ１８６ｅにジ
ャンプする。もしＳＨＡＤＯＷ ＷＲＩＴＥおよびＲＥ
ＡＤポインタが互いに等しければ、プログラムは次に待
ち行列の内容をテストし、それが少なくともしきい値量
のデータを含むかどうかを決定する。これはステップ１
８６ｄにおいて、待ち行列におけるデータの量を呈示す
るＲＥＡＤおよびＷＲＩＴＥポインタの値の間の差と、
伝送データのしきい値ＸＴＨＲを比較することによりな
される。
【００８１】伝送しきい値の値ＸＤＨＲは、バッファ１
２６に入ってくる伝送データがデータアンダーラニング
を防ぐためにバッファから出ていくデータと結合し得る
速度に依存する。データアンダーラニングは打切られな
ければならない「ボイドデータ」をつくるであろう。し
きい値ＸＴＨＲはシステムおよびネットワークバス待ち
時間に基づき、かつバスのデータ伝送の速度と反比例す
る。
２６に入ってくる伝送データがデータアンダーラニング
を防ぐためにバッファから出ていくデータと結合し得る
速度に依存する。データアンダーラニングは打切られな
ければならない「ボイドデータ」をつくるであろう。し
きい値ＸＴＨＲはシステムおよびネットワークバス待ち
時間に基づき、かつバスのデータ伝送の速度と反比例す
る。
【００８２】バッファメモリにストアされた伝送データ
の待ち行列は、図１２に示されるフォーマットを有し、
そこにおいて各フレームはタッグビット「０」により特
徴付けられる長いワードおよびタッグビット「１」によ
って特徴付けられる最後の長いワードを含む。パケット
の最後のワードに続いて、またタッグビット「１」によ
って特徴付けられる状態ワードがある。状態ワードはど
のバイト境界において、データの最後のワードが終るか
を規定し、ネットワークＤＭＡコントローラがシステム
メモリから得た状態からコピーされ、かつパケットがエ
ラーを含み、かつ打切られるべきかどうかを示す多数の
予め定められたビット含むパケットの状態と同様に、デ
ータバッファの状態を反映する。
の待ち行列は、図１２に示されるフォーマットを有し、
そこにおいて各フレームはタッグビット「０」により特
徴付けられる長いワードおよびタッグビット「１」によ
って特徴付けられる最後の長いワードを含む。パケット
の最後のワードに続いて、またタッグビット「１」によ
って特徴付けられる状態ワードがある。状態ワードはど
のバイト境界において、データの最後のワードが終るか
を規定し、ネットワークＤＭＡコントローラがシステム
メモリから得た状態からコピーされ、かつパケットがエ
ラーを含み、かつ打切られるべきかどうかを示す多数の
予め定められたビット含むパケットの状態と同様に、デ
ータバッファの状態を反映する。
【００８３】
【バッファメモリにおける受信パケットのローディン
グ】図１３における概観図に示されるフレーム化された
パケットの受信は、外部バッファメモリ１２６における
記憶のために媒体アクセスコントローラ１２４によるデ
ータパケットの受信（ステップ１９０）、およびバッフ
ァからネットワークＤＭＡコントローラ１２４の内部受
信ＦＩＦＯ１５４へのデータパケットの転送（ステップ
１９２）を必要とする。バッファメモリ１２６にストア
される受信フレームのフォーマットは図１５に示され
る。
グ】図１３における概観図に示されるフレーム化された
パケットの受信は、外部バッファメモリ１２６における
記憶のために媒体アクセスコントローラ１２４によるデ
ータパケットの受信（ステップ１９０）、およびバッフ
ァからネットワークＤＭＡコントローラ１２４の内部受
信ＦＩＦＯ１５４へのデータパケットの転送（ステップ
１９２）を必要とする。バッファメモリ１２６にストア
される受信フレームのフォーマットは図１５に示され
る。
【００８４】媒体アクセスコントローラ１２０によりバ
ッファメモリ１２６にストアされるネットワークから受
けられるパケットは、図１６に示される態様でメモリに
配列される。バッファメモリにおける受信パケットは連
続して接近してストアされ、バッファメモリ受信領域が
循環する待ち行列の構成を有するようにさせる。各パケ
ットの終りにおいて、媒体アクセスコントローラ１２０
はパケットの状態をストアする。タッグビットはデータ
のために０に、かつ状態ワードを識別するために１にセ
ットされる。
ッファメモリ１２６にストアされるネットワークから受
けられるパケットは、図１６に示される態様でメモリに
配列される。バッファメモリにおける受信パケットは連
続して接近してストアされ、バッファメモリ受信領域が
循環する待ち行列の構成を有するようにさせる。各パケ
ットの終りにおいて、媒体アクセスコントローラ１２０
はパケットの状態をストアする。タッグビットはデータ
のために０に、かつ状態ワードを識別するために１にセ
ットされる。
【００８５】
【バッファメモリからの受信フレームのアンローディン
グ】バッファ１２６にストアされるデータの量が受信し
きい値を超えたとき、ネットワークＤＭＡコントローラ
１２４は次に、パケットデータを内部受信ＦＩＦＯ１５
４からシステムメモリに転送し（ステップ１９４）、ホ
ストまたはノードプロセッサによって処理される（ステ
ップ１９６）。これは媒体アクセスコントローラ１２０
によって制御され、ネットワークＤＭＡコントローラ１
２４にデータをバッファメモリ１２６からシステムメモ
リに転送するように命令する。これはバッファメモリに
おけるワードの数がプログラムされた受信しきい値を超
えたとき行なわれる。フレーム受信の間の受信バッファ
待ち行列のいかなるオーバーフロー状態も状態ワードに
より示され、フレームが流されるべきであることを示
す。
グ】バッファ１２６にストアされるデータの量が受信し
きい値を超えたとき、ネットワークＤＭＡコントローラ
１２４は次に、パケットデータを内部受信ＦＩＦＯ１５
４からシステムメモリに転送し（ステップ１９４）、ホ
ストまたはノードプロセッサによって処理される（ステ
ップ１９６）。これは媒体アクセスコントローラ１２０
によって制御され、ネットワークＤＭＡコントローラ１
２４にデータをバッファメモリ１２６からシステムメモ
リに転送するように命令する。これはバッファメモリに
おけるワードの数がプログラムされた受信しきい値を超
えたとき行なわれる。フレーム受信の間の受信バッファ
待ち行列のいかなるオーバーフロー状態も状態ワードに
より示され、フレームが流されるべきであることを示
す。
【００８６】少なくとも予め定められた量の受信データ
がバッファ１２６の受信ＦＩＦＯにあるとき、いかにし
てシステムによるデータの受信が実行されるかは、今図
１４を参照してより詳細に説明される。ステップ１９４
ａを参照すると、受信しきい値の値ＲＴＨＲは図１８に
おけるレジスタ１８７から読出される。このしきい値は
伝送しきい値ＸＴＨＲのように、データがネットワーク
から入ってくる間バッファ１２６がシステムに受信デー
タを転送し始めることを可能にする。データ受信の各フ
レームがシステムにアドレスされ、かつそうでなければ
打切られないことを確実にするためにインタフェースを
能動化するため、受信しきい値の値ＲＴＨＲはシステム
およびネットワークバス待ち時間に基づいて、十分であ
るバッファの受信ＦＩＦＯにおいて受けられるワードの
数を呈示する。もしネットワークから受けられるバッフ
ァ１２６におけるワードの数が受信しきい値の値ＲＴＨ
Ｒを超えれば、ステップ１９４ｂにおいて、バッファか
らの受信データがシステムに転送されるステップ１９４
ｄにプログラムはジャンプする。
がバッファ１２６の受信ＦＩＦＯにあるとき、いかにし
てシステムによるデータの受信が実行されるかは、今図
１４を参照してより詳細に説明される。ステップ１９４
ａを参照すると、受信しきい値の値ＲＴＨＲは図１８に
おけるレジスタ１８７から読出される。このしきい値は
伝送しきい値ＸＴＨＲのように、データがネットワーク
から入ってくる間バッファ１２６がシステムに受信デー
タを転送し始めることを可能にする。データ受信の各フ
レームがシステムにアドレスされ、かつそうでなければ
打切られないことを確実にするためにインタフェースを
能動化するため、受信しきい値の値ＲＴＨＲはシステム
およびネットワークバス待ち時間に基づいて、十分であ
るバッファの受信ＦＩＦＯにおいて受けられるワードの
数を呈示する。もしネットワークから受けられるバッフ
ァ１２６におけるワードの数が受信しきい値の値ＲＴＨ
Ｒを超えれば、ステップ１９４ｂにおいて、バッファか
らの受信データがシステムに転送されるステップ１９４
ｄにプログラムはジャンプする。
【００８７】バッファに受けられるデータのフレームが
流されるべきであるかどうかを決定するために、ステッ
プ１９４ｃはバッファ１２６における受信ＦＩＦＯの内
容をテストする。これは、ＳＨＡＤＯＷ ＷＲＩＴＥポ
インタの値ＳＷＰＲとＷＲＩＴＥポインタの値ＷＰＲを
比較することにより実行される。ＳＨＡＤＯＷ ＷＲＩ
ＴＥポインタおよびＷＲＩＴＥポインタは初めは、デー
タが書込まれるべき待ち行列の位置にある。フレームが
待ち行列に書込まれるとき、ＷＲＩＴＥポインタのみが
増加する。受信フレームがシステムのアドレスを含まな
いか、またはそれが不完全であるかのどちらかの理由
で、もし受信フレームが流されるべきであれば、フレー
ムがバッファから「流される」（ステップ１９４ｆ）よ
うにＷＲＩＴＥポインタはＳＨＡＤＯＷ ＷＲＩＴＥポ
インタに再びセットされる。このゆえに、もし受信デー
タが受信しきい値を超え、フレームが流されるべきでな
ければ、ステップ１９４ｃは受信データをシステムに転
送する。
流されるべきであるかどうかを決定するために、ステッ
プ１９４ｃはバッファ１２６における受信ＦＩＦＯの内
容をテストする。これは、ＳＨＡＤＯＷ ＷＲＩＴＥポ
インタの値ＳＷＰＲとＷＲＩＴＥポインタの値ＷＰＲを
比較することにより実行される。ＳＨＡＤＯＷ ＷＲＩ
ＴＥポインタおよびＷＲＩＴＥポインタは初めは、デー
タが書込まれるべき待ち行列の位置にある。フレームが
待ち行列に書込まれるとき、ＷＲＩＴＥポインタのみが
増加する。受信フレームがシステムのアドレスを含まな
いか、またはそれが不完全であるかのどちらかの理由
で、もし受信フレームが流されるべきであれば、フレー
ムがバッファから「流される」（ステップ１９４ｆ）よ
うにＷＲＩＴＥポインタはＳＨＡＤＯＷ ＷＲＩＴＥポ
インタに再びセットされる。このゆえに、もし受信デー
タが受信しきい値を超え、フレームが流されるべきでな
ければ、ステップ１９４ｃは受信データをシステムに転
送する。
【００８８】
【ネットワークアクセスおよびネットワークＤＭＡコン
トローラインタフェス】図１７は媒体アクセスコントロ
ーラ１２０、ネットワークＤＭＡコントローラ１２４お
よびバッファメモリ１２６の間の信号フロー経路を示
す。バッファ１２６と同様に、媒体アクセスコントロー
ラ１２０とネットワークＤＭＡコントローラ１２４との
間に接続されるバッファデータバスＢＤＡＴＡは好まし
くは３２ビットバスであり、かつ付加的な線ＢＴＡＧは
ＢＤバスが、フレームデータまたはフレームの終りにフ
レーム状態を含むかどうかを規定するタッグビットを搬
送する。バスＢＤＰはＢＤバスおよびＢＤＴＡＧバスの
ためにバッファメモリデータパリティビットを搬送す
る。これら３つのすべてのバス、すなわちＢＤＡＴＡ、
ＢＴＡＧおよびＢＤＰはバッファメモリ１２６に与えら
れる。またバッファメモリ１２６に与えられるのは、媒
体アクセスコントローラ１２０によって与えられたアド
レス、好ましくは１６ビットアドレスを搬送するアドレ
スバスＢＡＤＤＲである。
トローラインタフェス】図１７は媒体アクセスコントロ
ーラ１２０、ネットワークＤＭＡコントローラ１２４お
よびバッファメモリ１２６の間の信号フロー経路を示
す。バッファ１２６と同様に、媒体アクセスコントロー
ラ１２０とネットワークＤＭＡコントローラ１２４との
間に接続されるバッファデータバスＢＤＡＴＡは好まし
くは３２ビットバスであり、かつ付加的な線ＢＴＡＧは
ＢＤバスが、フレームデータまたはフレームの終りにフ
レーム状態を含むかどうかを規定するタッグビットを搬
送する。バスＢＤＰはＢＤバスおよびＢＤＴＡＧバスの
ためにバッファメモリデータパリティビットを搬送す
る。これら３つのすべてのバス、すなわちＢＤＡＴＡ、
ＢＴＡＧおよびＢＤＰはバッファメモリ１２６に与えら
れる。またバッファメモリ１２６に与えられるのは、媒
体アクセスコントローラ１２０によって与えられたアド
レス、好ましくは１６ビットアドレスを搬送するアドレ
スバスＢＡＤＤＲである。
【００８９】ネットワークに伝送するために必要とされ
る信号は前の同時係属出願（３）に説明されるように優
先順位によって、コントロールバスＱＣＮＴＲＬ上のデ
ータによって決定された多数の異なる待ち行列のいずれ
かに与えられる。コントロールバスＱＣＮＴＲＬはま
た、前に一杯であった待ち行列が今付加的なデータを受
ける準備ができているということを、ネットワークＤＭ
Ａコントローラ１２４に示す。
る信号は前の同時係属出願（３）に説明されるように優
先順位によって、コントロールバスＱＣＮＴＲＬ上のデ
ータによって決定された多数の異なる待ち行列のいずれ
かに与えられる。コントロールバスＱＣＮＴＲＬはま
た、前に一杯であった待ち行列が今付加的なデータを受
ける準備ができているということを、ネットワークＤＭ
Ａコントローラ１２４に示す。
【００９０】ＱＣＮＴＲＬバスによってまた搬送される
のは、媒体にデータを転送するために待ち行列、すなわ
ち同期待ち行列および３つのレベルの非同期待ち行列の
うちどれか１つのデータの転送状態を示すデータであ
る。媒体アクセスコントローラ１２０によって与えられ
る転送状態は、ネットワークＤＭＡコントローラ１２４
に、コントローラ１２０がトークンを有し、かつ現在は
バッファメモリ１２６から媒体に特定の待ち行列を伝送
しているということを知らせる。
のは、媒体にデータを転送するために待ち行列、すなわ
ち同期待ち行列および３つのレベルの非同期待ち行列の
うちどれか１つのデータの転送状態を示すデータであ
る。媒体アクセスコントローラ１２０によって与えられ
る転送状態は、ネットワークＤＭＡコントローラ１２４
に、コントローラ１２０がトークンを有し、かつ現在は
バッファメモリ１２６から媒体に特定の待ち行列を伝送
しているということを知らせる。
【００９１】現在のネットワークＤＭＡコントローラ書
込み、または読出し要求が媒体アクセスコントローラ１
２０によって認められているということを示す信号を、
バスＨＳＡＣＫ（ホスト応答）は搬送する。この信号と
一緒に、バッファメモリ１２６は能動化され、かつデー
タはＢＤ（バスデータ）、ＢＤＰ（バスデータ優先順
位）およびＢＤＴＡＧバスに上に現われる。
込み、または読出し要求が媒体アクセスコントローラ１
２０によって認められているということを示す信号を、
バスＨＳＡＣＫ（ホスト応答）は搬送する。この信号と
一緒に、バッファメモリ１２６は能動化され、かつデー
タはＢＤ（バスデータ）、ＢＤＰ（バスデータ優先順
位）およびＢＤＴＡＧバスに上に現われる。
【００９２】ＲＤＡＴＡは媒体アクセスコントローラ１
２０が受信データをネットワークからネットワークＤＭ
Ａコントローラ１２４によってシステムメモリに転送さ
れるようにバッファメモリにストアしたときアサートさ
れる。応じて、ネットワークＤＭＡコントローラはバス
に対するアクセスを要求し、それは媒体アクセスコント
ローラ１２０によって応答される。媒体アクセスコント
ローラ１２０は、ＢＡＤＤＲバス上のデータによって特
定化されるアドレスでバッファメモリ１２６においてデ
ータをストアし、かつバッファにおいてストアされるデ
ータは、その後バッファのＲＥＡＤ端子の媒体アクセス
コントローラ１２０によるアサートに応答して、ネット
ワークＤＭＡコントローラ１２４に転送される。
２０が受信データをネットワークからネットワークＤＭ
Ａコントローラ１２４によってシステムメモリに転送さ
れるようにバッファメモリにストアしたときアサートさ
れる。応じて、ネットワークＤＭＡコントローラはバス
に対するアクセスを要求し、それは媒体アクセスコント
ローラ１２０によって応答される。媒体アクセスコント
ローラ１２０は、ＢＡＤＤＲバス上のデータによって特
定化されるアドレスでバッファメモリ１２６においてデ
ータをストアし、かつバッファにおいてストアされるデ
ータは、その後バッファのＲＥＡＤ端子の媒体アクセス
コントローラ１２０によるアサートに応答して、ネット
ワークＤＭＡコントローラ１２４に転送される。
【００９３】ホスト要求バスＨＳＲＥＱ上で実行される
ネットワークＤＭＡコントローラ１２４と、媒体アクセ
スコントローラ１２０との間のハンドシェイキングは図
１７、および図１９−２１の時間変化図において示され
る。図１７および１９を参照すると、ネットワークアク
セスコントローラ１２０、ネットワークＤＭＡコントロ
ーラ１２４およびバッファ１２６とインタフェースする
バス上の信号の時間は、そこに示されるバッファメモリ
クロックＢＭＣＬＫ信号と同期され、かつバッファメモ
リ１２６における受信データがネットワークＤＭＡコン
トローラ１２４によって、読出される準備が整っている
ということを示すために、ＲＤＡＴＡはアサートされ
る。ＲＤＡＴＡに応答して、ネットワークからデータフ
レームを読出すようにネットワークアクセスコントロー
ラ１２０に要求するために、ネットワークＤＭＡコント
ローラ１２４は適当なコードで、ホスト要求バスＨＳＲ
ＥＱ上でホスト要求を実行する。ネットワークアクセス
コントローラ１２０はバッファメモリ１２６のバスを仲
裁し、かつＨＳＡＣＫ上に肯定応答を与える。ネットワ
ークアクセスコントローラはまた、バッファメモリ１２
６にアドレスし、データがある位置を指し、バッファに
読出しコマンドをアサートし、かつバッファからのＢＤ
ＡＴＡ上のデータをメモリＤＭＡコントローラ１２４に
ラッチする。
ネットワークＤＭＡコントローラ１２４と、媒体アクセ
スコントローラ１２０との間のハンドシェイキングは図
１７、および図１９−２１の時間変化図において示され
る。図１７および１９を参照すると、ネットワークアク
セスコントローラ１２０、ネットワークＤＭＡコントロ
ーラ１２４およびバッファ１２６とインタフェースする
バス上の信号の時間は、そこに示されるバッファメモリ
クロックＢＭＣＬＫ信号と同期され、かつバッファメモ
リ１２６における受信データがネットワークＤＭＡコン
トローラ１２４によって、読出される準備が整っている
ということを示すために、ＲＤＡＴＡはアサートされ
る。ＲＤＡＴＡに応答して、ネットワークからデータフ
レームを読出すようにネットワークアクセスコントロー
ラ１２０に要求するために、ネットワークＤＭＡコント
ローラ１２４は適当なコードで、ホスト要求バスＨＳＲ
ＥＱ上でホスト要求を実行する。ネットワークアクセス
コントローラ１２０はバッファメモリ１２６のバスを仲
裁し、かつＨＳＡＣＫ上に肯定応答を与える。ネットワ
ークアクセスコントローラはまた、バッファメモリ１２
６にアドレスし、データがある位置を指し、バッファに
読出しコマンドをアサートし、かつバッファからのＢＤ
ＡＴＡ上のデータをメモリＤＭＡコントローラ１２４に
ラッチする。
【００９４】このように、ネットワークアクセスコント
ローラ１２０はフレームにおけるネットワークデータを
バッファメモリ１２６にストアし、かつそこのデータの
量が受信しきい値ＲＴＨＲを超えたとき、システムメモ
リにおいてどこにネットワークデータがストアされるべ
きかを決定するために、コントローラ１２０はネットワ
ークＤＭＡコントローラ１２４に、システムメモリから
記述子を取出させるためにＲＤＡＴＡをアサートする。
記述子によって指されたシステムメモリにおけるバッフ
ァが利用可能になったとき、ＤＭＡコントローラ１２４
はホスト肯定応答ＨＳＡＣＫをネットワークアクセスコ
ントローラ１２０に与える。ネットワークアクセスコン
トローラ１２０は応じて、仲裁する。なぜならばそれは
すでに占有されており、データをネットワークに伝送
し、または他の機能を実行しているかもしれないからで
ある。もしネットワークネットワークコントローラ１２
０が利用可能であれば、それは肯定応答（ＨＳＡＣＫ）
をＤＭＡコントローラ１２４に再び与え、かつそれから
読出しコマンドによって続けられる記憶アドレスをバッ
ファ１２６に出力する。バッファ１２６にアドレスされ
たデータはＢＤＡＴＡに書込まれ、かつネットワークか
らデータを受けるために必要なハンドシェイキングを完
全にするために、システムメモリにおいて指定されたバ
ッファに与えられるようにネットワークＤＭＡコントロ
ーラ１２４にラッチされる。
ローラ１２０はフレームにおけるネットワークデータを
バッファメモリ１２６にストアし、かつそこのデータの
量が受信しきい値ＲＴＨＲを超えたとき、システムメモ
リにおいてどこにネットワークデータがストアされるべ
きかを決定するために、コントローラ１２０はネットワ
ークＤＭＡコントローラ１２４に、システムメモリから
記述子を取出させるためにＲＤＡＴＡをアサートする。
記述子によって指されたシステムメモリにおけるバッフ
ァが利用可能になったとき、ＤＭＡコントローラ１２４
はホスト肯定応答ＨＳＡＣＫをネットワークアクセスコ
ントローラ１２０に与える。ネットワークアクセスコン
トローラ１２０は応じて、仲裁する。なぜならばそれは
すでに占有されており、データをネットワークに伝送
し、または他の機能を実行しているかもしれないからで
ある。もしネットワークネットワークコントローラ１２
０が利用可能であれば、それは肯定応答（ＨＳＡＣＫ）
をＤＭＡコントローラ１２４に再び与え、かつそれから
読出しコマンドによって続けられる記憶アドレスをバッ
ファ１２６に出力する。バッファ１２６にアドレスされ
たデータはＢＤＡＴＡに書込まれ、かつネットワークか
らデータを受けるために必要なハンドシェイキングを完
全にするために、システムメモリにおいて指定されたバ
ッファに与えられるようにネットワークＤＭＡコントロ
ーラ１２４にラッチされる。
【００９５】図１８を参照すると、現在伝送されるべき
データは図８におけるオンチップＦＩＦＯ１５２にスト
アされ、かつそのデータをバッファメモリ１２６におけ
る論理ＦＩＦＯに転送する準備が整っている。データを
ネットワークに伝送する要求に応答して、ネットワーク
ＤＭＡコントローラはホスト要求信号ＨＳＲＥＱをネッ
トワークアクセスコントローラ１２０に与え、ホストが
ネットワークに対する書込みを要求するということを示
す。ホストが書込むであろう特定の待ち行列は、ＨＳＲ
ＥＱバス上のコードによって決定される。この例におい
て、データの同期フレームがネットワークに与えられる
ように、ホストが同期待ち行列に書込むことを要求する
ということが想定される。応じて、ネットワークアクセ
スコントローラ１２０は仲裁し、かつ時間があればホス
トに対する肯定応答信号（ＨＳＡＣＫ）に応答する。ネ
ットワークアクセスコントローラ１２０はまた、ネット
ワークに伝送されるべきデータのフレームが一時的にス
トアされるバッファメモリ１２６にアドレスを与え、か
つバッファに書込みパルスを与える。したがって、ＢＤ
ＡＴＡバス上でネットワークＤＭＡコントローラ１２４
により与えられるデータは、ＢＤＡＤＤＲ上のネットワ
ークアクセスコントローラ１２０によって特定化される
位置において、バッファメモリ１２６に形成される論理
ＦＩＦＯに書込まれる。
データは図８におけるオンチップＦＩＦＯ１５２にスト
アされ、かつそのデータをバッファメモリ１２６におけ
る論理ＦＩＦＯに転送する準備が整っている。データを
ネットワークに伝送する要求に応答して、ネットワーク
ＤＭＡコントローラはホスト要求信号ＨＳＲＥＱをネッ
トワークアクセスコントローラ１２０に与え、ホストが
ネットワークに対する書込みを要求するということを示
す。ホストが書込むであろう特定の待ち行列は、ＨＳＲ
ＥＱバス上のコードによって決定される。この例におい
て、データの同期フレームがネットワークに与えられる
ように、ホストが同期待ち行列に書込むことを要求する
ということが想定される。応じて、ネットワークアクセ
スコントローラ１２０は仲裁し、かつ時間があればホス
トに対する肯定応答信号（ＨＳＡＣＫ）に応答する。ネ
ットワークアクセスコントローラ１２０はまた、ネット
ワークに伝送されるべきデータのフレームが一時的にス
トアされるバッファメモリ１２６にアドレスを与え、か
つバッファに書込みパルスを与える。したがって、ＢＤ
ＡＴＡバス上でネットワークＤＭＡコントローラ１２４
により与えられるデータは、ＢＤＡＤＤＲ上のネットワ
ークアクセスコントローラ１２０によって特定化される
位置において、バッファメモリ１２６に形成される論理
ＦＩＦＯに書込まれる。
【００９６】もしネットワークに伝送されるべきデータ
がなければ、ネットワークＤＭＡコントローラ１２４は
ネットワークアクセスコントローラ１２０に対するＨＳ
ＲＥＱ上にさらなる要求を与えない。もし付加的なデー
タがネットワークに伝送されるべきであれば、他方、Ｈ
ＳＲＥＱバスはそのままアサートされ、かつその時間を
仲裁するネットワークアクセスコントローラ１２０が利
用可能なとき、それはＨＳＡＣＫ上のコントローラ１２
４に応答した後、バッファ１２６に付加的なアドレスお
よび書込みパルスを与える。
がなければ、ネットワークＤＭＡコントローラ１２４は
ネットワークアクセスコントローラ１２０に対するＨＳ
ＲＥＱ上にさらなる要求を与えない。もし付加的なデー
タがネットワークに伝送されるべきであれば、他方、Ｈ
ＳＲＥＱバスはそのままアサートされ、かつその時間を
仲裁するネットワークアクセスコントローラ１２０が利
用可能なとき、それはＨＳＡＣＫ上のコントローラ１２
４に応答した後、バッファ１２６に付加的なアドレスお
よび書込みパルスを与える。
【００９７】図２１ははバック・ツー・バック読出しお
よび書込み動作の間のバス上のデータの時間関係を示
す。示された例においては、ネットワークアクセスコン
トローラ１２０は初めは書込み動作、それから読出し動
作を実行し、かつそれから書込み動作に戻る。含まれる
種々のバスに与えられる信号は、図１９および図２０に
示されるそれらと連続して対応する。
よび書込み動作の間のバス上のデータの時間関係を示
す。示された例においては、ネットワークアクセスコン
トローラ１２０は初めは書込み動作、それから読出し動
作を実行し、かつそれから書込み動作に戻る。含まれる
種々のバスに与えられる信号は、図１９および図２０に
示されるそれらと連続して対応する。
【００９８】
【結論】バッファ１２６における受信および伝送データ
の量を検出し、かつデータがバッファに入ってくる間、
ネットワークに対する伝送データおよびシステムメモリ
に対する受信データをアンロードすることによって、イ
ンタフェースのデータスループットは改良される。バッ
ファにおける伝送データの量がレジスタから読出される
伝送しきい値を超えたとき、または少なくとも１つの完
全なフレームのデータがバッファにあるとき、伝送デー
タはバッファからネットワークに送られる。伝送しきい
値はシステムおよびバス待ち時間ならびにほかの要因に
よって決定される多数のワードであり、それがバッファ
にストアされたときアンダーラニングを避けるために、
入ってくるデータが「追いつく」ことを可能にするであ
ろう。バッファにおける受信データの量がレジスタから
読出される受信しきい値を超えるとすぐに、受信データ
はバッファからシステムメモリに転送される。
の量を検出し、かつデータがバッファに入ってくる間、
ネットワークに対する伝送データおよびシステムメモリ
に対する受信データをアンロードすることによって、イ
ンタフェースのデータスループットは改良される。バッ
ファにおける伝送データの量がレジスタから読出される
伝送しきい値を超えたとき、または少なくとも１つの完
全なフレームのデータがバッファにあるとき、伝送デー
タはバッファからネットワークに送られる。伝送しきい
値はシステムおよびバス待ち時間ならびにほかの要因に
よって決定される多数のワードであり、それがバッファ
にストアされたときアンダーラニングを避けるために、
入ってくるデータが「追いつく」ことを可能にするであ
ろう。バッファにおける受信データの量がレジスタから
読出される受信しきい値を超えるとすぐに、受信データ
はバッファからシステムメモリに転送される。
【００９９】この開示において、この発明の好ましい実
施例のみが説明され、かつ示されるが、前述のように、
この発明は種々のほかの組合わせおよび環境における使
用も可能であり、かつここに表わされるような発明の概
念の範囲内での変更、または修正が可能であるというこ
とが理解されるべきである。たとえばこの発明はＦＤＤ
Ｉの環境において説明されるが、これはそんなに制限さ
れるべきではない。
施例のみが説明され、かつ示されるが、前述のように、
この発明は種々のほかの組合わせおよび環境における使
用も可能であり、かつここに表わされるような発明の概
念の範囲内での変更、または修正が可能であるというこ
とが理解されるべきである。たとえばこの発明はＦＤＤ
Ｉの環境において説明されるが、これはそんなに制限さ
れるべきではない。
【図１】先行技術において知られるタイプのＦＤＤＩネ
ットワークの典型的な実現化例のブロック図である。
ットワークの典型的な実現化例のブロック図である。
【図２】ＦＤＤＩパケットのフォーマットを示す図であ
る。
る。
【図３】ＦＤＤＩ仕様におけるＭＡＣサブレイヤの動作
を示す図である。
を示す図である。
【図４】別々のノードプロセッサおよびホストとインタ
フェースするネットワークの実現化例のブロック図であ
る。
フェースするネットワークの実現化例のブロック図であ
る。
【図５】図４に示される媒体アクセスコントローラのよ
り詳細な図である。
り詳細な図である。
【図６】ネットワークインタフェースにおいて実行され
るデータフローを示す図である。
るデータフローを示す図である。
【図７】ネットワークインタフェースにおいて実現され
る待ち行列におけるバッファメモリの構成を示す図であ
る。
る待ち行列におけるバッファメモリの構成を示す図であ
る。
【図８】図４に示されるネットワークインタフェースア
ーキテクチュアにおけるネットワークＤＭＡコントロー
ラのより詳細な図である。
ーキテクチュアにおけるネットワークＤＭＡコントロー
ラのより詳細な図である。
【図９】バッファメモリ伝送待ち行列を示す図である。
【図１０】いかにしてネットワークに伝送されるべきデ
ータがシステムメモリから動かされるかを示す一般化さ
れたフローチャートの図である。
ータがシステムメモリから動かされるかを示す一般化さ
れたフローチャートの図である。
【図１１】完全なフレームのデータ、または少なくとも
予め定められた量のデータのどちらかが伝送ＦＩＦＯに
受けられたとき、いかにして伝送データが伝送ＦＩＦＯ
からネットワークに転送されるかを示す、より詳細なフ
ローチャートの図である。
予め定められた量のデータのどちらかが伝送ＦＩＦＯに
受けられたとき、いかにして伝送データが伝送ＦＩＦＯ
からネットワークに転送されるかを示す、より詳細なフ
ローチャートの図である。
【図１２】バッファメモリにおいて待ち行列化された伝
送パケットの図である。
送パケットの図である。
【図１３】いかにしてネットワークから受けられるデー
タが、システムメモリに動かされるかを示す一般化され
たフローチャートの図である。
タが、システムメモリに動かされるかを示す一般化され
たフローチャートの図である。
【図１４】少なくとも予め定められた量のデータが受信
ＦＩＦＯに受けられたとき、いかにして受信データが受
信ＦＩＦＯからシステムに転送されるかを示す、より詳
細なフローチャートの図である。
ＦＩＦＯに受けられたとき、いかにして受信データが受
信ＦＩＦＯからシステムに転送されるかを示す、より詳
細なフローチャートの図である。
【図１５】バッファメモリ受信待ち行列の構造を示す図
である。
である。
【図１６】バッファメモリにストアされる受信パケット
のフォーマットを示す図である。
のフォーマットを示す図である。
【図１７】媒体アクセスコントローラ、ネットワークＤ
ＭＡコントローラおよびバッファメモリの間の信号のフ
ローを示す図である。
ＭＡコントローラおよびバッファメモリの間の信号のフ
ローを示す図である。
【図１８】伝送および受信ＦＩＦＯからのデータを転送
するための伝送および受信しきい値をストアするフレー
ムしきい値レジスタの図である。
するための伝送および受信しきい値をストアするフレー
ムしきい値レジスタの図である。
【図１９】バッファメモリによる受信フレームのローデ
ィングすること示す信号時間変化図である。
ィングすること示す信号時間変化図である。
【図２０】バッファメモリにおいて伝送フレームのロー
ディングを示す信号時間変化図である。
ディングを示す信号時間変化図である。
【図２１】バッファメモリによりバック・ツー・バック
読出しおよび書込みを示す時間変化図である。
読出しおよび書込みを示す時間変化図である。
（１１６） バスマスタアーキテクチュア
（１２０） 媒体アクセスコントローラ（ＭＡＣ）
（１３２） エンコーダ／デコーダ（ＥＮＤＥＣ）
（１２６） バッファメモリ
フロントページの続き
(56)参考文献 特開 平１−196654（ＪＰ，Ａ)
特開 昭62−221057（ＪＰ，Ａ)
特開 昭62−98444（ＪＰ，Ａ)
特開 昭62−113254（ＪＰ，Ａ)
特開 昭64−36149（ＪＰ，Ａ)
特開 昭64−81435（ＪＰ，Ａ)
特開 平２−87248（ＪＰ，Ａ)
(58)調査した分野(Int.Cl.7，ＤＢ名)
H04L 12/42
Claims (33)
- 【請求項１】 システムメモリからネットワークへの、
パケットに配列されたデータのフローを制御するネット
ワークアダプタであって、 データをストアするためのバッファメモリ手段と、 論理先入先出メモリ（ＦＩＦＯ）として前記バッファメ
モリ手段を構成するための手段と、 ネットワークに対するデータの伝送のための要求を検出
するための手段と、前記ネットワークに対する伝送のための要求に応答し
て、 一度に１つのパケットずつ、データを前記システム
メモリから前記ＦＩＦＯに転送するための第１の手段
と、前記ＦＩＦＯ内の前記データを、 データがネットワーク
から前記ＦＩＦＯに入ってくる間に、前記ＦＩＦＯから
前記ネットワークに転送するための第２の手段とを含
む、ネットワークアダプタ。 - 【請求項２】 ネットワークに伝送されるべき少なくと
も１つのパケットの前記データが前記ＦＩＦＯ内に存在
していることを検出するためのパケット検出手段をさら
に含み、前記第２の手段が、前記パケット検出手段に応
答して、前記ＦＩＦＯ内の前記データを前記ネットワー
クに転送するための手段を含む、請求項１記載のアダプ
タ。 - 【請求項３】 前記ネットワークに伝送されるべき少な
くとも予め定められた量のデータが前記ＦＩＦＯ内に存
在することを検出するための伝送データしきい値検出手
段をさらに含み、前記第２の手段は、前記データしきい
値検出手段に応答して、前記ＦＩＦＯ内の前記データを
前記ネットワークに転送するための手段を含む、請求項
１記載のアダプタ。 - 【請求項４】 前記ネットワークに伝送されるべき少な
くとも予め定められた量のデータが前記ＦＩＦＯ内に存
在することを検出するための伝送データしきい値検出手
段と、 少なくとも１つのパケットの前記データが前記ＦＩＦＯ
内に存在していることを検出するためのパケット検出手
段とをさらに含み、前記第２の手段は、前記パケット検出手段および前記し
きい値検出手段に応答 して、 少なくとも１パケットのデ
ータまたは少なくとも前記予め定められた量のデータが
前記ＦＩＦＯ内にあるとき、前記データを前記ネットワ
ークに転送するための手段を含む、請求項１記載のアダ
プタ。 - 【請求項５】 ネットワークから受信した、少なくとも
予め定められた量のデータが前記ＦＩＦＯ内に存在して
いることを検出するための受信データしきい値検出手段
をさらに含み、前記第２の手段は、前記受信データしき
い値検出手段に応答して、前記ＦＩＦＯ内の前記データ
を前記システムメモリ手段に転送するための手段を含
む、請求項１記載のアダプタ。 - 【請求項６】 前記ＦＩＦＯにストアされるデータは、
各々がタッグビットによって境界が画定された一端を有
するパケットの形であり、かつ前記アダプタはさらに、
前記タッグビットに応答してパケットの前記一端を検出
するための手段を含む、請求項１記載のアダプタ。 - 【請求項７】 前記ＦＩＦＯはＳＴＡＲＴおよびＥＮＤ
ポインタによって規定され、かつそれぞれ、前記ＦＩＦ
Ｏにデータを読出し、かつ前記ＦＩＦＯからデータを書
込むための、ＲＥＡＤポインタおよびＷＲＩＴＥポイン
タ、ならびに前記伝送ＦＩＦＯにストアされた完全なフ
レームの前記一端を指すＳＨＡＤＯＷＷＲＩＴＥポイン
タを含み、前記パケット検出手段は、前記ＳＨＡＤＯＷ
ＷＲＩＴＥポインタが前記ＲＥＡＤポインタを超える
ときを検出するための手段を含む、請求項２記載のアダ
プタ。 - 【請求項８】 データしきい値をストアするレジスタを
さらに含み、前記データしきい値検出手段は、前記ＦＩ
ＦＯの内容と前記データしきい値とを比較するための手
段を含む、請求項３記載のアダプタ。 - 【請求項９】 前記データしきい値検出手段は、前記Ｒ
ＥＡＤポインタと前記ＷＲＩＴＥポインタとの間の差
を、前記データしきい値と比較するための手段を含む、
請求項７記載のアダプタ。 - 【請求項１０】 少なくともデータビットおよびパケッ
トの終り（タッグ）ビットにより特徴付けられるフレー
ムに配列されるデータのパケットをストアするための少
なくとも１つのプロセッサおよび、システムメモリ手段
を含むネットワークアダプタのためのネットワークコン
トローラであって、 ランダムアクセスメモリと、 前記ランダムアクセスメモリ内に、伝送ＦＩＦＯとして
構成されるバッファメモリを規定するための手段と、 前記タッグビットによって境界が画定され、かつ伝送さ
れるべき待ち行列を形成する連続するフレームを前記シ
ステムメモリ手段から前記伝送ＦＩＦＯに転送するため
の手段と、 少なくとも１つの完全なフレームのデータが前記伝送Ｆ
ＩＦＯ内にストアされていることを検出するための第１
の検出器手段と、 少なくとも予め定められた量のデータが前記伝送ＦＩＦ
Ｏ内にストアされていることを検出するための第２の検
出器手段と、前記第１および第２の検出器手段のうちの少なくとも１
つに応答して、 ネットワークに対する前記伝送ＦＩＦＯ
の内容を伝送するための手段とを含む、ネットワークコ
ントローラ。 - 【請求項１１】 前記転送手段は、前記伝送ＦＩＦＯが
前記ネットワークに伝送する間に、データのフレームを
前記伝送ＦＩＦＯに転送するための第１の手段を含む、
請求項１０記載のコントローラ。 - 【請求項１２】 前記伝送ＦＩＦＯはＳＴＡＲＴおよび
ＥＮＤポインタにより規定され、かつそれぞれ、前記伝
送ＦＩＦＯにデータを読出し、かつ前記伝送ＦＩＦＯか
らデータを書込むためのＲＥＡＤポインタおよびＷＲＩ
ＴＥポインタ、ならびに前記伝送ＦＩＦＯにストアされ
ている完全なフレームの終りを指すＳＨＡＤＯＷ ＷＲ
ＩＴＥポインタを含み、前記第１の検出器手段は、前記
ＳＨＡＤＯＷ ＷＲＩＴＥポインタが前記ＲＥＡＤポイ
ンタを超えるときを検出するための手段を含む、請求項
１０記載のコントローラ。 - 【請求項１３】 データしきい値をストアするレジスタ
を含み、かつ前記第２の検出器手段は前記伝送ＦＩＦＯ
の内容と前記データしきい値とを比較するための手段を
含む、請求項１０記載のコントローラ。 - 【請求項１４】 前記第２の検出器手段は前記データし
きい値と、前記ＲＥＡＤポインタと前記ＷＲＩＴＥポイ
ンタとの間の差とを比較するための手段を含む、請求項
１２記載のコントローラ。 - 【請求項１５】 システムメモリとネットワークバスと
の間の、パケットに配列されるデータのフローを制御す
る方法であって、 第１の論理先入先出メモリ（伝送ＦＩＦＯ）として第１
のメモリを構成するステップと、 ネットワークバスに対するデータの伝送のための要求を
検出するステップと、 前記ネットワークバスに対する伝送のための要求に応答
して、一度に１つのパケットずつデータを前記システム
メモリから前記伝送ＦＩＦＯに転送するステップと、 データが前記システムメモリから前記伝送ＦＩＦＯに入
ってくる間に、前記伝送ＦＩＦＯ内の前記データを前記
伝送ＦＩＦＯから前記ネットワークバスに転送するステ
ップとを含む、方法。 - 【請求項１６】 少なくとも１つのパケットの前記デー
タが前記伝送ＦＩＦＯ内に存在することを検出し、かつ
応答して、前記データを前記ネットワークバスに転送す
るステップをさらに含む、請求項１５記載の方法。 - 【請求項１７】 少なくとも予め定められた量のデータ
が前記第２のＦＩＦＯ内に存在することを検出し、かつ
応答して、前記データを前記ネットワークバスに転送す
るステップをさらに含む、請求項１５記載の方法。 - 【請求項１８】 少なくとも予め定められた量のデータ
が前記伝送ＦＩＦＯ内に存在することを検出し、かつ応
答して、少なくとも一つのパケットの前記データ、また
は少なくとも予め定められた量のデータのどちらかが伝
送ＦＩＦＯにストアされているとき、前記データを前記
ネットワークバスに転送するステップをさらに含む、請
求項１７記載の方法。 - 【請求項１９】 第２の論理先入先出メモリ（受信ＦＩ
ＦＯ）として第２のメモリを構成するステップと、 システムにストアされるべき、ネットワークから入って
くるデータを検出するステップと、 データを前記ネットワークから前記受信ＦＩＦＯに転送
するステップと、 前記ネットワークから前記受信ＦＩＦＯにストアされ
た、予め定められた量のデータを検出するステップと、
および応答し、 前記データを前記受信ＦＩＦＯから前記システムメモリ
に転送するステップとをさらに含む、請求項１５記載の
方法。 - 【請求項２０】 各々が待ち行列に配列され、かつ複数
個の異なる伝送優先順位を有するデータのフレームをス
トアするためのシステムメモリ手段を含む複数個のプロ
セッサ、および前記プロセッサにデジタルデータ通信経
路を形成する光学媒体を有するファイバディストリビュ
ーテッドデータインタフェース（ＦＤＤＩ）のためのネ
ットワークコントローラであって、 前記光学媒体にアクセスするための時間決めされたトー
クンデータプロトコルを実現する第１の手段と、出 力バッファを形成するランダムアクセスメモリと、前記ランダムアクセスメモリ内に、 それぞれ、前記複数
個の異なる伝送優先順位を有する前記待ち行列化された
データのフレームを、そこにストアするための複数個の
論理ＦＩＦＯを構成するための第２の手段と、 前記バッファメモリにおける対応する論理ＦＩＦＯに対
する前記フレーム化されたデータのフローを制御するた
めの手段とを含み、前記フレーム化されたデータフロー
制御手段は、優先順に一度に１つの待ち行列ずつ、前記
システムメモリ手段から前記バッファメモリにおける対
応する論理ＦＩＦＯへの前記フレーム化されたデータの
フローを、制御するための第１の手段と、データが前記
システムメモリ手段から前記バッファメモリ内の前記Ｆ
ＩＦＯに入ってくる間に、前記論理ＦＩＦＯにストアさ
れた前記フレーム化されたデータを前記媒体に伝送する
ための第２の手段とを含む、ネットワークコントロー
ラ。 - 【請求項２１】 少なくとも１つの完全なフレームの伝
送データが前記バッファメモリ内に存在することを検出
するための伝送フレーム検出手段と、前記伝送フレーム
検出手段に応答して、伝送データを前記媒体に転送する
ための手段とをさらに含む、請求項２０記載のネットワ
ークコントローラ。 - 【請求項２２】 少なくとも予め定められた量の伝送デ
ータが前記バッファ内に存在することを検出するための
データしきい値検出手段をさらに含み、かつ前記データ
しきい値検出手段に応答して前記データを前記媒体に転
送するための手段をさらに含む、請求項２０記載のコン
トローラ。 - 【請求項２３】 少なくとも予め定められた量の伝送デ
ータが前記バッファメモリ内に存在することを検出する
ためのデータしきい値検出手段をさらに含み、前記転送
手段は前記フレームに応答する手段と、少なくとも完全
なフレームのデータ、または少なくとも予め定められた
量のデータのどちらかが前記バッファメモリにあると
き、前記データを前記媒体に転送するためのデータしき
い値検出手段とを含む、請求項２１記載のコントロー
ラ。 - 【請求項２４】 各前記論理ＦＩＦＯはＳＴＡＲＴおよ
びＥＮＤポインタにより規定され、かつそれぞれ、前記
論理ＦＩＦＯからデータを書込み、かつ前記論理ＦＩＦ
Ｏからデータを書込むためのＲＥＡＤポインタおよびＷ
ＲＩＴＥポインタ、ならびに前記論理ＦＩＦＯにストア
される完全なレームの終りを指すＳＨＡＤＯＷ ＷＲＩ
ＴＥポインタを含み、かつ前記データフロー制御手段
は、前記ＳＨＡＤＯＷ ＷＲＩＴＥポインタが前記ＲＥ
ＡＤポインタを超えたときを検出するための手段を含
む、請求項２０記載のコントローラ。 - 【請求項２５】 データしきい値をストアするレジスタ
をさらに含み、かつ前記データフロー制御手段は前記論
理ＦＩＦＯの内容と前記データしきい値とを比較するた
めの手段を含む、請求項２４記載のコントローラ。 - 【請求項２６】 前記しきい値検出手段は、前記データ
しきい値と、前記ＲＥＡＤポインタと前記ＷＲＩＴＥポ
インタとの間の差とを比較するための手段を含む、請求
項２５記載のコントローラ。 - 【請求項２７】 媒体からの少なくとも予め定められた
量の受信データが前記論理ＦＩＦＯ内に存在することを
検出するための受信データしきい値検出手段をさらに含
み、かつ前記データフローコントローラ手段は、前記受
信データしきい値検出手段に応答して、前記論理ＦＩＦ
Ｏ内の前記受信データを前記システムメモリ手段に転送
するための手段を含む、請求項２０記載のコントロー
ラ。 - 【請求項２８】 前記システムメモリ手段と前記バッフ
ァメモリとの間の前記フレーム化されたデータのための
単一の信号フロー経路を確立する物理ＦＩＦＯメモリを
含む、請求項２０記載のコントローラ。 - 【請求項２９】 複数個のプロセッサを有し、各々が複
数個の異なる待ち行列に配列されるデータのフレームを
ストアするためのシステムメモリ手段を有し、各待ち行
列のフレームは他の待ち行列のデータのフレームの優先
順位とは異なる優先順位を有し、前記プロセッサにデジ
タルデータ通信経路を形成する光学媒体と、それぞれ、
媒体に伝送されるべきフレーム化されたデータの複数個
の待ち行列をストアするための複数個の論理先入先出
（ＦＩＦＯ）メモリ領域を有するように構成される出力
バッファメモリと、前記出力バッファメモリの前記論理
ＦＩＦＯメモリ領域にストアされる前記フレーム化され
たデータを前記媒体に伝送するための手段とを有するフ
ァイバディストリビューテッドデータインタフェース
（ＦＤＤＩ）ネットワークのための前記システムバスお
よび前記光学媒体とインタフェースする方法であって、 予め定められた状態に応答して、トークンを捕獲する
と、前記光媒体にアクセスするステップと、かつ応答し
て、 （ａ） 優先順に一度に１つの待ち行列ずつ前記フレー
ム化されたデータを、前記システムメモリ手段から前記
バッファメモリ内の対応する論理ＦＩＦＯに伝送し、 （ｂ） データが前記システムメモリ手段から前記論理
ＦＩＦＯに入ってくる間に、前記論理ＦＩＦＯにストア
されている前記フレーム化されたデータを前記媒体に伝
送することにより、 前記媒体に伝送されるべきフレーム化されたデータの動
きを制御するステップとを含む、システムバスおよび光
学媒体とインタフェースする、方法。 - 【請求項３０】 前記論理ＦＩＦＯは伝送および受信論
理ＦＩＦＯを含み、その方法は少なくとも１つの完全な
パケットの前記データの伝送ＦＩＦＯにおける存在を検
出し、かつ応答し、前記データを前記媒体に転送するス
テップをさらに含む、請求項２９記載の方法。 - 【請求項３１】 前記論理ＦＩＦＯは伝送および受信論
理ＦＩＦＯを含み、その方法は少なくとも予め定められ
た量のデータが前記伝送ＦＩＦＯ内に存在することを検
出し、かつ応答して、前記データを前記媒体に転送する
ステップをさらに含む、請求項２９記載の方法。 - 【請求項３２】 少なくとも予め定められた量のデータ
が前記伝送ＦＩＦＯ内に存在することを検出し、かつ応
答して、少なくとも前記データのパケット、または少な
くとも予め定められた量のデータのどちらかが前記伝送
ＦＩＦＯにストアされている時、伝送ＦＩＦＯ内の前記
データを前記媒体に転送するステップをさらに含む、請
求項３０記載の方法。 - 【請求項３３】 システムメモリ手段にストアされるべ
き、媒体から入ってくるデータを検出するステップと、 データを前記媒体から前記受信ＦＩＦＯに転送するステ
ップと、 前記媒体から前記受信ＦＩＦＯにストアされた予め定め
られた量のデータを検出するステップと、かつ応答し
て、前記受信ＦＩＦＯ内の 前記データを前記受信ＦＩＦＯか
ら前記システムメモリ手段に転送するステップをさらに
含む、請求項３１記載の方法。
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