JP3451995B2 - コンピュータシステムの入出力装置 - Google Patents
コンピュータシステムの入出力装置Info
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Description
【０００１】
【発明の属する技術分野】本発明は、コンピュータシス
テムの入出力装置に関し、特に、ＳＣＳＩインターフェ
ースをＩ／Ｏインターフェースとして用いて上位装置と
のデータ転送を行う場合に好適に利用できる入出力装置
に関する。
テムの入出力装置に関し、特に、ＳＣＳＩインターフェ
ースをＩ／Ｏインターフェースとして用いて上位装置と
のデータ転送を行う場合に好適に利用できる入出力装置
に関する。
【０００２】
【従来の技術】ホストコンピュータやワークステーショ
ンなどの小型コンピュータと、ハードディスクや光ディ
スク装置等の周辺機器とを接続するＩ／Ｏインターフェ
ースとしてＳＣＳＩインターフェースが知られている。
このＳＣＳＩインターフェースは、複数の周辺機器を混
在させて使用することができるため、コンピュータ装置
と周辺機器との接続に広く利用されている。
ンなどの小型コンピュータと、ハードディスクや光ディ
スク装置等の周辺機器とを接続するＩ／Ｏインターフェ
ースとしてＳＣＳＩインターフェースが知られている。
このＳＣＳＩインターフェースは、複数の周辺機器を混
在させて使用することができるため、コンピュータ装置
と周辺機器との接続に広く利用されている。
【０００３】このようなＳＣＳＩインターフェースを用
いたデータ転送処理において、データ転送の信頼性を向
上させるために、例えばターゲットからイニシエータ方
向へのデータ転送を行うに際して、データ転送のＲＥＱ
（リクエスト）パルスと同期させた転送データをターゲ
ットがイニシエータ側に送出し、イニシエータ側はデー
タを正常に受信した場合に、ターゲット側にＡＣＫ（ア
クノウレッジ）パルスを送出するといった方法が採られ
ている。
いたデータ転送処理において、データ転送の信頼性を向
上させるために、例えばターゲットからイニシエータ方
向へのデータ転送を行うに際して、データ転送のＲＥＱ
（リクエスト）パルスと同期させた転送データをターゲ
ットがイニシエータ側に送出し、イニシエータ側はデー
タを正常に受信した場合に、ターゲット側にＡＣＫ（ア
クノウレッジ）パルスを送出するといった方法が採られ
ている。
【０００４】
【発明が解決しようとする課題】しかしながら、ＳＣＳ
Ｉインターフェースでは複数の機器を接続しているため
入出力装置（ターゲット）と上位装置（イニシエータ）
間のデータ転送処理において、各機器の伝送特性の変化
に起因してインターフェースエラーが発生することが往
々にしてある。
Ｉインターフェースでは複数の機器を接続しているため
入出力装置（ターゲット）と上位装置（イニシエータ）
間のデータ転送処理において、各機器の伝送特性の変化
に起因してインターフェースエラーが発生することが往
々にしてある。
【０００５】このような伝送エラーの一つに、下位終了
による強制終了が行われる場合のインターフェースエラ
ーがある。すなわち、ターゲットからイニシエータ方向
へデータを転送する際に、イニシエータ側が指定したデ
ータ数よりもターゲット側から転送するデータ数が少な
く、転送データが尽きてしまういわゆる下位終了が発生
した場合に、ターゲットはＲＥＱパルス送出後、一定の
時間が経過するとデータ転送が正常に行われたか否かに
関わらず、自動的にデータ転送強制終了処理を実行して
しまう。
による強制終了が行われる場合のインターフェースエラ
ーがある。すなわち、ターゲットからイニシエータ方向
へデータを転送する際に、イニシエータ側が指定したデ
ータ数よりもターゲット側から転送するデータ数が少な
く、転送データが尽きてしまういわゆる下位終了が発生
した場合に、ターゲットはＲＥＱパルス送出後、一定の
時間が経過するとデータ転送が正常に行われたか否かに
関わらず、自動的にデータ転送強制終了処理を実行して
しまう。
【０００６】ここで、従来の入出力装置には、ＲＥＱパ
ルスに対するＡＣＫパルスの応答が確実に行われたこと
を確認する手段が設けられていないため、ターゲットか
らのＲＥＱパルスに対して、イニシエータからのＡＣＫ
パルスによる応答が一定時間以上遅れた場合に、ターゲ
ット側がＡＣＫパルスを受信する前に誤ってＳＣＳＩフ
ェーズを遷移してしまい、ＳＣＳＩインターフェースエ
ラーが生じる。
ルスに対するＡＣＫパルスの応答が確実に行われたこと
を確認する手段が設けられていないため、ターゲットか
らのＲＥＱパルスに対して、イニシエータからのＡＣＫ
パルスによる応答が一定時間以上遅れた場合に、ターゲ
ット側がＡＣＫパルスを受信する前に誤ってＳＣＳＩフ
ェーズを遷移してしまい、ＳＣＳＩインターフェースエ
ラーが生じる。
【０００７】また、従来の装置はターゲットが転送デー
タの正当性の確認を行う機能を持っていないため、下位
終了によりターゲットがデータ転送の強制終了処理を実
行した場合に、転送データが正常なものかどうかを判断
することができず、データ転送の信頼性に欠けるという
問題点もある。
タの正当性の確認を行う機能を持っていないため、下位
終了によりターゲットがデータ転送の強制終了処理を実
行した場合に、転送データが正常なものかどうかを判断
することができず、データ転送の信頼性に欠けるという
問題点もある。
【０００８】本発明は上記課題を解決すべくなされたも
のであり、上述したＳＣＳＩインターフェースエラーの
発生を防止し、転送データが正常であるか否かを判断す
ることによってＳＣＳＩインターフェースを介して行わ
れるデータ転送の信頼性を向上させるようにしたコンピ
ュータシステムの入出力装置を提供することを目的とす
る。
のであり、上述したＳＣＳＩインターフェースエラーの
発生を防止し、転送データが正常であるか否かを判断す
ることによってＳＣＳＩインターフェースを介して行わ
れるデータ転送の信頼性を向上させるようにしたコンピ
ュータシステムの入出力装置を提供することを目的とす
る。
【０００９】
【課題を解決するための手段】上記課題を解決するため
に、本発明の入出力装置は、インターフェースを介して
上位装置とデータ転送を行うコンピュータシステムの入
出力装置において、前記上位装置とのインターフェース
を制御する上位インターフェース制御回路と、前記上位
インターフェース制御回路で行うデータ転送を制御する
データ転送制御回路と、前記上位装置に送られるリクエ
ストパルス（ＲＥＱパルス）と、当該ＲＥＱパルスに応
じて前記上位装置から送られてくる応答パルス（ＡＣＫ
パルス）とのパルス数をカウントするＲＥＱ／ＡＣＫパ
ルス監視回路と、前記上位インターフェース制御回路の
動作を制御する入出力装置制御回路とを具え、前記デー
タ転送制御回路が前記上位装置から指定されたデータ数
と前記上位装置へ転送するデータのデータ数とをカウン
トして、上位装置から指定されたデータ数よりも転送デ
ータのデータ数が少ない場合に前記ＲＥＱ／ＡＣＫパル
ス監視回路で所定の時間内にカウントしたＲＥＱパルス
とＡＣＫパルスのパルス数をチェックして、当該パルス
数が同じである場合に前記インターフェース制御回路に
おけるデータ転送処理を強制終了させ、前記パルス数が
異なる場合に前記インターフェース制御回路におけるデ
ータ転送処理をエラー終了させるようにしたことを特徴
とする。
に、本発明の入出力装置は、インターフェースを介して
上位装置とデータ転送を行うコンピュータシステムの入
出力装置において、前記上位装置とのインターフェース
を制御する上位インターフェース制御回路と、前記上位
インターフェース制御回路で行うデータ転送を制御する
データ転送制御回路と、前記上位装置に送られるリクエ
ストパルス（ＲＥＱパルス）と、当該ＲＥＱパルスに応
じて前記上位装置から送られてくる応答パルス（ＡＣＫ
パルス）とのパルス数をカウントするＲＥＱ／ＡＣＫパ
ルス監視回路と、前記上位インターフェース制御回路の
動作を制御する入出力装置制御回路とを具え、前記デー
タ転送制御回路が前記上位装置から指定されたデータ数
と前記上位装置へ転送するデータのデータ数とをカウン
トして、上位装置から指定されたデータ数よりも転送デ
ータのデータ数が少ない場合に前記ＲＥＱ／ＡＣＫパル
ス監視回路で所定の時間内にカウントしたＲＥＱパルス
とＡＣＫパルスのパルス数をチェックして、当該パルス
数が同じである場合に前記インターフェース制御回路に
おけるデータ転送処理を強制終了させ、前記パルス数が
異なる場合に前記インターフェース制御回路におけるデ
ータ転送処理をエラー終了させるようにしたことを特徴
とする。
【００１０】このように構成することによって、下位終
了によりデータ転送の強制終了を実行する場合に、入出
力装置がＲＥＱパルスを送出した後、上位装置からのＡ
ＣＫパルスによる応答を確実に待って行うことができ
る。このため、上位装置がＡＣＫパルスを送出する前の
不定なタイミングでＳＣＳＩフェーズが誤って遷移する
ことによるＳＣＳＩインターフェースエラーの発生を防
止することができる。
了によりデータ転送の強制終了を実行する場合に、入出
力装置がＲＥＱパルスを送出した後、上位装置からのＡ
ＣＫパルスによる応答を確実に待って行うことができ
る。このため、上位装置がＡＣＫパルスを送出する前の
不定なタイミングでＳＣＳＩフェーズが誤って遷移する
ことによるＳＣＳＩインターフェースエラーの発生を防
止することができる。
【００１１】また、本発明の入出力装置は更に、前記上
位装置へ転送するデータの状態をチェックするデータチ
ェック回路を具え、前記インターフェース制御回路にお
けるデータ転送処理を強制終了させる場合に、更に前記
転送したデータの正当性をチェックして転送したデータ
の状態が正当なものであれば、前記上位インターフェー
ス制御回路におけるデータ転送処理を強制終了させ、前
記データ転送処理によって転送したデータの状態が正当
でない場合には前記上位インターフェース制御回路にお
けるデータ転送処理をエラー終了させることを特徴とす
る。
位装置へ転送するデータの状態をチェックするデータチ
ェック回路を具え、前記インターフェース制御回路にお
けるデータ転送処理を強制終了させる場合に、更に前記
転送したデータの正当性をチェックして転送したデータ
の状態が正当なものであれば、前記上位インターフェー
ス制御回路におけるデータ転送処理を強制終了させ、前
記データ転送処理によって転送したデータの状態が正当
でない場合には前記上位インターフェース制御回路にお
けるデータ転送処理をエラー終了させることを特徴とす
る。
【００１２】このように構成することによって、データ
転送を下位終了により強制終了する場合に、データが正
当であるか否かを確認して行うことができ、転送データ
の信頼性を向上させることができる。
転送を下位終了により強制終了する場合に、データが正
当であるか否かを確認して行うことができ、転送データ
の信頼性を向上させることができる。
【００１３】また、本発明の入出力装置は更に、前記Ｒ
ＥＱ／ＡＣＫパルス監視回路において一定時間内に前記
ＡＣＫパルスの応答がない場合にパルス監視時間のタイ
ムアウトを検出するタイマ手段を具え、当該タイマ手段
にてタイムアウトが検出された場合に、前記上位インタ
ーフェース制御回路におけるデータ転送処理をエラー終
了させることを特徴とする。
ＥＱ／ＡＣＫパルス監視回路において一定時間内に前記
ＡＣＫパルスの応答がない場合にパルス監視時間のタイ
ムアウトを検出するタイマ手段を具え、当該タイマ手段
にてタイムアウトが検出された場合に、前記上位インタ
ーフェース制御回路におけるデータ転送処理をエラー終
了させることを特徴とする。
【００１４】このように構成することによって、一定時
間内にＡＣＫパルスの応答がない場合には、エラー処理
が行われることになり、入出力装置全体における処理の
迅速化、およびデータ転送の信頼性の向上を図ることと
ができる。
間内にＡＣＫパルスの応答がない場合には、エラー処理
が行われることになり、入出力装置全体における処理の
迅速化、およびデータ転送の信頼性の向上を図ることと
ができる。
【００１５】また、本発明の入出力装置は更に、前記入
出力装置制御回路がメモリ手段を具え、前記パルス監視
タイマ手段がタイムアウトを検出したときの事象を前記
メモリ手段に記憶させることを特徴とする。
出力装置制御回路がメモリ手段を具え、前記パルス監視
タイマ手段がタイムアウトを検出したときの事象を前記
メモリ手段に記憶させることを特徴とする。
【００１６】このように構成することによって、メモリ
上の記録を後ほど読み出すことで、どのような場合にＡ
ＣＫパルスの応答が遅れるのかを検証し、データ転送性
能が低下する場合の事象を的確に把握することができ
る。
上の記録を後ほど読み出すことで、どのような場合にＡ
ＣＫパルスの応答が遅れるのかを検証し、データ転送性
能が低下する場合の事象を的確に把握することができ
る。
【００１７】また、本発明の入出力装置は、前記入出力
装置が下位インターフェースを介して下位装置に接続さ
れていると共に、当該下位インターフェースを制御する
下位インターフェース制御回路を具え、前記データ転送
制御回路が前記下位インターフェース制御回路と前記上
位インターフェース制御回路間のデータ転送を制御する
ように構成されていてもよい。
装置が下位インターフェースを介して下位装置に接続さ
れていると共に、当該下位インターフェースを制御する
下位インターフェース制御回路を具え、前記データ転送
制御回路が前記下位インターフェース制御回路と前記上
位インターフェース制御回路間のデータ転送を制御する
ように構成されていてもよい。
【００１８】また、本発明の入出力装置は、前記上位イ
ンターフェースがＳＣＳＩインターフェースである場合
に好適に利用できる。
ンターフェースがＳＣＳＩインターフェースである場合
に好適に利用できる。
【００１９】
【発明の実施の形態】本発明の実施の形態を添付の図面
を参照して詳細に説明する。図１は、本発明に係る入出
力装置の第１の実施形態の構成を示す図であり、図２
は、図１の装置におけるデータ転送動作を説明するため
のフローチャートである。図１に示すとおり、入出力装
置１は、インターフェース２１を介して上位装置（図示
せず）と、またインターフェース２２を介して下位装置
（図示せず）と接続されている。本例では、上位装置
（図示せず）との間のデータ転送にＳＣＳＩインターフ
ェース２１をＩ／Ｏインターフェースとして使用してい
る。
を参照して詳細に説明する。図１は、本発明に係る入出
力装置の第１の実施形態の構成を示す図であり、図２
は、図１の装置におけるデータ転送動作を説明するため
のフローチャートである。図１に示すとおり、入出力装
置１は、インターフェース２１を介して上位装置（図示
せず）と、またインターフェース２２を介して下位装置
（図示せず）と接続されている。本例では、上位装置
（図示せず）との間のデータ転送にＳＣＳＩインターフ
ェース２１をＩ／Ｏインターフェースとして使用してい
る。
【００２０】入出力装置１はＳＣＳＩインターフェース
２１を制御するＳＣＳＩインターフェース制御回路１１
と、下位装置とのデータ転送を行うインターフェース２
２を制御する下位インターフェース制御回路１２と、Ｓ
ＣＳＩインターフェース制御回路１１と下位インターフ
ェース回路１２間でのデータ転送を制御するダイレクト
転送制御回路１３と、ＳＣＳＩインターフェース制御回
路１１の動作を制御する入出力装置制御回路１４と、割
り込みが発生した場合に割り込み発生信号を前記入出力
制御回路１４に送る割り込み制御回路１５とを具える。
２１を制御するＳＣＳＩインターフェース制御回路１１
と、下位装置とのデータ転送を行うインターフェース２
２を制御する下位インターフェース制御回路１２と、Ｓ
ＣＳＩインターフェース制御回路１１と下位インターフ
ェース回路１２間でのデータ転送を制御するダイレクト
転送制御回路１３と、ＳＣＳＩインターフェース制御回
路１１の動作を制御する入出力装置制御回路１４と、割
り込みが発生した場合に割り込み発生信号を前記入出力
制御回路１４に送る割り込み制御回路１５とを具える。
【００２１】更に、入出力装置１は、ＳＣＳＩインター
フェース２１とＳＣＳＩインターフェース制御回路１１
との間に設けられデータ転送の状態を監視するＲＥＱ／
ＡＣＫパルス監視回路１６と、やはり、ＳＣＳＩインタ
ーフェース２１とＳＣＳＩインターフェース制御回路１
１との間に設けられデータ転送終了時にデータエラーの
有無をチェックするデータチェック回路１７を具える。
なお、入出力制御回路１４は、ＲＥＱ／ＡＣＫパルス監
視回路１６と、データチェック回路１７にも接続されて
いる。
フェース２１とＳＣＳＩインターフェース制御回路１１
との間に設けられデータ転送の状態を監視するＲＥＱ／
ＡＣＫパルス監視回路１６と、やはり、ＳＣＳＩインタ
ーフェース２１とＳＣＳＩインターフェース制御回路１
１との間に設けられデータ転送終了時にデータエラーの
有無をチェックするデータチェック回路１７を具える。
なお、入出力制御回路１４は、ＲＥＱ／ＡＣＫパルス監
視回路１６と、データチェック回路１７にも接続されて
いる。
【００２２】ダイレクト転送制御回路１３は、ＳＣＳＩ
インターフェース制御回路１１と下位インターフェース
制御回路１２間のデータ転送の制御を行う。また、ダイ
レクト転送制御回路１３は、転送するデータ数をカウン
トするカウンタを具え、転送データ数をカウントして上
位装置から指定されたデータ数より入出力装置１から上
位装置へ転送したデータ数が少ない場合に、下位終了を
検出して割り込み制御回路１５へ“ＤＡＴＡ ＳＨＯＲ
Ｔ信号”出力する。
インターフェース制御回路１１と下位インターフェース
制御回路１２間のデータ転送の制御を行う。また、ダイ
レクト転送制御回路１３は、転送するデータ数をカウン
トするカウンタを具え、転送データ数をカウントして上
位装置から指定されたデータ数より入出力装置１から上
位装置へ転送したデータ数が少ない場合に、下位終了を
検出して割り込み制御回路１５へ“ＤＡＴＡ ＳＨＯＲ
Ｔ信号”出力する。
【００２３】割り込み制御回路１５では、この”ＤＡＴ
Ａ ＳＨＯＲＴ信号”を受けて“ＤＡＴＡ ＳＨＯＲＴ
割り込み信号”を入出力装置制御回路１４に送る。
Ａ ＳＨＯＲＴ信号”を受けて“ＤＡＴＡ ＳＨＯＲＴ
割り込み信号”を入出力装置制御回路１４に送る。
【００２４】ＲＥＱ／ＡＣＫパルス監視回路１６では入
出力装置１から上位装置へ送られるＲＥＱパルス数と上
位装置から入出力装置１へ送られてくるＡＣＫパルス数
とをカウントして、両者のパルス数が等しい場合にその
旨を表示すると共に、ＲＥＱパルスとＡＣＫパルスの各
々のパルス数を表示する。
出力装置１から上位装置へ送られるＲＥＱパルス数と上
位装置から入出力装置１へ送られてくるＡＣＫパルス数
とをカウントして、両者のパルス数が等しい場合にその
旨を表示すると共に、ＲＥＱパルスとＡＣＫパルスの各
々のパルス数を表示する。
【００２５】データチェック回路１７は、データ転送が
終了したときにデータエラーの有無をチェックしてそれ
を表示すると共に、データエラーが生じている場合はそ
のエラー内容を表示する。
終了したときにデータエラーの有無をチェックしてそれ
を表示すると共に、データエラーが生じている場合はそ
のエラー内容を表示する。
【００２６】入出力装置制御回路１４は、割り込み制御
回路１５から”ＤＡＴＡ ＳＨＯＲＴ割り込み信号”を
受け取ると、パルス監視回路１６に対してＲＥＱパルス
とＡＣＫパルスの両者のパルス数が等しいか否かの確認
を行って、等しければＳＣＳＩインターフェース制御回
路１１にデータ転送強制終了を指示し、等しくない場合
にはエラー終了を指示する。また、ＲＥＱパルスとＡＣ
Ｋパルスのパルス数が等しくデータ転送強制終了を指示
した場合は、データチェック回路１７に対してデータ転
送にエラーがあったか否かを確認し、エラーがなく正当
にデータ転送処理が行われた場合にはＳＣＳＩインター
フェース制御回路１１をリセットし、エラーが生じた場
合はエラー終了処理を指示する。
回路１５から”ＤＡＴＡ ＳＨＯＲＴ割り込み信号”を
受け取ると、パルス監視回路１６に対してＲＥＱパルス
とＡＣＫパルスの両者のパルス数が等しいか否かの確認
を行って、等しければＳＣＳＩインターフェース制御回
路１１にデータ転送強制終了を指示し、等しくない場合
にはエラー終了を指示する。また、ＲＥＱパルスとＡＣ
Ｋパルスのパルス数が等しくデータ転送強制終了を指示
した場合は、データチェック回路１７に対してデータ転
送にエラーがあったか否かを確認し、エラーがなく正当
にデータ転送処理が行われた場合にはＳＣＳＩインター
フェース制御回路１１をリセットし、エラーが生じた場
合はエラー終了処理を指示する。
【００２７】次に、図２を参照して、本発明の第１の実
施形態の入出力装置１におけるデータ転送動作を説明す
る。まず、ＳＣＳＩインターフェース２１においてター
ゲットからイニシエータ方向へのデータ転送が起動され
る（ステップ２０１）。このデータ転送処理実行中にイ
ニシエータが指定したデータ数よりも先に転送データが
尽きてしまい、いわゆる下位終了が発生すると、ダイレ
クト転送制御回路１３がこの下位終了を検出し、割り込
み制御回路１５に”ＤＡＴＡ ＳＨＯＲＴ信号”を通知
する。この信号を受けた割り込み制御回路１５は、”Ｄ
ＡＴＡ ＳＨＯＲＴ割り込み信号”を入出力装置制御回
路１４に通知する（ステップ２０２）。
施形態の入出力装置１におけるデータ転送動作を説明す
る。まず、ＳＣＳＩインターフェース２１においてター
ゲットからイニシエータ方向へのデータ転送が起動され
る（ステップ２０１）。このデータ転送処理実行中にイ
ニシエータが指定したデータ数よりも先に転送データが
尽きてしまい、いわゆる下位終了が発生すると、ダイレ
クト転送制御回路１３がこの下位終了を検出し、割り込
み制御回路１５に”ＤＡＴＡ ＳＨＯＲＴ信号”を通知
する。この信号を受けた割り込み制御回路１５は、”Ｄ
ＡＴＡ ＳＨＯＲＴ割り込み信号”を入出力装置制御回
路１４に通知する（ステップ２０２）。
【００２８】この通知を受けた入出力装置制御回路１４
は、ＲＥＱ／ＡＣＫパルス監視回路１６に対して、所定
の時間内におけるＲＥＱパルスとＡＣＫパルスの両パル
ス数が同じであるか否かを確認する（ステップ２０
３）。ここでＲＥＱパルスとＡＣＫパルスが同数であれ
ば（ステップ２０３、ＹＥＳ）、入出力装置制御回路１
４は、ＳＣＳＩインターフェース制御回路１１にデータ
転送の強制終了を指示する（ステップ２０４）。また、
ＲＥＱパルスとＡＣＫパルスが異なる場合（ステップ２
０３、ＮＯ）は、所定時間の経過を待って（ステップ２
０７）、エラー終了を指示する。
は、ＲＥＱ／ＡＣＫパルス監視回路１６に対して、所定
の時間内におけるＲＥＱパルスとＡＣＫパルスの両パル
ス数が同じであるか否かを確認する（ステップ２０
３）。ここでＲＥＱパルスとＡＣＫパルスが同数であれ
ば（ステップ２０３、ＹＥＳ）、入出力装置制御回路１
４は、ＳＣＳＩインターフェース制御回路１１にデータ
転送の強制終了を指示する（ステップ２０４）。また、
ＲＥＱパルスとＡＣＫパルスが異なる場合（ステップ２
０３、ＮＯ）は、所定時間の経過を待って（ステップ２
０７）、エラー終了を指示する。
【００２９】データ転送強制終了が正常に終了したら、
入出力装置制御回路１４はデータチェック回路１７から
転送したデータが正当であるかどうかの確認を行い、エ
ラーがなければ（ステップ２０５、ＮＯ）、更にダイレ
クト転送制御回路１３のカウンタから表示されるデータ
転送数と、ＲＥＱ／ＡＣＫパルス監視回路１６のカウン
タに表示されるデータ転送数の比較を行い、データ転送
数が等しいことを確認して、ＳＣＳＩインターフェース
制御回路１１にＳＣＳＩインターフェース制御回路１１
内部のデータ転送回路のリセット指示を行い（ステップ
２０６）、ターゲットからイニシエータ方向へのデータ
転送処理における下位終了によるデータ転送の強制終了
処理を終了する。また、ステップ２０５において、デー
タチェック回路１７が転送データにエラーを検出した場
合は（ステップ２０５、ＹＥＳ）、データ転送強制終了
処理をエラー終了させる。
入出力装置制御回路１４はデータチェック回路１７から
転送したデータが正当であるかどうかの確認を行い、エ
ラーがなければ（ステップ２０５、ＮＯ）、更にダイレ
クト転送制御回路１３のカウンタから表示されるデータ
転送数と、ＲＥＱ／ＡＣＫパルス監視回路１６のカウン
タに表示されるデータ転送数の比較を行い、データ転送
数が等しいことを確認して、ＳＣＳＩインターフェース
制御回路１１にＳＣＳＩインターフェース制御回路１１
内部のデータ転送回路のリセット指示を行い（ステップ
２０６）、ターゲットからイニシエータ方向へのデータ
転送処理における下位終了によるデータ転送の強制終了
処理を終了する。また、ステップ２０５において、デー
タチェック回路１７が転送データにエラーを検出した場
合は（ステップ２０５、ＹＥＳ）、データ転送強制終了
処理をエラー終了させる。
【００３０】図３は、本発明に係る入出力装置の第２の
実施形態の構成を示す図である。図３に示すように、第
２の実施形態の入出力装置３０は、ＲＥＱ／ＡＣＫパル
ス監視回路１６と割り込み制御回路１５との間にＲＥＱ
／ＡＣＫパルス監視タイマ３１を設けて、入出力装置か
ら出されたＲＥＱパルスに対して一定時間以上ＡＣＫパ
ルスの応答がない場合に割り込み制御回路１５にタイム
アウトを報告するようにしている。
実施形態の構成を示す図である。図３に示すように、第
２の実施形態の入出力装置３０は、ＲＥＱ／ＡＣＫパル
ス監視回路１６と割り込み制御回路１５との間にＲＥＱ
／ＡＣＫパルス監視タイマ３１を設けて、入出力装置か
ら出されたＲＥＱパルスに対して一定時間以上ＡＣＫパ
ルスの応答がない場合に割り込み制御回路１５にタイム
アウトを報告するようにしている。
【００３１】このＲＥＱ／ＡＣＫパルス監視タイマ３１
には、比較的小さなタイマ値が設定されており、設定し
た時間内にＲＥＱパルスに対するＡＣＫパルスの応答が
なかった場合にタイムアウトを検出して、割り込み制御
回路１４にタイムアウト信号を送る。割り込み制御回路
１５は、このタイムアウト信号を受けると、入出力装置
制御回路１４に割り込みを通知し、この割り込みを受け
た入出力制御回路１４は、ＳＣＳＩインターフェース制
御回路１１にエラー信号を送り、インターフェース制御
回路１１ではエラー終了を実行する。したがって、何ら
かの原因でＡＫＣパルスの応答がなされなかった場合
に、装置全体の処理が促進される。
には、比較的小さなタイマ値が設定されており、設定し
た時間内にＲＥＱパルスに対するＡＣＫパルスの応答が
なかった場合にタイムアウトを検出して、割り込み制御
回路１４にタイムアウト信号を送る。割り込み制御回路
１５は、このタイムアウト信号を受けると、入出力装置
制御回路１４に割り込みを通知し、この割り込みを受け
た入出力制御回路１４は、ＳＣＳＩインターフェース制
御回路１１にエラー信号を送り、インターフェース制御
回路１１ではエラー終了を実行する。したがって、何ら
かの原因でＡＫＣパルスの応答がなされなかった場合
に、装置全体の処理が促進される。
【００３２】また、本実施形態では、入出力装置制御回
路１４にメモリ３２を接続して、上記タイムアウトが生
じた時の事象をメモリ３２上に記録するようにしてい
る。メモリ３２上の記録を後ほど読み出すことで、どの
ような場合にＡＣＫパルスの応答が遅れるのかを検証す
ることが可能となり、データ転送性能が低下する場合の
事象を常に監視することができる。この性能低下は例え
ば、データ転送中ということで多重処理を行い、その時
の処理に問題があり、ファームウェアによるデータ転送
終了の確認が遅れ、最後のＡＣＫパルスのネゲートが遅
れてしまう場合に発生する性能低下をさす。尚、ＲＥＱ
／ＡＣＫパルス監視タイマ３１とメモリ３２以外の構成
は第１の実施形態の構成と同様であるので、図１に使用
した符号と同じ符号を付してその説明はここでは省略す
る。
路１４にメモリ３２を接続して、上記タイムアウトが生
じた時の事象をメモリ３２上に記録するようにしてい
る。メモリ３２上の記録を後ほど読み出すことで、どの
ような場合にＡＣＫパルスの応答が遅れるのかを検証す
ることが可能となり、データ転送性能が低下する場合の
事象を常に監視することができる。この性能低下は例え
ば、データ転送中ということで多重処理を行い、その時
の処理に問題があり、ファームウェアによるデータ転送
終了の確認が遅れ、最後のＡＣＫパルスのネゲートが遅
れてしまう場合に発生する性能低下をさす。尚、ＲＥＱ
／ＡＣＫパルス監視タイマ３１とメモリ３２以外の構成
は第１の実施形態の構成と同様であるので、図１に使用
した符号と同じ符号を付してその説明はここでは省略す
る。
【００３３】図４は、図３に示す第２実施形態の入出力
装置における動作処理のフローチャートである。パルス
監視回路１６にてＡＣＫパルスの応答がなく（ステップ
２０８、ＮＯ）、応答のない状態が監視タイマ３１に設
定したタイマ値を越えて、ＲＥＱ／ＡＣＫパルス監視タ
イマ３１がタイムアウトを検出した場合（ステップ２０
９、ＹＥＳ）、入出力装置制御回路１４は、割り込み制
御回路１５からのタイムアウト割り込み信号を受けてＳ
ＣＳＩインターフェース制御回路１１にエラー終了信号
を出力する。一方、設定したタイマ値内に、ＡＣＫパル
スの応答があった場合（ステップ２０８、ＹＥＳ）、Ｒ
ＥＱ／ＡＣＫパルス監視回路１６がパルス数の監視を続
けて、図２で説明したステップ２０３以降の処理を行
う。なお、ステップ２０１〜２０７までの処理は、第１
実施形態における処理と同様であるのでここではその説
明は省略する。
装置における動作処理のフローチャートである。パルス
監視回路１６にてＡＣＫパルスの応答がなく（ステップ
２０８、ＮＯ）、応答のない状態が監視タイマ３１に設
定したタイマ値を越えて、ＲＥＱ／ＡＣＫパルス監視タ
イマ３１がタイムアウトを検出した場合（ステップ２０
９、ＹＥＳ）、入出力装置制御回路１４は、割り込み制
御回路１５からのタイムアウト割り込み信号を受けてＳ
ＣＳＩインターフェース制御回路１１にエラー終了信号
を出力する。一方、設定したタイマ値内に、ＡＣＫパル
スの応答があった場合（ステップ２０８、ＹＥＳ）、Ｒ
ＥＱ／ＡＣＫパルス監視回路１６がパルス数の監視を続
けて、図２で説明したステップ２０３以降の処理を行
う。なお、ステップ２０１〜２０７までの処理は、第１
実施形態における処理と同様であるのでここではその説
明は省略する。
【００３４】
【発明の効果】上述のように、本発明の入出力装置によ
れば、ＳＣＳＩインターフェースを介して行うターゲッ
トからイニシエータ方向へのデータ転送を下位終了によ
り強制終了させる場合に、ＡＣＫパルスの応答が確実に
行われたか否かを確認することができる。従って、ＡＣ
Ｋパルス送出前の不定なタイミングでのＳＣＳＩインタ
ーフェースの遷移によるＳＣＳＩインターフェースエラ
ーの発生を効果的に防止することができる。
れば、ＳＣＳＩインターフェースを介して行うターゲッ
トからイニシエータ方向へのデータ転送を下位終了によ
り強制終了させる場合に、ＡＣＫパルスの応答が確実に
行われたか否かを確認することができる。従って、ＡＣ
Ｋパルス送出前の不定なタイミングでのＳＣＳＩインタ
ーフェースの遷移によるＳＣＳＩインターフェースエラ
ーの発生を効果的に防止することができる。
【００３５】また、下位終了によりデータ転送強制終了
を実行した場合に、転送データが正当であるか否かの確
認することが可能となるため、転送データの信頼性を向
上させることができる。
を実行した場合に、転送データが正当であるか否かの確
認することが可能となるため、転送データの信頼性を向
上させることができる。
【図１】図１は、本発明に係る入出力装置の第１の実施
形態の構成を示す図である。
形態の構成を示す図である。
【図２】図２は、図１の装置におけるデータ転送動作を
説明するためのフローチャートである。
説明するためのフローチャートである。
【図３】図３は、本発明に係る入出力装置の第１の実施
形態の構成を示す図である。
形態の構成を示す図である。
【図４】図４は、図３の装置におけるデータ転送動作を
説明するためのフローチャートである。
説明するためのフローチャートである。
１、３０ 入出力装置
１１ ＳＣＳＩインターフェース制御回路
１２ 下位インターフェース制御回路
１３ ダイレクト転送制御回路
１４ 入出力装置制御回路
１５ 割り込み制御回路
１６ ＲＥＱ／ＡＣＫパルス監視回路
１７ データチェック回路
２１ ＳＣＳＩインターフェース
２２ 下位インターフェース
３１ ＲＥＱ／ＡＣＫパルス監視タイマ
３２ メモリ
フロントページの続き
(58)調査した分野(Int.Cl.7，ＤＢ名)
G06F 13/00
G06F 13/10 - 13/14
Claims (6)
- 【請求項１】 インターフェースを介して上位装置とデ
ータ転送を行うコンピュータシステムの入出力装置にお
いて、前記上位装置とのインターフェースを制御する上
位インターフェース制御回路と、前記上位インターフェ
ース制御回路で行うデータ転送を制御するデータ転送制
御回路と、前記上位装置に送られるリクエストパルス
（ＲＥＱパルス）と、当該ＲＥＱパルスに応じて前記上
位装置から送られてくる応答パルス（ＡＣＫパルス）と
のパルス数をカウントするＲＥＱ／ＡＣＫパルス監視回
路と、前記上位インターフェース制御回路の動作を制御
する入出力装置制御回路とを具え、前記データ転送制御
回路が前記上位装置から指定されたデータ数と前記上位
装置へ転送するデータのデータ数とをカウントして、上
位装置から指定されたデータ数よりも転送データのデー
タ数が少ない場合に前記ＲＥＱ／ＡＣＫパルス監視回路
で所定の時間内にカウントしたＲＥＱパルスとＡＣＫパ
ルスのパルス数をチェックして、当該パルス数が同じで
ある場合に前記インターフェース制御回路におけるデー
タ転送処理を強制終了させ、前記パルス数が異なる場合
に前記インターフェース制御回路におけるデータ転送処
理をエラー終了させるようにしたことを特徴とするコン
ピュータシステムの入出力装置。 - 【請求項２】 請求項１に記載の入出力装置において、
前記入出力装置が更に、前記上位装置へ転送するデータ
の状態をチェックするデータチェック回路を具え、前記
インターフェース制御回路におけるデータ転送処理を強
制終了させる場合に、更に前記転送したデータの正当性
をチェックして転送したデータの状態が正当なものであ
れば、前記上位インターフェース制御回路におけるデー
タ転送処理を強制終了させ、前記データ転送処理によっ
て転送したデータの状態が正当でない場合には前記上位
インターフェース制御回路におけるデータ転送処理をエ
ラー終了させることを特徴とするコンピュータシステム
の入出力回路。 - 【請求項３】 請求項１又は２に記載の入出力装置にお
いて、前記入出力装置が更に、前記ＲＥＱ／ＡＣＫパル
ス監視回路において一定時間内に前記ＡＣＫパルスの応
答がない場合にパルス監視時間のタイムアウトを検出す
るタイマ手段を具え、当該タイマ手段にてタイムアウト
が検出された場合に、前記上位インターフェース制御回
路におけるデータ転送処理をエラー終了させることを特
徴とするコンピュータシステムの入出力装置。 - 【請求項４】 請求項３に記載の入出力装置において、
前記入出力装置制御回路がメモリ手段を具え、前記パル
ス監視タイマ手段がタイムアウトを検出したときの事象
を前記メモリ手段に記憶させることを特徴とするコンピ
ュータシステムの入出力装置。 - 【請求項５】 請求項１ないし４のいずれかに記載の入
出力装置において、前記入出力装置が下位インターフェ
ースを介して下位装置に接続されていると共に、当該下
位インターフェースを制御する下位インターフェース制
御回路を具え、前記データ転送制御回路が前記下位イン
ターフェース制御回路と前記上位インターフェース制御
回路間のデータ転送を制御することを特徴とするコンピ
ュータ装置の入出力装置。 - 【請求項６】 請求項１ないし５のいずれかに記載の入
出力装置において、前記上位インターフェースがＳＣＳ
Ｉインターフェースであることを特徴とするコンピュー
タシステムの入出力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27329299A JP3451995B2 (ja) | 1999-09-27 | 1999-09-27 | コンピュータシステムの入出力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27329299A JP3451995B2 (ja) | 1999-09-27 | 1999-09-27 | コンピュータシステムの入出力装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2001101090A JP2001101090A (ja) | 2001-04-13 |
| JP3451995B2 true JP3451995B2 (ja) | 2003-09-29 |
Family
ID=17525830
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27329299A Expired - Fee Related JP3451995B2 (ja) | 1999-09-27 | 1999-09-27 | コンピュータシステムの入出力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3451995B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100429267B1 (ko) * | 2001-11-27 | 2004-04-29 | 엘지전자 주식회사 | 외부기기 전송 인식 오류 처리장치와 방법 |
-
1999
- 1999-09-27 JP JP27329299A patent/JP3451995B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP2001101090A (ja) | 2001-04-13 |
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