JP3405619B2 - 無線受信機 - Google Patents

無線受信機

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JP3405619B2
JP3405619B2 JP10755595A JP10755595A JP3405619B2 JP 3405619 B2 JP3405619 B2 JP 3405619B2 JP 10755595 A JP10755595 A JP 10755595A JP 10755595 A JP10755595 A JP 10755595A JP 3405619 B2 JP3405619 B2 JP 3405619B2
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    • H04N21/2383Channel coding or modulation of digital bit-stream, e.g. QPSK modulation
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  • Television Receiver Circuits (AREA)
  • Superheterodyne Receivers (AREA)

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明はディジタル様式内に残留
側波帯情報の検出に関するもので、特にディジタル高品
位テレビジョン(HDTV:High−Definit
ion Television)信号無線受信機に関す
るものである。
【0002】
【従来の技術】HDTV信号の送信に利用される残留側
波帯(Vestigal Sideband:VSB)
信号は変調率により振幅が変換し、前記変調率に相応す
る固定振幅を有するパイロット搬送波により代替可能な
それら固有の搬送波を有する。このようなVSB信号
は、例えば米国で無線放送に利用可能であり、有線放送
システムにも利用可能である。このような有無線信号を
受信するディジタルHDTV信号無線受信機は提案さ
れ、本発明のような受信機は同期検出後にチューナ内で
二重変換をする。周波数合成器は第1の中間周波数(例
えば、920MHz搬送波)を発生するために受信され
たTV信号でヘテロダインされる第1局部発振を発生す
る。受動LC帯域フィルタは第1中間周波数増幅器によ
って増幅のための映像周波数からこのような第1中間周
波数を選択し、前記増幅した第1中間周波数は隣接した
チャネル応答を防ぐ第1弾性表面波(SAW)フィルタ
によってフィルタされる。前記第1中間周波数は第2中
間周波数(例えば、41MHz搬送波)を発生するため
に第2局部発振にヘテロダインされ、第2SAWフィル
タは第2中間周波数増幅器により増幅のための残留隣接
したチャネル応答と映像からこのような第2中間周波数
を選択する。前記第2中間周波数増幅器の応答は固定周
波数を有する第3局部発振により基底帯でシンクロダイ
ンされる。
【0003】固定周波数を有する前記第3局部発振は0
°と90°位相同期内に供給され、同相と直角位相同期
検出の手続が進まれる。HDTV信号が送信されると
き、前記同相同期検出の結果としてディジタル記号は8
レベル符号化され、前記直角同期検出の結果としてディ
ジタル記号は普通零の値とする。アナログ方式で発生し
た、分離されディジタル変換される同相と直角位相同期
検出の結果で、ディジタル変換後に相互に明らかに予想
される前記同期検出の結果に対する問題が提示される。
この問題は、量子化雑音がフェーザーとみなされる複合
信号内に顕著な位相誤差が移入されるということであ
る。この点は前記ディジタル方式内に同相と直角位相同
期検出の手続が進行されることにより、既に提案された
本形態のHDTV信号無線受信機内で解消される。
【0004】一例として、前記同相と直角位相同期検出
手続はディジタル変換されるとき8レベル符号化のナイ
キスト周波数の2倍で前記第2中間周波数増幅器の応答
をサンプル化することによって実行される。連続サンプ
ルは発生順序で一連番号を付けるようになる。しかし、
偶数サンプルと奇数サンプルは同相(または実数)と直
角位相(または虚数)同期検出の結果のうちそれぞれ一
つを発生するようにそれぞれから分離される。
【0005】前記ディジタル同相同期検出結果で8レベ
ル符号化はNTSC信号から共同チャネル(co−ch
annel)を干渉しないようにフィルタされ、等化フ
ィルタリングを条件とする。この等化フィルタ応答は格
子(トレリス)デコーダに入力信号として提供される。
この格子デコーダの応答はデータデインタリーバに入力
信号として供給され、デインタリーブされたデータはリ
ードソロモンデコーダに提供される。誤差が修正された
データはパケットデコーダのためのデータのパケットを
再生するデータデランダマイザ(derandomiz
er)に提供される。選択されたパケットは前記HDT
Vプログラムのオーディオ部分を再生するのに利用さ
れ、他の選択されたパケットは前記HDTVプログラム
のビデオ部分を再生するのに利用される。
【0006】前記同相と直角位相同期検出手続で利用さ
れた、前記シンクロダイン(synchrodyin
g)を遂行するために、前記直角位相同期検出の結果は
前記第2の局部発振を発生する制御発振器のための自動
周波数位相制御(AFPC)信号をデベロプするのに利
用される。前記直角位相同期検出結果を最小化するため
に、前記ディジタル直角位相同期検出結果は前記第2の
局部発振の位相と周波数を調節するAFPC信号を発生
するように低域でフィルタされる。
【0007】
【発明が解決しようとする課題】しかし、実際にこのよ
うな自動周波数位相制御は前記同相同期検出結果に所望
の程度の位相安定性を提供するのに不適当である。前記
ディジタル変換された同相同期検出結果の不適応等化フ
ィルタリングは前記同相と直角位相同期検出手続の間に
利用されるシンクロダインに固定位相誤差を修正できる
が、前記等化フィルタリングのフィルタ係数内に非適応
変換は非常に遅いので、前記HDTV信号のマルチパス
受信時に速い変換をする間に発生する位相誤差の変換ま
たは前記AFPC帰還ループ内に位相ジッタに対して補
償することができない。
【0008】
【課題を解決するための手段】したがって、上記提案さ
れた本発明のHDTV信号受信機において、位相トラッ
カ(tracker)はディジタル変換された同相同期
検出結果の等化フィルタリングと従属接続される。前記
等化された同相同期検出結果はヒルベルト変形有限イン
パルス応答フィルタにディジタル変換された形態で供給
される。このヒルベルト変形FIRフィルタの待ち時間
(latency)を補償するために遅延されたFIR
フィルタの応答と前記等化された同相同期検出は、複素
数積を発生するために複素数乗数信号によって乗算され
るように、複素数乗算器に実数入力信号と虚数入力信号
として印加される。帰還ループは前記複素数乗数信号と
して利用されるユニットオイラ−ベクトルの位相角を調
節するために、誤差信号をデベロプするための零の値か
ら複素数積の虚数部分を確実に退去させる。このユニッ
トオイラ−ベクトルの実数値と虚数値は前記誤差信号を
調整するのに利用さる累算器の出力によって伝達された
読出専用メモリ(ROM)に貯蔵されたサイン/コサイ
ンルックアップテーブル(LUT:Look−Up T
able)から類推される。前記位相トラッカは前記ヒ
ルベルト変形FIRフィルタが位相偏移の要求条件90
°をほぼ零の周波数の近くに提供するために非常に多い
タップを有しなければならないという問題をもたらす。
【0009】本発明者はこのHDTV信号無線受信機を
変形させ、第2中間周波数を前記第2局部発振に変形さ
せるために前記第1中間周波数とヘテロダインされる前
記第2局部発振は固定周波数を有する。したがって、制
御発振器の前記AFPC帰還ループ内に位相ジッタは前
記第2局部発振器を発生する過程で問題として除去され
る。第2局部発振は前記第2中間周波数のための搬送周
波数から固定周波数残留偏差(オフセット)で発生され
る。そこで、前記第2局部発振は前記第2中間周波数を
帯域に下向変換するために前記第1中間周波数にシンク
ロダインされるよりは、第2中間周波数に前記第2中間
周波数を下向変換するために前記第1中間周波数にヘテ
ロダインする。そのとき、前記第2中間周波数は基底帯
よりはかえって帯域アナログディジタル変換器でディジ
タル変換される。そして、残りの検出手続は前記ディジ
タル方式で実行される。前記第2中間周波数は、継続し
て前記HDTV信号のマルチパスの受信時に速い変換を
する間に発生される位相誤差の変換をもたらし、位相ト
ラッカは依然として必要となる。この位相トラッカは複
合同期検出の間に前記第2中間周波数で実行され、した
がって先行技術の受信機の場合と同様に、前記位相トラ
ッカは複合同期検出と等化フィルタリング後に実行する
よりは等化フィルタリング以前に実行される。前記位相
トラッカは先行技術の受信機で利用された帯域(または
低域)位相トラッカよりは帯域位相トラッカである。
【0010】前記帯域位相トラッカで利用された前記同
相と直角位相サンプリング手続は対称側波帯構造を有す
るディジタル変換した帯域信号の複合同期検出のために
既に利用された先行手続から類推される。無線放送のた
めのHDTV信号は両側波帯増幅(DSB)変調信号と
いうよりは残留側波帯(VSB)増幅変調信号である。
前記帯域の位相トラッカ内に誤差信号をデベロプするた
めに使用される、前記HDTV信号の複合同期検出は前
記VSB信号の非対称側波帯構造内に含まれる対称側波
帯構造に応答して帯幅を十分に制限される。前記8レベ
ル(又は16レベル)のVBS符号化を再生するための
前記HDTV信号の同期検出は帯域幅の制限を多く受け
ることはない。
【0011】前記側波帯位相トラッカに利用される前記
同相と直角位相サンプリング手続は、一般に例えば「I
EEE TRANSACTIONS ON AEROS
PACE AND ELECTRONIC SYSTE
MS,Vol.AES−18,No.4(1982年1
1月)、pp736−739」“Quadrature
Sampling with High Dynam
ic Range”という論文で、D.W.Riceと
K.H.Wuにより記述された手続と類似している。R
iceとWuは前記帯域信号の最高周波数要素によるこ
とではなく、前記帯域信号の帯域幅によって決定される
ナイキスト速度あるいはそれ以上にディジタル変換前な
サンプリングされる必要があると指摘する。直角位相同
期検出は前記ディジタル変換された帯域信号でヒルベル
ト変形FIRフィルタを利用して実行される。反面、同
相同期検出は前記ヒルベルト変形FIRフィルタの待ち
時間と同一な補償遅延以後に実行される。RiceとW
uは、ディジタル変換された帯域信号で複合同期検出を
遂行することにより混合器によって移入されて直接要素
が前記帯域フィルタによって抑圧され、ディジタル変換
に影響を与えないという長所を有する。帯域形態でディ
ジタル変換されたVSB信号の複合同期検出において、
部分的に抑圧された搬送波から発生される前記複合同期
検出の直接要素は本発明に重要な混合器に移入される直
接要素によって影響を受けることはない。
【0012】本発明において、本発明者はRiceとW
uにより開示された長所と同様の、ディジタル変換され
た帯域信号というよりはヒルベルトのディジタル変換さ
れた帯域信号に長所を認知した。前記ヒルベルト変形F
IRフィルタは位相偏移(フェーズ シフト)90°を
提供するが、非常に長い遅延が要求されるという点で、
これ以上零周波数に近く位相偏移90°を提供しない。
前記ヒルベルト変形FIRフィルタは、ただし、遅延要
求が節度ある、1MHzまたは2MHz以上、8MHz
乃至7MHz以下の位相偏移90°のみを提供しなけれ
ばならない。前記フィルタに要求された最上の応答周波
数と最低応答周波数との間の多少小さい比率はフィルタ
に要求されるタップの数字を若干少なく維持する。
【0013】本発明はディジタル信号を表示した記号コ
ードを含むVSB信号を受信するための無線受信機で実
行され、HDTV信号はそのようなVSB信号の典型的
な例である。チューナは前記VSB信号を送信するため
に使用された周波数帯域に異なる位置でチャネルのうち
一つのチャネルを選択するために提供する。また、前記
チューナは実際に零の周波数以上の一番低い周波数でア
ナログディジタル変換器によりディジタル変換された最
後の中間周波数信号に前記選択されたチャネルの複数変
換を遂行するための混合器等を含む。前記搬送周波数を
中心とする前記ディジタル変換された最後の中間周波数
信号の狭帯域フィルタされた部分で作動する位相トラッ
カは、周波数変換をする間に使用された局部発振で位相
非干渉性(incoherency)あるいはマルチパ
ス歪みから発生される、前記最後の中間周波数信号の虚
数部分を抑圧する。前記位相トラッカにディジタル制御
発振器は同期検出器に前記最後の中間周波数信号の実数
部分のための搬送波のディジタル表示値を供給し、前記
同期検出器は搬送波の他のディジタル表示値と一致して
前記ディジタル変換された最後の中間周波数信号の実数
部分を検出する。
【0014】本発明また他の側面は、AGC回路が前記
ディジタル変換された最後の中間周波数信号の狭帯域フ
ィルタされた部分に相応するVSB信号を受信するため
の無線受信機の前記中間周波数増幅器に対する自動利得
制御(AGC)回路である。
【0015】
【実施例】本発明による多様な実施例を添付の図面をも
ってより詳細に説明する。図1は放送受信アンテナ6か
らディジタルHDTV信号を受信するためのVSB無線
受信機5を示す。前記受信機5はキネスコープ7のため
にレッド(R)、グリーン(G)、ブルー(B)の色の
駆動信号を再生させ、左側拡声器8と右側拡声器9を駆
動させるために立体音信号を再生させる。その代りに、
前記VSB信号受信機5は有線放送受信アンテナあるい
は有線伝送システムからディジタルHDTV信号を受信
するために連結され得る。キネスコープ7の代わりに他
の表示装置が使用可能で、前記音響再生システムは単に
単一オーディオチャネルのみで構成され、あるいは単純
な立体音再生システムより精巧である。
【0016】要素11〜21を含むチューナ1は、もし
放送受信アンテナ6によって捕えた前記ディジタルHD
TV信号のような、前記受信されたVSB信号のための
前記周波数帯域内の異なる位置にチャネルのうちいずれ
か一つを選択し、最後の周波数帯域で前記選択されたチ
ャネルを最後の中間周波数信号への複数周波数変換をす
る。さらに重要な点は、人間によって作動さるように設
計されたチャネルセレクタ10は第1局部発振器として
機能をする周波数合成器11が前記放送受信アンテナ6
あるいは他のディジタルHDTV信号ソースから供給さ
れる、受信された信号にヘテロダインされるために第1
混合器12に供給する第1局部発振の周波数を決定す
る。前記第1混合器12は前記第1中間周波数(例え
ば、920MHz搬送波)で前記選択されたチャネル内
の前記受信された信号を上向変換(アップコンバート)
し、LCフィルタ13は前記第1混合器12から提供さ
れる前記上向変換された結果を伴う望ましくない映像周
波数を阻むのに利用される。前記上向変換から発生され
る前記第1中間周波数は第1表面弾性波(SAW)フィ
ルタ15を駆動させるために増幅した第1中間周波数を
供給する第1中間周波数増幅器14に入力信号として供
給される。多少高周波への第1中間周波数前記上向変換
は多数の極と零を有するSAWフィルタリングを活性化
させる。第2局部発振器16から第2局部発振は第2中
間周波数(例えば、41MHz搬送波)を発生させるた
めに、前記第1SAWフィルタ15に対する応答にヘテ
ロダインされるための第2混合器17に供給される。第
2SAWフィルタ18は前記第2混合器17から供給さ
れた前記上向変換の結果を随伴する前記望ましくない映
像周波数を阻むのに利用される。前記第2SAWフィル
タ18の応答は第2中間周波数増幅器19に入力信号と
して提供され、前記増幅された第2中間周波数信号応答
は第3局部発振器21から発振にヘテロダインされるよ
うに第3混合器20に入力信号として提供される。前記
第3混合器20が既に提案された零周波数の搬送波に基
底帯信号よりは1MHz−2MHzの周波数以下に拡大
される前記残留側波帯にそして7MHz−8MHzの周
波数まで拡大される全側波帯に、第3中間周波数信号の
応答を提供できるほどに前記第3局部発振器21からの
発振周波数が選択されるということを除いては、先に説
明されたような前記複数変換チューナ1は他の人により
既に提案された他のチューナと類似する。このような第
3中間周波数信号応答は、前記チューナ1の前記最後の
中間周波数入力信号である。
【0017】アナログディジタル変換器(ADC)22
は前記チューナ1の前記最後の中間周波数入力信号をサ
ンプルとし、前記それぞれのアナログサンプルはこれ以
上望ましくない折返し(エリアシング)を防ぐために、
前記最高最後の中間周波数は半サイクルより長く持続さ
れなく、10ビットまたはその程度の解像度を有するデ
ィジタルサンプルに前記サンプルをディジタル変換す
る。通常に、前記ADC22に含まれる前記低域フィル
タは前記第3混合器20から前記第3中間周波数信号応
答の前記高周波映像を抑圧する。前記第2のSAWフィ
ルタ18はディジタル変換される前記ADC22に提示
された前記第3中間周波数信号の帯域幅を制限して、前
記ADC22は帯域アナログディジタル変換器として機
能をする。ディジタル変換を行う間に、前記ADC22
によって利用された前記サンプル速度は少なくともHD
TV信号において6MHzの前記帯域信号の帯域幅にお
いて前記ナイキスト速度で、HDTV信号において6M
Hzである。実際に、本発明者は秒当りの約21.10
6 サンプル、あるいはVSB HDTV信号の記号速度
に約2倍のサンプル速度をよく使用する。“アイ(ey
e)”応答を最大限にするために、前記記号速度で前記
ADC22により前記サンプリングを同期化するための
回路を調節するように、前記VSB HDTV信号は前
記記号速度の2倍にサンプリングされる。この回路が図
1で明確に図示せずが、適切な回路は図11についての
本明細書でさらに説明されるであろう。
【0018】同相同期検出器23は零周波数搬送波で基
底帯で変換された前記受信されたVSB信号に相応する
応答を供給するために、前記ADC22の前記ディジタ
ル変換された最後の中間周波数出力信号に相応する。前
記ディジタルフィルタ24は有限インパルス応答(FI
R)型をもって対称カーネルを有することで、前記フィ
ルタ24は線形位相となる。帯域フィルタ24の応答は
前記搬送波周波数で中心に位置し、その応答に搬送波自
体、そのそれぞれに抑圧される程度の狭小な帯域幅を有
する。前記チューナ1に前記狭帯域フィルタリングと前
記自動利得制御(図1に明確に図示せず)は、前記狭帯
域フィルタ24の応答に再生された前記パイロット搬送
波が制御された増幅を有することにする。このフィルタ
24に起される前記側波帯構造は、搬送周波数において
本来対称される。前記フィルタ24の応答は直角位相同
期検出器25に供給される。前記同期検出器25の応答
は低域フィルタ26に印加され、この応答はディジタル
制御発振器(DCO)27の自動周波数と位相制御(A
FPC)のために使用される。また、前記ディジタル制
御発振器は“数学的に制御された発振器”と知られてい
る。前記DCO27は前記位相同期検出器23に同相搬
送波のディジタル(コサイン)表示値を提供し、前記D
CO27の検出器は基本的に前記DCO27から提供さ
れる前記ディジタル変換された同相搬送波により、前記
ADC22の応答を乗算するためのディジタル乗算器で
ある。また、前記DCO27は前記直角位相同期検出器
25に直角位相搬送波のディジタル(サイン)表示値を
供給し、前記DCO27は前記DCO27のAFPCの
ために使用される前記帰還ループ内誤差信号をデベロプ
するように前記狭帯域フィルタ24によって選択された
前記パイロット搬送波と比較される。前記低域フィルタ
26は前記直角位相同期検出器25から誤差信号に搬送
波調波を抑圧する。直角位相同期検出器25が基本的に
前記DCO27から提供された前記ディジタル変換され
た直角位相搬送波により、狭帯域フィルタ24の応答を
乗算するためのディジタル乗算器のときのみ、前記調波
が発生する。実際に、入力信号に対する狭帯域フィルタ
24の応答には一部の遅延または待ち時間が存在し、こ
のような遅延は図1に明らかに図示せず装置により、前
記位相同期検出器23の作動で補償される。例えば、前
記フィルタ24の待ち時間と同じ遅延は入力信号として
前記ADC22から前記ディジタル変換された最後のI
F信号を前記位相同期検出器23に印加する接続に挿入
可能である。
【0019】図1のVSB信号受信機に同相同期検出器
23の前記基底帯応答はクロックド遅延線28に対する
入力信号として、そして2入力ディジタル加算器29に
第1サメンド(summand)入力信号として印加さ
れる。前記クロック遅延線28は12個の記号エポク
(epoch)と同一の遅延以後に入力信号に対する応
答を提供して、遅延された応答は第2サメンド入力信号
として前記ディジタル加算器29に印加される。前記ク
ロック遅延線28と前記ディジタル加算器29は相互に
加えてNTSC信号から同一チャネル干渉を抑圧するた
めのNTSC阻止フィルタ30を提供する。前記NTS
C阻止フィルタ30はコームフィルタ(櫛形フィルタ)
であり、NTSC信号がディジタルHDTV信号と同一
のチャネル配分に伝送される間に要求される。前記フィ
ルタ30は前記NTSC輝度搬送波を抑圧し、シンクロ
ダインする情報を含む低周波数側波帯は非常に強く色
(カラー)副搬送波を阻んで、前記(クロミナンス)側
波帯を抑圧し、そして前記FMオーディオ搬送波を抑圧
する。前記フィルタ30は前記検出器23から8コーデ
ィングレベルのディジタル同相同期検出結果に対する応
答に、等化器31に15コーディングレベル信号を提供
する。確実に示していないが、前記等化フィルタ31に
前記入力信号はサンプル速度を記号速度に減らすために
2:1でデシメート(decimate)される。前記
等化フィルタ応答は前記ディジタルデータストリームを
再生する前記記号デコーディングを遂行する格子デコー
ダ32に入力信号として前記等化器31から提供され
る。前記等化器31は、調節された増幅応答が相互記号
干渉から結果で招来される記号誤差を最小化する前記格
子デコーダ32に印加される前記複数レベルコーディン
グに対する調節された増幅応答を発生する等化フィルタ
リングを提供する。
【0020】図1に明確に示されていないが、望ましい
回路がNTSC信号から同一チャネルが干渉されるとき
を感知し、NTSC信号から何らの同一チャネル干渉も
感知しないとき、前記フィルタ30をバイパスとして使
用し、予想されるコーディングレベルの数と一致して記
号デコーディング範囲を調節するために前記VSB信号
受信機5に提供される。15コーディングレベルが認知
されるときよりは8コーディングレベルが認知されると
き、前記識別に対する誤りの多い判定はほぼ発生するこ
とない。データ同期化回路は図1に明確に図示しない
が、前記ディジタルHDTV技術に熟練した技術者はデ
ータ領域とデータ線がタイミングデータデインタリービ
ングを調節するための基礎を提供するようになるときを
判定するための回路を含むことが理解できる。前記等化
器31が本発明者の望ましい形態をもち、前記形態がゴ
ースト消去基準信号に対する前記等化器31の応答に従
って増幅応答の帰還調節をすると仮定すると、データ領
域同期化回路は前記等化器31の出力部分から入力信号
を取る。データ領域の始めは前記等化器31のためのゴ
ースト消去基準として役割をする疑似ランダムパルス列
によって信号を送る。この等化器31の入力信号より前
記等化器31の応答として存在するとき、データ線の始
めを信号で示す前記記号コードシーケンスの発生を検索
するデータ線同期化回路は発明者によってよく用いられ
る。そのようなデータ線同期化回路は前記格子デコーダ
32が記号デコーディングのために使用する同一の回路
のレベルを決定するのに使用可能である。
【0021】格子デコーダ32の応答はデータインタリ
ーバ33に入力信号として提供され、前記デインタリー
ブされたデータは前記データデインタリーバ33からリ
ードソロモンデコーダ34に提供される。誤差修正され
たデータは前記リードソロモンデコーダ34からパケッ
ト整列器(パケット ソータ)36のためにデータパケ
ットを再生するデータデランダム抽出器(デランダマイ
ザ)35に提供される。前記パケット整列器36はデー
タ連続パケット内にヘッダコードに応答して異なって印
加されたるためにデータパケットを分類する。前記HD
TVプログラムのオーディオ部分を表示するデータパケ
ットはディジタル映像デコーダ37に前記パケット整列
器36によって印加される。前記ディジタル映像デコー
ダ37は前記多数の拡声器8及び9を駆動させる複数チ
ャネルオーディオ増幅器38に対する左側チャネルと右
側チャネルの立体音信号を供給する。前記HDTVプロ
グラムのビデオ部分を表示したデータパケットはMPE
Gデコーダ39に前記パケット整列器36によって印加
される。前記MPEGデコーダ38は前記キネスコープ
7のタイミングスクリーンまたは異なる表示装置のラス
タ走査のために提供するキネスコープ偏向回路40に水
平(H)と垂直(V)同期信号を供給する。また、前記
MPEGデコーダ39はキネスコープは7または異なる
表示装置に増幅したレッド(R)、グリーン(G)、そ
してブルー(B)色駆動信号を印加するために、前記キ
ネスコープ駆動増幅器41に信号を提供する。
【0022】前記狭帯域フィルタ24の応答は絶対値回
路に供給可能で、そのときに招来される印加された信号
はディジタル変換して低域でフィルタ可能で、その結果
で招来される低域フィルタの応答は前記IF増幅器14
及び18共に、あるいはその単一利得を調節するための
自動利得制御(AGC)信号を供給するようにアナログ
形態で変換可能である。これはその応答として、狭帯域
フィルタ24によって選択された前記ディジタル変換さ
れた搬送波の増幅をこのような過程で調節する。
【0023】図1の他の前記VSB信号受信機におい
て、前記狭帯域フィルタ24の応答は対称的に方形波の
ディジタル表示値を発生するようにクリップされる。前
記フィルタ24が2の補数計算にあると仮定すると、こ
の過程は次のように行われる。多重ビットフィルタ24
応答の最上位ビットは前記ディジタル対称的なクリッパ
の2ビット3元(ternary)応答に上位ビットと
して保存され、前記多重ビットフィルタ22応答の下位
ビットは前記ディジタル対称クリッパの2ビット3重応
答に下位ビットを発生させるように論理和(OR)され
る。
【0024】AFPC信号のための前記低域フィルタ2
4はすべてのディジタル制御発振器デザインに設置され
るが、多少障害を発生しDCO27の出力信号の周波数
と位相を制御する前記帰還ループの応答に遅延を取り入
れる。尚、前記帰還ループは所望の非条件的に安定した
状態よりは望ましくない条件的に安定しない状態にある
ことができる。このとき、本発明の望ましい実施例にお
いて但し実数信号で同相と直角位相同期検出を実行する
ためのシンプルディジタル乗算器は複合信号に位相と直
角位相同期検出を遂行するために使用されることはな
い。RiceとWuにより記述された前記同相と直角位
相サンプリング技術は、前記VBS信号の同期検出に利
用するために採択される。複合可変形態を使用する前記
同相と直角位相同期検出を遂行することで、前記同期検
出の結果で発生される搬送調波の発生はなくなる。
【0025】図2は本発明の他の実施例であって、VS
B信号の前記同期検出を実行するための変形された装置
を示す。前記アナログディジタル変換器22からディジ
タル変換された最後のIF信号は前記第3混合器20の
応答のヒルベルト変形を提供するFIRディジタルフィ
ルタ50に入力信号として提供される。また、前記AD
C22から前記ディジタル変換された最後のIF信号は
遅延線51が前記ディジタルフィルタ50の待ち時間と
同一の補償遅延を提供する、ディジタル遅延線51に入
力信号として提供される。前記ディジタルフィルタ50
と前記ディジタル遅延線51の応答はそれぞれ搬送帯域
フィルタ52及び53に入力信号として供給される。帯
域特徴を有する前記フィルタ52及び53は前記ディジ
タル遅延線51と前記ディジタルフィルタ50の応答に
よって形成された前記複合信号の8レベルVSBコーデ
ィングに従って変形された搬送側波帯から前記複合パイ
ロット搬送波を分離させる。前記ディジタルフィルタ5
0と前記ディジタル遅延線51の応答はそれぞれ搬送波
帯域フィルタ52及び53の待ち時間と同一なそれぞれ
の補償遅延を提供するディジタル遅延線54及び55に
入力信号として供給される。
【0026】前記ディジタル遅延線54及び55から供
給される複合信号のための同相同期検出器230はそれ
ぞれ搬送波のサインとコサインにより前記遅延線54と
55から供給される反応を乗算するためのディジタル乗
算器231及び232と、前記ディジタル乗算器231
と232から積信号を加算するためのディジタル加算器
233とを備える。既に複合積の虚数項は常に零値とな
り、あるいは実際に零値となると知られているので、前
記虚数項を発生するように要求される前記ディジタル乗
算器と減算器は必須的である。前記加算器233から加
算信号に提供される前記同相同期検出器230の出力信
号は入力信号として前記NTSC阻止フィルタ26に印
加される。
【0027】直角位相同期検出器250はそれぞれ搬送
波のサインとコサインにより搬送帯域フィルタ52及び
53の応答を乗算するためのディジタル乗算器251及
び252と、そして前記ディジタル乗算器252の積信
号から前記ディジタル乗算器251の積信号を減算する
ためのディジタル減算器253とを備える。すなわち、
搬送波帯域フィルタ52及び53によって提供される分
離されたパイロット搬送波の複合ディジタル表示値は前
記直角位相搬送波の複合ディジタル表示値によって乗算
される。複素積(complex product)の
実数項は常に零値となり、または実際に零値と既に知ら
れているので、そこで前記実数項を発生するように要求
される前記ディジタル減算器と加算器は必需的である。
前記減算器253から差出力信号は前記DCO27にA
FPC信号を提供する。
【0028】図2に示す前記ディジタル制御発振器27
は前記ディジタル乗算器231及び252に12ビット
被乗数を提供するための読出し専用メモリ271で搬送
波サインΦルックアップテーブルと、前記ディジタル乗
算器231及び251に12ビット被乗数を提供するた
めの読出し専用メモリ272に搬送波コサインΦルック
アップテーブルと、そしてROM271及び272のた
めのROMアドレス発生器とを備える。このようなアド
レス発生器は前記ROMアドレスのための累算器を完成
するための前記加算器273の第1サメンド入力とし加
算出力信号を印加するために、前記加算出力信号にクロ
ックされた単一サンプル遅延要素274として前記RO
MアドレスをROM271及び272に供給する入力デ
ィジタル加算器273を含む。2入力ディジタル加算器
2751は前記ROMアドレス累算をシステムクロック
サイクルに増加するために前記加算器273の前記第2
サメンド入力に加算出力信号を提供する。前記サスンΦ
とコサインΦ被乗数が、そのとき連続搬送波サンプルに
さらに高い角度分解能を提供する。Φの2πラジアンを
有する非常に多くの数のサンプルを有し、前記ROM2
71及び272から提供されるので、前記複数変換チュ
ーナ1は望ましく最後のIF信号周波数帯域の高周波数
部分よりは前記ADC22に供給された最後のIF信号
周波数帯域の低周波数部分に前記VSB信号搬送波をヘ
テロダインする。
【0029】ROM271及び272から直角関連同期
位相に供給された、前記DCO27の発振で誤差の不在
で、AFPC誤差信号として供給される前記減算器25
3から前記加算出力信号は零値となることであろう。前
記減算器253から前記加算出力信号は前記加算器27
5の第1サメンド入力に供給されるが、零値となっても
前記加算器275から前記加算出力信号に何ら影響しな
い。前記加算器275から加算出力信号はクロックされ
た単一サンプル遅延要素277による単一サンプルによ
って遅延された、また、他のディジタル加算器276か
ら加算出力信号の第2サメンド入力に供給される信号と
同一の信号となる。前記減算器253から前記加算出力
信号は固定被乗数を乗算するための乗数入力信号として
ディジタル乗算器278に供給され、さらに前記乗数の
入力信号が零値となることにより、前記ディジタル乗算
器278から前記積出力信号は零値となる。前記ディジ
タル乗算器278から前記積出力信号は、前記加算器2
76の第1サメンド入力に供給されるが、零値となって
も前記加算器276から加算出力信号に何らの影響もし
ないことであろう。前記加算器276から加算出力信号
は前記クロックされた単一サンプル遅延要素277によ
って単一サンプルを遅延された、前記加算器276から
加算出力信号のサンプル値と同一になる。前記加算器2
53の加算出力から前記APEC信号が零値の間に、前
記加算器276のループ接続と前記クロックされた単一
サンプル遅延要素277は前記加算器275の第2サメ
ンド入力と前記加算器273の第2サメンド入力に同一
の増加(インクリメント)を継続して供給する回路遅延
線メモリを形成する。ROMアドレスまで継続して徐々
に変化するサイクルを再開するようにオーバフローが発
生するまで、前記加算器273の加算出力から前記RO
Mアドレスは継続して値が変化する。
【0030】前記加算器253の加算出力から前記AP
EC信号が正の値であるとき、これは前記ROM271
と272から直角関連同期位相に供給される、前記DC
O27の発振が適正値から位相が遅延されることを示
す。前記APEC信号が零値のとき、前記実数AFPC
信号は前記加算器275の前記第1サメンド入力に印加
され、これは加算器273の加算出力から供給される前
記ROMアドレスを遅く変化する地点からすぐ前に向け
るか前進するかして、前記単一サンプル遅延要素を通じ
て前記加算器273の前記第1サメンド入力に再度フィ
ードされる前記アドレスのため、前記変化が持続され
る。この正のAFPC信号は前記固定した被乗数を乗算
するために前記ディジタル乗算器278に乗数入力信号
として印加され、前記固定被乗数は小さいので小さい正
積出力信号は前記加算器276の前記第1サメンド入力
に印加するために前記ディジタル乗算器278によって
発生される。前記加算器276のループ接続と前記クロ
ックされた単一サンプル遅延要素277によって形成さ
れたサイクル遅延線メモリに貯蔵される増分の大きさを
増加させながら、小さい値を有する前記第1サメンド入
力信号は前記加算器276から加算出力信号を増加させ
る。このようなさらに大きい増分は前記加算器275の
前記第2サメンド入力と前記加算器273の前記第2サ
メンド入力に単一サンプル遅延後に前記クロックされた
単一サンプル遅延要素277に印加される。このような
増加された増分は前記加算器273による前記第1サメ
ンド入力に付加する前記加算出力信号をさらにフィード
する前記単一サンプル遅延要素274のアドレス累算速
度を増加させる。ROMアドレスを継続して変化するサ
イクルを再開するようにオーバフローが発生されるま
で、出力から前記ROMアドレスは継続してその値が変
化され、さらにこの変化は前記AFPC信号の非零値が
アドレス累算速度を一層変更するまで増加した累算速度
を増加させる。
【0031】前記加算器253の加算出力から前記AF
PC信号が負値のとき、これは前記ROM271及び2
72から直角関連同期位相に提供される前記DCO27
の発振が適正値から位相内で前進することを示す。前記
負値AFPC信号は前記加算器275の第1サメンド入
力に印加され、前記AFPC信号が零値のとき、前記加
算出力信号の値が増加するようになる。これは加算器2
73の前記加算出力から供給される前記ROMアドレス
が徐々に変化する地点から直ちに後退するか後に向け
て、前記単一サンプル遅延要素274を通じて前記加算
器273の前記第1サメンド入力にさらにフィードされ
るアドレスのために前記変化は継続される。前記負値A
FPC信号は前記固定した被乗数を乗算するための前記
ディジタル乗算器278に乗数入力信号として印加さ
れ、前記AFPC信号の前記固定信号は小さいので、結
局小さい負積出力信号が前記加算器276の前記第1の
サメンド入力に印加するために前記ディジタル乗算器2
78によって発生される。前記クロックされた単一サン
プル遅延要素277と前記加算器276のループ接続に
よって形成された前記回路遅延線メモリに貯蔵される増
分の大きさを減らしつつ、小さい値を有する前記第1の
サメンド入力信号は前記加算器276から加算出力信号
を減少させる。このようなさらに小さい増分は前記加算
器275の前記第2サメンド入力と前記加算器273の
前記第2サメンド入力に単一サンプルの遅延後、前記ク
ロックされた単一サンプル遅延要素277によって印加
される。このような減少した増分は前記第1サメンド入
力に前記加算器の前記加算出力信号を再度フィードする
単一サンプル遅延要素274と前記加算器273により
アドレス累算速度を遅くする。前記加算器273の加算
出力から他のROMアドレスが継続して徐々に変化する
サイクルを再開するようにオーバフローされるまで継続
して値が変化し、また前記変化は前記AEPC信号の非
零値がアドレス累算速度を一層変更するまで前記減少し
た累算速度を減少させる。
【0032】図3は次の側面で図2の装置と本発明のま
た他の実施例であって、VSB信号の同期検出を遂行す
るための他の変形された装置を示す。前記搬送帯域フィ
ルタ52及び53は前記ADC22から前記ディジタル
変換されたIF信号を入力信号として受信し、応答を得
るためにディジタル変換された搬送波を選択する単一搬
送波の狭帯域フィルタ56において必需的である。前記
フィルタ56は前記フィルタ56の応答ヒルベルト変形
を提供するFIRディジタルフィルタ57に入力信号と
して提供される。また、前記フィルタ56応答は前記デ
ィジタルフィルタ56の待ち時間と同一の補償遅延を提
供するディジタル信号線58に入力信号として提供され
る前記直角位相同期検出器250に接続は変更されて、
結局前記ディジタル乗算器251及び252はそれぞれ
前記搬送帯域フィルタ52及び53の応答よりは前記デ
ィジタルフィルタ57と前記ディジタル遅延線58の応
答を増加させる。
【0033】遅延反応がディジタル遅延線59によって
提供されるADC22から前記ディジタル変換された最
後のIF信号に対する遅延応答は、前記FIRディジタ
ルフィルタ50と前記ディジタル遅延線51に入力信号
として印加される。前記FIRディジタル信号50と前
記ディジタル遅延線51の応答は、それぞれの被乗数信
号として前記ディジタル乗算器231と前記ディジタル
乗算器232に直接に印加される前記ディジタル遅延線
59は前記フィルタ50と前記遅延線51共の応答に前
記搬送帯域フィルタ56の待ち時間に対する補償遅延を
提供する。このフィルタ50と前記遅延線51に前記単
一遅延線59は前記フィルタ50と前記遅延線51が図
2で提供された後、それぞれの従属接続に連結される前
記2本の遅延線54及び55と同一の応答を提供する。
【0034】図4は次の側面で前記図2の装置とは他の
本発明による実施例で、VSB信号の前記同期検出を実
行するための非常に異なって変形された装置を示す。前
記搬送波帯域フィルタ52及び53はそれぞれ結線接続
に代替される。図2に搬送帯域フィルタ52及び53の
待ち時間と同一のそれぞれの補償遅延を提供する、前記
ディジタル遅延線54及び55はそれぞれの結線接続に
よってそれぞれ代替される。前記直角位相検出器259
は零値に、あるいは零に近い周波数にヘテロダインされ
る特徴を有する前記AFPC低域ディジタルフィルタ5
8を利用する前記加算器253の加算出力信号から選択
されることにより、多少広帯域で作動される。前記低域
フィルタ58は記号速度より低く縮小した周波数を有し
ており、結局連続類似記号集団と連結される周波数は阻
む。変圧器で記号コーディング以前段階にデータランダ
ム抽出(ランダマイゼーション)はAEPC信号を再生
するための直角位相同期検出以後に低域フィルタリング
を調節する存在可能な連続フィルタリング類似記号の数
を制限する。また、このデータランダム抽出は図2また
は図3のそれぞれにAEPC信号を再生するために直角
位相同期検出以前に帯域を助長する。
【0035】図2と図3及び図4に示した前記DCO2
7の単一の相互に異なる形態は2つの入力加算器273
及び275が単一の3つの入力ディジタル加算器によっ
て代替されるDCOである。前記サインとコサイン機能
で対称に依存する多くのトリック(trick)はサイ
ンΦとコサインΦテーブルルックアップのために要求さ
れたROMの量を減少するための熟練したディジタル設
計者に知られており、前記DCO27はそのような縮小
したROMデザインを利用するために変形可能である。
前記サインΦとコサインΦの信号がROMから読み出さ
れないが、−sin (A+B)= sinA cosB+ cosA s
inBと− cos(A+B)= cosA cosB− sinA sinB
との三角法公式により平行に累算される配置は本発明の
また他の実施例で、前記DCO27の変形に利用され得
るまた他のDCO配置である。
【0036】図5は図2と図3に示したVSB信号の前
記同期検出を実行するための装置の他の形態を示すが、
この装置はサイン(Φ+α)ルックアップテーブルを貯
蔵する読出し専用メモリ2701とコサイン(Φ+α)
ルックアップテーブルを貯蔵する読出し専用メモリ27
02が含まれることで、前記DCO27と異なるDCO
270を利用する。前記ディジタル乗算器231は前記
ROM271よりは前記ROM2701から乗数信号を
受信する。しかし、前記ディジタル乗算器232は前記
ROM272よりは前記ROM2702から乗数信号を
受信する。前記ADC22から前記ディジタル変換され
た最後のIF信号は実数遅延なしに結線接続を通じて前
記ヒルベルト変換FIRフィルタ50に入力信号として
印加される。そして、前記フィルタ50の応答は実数遅
延なしに結線接続を通じて被乗数入力信号に前記ディジ
タル乗算器231に印加される。前記ADC22から前
記ディジタル変換された最後のIF信号は実数遅延なし
に結線接続を通じて前記ディジタル遅延線51に入力信
号として印加される。そして、前記遅延線51の応答は
何等の実数遅延なしに接続によって被乗数入力信号に前
記ディジタル乗算器231に印加される。
【0037】すなわち、図5は前記遅延線54及び55
がそれぞれの結線接続によって代替されるという点で図
2と異なる。前記ディジタル乗算器231及び232に
印加された前記被乗数信号を遅延させるために前記遅延
線54及び55を利用する代わりに、前記被乗数信号は
前記ROM2701及び2702に貯蔵された前記サイ
ン(Φ+α)とコサイン(Φ+α)ルックアップテーブ
ルから前記信号を取ることにより、間に合って進む。図
5は前記ディジタル遅延線59が結線接続によって代替
されるという図3と異なる。前記ディジタル乗算器23
1及び232に印加された前記被乗数信号を遅延させる
ために前記ディジタル遅延線59を利用する代わりに、
前記被乗数信号は前記ROM2701及び2702に貯
蔵されたサイン(Φ+α)とコサイン(Φ+α)から前
記信号を取ることで向上する。αが90°である特殊の
場合、サイン(Φ+α)とコサイン(Φ+α)の値がそ
れぞれ前記271から読み出された前記サインΦの負値
と前記ROM272から読み出された前記コサイン値と
同一なので、勿論ROM2701及び2702は要求さ
れることはない。
【0038】たとえ、複合同期検出に従属された前記最
後の中間周波数信号としてディジタル信号を表示する記
号コードを含むVSB信号を受信するために、特に前記
無線受信機が第3中間周波数信号をデベロプするために
前記3重変換チューナ1を使用したとしても、前記特徴
を有する帯域位相と二重変換チューナを使用する受信機
は本発明をさらに広範囲に実施する。ただ、二重変換チ
ューナのみを使用する無線受信機が可能で、前記受信機
内に第2中間周波数信号は前記最後の中間周波数信号
で、3重変換チューナ1の最後の中間周波数信号と同一
な周波数の範囲内に存在する。また、30〜45MHz
範囲に直接に前記選択されたHDTVチャネルを変換す
る二重変換チューナを構成してから、その結果として招
来される前記第1中間周波数信号を前記1−8MHzの
範囲内に最後の中間周波数に変換することは可能であ
る。
【0039】特に、上記で説明された前記無線受信機は
最後の中間周波数信号を零周波数以上1MHzまたは2
MHzの最低周波数として利用する。このような最後の
中間周波数信号は前記ヒルベルト変形FIRフィルタと
補償遅延FIRフィルタが非常に短い遅延と非常に少な
いタップを有することができる程度のほぼ十分な高周波
数である。前記最後の中間周波数信号は単純化で望まし
いアナログディジタル変換器にディジタル変換を行うた
めに取られた前記アナログ信号サンプル帰間が増加する
程度に非常に低いので、ディジタル変換以前にサンプリ
ング回路(サンプラー)の構造と作動中に提供される。
望ましくない折返しを避けるために、このようなサンプ
ルは最後の中間周波数で搬送波の1/2サイクルを超え
て持続されなければならない。そうでないと、Rice
とWuの指摘のように前記帯域信号は前記帯域信号の最
高周波数要素によることではなく、前記帯域信号の帯域
幅によって決定された前記ナイキスト速度以上またはナ
イキスト速度でディジタル変換以前にサンプル化される
必要がある。
【0040】さらに短期間のサンプルのみを取られるサ
ンプリング回路は前記最後の中間周波数が1−8MHz
の範囲より高くなるように許容する。例えば、HDTV
記号速度の2倍あるいは約21MHzとなる最後の中間
周波数を有する二重変換チューナは可能でなければなら
ない。たとえ、前記最後の中間周波数信号の最低要素周
波数が実際に1MHzまたは2MHzより高いとして
も、受信機が前記属性を有する帯域位相トラッカを用い
るディジタル信号を表示する記号コードを含むVBS信
号を受信するための無線受信機はさらに広範囲に本発明
を実施する。
【0041】60−90dBであるAGCの範囲は多数
の制御利得中間周波数増幅器の段階を要求しながら、前
記チューナに要求される。制御利得の広い範囲以上に位
相直系が1−8MHz範囲より高い周波数でさらに容易
に維持される。そこで、前記最後のIF信号が1−8M
Hzの範囲にあるように選択されるとき、前記IF増幅
器が前記最後の混合器以前に60−90dbである前記
要求されたAGC範囲を提供することは望ましい。2周
波数でこのような制御利得を提供することで、単一周波
数帯域で作動をする高利得増幅器内で発生され得る望ま
しくない再生結果が発生されることはない。前記SAW
フィルタリングに対して要求された位相直線性の高い程
度は30−40MHzの範囲より高い中間周波数でさら
に容易になされる。したがって、3重変換チューナが現
在さらに採択されている。
【0042】図6は前記ヒルベルト変形FIRフィルタ
50または57のうち一つの代わりに利用され得る7タ
ップヒルベルト変形FIRフィルタ60を示す。前記7
タップFIRフィルタ60は前記ヒルベルト変形応答を
発生させるために、前記7差動遅延入力信号サンプルが
重みを有し加算されるように考案される単一遅延要素の
61,62,63,64,65及び66の従属接続を含
む。前記ヒルベルト変形は本来線形位相なので、前記F
IRフィルタ60のタップ重みは中間(median)
遅延に対する対称を示す。したがって、ディジタル加算
器67は普通の重みとなるように前記遅延要素61から
遅延要素61に入力信号を加算し、ディジタル加算器6
8は普通重みとなるように前記遅延要素65から出力信
号と前記遅延要素61から加算し、そしてディジタル加
算器69は普通の重みとなるように前記遅延要素62か
ら前記出力信号と前記遅延要素64から前記出力信号を
加算する。前記遅延要素64から前記出力信号は、適切
な重みW0 の大きさほどその信号を乗算させる読出し専
用メモリ70に入力アドレスとして印加される。前記デ
ィジタル加算器69から前記加算出力信号は適切な重み
1 の大きさほど信号を乗算させる読出し専用メモリ7
1に入力アドレスとして印加される。前記ディジタル加
算器68から前記加算出力信号は適切な重みW2 の大き
さほど信号を乗算させる読出し専用メモリ72に入力ア
ドレスとして印加される。前記ディジタル加算器67か
ら前記加算出力信号は適切な重みW3 の大きさほど信号
を乗算させる読出し専用メモリ73に入力アドレスとし
て印加される。前記ROM70,71,72及び73を
固定被乗数の乗数として利用することで、増加と連結さ
れる遅延が非常に短く維持される。このROM70,7
1,72及び73の前記出力信号は前記ROM70,7
1,72及び73に貯蔵された重みW0 ,W1 ,W2
びW3 のサイズに適切な割当サインに要求される要求さ
れた、加算器または減算器として作動をするようになる
サインされたディジタル加算器74及び75、そして7
6のトリーによって組み合わせる。前記加算器67,6
8,69,74,75及び76は6サンプル遅延を示す
前記7タップFIRフィルタ60を結果として招来する
単一サンプル待ち時間を示すそれぞれの加算器がクロッ
クされるように仮定する。このような待ち時間を補償す
る前記フィルタ60の入力信号遅延は前記6単一サンプ
ル遅延要素61,62,63,64,65及び66の従
属接続によって提供される。そこで、前記フィルタ60
が前記フィルタ50の代わりに使用される場合、前記遅
延要素61,62,63,64,65及び66の従属接
続は前記フィルタ50から分離された前記遅延線51の
代わりに用いられる場合、前記遅延要素61,62,6
3,64,65及び66の従属接続は前記フィルタ57
から分離された前記遅延線58の代わりに利用され得
る。ディジタルデザイン技術に熟練された人はここで説
明した前記多様なフィルタリング内にフィルタ機能を発
生させるための重みを有し加算するためにサンプルをデ
ベロプするために使用された前記遅延構造も前記フィル
タ機能で前記待ち時間のために補償するように要求され
た前記遅延の一部分あるいは遅延全体を形成するために
どのように利用されるかが理解できるであろう。
【0043】本発明のまた他の実施例は前記帯域位相ト
ラッカに使用される前記位相と直角位相サンプリング手
続が前記ディジタル変換された帯域信号に対する位相応
答で定π/2差を示す対からなる他の形態の全域通過デ
ィジタルフィルタによって補われるという点で可能であ
る。論文IEEE TRANSACTIONS ONA
EROSPACE AND ELECTRONIC S
YSTEMS,Vol.AES−20,No.6(19
84年11月)、pp821−824に記載の“位相と
直角要素をサンプル化するための単純な方法”におい
て、C.M.ReaderはRiceとWudml前記
補償遅延FIRフィルタと前記ヒルベルト変形FIRフ
ィルタにより多少単純に補充するための対からなる全域
通過ディジタルフィルタの形態を説明する。Reade
rはRiceとWuの前記フィルタをヤコビアン楕円形
の機能を利用するようにデザインされた一対の全体通過
のディジタルフィルタに代替される。Readerによ
り採択される一対のそのような全体通過のディジタルフ
ィルタは次のようなシステムの機能を有する。
【0044】 H1 (z)=z-1(z-2−a2 )/(1−a2 -2) a=0.5846832 H2 (z)= −(z-2−b2 )/(1−b2 -2) a=0.1380250 Readerはただ2個の倍数であるa2 による一つと
2 による一つを要求するフィルタ構成を表わす。ディ
ジタル変換された帯域信号の同期検出を実行するRea
derの向上された回路は本発明のまた他の実施例で利
用するために採択され得る。
【0045】図7は前記それぞれの利得を制御するため
の前記図1のVSB信号受信機の第1IF増幅器14と
前記第2IF増幅器19に自動利得制御信号を提供する
AGC遅延回路網42に自動利得制御(AGC)信号を
供給するための配置を示す。第1IF増幅器14と前記
第2IF増幅器19と、そして前記AGC遅延回路網4
2の前記組み合わせた作動は先行技術と一致される。特
に、興味を呼び起こすことは前記AGC入力信号が前記
AGC遅延回路網42に利用するために発生するという
ことである。前記AGC遅延回路網42は前記AGC入
力信号のためのAGC信号増幅器を含むが、細心にデザ
インされた前記AGC信号増幅器は不要となる。前記狭
帯域フィルタ24によって分離されるパイロット搬送波
に対するディジタル表示値は前記DCO27から0°同
期位相に供給される発振にヘテロダインされるようにま
た他の同相同期検出器43に入力信号として印加され
る。前記同相同期検出器43はただ0°同期位相に前記
パイロット搬送波のディジタル表示値に相応項により前
記狭帯域フィルタ24によって分離されるパイロット搬
送波に対する前記ディジタル標準値に連続項を乗算する
ためのディジタル乗算器で構成される。前記同相同期検
出器43の前記ディジタル出力信号は前記ディジタルア
ナログ変換器(DAC)によりアナログ信号に変換さ
れ、前記DAC44の前記アナログ出力信号は幾らかの
ビデオフィールド順序の時定数への変化を示す、本来基
本的に直接な応答である、応答を発生するために低域フ
ィルタ45によって低域でフィルタされる。前記フィル
タ45応答はAGC入力信号として前記AGC遅延回路
網に印加される。前記低域フィルタ45は抵抗器−キャ
パシタL部分から構成可能なアナログフィルタである。
前記狭帯域フィルタ24が入力される二重使用は関心を
もたせす、AFPC信号を再生させるだけではなくAG
C信号を発生させるのに使用される。前記狭帯域フィル
タ24によって再生される前記パイロット搬送波の持続
的な特徴はAGC信号を発生するのに利得となる。
【0046】(要素43,44及び45を利用する)パ
イロット搬送波に前記狭帯域フィルタ24の前記二重側
波帯応答に狭帯域同期検出から先行される自動利得制御
は実際にジョンソン騒音に影響を受けることはない。前
記帯域フィルタ24は前記ジョンソン騒音レベルを前記
帯域フィルタ24の狭帯域幅に対する前記最後のIF信
号の全域帯域幅の比率の自乗根としてパイロット搬送波
に減少し、さらに、直角位相騒音は同期検出によって抑
圧される。特別な記号と関連したディジタル値の範囲が
さらに制限されるため、実際に騒音に影響を受けない自
動利得制御は記号デコーディングが遂行されるときに利
益となる。前記ADC22がディジタル変換されるよう
に要請を受ける前記入力信号の範囲は、重要なクリッピ
ングを発生させずに前記制御レベルの最後のIF信号に
付加時間に騒音を適当なレベルに調節しなければならな
い。
【0047】図8は図2,図3,図4または図5につい
ての図1のVSB信号受信機の変形に含まれる前記AG
C遅延回路網42にAGC信号を供給するためのまた他
の配置を示す。このような配置は、また他の同相同期検
出器430を含むが、前記検出器430は前記ディジタ
ル乗算器251が搬送波のコサインによって乗算するデ
ィジタル乗算器431と、前記ディジタル乗算器252
が同一な信号を搬送波のサインによって乗算するための
ディジタル乗算器432と、そして前記ディジタル乗算
器431及び432から積信号を加算するためのディジ
タル加算器433とを備える。前記同相同期検出器43
0の前記ディジタル出力信号は前記ディジタルアナログ
変換器(DAC)44によりアナログ信号に変換され
た。前記DAC44の前記アナログ出力信号は前記AG
C遅延回路網42に用いられる前記AGC入力信号を発
生するための低域フィルタ45によって低域でフィルタ
される。
【0048】図9は図2,図3,図4または図5に変形
あるいは図1のVSB信号受信機に含まれる前記AGC
遅延回路網42にAGC信号を供給するためのまた他の
配置を示す。前記DAC44は前記図1のVSB信号受
信機の前記同相同期検出器23の応答に供給される。前
記図1のVSB信号受信機の図2,図3,図4または図
5に対する変形に、前記DAC44は前記同相同期検出
器230の応答に供給される。
【0049】図10は前記低域フィルタ45の応答が第
2IF増幅器応答をNTSC TV信号のための付加受
信機回路に入力信号として、あるいは複合増幅変調(Q
AM)上のHDTV信号のための付加受信機回路に入力
信号として、または他の付加受信機回路に入力信号とし
て印加され、尚、VSB HDTV信号のための付加受
信機回路内に使用されるTV受信機に前記AGC遅延回
路網42に利用されるという点で変形を示す。前記低域
フィルタ45の応答はアナログOR回路46の第1入力
47に印加され、前記アナログOR回路網46は少なく
とも他の単一入力信号を受信する。前記アナログOR回
路46の第2入力信号48はNTSCTV信号のための
付加受信機回路または複合増幅変調(QAM)搬送波に
HDTV信号のための付加受信機回路からAGC入力信
号として供給されえる選択的に、前記アナログOR回路
46の前記第2入力48と第3入力49は複合増幅変調
(QAM)搬送波にHDTV信号に対する付加受信機回
路とNTSC TV信号のための付加受信機回路のう
ち、分離されたものからそれぞれのAGC入力信号とし
て供給され得る。前記AGC遅延回路網42に前記AG
C入力信号のうちの選択された信号が供給されるに従っ
て、前記遅延回路42に印加された前記アナログOR回
路46の応答は前記第1IF増幅器14と上記第2IF
増幅器19の利得を全然減さず、前記アナログOR回路
46の非使用される入力は基準電圧と戻ることについて
減給されるもののうち一番大きいものに対応する。尚、
引き起こされる前記IF増幅器14と19の利得を減す
ために、前記AGC遅延回路網42に印加される前記選
択されるAGC入力進行の基準電圧からの分離は実数値
を有するべきである。
【0050】しきい値検出器4は前記チューナ1によっ
て選択されるVSB搬送波に伝達される前記TVプログ
ラムを再生するために前記TV受信機の作動を容易にす
る信号を発生させるために、利得が実際に減少する実数
値よりしきい値が一層小さいしきい値に前記IF増幅器
14及び19の利得を減少させようとするセンスに基準
電圧から分離される前記低域フィルタ45の応答に対応
する。
【0051】図11は判定指示タイミング再生回路を示
しており、前記回路は前記ADCによりアナログディジ
タル変換される間にサンプルタイミングが前記VSB搬
送波に記号の伝送と一時的な一致状態にあるように前記
サンプリングされたクロック周波数と位相を調節するた
めの前記図1のVSB信号受信機に含まれる。前記タイ
ミング回路は、論文「IEEE TRANSITION
S ON COMMUNICATIONS,Dec.1
976,pp.1326−13330.」“Timin
g Recovery for Equalized
PartialRespones Systems”に
パルス増幅変調(PAM)信号の利用についてS.U.
H.Quaeshiにより開示されているものと同一の
一般形態を含む。電圧制御発振器80は21MHz周波
数を有するシッソイダル(cissoidal)発振を
発生させる。前記発振器80は望ましく非常に狭い範囲
以上に周波数制御可能な水晶発振器である。対称クリッ
パまたはリミッタ81は帯域幅を制限する一段階のフィ
ルタリング後に前記ディジタル変換手続の一段階とし
て、前記ADC22によって前記最後のIF信号のサン
プリングのタイミングのための第1クロック信号として
使用される、このようなシッソイダル発振に方形波を発
生する。周波数分割器フリップフロップ82は第2クロ
ック信号を発生するための前記第1クロック信号として
AND回路83がANDされるまた他の方形波を発生す
るための規定センスで第1クロック信号の電位に相応す
る。前記VCO80によって発生される前記シッソイダ
ル発振の周波数と位相を制御するための前記誤差信号の
発生について説明する。
【0052】前記同相同期検出器23または230から
のサンプルは平均2乗根(mean−square)誤
差傾斜検出フィルタ90に入力信号として印加される。
前記フィルタ90は前記第1サンプリングクロックによ
ってクロックされる作用をする(−1/2),1,0,
(−1),(+1/2)を有する有限インパルス応答デ
ィジタルフィルタである。前記フィルタ90はクロック
されたラッチ91,92,93及び94の従属接続を含
み、尚、ディジタル加算器/減算器95,96及び97
を含む。前記ディジタル加算器/減算器95,96はク
ロックされずに作動するが、前記ディジタル加算器/減
算器97は第1サンプルクロックによってクロックされ
る出力でクロックされたラッチを含むことにより、クロ
ックされた要素として作動される。前記クロックされた
要素91−94及び97はそれぞれ入力サンプリングの
ために前記ADC22が使用する前記第1サンプリング
クロックの前記21メガサンプル/第2クロック速度で
ユニットクロック遅延を放出する。前記加算器/減算器
95は以前期間で4つのサンプルを提供した前記入力サ
ンプルから前記フィルタ90に提供される前記現在の入
力サンプルを減算するために減算器として作動される。
前記加算器/減算器96は前記現期間よりさらに初期に
単一サンプルを提供した前記入力サンプルから初期に3
つのサンプルを供給した前記入力サンプルは減算するた
めに減算器として作動される。前記減算器95から差信
号1/2だけ前記減算器96から差信号に付加しなが
ら、前記加算器/減算器97は加算器として作動され
る。前記加算器97の加算信号は前記フィルタ90が応
答として供給される。
【0053】前記クロックされたラッチ91,92,9
3及び94の従属接続によって遅延された、前記同相同
期検出器23または230からの前記サンプルは入力信
号として量子器84により現在受信される前記サンプル
によってほぼ近接に推定される前記量子化レベルを供給
する量子器84に供給される。このような量子化レベル
は出力にクロックされるラッチを含むことによってクロ
ックされた要素として作動されるディジタル加算器/減
算器85によって減算された前記量子器84の入力信号
を有する。前記フィルタ90応答は前記減算器55から
前記差信号と一時的に一致される。前記減算器85から
前記差信号は前記同相同期検出器23または230によ
って検出される記号に誤差を修正するように要求される
修正を示すが、誤位相にある前記VSB信号受信機5に
サンプリングから起こる誤差が間に合って非常に早くサ
ンプリングされるか、あるいは非常に遅くサンプリング
されるかを示すことはない。ディジタル乗算器86はこ
のような問題を解決するために前記フィルタ90応答に
よって前記減算器85から差信号を増加させる。前記加
算器97から2の補数加算信号の前記サインビットと、
次に一番重要なビットは前記ディジタル乗算器86の構
造の単純化を許容する倍数に供給される。前記ディジタ
ル乗算器86から積信号はディジタルアナログ変換器8
8によってアナログ制御電圧に変換されるディジタル制
御信号を発生させるために積分する累算器87に供給さ
れる。狭低域フィルタは前記VOS80に前記アナログ
制御電圧を印加するために利用される。
【0054】以上に上述したディジタルVSB検出回路
は複合増幅変調(QAM)搬送波上にHDTV信号を受
信するためのキャパシタを有するようにデザインされる
TV受信機に利用される。前記複合増幅変調(QAM)
搬送波を検出するための付加受信機回路の必要性は、前
記ディジタルVSB検出回路の前記DCO全帯域同相同
期検出器部分が前記ディジタルQAW検出回路に含まれ
ることができるので減少する。
【図面の簡単な説明】
【図1】ディジタルHDTV信号を受信するための本発
明により構成される、パイロット搬送波要素を有するV
SB信号受信機の概略図である。
【図2】図1の同期検出回路が本発明の多様な実施例に
変形可能な他の形態の概略図である。
【図3】図1の同期検出回路が本発明の多様な実施例に
変形可能な他の形態の概略図である。
【図4】図1の同期検出回路が本発明の多様な実施例に
変形可能な他の形態の概略図である。
【図5】図1の同期検出回路が本発明の多様な実施例に
変形可能な他の形態の概略図である。
【図6】図2,図3,図4または図5の同期検出回路で
利用可能なヒルベルト変圧器FIRフィルタと補償遅延
の細部概略図である。
【図7】図1のVSB信号受信機に自動利得制御(AG
C)配置の概略図である。
【図8】図2,図3,図4または図5の同期検出回路を
しようするために変形される、図1のVSB信号受信機
に対するまた他のAGC配置の概略図である。
【図9】図1のVSB信号受信機または図2,図3,図
4または図5のそれぞれに対する同期検出回路を使用す
るために変形された受信機のまた他のAGC配置の概略
図である。
【図10】ディジタル情報を記号形式に符号化するVS
B信号を利用する形態に加えて、少なくとも異なる形態
のTV信号を受信するために設置されるTV受信機にお
いて、図7,図8または図9の前記AGC配置のうちの
一つに可能な変形の概略図である。
【図11】記号速度の倍で最後の中間周波数が下向変換
したVSB信号をサンプリングするための、図1の受信
機に具備可能な判定指示タイミング再生(Decisi
on−Directed Timing Recove
ry)回路の概略図であって、制御され信号のための接
続と区別するためにクロックあるいは制御信号接続は点
線で表示する図である。
【符号の説明】
1 複数変換チューナ 5 VSB信号受信機 7 キネスコープ 10 チャネルセレクタ 11 周波数合成器 12 第1混合器 13 LCフィルタ 14 第1中間周波数増幅器 15 第1SAWフィルタ 16 第2局部発振器 18 第2SAWフィルタ 19 第2中間周波数増幅器 20 第3混合器 21 第3局部発振器 22 アナログディジタル変換器 23 同相同期検出器 24 狭帯域フィルタ 25 直角位相同期検出器 26 低域フィルタ 27 ディジタル制御発振器 28 クロック遅延線 29 ディジタル加算器 30 NTSC阻止フィルタ 31 等化器 32 格子デコーダ 33 データデインタリーバ 34 リードソロモンデコーダ 35 データデランダム抽出器 36 パケット整列器 37 ディジタル映像デコーダ 38 複数チャネル−オーディオ増幅器 39 MPEGデコーダ 40 キネスコープ偏向回路 41 キネスコープ駆動増幅器
フロントページの続き (72)発明者 アレン ルロイ リンバーグ アメリカ合衆国 ニュージャージー 08551 ハート・レーン・リンゴーズ 22 (56)参考文献 特開 平3−278681(JP,A) 特開 平5−327355(JP,A) 特開 平1−185085(JP,A) 特開 平3−44280(JP,A)

Claims (24)

    (57)【特許請求の範囲】
  1. 【請求項1】 周波数帯域の異なる位置にあるチャネル
    のうちの一つを選択し、選択されたチャネルを最後の中
    間周波数帯域の最後の中間周波数信号に変換するための
    チューナ(1)と、 ディジタル変換された最後の中間周波数信号を出力信号
    として得るために、前記最後の中間周波数信号をディジ
    タル変換するためのアナログディジタル変換器(22)
    と、 周波数変換における局部発振器(21)の位相不整合性
    あるいはマルチパス歪みが原因の前記最後の中間周波数
    信号の虚数部分を抑圧し、更に前記最後の中間周波数信
    号の実数部分のためのディジタル値で表わされた搬送波
    を供給するための、搬送周波数周辺の前記ディジタル変
    換された最後の中間周波数信号の狭帯域でフィルタされ
    た部分で作動する位相トラッカ(24,25,26,2
    7)と、 前記最後の中間周波数信号の実数部分のためのディジタ
    ル値で表わされた搬送波により前記実数部分を検出する
    ために前記ディジタル変換された最後の中間周波数信号
    に応答する第1同期検出器(23)とを備えた第1同期
    検出出力信号を発生する無線受信機(5)において、 前記無線受信機(5)の前記位相トラッカ(24,2
    5,26,27)、 制御された周波数のサイン波を有するディジタル変換さ
    れたサンプルと、制御された周波数のコサイン波を有す
    るディジタル変換されたサンプルを発生するためのディ
    ジタル制御発振器(27)と前記中間周波数信号の虚数
    部分のための前記ディジタル値で表わされた搬送波と同
    期して、前記ディジタル変換された最後の中間周波数信
    号の分離された搬送波部分に対する直角位相同期検出応
    答を発生するための第2同期検出器(25)とを備えて
    おり、 前記コサイン波を前記第1同期検出器(23)に印加
    し、前記サイン波を前記第2同期検出器(25)に印加
    し、 前記制御された周波数は所望の周波数から前記制御され
    た周波数の差を示すディジタル制御信号に対する応答と
    して前記最後の中間周波数信号の前記搬送周波数を含む
    周波数範囲以上に制御可能であり、 前記無線受信機(5)の前記位相トラッカ(24,2
    5,26,27)は、さらに、 第ディジタルフィルタ(50)の待ち時間だけ遅延さ
    れた、前記ディジタル変換された最後の中間周波数信号
    に対するヒルベルト変形応答を発生する有限インパルス
    応答の前記第1ディジタルフィルタ(50)と、 遅延されたディジタル変換された最後の中間周波数信号
    を発生し、前記第1ディジタルフィルタ(50)の待ち
    時間と同一の待ち時間だけ前記ディジタル変換された最
    後の中間周波数信号を遅延するための第1ディジタル遅
    延線(51)と、 前記最後の中間周波数信号の前記搬送周波数近辺の同一
    の応答機能を有する有限インパルス応答の狭帯域、第2
    (52)及び第3ディジタルフィルタ(53)を備えて
    おり、前記第2ディジタルフィルタ(52)は前記第1
    ディジタルフィルタ(50)の待ち時間だけ遅延され、
    前記第2ディジタルフィルタ(52)は前記第2ディジ
    タルフィルタ(52)の待ち時間だけ遅延された前記デ
    ィジタル変換された最後の中間周波数信号の前記ヒルベ
    ルト変換に対して周波数選択応答を提供するために前記
    第1ディジタルフィルタ(50)に引続き従属接続さ
    れ、前記第3ディジタルフィルタ(53)は前記第3デ
    ィジタルフィルタ(53)の待ち時間だけさらに遅延し
    た前記遅延されたディジタル変換された最後の中間周波
    数信号に対する周波数の選択的応答を提供するための前
    記第1ディジタル遅延線(51)に引続き従属接続さ
    れ、 第1積信号を発生させるために、前記制御された周波数
    の前記コサイン波を有する前記ディジタル変換されたサ
    ンプルを乗数信号として受信し、前記第2ディジタルフ
    ィルタ(52)の前記周波数選択応答を被乗数信号とし
    て受信する第1ディジタル乗算器(251)と、 第2積信号を発生させるために、前記制御された周波数
    の前記サイン波を有する前記ディジタル変換されたサン
    プルを乗数信号として受信し、前記第3ディジタルフィ
    ルタ(53)の前記周波数選択応答を被乗数信号として
    受信する第2ディジタル乗算器(252)と、 前記最後の中間周波数信号の前記搬送周波数から前記制
    御された周波数の周波数と位相の退去を示す差信号を発
    生するために、前記第1及び第2積信号を差動的に組み
    合わせるディジタル減算器(253)と、 前記ディジタル制御信号を前記ディジタル制御された発
    振器(27)に供給するために前記差信号に応答する手
    段とを備えることを特徴とする無線受信機。
  2. 【請求項2】 遅延された最後の中間周波数信号を発生
    し、前記第2ディジタルフィルタ(52)の待ち時間と
    同一の付加待ち時間だけ前記第1ディジタル遅延線(5
    1)から前記遅延されたディジタル変換された最後の中
    間周波数をさらに遅延するための第2のディジタル遅延
    (55)と、 前記ディジタル変換された最後の中間周波数信号のさら
    に遅延されたヒルベルト変形を発生し、前記第3ディジ
    タルフィルタ(53)の待ち時間と同一の付加待ち時間
    だけ前記第1ディジタルフィルタ(50)の前記遅延さ
    れたヒルベルト変形応答を遅延するための第3ディジタ
    ル遅延線(54)と、 第3積信号を発生するために、前記さらに遅延されたデ
    ィジタル変換された最後の中間周波数信号を被乗数信号
    として受信し、前記制御された周波数の前記コサイン波
    の前記ディジタル変換されたサンプルを乗数信号として
    受信する第3ディジタル乗算器(232)と、 第4積信号を発生させるために、前記ディジタル変換さ
    れた最後の間周波数信号の前記さらに遅延されたヒル
    ベルト変形を被乗数信号として受信し、前記制御された
    周波数の前記サイン波を有する前記ディジタル変換され
    たサンプルを乗数信号として受信する第4ディジタル乗
    算器(231)と、 ディジタル加算器(233)が付加的に前記第1同期検
    出器出力信号として供給された加算信号を発生するため
    の前記第3及び第4積信号を組み合わせて、前記第3
    (232)及び第4ディジタル乗算器(231)に共に
    前記第1同期検出器(230)内に含まれる前記ディジ
    タル加算器(233)とを備えることを特徴とする請求
    項1記載の無線受信機。
  3. 【請求項3】 前記チューナ(1)内に含まれる多数の
    連続中間周波数増幅器段を備えるが、前記中間周波数増
    幅器段のうち少なくとも一つは前記最後の中間周波数帯
    域と異なる中間周波数で利得を提供し、前記最後の中間
    周波数増幅器段のうち少なくとも二つはそれぞれの利得
    制御信号によって制御された量だけそれぞれ利得を提供
    し、 それぞれ自動利得制御入力信号によって制御されるそれ
    ぞれの量だけ前記それぞれの利得制御信号を印加するた
    めの手段と、 第1同期検出器出力信号にアナログ低域フィルタ応答を
    発生するための手段と、 少なくとも選択される条件の下で、前記自動利得制御入
    力信号として前記それぞれの利得制御信号を印加するた
    めの前記手段に前記アナログフィルタ低域応答を提供す
    るための手段とをさらに備えることを特徴とする請求項
    記載の無線受信機。
  4. 【請求項4】 前記無線受信機の前記それぞれの利得制
    御信号を印加するための前記手段が、前記それぞれの利
    得制御信号を印加するための前記自動利得制御入力信号
    に応答するAGC遅延回路網(42)を含む請求項3記
    載の無線受信機。
  5. 【請求項5】 少なくとも選択される条件の下で、前記
    自動利得制御入力信号として前記それぞれの利得制御信
    号を印加するための前記手段に前記アナログ低域フィル
    タ応答を供給するための前記無線受信機(5)の前記手
    段が、自動利得制御入力信号として応答する前記AGC
    遅延回路網(42)にすべての条件の下で前記アナログ
    低域フィルタ応答を提供する形態である請求項4記載の
    無線受信機。
  6. 【請求項6】 少なくとも選択される条件の下で、前記
    自動利得制御入力信号として前記それぞれの利得制御信
    号を印加するための前記手段に前記アナログ低域フィル
    タ応答を提供するための前記手段が、多数の入力信号の
    うちの一つとして前記アナログ低域フィルタ応答を受信
    し、前記それぞれの利得制御信号を印加するための前記
    手段に前記自動利得制御入力信号を提供するアナログO
    R回路(46)を備えることを特徴とする請求項4記載
    の無線受信機。
  7. 【請求項7】 周波数帯域の異なる位置にあるチャネル
    のうちの一つを選択し、選択されたチャネルを最後の中
    間周波数帯域の最後の中間周波数信号に変換するための
    チューナ(1)と、 ディジタル変換された最後の中間周波数信号を出力信号
    として得るために、前記最後の中間周波数信号をディジ
    タル変換するためのアナログディジタル変換器(22)
    と、 周波数変換における局部発振器(21)の位相不整合性
    あるいはマルチパス歪みが原因の前記最後の中間周波数
    信号の虚数部分を抑圧し、更に前記最後の中間周波数信
    号の実数部分のためのディジタル値で表わされた搬送波
    を供給するための、搬送周波数周辺の前記ディジタル変
    換された最後の中間周波数信号の狭帯域でフィルタされ
    た部分で作動する位相トラッカ(24,25,26,2
    7)と、 前記最後の中間周波数信号の実数部分のためのディジタ
    ル値で表わされた搬送波により前記実数部分を検出する
    ために前記ディジタル変換された最後の中間周波数信号
    に応答する第1同期検出器(23)とを備えた第1同期
    検出出力信号を発生する無線受信機(5)において、 前記無線受信機(5)の前記位相トラッカ(24,2
    5,26,27)は、 制御された周波数のサイン波を有するディジタル変換さ
    れたサンプルと、制御された周波数のコサイン波を有す
    るディジタル変換されたサンプルを発生するためのディ
    ジタル制御発振器(27)と前記中間周波数信号の虚数
    部分のための前記搬送波の前記ディジタル表示値と同期
    して、前記ディジタル変換された最後の中間周波数信号
    の分離された搬送波部分に対する直角位相同期検出応答
    を発生するための第2同期検出器(25)とを備えてお
    り、 前記コサイン波を前記第1同期検出器(23)に印加
    し、前記サイン波を前記第2同期検出器(25)に印加
    し、 前記制御された周波数は所望の周波数から前記制御され
    た周波数の差を示すディジタル制御信号に対する応答と
    して前記最後の中間周波数信号の前記搬送周波数を含む
    周波数範囲以上に制御可能であり、 前記無線受信機(5)の前記位相トラッカ(24,2
    5,26,27)は、さらに、 搬送周波数を中心とする前記ディジタル変換された最後
    の中間周波数信号の部分に対する周波数選択応答を第1
    ディジタルフィルタ(56)のために待ち時間以後に供
    給し、前記アナログディジタル変換器(22)から前記
    ディジタル変換された最後の中間周波数信号を受信する
    有限インパルス応答である狭帯域の前記第1ディジタル
    フィルタ(56)と、 第2ディジタルフィルタ(57)の待ち時間だけ遅延さ
    れた、前記第1ディジタルフィルタ(56)の前記周波
    数選択応答の前記ヒルベルト変形である前記第2ディジ
    タルフィルタ(57)の応答を発生するために、前記第
    1ディジタルフィルタ(56)の前記周波数選択応答に
    相応する有限インパルス応答である前記第2ディジタル
    フィルタ(57)と、 第1ディジタル遅延線応答を発生し、前記第2ディジタ
    ルフィルタ(57)の待ち時間と同一の遅延だけ前記第
    1ディジタルフィルタ(56)の前記周波数選択応答を
    遅延するための第1ディジタル遅延線(58)と、 第1積信号を発生するために、前記制御された周波数の
    前記コサイン波を有する前記ディジタル変換されたサン
    プルを周波数信号として受信し、前記第2ディジタルフ
    ィルタ(57)の応答を被乗数信号として受信する第1
    ディジタル乗算器(251)と、 第2積信号を発生するために、前記制御された周波数の
    前記サイン波を有する前記ディジタル変換されたサンプ
    ルを周波数信号として受信し、前記第1ディジタル遅延
    (58)の応答を被乗数信号として受信する第2ディ
    ジタル乗算器(252)と、 前記最後の中間周波数信号の前記搬送周波数から前記制
    御された周波数の周波数と位相を取り除いた差信号を発
    生するための前記第1及び第2積信号を差動的に組み合
    わせるディジタル減算器(253)と、 前記ディジタル制御信号を前記ディジタル制御発振器
    (27)に供給するための前記差信号に応答する手段と
    を備えることを特徴とする無線受信機。
  8. 【請求項8】 遅延されたディジタル変換した最後の中
    間周波数信号を発生し、前記第1ディジタルフィルタ
    (56)の待ち時間と同一な遅延だけ前記ディジタル変
    換された最後の中間周波数信号を遅延させるための第2
    のディジタル遅延線(59)と、 前記第3ディジタルフィルタ(50)の待ち時間だけさ
    らに遅延され、前記遅延されたディジタル変換した最後
    の中間周波数信号のヒルベルト変形である前記第3ディ
    ジタルフィルタ(50)の応答を発生するための前記遅
    延されたディジタル変換した最後の中間周波数信号に応
    答する有限インパルス応答の第3ディジタルフィルタ
    (50)、さらに遅延されたディジタル変換された最
    後の中間周波数信号を発生させ、前記第3ディジタルフ
    ィルタ(50)は待ち時間と同一な付加遅延だけ前記第
    2ディジタル遅延線(59)から前記遅延されたディジ
    タル変換した中間周波数信号をさらに遅延するための第
    3ディジタル遅延線(51) と、第3積信号を発生するために、前記第3ディジタル
    遅延線(51)から前記さらに遅延されたディジタル変
    換された最後の中間周波数信号を被乗数信号として受信
    し、前記制御された周波数の前記コサイン波を有する前
    記ディジタル変換されたサンプルを乗数信号として受信
    する第3ディジタル乗算器(232)と、 第4積信号を発生するために、前記ディジタル変換され
    たフィルタの応答を被乗数信号として受信し、前記制御
    された周波数の前記サイン波を有する前記ディジタル変
    換されたサンプルを乗数信号として受信する第4ディジ
    タル乗算器(231)と、 前記第1同期検出器出力信号として供給される加算信号
    を発生するための前記第3及び第4積信号を付加して組
    み合わせて、前記第3(232)及び第4ディジタル乗
    算器(231)と共に前記第1同期検出器(230)
    含まれるディジタル加算器(233)とをさらに備える
    ことを特徴とする請求項7記載の無線受信機。
  9. 【請求項9】 前記チューナ(1)内に含まれる多数の
    連続中間周波数増幅器段を備えるが、前記中間周波数増
    幅器段のうち少なくとも一つは前記最後の中間周波数帯
    域と異なる中間周波数で利得を提供し、前記最後の中間
    周波数増幅器段のうち少なくとも二つはそれぞれの利得
    制御信号によって制御される量だけそれぞれ利得を提供
    し、 それぞれ自動利得制御入力信号によって制御されるそれ
    ぞれの量だけ前記それぞれの利得制御信号を印加するた
    めの手段と、 第1同期検出器出力信号にアナログ低域フィルタ応答を
    発生するための手段と、 少なくとも選択される条件の下で、前記自動利得制御入
    力信号として前記それぞれの利得制御信号を印加するた
    めの前記手段に前記アナログフィルタされた低域応答を
    提供するための手段とをさらに備えることを特徴とする
    請求項8記載の無線受信機。
  10. 【請求項10】 前記無線受信機(5)の前記それぞれ
    の利得制御信号を印加するための前記手段が、前記それ
    ぞれの利得制御信号を印加するための前記自動利得制御
    入力信号に応答するAGC遅延回路網(42)を含むこ
    とを特徴とする請求項9記載の無線受信機。
  11. 【請求項11】 少なくとも選択される条件の下で、前
    記自動利得制御入力信号として前記それぞれの利得制御
    信号を印加するための前記手段に前記アナログ低域フィ
    ルタ応答を供給するための前記無線受信機(5)の前記
    手段が、自動利得制御入力信号として応答する前記AG
    C遅延回路網(42)にすべての条件の下で前記アナロ
    グ低域フィルタ応答を提供する形態である請求項10記
    載の無線受信機。
  12. 【請求項12】 少なくとも選択される条件の下で、前
    記自動利得制御入力信号として前記それぞれの利得制御
    信号を印加するための前記手段に前記アナログ低域フィ
    ルタ応答を提供するための前記手段が、多数の入力信号
    のうちいずれか一つとして前記アナログ低域フィルタ応
    答を受信し、前記それぞれの利得制御信号を印加するた
    めの前記手段に前記自動利得制御入力信号を提供するア
    ナログOR回路(46)を備えることを特徴とする請求
    項10記載の無線受信機。
  13. 【請求項13】 周波数帯域の異なる位置にあるチャネ
    ルのうちの一つを選択し、選択されたチャネルを最後の
    中間周波数帯域の最後の中間周波数信号に変換するため
    のチューナ(1)と、 ディジタル変換された最後の中間周波数信号を出力信号
    として得るために、前記最後の中間周波数信号をディジ
    タル変換するためのアナログディジタル変換器(22)
    と、 周波数変換における局部発振器(21)の位相不整合性
    あるいはマルチパス歪みが原因の前記最後の中間周波数
    信号の虚数部分を抑圧し、更に前記最後の中間周波数信
    号の実数部分のためのディジタル値で表わされた搬送波
    を供給するための、搬送周波数周辺の前記ディジタル変
    換された最後の中間周波数信号の狭帯域でフィルタされ
    た部分で作動する位相トラッカ(24,25,26,2
    7)と、 前記最後の中間周波数信号の実数部分のためのディジタ
    ル値で表わされた搬送波により前記実数部分を検出する
    ために前記ディジタル変換された最後の中間周波数信号
    に応答する第1同期検出器(23)とを備えた第1同期
    検出出力信号を発生する無線受信機(5)において、 前記無線受信機(5)の前記位相トラッカ(24,2
    5,26,27)は、 制御された周波数のサイン波を有するディジタル変換さ
    れたサンプルと、制御された周波数のコサイン波を有す
    るディジタル変換されたサンプルを発生するためのディ
    ジタル制御発振器(27)と前記中間周波数信号の虚数
    部分のための前記搬送波の前記ディジタル表示値と同期
    して、前記ディジタル変換された最後の中間周波数信号
    の分離された搬送波部分に対する直角位相同期検出応答
    を発生するための第2同期検出器(25)とを備えてお
    り、 前記コサイン波を前記第1同期検出器(23)に印加
    し、前記サイン波を前記第2同期検出器(25)に印加
    し、 前記制御された周波数は所望の周波数から前記制御され
    た周波数の差を示すディジタル制御信号に対する応答と
    して前記最後の中間周波数信号の前記搬送周波数を含む
    周波数範囲以上に制御可能であり、 前記無線受信機(5)の前記位相トラッカ(24,2
    5,26,27)は、さらに 第1ディジタルフィルタの待ち時間だけ遅延された前記
    ディジタル変換された最後の中間周波数信号に対するヒ
    ルベルト変形応答を発生するための有限インパルス応答
    の前記第1ディジタルフィルタ(50)と、 遅延されたディジタル変換された最後の中間周波数信号
    を発生し、前記第1ディジタルフィルタ(50)の待ち
    時間と同一の遅延だけ前記ディジタル変換した最後の中
    間周波数信号を遅延するためのディジタル遅延線(5
    1)と、 第1積信号を発生するために、前記第1ディジタルフィ
    ルタ(50)の前記ヒルベルト変形応答を被乗数信号に
    受信し、前記制御された周波数の前記コサイン波を有す
    る前記ディジタル変換されたサンプルを乗数信号として
    受信する第1ディジタル乗算器(251)と、 第2積信号を発生するために、前記制御された周波数の
    前記サイン波を有する前記ディジタル変換されたサンプ
    ルを乗数信号に受信し、第2ディジタル遅延線(51)
    から前記遅延されたディジタル変換された最後の中間周
    波数信号を被乗数信号に受信する前記第2ディジタル乗
    算器(252)と、 差信号を発生するために前記第1及び第2積信号を差動
    的に組み合わせるディジタル減算器(253)と、 前記最後の中間周波数信号の前記搬送周波数の位相と周
    波数を取り除いた前記差信号に対する低域応答を発生す
    る第2ディジタルフィルタ(58) 前記ディジタル制御信号を前記ディジタル制御発振器
    (27)に供給するために前記低域応答に応答する手段
    とをさらに備えることを特徴とする無線受信機。
  14. 【請求項14】 第3積信号を発生するために、前記デ
    ィジタル遅延線(51)から前記遅延されたディジタル
    変換された最後の中間周波数信号を被乗数信号として受
    信し、前記制御された周波数の前記コサイン波を有する
    前記ディジタル変換されたサンプルを乗数信号として受
    信する第3ディジタル乗算器(232)と、 第4積信号を発生するために、前記第1ディジタルフィ
    ルタ(50)の前記応答を被乗数信号に受信し、前記制
    御された周波数の前記サイン波を有する前記ディジタル
    変換されたサンプルを乗数信号として受信する第4ディ
    ジタル乗算器(231)と、 前記第1同期検出出力信号として供給された加算信号を
    発生するために第3及び第4積信号を加え合わせ、第3
    (232)及び第4ディジタル乗算器(231)と前記
    第1同期検出器(230)内に含まれるディジタル加算
    (233)とを備えることを特徴とする請求項13記
    載の無線受信機。
  15. 【請求項15】 前記チューナ(1)内に含まれる多数
    の連続中間周波数増幅器段を備えるが、前記中間周波数
    増幅器段のうち少なくとも一つは前記最後の中間周波数
    帯域と異なる中間周波数で利得を提供し、前記最後の中
    間周波数増幅器段のうち少なくとも二つはそれぞれの利
    得制御信号によって制御される量だけそれぞれ利得を提
    供し、 それぞれ自動利得制御入力信号によって制御されるそれ
    ぞれの量だけ前記それぞれの利得制御信号を印加するた
    めの手段と、 第1同期検出器出力信号にアナログ低域フィルタ応答を
    発生するための手段と、 少なくとも選択される条件の下で、前記自動利得制御入
    力信号として前記それぞれの利得制御信号を印加するた
    めの前記手段に前記アナログ低域フィルタ応答を提供す
    るための手段とをさらに備えることを特徴とする請求項
    14記載の無線受信機。
  16. 【請求項16】 前記無線受信機(5)の前記それぞれ
    の利得制御信号を印加するための前記手段が、前記それ
    ぞれの利得制御信号を印加するための前記自動利得制御
    入力信号に応答するAGC遅延回路網(42)を含むこ
    とを特徴とする請求項15記載の無線受信機。
  17. 【請求項17】 少なくとも選択される条件の下で、前
    記自動利得制御入力信号として前記それぞれの利得制御
    信号を印加するための前記手段に前記アナログ低域フィ
    ルタ応答を供給するための前記無線受信機(5)の前記
    手段が、自動利得制御入力信号として応答する前記AG
    C遅延回路網(42)にすべての条件の下で前記アナロ
    グ低域フィルタ応答を提供する形態であることを特徴と
    する請求項16記載の無線受信機。
  18. 【請求項18】 少なくとも選択される条件の下で、前
    記自動利得制御入力信号として前記それぞれの利得制御
    信号を印加するための前記手段に前記アナログ低域フィ
    ルタ応答を提供するための前記手段が、多数の入力信号
    のうちいずれか一つとして前記アナログ低域フィルタ応
    答を受信し、前記それぞれの利得制御信号を印加するた
    めの前記手段に前記自動利得制御入力信号を提供するア
    ナログOR回路(46)を備えることを特徴とする請求
    項16記載の無線受信機。
  19. 【請求項19】 周波数帯域の異なる位置にあるチャネ
    ルのうちの一つを選択し、選択されたチャネルを最後の
    中間周波数帯域の最後の中間周波数信号に変換するため
    のチューナ(1)と、 ディジタル変換された最後の中間周波数信号を出力信号
    として得るために、前記最後の中間周波数信号をディジ
    タル変換するためのアナログディジタル変換器(22)
    と、 周波数変換における局部発振器(21)の位相不整合性
    あるいはマルチパス歪みが原因の前記最後の中間周波数
    信号の虚数部分を抑圧し、更に前記最後の中間周波数信
    号の実数部分のためのディジタル値で表わされた搬送波
    を供給するための、搬送周波数周辺の前記ディジタル変
    換された最後の中間周波数信号の狭帯域でフィルタされ
    た部分で作動する位相トラッカ(24,25,26,2
    7)と、 前記最後の中間周波数信号の実数部分のためのディジタ
    ル値で表わされた搬送波により前記実数部分を検出する
    ために前記ディジタル変換された最後の中間周波数信号
    に応答する第1同期検出器(23)とを備えた第1同期
    検出出力信号を発生する無線受信機(5)において、 前記無線受信機(5)の位相トラッカ(24,25,2
    6,27)は、 前記搬送波を分離するために前記ディジタル変換された
    最後の中間周波数信号に選択的に応答する有限インパル
    ス応答の狭帯域ディジタルフィルタ(24)と、 前記最後の中間周波数信号の虚数部分のために搬送波の
    ディジタル表示値を提供し、そして前記最後の中間周波
    数信号の実数部分のために搬送波の前記ディジタル表示
    値を提供するディジタル制御発振器(27)であって、
    出力信号である前記最後の中間周波数信号の前記実数部
    分と虚数部分のための前記搬送波の位相は互いに固定さ
    れているが、出力信号である前記最後の中間周波数信号
    の前記実数部分と前記虚数部分の位相と周波数はディジ
    タル制御信号に制御されて応答出力を出力するディジタ
    ル制御発振器(27)と、 前記中間周波数信号の虚数部分のための前記搬送波の前
    記ディジタル表示値と同期して、前記ディジタル変換さ
    れた最後の中間周波数信号の前記分離された搬送波部分
    に対する直角位相同期検出応答を発生するための第2同
    期検出器(25)と、 前記第2同期検出器(25)の前記直角位相同期検出に
    対する応答で前記ディジタル制御信号を供給するための
    低域フィルタ(26)とを備え、前記無線受信機(5)
    の前記位相トラッカ(24,25,26,27)は、さ
    らに、 制御される周波数のサイン波を有するディジタル変換さ
    れたサンプルと制御される周波数のコサイン波を有する
    ディジタル変換されたサンプルと、規定角だけ前記制御
    された周波数のコサイン波から位相で前進する前記制御
    された周波数を有するディジタル変換されたサンプル
    と、前記角だけ前記制御される周波数の前記サイン波か
    ら位相が前進する前記制御された周波数を有するディジ
    タル変換されるサンプルを発生するためのディジタル制
    御発振器(27)を備えており、前記制御された周波数
    は所望の周波数から前記制御された周波数の差を示すデ
    ィジタル制御信号に対する応答で前記最後の中間周波数
    信号の前記搬送周波数を含む周波数範囲以上に制御さ
    れ、 前記無線受信機(5)の前記位相トラッカ(24,2
    5,26,27)は、さらに、 前記第1ディジタルフィルタ(50)の待ち時間だけ遅
    延された、前記ディジタル変換した最後の中間周波数信
    号に対するヒルベルト変形応答を発生する有限インパル
    ス応答である第1ディジタルフィルタ(50)と、 遅延されたディジタル変換された最後の中間周波数信号
    を発生し、前記第1ディジタルフィルタ(50)の待ち
    時間と同一の遅延だけ前記ディジタル変換された最後の
    中間周波数信号を遅延するための第1ディジタル遅延線
    (51)と、 前記最後の中間周波数信号の前記搬送周波数を中心とし
    て同一の応答機能を有する有限インパルス応答の、狭帯
    域、第2(52)及び第3ディジタルフィルタ(53)
    を備えており、前記第2ディジタルフィルタ(52)
    前記第1ディジタルフィルタ(50)の待ち時間だけ遅
    延され、前記第2ディジタルフィルタ(52)の待ち時
    間だけ遅延された前記ディジタル変換された最後の中間
    周波数信号の前記ヒルベルト変形に対する周波数選択応
    答を提供するために前記第1ディジタルフィルタ(5
    0)に引続き従属接続され、前記第3ディジタルフィル
    (53)は前記第3ディジタルフィルタ(53)の待
    ち時間だけ遅延された前記遅延されたディジタル変換し
    た最後の中間周波数信号に対する周波数選択応答を提供
    するために前記第1ディジタル遅延線(51)に引続き
    従属接続され、 第1積信号を発生するために、前記制御される周波数の
    前記コサイン波を有する前記ディジタル変換されたサン
    プルを乗数信号として受信し、前記第2ディジタルフィ
    ルタ(52)の前記周波数選択応答を被乗数信号として
    受信する第1ディジタル乗算器(251)と、 第2積信号を発生するために、前記規定角だけ前記制御
    された周波数のサイン波を有する前記ディジタル変換さ
    れたサンプルを乗数信号として受信し、前記第3ディジ
    タルフィルタ(53)の前記周波数選択応答を被乗数信
    号として受信する第2ディジタル乗算器(252)と、 前記最後の中間周波数信号の前記搬送周波数から前記制
    御された周波数の周波数と位相を取り除いた差信号を発
    生するために、前記第1及び第2積信号の差を組み合わ
    せるディジタル減算器(253)と、 前記ディジタル制御信号を前記ディジタル制御された発
    振器(270)に供給するために前記差信号に応答する
    手段とを備えることを特徴とする無線受信機。
  20. 【請求項20】 第3積信号を発生するために、前記デ
    ィジタル遅延線(51)から前記さらに遅延されたディ
    ジタル変換された最後の中間周波数信号を被乗数信号と
    して受信し、前記制御された周波数の前記コサイン波か
    ら位相で前進した前記制御された周波数の前記波を有す
    る前記ディジタル変換されたサンプルを乗数信号として
    受信する第3ディジタル乗算器(232)と、 第4積信号を発生するために、前記第1ディジタルフィ
    ルタ(50)の前記ヒルベルト変形応答を被乗数信号と
    して受信し、前記制御された周波数の前記サイン波から
    位相で前進された前記制御された周波数の前記波を有す
    る前記ディジタル変換されたサンプルを乗数信号として
    受信する第4ディジタル乗算器(231)と、 前記第1同期検出器出力信号として供給される加算信号
    を発生するために前記第3及び第4積信号を加え合わせ
    て、前記第3(232)及び第4ディジタル乗算器(2
    31)と共に前記第1同期検出器(230)に含まれる
    ディジタル加算器(233)とを備えることを特徴とす
    る請求項19記載の無線受信機。
  21. 【請求項21】 前記チューナ(1)内に含まれる多数
    の連続中間周波数増幅器段を備えるが、前記中間周波数
    増幅器段のうち少なくとも一つは前記最後の中間周波数
    帯域と異なる中間周波数で利得を提供し、前記最後の中
    間周波数増幅器段のうち少なくとも二つはそれぞれの利
    得制御信号によって制御される量だけそれぞれ利得を提
    供し、 それぞれ自動利得制御入力信号によって制御されるそれ
    ぞれの量だけ前記それぞれの利得制御信号を印加するた
    めの手段と、 第1同期検出器出力信号にアナログ低域フィルタ応答を
    発生するための手段と、 少なくとも選択される条件の下で、前記自動利得制御入
    力信号として前記それぞれの利得制御信号を印加するた
    めの前記手段に前記アナログ低域フィルタ応答を提供す
    るための手段とをさらに備えることを特徴とする請求項
    20記載の無線受信機。
  22. 【請求項22】 前記無線受信機(5)の前記それぞれ
    の利得制御信号を印加するための前記手段が、前記それ
    ぞれの利得制御信号を印加するための前記自動利得制御
    入力信号に応答するAGC遅延回路網(42)を含むこ
    とを特徴とする請求項29記載の無線受信機。
  23. 【請求項23】 少なくとも選択される条件の下で、前
    記自動利得制御入力信号として前記それぞれの利得制御
    信号を印加するための前記手段に前記アナログ低域フィ
    ルタ応答を供給するための前記無線受信機(5)の前記
    手段が、自動利得制御入力信号として応答する前記AG
    C遅延回路網(42)にすべての条件の下で前記アナロ
    グ低域フィルタ応答を提供する形態である請求項9記載
    の無線受信機。
  24. 【請求項24】 少なくとも選択される条件の下で、前
    記自動利得制御入力信号として前記それぞれの利得制御
    信号を印加するための前記手段に前記アナログ低域フィ
    ルタ応答を提供するための前記手段が、多数の入力信号
    のうちいずれか一つとして前記アナログ低域フィルタ応
    答を受信し、前記それぞれの利得制御信号を印加するた
    めの前記手段に前記自動利得制御入力信号を提供するア
    ナログOR回路(46)を備えることを特徴とする請求
    項22記載の無線受信機。
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