JP3393455B2 - Semiconductor device and method of manufacturing semiconductor device - Google Patents

Semiconductor device and method of manufacturing semiconductor device

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JP3393455B2 JP23063094A JP23063094A JP3393455B2 JP 3393455 B2 JP3393455 B2 JP 3393455B2 JP 23063094 A JP23063094 A JP 23063094A JP 23063094 A JP23063094 A JP 23063094A JP 3393455 B2 JP3393455 B2 JP 3393455B2
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Description

【発明の詳細な説明】Detailed Description of the Invention

【０００１】[0001]

【産業上の利用分野】本発明は、半導体装置及び半導体
装置の製造方法に関する。本発明は、配線構造を改良し
た各種半導体装置に係る技術として適用でき、ＩＣデバ
イスその他各種の半導体装置の分野に好ましく用いるこ
とができる。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a semiconductor device and a method for manufacturing the semiconductor device. INDUSTRIAL APPLICABILITY The present invention can be applied as a technique relating to various semiconductor devices having an improved wiring structure, and can be preferably used in the field of IC devices and other various semiconductor devices.

【０００２】[0002]

【従来の技術とその問題点】例えば半導体装置の分野で
は、素子の微細化に伴い、配線幅も微細化している。そ
れに伴いエレクトロマイグレーション（ＥＭ）耐性の優
れた配線を形成する必要がある。2. Description of the Related Art For example, in the field of semiconductor devices, wiring widths have become finer with the miniaturization of elements. Along with this, it is necessary to form a wiring excellent in electromigration (EM) resistance.

【０００３】例えば、従来の半導体装置におけるＡｌ系
配線、例えば従来のＡｌ−Ｓｉ系配線は、エレクトロマ
イグレーション耐性強化の目的として、Ａｌ−Ｓｉにさ
らにＣｕを０．５％から２％程度添加した材料を用いる
などしている。For example, an Al-based wiring in a conventional semiconductor device, for example, a conventional Al-Si-based wiring is a material in which Cu is added to Al-Si in an amount of 0.5% to 2% for the purpose of enhancing electromigration resistance. Are used.

【０００４】この材料を、ＭＯＳＦＥＴに適用した場合
の例を、図９ないし図１２を参照して説明すると、次の
とおりである。An example of applying this material to a MOSFET will be described below with reference to FIGS. 9 to 12.

【０００５】（ａ）図９を参照する。半導体基板１（こ
こではＳｉ基板）上に素子分離領域１２（ＬＯＣＯＳ−
ＳｉＯ2 ）及びゲート領域を形成する。ゲート領域は、
ゲート材１５（ポリＳｉ、ポリサイド等）、ゲート絶縁
膜１７（ＳｉＯ2 ）、サイドウォール１６ａ，１６ｂを
備える。即ち、ＬＤＤ領域１４ａ，１４ｂ形成用イオン
注入を行い、ゲートサイドウォール１６ａ，１６ｂを形
成し、ソース／ドレイン１３ａ，１３ｂ形成のためのイ
オン注入を行い、図９の構造を得る。(A) Referring to FIG. An element isolation region 12 (LOCOS-) is formed on a semiconductor substrate 1 (here, a Si substrate).
SiO 2 ) and the gate region are formed. The gate area is
The gate material 15 (poly Si, polycide, etc.), the gate insulating film 17 (SiO 2 ) and the sidewalls 16a and 16b are provided. That is, the ion implantation for forming the LDD regions 14a and 14b is performed, the gate sidewalls 16a and 16b are formed, and the ion implantation for forming the source / drain 13a and 13b is performed to obtain the structure of FIG.

【０００６】（ｂ）ＳＯＧ、ＣＶＤ−ＳｉＯ2 、ＴＥＯ
Ｓ−ＳｉＯ2 等により層間絶縁膜１８を形成し、更に、
配線用接続孔１９を形成して図１０のようにする。(B) SOG, CVD-SiO 2 , TEO
An interlayer insulating film 18 is formed of S-SiO 2 or the like, and further,
The wiring connection hole 19 is formed as shown in FIG.

【０００７】（ｃ）更にスパッタ法でＴｉＮ／Ｔｉ積層
膜２０を形成する。更に接続用埋め込み材料としてメタ
ルプラグ２１（ここではＷプラグ）を形成する。その後
Ａｌ−Ｓｉ−Ｃｕ／Ｔｉの２層をスパッタ法で全面に堆
積させ、パターニングする。符号２２ａで下地Ｔｉ層、
２３ａで上層Ａｌ（Ａｌ−Ｓｉ−Ｃｕ）配線を示す。以
上により配線領域を形成し、図１１の構造を得る。(C) Further, a TiN / Ti laminated film 20 is formed by a sputtering method. Further, a metal plug 21 (here, a W plug) is formed as a connection embedding material. After that, two layers of Al-Si-Cu / Ti are deposited on the entire surface by the sputtering method and patterned. Reference numeral 22a indicates a base Ti layer,
Reference numeral 23a indicates an upper layer Al (Al-Si-Cu) wiring. The wiring region is formed as described above, and the structure shown in FIG.

【０００８】（ｅ）その後更に層間絶縁膜１８ａを形成
し、更に上記と同様の手順で接続孔１９ａの形成（図１
２）、及びブランケットＷプラグ２１ａによる埋め込み
を行って、スタックコンタクトを形成する。(E) After that, an interlayer insulating film 18a is further formed, and a connection hole 19a is formed by the same procedure as described above (see FIG. 1).
2) and filling with the blanket W plug 21a is performed to form a stack contact.

【０００９】（ｆ）密着層２０ａを形成し（ＴｉＮによ
る）、更に第２層Ａｌ配線層２４ａを形成する（図１
３）。(F) The adhesion layer 20a is formed (of TiN), and then the second Al wiring layer 24a is formed (FIG. 1).
3).

【００１０】ここで、配線構造を符号２２ａ，２３ａで
示すＡｌ−Ｓｉ−Ｃｕ／Ｔｉの２層構造にする理由は、
エレクトロマイグレーション及びストレスマイグレーシ
ョン（ＳＭ）耐性を改善する目的にあり、上層Ａｌ系配
線２３ａが断線しても下地Ｔｉ２２ａがつながっていれ
ば配線は電気的につながっている状態にすることが一つ
の理由となっている。Here, the reason why the wiring structure is a two-layer structure of Al-Si-Cu / Ti shown by reference numerals 22a and 23a is as follows.
It is for the purpose of improving electromigration and stress migration (SM) resistance, and one reason is that the wiring is electrically connected if the underlying Ti 22a is connected even if the upper layer Al-based wiring 23a is disconnected. Has become.

【００１１】また、本配線Ａｌ中にＳｉが含有している
理由は、従来、ＴｉＮ等のバリアメタルを用いず直接Ａ
ｌ配線と下地Ｓｉが接している場合にＡｌが下地Ｓｉに
突き抜けをおこさないように、Ａｌ中にＳｉが溶け込む
レベルのＳｉをあらかじめ含有させておいたことによ
る。しかし、現状の配線構造は、Ｓｉ基板と接する部分
はＷ／ＴｉＮ／Ｔｉで接触していることにより、Ａｌ中
にＳｉを含有させる必要は全くない。Further, the reason why Si is contained in the main wiring Al is that, in the conventional method, a barrier metal such as TiN is not directly used and
This is because the level of Si in which Si is dissolved is contained in advance in Al so that Al does not penetrate into the underlying Si when the 1 wiring is in contact with the underlying Si. However, in the current wiring structure, since the portion in contact with the Si substrate is in contact with W / TiN / Ti, it is not necessary to contain Si in Al at all.

【００１２】さらに、Ａｌ−Ｓｉ−Ｃｕを用いた配線
は、その後のＣＶＤ等の成膜時に伴う温度でＳｉノジュ
ールを形成する。そのため、上層のＡｌ配線上の層間膜
のドライエッチングによるパターニングの際にＳｉノジ
ュールがＡｌ表面に表出しているとフッ素プラズマに曝
され、Ｓｉがエッチングされ、配線内にボイドを形成す
る問題が生じる。Further, the wiring using Al-Si-Cu forms Si nodules at a temperature associated with the subsequent film formation such as CVD. Therefore, if Si nodules are exposed on the Al surface during patterning of the interlayer film on the upper Al wiring by dry etching, the Si is exposed to fluorine plasma and Si is etched, which causes a problem of forming voids in the wiring. .

【００１３】そこで、近年配線材料として、Ｓｉを含有
しないＡｌ−Ｃｕが配線として用いられるに至ってい
る。しかし、配線構造をＡｌ−Ｃｕ／Ｔｉ構造にするこ
とで、最終的なシンター（例えば４００℃）時に、Ａｌ
と下地Ｔｉとがはなはだしく反応するため、結果として
配線の抵抗が上昇する問題が生じる。一方、従来のＡｌ
−Ｓｉ−Ｃｕ系配線では、この問題は小さい。それは、
下地ＴｉとＡｌの反応が、配線に含有されるＳｉの影響
によりこのＡｌ−Ｔｉ合金化反応が阻害され、よって反
応が抑制されているためと、推定される。これは、Ｓｉ
がＴｉと反応するためＡｌと反応すべきＴｉが少なくな
るためと考えられる。Therefore, in recent years, as a wiring material, Al-Cu containing no Si has been used as a wiring. However, by making the wiring structure an Al-Cu / Ti structure, at the time of final sintering (for example, 400 ° C.), Al
The underlying Ti reacts remarkably, resulting in a problem that the resistance of the wiring increases. On the other hand, conventional Al
This problem is small in the -Si-Cu system wiring. that is,
It is presumed that the reaction between the underlying Ti and Al is because the Al-Ti alloying reaction is hindered by the influence of Si contained in the wiring and thus the reaction is suppressed. This is Si
It is thought that this is because since Ti reacts with Ti, the Ti that should react with Al decreases.

【００１４】ＥＭ耐性を向上させる配線構造の例として
は、Ｔｉより抵抗の低いＷを用い、例えばＡｌ−Ｃｕ／
Ｗ積層構造とすることが提案されている。この構造にお
いては、Ｗを接続孔のプラグ材として用いるが、その後
接続孔内にのみプラグとしてＷを残すために、エッチバ
ックを施している。しかしエッチバックの制御性の困難
さから、接続孔内のプラグロス量が大きくなる問題、即
ち、接続孔以外の部分のＷを完全に除去するエッチバッ
クを行うと、接続孔内のＷが開口上面より深くエッチバ
ックされて、その分（プラグロスの分）接続孔が埋め切
れない構造となるという問題がある。この問題を有する
ままその後の配線プロセスを行うと、プラグロスの大き
いプラグ上に、例えばＡｌ配線をスパッタで形成させる
ので、配線のカバレージ低下を招く。更に、その上に、
第２の接続孔をスタック構造で形成すと、Ａｌのカバレ
ージの落ち込んだ部分に第２の接続孔が形成するため、
第２の接続孔の深さは、より深くなり、その後のプラグ
形成において、ボイドを作る等の問題を招く原因とな
る。As an example of the wiring structure for improving the EM resistance, W having a lower resistance than Ti is used, and for example, Al--Cu /
It has been proposed to use a W laminated structure. In this structure, W is used as the plug material of the connection hole, but thereafter, etching back is performed to leave W as a plug only in the connection hole. However, since the controllability of the etch-back is difficult, the amount of plug loss in the contact hole becomes large, that is, when the etch-back is performed to completely remove the W in the portion other than the contact hole, the W in the contact hole becomes the upper surface of the opening. There is a problem in that the structure is etched back deeper and the contact hole is not filled up by that much (plug loss). If the subsequent wiring process is carried out with this problem, an Al wiring, for example, is formed on the plug having a large plug loss by sputtering, so that the coverage of the wiring is lowered. Furthermore, on top of that,
When the second connection hole is formed in a stack structure, the second connection hole is formed in a portion where the coverage of Al is lowered,
The depth of the second connection hole becomes deeper, which causes problems such as formation of voids in the subsequent plug formation.

【００１５】上記問題の解決法として、Ｗプラグ形成
時、エッチバックを施さず、Ｗを埋め込み材としてばか
りでなくこれも配線として用いるプロセスが注目されて
いる。As a solution to the above problem, attention is paid to a process in which W is used not only as an embedding material but also as a wiring without etching back when forming a W plug.

【００１６】更に、Ａｌ−Ｃｕ／Ｗ積層構造は、上層Ａ
ｌがＥＭで断線しても、電流は、下層Ｗ部を流れるため
に、下層がＴｉの場合よりＥＭ耐性が向上できることが
期待される。しかし、この構造において、そのＥＭ耐性
は思ったほど向上できない。その理由として考えられる
ことは、下層Ｗの結晶配向が上層Ａｌの結晶配向に揃わ
ず、その影響で、ＥＭ耐性の比較的強いＡｌ（１１１）
結晶配向の度合いが、下地Ｔｉの場合と比較して低いた
め、ＥＭ耐性が劣化すると考えられる（ＴｉはＴｉ（２
００）が結晶配向すれば、その上のＡｌはＡｌ（１１
１）に結晶配向しやすくなることが確認されてい
る。）。Further, the Al--Cu / W laminated structure has an upper layer A.
Even if 1 is disconnected by EM, the current flows through the lower layer W portion, so that it is expected that the EM resistance can be improved as compared with the case where the lower layer is Ti. However, in this structure, the EM resistance cannot be improved as expected. A possible reason for this is that the crystal orientation of the lower layer W is not aligned with the crystal orientation of the upper layer Al, and as a result, Al (111) having relatively high EM resistance is exerted.
Since the degree of crystal orientation is lower than that of the underlying Ti, the EM resistance is considered to deteriorate (Ti is Ti (2
If (00) is crystallographically oriented, Al on it is Al (11
It has been confirmed that crystal orientation is easy to occur in 1). ).

【００１７】上記するように現状の配線構造は、各種問
題を解決する必要があり、その解決策が望まれている。
（なお、この種の従来構造として、特開平４−２９８０
３０号に開示のものがある）。As described above, the current wiring structure needs to solve various problems, and a solution to that problem is desired.
(Note that as a conventional structure of this type, Japanese Patent Application Laid-Open No. 4-2980
There is one disclosed in No. 30).

【００１８】[0018]

【発明の目的】本発明は上記問題点を解決して、接続孔
の埋め込み金属膜をエッチバックすることに伴うプラグ
ロスの問題がなく、その上層の配線形成がカバレージ良
く実現でき、コンタクトを安定に形成でき、配線の信頼
性を向上でき、しかもプロセス的に容易で、ＥＭ耐性の
良好な半導体装置が得られる技術を提供することを目的
とする。SUMMARY OF THE INVENTION The present invention solves the above problems and eliminates the problem of plug loss due to etching back of a metal film embedded in a contact hole, and can form a wiring in an upper layer with good coverage and stabilize contacts. It is an object of the present invention to provide a technique capable of obtaining a semiconductor device which can be formed, can improve reliability of wiring, is easy in the process, and has excellent EM resistance.

【００１９】[0019]

【課題を解決するための手段】上記目的を達成するた
め、以下の構成をとる。 In order to solve the problem] was to achieve the above purpose
Therefore, the following configuration is adopted.

【００２０】請求項１の発明は、第1の接続孔内を第1の
金属膜で埋め込むとともに、更に、第1の接続孔の開口
周辺部にも該第1の金属膜を形成し、更に、該第1の金属
膜及び第1の接続孔が形成された絶縁膜上に第2の金属膜
を形成するとともに、前記第1の接続孔の開口周辺部に
形成する第1の金属膜は、前記第2の金属膜の配線の長手
方向の周辺に対してのみ形成し、かつ前記第2の金属膜
は、前記第1の金属膜全面を覆い、更に長手方向に延び
ている接続構造を有することを特徴とする半導体装置で
あって、この構成により上記目的を達成するものであ
る。According to a first aspect of the present invention, the inside of the first connection hole is filled with the first metal film, and further, the first metal film is formed in the peripheral portion of the opening of the first connection hole. A second metal film is formed on the insulating film on which the first metal film and the first connection hole are formed, and the first metal film formed on the periphery of the opening of the first connection hole is The second metal film is formed only around the longitudinal direction of the wiring of the second metal film, and
Covers the entire surface of the first metal film and further extends in the longitudinal direction.
A semiconductor device characterized by having a connection being structure, is intended to achieve the above object by this configuration.

【００２１】請求項２の発明は、第1の接続孔内を第1の
金属膜で埋め込むとともに、更に、該第1の接続孔の開
口周辺部にも該第1の金属膜を形成し、更に、該第1の金
属膜及び第1の接続孔が形成された絶縁膜上に第２の金
属膜を形成し、その上に、第２の接続孔を形成し、第3
の金属膜で埋め込み、更に第4の金属膜を形成するとと
もに、前記第1の接続孔の開口周辺部に形成する第1の金
属膜は、前記第2の金属膜の配線の長手方向の周辺に対
してのみ形成し、かつ前記第2の金属膜は、前記第1の金
属膜全面を覆い、更に長手方向に延びている構造を有す
ることを特徴とする半導体装置であって、この構成によ
り上記目的を達成するものである。According to a second aspect of the present invention, the inside of the first connection hole is filled with the first metal film, and further, the first metal film is formed also in the peripheral portion of the opening of the first connection hole, Further, a second metal film is formed on the insulating film in which the first metal film and the first connection hole are formed, and a second connection hole is formed on the second metal film.
Embedded in the metal film, further forming a fourth metal film, the first metal film formed in the peripheral portion of the opening of the first connection hole is a peripheral portion in the longitudinal direction of the wiring of the second metal film. And the second metal film is formed only for the first gold film.
A semiconductor device having a structure that covers the entire surface of the metal film and further extends in the longitudinal direction, and achieves the above object by this configuration.

【００２２】請求項３の発明は、第1の接続孔内をＷ膜
である第1の金属膜で埋め込むとともに、更に、該第1の
接続孔の開口周辺部にも該Ｗ膜である第1の金属膜を形
成し、更に、該第1の金属膜及び第1の接続孔が形成され
た絶縁膜上にＡｌもしくはＡｌ系合金膜である第２の金
属膜を形成し、その上に、第２の接続孔を形成し、Ｗ膜
である第3の金属膜で埋め込み、更にＡｌもしくはＡｌ
系合金膜である第4の金属膜を形成するとともに、前記
第1の接続孔の開口周辺部に形成する第1の金属膜は、前
記第2の金属膜の配線の長手方向の周辺に対してのみ形
成し、かつ前記第2の金属膜は、前記第1の金属膜全面を
覆い、更に長手方向に延びている構造を有することを特
徴とする半導体装置であって、この構成により上記目的
を達成するものである。According to a third aspect of the invention, the W film is formed in the first connection hole.
Embedded with a first metal film that is
A first metal film, which is the W film, is formed around the opening of the connection hole.
And further, the first metal film and the first connection hole are formed.
Second gold which is an Al or Al-based alloy film on the insulating film
A metal film is formed, a second connection hole is formed on the metal film, and a W film is formed.
Embedded with a third metal film that is
Forming a fourth metal film which is a system alloy film,
The first metal film formed around the opening of the first connection hole is
Note: The shape is formed only on the periphery of the second metal film wiring in the longitudinal direction.
And the second metal film covers the entire surface of the first metal film.
It has a structure that covers and further extends in the longitudinal direction.
A characteristic semiconductor device , which achieves the above object by this configuration.

【００２３】請求項４の発明は、第1の接続孔内を第1の
金属膜で埋め込むとともに、更に、該第1の接続孔の開
口周辺部にも該第1の金属膜を形成し、更に、該第1の金
属膜及び第1の接続孔が形成された絶縁膜上に第2の金属
膜を形成した構造を有する半導体装置の製造方法であっ
て、前記第1の接続孔の開口周辺部に形成する第1の金属
膜は、前記第2の金属膜の配線の長手方向の周辺に対し
てのみ形成し、かつ前記第2の金属膜は、前記第1の金属
膜全面を覆い、更に長手方向に延びている構造を有する
ものであり、該第1の金属膜をパターニングした後、前
記第2の金属膜をパターニングすることによって、前記
第1の金属膜が前記第2の金属膜の配線の長手方向の周辺
に対してのみ形成し、かつ前記第2の金属膜は該第1の金
属膜全面を覆い、更に長手方向に延びている構造とした
ことを特徴とする半導体装置の製造方法であって、この
構成により上記目的を達成するものである。According to the invention of claim 4, the inside of the first connection hole is formed into the first connection hole.
In addition to embedding with a metal film, open the first connection hole.
The first metal film is also formed on the periphery of the mouth, and the first gold film is further formed.
A second metal is formed on the insulating film on which the metal film and the first connection hole are formed.
It is a method of manufacturing a semiconductor device having a film-formed structure.
The first metal formed around the opening of the first connection hole.
The film is attached to the periphery of the second metal film in the longitudinal direction of the wiring.
And the second metal film is formed only on the first metal.
Has a structure that covers the entire surface of the film and extends in the longitudinal direction.
After patterning the first metal film,
By patterning the second metal film,
The first metal film is the periphery of the wiring of the second metal film in the longitudinal direction.
Only for the second metal film, and the second metal film is formed on the first gold film.
A structure that covers the entire surface of the metal film and further extends in the longitudinal direction
A method of manufacturing a semiconductor device, characterized in that the above object is achieved by this configuration.

【００２４】[0024]

【００２５】[0025]

【００２６】各請求に係る発明は、上記構成により、目
的を達成するものである。 The invention according to each claim has the above-mentioned structure.
To achieve the goal.

【００２７】[0027]

【００２８】[0028]

【００２９】[0029]

【作用】本発明によれば、半導体基板上の絶縁膜に形成
した第１の接続孔内第１の金属膜で埋め込むとともに、
更に、該第１の接続孔の開口周辺部にも該第１の金属膜
を形成した構造をとるので、接続孔内の金属材料である
Ｗプラグ等を接続孔内にのみプラグとして残すためのエ
ッチバックは必ずしも必要がないので、プラグロスの問
題を避けることができ、その上のＡｌ等の配線のカバレ
ージの落ち込みは発生しない。更に、その上にスタック
コンタクトを形成する場合も、これを安定して形成でき
る。According to the present invention, the first metal film in the first connection hole formed in the insulating film on the semiconductor substrate is embedded and
Furthermore, since the structure in which the first metal film is formed around the opening of the first connection hole is adopted, the W plug, which is the metal material in the connection hole, is left as a plug only in the connection hole. Since the etch back is not always necessary, the problem of plug loss can be avoided, and the fall of the coverage of the wiring such as Al on it does not occur. Further, when the stack contact is formed on it, it can be stably formed.

【００３０】本発明によれば上記のとおりＡｌ等の配線
カバレージの落ち込みは発生しないので、配線の信頼性
が向上する。かつ、必要に応じて配線材料の変更だけ
で、配線構造に大幅な変更を施す必要がなくこの構造が
得られるので、従来のプロセスにそのまま適用でき、開
発コストは抑制できる。Ａｌ等の配線部の下層について
は全面に金属材料であるＷ等が残っている必要がないの
で、ＥＭ耐性を劣化させないようにできる。According to the present invention, since the wiring coverage of Al or the like does not drop as described above, the reliability of the wiring is improved. Moreover, since this structure can be obtained without making a large change in the wiring structure only by changing the wiring material as required, the conventional process can be directly applied and the development cost can be suppressed. Since it is not necessary that the metal material such as W remains on the entire lower layer of the wiring portion such as Al, the EM resistance can be prevented from deteriorating.

【００３１】[0031]

【実施例】以下、本発明の実施例について、図面を参照
して説明する。但し当然のことではあるが、本発明は図
示の実施例により限定を受けるものではない。Embodiments of the present invention will be described below with reference to the drawings. However, it should be understood that the present invention is not limited to the illustrated embodiments.

【００３２】実施例１ この実施例は、Ａｌ合金配線のＥＭ耐性を向上させる配
線構造及びその製造方法について本発明を適用したもの
で、特に、第１の金属膜としてＷ膜を用いてＷプラグ形
成後、接続孔周辺部のみにＷを残すようにパターニング
を行い、その後、更に配線形成を行う態様で本発明を実
施したものである。Example 1 In this example, the present invention was applied to a wiring structure for improving the EM resistance of an Al alloy wiring and a method for manufacturing the wiring structure. In particular, a W film was used as the first metal film to form a W plug. After the formation, the present invention is embodied in such a manner that the patterning is performed so that W is left only in the peripheral portion of the connection hole, and then the wiring is further formed.

【００３３】この実施例は具体的には、本発明を、ＭＯ
Ｓデバイスの配線構造に適用した場合である。This embodiment specifically describes the present invention by MO
This is the case when applied to the wiring structure of an S device.

【００３４】本実施例では、下記（ａ）〜（ｅ）の工程
で、本発明に係る半導体装置であるＭＯＳトランジスタ
を製造した。図１ないし図５を参照する。In this example, a MOS transistor which is a semiconductor device according to the present invention was manufactured by the following steps (a) to (e). Please refer to FIG. 1 to FIG.

【００３５】（ａ）Ｓｉ（１００）基板１上に素子分離
領域１２及びゲート領域（ゲート電極１５及びゲート絶
縁膜１７）をを形成する。更にＬＤＤイオン注入を行
い、ＬＤＤ領域１４ａ，１４ｂを形成する。そして全面
に下記条件でＳｉ酸化膜を形成させる。 条件 ガス ＳｉＨ4 ／Ｏ2 ／Ｎ2 ＝２５０／２５０／１０
０ｓｃｃｍ 温度 ４２０℃ 圧力 １３．３Ｐａ 膜厚 ０．２５μｍ(A) The element isolation region 12 and the gate region (gate electrode 15 and gate insulating film 17) are formed on the Si (100) substrate 1. Further, LDD ion implantation is performed to form LDD regions 14a and 14b. Then, a Si oxide film is formed on the entire surface under the following conditions. Condition gas SiH 4 / O 2 / N 2 = 250/250/10
0 sccm temperature 420 ° C. pressure 13.3 Pa film thickness 0.25 μm

【００３６】更に、下記条件で全面エッチバックを行
い、ゲート１５にサイドウォール１６ａ，１６ｂを形成
する。 条件 ガス Ｃ4 Ｆ8 ＝５０ｓｃｃｍ ＲＦパワー １２００Ｗ 圧力 ２ＰａFurther, the entire surface is etched back under the following conditions to form the sidewalls 16a and 16b on the gate 15. Condition gas C 4 F 8 = 50 sccm RF power 1200 W Pressure 2 Pa

【００３７】その後、ソース／ドレイン領域形成１３
ａ，１３ｂのための不純物イオン注入を行う。下記条件
のイオン注入とした。 条件 Ｎチャネル Ａｓ ２０ｋｅＶ，５ｅ１５／ｃｍ2 Ｐチャネル ＢＦ2 ２０ｋｅＶ，３ｅ１５／ｃｍ2 以上により、図１の構造を得た。Then, source / drain region formation 13
Impurity ion implantation for a and 13b is performed. Ion implantation was performed under the following conditions. Condition N channel As 20 keV, 5e15 / cm 2 P channel BF 2 20 keV, 3e15 / cm 2 With the above conditions, the structure of FIG. 1 was obtained.

【００３８】（ｂ）その後層間膜１８を形成する。ま
ず、例えば、次の条件でＴＥＯＳを用いたＣＶＤ酸化膜
を形成する。 条件 ガス ＴＥＯＳ＝５０ｓｃｃｍ 圧力 ４０Ｐａ 温度 ７２０℃ 膜厚 ４００ｎｍ(B) After that, the interlayer film 18 is formed. First, for example, a CVD oxide film using TEOS is formed under the following conditions. Condition gas TEOS = 50 sccm Pressure 40 Pa Temperature 720 ° C. Film thickness 400 nm

【００３９】更に、例えば次の条件でＢＰＳＧ等の膜を
成膜させる。これにより層間膜１８の形成を行う。 条件 ガス ＳｉＨ4 ／ＰＨ3 ／Ｂ2 Ｈ6 ／Ｏ2 ／Ｎ2 ＝８０／７／７／１０００／３２０００ｓｃｃｍ 温度 ４００℃ 圧力 １０１３２５Ｐａ 膜厚 ５００ｎｍFurther, for example, a film of BPSG or the like is formed under the following conditions. Thereby, the interlayer film 18 is formed. Condition gas SiH 4 / PH 3 / B 2 H 6 / O 2 / N 2 = 80/7/7/1000 / 32000sccm Temperature 400 ° C Pressure 101325Pa Film thickness 500nm

【００４０】レジストパターン後、下記条件のドライエ
ッチングでコンタクトホール１９を形成する。 条件 ガス Ｃ4 Ｆ8 ＝５０ｓｃｃｍ ＲＦパワー １２００Ｗ 圧力 ２ＰａAfter the resist pattern, the contact hole 19 is formed by dry etching under the following conditions. Condition gas C 4 F 8 = 50 sccm RF power 1200 W Pressure 2 Pa

【００４１】更に、下記条件のコンタクトイオン注入を
行うことにより、接合領域を形成させる。 条件 Ｎチャネル Ａｓ ２０ｋｅＶ，５ｅ１５／ｃｍ2 Ｐチャネル ＢＦ2 ２０ｋｅＶ，３ｅ１５／ｃｍ2 そしてその後１０５０℃５秒の活性化アニールを行う。Further, contact ions are implanted under the following conditions to form a junction region. Conditions N channel As 20 keV, 5e15 / cm 2 P channel BF 2 20 keV, 3e15 / cm 2 and then activation annealing at 1050 ° C. for 5 seconds.

【００４２】以上により図２の構造とした。From the above, the structure shown in FIG. 2 is obtained.

【００４３】（ｃ）次にコンタクト埋め込みを行う。ま
ずＴｉ／ＴｉＮ２０を成膜する。Ｔｉはコリメータスパ
ッタを用いて形成する。 Ｔｉ成膜条件例 パワー ４ｋＷ 成膜温度 ４５０℃ ガス Ａｒ＝１００ｓｃｃｍ 膜厚 ３０ｎｍ 圧力 ０．４７Ｐａ(C) Next, contact embedding is performed. First, Ti / TiN 20 is formed. Ti is formed by using collimator sputtering. Ti film forming condition example power 4 kW film forming temperature 450 ° C. gas Ar = 100 sccm film thickness 30 nm pressure 0.47 Pa

【００４４】ＴｉＮ成膜条件例 ガス Ａｒ／Ｎ2 ＝４０／７０ｓｃｃｍ パワー ５ｋＷ 圧力 ０．４７Ｐａ 膜厚 １０ｎｍExample of TiN film forming conditions Gas Ar / N 2 = 40/70 sccm Power 5 kW Pressure 0.47 Pa Film thickness 10 nm

【００４５】更に、次のようにして、第１の金属膜２１
であるＷ膜を形成する。ここでは次の条件で、ＣＶＤＷ
を堆積させる。まず、ＳｉＨ4 ガスを下記条件で先に流
す。 条件 ガス ＳｉＨ4 ＝３０ｓｃｃｍ 温度 ４５０℃ 圧力 １０６４０ＰａFurther, the first metal film 21 is formed as follows.
To form a W film. Here, under the following conditions, CVDW
Deposit. First, SiH 4 gas is first flowed under the following conditions. Condition gas SiH 4 = 30 sccm Temperature 450 ° C. Pressure 10640 Pa

【００４６】続いて、Ｗを下記条件でＣＶＤにより形成
する。 条件 ガス ＷＦ6 ／Ｈ2 ＝９５／５５０ｓｃｃｍ 温度 ４５０℃ 圧力 １０６４０Ｐａ膜厚 ４００ｎｍSubsequently, W is formed by CVD under the following conditions. Condition gas WF 6 / H 2 = 95/550 sccm Temperature 450 ° C. Pressure 10640 Pa Film thickness 400 nm

【００４７】続いてレジストパターニングを行い、その
後Ｗを下記条件のドライエッチングでパターニングす
る。 条件 ガス ＳＦ6 ＝５０ｓｃｃｍ マイクロ波パワー ８５０Ｗ ＲＦパワー １５０Ｗ 圧力 １．３３Ｐａ 以上により第１の金属膜２１であるＷで第１の接続孔で
あるコンタクトホール１９の埋め込み及びその開口周辺
部の膜形成を行った図３の構造とした。Subsequently, resist patterning is performed, and then W is patterned by dry etching under the following conditions. Condition gas SF 6 = 50 sccm Microwave power 850 W RF power 150 W Pressure 1.33 Pa With the above, W as the first metal film 21 fills the contact hole 19 as the first connection hole and forms a film around the opening. The structure is shown in FIG.

【００４８】（ｄ）次に、Ａｌ−Ｃｕ（０．５％）２２
／Ｔｉ２５をスパッタで形成する。まず、Ｔｉ膜２５を
下記条件で形成する。 Ｔｉ成膜条件 パワー ４ｋＷ 成膜温度 １５０℃ ガス Ａｒ＝１００ｓｃｃｍ 膜厚 ３０ｎｍ 圧力 ０．４７Ｐａ(D) Next, Al--Cu (0.5%) 22
/ Ti25 is formed by sputtering. First, the Ti film 25 is formed under the following conditions. Ti film forming condition power 4 kW film forming temperature 150 ° C. gas Ar = 100 sccm film thickness 30 nm pressure 0.47 Pa

【００４９】次に、第２の金属膜をなすＡｌ−Ｃｕ
（０．５％）２２を下記条件で成膜する。 成膜条件 パワー ２２．５ｋＷ 成膜温度 １５０℃ ガス Ａｒ＝４０ｓｃｃｍ 膜厚 ５００ｎｍ 圧力 ０．４７ＰａNext, Al--Cu forming the second metal film.
(0.5%) 22 is formed under the following conditions. Film forming condition power 22.5 kW Film forming temperature 150 ° C. Gas Ar = 40 sccm Film thickness 500 nm Pressure 0.47 Pa

【００５０】その後、レジストパターニング及び下記条
件のドライエッチングで、Ａｌ−Ｃｕ２２／Ｔｉ配線層
２５を形成する。 条件 ガス ＢＣｌ3 ／Ｃｌ2 ＝６０／９０ｓ
ｃｃｍ マイクロ波パワー １０００Ｗ ＲＦパワー ５０Ｗ 圧力 ０．０１６ＰａAfter that, the Al-Cu22 / Ti wiring layer 25 is formed by resist patterning and dry etching under the following conditions. Condition gas BCl 3 / Cl 2 = 60 / 90s
ccm Microwave power 1000W RF power 50W Pressure 0.016Pa

【００５１】以上で図４の配線構造を得た。Thus, the wiring structure shown in FIG. 4 was obtained.

【００５２】（ｅ）その後、例えば下記条件の成膜によ
り上層絶縁膜１８ａを形成させる。 条件 ガス ＳｉＨ4 ／Ｏ2 ／Ｎ2 ＝２５０／２５
０／１００ｓｃｃｍ 温度 ４２０℃ 圧力 １３．３Ｐａ 膜厚 ０．６μｍ(E) After that, the upper insulating film 18a is formed by, for example, film formation under the following conditions. Condition gas SiH 4 / O 2 / N 2 = 250/25
0/100 sccm temperature 420 ° C. pressure 13.3 Pa film thickness 0.6 μm

【００５３】レジストパターニング後、下記条件で接続
孔１９ａを形成する。 条件 ガス Ｃ4 Ｆ8 ＝５０ｓｃｃｍ ＲＦパワー １２００Ｗ 圧力 ２ＰａAfter resist patterning, the connection hole 19a is formed under the following conditions. Condition gas C 4 F 8 = 50 sccm RF power 1200 W Pressure 2 Pa

【００５４】ＴｉＮ膜をスパッタで形成してバリア層２
５ａを形成し、更に第３の金属膜２３としてブランケッ
ト−Ｗを形成させ、接続孔１９ａ（ヴィアホール）埋め
込みを行う。条件は前記と同様にして行うことができ
る。A barrier layer 2 is formed by forming a TiN film by sputtering.
5a is formed, a blanket-W is further formed as the third metal film 23, and the connection hole 19a (via hole) is buried. The conditions can be the same as described above.

【００５５】次いで、下記条件で全面Ｗのエッチバック
を施す。 条件 ガス ＳＦ6 ／５０ｓｃｃｍ マイクロ波パワー ８５０Ｗ ＲＦパワー １５０Ｗ 圧力 １．３３ＰａNext, the entire surface W is etched back under the following conditions. Condition gas SF 6 / 50sccm Microwave power 850W RF power 150W Pressure 1.33Pa

【００５６】Ａｌ−Ｃｕ（０．５％）／Ｔｉをスパッタ
で形成する。このＡｌ−Ｃｕが第４の金属膜２４をな
す。Al-Cu (0.5%) / Ti is formed by sputtering. This Al-Cu forms the fourth metal film 24.

【００５７】まず、下記条件でＴｉを成膜する。 Ｔｉ成膜条件 パワー ４ｋＷ 成膜温度 １５０℃ ガス Ａｒ＝１００ｓｃｃｍ 膜厚 ３０ｎｍ 圧力 ０．４７ＰａFirst, a Ti film is formed under the following conditions. Ti film formation conditions Power 4kW Deposition temperature 150 ℃ Gas Ar = 100 sccm Film thickness 30nm Pressure 0.47Pa

【００５８】次に、下記条件で第４の金属膜２４として
Ａｌ−Ｃｕ（０．５％）を成膜する。 成膜条件 パワー ２２．５ｋＷ 成膜温度 １５０℃ ガス Ａｒ＝４０ｓｃｃｍ 膜厚 ５００ｎｍ 圧力 ０．４７ＰａNext, Al-Cu (0.5%) is formed as the fourth metal film 24 under the following conditions. Film forming condition power 22.5 kW Film forming temperature 150 ° C. Gas Ar = 40 sccm Film thickness 500 nm Pressure 0.47 Pa

【００５９】その後、レジストパターニング及び下記条
件のドライエッチングで、Ａｌ−Ｃｕ／Ｔｉ配線層を形
成させる。 条件 ガス ＢＣｌ3 ／Ｃｌ2 ＝６０／９０ｓ
ｃｃｍ マイクロ波パワー １０００Ｗ ＲＦパワー ５０Ｗ 圧力 ０．０１６ＰａAfter that, an Al—Cu / Ti wiring layer is formed by resist patterning and dry etching under the following conditions. Condition gas BCl 3 / Cl 2 = 60 / 90s
ccm Microwave power 1000W RF power 50W Pressure 0.016Pa

【００６０】上記プロセスにより、図５に示したように
スタックコンタクト構造を有するデバイスを安定に形成
できる。By the above process, a device having a stack contact structure as shown in FIG. 5 can be stably formed.

【００６１】実施例２ この実施例は、第１の金属膜としてＷプラグ形成後、接
続孔周辺部のみにＷを残すようにパターニングするが、
その際、上部第２の接続孔で用いるマスクを用い、第１
の金属膜をパターニングしてプラグの加工を行い、その
後、配線形成を行う態様で実施したものである。Example 2 In this example, after forming the W plug as the first metal film, patterning is performed so that W is left only in the peripheral portion of the connection hole.
At that time, using the mask used for the upper second connection hole,
This is carried out in such a manner that the metal film is patterned, the plug is processed, and then the wiring is formed.

【００６２】この実施例は、実施例１の（ｃ）の第１の
金属膜形成のためのＷパターニング部分のみの変更であ
る。This embodiment is a modification of only the W patterning portion for forming the first metal film in (c) of the first embodiment.

【００６３】（ｃ）本実施例では、次のように第１の接
続孔であるコンタクトホール埋め込みを行う。まずＴ
ｉ、ＴｉＮを成膜する。Ｔｉは次の条件でコリメータス
パッタを用いて形成させる。 Ｔｉ成膜条件 パワー ４ｋＷ 成膜温度 ４５０℃ ガス Ａｒ＝１００ｓｃｃｍ 膜厚 ３０ｎｍ 圧力 ０．４７Ｐａ(C) In this embodiment, the contact hole, which is the first connection hole, is filled as follows. First T
i, TiN is formed into a film. Ti is formed using collimator sputtering under the following conditions. Ti film forming condition power 4 kW film forming temperature 450 ° C. gas Ar = 100 sccm film thickness 30 nm pressure 0.47 Pa

【００６４】次に下記条件で、ＴｉＮを成膜する。 ＴｉＮ成膜条件 ガス Ａｒ／Ｎ2 ＝４０／７０ｓｃｃｍ パワー ５ｋＷ 圧力 ０．４７Ｐａ 膜厚 １０ｎｍNext, a TiN film is formed under the following conditions. TiN film forming condition gas Ar / N 2 = 40/70 sccm power 5 kW pressure 0.47 Pa film thickness 10 nm

【００６５】更に、下記条件でＣＶＤＷを堆積させる。 条件；まず、ＳｉＨ4 ガスを先に流す。 ガス ＳｉＨ4 ＝３０ｓｃｃｍ 温度 ４５０℃ 圧力 １０６４０ＰａFurther, CVDW is deposited under the following conditions. Conditions; First, SiH 4 gas is flown first. Gas SiH 4 = 30 sccm Temperature 450 ° C. Pressure 10640 Pa

【００６６】次に、下記条件でＷを成膜する。 条件 ガス ＷＦ6 ／Ｈ2 ＝９５／５５０ｓｃｃｍ 温度 ４５０℃ 圧力 １０６４０Ｐａ 膜厚 ４００ｎｍNext, W is deposited under the following conditions. Condition gas WF 6 / H 2 = 95/550 sccm Temperature 450 ° C. Pressure 10640 Pa Film thickness 400 nm

【００６７】レジストパターニングを行い、Ｗをパター
ニングする。Resist patterning is performed to pattern W.

【００６８】その後Ｗを下記条件のドライエッチング法
でパターニングする。ここでは上層接続孔形成用マスク
とするポジレジストを用いて、Ｗをパターニングする。 条件 ガス ＳＦ6 ＝５０ｓｃｃｍ マイクロ波パワー ８５０Ｗ ＲＦパワー １５０Ｗ 圧力 １．３３ＰａAfter that, W is patterned by a dry etching method under the following conditions. Here, W is patterned using a positive resist which is used as an upper layer connection hole forming mask. Condition gas SF 6 = 50 sccm Microwave power 850 W RF power 150 W Pressure 1.33 Pa

【００６９】以下実施例１と同一の工程をとる。本実施
例によれば、実施例１で示した第１の金属膜２１である
Ｗのパターニングを、上部の第２の接続孔１９ａの形成
用マスクを用いて、マスク兼用の形をとることができ
る。The same steps as in Example 1 are performed below. According to the present embodiment, the patterning of W, which is the first metal film 21 shown in the first embodiment, can be used also as a mask by using the mask for forming the second connection hole 19a in the upper portion. it can.

【００７０】実施例３ この実施例では、配線の長手方向のみ接続孔周辺部に第
１の金属膜としてＷを残すようにパターニングを施した
場合である。Example 3 In this example, patterning is performed so that W is left as the first metal film in the peripheral portion of the connection hole only in the longitudinal direction of the wiring.

【００７１】本実施例は、実施例１と同一であるが、実
施例１の工程（ｃ）のブランケットＷのパターニングマ
スク形状に特徴を有する。即ち、図６、特に図６（ｂ）
の平面に示すような形状のレジストを用いてこれをマス
ク３０として、配線の長手方向のみ接続孔１９周辺部に
第１の金属膜としてＷを残すようにパターニングを施し
た。This embodiment is the same as the first embodiment, but is characterized by the patterning mask shape of the blanket W in the step (c) of the first embodiment. That is, FIG. 6, especially FIG.
Using a resist having a shape as shown in the plane of FIG. 2 as a mask 30, patterning was performed so that W was left as the first metal film around the connection hole 19 only in the longitudinal direction of the wiring.

【００７２】実施例４ この実施例は、実施例１における第２の接続孔１９ａで
あるヴィアホールについても第１の接続孔１９（２２コ
ンタクトホール）と同様に開口部周辺にＷを残したＷプ
ラグ構造を適用した例である。Example 4 In this example, as for the via hole which is the second connection hole 19a in Example 1, W is left around the opening as in the case of the first connection hole 19 (22 contact holes). It is an example in which a plug structure is applied.

【００７３】本実施例は、実施例１とほぼ同一の工程を
とるものであるが、実施例１の工程（ｅ）におけるメタ
ライゼーションに特徴を有する。図７を参照する。ここ
では次のように工程（ｅ）を行った。This embodiment takes almost the same steps as the first embodiment, but is characterized by the metallization in the step (e) of the first embodiment. Please refer to FIG. Here, the step (e) was performed as follows.

【００７４】（ｅ）ＴｉＮ膜２５ａをスパッタで形成さ
せ、更にブランケット−Ｗを形成させ、ヴィアホール埋
め込みを行う。条件は前記と同様なので省略する。(E) A TiN film 25a is formed by sputtering, a blanket-W is further formed, and a via hole is filled. The conditions are the same as above, and will not be described.

【００７５】レジストパターニングを行い、その後Ｗを
下記条件のドライエッチングでパターニングし、第３の
金属膜２３′を形成する。これにより、図７に示すよう
に、第２の接続孔１９ａ内部及びその開口部周辺にこの
第３の金属膜２３′（Ｗ）が形成された構造を得る。 条件 ガス ＳＦ6 ＝５０ｓｃｃｍ マイクロ波パワー ８５０Ｗ ＲＦパワー １５０Ｗ 圧力 １．３３ＰａResist patterning is performed, and then W is patterned by dry etching under the following conditions to form a third metal film 23 '. As a result, as shown in FIG. 7, a structure in which the third metal film 23 '(W) is formed inside the second connection hole 19a and around the opening thereof is obtained. Condition gas SF 6 = 50 sccm Microwave power 850 W RF power 150 W Pressure 1.33 Pa

【００７６】第４の金属膜２８を形成するため、Ａｌ−
Ｃｕ（０．５％）／Ｔｉをスパッタで形成する。まず、
下記条件でＴｉを成膜する。 Ｔｉ成膜条件 パワー ４ｋＷ 成膜温度 １５０℃ ガス Ａｒ＝１００ｓｃｃｍ 膜厚 ３０ｎｍ 圧力 ０．４７ＰａIn order to form the fourth metal film 28, Al--
Cu (0.5%) / Ti is formed by sputtering. First,
A Ti film is formed under the following conditions. Ti film forming condition power 4 kW film forming temperature 150 ° C. gas Ar = 100 sccm film thickness 30 nm pressure 0.47 Pa

【００７７】次に、Ａｌ−Ｃｕ（０．５％）を下記条件
で成膜する。 成膜条件 パワー ２２．５ｋＷ 成膜温度 １５０℃ ガス Ａｒ＝４０ｓｃｃｍ 膜厚 ５００ｎｍ 圧力 ０．４７ＰａNext, Al-Cu (0.5%) is formed under the following conditions. Film forming condition power 22.5 kW Film forming temperature 150 ° C. Gas Ar = 40 sccm Film thickness 500 nm Pressure 0.47 Pa

【００７８】その後、レジストパターニング及び下記条
件のドライエッチングで、Ａｌ−Ｃｕ／Ｔｉ配線層を形
成させる。以上で、第４の金属膜２８が形成された図７
の構造が完成する。 条件 ガス ＢＣｌ3 ／Ｃｌ2 ＝６０／９０ｓ
ｃｃｍ マイクロ波パワー １０００Ｗ ＲＦパワー ５０Ｗ 圧力 ０．０１６ＰａAfter that, an Al-Cu / Ti wiring layer is formed by resist patterning and dry etching under the following conditions. With the above, the fourth metal film 28 is formed in FIG.
The structure of is completed. Condition gas BCl 3 / Cl 2 = 60 / 90s
ccm Microwave power 1000W RF power 50W Pressure 0.016Pa

【００７９】実施例５ この実施例は、実施例４の第４の金属膜２８をなすＡｌ
形成をＡｌリフロー、もしくは高温Ａｌスパッタを用い
て実施したものである。この手法でＡｌ平坦化ができ、
完全平坦化が可能になる。Example 5 In this example, Al forming the fourth metal film 28 of Example 4 was used.
The formation is performed by Al reflow or high temperature Al sputtering. With this method, Al can be flattened,
Complete flattening is possible.

【００８０】即ちこの実施例５は、更に実施例１の工程
（ｄ）（ｅ）部分が変更する。その部分のみを示す。第
８を参照する。That is, in the fifth embodiment, the steps (d) and (e) of the first embodiment are changed. Only that part is shown. Reference is made to the eighth.

【００８１】（ｄ）Ａｌ−Ｃｕ（０．５％）／Ｔｉをス
パッタで形成する。このＡｌ−Ｃｕ膜２２は、第２の金
属膜を構成するものである。まず、Ｔｉを下記条件で形
成する。 Ｔｉ成膜条件 パワー ４ｋＷ 成膜温度 １５０℃ ガス Ａｒ＝１００ｓｃｃｍ 膜厚 ３０ｎｍ 圧力 ０．４７Ｐａ(D) Al-Cu (0.5%) / Ti is formed by sputtering. The Al-Cu film 22 constitutes the second metal film. First, Ti is formed under the following conditions. Ti film forming condition power 4 kW film forming temperature 150 ° C. gas Ar = 100 sccm film thickness 30 nm pressure 0.47 Pa

【００８２】次に、下記条件で第２の金属膜２２をなす
Ａｌ−Ｃｕ（０．５％）を成膜する。 成膜条件 パワー ２２．５ｋＷ 成膜温度 ５００℃ ガス Ａｒ＝４０ｓｃｃｍ 膜厚 ５００ｎｍ 圧力 ０．４７ＰａNext, Al-Cu (0.5%) forming the second metal film 22 is formed under the following conditions. Film forming condition power 22.5 kW Film forming temperature 500 ° C. Gas Ar = 40 sccm Film thickness 500 nm Pressure 0.47 Pa

【００８３】その後、レジストパターニング及び下記条
件のドライエッチングで、Ａｌ−Ｃｕ／Ｔｉ配線層を形
成する。これにより第２の金属膜２２を形成する。 条件 ガス ＢＣｌ3 ／Ｃｌ2 ＝６０／９０ｓ
ｃｃｍ マイクロ波パワー １０００Ｗ ＲＦパワー ５０Ｗ 圧力 ０．０１６ＰａThen, an Al-Cu / Ti wiring layer is formed by resist patterning and dry etching under the following conditions. Thereby, the second metal film 22 is formed. Condition gas BCl 3 / Cl 2 = 60 / 90s
ccm Microwave power 1000W RF power 50W Pressure 0.016Pa

【００８４】（ｅ）ＴｉＮ膜２５ａをスパッタで形成さ
せ、更に第３の金属膜２３を形成するためのブランケッ
ト−Ｗを形成させ、ヴィアホール埋め込みを行う。条件
は実施例４におけると同様であり、同様にパターニング
する。詳しい説明は省略する。(E) The TiN film 25a is formed by sputtering, a blanket-W for forming the third metal film 23 is formed, and the via holes are filled. The conditions are the same as in Example 4, and patterning is performed in the same manner. Detailed explanation is omitted.

【００８５】レジストパターニングを行い、その後Ｗを
下記条件のドライエッチングでパターニングする。 条件 ガス ＳＦ6 ／５０ｓｃｃｍ マイクロ波パワー ８５０Ｗ ＲＦパワー １５０Ｗ 圧力 １．３３ＰａAfter resist patterning, W is patterned by dry etching under the following conditions. Condition gas SF 6 / 50sccm Microwave power 850W RF power 150W Pressure 1.33Pa

【００８６】Ａｌ−Ｃｕ（０．５％）／Ｔｉをスパッタ
で形成する。まず、下記条件でＴｉを成膜する。 Ｔｉ成膜条件 パワー ４ｋＷ 成膜温度 １５０℃ ガス Ａｒ＝１００ｓｃｃｍ 膜厚 ３０ｎｍ 圧力 ０．４７ＰａAl-Cu (0.5%) / Ti is formed by sputtering. First, a Ti film is formed under the following conditions. Ti film forming condition power 4 kW film forming temperature 150 ° C. gas Ar = 100 sccm film thickness 30 nm pressure 0.47 Pa

【００８７】次に、第４の金属膜２８を形成するＡｌ−
Ｃｕ（０．５％）を下記条件で成膜する。 成膜条件 パワー ２２．５ｋＷ 成膜温度 １５０℃ ガス Ａｒ＝４０ｓｃｃｍ 膜厚 ５００ｎｍ 圧力 ０．４７ＰａNext, Al-- forming the fourth metal film 28 is formed.
Cu (0.5%) is formed under the following conditions. Film forming condition power 22.5 kW Film forming temperature 150 ° C. Gas Ar = 40 sccm Film thickness 500 nm Pressure 0.47 Pa

【００８８】その後、レジストパターニング及び下記条
件のドライエッチングで、Ａｌ−Ｃｕ／Ｔｉ配線層を形
成させる。 条件 ガス ＢＣｌ3 ／Ｃｌ2 ＝６０／９０ｓ
ｃｃｍ マイクロ波パワー １０００Ｗ ＲＦパワー ５０Ｗ 圧力 ０．０１６ＰａAfter that, an Al—Cu / Ti wiring layer is formed by resist patterning and dry etching under the following conditions. Condition gas BCl 3 / Cl 2 = 60 / 90s
ccm Microwave power 1000W RF power 50W Pressure 0.016Pa

【００８９】上記プロセスで、図８に示したように、安
定構造を有するスタックコンタクト構造を有するデバイ
スを形成できる。By the above process, as shown in FIG. 8, a device having a stack contact structure having a stable structure can be formed.

【００９０】[0090]

【発明の効果】上述の如く、本発明の半導体装置及び半
導体装置の製造方法によれば、接続孔の埋め込み金属膜
をエッチバックすることに伴うプラグロスの問題がな
く、その上層の配線形成がカバレージ良く実現でき、コ
ンタクトを安定に形成でき、配線の信頼性を向上でき、
しかもプロセス的に容易で、ＥＭ耐性の良好な半導体装
置が得られるという効果がある。As described above, according to the semiconductor device and the method of manufacturing the semiconductor device of the present invention, there is no problem of plug loss due to the etching back of the buried metal film of the connection hole, and the wiring formation of the upper layer is covered. Well realized, the contact can be formed stably, the reliability of the wiring can be improved,
Moreover, there is an effect that a semiconductor device which is easy in process and has a good EM resistance can be obtained.

【図面の簡単な説明】[Brief description of drawings]

【図１】実施例１の工程を順に断面図で示すものである
（１）。1A to 1C are sectional views showing steps of Example 1 in order (1).

【図２】実施例１の工程を順に断面図で示すものである
（２）。2A to 2C are sectional views showing the steps of Example 1 in order (2).

【図３】実施例１の工程を順に断面図で示すものである
（３）。FIG. 3 is a sectional view showing the steps of Example 1 in order (3).

【図４】実施例１の工程を順に断面図で示すものである
（４）。FIG. 4 is a sectional view showing the steps of Example 1 in order (4).

【図５】実施例１の工程を順に断面図で示すものである
（５）。FIG. 5 is a sectional view showing the steps of Example 1 in order (5).

【図６】実施例３の工程を順に断面図で示すものであ
る。6A to 6C are sectional views showing steps of Example 3 in order.

【図７】実施例４の工程を順に断面図で示すものであ
る。FIG. 7 is a sectional view showing the steps of Example 4 in order.

【図８】実施例５の工程を順に断面図で示すものであ
る。FIG. 8 is a sectional view showing the steps of Example 5 in order.

【図９】従来技術を示す図である。FIG. 9 is a diagram showing a conventional technique.

【図１０】従来技術を示す図である。FIG. 10 is a diagram showing a conventional technique.

【図１１】従来技術を示す図である。FIG. 11 is a diagram showing a conventional technique.

【図１２】従来技術を示す図である。FIG. 12 is a diagram showing a conventional technique.

【図１３】従来技術を示す図である。FIG. 13 is a diagram showing a conventional technique.

【符号の説明】[Explanation of symbols]

１ 半導体基板 ２１ 第１の金属膜 ２２ 第２の金属膜 ２３ 第３の金属膜 ２４，２８ 第４の金属膜 １９ 第１の接続孔 １９ａ 第２の接続孔 1 Semiconductor substrate 21 First Metal Film 22 Second metal film 23 Third Metal Film 24, 28 Fourth metal film 19 First connection hole 19a Second connection hole

───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平１−214137（ＪＰ，Ａ) 特開 平３−44034（ＪＰ，Ａ) 特開 平３−123032（ＪＰ，Ａ) 特開 平３−280533（ＪＰ，Ａ) 特開 平４−80960（ＪＰ，Ａ) 特開 平５−144768（ＪＰ，Ａ) 特開 平５−144946（ＪＰ，Ａ) 特開 平５−175347（ＪＰ，Ａ) 特開 平６−29405（ＪＰ，Ａ) 特開 平６−209047（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H01L 21/3205 H01L 21/321 H01L 21/3213 H01L 21/768 ─────────────────────────────────────────────────── ─── Continuation of the front page (56) Reference JP-A-1-214137 (JP, A) JP-A-3-44034 (JP, A) JP-A-3-123032 (JP, A) JP-A-3- 280533 (JP, A) JP 4-80960 (JP, A) JP 5-144768 (JP, A) JP 5-144946 (JP, A) JP 5-175347 (JP, A) JP-A-6-29405 (JP, A) JP-A-6-209047 (JP, A) (58) Fields investigated (Int.Cl. 7 , DB name) H01L 21/3205 H01L 21/321 H01L 21/3213 H01L 21/768

Claims (4)

(57)【特許請求の範囲】(57) [Claims] 【請求項１】第1の接続孔内を第1の金属膜で埋め込むと
ともに、更に、第1の接続孔の開口周辺部にも該第1の金
属膜を形成し、更に、該第1の金属膜及び第1の接続孔が
形成された絶縁膜上に第2の金属膜を形成するととも
に、前記第1の接続孔の開口周辺部に形成する第1の金属
膜は、前記第2の金属膜の配線の長手方向の周辺に対し
てのみ形成し、かつ前記第2の金属膜は、前記第1の金属
膜全面を覆い、更に長手方向に延びている接続構造を有
することを特徴とする半導体装置。1. A first metal film is embedded in the first connection hole, and further, the first metal film is formed around the opening of the first connection hole, and further, the first metal film is formed. A second metal film is formed on the insulating film in which the metal film and the first connection hole are formed, and the first metal film formed in the peripheral portion of the opening of the first connection hole is the second metal film. The metal film is formed only on the periphery of the wiring in the longitudinal direction , and the second metal film is the first metal film.
A semiconductor device having a connection structure which covers the entire surface of the film and further extends in the longitudinal direction . 【請求項２】第1の接続孔内を第1の金属膜で埋め込むと
ともに、更に、該第1の接続孔の開口周辺部にも該第1の
金属膜を形成し、更に、該第1の金属膜及び第1の接続孔
が形成された絶縁膜上に第２の金属膜を形成し、その上
に、第２の接続孔を形成し、第3の金属膜で埋め込み、
更に第4の金属膜を形成するとともに、前記第1の接続孔
の開口周辺部に形成する第1の金属膜は、前記第2の金属
膜の配線の長手方向の周辺に対してのみ形成し、かつ前
記第2の金属膜は、前記第1の金属膜全面を覆い、更に長
手方向に延びている構造を有することを特徴とする半導
体装置。2. A first metal film is embedded in the first connection hole, and further, the first metal film is formed around the opening of the first connection hole, and the first metal film is further formed. Forming a second metal film on the insulating film having the metal film and the first connection hole formed therein, forming a second connection hole on the second metal film, and filling with a third metal film,
Further to form a fourth metal film, a first metal film formed on the opening peripheral portion of the first connection hole is formed only with respect to the longitudinal direction of the periphery of the wiring of the second metal film And before
The second metal film covers the entire surface of the first metal film and has a longer length.
A semiconductor device having a structure extending in a hand direction . 【請求項３】第1の接続孔内をＷ膜である第1の金属膜で
埋め込むとともに、更に、該第1の接続孔の開口周辺部
にも該Ｗ膜である第1の金属膜を形成し、更に、該第1の
金属膜及び第1の接続孔が形成された絶縁膜上にＡｌも
しくはＡｌ系合金膜である第２の金属膜を形成し、その
上に、第２の接続孔を形成し、Ｗ膜である第3の金属膜
で埋め込み、更にＡｌもしくはＡｌ系合金膜である第4
の金属膜を形成するとともに、前記第1の接続孔の開口
周辺部に形成する第1の金属膜は、前記第2の金属膜の配
線の長手方向の周辺に対してのみ形成し、かつ前記第2
の金属膜は、前記第1の金属膜全面を覆い、更に長手方
向に延びている構造を有することを特徴とする半導体装
置。3. A first metal film, which is a W film, is formed in the first connection hole.
In addition to embedding, further around the opening of the first connection hole
Also, a first metal film that is the W film is formed, and further, the first metal film is formed.
Al is also formed on the insulating film on which the metal film and the first connection hole are formed.
A second metal film, which is preferably an Al-based alloy film, is formed, and
A second connection hole is formed on the third metal film which is a W film.
Embedded with Al and Al-based alloy film
Forming the metal film and opening the first connection hole
The first metal film formed on the peripheral portion is the same as the second metal film.
Formed only around the longitudinal direction of the line, and said second
Metal film covers the entire surface of the first metal film and
A semiconductor device having a structure extending in a direction
Place 【請求項４】第1の接続孔内を第1の金属膜で埋め込むと
ともに、更に、該第1の接続孔の開口周辺部にも該第1の
金属膜を形成し、更に、該第1の金属膜及び第1の接続孔
が 形成された絶縁膜上に第2の金属膜を形成した構造を
有する半導体装置の製造方法であって、 前記第1の接続孔の開口周辺部に形成する第1の金属膜
は、前記第2の金属膜の配線の長手方向の周辺に対して
のみ形成し、かつ前記第2の金属膜は、前記第1の金属膜
全面を覆い、更に長手方向に延びている構造を有するも
のであり、 該第1の金属膜をパターニングした後、前記第2の金属膜
をパターニングすることによって、前記第1の金属膜が
前記第2の金属膜の配線の長手方向の周辺に対してのみ
形成し、かつ前記第2の金属膜は該第1の金属膜全面を覆
い、更に長手方向に延びている構造としたこと を特徴と
する半導体装置の製造方法。4. When the inside of the first connection hole is filled with a first metal film
In addition, in addition, the first connecting hole is also provided at the periphery of the opening of the first connecting hole.
A metal film is formed, and the first metal film and the first connection hole are further formed.
The structure in which the second metal film is formed on the insulating film on which the
A method of manufacturing a semiconductor device having the first metal film, which is formed in a peripheral portion of an opening of the first connection hole.
Is to the periphery of the wiring of the second metal film in the longitudinal direction.
Formed only, and the second metal film is the first metal film
It has a structure that covers the entire surface and extends in the longitudinal direction.
And than, after patterning the first metal film, the second metal film
By patterning the first metal film
Only for the periphery of the second metal film wiring in the longitudinal direction
And the second metal film covers the entire surface of the first metal film.
The method for manufacturing a semiconductor device is characterized in that the structure further extends in the longitudinal direction .
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