JP3243656B2 - ディスクアレイ装置 - Google Patents
ディスクアレイ装置Info
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Description
ディスク装置(以下、各々のディスク装置を物理デバイ
スという。)を同期並列処理させる事により信頼性が高
く高性能な1台のディスク装置(以下、論理デバイスと
いう。)を実現するディスクアレイ装置に関する。
は、“A Case for Redandant A
rrays of Inexpensive Disk
s(=RAID)”(Technical Repor
t UCB/CSD 87/391、December
1987)でRAID1〜5が提案されているが、障
害ディスク装置を交換する時のオペレータまたは保守者
とのマンマシンインタフェースについては、上記レポー
トには何も提案されていない。また、最近各社から発表
されているディスクアレイ装置においては、ホストシス
テム側の負担を軽減する事を考えて、ディスクアレイ装
置側単独で障害ディスクの処理を行っているのが現状で
ある。
クアレイ装置は、ホストシステム側の負担が少なく優れ
ている様に考えられがちであるが、ディスク装置の交換
条件が画一的になり、予防保守の観点から早めにディス
ク装置を交換する等の場合に対応できない構造に成って
しまっていた。
するために、従来のディスクアレイ装置において、ホス
トインタフェースを通じてホストコンピュータから正常
/縮退/修復の各動作モード及び関連するディスク装置
番号を指定できる構造にし、オペレータまたは保守者が
ディスク装置を容易に交換できるマンマシンインタフェ
ースを構築する事にある。
装置は、ホストコンピュータに接続されるホストインタ
フェースと、前記ホストインタフェースを制御するホス
トインタフェース制御回路と、前記ホストインタフェー
ス制御回路に接続されるホストデータバスと、前記ホス
トデータバスに接続され、データ変換を実施するアレイ
データ制御回路と、前記アレイデータ制御回路に接続さ
れるN個(Nは2以上の整数)のアレイデータバスと、
前記N個のアレイデータバスの各々に接続されるN個の
デバイスインタフェース制御回路と、前記N個のデバイ
スインタフェース制御回路の各々に接続されるN個のデ
バイスインタフェースと、前記N個のデバイスインタフ
ェースの各々に接続されるN台のディスク装置と、前記
各制御回路を制御するマイクロプロセッサ制御回路と、
前記各制御回路と前記マイクロプロセッサ制御回路との
間の制御信号線とを有するディスクアレイ装置におい
て、前記ホストインタフェースを通じて前記ホストコン
ピュータから指令される正常/縮退/修復の各動作モー
ド及び関連するディスク装置番号を貯蔵する為の動作モ
ード/ディスク装置番号貯蔵手段を有し、前記マイクロ
プロセッサ制御回路は、前記動作モードの内容が正常モ
ードの場合には前記関連するディスク装置番号を無視
し、前記N台のディスク装置においてホストコンピュー
タからの書き込み/読み取り指令を処理し、前記動作モ
ードの内容が縮退モードの場合には前記関連するディス
ク装置番号で指定されたディスク装置を除くN−1台の
ディスク装置においてホストコンピュータからの書き込
み/読み取り指令を処理し、また、前記動作モードの内
容が修復モードの場合には、媒体へのデータの書き込み
時は前記N台のディスク装置においてホストコンピュー
タからの書き込み指令を処理し、媒体からのデータの読
み取り時は前記関連するディスク装置番号で指定された
ディスク装置を除くN−1台のディスク装置においてホ
ストコンピュータからの読み取り指令を処理する構成を
備えて、上記課題を解決する。
する。
図である。図1において、本発明のディスクアレイ装置
は、ホストコンピュータに接続されるホストインタフェ
ース1と、前記ホストインタフェース1を制御するホス
トインタフェース制御回路2と、前記ホストインタフェ
ース制御回路2に接続されるホストデータバス3と、前
記ホストデータバス3に接続されデータを処理するアレ
イデータ制御回路4と、前記アレイデータ制御回路4に
接続されるN個(Nは2以上の整数)のアレイデータバ
ス5と、前記N個のアレイデータバス5の各々に接続さ
れるN個のデバイスインタフェース制御回路6と、前記
N個のデバイスインタフェース制御回路6の各々に接続
されるN個のデバイスインタフェース7と、前記N個の
デバイスインタフェース7の各々に接続されるN台の物
理デバイス8と、前記N台の物理デバイス8を総称する
論理デバイス9と、前記各制御回路を制御するマイクロ
プロセッサ制御回路10と、前記マイクロプロセッサ制
御回路10と前記ホストインタフェース制御回路2との
間の制御信号線11と、前記マイクロプロセッサ制御回
路10と前記アレイデータ制御回路4との間の制御信号
線12と、前記マイクロプロセッサ制御回路10と前記
N個のデバイスインタフェース制御回路6との間の制御
信号線13とを有する従来のディスクアレイ装置におい
て、前記ホストインタフェース1を通じて前記ホストコ
ンピュータから指令される正常/縮退/修復の各動作モ
ード及び関連するディスク装置番号を貯蔵する為の動作
モード/ディスク装置番号貯蔵手段14と、前記マイク
ロプロセッサ制御回路10と前記動作モード/ディスク
装置番号貯蔵手段14との間の制御信号線15とを備え
ている。
ド動作について説明する。
ス1を通してディスクアレイ装置に対してデータリード
命令を発信すると、ホストインタフェース制御回路2を
監視しているマイクロプロセッサ制御回路10は、デー
タリード命令が転送されてきたことを検出し、アレイデ
ータバス5とホストデータバス3との間のリードデータ
パスの確立を行うようにアレイデータ制御回路4へ命令
を送る。次に、マイクロプロセッサ制御回路10は、デ
バイスインタフェース制御回路6から制御信号線13を
通して送られてくるステータス情報によりアクセス可能
であると判断すると、制御信号線13を通してデバイス
インタフェース制御回路6を制御するのに必要な命令を
デバイスインタフェース制御回路6に送る。デバイスイ
ンタフェース制御回路6は、送られてきた命令を解読し
物理デバイス8からのリード動作を行う。この動作中に
デバイスインタフェース制御回路6に対してマイクロプ
ロセッサ制御回路10から命令が送られてきた場合に
は、マイクロプロセッサ制御回路10からの命令が受け
付けられないという意味のステータス情報を制御信号線
13を通してマイクロプロセッサ制御回路10に送られ
る。物理デバイス8がリード動作を終了すると、デバイ
スインタフェース制御回路6は、制御信号線13を通し
てマイクロプロセッサ制御回路10にアクセス可能とい
う意味の制御情報を送り、データリード命令動作を終了
する。
イト動作について説明する。
ス1を通してディスクアレイ装置に対してデータライト
命令を発信すると、ホストインタフェース制御回路2を
監視しているマイクロプロセッサ制御回路10はデータ
ライト命令が転送されてきたことを検出し、アレイデー
タバス5とホストデータバス3との間のライトデータパ
スの確立を行うようにアレイデータ制御回路4へ命令を
送る。次に、マイクロプロセッサ制御回路10は、デバ
イスインタフェース制御回路6からの制御信号線13を
通して送られてくるステータス情報によりアクセス可能
と判断すると、制御信号線13を通してデバイスインタ
フェース制御回路6を制御するのに必要な命令をデバイ
スインタフェース制御回路6に送る。デバイスインタフ
ェース制御回路6は、送られてきた命令を解読し物理デ
バイス8へのライト動作を行う。この動作中にデバイス
インタフェース制御回路6に対してマイクロプロセッサ
制御回路10から命令が送られてきた場合には、マイク
ロプロセッサ制御回路10からの命令が受け付けられな
いという意味のステータス情報を制御信号線13を通し
てマイクロプロセッサ制御回路10に送られる。物理デ
バイス8がライト動作を終了すると、デバイスインタフ
ェース制御回路6は、制御信号線13を通してマイクロ
プロセッサ制御回路10にアクセス可能という意味の制
御情報を送り、データライト命令動作を終了する。
ト及びリード動作時における動作モードと使用ディスク
装置との関連について説明する。
ンタフェース1を通してホストコンピュータから指令さ
れる正常/縮退/修復の各動作モード及び関連するディ
スク装置番号を動作モード/ディスク装置番号貯蔵手段
14に貯蔵する。それと同時に電源OFF対策用にN台
のディスク装置の特定領域に貯蔵する。マイクロプロセ
ッサ制御回路10は、この動作モードの内容が正常モー
ドの場合には関連するディスク装置番号を無視し、N台
のディスク装置8においてホストコンピュータからのラ
イト及びリード命令を処理し、動作モードの内容が縮退
モードの場合には関連するディスク装置番号で指定され
たディスク装置8を除くN−1台のディスク装置8にお
いてホストコンピュータからのリード及びライト命令を
処理し、また、前記動作モードの内容が修復モードの場
合には、媒体へのデータのライト時はN台のディスク装
置8においてホストコンピュータからのライト命令を処
理し、媒体からのデータのリード時は関連するディスク
装置番号で指定されたディスク装置8を除くN−1台の
ディスク装置8においてホステコンピュータからのリー
ド命令を処理する。
ホストインタフェースを通じてホストコンピュータから
正常/縮退/修復の各動作モード及び関連するディスク
装置番号を指定できる構造にする事により、予防保守等
の為に、オペレータまたは保守者がディスク装置を容易
に交換できる優れたマンマシンインタフェースを持った
ディスクアレイ装置を提供できる。
ェース制御回路との間の制御信号線 12 マイクロプロセッサ制御回路とアレイデータ制
御回路との間の制御信号線 13 マイクロプロセッサ制御回路とデバイスインタ
フェース制御回路との間の制御信号線 14 動作モード/ディスク装置番号貯蔵手段 15 マイクロプロセッサ制御回路と動作モード/デ
ィスク装置番号貯蔵手段との間の制御信号線
Claims (1)
- 【請求項1】 ホストコンピュータに接続されるホスト
インタフェースと、前記ホストインタフェースを制御す
るホストインタフェース制御回路と、前記ホストインタ
フェース制御回路に接続されるホストデータバスと、前
記ホストデータバスに接続され、データ変換を実施する
アレイデータ制御回路と、前記アレイデータ制御回路に
接続されるN個(Nは2以上の整数)のアレイデータバ
スと、前記N個のアレイデータバスの各々に接続される
N個のデバイスインタフェース制御回路と、前記N個の
デバイスインタフェース制御回路の各々に接続されるN
個のデバイスインタフェースと、前記N個のデバイスイ
ンタフェースの各々に接続されるN台のディスク装置
と、前記各制御回路を制御するマイクロプロセッサ制御
回路と、前記各制御回路と前記マイクロプロセッサ制御
回路との間の制御信号線とを有するディスクアレイ装置
において、前記ホストインタフェースを通じて前記ホス
トコンピュータから指令される正常/縮退/修復の各動
作モード及び関連するディスク装置番号を貯蔵する為の
動作モード/ディスク装置番号貯蔵手段を有し、前記マ
イクロプロセッサ制御回路は、前記動作モードの内容が
正常モードの場合には前記関連するディスク装置番号を
無視し、前記N台のディスク装置においてホストコンピ
ュータからの書き込み/読み取り指令を処理し、前記動
作モードの内容が縮退モードの場合には前記関連するデ
ィスク装置番号で指定されたディスク装置を除くN−1
台のディスク装置においてホストコンピュータからの書
き込み/読み取り指令を処理し、また、前記動作モード
の内容が修復モードの場合には、媒体へのデータの書き
込み時は前記N台のディスク装置においてホストコンピ
ュータからの書き込み指令を処理し、媒体からのデータ
の読み取り時は前記関連するディスク装置番号で指定さ
れたディスク装置を除くN−1台のディスク装置におい
てホストコンピュータからの読み取り指令を処理するこ
とを特徴とするアレイディスク装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP33590392A JP3243656B2 (ja) | 1992-12-16 | 1992-12-16 | ディスクアレイ装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP33590392A JP3243656B2 (ja) | 1992-12-16 | 1992-12-16 | ディスクアレイ装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH06187250A JPH06187250A (ja) | 1994-07-08 |
JP3243656B2 true JP3243656B2 (ja) | 2002-01-07 |
Family
ID=18293663
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP33590392A Expired - Fee Related JP3243656B2 (ja) | 1992-12-16 | 1992-12-16 | ディスクアレイ装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3243656B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008234385A (ja) * | 2007-03-22 | 2008-10-02 | Nec Corp | 冗長システム、サーバ、情報処理装置、制御方法、及びプログラム |
-
1992
- 1992-12-16 JP JP33590392A patent/JP3243656B2/ja not_active Expired - Fee Related
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Publication number | Publication date |
---|---|
JPH06187250A (ja) | 1994-07-08 |
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