JP3182339B2 - 映像信号処理回路 - Google Patents
映像信号処理回路Info
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- JP3182339B2 JP3182339B2 JP13922196A JP13922196A JP3182339B2 JP 3182339 B2 JP3182339 B2 JP 3182339B2 JP 13922196 A JP13922196 A JP 13922196A JP 13922196 A JP13922196 A JP 13922196A JP 3182339 B2 JP3182339 B2 JP 3182339B2
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- JP
- Japan
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- video signal
- circuit
- signal processing
- processing circuit
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- Picture Signal Circuits (AREA)
- Transforming Light Signals Into Electric Signals (AREA)
Description
【０００１】
【発明の属する技術分野】本発明は、ビデオカメラやデ
ィジタルスチルカメラ等において、電源投入時に高速に
映像信号の処理を立ち上げる映像信号処理回路に関す
る。
ィジタルスチルカメラ等において、電源投入時に高速に
映像信号の処理を立ち上げる映像信号処理回路に関す
る。
【０００２】
【従来の技術】ビデオカメラやディジタルスチルカメラ
等において、カメラ部に電源を投入した瞬間に撮影を行
う場合には、撮像映像信号が立ち上がるのに時間を要す
ると、シャッタチャンスを逃すことになる。特に、ディ
ジタルスチルカメラでは、シャッタボタンが電源スイッ
チの機能を兼ねている場合があり、消費電力削減の為
に、通常は電源をＯＦＦ状態に保持しておき、シャッタ
ーボタンを押すと同時に電源が入り、シャッターがきら
れて得られた画像データがメモリに記憶される。そこ
で、撮像映像信号の立ち上がりに時間がかかると常にシ
ャッターチャンスを逃すことになる。
等において、カメラ部に電源を投入した瞬間に撮影を行
う場合には、撮像映像信号が立ち上がるのに時間を要す
ると、シャッタチャンスを逃すことになる。特に、ディ
ジタルスチルカメラでは、シャッタボタンが電源スイッ
チの機能を兼ねている場合があり、消費電力削減の為
に、通常は電源をＯＦＦ状態に保持しておき、シャッタ
ーボタンを押すと同時に電源が入り、シャッターがきら
れて得られた画像データがメモリに記憶される。そこ
で、撮像映像信号の立ち上がりに時間がかかると常にシ
ャッターチャンスを逃すことになる。
【０００３】ここで、映像信号を扱う従来のカメラの映
像信号処理回路の一例を図２を参考に説明する。図２に
おいて、１は入射光を光電変換して撮像信号に変換する
ＣＣＤイメージャであり、このＣＣＤイメージャ１出力
は経路１０、１１を通って２系統の信号となり、それぞ
れＤＣカット用のコンデンサＣ１、Ｃ２を経て、ＣＤＳ
回路２に入力される。このＣＤＳ回路２はクランプ回路
３、４及びサンプルホールド（Ｓ／Ｈ）回路５、６、７
にて構成される周知の２重サンプリング回路である。
像信号処理回路の一例を図２を参考に説明する。図２に
おいて、１は入射光を光電変換して撮像信号に変換する
ＣＣＤイメージャであり、このＣＣＤイメージャ１出力
は経路１０、１１を通って２系統の信号となり、それぞ
れＤＣカット用のコンデンサＣ１、Ｃ２を経て、ＣＤＳ
回路２に入力される。このＣＤＳ回路２はクランプ回路
３、４及びサンプルホールド（Ｓ／Ｈ）回路５、６、７
にて構成される周知の２重サンプリング回路である。
【０００４】クランプ回路３は、経路１０からの撮像信
号を所定レベル（例えば２．５Ｖ）にクランプするもの
で、クランプ回路４も同様に経路１１からの撮像信号を
前記所定レベルにクランプする。
号を所定レベル（例えば２．５Ｖ）にクランプするもの
で、クランプ回路４も同様に経路１１からの撮像信号を
前記所定レベルにクランプする。
【０００５】Ｓ／Ｈ回路５は、クランプ回路３からのＣ
ＣＤ出力をサンプリングパルス（ＨＰ）にてサンプルホ
ールドするもので、パルス（ＨＰ）は図３の（Ｂ）に示
すようにＣＣＤ出力の黒レベルを検出できるタイミング
に設定されており、Ｓ／Ｈ回路５出力は図３の（Ｄ）に
示すようにＣＣＤ出力の黒レベルを検出したことにな
る。
ＣＤ出力をサンプリングパルス（ＨＰ）にてサンプルホ
ールドするもので、パルス（ＨＰ）は図３の（Ｂ）に示
すようにＣＣＤ出力の黒レベルを検出できるタイミング
に設定されており、Ｓ／Ｈ回路５出力は図３の（Ｄ）に
示すようにＣＣＤ出力の黒レベルを検出したことにな
る。
【０００６】Ｓ／Ｈ回路６はクランプ回路４からのＣＣ
Ｄ出力をサンプリングパルス（ＤＰ）にてサンプルホー
ルドするもので、パルス（ＤＰ）は図３の（Ｃ）に示す
ようにＣＣＤ出力の信号成分を検出できるタイミングに
設定されており、Ｓ／Ｈ回路６出力は図３の（Ｆ）に示
すようにＣＣＤ出力の信号成分を検出したことになる。
Ｄ出力をサンプリングパルス（ＤＰ）にてサンプルホー
ルドするもので、パルス（ＤＰ）は図３の（Ｃ）に示す
ようにＣＣＤ出力の信号成分を検出できるタイミングに
設定されており、Ｓ／Ｈ回路６出力は図３の（Ｆ）に示
すようにＣＣＤ出力の信号成分を検出したことになる。
【０００７】こうして得られた黒レベルと信号成分レベ
ルの差を取り出せば、有効な撮像信号成分を得ることが
できるが、これらの信号には、サンプリングパルスの漏
れ込みによるノイズが含まれており、このままではＳ／
Ｎが良くない。そこで、図３の（Ｅ）に示すように、Ｓ
／Ｈ回路５出力をサンプリングパルス（ＤＰ）によって
再びサンプルホールドすると、パルス漏れによるノイズ
の位相をＳ／Ｈ回路６出力に合わせることができ、Ｓ／
Ｈ回路６、７出力の差を減算器８にて取り出せば、図３
の（Ｇ）に示すようにノイズが除去された撮像信号成分
を得ることができる。
ルの差を取り出せば、有効な撮像信号成分を得ることが
できるが、これらの信号には、サンプリングパルスの漏
れ込みによるノイズが含まれており、このままではＳ／
Ｎが良くない。そこで、図３の（Ｅ）に示すように、Ｓ
／Ｈ回路５出力をサンプリングパルス（ＤＰ）によって
再びサンプルホールドすると、パルス漏れによるノイズ
の位相をＳ／Ｈ回路６出力に合わせることができ、Ｓ／
Ｈ回路６、７出力の差を減算器８にて取り出せば、図３
の（Ｇ）に示すようにノイズが除去された撮像信号成分
を得ることができる。
【０００８】
【発明が解決しようとする課題】ここで、ＣＣＤ出力が
クランプ回路３、４のクランプ電位に到達している場合
には、得られる信号成分は正規の信号となるが、ＣＣＤ
出力がクランプ電位に到達しない間には、このＣＤＳ回
路２からの出力は正常な信号ではなくなる。
クランプ回路３、４のクランプ電位に到達している場合
には、得られる信号成分は正規の信号となるが、ＣＣＤ
出力がクランプ電位に到達しない間には、このＣＤＳ回
路２からの出力は正常な信号ではなくなる。
【０００９】即ち、図４の（Ａ）、（Ｂ）はそれぞれク
ランプ回路３、４の入力レベルの直流成分レベルの変化
のみを表した波形図であり、電源投入時に０Ｖの電圧が
徐々に安定状態でのクランプ電位（２．５Ｖ）クランプ
されていく様子が示されており、この０Ｖから２．５Ｖ
への移行に要する期間には正常な撮像信号は期待できな
い。そこで、電源投入後に映像信号を高速で立ち上げる
場合には、ＣＣＤ出力のクランプ電位に到達する時間を
短くする必要がある。
ランプ回路３、４の入力レベルの直流成分レベルの変化
のみを表した波形図であり、電源投入時に０Ｖの電圧が
徐々に安定状態でのクランプ電位（２．５Ｖ）クランプ
されていく様子が示されており、この０Ｖから２．５Ｖ
への移行に要する期間には正常な撮像信号は期待できな
い。そこで、電源投入後に映像信号を高速で立ち上げる
場合には、ＣＣＤ出力のクランプ電位に到達する時間を
短くする必要がある。
【００１０】
【課題を解決するための手段】本発明は、電源投入直後
の所定期間に入力映像信号に所定のバイアスを付与しク
ランプ回路に入力する映像信号処理回路であり、特に、
入力映像信号はＣＣＤイメージャからの撮像信号であ
り、クランプ回路の後段にはサンプルホールド回路を有
する電子式スチルカメラに使用されることを特徴とす
る。
の所定期間に入力映像信号に所定のバイアスを付与しク
ランプ回路に入力する映像信号処理回路であり、特に、
入力映像信号はＣＣＤイメージャからの撮像信号であ
り、クランプ回路の後段にはサンプルホールド回路を有
する電子式スチルカメラに使用されることを特徴とす
る。
【００１１】
【発明の実施の形態】以下、図面に従い本発明の一実施
例について説明する。図１は本実施例の回路図である。
図中、従来例の図２と同一部分には同一符号を付して説
明を省略する。
例について説明する。図１は本実施例の回路図である。
図中、従来例の図２と同一部分には同一符号を付して説
明を省略する。
【００１２】図１において、図２との相違点は、バイア
ス付与回路２０とこのバイアス付与回路２０からのバイ
アスを経路１０及び１１に付与する信号路を配した点で
ある。具体的には、バイアス付与回路は電源線路（Ｖ
ｃ）とアース間に抵抗Ｒ１、Ｒ２とコンデンサＣ３を直
列的に接続し、抵抗Ｒ１、Ｒ２の接続中点にトランジス
タＱ１のベースを結合し、トランジスタＱ１のエミッタ
を電源線路に結合し、コレクタとアース間に抵抗Ｒ３、
Ｒ４を直列的に接続して構成され、抵抗Ｒ３、Ｒ４の接
続中点をダイオードＤ１を介して経路１０と、またダイ
オードＤ２を介して経路１１とそれぞれ結合することで
両経路にバイアスを付与している。
ス付与回路２０とこのバイアス付与回路２０からのバイ
アスを経路１０及び１１に付与する信号路を配した点で
ある。具体的には、バイアス付与回路は電源線路（Ｖ
ｃ）とアース間に抵抗Ｒ１、Ｒ２とコンデンサＣ３を直
列的に接続し、抵抗Ｒ１、Ｒ２の接続中点にトランジス
タＱ１のベースを結合し、トランジスタＱ１のエミッタ
を電源線路に結合し、コレクタとアース間に抵抗Ｒ３、
Ｒ４を直列的に接続して構成され、抵抗Ｒ３、Ｒ４の接
続中点をダイオードＤ１を介して経路１０と、またダイ
オードＤ２を介して経路１１とそれぞれ結合することで
両経路にバイアスを付与している。
【００１３】次に上述の回路の動作を説明する。電源が
投入されると、抵抗Ｒ１、Ｒ２及びコンデンサＣ３は微
分回路として機能し、一時的にトランジスタＱ１のベー
ス電位がＬ（ロウ）レベルとなってトランジスタＱ１が
導通し、電圧Ｖｃを抵抗Ｒ４及びＲ５で分圧された電圧
値が経路１０及び１１にバイアスとして付加される。従
って、経路１０、１１での電圧値がこのバイアス分だけ
上昇し、クランプ電位に達する時間が短くなる。そし
て、コンデンサＣ３がチャージされるとトランジスタＱ
１のベース電圧はＨ（ハイ）となり、トランジスタＱ１
は非導通となってバイアスの付加は止まる。
投入されると、抵抗Ｒ１、Ｒ２及びコンデンサＣ３は微
分回路として機能し、一時的にトランジスタＱ１のベー
ス電位がＬ（ロウ）レベルとなってトランジスタＱ１が
導通し、電圧Ｖｃを抵抗Ｒ４及びＲ５で分圧された電圧
値が経路１０及び１１にバイアスとして付加される。従
って、経路１０、１１での電圧値がこのバイアス分だけ
上昇し、クランプ電位に達する時間が短くなる。そし
て、コンデンサＣ３がチャージされるとトランジスタＱ
１のベース電圧はＨ（ハイ）となり、トランジスタＱ１
は非導通となってバイアスの付加は止まる。
【００１４】図４の（Ｃ）はトランジスタＱ１の導通／
非導通のタイミングを示しており、トランジスタＱ１が
導通している期間では、図４の（Ｄ）、（Ｅ）に示すよ
うに、経路１０、１１の直流成分レベルは（Ａ）、
（Ｂ）に比べて急激に上昇して安定状態でのクランプ電
位に達するまでに要する時間は（Ａ）、（Ｂ）に比べて
時間Ｔだけ短くなり、結果的にこの時間Ｔ分だけＣＤＳ
回路２から正規の撮像信号が速く得られることになる。
尚、図４において（Ａ）、（Ｂ）、（Ｄ）、（Ｅ）の各
波形図は、ＣＣＤイメージャ１からコンデンサＣ１、Ｃ
２を経て入力される撮像信号成分を図示省略し、直流成
分のみの波形を示している。
非導通のタイミングを示しており、トランジスタＱ１が
導通している期間では、図４の（Ｄ）、（Ｅ）に示すよ
うに、経路１０、１１の直流成分レベルは（Ａ）、
（Ｂ）に比べて急激に上昇して安定状態でのクランプ電
位に達するまでに要する時間は（Ａ）、（Ｂ）に比べて
時間Ｔだけ短くなり、結果的にこの時間Ｔ分だけＣＤＳ
回路２から正規の撮像信号が速く得られることになる。
尚、図４において（Ａ）、（Ｂ）、（Ｄ）、（Ｅ）の各
波形図は、ＣＣＤイメージャ１からコンデンサＣ１、Ｃ
２を経て入力される撮像信号成分を図示省略し、直流成
分のみの波形を示している。
【００１５】コンデンサＣ３、抵抗Ｒ１、Ｒ２の各値を
調整することにより、クランプ回路３、４への入力信号
の直流成分レベルが安定状態でのクランプ電位に達する
時点でトランジスタＱ１が非導通状態となるようにベー
ス電圧を設定しておけば、クランプ回路３、４が安定状
態になりＣＤＳ回路２は正常に動作している期間にはバ
イアス付与回路２０からのバイアス付与を阻止して、バ
イアス付与回路２０のＣＤＳ回路２への影響を抑えられ
る。
調整することにより、クランプ回路３、４への入力信号
の直流成分レベルが安定状態でのクランプ電位に達する
時点でトランジスタＱ１が非導通状態となるようにベー
ス電圧を設定しておけば、クランプ回路３、４が安定状
態になりＣＤＳ回路２は正常に動作している期間にはバ
イアス付与回路２０からのバイアス付与を阻止して、バ
イアス付与回路２０のＣＤＳ回路２への影響を抑えられ
る。
【００１６】尚、前記実施例では、バイアス付与回路２
０として、微分回路とトランジスタを用いたが、これに
限定されるものではなく、例えば、トランジスタＱ１の
ベースにモノマルチを結合して、電源投入時に所定のパ
ルス幅のパルスを作成し、この反転出力をトランジスタ
Ｑ１のベースに印加するように構成してもよいことは言
うまでもない。
０として、微分回路とトランジスタを用いたが、これに
限定されるものではなく、例えば、トランジスタＱ１の
ベースにモノマルチを結合して、電源投入時に所定のパ
ルス幅のパルスを作成し、この反転出力をトランジスタ
Ｑ１のベースに印加するように構成してもよいことは言
うまでもない。
【００１７】
【発明の効果】上述の如く本発明によると、入力映像信
号の直流成分レベルがクランプ回路の安定状態でのクラ
ンプ電位に達するまでに要する時間を大幅に短縮するこ
とで、正常な映像信号作成を速め、高速で立ち上げるこ
とができるので、ＣＣＤイメージャの後段のクランプ回
路に用いれば、撮像機器での撮影の開始タイミングを速
めることができ、特に、ディジタルスチルカメラでは電
源ＯＮ直後のシャッターチャンスを逃すことが防止でき
極めて有効である。
号の直流成分レベルがクランプ回路の安定状態でのクラ
ンプ電位に達するまでに要する時間を大幅に短縮するこ
とで、正常な映像信号作成を速め、高速で立ち上げるこ
とができるので、ＣＣＤイメージャの後段のクランプ回
路に用いれば、撮像機器での撮影の開始タイミングを速
めることができ、特に、ディジタルスチルカメラでは電
源ＯＮ直後のシャッターチャンスを逃すことが防止でき
極めて有効である。
【図１】本発明の一実施例の回路図である。
【図２】従来例のブロック図である。
【図３】本発明の一実施例に係わり、ＣＤＳ回路の動作
を説明する波形図である。
を説明する波形図である。
【図４】本発明の一実施例と従来例との対比を行う波形
図である。
図である。
３ クランプ回路 ４ クランプ回路 ２０ バイアス付与回路 １ ＣＣＤイメージャ ５ サンプルホールド回路 ６ サンプルホールド回路
Claims (3)
- 【請求項１】 入力映像信号を所定のレベルにクランプ
するクランプ手段と、 電源投入直後の所定期間に該入力映像信号に所定のバイ
アスを付与するバイアス付与手段とを備える映像信号処
理回路。 - 【請求項２】 該入力映像信号はＣＣＤイメージャから
の撮像信号であり、前記クランプ手段の後段にはサンプ
ルホールド回路を有することを特徴とする請求項１記載
の映像信号処理回路である。 - 【請求項３】 前記映像信号処理回路は静止画撮影用の
電子式スチルカメラに使用されることを特徴とする前記
請求項２記載の映像信号処理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13922196A JP3182339B2 (ja) | 1996-05-31 | 1996-05-31 | 映像信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13922196A JP3182339B2 (ja) | 1996-05-31 | 1996-05-31 | 映像信号処理回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH09322071A JPH09322071A (ja) | 1997-12-12 |
| JP3182339B2 true JP3182339B2 (ja) | 2001-07-03 |
Family
ID=15240334
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13922196A Expired - Fee Related JP3182339B2 (ja) | 1996-05-31 | 1996-05-31 | 映像信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3182339B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6372071B1 (en) | 1990-12-27 | 2002-04-16 | Pirelli Coordinamento Pneumatici S.P.A. | Article comprising at least one metal wire embedded in a vulcanized elastomeric material |
-
1996
- 1996-05-31 JP JP13922196A patent/JP3182339B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6372071B1 (en) | 1990-12-27 | 2002-04-16 | Pirelli Coordinamento Pneumatici S.P.A. | Article comprising at least one metal wire embedded in a vulcanized elastomeric material |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH09322071A (ja) | 1997-12-12 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090420 Year of fee payment: 8 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090420 Year of fee payment: 8 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100420 Year of fee payment: 9 |
|
| LAPS | Cancellation because of no payment of annual fees |