JP3122828B2 - 三相整流式抵抗溶接機の電流制御方法及び装置 - Google Patents
三相整流式抵抗溶接機の電流制御方法及び装置Info
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Landscapes
- Arc Welding Control (AREA)
- Generation Of Surge Voltage And Current (AREA)
Description
【０００１】
【産業上の利用分野】本発明は，抵抗溶接の通電制御を
サイリスタの位相制御によって行う三相整流式抵抗溶接
機の制御装置に関するものである。
サイリスタの位相制御によって行う三相整流式抵抗溶接
機の制御装置に関するものである。
【０００２】
【従来の技術】従来，三相抵抗溶接機の位相制御回路に
用いている電源同期信号（パルス）は一般の電気機械が
そうであるように，制御の最終段と同相である。溶接機
の場合，サイリスタの電源と同相の電源から得てこの同
期信号を作っている。例えば三相においてＡ相のトラン
スの電流制御を行うＡ相のサイリスタの同期信号の電源
はＡ相の電源から得ている。
用いている電源同期信号（パルス）は一般の電気機械が
そうであるように，制御の最終段と同相である。溶接機
の場合，サイリスタの電源と同相の電源から得てこの同
期信号を作っている。例えば三相においてＡ相のトラン
スの電流制御を行うＡ相のサイリスタの同期信号の電源
はＡ相の電源から得ている。
【０００３】
【発明が解決しようとする課題】三相整流式抵抗溶接機
は，一般に大形の機械である。二次側に流れる溶接電流
は６万アンペア〜１５万アンペアもある。大形のもので
は３０万アンペアのものもある。このため一次電流も１
０００アンペア〜５０００アンペアと非常に大きな電流
が電路に流れる。
は，一般に大形の機械である。二次側に流れる溶接電流
は６万アンペア〜１５万アンペアもある。大形のもので
は３０万アンペアのものもある。このため一次電流も１
０００アンペア〜５０００アンペアと非常に大きな電流
が電路に流れる。
【０００４】その上，三相整流式抵抗溶接機の一次電流
は，通常の交流負荷と異なり滑らかな正弦波ではなく，
電流の立ち上がりが通常の交流溶接機に比べて急峻であ
る。
は，通常の交流負荷と異なり滑らかな正弦波ではなく，
電流の立ち上がりが通常の交流溶接機に比べて急峻であ
る。
【０００５】そのため，溶接一次電流が電路に流れる
と，その電流の立ち上がりと，立ち下がり時点でスパイ
ク状の大きな電源の落ち込みが生じる。すなわち，電路
のＬと電流の立ち上がり，立ち下がりの電流変化率ｄｉ
／ｄｔによって電圧降下ｖは ｖ＝Ｌｄｉ／ｄｔによる
値で発生する。ところが，三相整流式抵抗溶接機は前述
したようにｄｉ／ｄｔはＡＣ機より非常に大きな値にな
るのである。即ち，電圧降下ｖの落ち込みは甚だしいの
である。
と，その電流の立ち上がりと，立ち下がり時点でスパイ
ク状の大きな電源の落ち込みが生じる。すなわち，電路
のＬと電流の立ち上がり，立ち下がりの電流変化率ｄｉ
／ｄｔによって電圧降下ｖは ｖ＝Ｌｄｉ／ｄｔによる
値で発生する。ところが，三相整流式抵抗溶接機は前述
したようにｄｉ／ｄｔはＡＣ機より非常に大きな値にな
るのである。即ち，電圧降下ｖの落ち込みは甚だしいの
である。
【０００６】図１はこのような電源の落ち込みの状況と
それにより同期信号（パルス）の位相が乱される様子を
示したものである。上記の電源の落ち込みは図１でＺで
示されるようになるのである。
それにより同期信号（パルス）の位相が乱される様子を
示したものである。上記の電源の落ち込みは図１でＺで
示されるようになるのである。
【０００７】ところで，このような激しいスパイク状の
電源の落ち込みがあると，この電源から得て作る位相制
御回路の電源同期信号（パルス）は電源の激しい落ち込
みが０ボルト近くまで落ちれば図１における正規の同期
信号Ｐ1 に対し，Ｐ2或いはＰ3 として発信されてしま
う。
電源の落ち込みがあると，この電源から得て作る位相制
御回路の電源同期信号（パルス）は電源の激しい落ち込
みが０ボルト近くまで落ちれば図１における正規の同期
信号Ｐ1 に対し，Ｐ2或いはＰ3 として発信されてしま
う。
【０００８】そしてこのＰ2 ，Ｐ3 を位相制御回路が受
信すると，図２の電流はＰ1 を受信するときの正しい電
流ｉ１に対し，Ｐ2 を受信するとｉ２のように大きな電
流となってしまう。このように同期信号が誤動作させら
れると，位相制御の制御角も乱される。これがひどいと
きには正と負の電流を制御する二つのサイリスタが不平
衡の点弧制御をさせられ，その結果，溶接トランスは偏
磁し，磁気飽和して，サイリスタやトランスが損傷する
に至ることがある。例え破損しなくても溶接機の生命で
ある溶接電流の安定が得られなくなり，溶接不良，溶接
ハガレとなるなどを発生するので，溶接機にとってこの
電源同期信号の乱れは大きな問題なのである。
信すると，図２の電流はＰ1 を受信するときの正しい電
流ｉ１に対し，Ｐ2 を受信するとｉ２のように大きな電
流となってしまう。このように同期信号が誤動作させら
れると，位相制御の制御角も乱される。これがひどいと
きには正と負の電流を制御する二つのサイリスタが不平
衡の点弧制御をさせられ，その結果，溶接トランスは偏
磁し，磁気飽和して，サイリスタやトランスが損傷する
に至ることがある。例え破損しなくても溶接機の生命で
ある溶接電流の安定が得られなくなり，溶接不良，溶接
ハガレとなるなどを発生するので，溶接機にとってこの
電源同期信号の乱れは大きな問題なのである。
【０００９】
【課題を解決するための手段】本発明はこのような従来
からの電源電圧の落ち込みによる電源同期信号の乱れを
解決するものである。
からの電源電圧の落ち込みによる電源同期信号の乱れを
解決するものである。
【００１０】先ず，電源同期電圧を電源の落ち込みを十
分に吸収できるフイルタ回路で吸収するのである。しか
し，十分なフイルタ効果を持たせると，出力電圧位相は
入力電圧位相，即ち，これから制御しようとサイリスタ
の電源位相より大幅に遅れるため，必要な点弧制御角ま
で進められない。このため，従来からこのような歪み電
源に対しての電源同期回路の対策として，大きなフイル
タ定数を与えることができなかったのである。
分に吸収できるフイルタ回路で吸収するのである。しか
し，十分なフイルタ効果を持たせると，出力電圧位相は
入力電圧位相，即ち，これから制御しようとサイリスタ
の電源位相より大幅に遅れるため，必要な点弧制御角ま
で進められない。このため，従来からこのような歪み電
源に対しての電源同期回路の対策として，大きなフイル
タ定数を与えることができなかったのである。
【００１１】そこで，本発明は「十分なフイルタ定数
を与え」こうすることによって遅れた出力電圧（約６０
度遅らせる）を「次の相の同期電源電圧として用い
る」のである。
を与え」こうすることによって遅れた出力電圧（約６０
度遅らせる）を「次の相の同期電源電圧として用い
る」のである。
【００１２】今，A相の場合で説明する。即ち，三相の
相順がA相→B相→C相→A相→……となっている場合に，
前述のようにＡ相より６０度進んでいる相，すなわち１
２０度遅れているＢ相の負電，即ちＡ相より６０度進ん
でいる電圧を，十分なフイルタ効果を持つフイルタ回路
によって約６０度遅らせて得た出力電圧を，Ａ相の位相
制御回路の同期電源電圧として用いて，Ａ相のサイリス
タの通電電流を制御することを特徴としているのであ
る。
相順がA相→B相→C相→A相→……となっている場合に，
前述のようにＡ相より６０度進んでいる相，すなわち１
２０度遅れているＢ相の負電，即ちＡ相より６０度進ん
でいる電圧を，十分なフイルタ効果を持つフイルタ回路
によって約６０度遅らせて得た出力電圧を，Ａ相の位相
制御回路の同期電源電圧として用いて，Ａ相のサイリス
タの通電電流を制御することを特徴としているのであ
る。
【００１３】なお，このようにしてフイルタ回路で電源
歪みを吸収してから電源同期信号を作る方法は同一出願
人による特願平５−８５６０６号と類似しているようだ
が，実はこれとは異なるのである。即ち前者は，今，制
御しようとしているサイリスタ電源の前の半波（１８０
度進んだ半波）の電圧を積分回路で平滑して，歪みを除
去するのであるが，Ｃ・Ｒ積分では１８０度までは遅ら
せないので，これを自分の電源位相の同期パルスとして
用いるためには，前述のＣ・Ｒ積分回路から得られた同
期パルスＳ1 をさらに９０度遅らせ，Ｓｚを作り，これ
によって自分の電源位相の位相制御用，同期パルスとし
ているのである。
歪みを吸収してから電源同期信号を作る方法は同一出願
人による特願平５−８５６０６号と類似しているようだ
が，実はこれとは異なるのである。即ち前者は，今，制
御しようとしているサイリスタ電源の前の半波（１８０
度進んだ半波）の電圧を積分回路で平滑して，歪みを除
去するのであるが，Ｃ・Ｒ積分では１８０度までは遅ら
せないので，これを自分の電源位相の同期パルスとして
用いるためには，前述のＣ・Ｒ積分回路から得られた同
期パルスＳ1 をさらに９０度遅らせ，Ｓｚを作り，これ
によって自分の電源位相の位相制御用，同期パルスとし
ているのである。
【００１４】本発明の場合は前の相，即ち自分が制御し
ようとしている相よりも６０度進んだ相，即ち１２０度
遅れた相の負電圧から同期電源電圧をとるので，前者よ
りも回路構成を簡単にすることができるので，三相の場
合の同期信号を作る方法としては優れているのである。
ようとしている相よりも６０度進んだ相，即ち１２０度
遅れた相の負電圧から同期電源電圧をとるので，前者よ
りも回路構成を簡単にすることができるので，三相の場
合の同期信号を作る方法としては優れているのである。
【００１５】
【作用】上記の手段を講じることによって得た電源同期
信号を用いて位相制御を行うことにより，例え，激しい
スパイク状の電源電圧の落ち込みがあっても位相制御回
路に与える電源同期信号の位相が乱されることがなく，
この結果，サイリスタや溶接電流は安定に制御され，溶
接不良やサイリスタ，溶接トランス等が破壊することが
なくなり，また溶接結果の安定性，即ち溶接ハガレなど
をなくすことができる。
信号を用いて位相制御を行うことにより，例え，激しい
スパイク状の電源電圧の落ち込みがあっても位相制御回
路に与える電源同期信号の位相が乱されることがなく，
この結果，サイリスタや溶接電流は安定に制御され，溶
接不良やサイリスタ，溶接トランス等が破壊することが
なくなり，また溶接結果の安定性，即ち溶接ハガレなど
をなくすことができる。
【００１６】次に本発明の実施例を図３，図４，図５に
基づいて説明する。図３は従来の同期方法による同期信
号の誤動作を説明したものである。ａ相の電源が落ち込
むと，そのままａ相の同期回路は誤った電源同期信号Ｐ
3 又はＰ2 を発信してしまう。
基づいて説明する。図３は従来の同期方法による同期信
号の誤動作を説明したものである。ａ相の電源が落ち込
むと，そのままａ相の同期回路は誤った電源同期信号Ｐ
3 又はＰ2 を発信してしまう。
【００１７】図４は本発明のフイルタ回路を通じて得ら
れた電源同期信号1であるＰａ1，Ｐａ2を説明したもの
である。図４のようにｂ相の電源に激しい落ち込みがあ
っても電源の落ち込みを十分に吸収できるフイルタ回路
を通すことが出来たので，その出力にこの落ち込みは現
れない。即ち，同期信号の発信位相が電源波形に影響を
受けないのである。そして，このフイルタを通過して出
来た同期信号Ｐａ1，Ｐａ2をA相を制御する位相制御回
路に用いるのである。
れた電源同期信号1であるＰａ1，Ｐａ2を説明したもの
である。図４のようにｂ相の電源に激しい落ち込みがあ
っても電源の落ち込みを十分に吸収できるフイルタ回路
を通すことが出来たので，その出力にこの落ち込みは現
れない。即ち，同期信号の発信位相が電源波形に影響を
受けないのである。そして，このフイルタを通過して出
来た同期信号Ｐａ1，Ｐａ2をA相を制御する位相制御回
路に用いるのである。
【００１８】図５は本発明の１実施例である。Ａ相の動
作とについて説明する。Ｂ相，Ｃ相はＡ相に準ずるので
説明を省略する。
作とについて説明する。Ｂ相，Ｃ相はＡ相に準ずるので
説明を省略する。
【００１９】三相電源１２からの電圧は同期電源ｖｂを
受信するトランス１Ａで受電し，その出力を反転させた
−ｖｂを大きなフイルタであるフイルタ手段２Aに導
く。フイルタ手段によって入力された激しい電源の落ち
込みが除去され，きれいな交流電圧―(入力された同期
電源より６０度遅れた電圧)―を同期信号発生回路３Ａ
に導き，電源同期信号1であるＰａパルスを作り出す。
この出力Ｐａと通電時間制御手段４から来る通電許可信
号との論理積をＡＮＤゲート手段５Aで取る。そして，
このＡＮＤゲート手段５Ａの出力である電源同期信号，
６Aを位相制御手段７Ａに与える。
受信するトランス１Ａで受電し，その出力を反転させた
−ｖｂを大きなフイルタであるフイルタ手段２Aに導
く。フイルタ手段によって入力された激しい電源の落ち
込みが除去され，きれいな交流電圧―(入力された同期
電源より６０度遅れた電圧)―を同期信号発生回路３Ａ
に導き，電源同期信号1であるＰａパルスを作り出す。
この出力Ｐａと通電時間制御手段４から来る通電許可信
号との論理積をＡＮＤゲート手段５Aで取る。そして，
このＡＮＤゲート手段５Ａの出力である電源同期信号，
６Aを位相制御手段７Ａに与える。
【００２０】このように，大きなフイルタ定数をもフイ
ルタ手段によって得られた正確な電源同期パルスによっ
て同調された位相制御手段の出力を点弧手段８Ａに与
え，この回路で電力増幅された点弧信号を溶接電流を制
御するサイリスタ９Ａのゲートに与えて，サイリスタを
通電制御する。これにより溶接機１０の電流が制御され
る。
ルタ手段によって得られた正確な電源同期パルスによっ
て同調された位相制御手段の出力を点弧手段８Ａに与
え，この回路で電力増幅された点弧信号を溶接電流を制
御するサイリスタ９Ａのゲートに与えて，サイリスタを
通電制御する。これにより溶接機１０の電流が制御され
る。
【００２１】
【発明の効果】以上で説明したように，三相整流式抵抗
溶接機の制御装置の電源同期手段として本発明方法を用
いることにより，電源電圧の落ち込みの激しい電路であ
っても同期信号の位相が，溶接電源の位相に対し，ずら
されることがなくなり，従来しばしば問題となった同期
信号の位相ズレによって生ずるサイリスタ或いは溶接ト
ランスの破壊或いは，溶接機が最も求められる溶接ハガ
レ，溶接不良が無くなるという大きな効果がもたらされ
る。
溶接機の制御装置の電源同期手段として本発明方法を用
いることにより，電源電圧の落ち込みの激しい電路であ
っても同期信号の位相が，溶接電源の位相に対し，ずら
されることがなくなり，従来しばしば問題となった同期
信号の位相ズレによって生ずるサイリスタ或いは溶接ト
ランスの破壊或いは，溶接機が最も求められる溶接ハガ
レ，溶接不良が無くなるという大きな効果がもたらされ
る。
【図１】従来の同期手段に於ける電源落ち込み波形によ
って乱される同期信号の様子を説明する波形図である。
って乱される同期信号の様子を説明する波形図である。
【図２】従来の同期手段での同期信号が乱されたとき生
ずるサイリスタ及び溶接機に流れる過大電流の様子を説
明する波形図である。
ずるサイリスタ及び溶接機に流れる過大電流の様子を説
明する波形図である。
【図３】従来の同期電源と，この電源から作られた同期
信号との関係を示す波形図である。
信号との関係を示す波形図である。
【図４】本発明のフイルタ手段の出力と同期信号との関
係を示す波形図である。
係を示す波形図である。
【図５】本発明方法を実施するための装置の１実施例を
示すブロック電気回路図である。
示すブロック電気回路図である。
１Ａ，１Ｂ，１Ｃ 制御トランス ２Ａ，２Ｂ，２Ｃ フイルタ手段 ３Ａ，３Ｂ，３Ｃ 同期信号発生手段 ４ 通電時間制御手段 ５Ａ，５Ｂ，５Ｃ ＡＮＤゲート手段 ７Ａ，７Ｂ，７Ｃ 位相制御手段 ８Ａ，８Ｂ，８Ｃ 点弧手段 ９Ａ，９Ｂ，９Ｃ サイリスタ １０ 三相整流式溶接機 １２ 三相電源
Claims (2)
- 【請求項１】 通電制御すべきサイリスタの電源電圧位
相よりも１２０度遅れた電源位相の電圧を極性反転して
６０度進んだ同期電源にし，前記同期電源をフイルタ手
段に導き，前記フイルタ手段によって，前記同期電源を
６０度遅らせ且つ電源歪みを除去し，前記フイルタ手段
の出力信号を同期信号発生手段に与えて電源同期信号ｐ
ａ，ｐｃ，ｐｄを作る，前記のようにして作った三相各
相毎の電源同期信号，即ちＡ相，Ｂ相，Ｃ相の同期信号
のそれぞれと，通電時間制御信号との論理積を三相各々
の相の位相制御手段に与えて三相位相制御を行い，前記
三相制御手段の出力信号を，点弧手段を経て前記通電す
べきサイリスタのゲートに与えることによって電源電圧
の歪みによる前記サイリスタの通電電流の乱調を抑制す
ることを特徴とする三相整流式抵抗溶接機の電流制御方
法。 - 【請求項２】 通電すべきサイリスタ（９Ａ，９Ｂ，９
Ｃ）の電源位相より１２０度遅れた電源を制御トランス
（１ａ，１ｂ，１ｃ）に与え，前記制御トランスの出力
電圧をフイルタ手段（２ａ，２ｂ，２ｃ）に与え，前記
フイルタ手段によって同期電源より６０度遅らせ且つ電
源歪みを除去した後，得られた前記フイルタ手段の出力
信号を同期信号発生手段（３Ａ，３Ｂ，３Ｃ）に与え，
前記同期信号発生手段で作られた電源同期信号と通電制
御手段４の出力信号とをＡＮＤゲート（５Ａ，５Ｂ，５
Ｃ）に与え，更に前記ANDゲートの出力を位相制御手段
（７Ａ，７Ｂ，７Ｃ）に与え，前記位相制御手段の出力
を点弧手段(８Ａ，８Ｂ，８Ｃ)に与え，前記点弧手段の
出力は前記通電制御すべきサイリスタのゲートに与え，
これにより前記サイリスタを点弧させて，前記サイリス
タに接続されている，三相整流式抵抗溶接機の電流を制
御することを特徴とした三相整流式抵抗溶接機の制御装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP06199049A JP3122828B2 (ja) | 1994-08-01 | 1994-08-01 | 三相整流式抵抗溶接機の電流制御方法及び装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP06199049A JP3122828B2 (ja) | 1994-08-01 | 1994-08-01 | 三相整流式抵抗溶接機の電流制御方法及び装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0839266A JPH0839266A (ja) | 1996-02-13 |
| JP3122828B2 true JP3122828B2 (ja) | 2001-01-09 |
Family
ID=16401267
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP06199049A Expired - Lifetime JP3122828B2 (ja) | 1994-08-01 | 1994-08-01 | 三相整流式抵抗溶接機の電流制御方法及び装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3122828B2 (ja) |
-
1994
- 1994-08-01 JP JP06199049A patent/JP3122828B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0839266A (ja) | 1996-02-13 |
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