JP3118909B2 - 画像処理装置 - Google Patents
画像処理装置Info
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Description
を、第1の形式(例えば、画像表示用の表示フォーマッ
ト)と第2の形式(例えば、記録媒体への記録フォーマ
ット)で取り扱う画像処理装置に関する。
録再生を含む。)装置が開発され、S/N劣化の無い画
像伝送や、経時変化の無い記録再生が実現されている。
このようなディジタル画像処理装置で取り扱う画像信号
のフォーマットとしては、例えば、モニタ出力又はカメ
ラ入力のように、画素信号(及び映像同期信号)が走査
方向順に並ぶ表示フォーマット(又は、基準入出力フォ
ーマット)、磁気記録媒体の記録フォーマット、及び、
伝送路の個々の伝送規約に従った送受信フォーマットな
どがあり、必要に応じて、これらフォーマット間の変換
が行なわれる。
のシャフリングが行なわれ、誤り訂正符号が付加され、
データ・ブロックでは、同期コードSYNCや識別コー
ドIDなども付加される。図4(A)は、各画素データ
が水平走査及び垂直走査の順で並ぶフォーマット(基本
フォーマット)を示し、同(B)は、ディジタルVTR
での磁気テープの記録フォーマットを示す。図4(A)
に示す基本フォーマットは、映像モニタにおける水平・
垂直走査に対応している。
象の画像データを一時記憶するデータ・メモリが装備さ
れているのが普通である。従来のディジタル画像処理装
置では、ハードウエアを節約する目的で、入出力回路、
記録再生回路、データ・メモリなどの回路ブロックをバ
ス結合し、1つのデータ・メモリを共通に利用できる回
路構成を採用している。このようなディジタル画像処理
装置の一つにディジタル・ビデオ・テープ・レコーダ
(VTR)がある。
成ブロック図を示す。10は公衆電話回線網、ディジタ
ル回線網などの伝送路、TVカメラ、画像モニタ装置、
伝送路インターフェース装置などに接続する入出力端
子、12はA/D変換器、D/A変換器、及び所定のイ
ンターフェース回路などからなる入出力回路、14は、
磁気テープ16に画像データをディジタル記録するため
の記録処理、及び磁気テープ16に記録される信号を再
生処理する記録再生処理回路である。
誤り訂正符号化及び復号化を行なう符号化復号化回路、
20は記録再生処理回路14による記録再生、符号化復
号化回路18による誤り訂正符号化復号化、及び入出力
回路12による入出力処理に利用されるデータ・メモ
リ、22は回路12,14,18,20を相互に接続す
るデータ・バスである。
りを図6に示す。入出力回路12からデータ・メモリ2
0へのデータの書き込みは、基本フォーマットで行なわ
れる。符号化復号化回路18は基本フォーマット(又は
独自のフォーマット)でデータ・メモリ20にアクセス
して、誤り訂正符号化する。記録再生処理回路14は、
データ・メモリ20のデータを記録フォーマットで読み
出し、同期ブロック化して磁気テープ16に記録する。
のデータ・バスに対して入出力が頻発し、データ・バス
及びデータ・メモリのアクセス・レートが高くなるとい
う問題点がある。特に、ビデオ信号をリアルタイム処理
する場合には、より速い処理速度が要求される。
基本フォーマットと記録フォーマットというように異な
るフォーマットで行なう場合には、そのメモリ・アドレ
スの管理又は制御が複雑になる。これを容易化するの
は、データ・バスに接続する全ての処理回路に個別に、
対応するフォーマットに応じたメモリ・アドレス発生回
路を持たせなければならず、回路の大規模化は避けえな
い。
較的大きなゴミ等により再生データが大量に欠落するこ
とがあり、このような場合には前フレーム(又はフィー
ルド)のデータで補間するのが一般的である。しかし、
従来の構成では、データ・メモリの読み出しアドレスが
書き込みアドレスを追い越すことがないよう、図7に示
すように、書き込みアドレス及び読み出しアドレスにフ
レーム(又はフィールド)単位でオフセットを設け、フ
レーム(又はフィールド)時間単位で切り換える構成に
なっている。
メモリへの書き込みを禁止しても、データ・メモリに保
存されているのは前フレームのデータではなく、前々フ
レームのデータである。即ち、そのままでは、前々フレ
ームのデータによるフレーム補間が行なわれることにな
る。これを避けるには、フレーム補間専用のデータ・メ
モリを設ければよいが、それでは、ハードウエアが大規
模になってしまう。
処理装置を提示することを目的とする。
置は、記録媒体に対して画像データを記録再生する装置
であって、第1のデータバスに接続され、第1のフォー
マットの画像データを入力する入力処理手段と、前記第
1のデータバスに接続され、前記第1のデータバスを介
して前記入力処理手段より入力した前記第1のフォーマ
ットの画像データを記憶する第1のメモリと、第2のデ
ータバスに接続され、前記第1のフォーマットとは異な
る第2のフォーマットの画像データを記憶する第2のメ
モリと、前記第2のデータバスに接続され、前記第2の
データバスを介して前記第2のメモリより前記第2のフ
ォーマットの画像データを読み出して前記記録媒体に記
録すると共に、前記記録媒体から前記第2のフォーマッ
トの画像データを読み出して前記第2のデータバスを介
して前記第2のメモリに書き込む記録再生手段と、前記
第1のメモリと前記第2のメモリとの間で前記画像デー
タを転送すると共に、前記第1のメモリと前記第2のメ
モリとの間で転送される画像データのフォーマットを変
換する転送手段とを備え、前記転送手段は、前記第2の
メモリから前記第1のメモリへの画像データの転送時に
前記第2のメモリから前記第1のメモリへ転送される画
像データ中のエラーを補間することを特徴とする。本発
明に係る画像処理装置はまた、記録媒体から画像データ
を再生する装置であって、入力順に従う第1のフォーマ
ットの画像データを伝送する第1のデータバスと、前記
第1のデータバスに接続され、前記第1のフォーマット
の画像データを記憶する第1のメモリと、前記記録媒体
上の記録フォーマットに従う第2のフォーマットの画像
データを伝送する第2のデータバスと、前記第2のデー
タバスに接続され、前記第2のフォーマットの画像デー
タを記憶する第2のメモリと、前記記録媒体から前記第
2のフォーマットの画像データを再生し、再生された画
像データを前記第2のデータバスを介して前記第2のメ
モリに出力する再生手段と、前記第2のメモリより前記
第2のフォーマットの画像データを読み出し、そのフォ
ーマットを前記第2のフォーマットから前記第1のフォ
ーマットに変換して前記第1のメモリに書き込む転送手
段と、前記再生画像データ中のエラーを訂正すると共に
訂正不能なエラーを検出するエラー訂正手段と、前記エ
ラー訂正 手段によるエラー検出結果に応じて前記転送手
段による前記第2のメモリから前記第1のメモリへの画
像データの転送を禁止する制御手段とを備えることを特
徴とする。
マットで画像データの書き込み読み出しが行われること
になり、メモリ・アドレスの管理が簡単になる。1つの
メモリに対するアクセスの回数が少なくなり、メモリ及
びバスのアクセス・レートを下げることができる。第2
のメモリから第1のメモリへの画像データの転送中にエ
ラーを補間できる。
する。
明の一実施例の基本構成ブロック図を示す。30は基本
フォーマットでアナログ画像信号が入出力する入出力端
子、32は、入出力用バス34上の画像データをアナロ
グ信号に変換して入出力端子30に出力し、入出力端子
30に入力する画像信号をディジタル化して入出力用バ
ス34に出力する入出力回路、36は入出力用バス34
を介して入出力回路32と接続する入出力用メモリであ
る。入出力用バス34上では、画像データは図4(A)
の基本フォーマットに従って流れる。
ーマットに従う順序で入力する画像データを例えば2重
積符号の誤り検出訂正符号化し、同期コード及びIDを
付加して記録媒体42に記録し、また、記録媒体42の
記録信号を再生し、同期コード及びIDに従いデータを
復元して、再生画像データを記録フォーマットに従い記
録再生用バス40に出力する記録再生処理回路である。
44は記録再生処理回路38により再生されたデータを
誤り検出訂正する誤り検出訂正回路である。46は、記
録再生用バス40を介して記録再生処理回路38及び誤
り検出訂正回路44と記録フォーマットに従い画像デー
タの授受を行なう記録再生用メモリである。
6とはデータ転送制御回路48を介して相互に接続して
いる。データ転送制御回路48の詳細な回路構成例を図
2に示す。アドレス発生回路50は転送の際の基本とな
るアドレスを発生し、アドレス変換回路52はアドレス
発生回路50からのアドレスを入出力用メモリ36のア
ドレスに変換し、アドレス変換回路54はアドレス発生
回路50からのアドレスを記録再生用メモリ46のアド
レスに変換する。ここでのアドレス操作により、転送と
同時に、シャフリング又はデシャフリングを行なう。
正不能エラーに対する修正フラグにより、フレーム補間
を行なうか否かを判定する。転送データ遅延回路58
は、時間調整用の遅延素子からなる。
力端子、64はデータ入出力端子であり、これらは入出
力用メモリ36に接続する。66はアドレス出力端子、
68はフラグ入力端子、70はデータ入出力端子であ
り、これらは記録再生用メモリ36に接続する。モード
入力端子72には、図示しないシステム制御回路から、
記録、再生、スロー再生、サーチ等の動作モードを示す
モード信号が入力し、このモード信号に応じて、アドレ
ス変換回路52,54のアドレス変換テーブル及びフラ
グ判定回路56の判定基準が選択される。
端子30から入力する画像信号をディジタル化し、入出
力用バス34を介して、図4(A)に示す基本フォーマ
ットで入出力用メモリ36に書き込む。
回路52からアドレス出力端子60を介して入出力用メ
モリ36に読み出しアドレスを印加し、アドレス変換回
路54からアドレス出力端子66を介して記録再生用メ
モリ46に書き込みアドレスを印加する。入出力用メモ
リ36から読み出された画像データは、データ入出力端
子64、遅延回路58及びデータ入出力端子70を介し
て記録再生用メモリ46に転送される。遅延回路58に
より時間調整される。この転送に際して、データ・シャ
フリングが同時に行なわれる。
データは、図4(B)に示す記録フォーマットの順序で
読み出され、記録再生用バス40を介して記録再生処理
回路38に印加される。記録再生処理回路38は、例え
ば2重積符号の誤り検出訂正符号化し、同期コード及び
IDを付加して記録媒体42に記録する。
媒体42からの再生信号を同期コード及びIDに従い再
生処理し、再生画像データを記録再生用バス40を介し
て記録再生用メモリ46に書き込む。この書き込みと同
時に、誤り検出訂正回路44は再生データの誤りを検出
し、訂正できるものは訂正する。訂正不能データに対し
ては、記録再生用メモリ46のフラグ・メモリ・エリア
に修正フラグを書き込む。
は、符号ブロック単位で2方向にフラグが立ち、その交
点にエラーがあることを示す。
れに対応するフラグを並列に読み出せるようになってい
る。データ転送制御回路48は、エラー訂正処理及びフ
ラグ書き込みの終了したデータを記録再生用メモリ46
から読み出す。データ入出力端子70には再生データが
入力し、フラグ入力端子68にはフラグが入力する。
回路56が、フラグ入力端子68からのフラグによりフ
レーム間補間するか否かを判定する。フレーム間補間処
理を行なう場合には、アドレス変換回路52に書き込み
禁止信号を出力する。アドレス変換回路52は書き込み
禁止信号に応じて、入出力用メモリ36に無効エリアの
アドレスを発生する。これにより、入出力用メモリ36
の更新が禁止される。例えば、誤り検出訂正回路44の
処理による2方向のフラグが共に立っている場合に、訂
正不能としてデータの書き込みを禁止する。
レーム間補間とフレーム内補間を選択するようにしても
よい。また、VTRのスロー、サーチなどの特殊再生で
は、再生データの欠落が頻発するので、再生エンベロー
プから検出されるドロップアウト検出信号により入出力
用メモリ36への書き込みを禁止するようにしてもよ
い。
レス変換回路54は記録再生用メモリ46に対する読み
出しアドレスを発生し、アドレス変換回路52は入出力
用メモリ36に対する書き込みアドレスを発生する。こ
こでのアドレス操作により、デシャフリング及び記録フ
ォーマットから基本フォーマットへの変換が行なわれ
る。
タは、基本フォーマットの順序でデータ・バス34に読
み出され、入出力回路32によりアナログ信号に変換さ
れて、入出力端子30から外部モニタ装置などに出力さ
れる。
3と、従来例のデータ・フローを示す図6を比較すれば
分かるように、本実施例では、バス34,40のアクセ
ス・レートを従来例のバス22のアクセス・レートより
低くできる。また、各バスを流れるデータのフォーマッ
トが統一されているので、メモリ・アドレス管理が簡単
になる。更には、データ転送制御回路48による転送の
際に、フレーム補間処理を同時に行なえる。なお、本実
施例では、アドレス操作により入出力用メモリ36を書
き込み禁止にしているが、勿論、フラグ判定結果により
直接、入出力メモリ36を制御してもよいことはいうま
でもない。
置を例に説明したが、本発明はかかる装置に限らず、他
の装置、例えば光ファイリング装置や画像データ伝送装
置にも適用できる。
入力用の第1のメモリと記録または再生用の第2のメモ
リとを備えたことにより、メモリやデータ・バスのアク
セス・レートを下げることができる。各データ・バスを
流れる画像データのフォーマットが統一されるので、メ
モリのアドレス管理が簡単になり、回路規模を小さくす
ることができる。第2のメモリから第1のメモリへの画
像データの転送時にエラーを補間できる。
る。
である。
である。
る。
処理回路 16:磁気テープ 18:符号化復号化回路
20:データ・メモリ 30:入出力端子 32:画
像入出力回路 34:入出力用バス 36:入出力用メ
モリ 38:記録再生処理回路 40:記録再生用バス
42:記録媒体 44:誤り検出訂正回路 46:記
録再生用メモリ 48:データ転送制御回路 50:ア
ドレス発生回路 52,54:アドレス変換回路 5
6:フラグ判定回路 58:転送データ遅延回路 6
0:アドレス出力端子 62:フラグ出力端子 64:
データ入出力端子 66:アドレス出力端子 68:フ
ラグ入力端子 70:データ入出力端子 72:モード
入力端子
Claims (8)
- 【請求項1】 記録媒体に対して画像データを記録再生
する装置であって、 第1のデータバスに接続され、第1のフォーマットの画
像データを入力する入力処理手段と、 前記第1のデータバスに接続され、前記第1のデータバ
スを介して前記入力処理手段より入力した前記第1のフ
ォーマットの画像データを記憶する第1のメモリと、 第2のデータバスに接続され、前記第1のフォーマット
とは異なる第2のフォーマットの画像データを記憶する
第2のメモリと、 前記第2のデータバスに接続され、前記第2のデータバ
スを介して前記第2のメモリより前記第2のフォーマッ
トの画像データを読み出して前記記録媒体に記録すると
共に、前記記録媒体から前記第2のフォーマットの画像
データを読み出して前記第2のデータバスを介して前記
第2のメモリに書き込む記録再生手段と、 前記第1のメモリと前記第2のメモリとの間で前記画像
データを転送すると共に、前記第1のメモリと前記第2
のメモリとの間で転送される画像データのフォーマット
を変換する転送手段とを備え、前記転送手段は、前記第
2のメモリから前記第1のメモリへの画像データの転送
時に前記第2のメモリから前記第1のメモリへ転送され
る画像データ中のエラーを補間する ことを特徴とする画
像処理装置。 - 【請求項2】 更に、前記第2のデータバスに接続さ
れ、前記記録再生手段により再生された前記第2のフォ
ーマットの画像データ中のエラーを訂正するエラー訂正
手段を備え、前記転送手段は前記エラー訂正手段により
訂正不能なエラーを補間する請求項1に記載の画像処理
装置。 - 【請求項3】 前記エラー訂正手段は、前記訂正不能な
エラーを示すフラグを発生し、前記第2のデータバスを
介して前記第2のメモリに書き込む請求項2に記載の画
像処理装置。 - 【請求項4】 前記転送手段は、前記第2のメモリに記
憶された前記フラグに応じて前記補間処理を行う請求項
3に記載の画像処理装置。 - 【請求項5】 前記転送手段は、前記第2のメモリから
前記第1のメモリへの画像データの転送時において前記
第2のメモリから前記第1のメモリに対する前記エラー
に対応した画像データの転送を禁止することにより前記
補間処理を行う請求項1に記載の画像処理装置。 - 【請求項6】 前記第1のフォーマットは、前記入力手
段からの画像データの入力順に従うフォーマットであ
り、前記第2のフォーマットは前記記録媒体上の記録フ
ォーマットに従うフォーマットである請求項1に記載の
画像処理装置。 - 【請求項7】 前記転送手段は、前記第1のメモリのア
ドレスを前記第2のメモリのアドレスに変換すると共
に、前記第2のメモリのアドレスを前記第1のメモリの
アドレスに変換するアドレス変換手段を有する請求項1
に記載の画像処理装置。 - 【請求項8】 記録媒体から画像データを再生する装置
であって、 入力順に従う第1のフォーマットの画像データを伝送す
る第1のデータバスと、 前記第1のデータバスに接続され、前記第1のフォーマ
ットの画像データを記憶する第1のメモリと、 前記記録媒体上の記録フォーマットに従う第2のフォー
マットの画像データを伝送する第2のデータバスと、 前記第2のデータバスに接続され、前記第2のフォーマ
ットの画像データを記憶する第2のメモリと、 前記記録媒体から前記第2のフォーマットの画像データ
を再生し、再生された画像データを前記第2のデータバ
スを介して前記第2のメモリに出力する再生手段と、 前記第2のメモリより前記第2のフォーマットの画像デ
ータを読み出し、そのフォーマットを前記第2のフォー
マットから前記第1のフォーマットに変換して前記第1
のメモリに書き込む転送手段と、 前記再生画像データ中のエラーを訂正すると共に訂正不
能なエラーを検出するエラー訂正手段と、 前記エラー訂正手段によるエラー検出結果に応じて前記
転送手段による前記第 2のメモリから前記第1のメモリ
への画像データの転送を禁止する制御手段とを備えるこ
とを特徴とする画像処理装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP03287852A JP3118909B2 (ja) | 1991-11-01 | 1991-11-01 | 画像処理装置 |
US08/296,928 US5930453A (en) | 1991-11-01 | 1994-08-31 | Image processing apparatus with two types of data format |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP03287852A JP3118909B2 (ja) | 1991-11-01 | 1991-11-01 | 画像処理装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH05130563A JPH05130563A (ja) | 1993-05-25 |
JP3118909B2 true JP3118909B2 (ja) | 2000-12-18 |
Family
ID=17722617
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP03287852A Expired - Fee Related JP3118909B2 (ja) | 1991-11-01 | 1991-11-01 | 画像処理装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3118909B2 (ja) |
-
1991
- 1991-11-01 JP JP03287852A patent/JP3118909B2/ja not_active Expired - Fee Related
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Publication number | Publication date |
---|---|
JPH05130563A (ja) | 1993-05-25 |
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