JP3077723B2 - 周波数位相比較回路 - Google Patents
周波数位相比較回路Info
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Description
関し、特にシステムを間欠動作させる回路に使用する周
波数位相比較回路に関する。
ように周波数位相比較器1及びチャージポンプ回路2を
含んで構成され、周波数位相比較器1は図4(b)に示
すゲート回路の組み合わせ(順序回路)で構成される。
であるアップ出力信号gをチャージポンプ回路2の特性
に合わせるために、反転器5を含んでいる。
ャートである。周波数位相比較器1の同期信号aに対
し、もう一方の被同期信号bの位相が進んでいるか、周
波数が高い期間ではアップ出力信号gはその期間ロウ出
力を出し、ダウン出力信号hはハイ出力を出す。
号hの値により、チャージポンプ回路2の出力信号fは
Pch Mos(P MOST)トランジスタQ1がオ
フ、Nch Mos(N MOST)トランジスタQ2
がオン状態となるので、ロウ出力の電流引き込みを行な
う(図5中のH〜I)。
の負荷側が通常容量性の負荷となり、ローパスフィルタ
(PLLではループフィルタという)を構成するので、
この場合、Cチャージダウンを行なう。
遅れるか、周波数が低い場合には、ダウン出力信号h
は、その期間ロウ出力を出し、アップ出力信号gはハイ
出力となる。
ch Mos(P MOST)トランジスタQ1がオ
ン、Nch Mos(N MOST)トランジスタQ2
がオフ状態となるので、ハイ出力の電流吐き出しを行な
う(図5中J〜K)。
ルタに対しては、Cチャージアップを行なうことにな
る。
周波数が共に一致している場合には、アップ出力信号
g、ダウン出力信号hは共にハイレベルを出力してい
る。
信号fはPch Mos(P MOST)トランジスタ
Q1、Nch Mos(N MOST)トランジスタQ
2が共にオフ状態であるため、ハイインピーダンス状態
となる。
インピーダンスであるので、電流の引き込み、吐き出し
がなく、保持状態になる。PLL回路がロックしている
場合は、定状位相誤差の状態を除き、その保持状態であ
り、ローパスフィルタの出力の電位を一定に保ち、VC
Oのチューニング電圧として与える為VCOの発振周波
数を一定にする。
たシステムにおいては、システムを間欠的に動作させる
場合がある。前記のPLLを用い、周波数シンセサイザ
を構成し、これを移動無線機、コードレス電話等のシス
テムで使用する場合、消費電力を極力押さえるために、
システムを間欠動作させる例がこれにあたる。
LLをロックアップ時間に依存する為、間欠動作時のP
LLロックアップ時間を短くするという技術が必要とな
ってくる。
ては、システムオン初期における位相、周波数差の読み
取り誤りによる、逆方向の位相誤差出力がある。従来の
周波数位相比較回路においては、図4(b)に示すよう
に周波数位相比較器1が順序回路で構成されている為、
その出力状態の決定は、前状態によって決まる。
力a,bの信号クロックの立ち下がりエッジにて動作状
態を決定していくが、その決定条件は前クロックにおい
て決定された状態に準ずるということである。
定)状態から初めのクロックに対する出力は、正常な動
作とはいえない場合がある。図6のタイミングチャート
を用いて説明する。図中、a,b,fは図4(a)にお
ける従来回路の端子、信号記号と同一である。
動作制御信号は、システムの電源或いは、PLL系の動
作制御を示す。図中、A点において、間欠動作制御信号
においてPLL系が動作状態になったものとする。
ように被同期信号bが同期信号aより位相が進んでい
る。本来の状態であれば、図中D点からG点に示すよう
に、位相差に応じた出力信号fが得られる。
の位相差に応じた出力信号fがハイレベルにある。同じ
くF点からG点までもハイレベルを示す。
初めの状態においては、正常の状態出力を得ることがで
きず、場合によっては、出力信号fがハイレベルを出す
べき状態において、ロウレベルを出力してしまうことが
ある(A〜C点)。
込み時、一旦逆の状態へ引き込まれてから正常引き込み
方向へ戻るため、時間的なロスをすることになる。つま
り、PLLの動作立上り時、ロックアップタイムを長く
してしまうという問題がある。
り時、ロックアップタイムを短縮することができる周波
数位相比較回路を提供することにある。
号と被同期信号との位相差を検出する、順序回路で構成
された、周波数位相比較器と、前記同期信号及び間欠動
作制御信号を入力とし、該間欠動作制御信号が休止状態
を示す信号レベルから動作状態を示す信号レベルへ遷移
してから前記同期信号が所定のクロック数を出力する期
間、所定の論理レベルを出力する間欠動作検出回路と、
該間欠動作検出回路の出力と前記周波数位相比較器の2
つの位相誤差出力を入力とする間欠出力制御回路と、該
間欠出力制御回路の出力を入力とするチャージポンプ回
路とを有し、前記間欠出力制御回路は、前記間欠動作検
出回路が前記所定の論理レベルを出力している期間、前
記チャージポンプ回路の出力をハイインピーダンス状態
とする信号を出力し、その後、前記位相誤差出力を前記
チャージポンプ回路に出力するものであることを特徴と
する周波数位相比較回路が得られる。
態から動作状態に移った後、不定な誤ったチャージポン
プ出力を出すことがなく、正確な周波数位相差に応じた
出力を出すことにより、逆方向への周波数位相制御を行
なわなくなる。
実施例は従来と同様の周波数位相比較器(PFC)1
と、同期信号a及び間欠動作制御信号cを入力とする間
欠動作検出回路3と、この間欠動作検出回路3の出力e
を入力とし、周波数位相比較器1の2つの出力g,hを
間欠出力として制御する間欠出力制御回路4と、この間
欠出力制御回路4により間欠出力として制御された2つ
の出力g’,h’に接続された従来と同様のチャージポ
ンプ回路2より構成される。
行なう。図2は図1に示した本発明による回路図に対応
したタイムチャートである。比較のために、従来回路で
ある図4に対応するタイムチャートである図6を参照す
る。
又はシステムの間欠動作に連動しており、ハイ状態時に
は休止状態、ロウ状態時は動作状態を示すものとする。
A点で間欠動作を動作状態とした場合、周波数位相比較
器1の動作状態は不安定な状態となっている。
被同期信号bにかかわりなく不定の信号出力を示す。
2の出力状態は、図7に示す遷移表に示す通りであり、
一般に入力2クロック後には正常の周波数位相比較出力
を出すことが分かる。
までの間は不定な出力を出すことになる。
ら、同期信号が2クロック入力されるまで、チャージポ
ンプ出力fをハイインピーダンス状態とするように、間
欠動作検出回路3と間欠出力制御回路4を設けている。
cがハイからロウになることで分周回路をセット状態か
ら解除し、同期信号aのクロックに従い、カウント動作
を行なう。
は、間欠動作制御信号3がロウ状態に移った後、同期信
号aのクロックで2クロックされた後、出力をハイから
ロウ状態に移る。
回路3の出力eを受けて、出力eがハイ状態時、チャー
ジポンプ回路2への出力をチャージポンプ回路2がハイ
インピーダンス状態になるよう出力制御し、出力eがロ
ウ状態時には、チャージポンプ回路2が従来と同様の動
作を行なうように出力制御する。
NOR回路2つと、反転回路1つとから構成できる。反
転回路はチャージポンプ回路2をトランジスタの極性を
合わせるものである。
の立上りで出力変化するセット入力付きD−FF2段で
構成することができる。
は、間欠動作を動作状態に移した後、不定な出力が出る
期間、同期信号2クロックの間はハイインピーダンス出
力を出力し、正常な周波数位相比較信号に対応する出力
状態の同期信号aの2クロック後から正常な出力信号f
を出力することになる。
のである。図1に対応して、同期信号a、被同期信号b
に対する位相誤差出力を極性反転している。第2の実施
例においても、第1の実施例と同様の動作を行なう。
LLにおいて、休止状態から動作状態に移った後、不定
な誤ったチャージポンプ出力を出すことがなく、正確な
周波数位相差に応じた出力を出すことにより、逆方向へ
の周波数位相制御を行なわなくなる為、これによるPL
Lのロックアップ時間の延長をなくし、効果的にロック
アップ時間を短くすることができる。
LL動作立上り時、ロックアップタイムを短縮すること
ができる。
すブロック図である。
イムチャートである。
る。
イムチャートである。
説明したタイムチャートである。
路の動作を説明する状態遷移図である。
Claims (1)
- 【請求項1】 同期信号と被同期信号との位相差を検出
する、順序回路で構成された、周波数位相比較器と、 前記同期信号及び間欠動作制御信号を入力とし、該間欠
動作制御信号が休止状態を示す信号レベルから動作状態
を示す信号レベルへ遷移してから前記同期信号が所定の
クロック数を出力する期間、所定の論理レベルを出力す
る間欠動作検出回路と、 該間欠動作検出回路の出力と前記周波数位相比較器の2
つの位相誤差出力を入力とする間欠出力制御回路と、 該間欠出力制御回路の出力を入力とするチャージポンプ
回路とを有し、 前記間欠出力制御回路は、前記間欠動作検出回路が前記
所定の論理レベルを出力している期間、前記チャージポ
ンプ回路の出力をハイインピーダンス状態とする信号を
出力し、その後、前記位相誤差出力を前記チャージポン
プ回路に出力するものであることを特徴とする周波数位
相比較回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP04344597A JP3077723B2 (ja) | 1992-12-24 | 1992-12-24 | 周波数位相比較回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP04344597A JP3077723B2 (ja) | 1992-12-24 | 1992-12-24 | 周波数位相比較回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH06197013A JPH06197013A (ja) | 1994-07-15 |
JP3077723B2 true JP3077723B2 (ja) | 2000-08-14 |
Family
ID=18370506
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP04344597A Expired - Fee Related JP3077723B2 (ja) | 1992-12-24 | 1992-12-24 | 周波数位相比較回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3077723B2 (ja) |
-
1992
- 1992-12-24 JP JP04344597A patent/JP3077723B2/ja not_active Expired - Fee Related
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JPH06197013A (ja) | 1994-07-15 |
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