JP3075425B2 - デジタルオシロスコープ - Google Patents
デジタルオシロスコープInfo
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- JP3075425B2 JP3075425B2 JP03103048A JP10304891A JP3075425B2 JP 3075425 B2 JP3075425 B2 JP 3075425B2 JP 03103048 A JP03103048 A JP 03103048A JP 10304891 A JP10304891 A JP 10304891A JP 3075425 B2 JP3075425 B2 JP 3075425B2
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- Controls And Circuits For Display Device (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、デジタルオシロスコー
プの表示に関し、詳しくはその表示画面を標準テレビ信
号規格の映像信号に変換し出力する機能を有するデジタ
ルオシロスコープに関するものである。
プの表示に関し、詳しくはその表示画面を標準テレビ信
号規格の映像信号に変換し出力する機能を有するデジタ
ルオシロスコープに関するものである。
【０００２】
【従来の技術】従来のデジタルオシロスコープでは、波
形観測結果をその内蔵ＣＲＴで表示を行い、外部の標準
のテレビ等に表示させることが出来なかった。この様な
デジタルオシロスコープを用いて、例えば波形の長時間
の観測を行い後に再現したいとする。
形観測結果をその内蔵ＣＲＴで表示を行い、外部の標準
のテレビ等に表示させることが出来なかった。この様な
デジタルオシロスコープを用いて、例えば波形の長時間
の観測を行い後に再現したいとする。
【０００３】
【発明が解決しようとする課題】上記のようなロングメ
モリを実現するためには、大容量のメモリが必要にな
り、実現が困難であるという問題があった。本発明はこ
の様な問題点を解決するためになされたものであり、デ
ジタルオシロスコープ等において、波形観測の結果をデ
ジタル信号処理して高画質の画像を標準のテレビ等に表
示させる手段を設けさせ、ビデオ録画などを可能にし長
時間の波形観測の結果を記憶し観測することのできるデ
ジタルオシロスコープを実現することを目的とする。
モリを実現するためには、大容量のメモリが必要にな
り、実現が困難であるという問題があった。本発明はこ
の様な問題点を解決するためになされたものであり、デ
ジタルオシロスコープ等において、波形観測の結果をデ
ジタル信号処理して高画質の画像を標準のテレビ等に表
示させる手段を設けさせ、ビデオ録画などを可能にし長
時間の波形観測の結果を記憶し観測することのできるデ
ジタルオシロスコープを実現することを目的とする。
【０００４】
【課題を解決するための手段】本発明は、アナログの入
力信号を、デジタル信号に変換するＡ／Ｄ変換回路と、
前記Ａ／Ｄ変換手段から入力したデジタル信号を記憶
する表示データ記憶手段と、前記表示データ記憶手段か
ら入力したデジタル信号を表示するための信号に変換す
る波形表示回路と、前記波形表示回路から入力した信号
を表示する内蔵表示手段と、前記波形表示回路から入力
した信号をデジタル信号処理して標準テレビ信号規格の
映像信号に変換し出力するテレビ出力変換回路を設け、
一般のテレビにおいて波形観測ができることを特徴とす
るデジタルオシロスコープである。
力信号を、デジタル信号に変換するＡ／Ｄ変換回路と、
前記Ａ／Ｄ変換手段から入力したデジタル信号を記憶
する表示データ記憶手段と、前記表示データ記憶手段か
ら入力したデジタル信号を表示するための信号に変換す
る波形表示回路と、前記波形表示回路から入力した信号
を表示する内蔵表示手段と、前記波形表示回路から入力
した信号をデジタル信号処理して標準テレビ信号規格の
映像信号に変換し出力するテレビ出力変換回路を設け、
一般のテレビにおいて波形観測ができることを特徴とす
るデジタルオシロスコープである。
【０００５】
【作用】デジタルオシロスコープ内蔵のＣＲＴに表示さ
せるための一画面毎のデータを、テレビ等に出力する際
に、複数のメモリを順番に用いることにより、内蔵のＣ
ＲＴに表示するタイミング（フレーム周期）に与えられ
る表示データを、テレビ等に表示するタイミング（テレ
ビ用のフレーム周期）でテレビ等に出力する。
せるための一画面毎のデータを、テレビ等に出力する際
に、複数のメモリを順番に用いることにより、内蔵のＣ
ＲＴに表示するタイミング（フレーム周期）に与えられ
る表示データを、テレビ等に表示するタイミング（テレ
ビ用のフレーム周期）でテレビ等に出力する。
【０００６】
【実施例】図１は、本発明の基本的な構成図である。
【０００７】１はＡ／Ｄ変換手段で、アナログの入力信
号を入力しデジタル信号に変換する。２は表示データ記
憶手段で、Ａ／Ｄ変換回路で変換したデジタル信号を記
憶する。３は波形表示回路で、表示データ記憶手段２か
ら出力されるデジタル信号を波形表示可能な信号に変換
する。４は内蔵表示手段で、波形表示回路３から入力し
た信号を表示する。５はテレビ出力変換回路で、波形表
示回路３から入力した信号を一般のテレビに出力できる
信号に変換する。この様な構成においては、入力信号を
Ａ／Ｄ変換回路１でデジタル信号に変換する。このデジ
タル信号のデータは表示データ記憶手段２に格納され、
本発明デジタルオシロスコープ全体の動作を制御してい
るようなＣＰＵで、読み出され演算処理を行ったのち波
形表示回路３に入力する。前記波形表示回路３では、前
記のデータを内蔵表示手段４で表示できるようなシリア
ル信号等に変換する。デジタルオシロスコープ本体に内
蔵されているような内蔵表示手段４は波形表示回路３か
らの信号で表示データを表示する。またテレビ出力変換
回路５は、本発明の特徴を担い、波形表示回路からの出
力信号ｓを一般のテレビに出力できる信号に変換してい
る。
号を入力しデジタル信号に変換する。２は表示データ記
憶手段で、Ａ／Ｄ変換回路で変換したデジタル信号を記
憶する。３は波形表示回路で、表示データ記憶手段２か
ら出力されるデジタル信号を波形表示可能な信号に変換
する。４は内蔵表示手段で、波形表示回路３から入力し
た信号を表示する。５はテレビ出力変換回路で、波形表
示回路３から入力した信号を一般のテレビに出力できる
信号に変換する。この様な構成においては、入力信号を
Ａ／Ｄ変換回路１でデジタル信号に変換する。このデジ
タル信号のデータは表示データ記憶手段２に格納され、
本発明デジタルオシロスコープ全体の動作を制御してい
るようなＣＰＵで、読み出され演算処理を行ったのち波
形表示回路３に入力する。前記波形表示回路３では、前
記のデータを内蔵表示手段４で表示できるようなシリア
ル信号等に変換する。デジタルオシロスコープ本体に内
蔵されているような内蔵表示手段４は波形表示回路３か
らの信号で表示データを表示する。またテレビ出力変換
回路５は、本発明の特徴を担い、波形表示回路からの出
力信号ｓを一般のテレビに出力できる信号に変換してい
る。
【０００８】図２は、本発明の一実施例の具体的構成図
で、図１内のテレビ出力変換回路５を詳しく説明したも
のである。図において、１０，１１はデータ変換回路
で、図１内の内蔵表示手段４に入力されるビデオ用のシ
リアルデータの信号ｓを８ビットの信号にデータ変換回
路１０で変換し、バッファ２０，２２，２４に出力す
る。変換メモリ１７〜１９から読み出された８ビットデ
ータはバッファ２６，２８，３０を介し、データ変換回
路１１でシリアル信号に変換し、端子Ｖout からシリア
ルのテレビ信号として出力される。１２，１３はアドレ
スカウンタで、端子Ｃｏinからの表示クロック（内蔵表
示手段４の１点を表示する時間を示すクロック）の８分
周のタイミングのパルスをアドレスカウンタ１２でカウ
ントし、書き込みアドレスをバッファ２１，２３，２５
を介し変換メモリ１７〜１９に出力する。アドレスカウ
ンタ１３は、端子Ｃｖinからのテレビ信号表示クロック
の８分周のタイミングのパルスをカウントし、読出しア
ドレスをバッファ２７，２９，３１を介し変換メモリ１
７〜１９に出力する。１４は書き込み信号発生回路で、
端子Ｆｏinから入力される内蔵表示手段４のフレーム信
号（内蔵表示手段４の１画面を表示する時間を示すパル
ス）を入力し、変換メモリ１７〜１９の書き込み信号ｗ
１，ｗ２，ｗ３をバッファ２０〜２５および変換メモリ
１７〜１９に出力する。１５は読出し信号発生回路で、
タインミング調整回路１６からの信号を入力し、変換メ
モリ１７〜１９の読出し信号ｒ１，ｒ２，ｒ３をバッフ
ァ２６〜３１および変換メモリ１７〜１９に出力する。
タインミング調整回路１６は、書き込み信号発生回路１
４からの信号と、端子Ｆｖinから入力されるテレビフレ
ーム信号（テレビの１画面を表示する時間を示すパル
ス）と、上記端子Ｃｖinからのテレビ信号表示クロック
を入力し、内蔵表示手段４のフレーム信号とテレビフレ
ーム信号とのずれを調整させる信号を読出し信号発生回
路１５に出力し、読出し用のアドレスカウンタ１３とデ
ータ変換回路１１で用いる信号を出力する。
で、図１内のテレビ出力変換回路５を詳しく説明したも
のである。図において、１０，１１はデータ変換回路
で、図１内の内蔵表示手段４に入力されるビデオ用のシ
リアルデータの信号ｓを８ビットの信号にデータ変換回
路１０で変換し、バッファ２０，２２，２４に出力す
る。変換メモリ１７〜１９から読み出された８ビットデ
ータはバッファ２６，２８，３０を介し、データ変換回
路１１でシリアル信号に変換し、端子Ｖout からシリア
ルのテレビ信号として出力される。１２，１３はアドレ
スカウンタで、端子Ｃｏinからの表示クロック（内蔵表
示手段４の１点を表示する時間を示すクロック）の８分
周のタイミングのパルスをアドレスカウンタ１２でカウ
ントし、書き込みアドレスをバッファ２１，２３，２５
を介し変換メモリ１７〜１９に出力する。アドレスカウ
ンタ１３は、端子Ｃｖinからのテレビ信号表示クロック
の８分周のタイミングのパルスをカウントし、読出しア
ドレスをバッファ２７，２９，３１を介し変換メモリ１
７〜１９に出力する。１４は書き込み信号発生回路で、
端子Ｆｏinから入力される内蔵表示手段４のフレーム信
号（内蔵表示手段４の１画面を表示する時間を示すパル
ス）を入力し、変換メモリ１７〜１９の書き込み信号ｗ
１，ｗ２，ｗ３をバッファ２０〜２５および変換メモリ
１７〜１９に出力する。１５は読出し信号発生回路で、
タインミング調整回路１６からの信号を入力し、変換メ
モリ１７〜１９の読出し信号ｒ１，ｒ２，ｒ３をバッフ
ァ２６〜３１および変換メモリ１７〜１９に出力する。
タインミング調整回路１６は、書き込み信号発生回路１
４からの信号と、端子Ｆｖinから入力されるテレビフレ
ーム信号（テレビの１画面を表示する時間を示すパル
ス）と、上記端子Ｃｖinからのテレビ信号表示クロック
を入力し、内蔵表示手段４のフレーム信号とテレビフレ
ーム信号とのずれを調整させる信号を読出し信号発生回
路１５に出力し、読出し用のアドレスカウンタ１３とデ
ータ変換回路１１で用いる信号を出力する。
【０００９】表示データは、フレーム信号の１周期毎に
１画面ずつ波形表示回路３からシリアル信号で送られて
くる。そして、テレビフレーム信号の１周期毎に１画面
ずつ表示データを一般のテレビに出力する。但し、フレ
ーム信号とテレビフレーム信号は同期がとれていないか
ら、フレーム信号で変換メモリ１７〜１９に順番に表示
データを書き込み、テレビフレーム信号で変換メモリ１
７〜１９から順番に表示データを読出すと、書き込みと
読出しが同時に、同一メモリで行われることになる。こ
れを回避するためにタインミング調整回路１６で、書き
込み信号発生回路１４からの信号と、端子Ｆｖinから入
力されるテレビフレーム信号（テレビの１画面を表示す
る時間を示すパルス）と、上記端子Ｃｖinからのテレビ
信号表示クロックを入力し、内蔵表示手段４のフレーム
信号とテレビフレーム信号とのずれを調整させる信号を
読出し信号発生回路１５に出力し、読出し用のアドレス
カウンタ１３とデータ変換回路１１で用いる信号を出力
する。この信号に基づき読出し信号発生回路１５は、書
き込みと読出しが重ならないタイミングで、読出し信号
ｒ１，ｒ２，ｒ３をバッファ２６〜３１および変換メモ
リ１７〜１９に出力する。バッファ２０〜３１は書き込
み信号ｗ１，ｗ２，ｗ３と読出し信号ｒ１，ｒ２，ｒ３
に基づいてメモリ１７〜１９に入力されるアドレスの制
御およびデータの書き込み読出しの制御を行う。
１画面ずつ波形表示回路３からシリアル信号で送られて
くる。そして、テレビフレーム信号の１周期毎に１画面
ずつ表示データを一般のテレビに出力する。但し、フレ
ーム信号とテレビフレーム信号は同期がとれていないか
ら、フレーム信号で変換メモリ１７〜１９に順番に表示
データを書き込み、テレビフレーム信号で変換メモリ１
７〜１９から順番に表示データを読出すと、書き込みと
読出しが同時に、同一メモリで行われることになる。こ
れを回避するためにタインミング調整回路１６で、書き
込み信号発生回路１４からの信号と、端子Ｆｖinから入
力されるテレビフレーム信号（テレビの１画面を表示す
る時間を示すパルス）と、上記端子Ｃｖinからのテレビ
信号表示クロックを入力し、内蔵表示手段４のフレーム
信号とテレビフレーム信号とのずれを調整させる信号を
読出し信号発生回路１５に出力し、読出し用のアドレス
カウンタ１３とデータ変換回路１１で用いる信号を出力
する。この信号に基づき読出し信号発生回路１５は、書
き込みと読出しが重ならないタイミングで、読出し信号
ｒ１，ｒ２，ｒ３をバッファ２６〜３１および変換メモ
リ１７〜１９に出力する。バッファ２０〜３１は書き込
み信号ｗ１，ｗ２，ｗ３と読出し信号ｒ１，ｒ２，ｒ３
に基づいてメモリ１７〜１９に入力されるアドレスの制
御およびデータの書き込み読出しの制御を行う。
【００１０】この様な構成の動作を図３に示すタイムチ
ャートで説明する。本実施例では３個のメモリで表示デ
ータを順番に格納してゆくので、書き込み信号ｗ１，ｗ
２，ｗ３はフレーム信号を３分周したものとなる。各々
の信号がＬレベルで動作の許可状態である。たとえば、
書き込み信号ｗ１がＬレベル状態において、変換メモリ
１７は書き込み状態になり、バッファ２１を介して入力
されるアドレスカウンタ１３からの書き込みアドレス
に、バッファ２０を介した８ビットの表示データが書き
込まれる。また、テレビフレーム信号を３分周して読出
し信号としている。読出し信号ｒ１がＬレベル状態にお
いて、変換メモリ１７は読出し状態になり、バッファ２
７を介して入力される、アドレスカウンタ１４からの読
み出しアドレスから、バッファ２６を介した８ビットの
表示データが読み出され、データ変換回路１１でシリア
ル信号に変換し、端子Ｖout からテレビ信号を出力す
る。
ャートで説明する。本実施例では３個のメモリで表示デ
ータを順番に格納してゆくので、書き込み信号ｗ１，ｗ
２，ｗ３はフレーム信号を３分周したものとなる。各々
の信号がＬレベルで動作の許可状態である。たとえば、
書き込み信号ｗ１がＬレベル状態において、変換メモリ
１７は書き込み状態になり、バッファ２１を介して入力
されるアドレスカウンタ１３からの書き込みアドレス
に、バッファ２０を介した８ビットの表示データが書き
込まれる。また、テレビフレーム信号を３分周して読出
し信号としている。読出し信号ｒ１がＬレベル状態にお
いて、変換メモリ１７は読出し状態になり、バッファ２
７を介して入力される、アドレスカウンタ１４からの読
み出しアドレスから、バッファ２６を介した８ビットの
表示データが読み出され、データ変換回路１１でシリア
ル信号に変換し、端子Ｖout からテレビ信号を出力す
る。
【００１１】しかしながら、図３内に示す、テレビフレ
ーム信号を３分周しただけのｒ１´に着目すると、フレ
ーム信号が立ち上がったｔ1 からテレビフレーム信号が
立ち上がるまでの間に、変換メモリ１７では書き込みと
読出しが同時に行われてしまうことが理解される。タイ
ンミング調整回路１６ではこのとき（ｔ1 からｔ2 の期
間）、すべてのメモリの読出しを禁止し、次のテレビフ
レーム信号の立ち上がりから、変換メモリ１７，１８，
１９と順番に読出しを行うように読出し信号発生回路な
どに信号を出力する。この様にして、周期の違うフレー
ム信号（例えば５９．９７Ｈz ）とテレビフレーム信号
（例えばＮＴＳＣ方式では６０Ｈz ）とを用いて、テレ
ビへの表示データの出力を行う。
ーム信号を３分周しただけのｒ１´に着目すると、フレ
ーム信号が立ち上がったｔ1 からテレビフレーム信号が
立ち上がるまでの間に、変換メモリ１７では書き込みと
読出しが同時に行われてしまうことが理解される。タイ
ンミング調整回路１６ではこのとき（ｔ1 からｔ2 の期
間）、すべてのメモリの読出しを禁止し、次のテレビフ
レーム信号の立ち上がりから、変換メモリ１７，１８，
１９と順番に読出しを行うように読出し信号発生回路な
どに信号を出力する。この様にして、周期の違うフレー
ム信号（例えば５９．９７Ｈz ）とテレビフレーム信号
（例えばＮＴＳＣ方式では６０Ｈz ）とを用いて、テレ
ビへの表示データの出力を行う。
【００１２】
【発明の効果】本発明により、デジタルオシロスコープ
内蔵のＣＲＴに表示させた内容を、デジタル回路によっ
て構成されたテレビ出力変換回路を用いて標準テレビ規
格の映像信号に変換し出力することが可能となるため、
常に安定した高画質の画像をテレビまたはビデオ機器に
出力することが可能になる。また、デジタル回路では、
周囲温度の変化や経年劣化等による素子の特性の変化が
無いため、一度、テレビ出力変換回路の映像調整を行っ
た後は、再調整を行う必要が無い。従ってデジタルオシ
ロスコープのランニングコストを大幅に低減することが
可能である。
内蔵のＣＲＴに表示させた内容を、デジタル回路によっ
て構成されたテレビ出力変換回路を用いて標準テレビ規
格の映像信号に変換し出力することが可能となるため、
常に安定した高画質の画像をテレビまたはビデオ機器に
出力することが可能になる。また、デジタル回路では、
周囲温度の変化や経年劣化等による素子の特性の変化が
無いため、一度、テレビ出力変換回路の映像調整を行っ
た後は、再調整を行う必要が無い。従ってデジタルオシ
ロスコープのランニングコストを大幅に低減することが
可能である。
【図１】本発明の構成図である。
【図２】本発明の一実施例を示す図である。
【図３】本発明の一実施例動作を示すタイムチャートで
ある。
ある。
１…Ａ／Ｄ変換手段、 ２…表示データ記憶手段、 ３…波形表示回路、 ４…内蔵表示手段、 ５…テレビ出力変換回路、 １０，１１…データ変換回路、 １２，１３…アドレスカウンタ、 １４，１５…信号発生回路、 １６…タインミング調整回路、 １７〜１９…変換メモリ、 ２０〜３１…バッファ。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平３−94172（ＪＰ，Ａ) 実開 平４−102476（ＪＰ，Ｕ) 実開 平４−16371（ＪＰ，Ｕ) (58)調査した分野(Int.Cl.7，ＤＢ名) G01R 13/00 - 13/42
Claims (1)
- 【請求項１】アナログの入力信号を、デジタル信号に変
換するＡ／Ｄ変換回路と、 前記Ａ／Ｄ変換手段から入
力したデジタル信号を記憶する表示データ記憶手段と、
前記表示データ記憶手段から入力したデジタル信号を表
示するための信号に変換する波形表示回路と、前記波形
表示回路から入力した信号を表示する内蔵表示手段と、
前記波形表示回路から入力した信号をデジタル信号処理
して標準テレビ信号規格の映像信号に変換し出力するテ
レビ出力変換回路を設け、一般のテレビにおいて波形観
測ができることを特徴とするデジタルオシロスコープ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03103048A JP3075425B2 (ja) | 1991-05-09 | 1991-05-09 | デジタルオシロスコープ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03103048A JP3075425B2 (ja) | 1991-05-09 | 1991-05-09 | デジタルオシロスコープ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04332873A JPH04332873A (ja) | 1992-11-19 |
| JP3075425B2 true JP3075425B2 (ja) | 2000-08-14 |
Family
ID=14343789
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03103048A Expired - Fee Related JP3075425B2 (ja) | 1991-05-09 | 1991-05-09 | デジタルオシロスコープ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3075425B2 (ja) |
-
1991
- 1991-05-09 JP JP03103048A patent/JP3075425B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04332873A (ja) | 1992-11-19 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |