JP3013471B2 - 画像表示装置 - Google Patents
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- JP3013471B2 JP3013471B2 JP3047786A JP4778691A JP3013471B2 JP 3013471 B2 JP3013471 B2 JP 3013471B2 JP 3047786 A JP3047786 A JP 3047786A JP 4778691 A JP4778691 A JP 4778691A JP 3013471 B2 JP3013471 B2 JP 3013471B2
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- electrodes
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- G—PHYSICS
- G02—OPTICS
- G02F—OPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
- G02F1/00—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
- G02F1/01—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour
- G02F1/13—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour based on liquid crystals, e.g. single liquid crystal display cells
- G02F1/133—Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
- G02F1/1333—Constructional arrangements; Manufacturing methods
- G02F1/13334—Plasma addressed liquid crystal cells [PALC]
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- Devices For Indicating Variable Information By Combining Individual Elements (AREA)
- Control Of Gas Discharge Display Tubes (AREA)
- Engineering & Computer Science (AREA)
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、プラズマを利用して電
気光学材料層を駆動し画素選択を行う画像表示装置に関
するものである。
気光学材料層を駆動し画素選択を行う画像表示装置に関
するものである。
【０００２】
【従来の技術】例えば、液晶ディスプレイを高解像度
化，高コントラスト化するための手段としては、各表示
画素毎にトランジスタ等の能動素子を設け、これを駆動
する方法（いわゆるアクティブマトリクスアドレス方
式）が一般に行われている。しかしながら、この場合、
薄膜トランジスタの如き半導体素子を多数設ける必要が
あることから、特に大面積化したときに歩留りの問題が
懸念され、どうしてもコスト高になるという大きな問題
が生ずる。
化，高コントラスト化するための手段としては、各表示
画素毎にトランジスタ等の能動素子を設け、これを駆動
する方法（いわゆるアクティブマトリクスアドレス方
式）が一般に行われている。しかしながら、この場合、
薄膜トランジスタの如き半導体素子を多数設ける必要が
あることから、特に大面積化したときに歩留りの問題が
懸念され、どうしてもコスト高になるという大きな問題
が生ずる。
【０００３】そこで、これを解決する手段として、ブザ
ク等は、特開平１−２１７３９６号公報において、能動
素子としてＭＯＳトランジスタや薄膜トランジスタ等の
半導体素子ではなく放電プラズマを利用する方法を提案
している。以下、放電プラズマを利用して液晶を駆動す
る画像表示装置の構成を簡単に説明する。
ク等は、特開平１−２１７３９６号公報において、能動
素子としてＭＯＳトランジスタや薄膜トランジスタ等の
半導体素子ではなく放電プラズマを利用する方法を提案
している。以下、放電プラズマを利用して液晶を駆動す
る画像表示装置の構成を簡単に説明する。
【０００４】この画像表示装置は、プラズマ・アドレス
ト・液晶表示装置（ＰＡＬＣ）と称されるもので、図６
に示すように、電気光学材料層である液晶層１０１と、
プラズマ室１０２とが、ガラス等からなる薄い誘電体の
シート１０３を介して隣接配置されてなるものである。
プラズマ室１０２は、ガラス基板１０４に互いに平行な
複数の溝１０５を形成することにより構成されるもの
で、この中にはイオン化可能なガスが封入されている。
また、各溝１０５には、互いに平行な一対の電極１０
６，１０７が設けられており、これら電極１０６，１０
７がプラズマ室１０２内のガスをイオン化して放電プラ
ズマを発生するためのアノード及びカソードとして機能
する。一方、液晶層１０１は、前記誘電体のシート１０
３と透明基板１０８とによって挟持されており、透明基
板１０８の液晶層１０１側の表面には、透明電極１０９
が形成されている。この透明電極１０９は、前記溝１０
５によって構成されるプラズマ室１０２と直交してお
り、これら透明電極１０９とプラズマ室１０２の交差部
分が各画素に対応している。
ト・液晶表示装置（ＰＡＬＣ）と称されるもので、図６
に示すように、電気光学材料層である液晶層１０１と、
プラズマ室１０２とが、ガラス等からなる薄い誘電体の
シート１０３を介して隣接配置されてなるものである。
プラズマ室１０２は、ガラス基板１０４に互いに平行な
複数の溝１０５を形成することにより構成されるもの
で、この中にはイオン化可能なガスが封入されている。
また、各溝１０５には、互いに平行な一対の電極１０
６，１０７が設けられており、これら電極１０６，１０
７がプラズマ室１０２内のガスをイオン化して放電プラ
ズマを発生するためのアノード及びカソードとして機能
する。一方、液晶層１０１は、前記誘電体のシート１０
３と透明基板１０８とによって挟持されており、透明基
板１０８の液晶層１０１側の表面には、透明電極１０９
が形成されている。この透明電極１０９は、前記溝１０
５によって構成されるプラズマ室１０２と直交してお
り、これら透明電極１０９とプラズマ室１０２の交差部
分が各画素に対応している。
【０００５】上記画像表示装置においては、プラズマ放
電が行われるプラズマ室１０２を順次切り換え走査する
とともに、液晶層１０１側の透明電極１０９にこれと同
期して信号電圧を印加することにより、該信号電圧が各
画素に保持され、液晶層１０１が駆動される。したがっ
て、各溝１０５，すなわち各プラズマ室１０２がそれぞ
れ１走査ラインに相当し、走査単位毎に放電領域が分割
されている。
電が行われるプラズマ室１０２を順次切り換え走査する
とともに、液晶層１０１側の透明電極１０９にこれと同
期して信号電圧を印加することにより、該信号電圧が各
画素に保持され、液晶層１０１が駆動される。したがっ
て、各溝１０５，すなわち各プラズマ室１０２がそれぞ
れ１走査ラインに相当し、走査単位毎に放電領域が分割
されている。
【０００６】
【発明が解決しようとする課題】ところで、上述の画像
表示装置においては、各走査線の幅はプラズマ室１０２
（溝１０５）の幅で決まり、放電の物理特性から、通常
は０．４ｍｍ程度、最小でも０．２５ｍｍ程度が限界と
言われている。したがって、このことがＰＡＬＣでの微
細ピッチ化、あるいは高密度ピッチ化を妨げる要因の一
つとなっている。そこで本発明は、かかる従来のものの
有する課題を解決するために提案されたものであって、
走査線の微細ピッチ化、高密度ピッチ化を図ることが可
能な画像表示装置を提供することを目的とする。
表示装置においては、各走査線の幅はプラズマ室１０２
（溝１０５）の幅で決まり、放電の物理特性から、通常
は０．４ｍｍ程度、最小でも０．２５ｍｍ程度が限界と
言われている。したがって、このことがＰＡＬＣでの微
細ピッチ化、あるいは高密度ピッチ化を妨げる要因の一
つとなっている。そこで本発明は、かかる従来のものの
有する課題を解決するために提案されたものであって、
走査線の微細ピッチ化、高密度ピッチ化を図ることが可
能な画像表示装置を提供することを目的とする。
【０００７】
【課題を解決するための手段】上述の目的を達成するた
めに、本発明の画像表示装置は、一主面上に互いに略平
行な複数の第１電極を有する第１の基板と、一主面上に
前記第１電極と略直交し且つ互いに略平行な複数の第２
電極を有する第２の基板とを備え、これら第１の基板と
第２の基板が第１電極と第２電極が対向する如く互いに
略平行に配置されてなり、前記第１の基板の第１電極と
接するように電気光学材料層が間挿されるとともに、前
記電気光学材料層と第２の基板間にイオン化可能なガス
が封入されて放電領域とされ、前記第１電極が各走査単
位において複数に分割され多重マトリクス化されている
ことを特徴とするものである。
めに、本発明の画像表示装置は、一主面上に互いに略平
行な複数の第１電極を有する第１の基板と、一主面上に
前記第１電極と略直交し且つ互いに略平行な複数の第２
電極を有する第２の基板とを備え、これら第１の基板と
第２の基板が第１電極と第２電極が対向する如く互いに
略平行に配置されてなり、前記第１の基板の第１電極と
接するように電気光学材料層が間挿されるとともに、前
記電気光学材料層と第２の基板間にイオン化可能なガス
が封入されて放電領域とされ、前記第１電極が各走査単
位において複数に分割され多重マトリクス化されている
ことを特徴とするものである。
【０００８】
【作用】本発明の画像表示装置においては、信号書き込
み電極であり各プラズマチャンネル（走査線）と直交し
て配設される第１電極が、各走査単位において複数に分
割され多重マトリクス化されている。そして、例えば第
１電極をプラズマチャンネル内で上下２分割する形で２
重マトリクス化すれば、プラズマチャンネル１本に対し
て２つの走査線があるのと等価な動作が行われる。した
がって、走査線の数が一定であれば、プラズマチャンネ
ルのピッチが半減され、加工が容易なものとなる。
み電極であり各プラズマチャンネル（走査線）と直交し
て配設される第１電極が、各走査単位において複数に分
割され多重マトリクス化されている。そして、例えば第
１電極をプラズマチャンネル内で上下２分割する形で２
重マトリクス化すれば、プラズマチャンネル１本に対し
て２つの走査線があるのと等価な動作が行われる。した
がって、走査線の数が一定であれば、プラズマチャンネ
ルのピッチが半減され、加工が容易なものとなる。
【０００９】
【実施例】以下、本発明を適用した具体的な実施例につ
いて、図面を参照しながら詳細に説明する。本実施例の
画像表示装置は、図１に示すように、電極３が形成され
た平坦な第１の基板１と、複数の平行な溝４が形成さ
れ、さらにこの溝４内に放電用電極５が形成されてなる
第２の基板２との間に、電気光学材料層である液晶層６
を間挿するとともに、前記液晶層６と第２の基板２との
間の空間、すなわち前記溝４内を放電領域としてなるも
のである。これら基板１，２は、ここでは非導電性で光
学的に透明な材料により形成されるが、これは透過型表
示装置を考慮してのことで、直視型あるいは反射型表示
装置とする場合には、いずれか一方の基板が透明であれ
ばよい。
いて、図面を参照しながら詳細に説明する。本実施例の
画像表示装置は、図１に示すように、電極３が形成され
た平坦な第１の基板１と、複数の平行な溝４が形成さ
れ、さらにこの溝４内に放電用電極５が形成されてなる
第２の基板２との間に、電気光学材料層である液晶層６
を間挿するとともに、前記液晶層６と第２の基板２との
間の空間、すなわち前記溝４内を放電領域としてなるも
のである。これら基板１，２は、ここでは非導電性で光
学的に透明な材料により形成されるが、これは透過型表
示装置を考慮してのことで、直視型あるいは反射型表示
装置とする場合には、いずれか一方の基板が透明であれ
ばよい。
【００１０】上記第１の基板１には、その１主面に電極
３が形成されるとともに、この電極３に接してネマチッ
ク液晶等からなる液晶層６が配置されている。この液晶
層６は、ガラス、雲母、プラスチック等からなる誘電体
膜７によって第１の基板１との間に挟持されており、こ
れら第１の基板１、液晶層６及び誘電体膜７によって、
いわゆる液晶セルが構成された形になっている。ここ
で、上記電極３は、プラズマチャンネルとなる溝４と直
交されており、各溝４と対向する部分において上下に２
分割されたパターンとされている。すなわち、電極３
は、図２に示すように、各プラズマチャンネル（溝４）
の上半分に対応するパターン電極Ｘ1 ，Ｘ2 ，Ｘ3 ・・
・Ｘm-1 ，Ｘm と、各プラズマチャンネルの下半分に対
応するパターン電極Ｘ’1 ，Ｘ’2 ，Ｘ’3 ・・・Ｘ’
m-1 ，Ｘ’m とからなる２重マトリクス電極とされてい
る。
３が形成されるとともに、この電極３に接してネマチッ
ク液晶等からなる液晶層６が配置されている。この液晶
層６は、ガラス、雲母、プラスチック等からなる誘電体
膜７によって第１の基板１との間に挟持されており、こ
れら第１の基板１、液晶層６及び誘電体膜７によって、
いわゆる液晶セルが構成された形になっている。ここ
で、上記電極３は、プラズマチャンネルとなる溝４と直
交されており、各溝４と対向する部分において上下に２
分割されたパターンとされている。すなわち、電極３
は、図２に示すように、各プラズマチャンネル（溝４）
の上半分に対応するパターン電極Ｘ1 ，Ｘ2 ，Ｘ3 ・・
・Ｘm-1 ，Ｘm と、各プラズマチャンネルの下半分に対
応するパターン電極Ｘ’1 ，Ｘ’2 ，Ｘ’3 ・・・Ｘ’
m-1 ，Ｘ’m とからなる２重マトリクス電極とされてい
る。
【００１１】また、上記誘電体膜７は、液晶層６と放電
領域４の絶縁遮断層として機能するものであり、この誘
電体膜７が無いと液晶材料が放電領域（溝４）内に流れ
込んだり、放電領域内のガスにより液晶材料が汚染され
る虞れがある。ただし、液晶材料の代わりに固体あるい
はカプセル化された電気光学材料を使用する場合には、
前記誘電体膜７は必要ないこともある。なお、上記誘電
体膜７は、誘電体材料により形成されることから、それ
自身もキャパシタとして機能し、したがって上記溝４内
で発生する放電プラズマと液晶層６との電気的結合を十
分に確保し、且つ電荷の２次元的な拡散を抑制するため
には、なるべく薄い方がよい。
領域４の絶縁遮断層として機能するものであり、この誘
電体膜７が無いと液晶材料が放電領域（溝４）内に流れ
込んだり、放電領域内のガスにより液晶材料が汚染され
る虞れがある。ただし、液晶材料の代わりに固体あるい
はカプセル化された電気光学材料を使用する場合には、
前記誘電体膜７は必要ないこともある。なお、上記誘電
体膜７は、誘電体材料により形成されることから、それ
自身もキャパシタとして機能し、したがって上記溝４内
で発生する放電プラズマと液晶層６との電気的結合を十
分に確保し、且つ電荷の２次元的な拡散を抑制するため
には、なるべく薄い方がよい。
【００１２】一方、第２の基板２にも放電用電極５が帯
状電極として形成されるとともに、この第２の基板２と
誘電体膜７の間の空間、すなわち各溝４内の空間が放電
プラズマを発生する放電領域とされている。放電領域
は、溝４間に形成された隔壁８によって仕切られ、それ
ぞれ独立したプラズマ室Ｐ1 ，Ｐ2 ，Ｐ3 ・・・Ｐn と
されるとともに、イオン化可能なガスが封入されプラズ
マチャンネルとされている。イオン化可能なガスとして
はヘリウム、ネオン、アルゴン、あるいはこれらの混合
ガス等が用いられる。また、上記放電用電極５は、上記
溝４内に互いに平行に一対ずつ形成されており、これら
電極間の放電によって前記溝４内に放電プラズマが発生
する。したがって各プラズマ室Ｐ1 ，Ｐ2 ，Ｐ3 ・・・
Ｐn が走査単位となる。
状電極として形成されるとともに、この第２の基板２と
誘電体膜７の間の空間、すなわち各溝４内の空間が放電
プラズマを発生する放電領域とされている。放電領域
は、溝４間に形成された隔壁８によって仕切られ、それ
ぞれ独立したプラズマ室Ｐ1 ，Ｐ2 ，Ｐ3 ・・・Ｐn と
されるとともに、イオン化可能なガスが封入されプラズ
マチャンネルとされている。イオン化可能なガスとして
はヘリウム、ネオン、アルゴン、あるいはこれらの混合
ガス等が用いられる。また、上記放電用電極５は、上記
溝４内に互いに平行に一対ずつ形成されており、これら
電極間の放電によって前記溝４内に放電プラズマが発生
する。したがって各プラズマ室Ｐ1 ，Ｐ2 ，Ｐ3 ・・・
Ｐn が走査単位となる。
【００１３】以上が本実施例の画像表示装置の概略構成
であるが、各基板１，２にはそれぞれ前記液晶層６を駆
動するための電極が形成されている。そこで、次にこれ
ら電極構成について説明する。
であるが、各基板１，２にはそれぞれ前記液晶層６を駆
動するための電極が形成されている。そこで、次にこれ
ら電極構成について説明する。
【００１４】先ず、上記第１の基板１のうち上記第２の
基板２と対向する主面上には、所定の幅をもった帯状の
電極３が複数形成されており、信号書き込み電極とされ
ている。これら帯状の電極３は、例えばインジウム錫オ
キサイド（ＩＴＯ）等の透明導電材料により形成されて
おり、光学的に透明である。また、各電極３は互いに平
行に配列され、例えば画面に垂直に配列されている。そ
して、この電極３は、先にも述べた通り、各プラズマチ
ャンネル（溝４）の上半分に対応するパターン電極
Ｘ1 ，Ｘ2 ，Ｘ3 ・・・Ｘm-1 ，Ｘm と、各プラズマチ
ャンネルの下半分に対応するパターン電極Ｘ’1 ，Ｘ’
2 ，Ｘ’3 ・・・Ｘ’m-1 ，Ｘ’m とからなる２重マト
リクス電極とされている。
基板２と対向する主面上には、所定の幅をもった帯状の
電極３が複数形成されており、信号書き込み電極とされ
ている。これら帯状の電極３は、例えばインジウム錫オ
キサイド（ＩＴＯ）等の透明導電材料により形成されて
おり、光学的に透明である。また、各電極３は互いに平
行に配列され、例えば画面に垂直に配列されている。そ
して、この電極３は、先にも述べた通り、各プラズマチ
ャンネル（溝４）の上半分に対応するパターン電極
Ｘ1 ，Ｘ2 ，Ｘ3 ・・・Ｘm-1 ，Ｘm と、各プラズマチ
ャンネルの下半分に対応するパターン電極Ｘ’1 ，Ｘ’
2 ，Ｘ’3 ・・・Ｘ’m-1 ，Ｘ’m とからなる２重マト
リクス電極とされている。
【００１５】一方、第２の基板２のうち上記溝４にも、
やはり放電用電極５が形成されている。これら放電用電
極５も、平行な線状電極であるが、その配列方向は先の
第１の基板１上に形成された電極３と直交する方向であ
る。すなわち、これら放電用電極５は画面に水平に配列
されている。また、これら放電用電極５は、アノード電
極Ａ1 ，Ａ2 ，Ａ3 ・・・Ａn-1 ，Ａn とカソード電極
Ｋ1 ，Ｋ2 ，Ｋ3 ・・・Ｋn-1 ，Ｋn からなり、これら
を対にして放電用電極が構成されており、各プラズマ室
Ｐ1 ，Ｐ2 ，Ｐ3 ・・・Ｐn 内にそれぞれ１対ずつ配置
されている。
やはり放電用電極５が形成されている。これら放電用電
極５も、平行な線状電極であるが、その配列方向は先の
第１の基板１上に形成された電極３と直交する方向であ
る。すなわち、これら放電用電極５は画面に水平に配列
されている。また、これら放電用電極５は、アノード電
極Ａ1 ，Ａ2 ，Ａ3 ・・・Ａn-1 ，Ａn とカソード電極
Ｋ1 ，Ｋ2 ，Ｋ3 ・・・Ｋn-1 ，Ｋn からなり、これら
を対にして放電用電極が構成されており、各プラズマ室
Ｐ1 ，Ｐ2 ，Ｐ3 ・・・Ｐn 内にそれぞれ１対ずつ配置
されている。
【００１６】図３に第１の基板１に形成された電極３と
第２の基板に形成された放電用電極５の配列状態を模式
的に示す。ここで、第２の基板２上の放電用電極５のう
ち、各カソード電極Ｋ1 ，Ｋ2 ，Ｋ3 ・・・Ｋn-1 ，Ｋ
n には、データストローブ回路９と出力増幅器１０から
構成される第２信号印加手段が接続されており、各出力
増幅器１０から出力されるパルス電圧がデータストロー
ブ信号として供給される。また、各アノード電極Ａ1 ，
Ａ2 ，Ａ3 ・・・Ａn-1 ，Ａn には、共通の基準電圧
（接地電圧）が印加される。したがって、上記第２の基
板２に形成された放電用電極５の接続構造は、図４に示
す通りである。これに対して、第１の基板１の電極３に
は、データドライバ回路１１と出力増幅器１２とで構成
された第１信号印加手段が接続され、各出力増幅器１２
から出力されるアナログ電圧が液晶駆動信号として供給
される。ここで、前記電極３が各プラズマチャンネルの
上半分に対応するパターン電極Ｘ1 ，Ｘ2 ，Ｘ3 ・・・
Ｘm-1 ，Ｘm と、下半分に対応するパターン電極
Ｘ’1 ，Ｘ’2 ，Ｘ’3 ・・・Ｘ’m-1 ，Ｘ’m とから
なる２重マトリクス電極とされていることから、上記デ
ータストローブ信号が供給される各カソード電極Ｋ1 ，
Ｋ2 ，Ｋ3 ・・・Ｋn-1 ，Ｋn に対して、図５に示すよ
うに２つの電極マトリクスが構成されることになる。ま
た、表示面の全体にわたって画像を形成するために、前
記データドライバ回路１１及びデータストローブ回路９
と接続して走査制御回路１３が設けられている。この走
査制御回路１３は、データドライバ回路１１とデータス
トローブ回路９との機能を調整し、液晶層６の全ての画
素列について、行から行へと順次アドレス指定するもの
である。
第２の基板に形成された放電用電極５の配列状態を模式
的に示す。ここで、第２の基板２上の放電用電極５のう
ち、各カソード電極Ｋ1 ，Ｋ2 ，Ｋ3 ・・・Ｋn-1 ，Ｋ
n には、データストローブ回路９と出力増幅器１０から
構成される第２信号印加手段が接続されており、各出力
増幅器１０から出力されるパルス電圧がデータストロー
ブ信号として供給される。また、各アノード電極Ａ1 ，
Ａ2 ，Ａ3 ・・・Ａn-1 ，Ａn には、共通の基準電圧
（接地電圧）が印加される。したがって、上記第２の基
板２に形成された放電用電極５の接続構造は、図４に示
す通りである。これに対して、第１の基板１の電極３に
は、データドライバ回路１１と出力増幅器１２とで構成
された第１信号印加手段が接続され、各出力増幅器１２
から出力されるアナログ電圧が液晶駆動信号として供給
される。ここで、前記電極３が各プラズマチャンネルの
上半分に対応するパターン電極Ｘ1 ，Ｘ2 ，Ｘ3 ・・・
Ｘm-1 ，Ｘm と、下半分に対応するパターン電極
Ｘ’1 ，Ｘ’2 ，Ｘ’3 ・・・Ｘ’m-1 ，Ｘ’m とから
なる２重マトリクス電極とされていることから、上記デ
ータストローブ信号が供給される各カソード電極Ｋ1 ，
Ｋ2 ，Ｋ3 ・・・Ｋn-1 ，Ｋn に対して、図５に示すよ
うに２つの電極マトリクスが構成されることになる。ま
た、表示面の全体にわたって画像を形成するために、前
記データドライバ回路１１及びデータストローブ回路９
と接続して走査制御回路１３が設けられている。この走
査制御回路１３は、データドライバ回路１１とデータス
トローブ回路９との機能を調整し、液晶層６の全ての画
素列について、行から行へと順次アドレス指定するもの
である。
【００１７】上述の構成を有する画像表示装置において
は、液晶層６が第１の基板１に形成された電極３に印加
されるアナログ電圧のサンプリング・キャパシタとして
機能し、各プラズマ室Ｐ1 ，Ｐ2 ，Ｐ3 ・・・Ｐn で発
生する放電プラズマがサンプリング・スイッチとして機
能することで画像表示が行われる。この画像表示動作を
説明するためのモデルが図６である。図６において、各
画素に対応する液晶層６は、キャパシタ・モデル１４と
して捉えることができる。すなわち、キャパシタ・モデ
ル１４は、パターン電極Ｘ1 ，Ｘ2 ，Ｘ3 ・・・
Ｘm-1 ，Ｘm 及びパターン電極Ｘ’1 ，Ｘ’2 ，Ｘ’3
・・・Ｘ’m-1 ，Ｘ’m と各プラズマ室Ｐ1 ，Ｐ2 ，Ｐ
3 ・・・Ｐn が重なった部分に形成される容量性液晶セ
ルを表している。
は、液晶層６が第１の基板１に形成された電極３に印加
されるアナログ電圧のサンプリング・キャパシタとして
機能し、各プラズマ室Ｐ1 ，Ｐ2 ，Ｐ3 ・・・Ｐn で発
生する放電プラズマがサンプリング・スイッチとして機
能することで画像表示が行われる。この画像表示動作を
説明するためのモデルが図６である。図６において、各
画素に対応する液晶層６は、キャパシタ・モデル１４と
して捉えることができる。すなわち、キャパシタ・モデ
ル１４は、パターン電極Ｘ1 ，Ｘ2 ，Ｘ3 ・・・
Ｘm-1 ，Ｘm 及びパターン電極Ｘ’1 ，Ｘ’2 ，Ｘ’3
・・・Ｘ’m-1 ，Ｘ’m と各プラズマ室Ｐ1 ，Ｐ2 ，Ｐ
3 ・・・Ｐn が重なった部分に形成される容量性液晶セ
ルを表している。
【００１８】いま、各パターン電極Ｘ1 ，Ｘ2 ，・・・
及びパターン電極Ｘ’1 ，Ｘ’2 ・・・にデータドライ
バ回路１１よりアナログ電圧が印加されているとする。
ここで、第２の基板２のカソード電極Ｋ1 にデータスト
ローブ信号（パルス電圧）が印加されていないとする
と、すなわちオフ状態であるとすると、アノード電極Ａ
1 とカソード電極Ｋ1 での放電が起こらず、プラズマ室
Ｐ1 内のガスはイオン化されていない状態となる。した
がって、プラズマ・スイッチＳ1 （パターン電極Ｘ1 ，
Ｘ2 ，・・・及びパターン電極Ｘ’1 ，Ｘ’2 ・・・と
アノード電極Ａ1との電気的接続）もオフの状態となっ
て、これらパターン電極Ｘ1 ，Ｘ2 ，・・・及びパター
ン電極Ｘ’1 ，Ｘ’2 ・・・に如何なるアナログ電圧が
印加されても、各キャパシタ・モデル１４にかかる電位
差に変化はない。
及びパターン電極Ｘ’1 ，Ｘ’2 ・・・にデータドライ
バ回路１１よりアナログ電圧が印加されているとする。
ここで、第２の基板２のカソード電極Ｋ1 にデータスト
ローブ信号（パルス電圧）が印加されていないとする
と、すなわちオフ状態であるとすると、アノード電極Ａ
1 とカソード電極Ｋ1 での放電が起こらず、プラズマ室
Ｐ1 内のガスはイオン化されていない状態となる。した
がって、プラズマ・スイッチＳ1 （パターン電極Ｘ1 ，
Ｘ2 ，・・・及びパターン電極Ｘ’1 ，Ｘ’2 ・・・と
アノード電極Ａ1との電気的接続）もオフの状態となっ
て、これらパターン電極Ｘ1 ，Ｘ2 ，・・・及びパター
ン電極Ｘ’1 ，Ｘ’2 ・・・に如何なるアナログ電圧が
印加されても、各キャパシタ・モデル１４にかかる電位
差に変化はない。
【００１９】一方、第２の基板２のカソード電極Ｋ2 に
データストローブ信号が印加されていると、すなわちオ
ン状態であるとすると、アノード電極Ａ2 とカソード電
極Ｋ2 間での放電によりガスがイオン化され、プラズマ
室Ｐ2 内にイオン化領域（放電プラズマ）が発生する。
すると、いわゆるプラズマ・スイッチング動作によって
各パターン電極Ｘ1 ，Ｘ2 ，・・・及びパターン電極
Ｘ’1 ，Ｘ’2 ・・・とアノード電極Ａ2 が電気的に接
続された状態となり、回路的に見たときにはプラズマ・
スイッチＳ2 がオンされたのと等価な状態となる。その
結果、カソード電極Ｋ2 がストローブされている列のキ
ャパシタ・モデル１４には、各パターン電極Ｘ1 ，
Ｘ2 ，・・・及びパターン電極Ｘ’1 ，Ｘ’2 ・・・に
供給されるアナログ電圧がストアされる。そして、カソ
ード電極Ｋ2 へのストローブが終了し放電プラズマが消
失した後も、次のストローブが行われるまでの間（少な
くともその画像のフィールド期間中）はこのアナログ電
圧がキャパシタ・モデル１４にそれぞれストアされたま
まの状態となり、パターン電極Ｘ1 ，Ｘ2 ，・・・及び
パターン電極Ｘ’1 ，Ｘ’2 ・・・に印加されるアナロ
グ電圧のその後の変化の影響を受けない。
データストローブ信号が印加されていると、すなわちオ
ン状態であるとすると、アノード電極Ａ2 とカソード電
極Ｋ2 間での放電によりガスがイオン化され、プラズマ
室Ｐ2 内にイオン化領域（放電プラズマ）が発生する。
すると、いわゆるプラズマ・スイッチング動作によって
各パターン電極Ｘ1 ，Ｘ2 ，・・・及びパターン電極
Ｘ’1 ，Ｘ’2 ・・・とアノード電極Ａ2 が電気的に接
続された状態となり、回路的に見たときにはプラズマ・
スイッチＳ2 がオンされたのと等価な状態となる。その
結果、カソード電極Ｋ2 がストローブされている列のキ
ャパシタ・モデル１４には、各パターン電極Ｘ1 ，
Ｘ2 ，・・・及びパターン電極Ｘ’1 ，Ｘ’2 ・・・に
供給されるアナログ電圧がストアされる。そして、カソ
ード電極Ｋ2 へのストローブが終了し放電プラズマが消
失した後も、次のストローブが行われるまでの間（少な
くともその画像のフィールド期間中）はこのアナログ電
圧がキャパシタ・モデル１４にそれぞれストアされたま
まの状態となり、パターン電極Ｘ1 ，Ｘ2 ，・・・及び
パターン電極Ｘ’1 ，Ｘ’2 ・・・に印加されるアナロ
グ電圧のその後の変化の影響を受けない。
【００２０】したがって、カソード電極Ｋ1 ，Ｋ2 ，Ｋ
3 ・・・Ｋn-1 ，Ｋn を順次アドレス指定して２走査線
相当時間データストローブ信号を印加し、プラズマ室Ｐ
1 ，Ｐ2 ，Ｐ3 ・・・Ｐn に順次放電プラズマを発生さ
せると同時に、各パターン電極Ｘ1 ，Ｘ2 ，・・・及び
パターン電極Ｘ’1 ，Ｘ’2 ・・・にこれに同期して液
晶駆動信号をアナログ電圧として印加することで、プラ
ズマチャンネル（各プラズマ室Ｐ1 ，Ｐ2 ，Ｐ3 ・・・
Ｐn ）１本に２つの走査線があるのと等価な動作が行わ
れる。
3 ・・・Ｋn-1 ，Ｋn を順次アドレス指定して２走査線
相当時間データストローブ信号を印加し、プラズマ室Ｐ
1 ，Ｐ2 ，Ｐ3 ・・・Ｐn に順次放電プラズマを発生さ
せると同時に、各パターン電極Ｘ1 ，Ｘ2 ，・・・及び
パターン電極Ｘ’1 ，Ｘ’2 ・・・にこれに同期して液
晶駆動信号をアナログ電圧として印加することで、プラ
ズマチャンネル（各プラズマ室Ｐ1 ，Ｐ2 ，Ｐ3 ・・・
Ｐn ）１本に２つの走査線があるのと等価な動作が行わ
れる。
【００２１】以上、本発明を適用した具体的な実施例に
ついて説明したが、本発明がこれらの実施例に限定され
るものではない。例えば、本例では２重マトリクスとし
たが、３重マトリクス以上の電極構成としてもよい。ま
た、構造に関しても、本例のものは各プラズマ室が溝に
よって形成されているが、印刷法によって形成された隔
壁で仕切られていてもよい。あるいは、隔壁の全くない
オープンセル構造であってもよい。
ついて説明したが、本発明がこれらの実施例に限定され
るものではない。例えば、本例では２重マトリクスとし
たが、３重マトリクス以上の電極構成としてもよい。ま
た、構造に関しても、本例のものは各プラズマ室が溝に
よって形成されているが、印刷法によって形成された隔
壁で仕切られていてもよい。あるいは、隔壁の全くない
オープンセル構造であってもよい。
【００２２】
【発明の効果】以上の説明からも明らかなように、本発
明においては、信号書き込み電極を各走査単位において
複数に分割し多重マトリクス化しているので、走査線の
数を大幅に増やし、高密度ピッチ化、微細ピッチ化する
ことができる。逆に言えば、プラズマ特性によって原理
的に規制されるプラズマチャンネルの数を大幅に減らす
ことができ、例えば２重マトリクス化することで半減す
ることができる。したがって、高電圧を要するプラズマ
駆動回路を半減することができ、またプラズマチャンネ
ルの加工を容易なものとすることができる等、回路構成
上あるいは製造上、非常に有利である。
明においては、信号書き込み電極を各走査単位において
複数に分割し多重マトリクス化しているので、走査線の
数を大幅に増やし、高密度ピッチ化、微細ピッチ化する
ことができる。逆に言えば、プラズマ特性によって原理
的に規制されるプラズマチャンネルの数を大幅に減らす
ことができ、例えば２重マトリクス化することで半減す
ることができる。したがって、高電圧を要するプラズマ
駆動回路を半減することができ、またプラズマチャンネ
ルの加工を容易なものとすることができる等、回路構成
上あるいは製造上、非常に有利である。
【図１】本発明を適用した画像表示装置の一実施例を示
す要部概略斜視図である。
す要部概略斜視図である。
【図２】信号書き込み電極の電極パターンを模式的に示
す要部概略平面図である。
す要部概略平面図である。
【図３】液晶層を駆動するための電極構成を示す模式図
である。
である。
【図４】放電用電極の配列及び接続状態を示す模式図で
ある。
ある。
【図５】２重マトリクス化された駆動回路の等価回路図
である。
である。
【図６】画像表示動作を説明するための等価回路図であ
る。
る。
【図７】従来の画像表示装置の一例を示す概略断面図で
ある。
ある。
１・・・第１の基板 ２・・・第２の基板 ３・・・電極 ５・・・放電用電極 ６・・・液晶層（電気光学材料層）
フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) G02F 1/1333 G02F 1/1343 G09F 9/30 G09F 9/00
Claims (1)
- 【請求項１】 一主面上に互いに略平行な複数の第１電
極を有する第１の基板と、一主面上に前記第１電極と略
直交し且つ互いに略平行な複数の第２電極を有する第２
の基板とを備え、これら第１の基板と第２の基板が第１
電極と第２電極が対向する如く互いに略平行に配置され
てなり、前記第１の基板の第１電極と接するように電気
光学材料層が間挿されるとともに、前記電気光学材料層
と第２の基板間にイオン化可能なガスが封入されて放電
領域とされ、前記第１電極が各走査単位において複数に
分割され多重マトリクス化されていることを特徴とする
画像表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3047786A JP3013471B2 (ja) | 1991-02-20 | 1991-02-20 | 画像表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3047786A JP3013471B2 (ja) | 1991-02-20 | 1991-02-20 | 画像表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04265933A JPH04265933A (ja) | 1992-09-22 |
| JP3013471B2 true JP3013471B2 (ja) | 2000-02-28 |
Family
ID=12785060
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3047786A Expired - Fee Related JP3013471B2 (ja) | 1991-02-20 | 1991-02-20 | 画像表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3013471B2 (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR19980022931A (ko) * | 1996-09-24 | 1998-07-06 | 손욱 | 액정 표시 장치의 구동 칩 전극 접속 구조 |
| JPH113050A (ja) * | 1997-06-10 | 1999-01-06 | Sony Corp | プラズマアドレス表示装置 |
| CN1124585C (zh) * | 1998-02-20 | 2003-10-15 | 索尼株式会社 | 等离子体编址的显示装置 |
| JP2003131615A (ja) * | 2001-10-30 | 2003-05-09 | Sharp Corp | プラズマディスプレイ装置及びその駆動方法 |
| KR100482322B1 (ko) * | 2001-12-28 | 2005-04-13 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널의 고속 스캐닝 방법 및 장치 |
-
1991
- 1991-02-20 JP JP3047786A patent/JP3013471B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04265933A (ja) | 1992-09-22 |
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Legal Events
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|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |