JP2783395B2 - 液晶表示装置の駆動回路 - Google Patents
液晶表示装置の駆動回路Info
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- JP2783395B2 JP2783395B2 JP13286992A JP13286992A JP2783395B2 JP 2783395 B2 JP2783395 B2 JP 2783395B2 JP 13286992 A JP13286992 A JP 13286992A JP 13286992 A JP13286992 A JP 13286992A JP 2783395 B2 JP2783395 B2 JP 2783395B2
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Description
【０００１】
【産業上の利用分野】本発明は、例えば薄膜トランジス
タ型ドットマトリクス液晶表示装置等の液晶表示装置の
駆動回路に関する。
タ型ドットマトリクス液晶表示装置等の液晶表示装置の
駆動回路に関する。
【０００２】
【従来の技術】図３に従来の薄膜トランジスタ（以下Ｔ
ＦＴと略す）型ドットマトリクス液晶表示装置（駆動回
路を含む）を示す。この装置は、液晶層１を挟んで図示
しない２つの絶縁性基板が対向配設され、一方（図下
側）の基板には液晶層１側の面に複数の平行な走査線２
と、その走査線２に交差するように複数の平行な信号線
３が互いに絶縁した状態で設けられており、もう一方
（図上側）の基板には液晶層１側の面に共通電極となる
一つの対向電極４が設けられている。隣合う走査線２と
隣合う信号線３とで囲まれた領域に、スイッチング素子
としてのＴＦＴ５、液晶補助容量６及び絵素電極７が形
成されている。ＴＦＴ５は走査線２と信号線３とが交差
するところに形成され、液晶補助容量６は絵素電極７
と、この絵素電極７と対向する電極との間で容量を形成
するようになっている。以上のように液晶表示素子は構
成されている。
ＦＴと略す）型ドットマトリクス液晶表示装置（駆動回
路を含む）を示す。この装置は、液晶層１を挟んで図示
しない２つの絶縁性基板が対向配設され、一方（図下
側）の基板には液晶層１側の面に複数の平行な走査線２
と、その走査線２に交差するように複数の平行な信号線
３が互いに絶縁した状態で設けられており、もう一方
（図上側）の基板には液晶層１側の面に共通電極となる
一つの対向電極４が設けられている。隣合う走査線２と
隣合う信号線３とで囲まれた領域に、スイッチング素子
としてのＴＦＴ５、液晶補助容量６及び絵素電極７が形
成されている。ＴＦＴ５は走査線２と信号線３とが交差
するところに形成され、液晶補助容量６は絵素電極７
と、この絵素電極７と対向する電極との間で容量を形成
するようになっている。以上のように液晶表示素子は構
成されている。
【０００３】駆動回路は、対向電極４に一端を接続した
対向電圧印加線Ｌ１と、対向電圧印加線Ｌ１の他端に接
続した対向電圧印加回路８と、走査線２の一端に設けら
れたゲートドライバー群９に接続した走査電圧印加線Ｌ
２と、走査電圧印加線Ｌ２の途中に設けたレベルシフト
回路１０とを有している。対向電圧印加回路８は対向電
極４への電圧印加用の回路で、対向電圧を対向電極４へ
印加している。対向電圧印加回路８において、入力信号
は増幅抵抗Ｒｓを通ってオペアンプＯＰ１に入力され、
オペアンプＯＰ１から対向電圧印加線Ｌ１を介して対向
電極４に出力される。オペアンプＯＰ１のもう一方の入
力端子はオフセット８ａを介して接地されている。増幅
抵抗ＲｓとオペアンプＯＰ１との間の配線部分には増幅
抵抗Ｒｆの一端が接続され、この増幅抵抗Ｒｆの他端が
対向電圧印加線Ｌ１に接続点Ｂで接続されている。この
接続点Ｂは、オペアンプＯＰ１と対向電圧配線Ｌ１との
接続点Ａよりも対向電極４側に位置する。レベルシフト
回路１０は走査線２に印加する走査電圧を作製する回路
で、接続点Ａに一端を接続し、他端をゲートドライバー
群９に接続した走査電圧印加線Ｌ２の途中に設けられて
いる。
対向電圧印加線Ｌ１と、対向電圧印加線Ｌ１の他端に接
続した対向電圧印加回路８と、走査線２の一端に設けら
れたゲートドライバー群９に接続した走査電圧印加線Ｌ
２と、走査電圧印加線Ｌ２の途中に設けたレベルシフト
回路１０とを有している。対向電圧印加回路８は対向電
極４への電圧印加用の回路で、対向電圧を対向電極４へ
印加している。対向電圧印加回路８において、入力信号
は増幅抵抗Ｒｓを通ってオペアンプＯＰ１に入力され、
オペアンプＯＰ１から対向電圧印加線Ｌ１を介して対向
電極４に出力される。オペアンプＯＰ１のもう一方の入
力端子はオフセット８ａを介して接地されている。増幅
抵抗ＲｓとオペアンプＯＰ１との間の配線部分には増幅
抵抗Ｒｆの一端が接続され、この増幅抵抗Ｒｆの他端が
対向電圧印加線Ｌ１に接続点Ｂで接続されている。この
接続点Ｂは、オペアンプＯＰ１と対向電圧配線Ｌ１との
接続点Ａよりも対向電極４側に位置する。レベルシフト
回路１０は走査線２に印加する走査電圧を作製する回路
で、接続点Ａに一端を接続し、他端をゲートドライバー
群９に接続した走査電圧印加線Ｌ２の途中に設けられて
いる。
【０００４】この駆動回路は更に、信号線３の端部に設
けられたソースドライバー群１１と接続された信号電圧
印加回路１２を有している。信号電圧印加回路１２は信
号線３への電圧印加用の回路である。
けられたソースドライバー群１１と接続された信号電圧
印加回路１２を有している。信号電圧印加回路１２は信
号線３への電圧印加用の回路である。
【０００５】上記のような構造を持つ従来の液晶表示装
置において画像を表示する場合には、レベルシフト回路
１０が走査線２にＴＦＴ５をオン状態にするための走査
電圧を順次印加する。同時に、信号電圧印加回路１２が
走査電圧と同期させた信号電圧を信号線３に印加し、Ｔ
ＦＴを通して絵素電極７に書き込む。信号電圧は絵素電
極７と対向電極４との間に挟まれた、キャパシタとして
の液晶層１に、次の表示内容が書き込まれるまで保持さ
れる。この保持動作を改善し高画質化するために前記液
晶補助容量６が各絵素に形成されている。
置において画像を表示する場合には、レベルシフト回路
１０が走査線２にＴＦＴ５をオン状態にするための走査
電圧を順次印加する。同時に、信号電圧印加回路１２が
走査電圧と同期させた信号電圧を信号線３に印加し、Ｔ
ＦＴを通して絵素電極７に書き込む。信号電圧は絵素電
極７と対向電極４との間に挟まれた、キャパシタとして
の液晶層１に、次の表示内容が書き込まれるまで保持さ
れる。この保持動作を改善し高画質化するために前記液
晶補助容量６が各絵素に形成されている。
【０００６】
【発明が解決しようとする課題】図４に図３の液晶表示
装置における１絵素の等価回路を示す。この回路に於
て、図５に示すように軽負荷（ノーマリーホワイトパネ
ルの場合は白色）を表示した場合は、信号電圧印加回路
１２、対向電圧印加回路８及びレベルシフト回路１０か
らの出力電圧である信号電圧ＶＳ、対向電圧ＶＣ及び走
査電圧ＶＧに対し、実際に絵素に印加される電圧である
信号電圧ＶＤ’、対向電圧ＶＣ’及び走査電圧ＶＧ’は
同じ波形をしている。しかし、図６に示すように重負荷
（ノーマリーホワイトパネルの場合は黒色）を表示した
場合は、信号電圧ＶＳ、対向電圧ＶＣ及び走査電圧ＶＧ
に対し、実際に絵素に印加される電圧である信号電圧Ｖ
Ｄ’、対向電圧ＶＣ’及び走査電圧ＶＧ’は異なること
がわかる。
装置における１絵素の等価回路を示す。この回路に於
て、図５に示すように軽負荷（ノーマリーホワイトパネ
ルの場合は白色）を表示した場合は、信号電圧印加回路
１２、対向電圧印加回路８及びレベルシフト回路１０か
らの出力電圧である信号電圧ＶＳ、対向電圧ＶＣ及び走
査電圧ＶＧに対し、実際に絵素に印加される電圧である
信号電圧ＶＤ’、対向電圧ＶＣ’及び走査電圧ＶＧ’は
同じ波形をしている。しかし、図６に示すように重負荷
（ノーマリーホワイトパネルの場合は黒色）を表示した
場合は、信号電圧ＶＳ、対向電圧ＶＣ及び走査電圧ＶＧ
に対し、実際に絵素に印加される電圧である信号電圧Ｖ
Ｄ’、対向電圧ＶＣ’及び走査電圧ＶＧ’は異なること
がわかる。
【０００７】この様に電圧が印加される絵素を多数有す
る液晶表示装置において、例えば図７のようにパネル中
央部の表示部分７１に黒色を、その周囲の表示部分７２
及び７３にそれ以外の色を表示した。このとき、表示部
分７２では、各回路１２、８及び１０からの出力電圧で
ある信号電圧ＶＳ、対向電圧ＶＣ及び走査電圧ＶＧの波
形及び実際に絵素に印加される電圧である信号電圧Ｖ
Ｄ’、対向電圧ＶＣ’及び走査電圧ＶＧ’の波形は、図
５に示すような軽負荷時の各電圧波形の近似値となり支
障が無い。これに対して、表示部分７３では図８に示す
ようにＣ区間及びＤ区間で走査電圧ＶＧ’に歪みが生じ
る。この歪みは表示部分７３が、黒色表示部分７１と同
じ走査線２上にあることに起因する。この歪みが生じる
と、信号線３と走査線２との間に形成される液晶補助容
量６に印加される電圧が、表示部分７２より表示部分７
３の方が小さくなる。その結果、表示部分７２と表示部
分７３との液晶補助容量６に充電される電荷量は表示部
分７２の方が大きくなり、表示部分７２と７３に輝度差
が現れる。このような現象をシャドーイング現象とよ
ぶ。このために従来技術では画質が劣るという欠点があ
る。
る液晶表示装置において、例えば図７のようにパネル中
央部の表示部分７１に黒色を、その周囲の表示部分７２
及び７３にそれ以外の色を表示した。このとき、表示部
分７２では、各回路１２、８及び１０からの出力電圧で
ある信号電圧ＶＳ、対向電圧ＶＣ及び走査電圧ＶＧの波
形及び実際に絵素に印加される電圧である信号電圧Ｖ
Ｄ’、対向電圧ＶＣ’及び走査電圧ＶＧ’の波形は、図
５に示すような軽負荷時の各電圧波形の近似値となり支
障が無い。これに対して、表示部分７３では図８に示す
ようにＣ区間及びＤ区間で走査電圧ＶＧ’に歪みが生じ
る。この歪みは表示部分７３が、黒色表示部分７１と同
じ走査線２上にあることに起因する。この歪みが生じる
と、信号線３と走査線２との間に形成される液晶補助容
量６に印加される電圧が、表示部分７２より表示部分７
３の方が小さくなる。その結果、表示部分７２と表示部
分７３との液晶補助容量６に充電される電荷量は表示部
分７２の方が大きくなり、表示部分７２と７３に輝度差
が現れる。このような現象をシャドーイング現象とよ
ぶ。このために従来技術では画質が劣るという欠点があ
る。
【０００８】本発明は、この様な従来技術の課題を解決
するものであり、上記シャドーイング現象を防止し、画
質を向上させることの出来る液晶表示装置を提供するこ
とを目的とする。
するものであり、上記シャドーイング現象を防止し、画
質を向上させることの出来る液晶表示装置を提供するこ
とを目的とする。
【０００９】
【課題を解決するための手段】本発明の液晶表示装置の
駆動回路は、液晶層を挟んでマトリクス基板と対向基板
とが対向配設され、該マトリクス基板は縦横に配線され
た走査線及び信号線に、スイッチング素子が形成されて
いると共に、走査線及び信号線で囲まれた領域に絵素電
極が形成されており、該走査線と該絵素電極との間に液
晶補助容量が形成された液晶表示装置の駆動回路におい
て、該対向電極への電圧印加用の対向電圧印加回路にお
ける帰還増幅回路のフィードバックポイントと該帰還増
幅回路の出力端との間に電圧降下手段が設けられ、該電
圧降下手段から出力された電圧が該対向電極に印加さ
れ、かつ該電圧降下手段に入力される該帰還増幅回路の
出力電圧がレベルシフト回路に与えられ、該レベルシフ
ト回路を経た電圧が該液晶補助容量に印加されるように
構成されており、そのことにより上記目的が達成され
る。
駆動回路は、液晶層を挟んでマトリクス基板と対向基板
とが対向配設され、該マトリクス基板は縦横に配線され
た走査線及び信号線に、スイッチング素子が形成されて
いると共に、走査線及び信号線で囲まれた領域に絵素電
極が形成されており、該走査線と該絵素電極との間に液
晶補助容量が形成された液晶表示装置の駆動回路におい
て、該対向電極への電圧印加用の対向電圧印加回路にお
ける帰還増幅回路のフィードバックポイントと該帰還増
幅回路の出力端との間に電圧降下手段が設けられ、該電
圧降下手段から出力された電圧が該対向電極に印加さ
れ、かつ該電圧降下手段に入力される該帰還増幅回路の
出力電圧がレベルシフト回路に与えられ、該レベルシフ
ト回路を経た電圧が該液晶補助容量に印加されるように
構成されており、そのことにより上記目的が達成され
る。
【００１０】前記電圧降下手段が可変抵抗であってもよ
い。
い。
【００１１】
【作用】本発明の液晶表示装置は、対向電圧印加回路の
出力側に電圧降下手段が設けられており、電圧降下手段
から出力された電圧が対向電極に印加され、かつ電圧降
下手段に入力される電圧がレベルシフト回路に与えられ
るように構成されている。よって、対向電圧印加回路か
ら出力されてレベルシフト回路に入力される電圧は、電
圧降下手段の両端に生じる電圧降下分だけ対向電圧に上
乗せされた電圧波形となる。
出力側に電圧降下手段が設けられており、電圧降下手段
から出力された電圧が対向電極に印加され、かつ電圧降
下手段に入力される電圧がレベルシフト回路に与えられ
るように構成されている。よって、対向電圧印加回路か
ら出力されてレベルシフト回路に入力される電圧は、電
圧降下手段の両端に生じる電圧降下分だけ対向電圧に上
乗せされた電圧波形となる。
【００１２】
【実施例】図１は本発明の液晶表示装置を示す図であ
る。
る。
【００１３】本実施例の液晶表示素子部分については図
３に示す従来の液晶表示素子と同様の構成をしている。
３に示す従来の液晶表示素子と同様の構成をしている。
【００１４】本実施例の駆動回路については、図１に示
すように、対向電極４に一端を接続した対向電圧印加線
Ｌ１と、対向電圧印加線Ｌ１の途中に設けられた電圧降
下手段１３と、対向電圧印加線Ｌ１の他端に接続した対
向電圧印加回路８と、走査線２の一端に設けられたゲー
トドライバー群９に接続した走査電圧印加線Ｌ２と、走
査電圧印加線Ｌ２の途中に設けたレベルシフト回路１０
とを有している。対向電圧印加回路８は対向電極４への
電圧印加用の回路であり、対向電圧印加回路８へ入力さ
れた信号は増幅抵抗Ｒｓを通ってオペアンプＯＰ１に入
力され、オペアンプＯＰ１から対向電圧印加線Ｌ１の途
中に設けた電圧降下手段１３を介して対向電極４に出力
される。オペアンプＯＰ１のもう一方の入力端子はオフ
セット８ａを介して接地されている。増幅抵抗Ｒｓとオ
ペアンプＯＰ１との間の配線部分には増幅抵抗Ｒｆの一
端が接続され、この増幅抵抗Ｒｆの他端が対向電圧印加
線Ｌ１に接続点Ｂで接続されている。この接続点Ｂは、
電圧降下手段１３よりも対向電極４側に位置する。レベ
ルシフト回路１０は走査線２に印加する走査電圧を作製
する回路で、電圧降下手段１３と電圧印加回路８との間
に位置する接続点Ａに一端を接続し、他端をゲートドラ
イバー群９に接続した走査電圧印加線Ｌ２の途中に設け
られている。
すように、対向電極４に一端を接続した対向電圧印加線
Ｌ１と、対向電圧印加線Ｌ１の途中に設けられた電圧降
下手段１３と、対向電圧印加線Ｌ１の他端に接続した対
向電圧印加回路８と、走査線２の一端に設けられたゲー
トドライバー群９に接続した走査電圧印加線Ｌ２と、走
査電圧印加線Ｌ２の途中に設けたレベルシフト回路１０
とを有している。対向電圧印加回路８は対向電極４への
電圧印加用の回路であり、対向電圧印加回路８へ入力さ
れた信号は増幅抵抗Ｒｓを通ってオペアンプＯＰ１に入
力され、オペアンプＯＰ１から対向電圧印加線Ｌ１の途
中に設けた電圧降下手段１３を介して対向電極４に出力
される。オペアンプＯＰ１のもう一方の入力端子はオフ
セット８ａを介して接地されている。増幅抵抗Ｒｓとオ
ペアンプＯＰ１との間の配線部分には増幅抵抗Ｒｆの一
端が接続され、この増幅抵抗Ｒｆの他端が対向電圧印加
線Ｌ１に接続点Ｂで接続されている。この接続点Ｂは、
電圧降下手段１３よりも対向電極４側に位置する。レベ
ルシフト回路１０は走査線２に印加する走査電圧を作製
する回路で、電圧降下手段１３と電圧印加回路８との間
に位置する接続点Ａに一端を接続し、他端をゲートドラ
イバー群９に接続した走査電圧印加線Ｌ２の途中に設け
られている。
【００１５】この駆動回路は更に、信号線３の端部に設
けられたソースドライバー群１１と接続された信号電圧
印加回路１２を有している。信号電圧印加回路１２は信
号線３への電圧印加用の回路である。
けられたソースドライバー群１１と接続された信号電圧
印加回路１２を有している。信号電圧印加回路１２は信
号線３への電圧印加用の回路である。
【００１６】上述のような構成の液晶表示装置により図
７の表示を行った場合、表示部分７２での各回路１２、
８及び１０からの出力電圧波形及び実際に絵素に印加さ
れる電圧波形の関係は従来と同様で図５に示す関係の近
似値になり、表示部分７３についての関係は図２に示す
ようになる。本実施例である図２と従来例である図８に
示されている各走査電圧ＶＧ’を比較すれば、実際に液
晶補助容量６に印加される走査電圧ＶＧ’の波形が最適
化されていることがわかる。
７の表示を行った場合、表示部分７２での各回路１２、
８及び１０からの出力電圧波形及び実際に絵素に印加さ
れる電圧波形の関係は従来と同様で図５に示す関係の近
似値になり、表示部分７３についての関係は図２に示す
ようになる。本実施例である図２と従来例である図８に
示されている各走査電圧ＶＧ’を比較すれば、実際に液
晶補助容量６に印加される走査電圧ＶＧ’の波形が最適
化されていることがわかる。
【００１７】ここで、電圧降下手段１３の抵抗の大きさ
をＲｓｈ、電圧降下手段１３を流れる電流の大きさをＩ
ｓｈとすると、電圧降下手段１３の両端に生じる電圧降
下Ｖｓｈは、 Ｖｓｈ＝Ｒｓｈ×Ｉｓｈ と表すことができる。
をＲｓｈ、電圧降下手段１３を流れる電流の大きさをＩ
ｓｈとすると、電圧降下手段１３の両端に生じる電圧降
下Ｖｓｈは、 Ｖｓｈ＝Ｒｓｈ×Ｉｓｈ と表すことができる。
【００１８】表示部分７３では、表示部分７２に比べて
重負荷になるため、表示部分７３に対応する走査線２に
走査電圧を送るときのＩｓｈ73は表示部分７２に対応す
る走査線２に走査電圧を送るときのＩｓｈ72より大きく
なる。従って、上式よりＩｓｈ73によって生じる電圧降
下Ｖｓｈ73の方が、Ｉｓｈ72によって生じる電圧降下Ｖ
ｓｈ72より大きくなることがわかる。
重負荷になるため、表示部分７３に対応する走査線２に
走査電圧を送るときのＩｓｈ73は表示部分７２に対応す
る走査線２に走査電圧を送るときのＩｓｈ72より大きく
なる。従って、上式よりＩｓｈ73によって生じる電圧降
下Ｖｓｈ73の方が、Ｉｓｈ72によって生じる電圧降下Ｖ
ｓｈ72より大きくなることがわかる。
【００１９】又、同一の表示部分７３においても図８の
Ａで示される液晶補助容量６に充電が完了していない間
は、次第にＩｓｈ73が小さくなるので、Ｖｓｈ73も次第
に小さくなり、ちょうど図８のＣ区間で見られる歪みを
補正できるようにＶｓｈ73が変動する。
Ａで示される液晶補助容量６に充電が完了していない間
は、次第にＩｓｈ73が小さくなるので、Ｖｓｈ73も次第
に小さくなり、ちょうど図８のＣ区間で見られる歪みを
補正できるようにＶｓｈ73が変動する。
【００２０】図８のＤ区間では、Ｉｓｈの向きが逆にな
っているので、Ｖｓｈは負の方向に上乗せされている。
っているので、Ｖｓｈは負の方向に上乗せされている。
【００２１】即ち、電圧降下手段１３の抵抗値を適当な
値にすれば、走査電圧ＶＧに図８の走査電圧ＶＧ’のＡ
区間及びＢに見られる歪み分を補正するようにＶｓｈを
上乗せすることができ、図２に示すように実際に液晶補
助容量６に印加される電圧波形が最適化される。
値にすれば、走査電圧ＶＧに図８の走査電圧ＶＧ’のＡ
区間及びＢに見られる歪み分を補正するようにＶｓｈを
上乗せすることができ、図２に示すように実際に液晶補
助容量６に印加される電圧波形が最適化される。
【００２２】従って、本実施例の液晶表示装置では、シ
ャドーイング現象を防止した優れた画像を得ることが出
来る。
ャドーイング現象を防止した優れた画像を得ることが出
来る。
【００２３】尚、本発明の液晶表示素子及び駆動回路の
構成は本実施例に限られるものではなく、例えば液晶補
助容量を形成する電極を走査線と兼用しても別途設けて
も構わない。
構成は本実施例に限られるものではなく、例えば液晶補
助容量を形成する電極を走査線と兼用しても別途設けて
も構わない。
【００２４】
【発明の効果】以上の説明から明らかなように、本発明
の液晶表示装置の駆動回路によれば、シャドーイング現
象を防止すべく液晶補助容量に実際に印加する電圧波形
の適正化を図り、画質を向上させることが出来る。
の液晶表示装置の駆動回路によれば、シャドーイング現
象を防止すべく液晶補助容量に実際に印加する電圧波形
の適正化を図り、画質を向上させることが出来る。
【００２５】又、電圧降下手段を可変抵抗にすれば、シ
ャドーイング現象を防止するだけでなく、各絵素のイン
ピーダンスのバラツキ等による液晶補助容量に実際に印
加する電圧波形の違いを調節することが可能になる。
ャドーイング現象を防止するだけでなく、各絵素のイン
ピーダンスのバラツキ等による液晶補助容量に実際に印
加する電圧波形の違いを調節することが可能になる。
【図１】本発明のＴＦＴ型ドットマトリクス液晶表示装
置のブロック図である。
置のブロック図である。
【図２】本発明の駆動回路による各印加回路からの出力
電圧及び実際に絵素に印加される電圧の関係を示すタイ
ミングチャートである。
電圧及び実際に絵素に印加される電圧の関係を示すタイ
ミングチャートである。
【図３】従来のＴＦＴ型ドットマトリクス液晶表示装置
のブロック図である。
のブロック図である。
【図４】図３の液晶表示装置における１絵素の等価回路
図である。
図である。
【図５】軽負荷時における各印加回路からの出力電圧及
び実際に絵素に印加される電圧の関係を示すタイミング
チャートである。
び実際に絵素に印加される電圧の関係を示すタイミング
チャートである。
【図６】重負荷時における各印加回路からの出力電圧及
び実際に絵素に印加される電圧の関係を示すタイミング
チャートである。
び実際に絵素に印加される電圧の関係を示すタイミング
チャートである。
【図７】シャドーイング表示パターンを示す図である。
【図８】シャドー部分における各印加回路からの出力電
圧及び実際に絵素に印加される電圧の関係を示すタイミ
ングチャートである。
圧及び実際に絵素に印加される電圧の関係を示すタイミ
ングチャートである。
１ 液晶層 ２ 走査線 ３ 信号線 ４ 対向電極 ５ ＴＦＴ ６ 液晶補助容量 ７ 絵素電極 ８ 対向電圧印加回路 ８ａ オフセット ９ ゲートドライバー群 １０ レベルシフト回路 １１ ソースドライバー群 １２ 信号電圧印加回路 １３ 電圧降下手段 Ｌ１ 対向電圧印加線 Ｌ２ 走査電圧印加線 ＯＰ１ オペアンプ Ｒｓ、Ｒｆ 増幅抵抗
フロントページの続き (72)発明者 福岡 宏文 大阪府大阪市阿倍野区長池町22番22号 シャープ株式会社内 (72)発明者 金谷 吉春 大阪府大阪市阿倍野区長池町22番22号 シャープ株式会社内 (56)参考文献 特開 平４−191821（ＪＰ，Ａ) 実開 平１−244429（ＪＰ，Ｕ) (58)調査した分野(Int.Cl.6，ＤＢ名) G02F 1/133 G09G 3/36
Claims (2)
- 【請求項１】 液晶層を挟んでマトリクス基板と対向基
板とが対向配設され、該マトリクス基板は縦横に配線さ
れた走査線及び信号線に、スイッチング素子が形成され
ていると共に、走査線及び信号線で囲まれた領域に絵素
電極が形成されており、該走査線と該絵素電極との間に
液晶補助容量が形成された液晶表示装置の駆動回路にお
いて、 該対向電極への電圧印加用の対向電圧印加回路における
帰還増幅回路のフィードバックポイントと該帰還増幅回
路の出力端との間に電圧降下手段が設けられ、該電圧降
下手段から出力された電圧が該対向電極に印加され、か
つ該電圧降下手段に入力される該帰還増幅回路の出力電
圧がレベルシフト回路に与えられ、該レベルシフト回路
を経た電圧が該液晶補助容量に印加されるように構成さ
れた液晶表示装置の駆動回路。 - 【請求項２】 前記電圧降下手段が可変抵抗である請求
項１に記載の液晶表示装置の駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13286992A JP2783395B2 (ja) | 1992-05-25 | 1992-05-25 | 液晶表示装置の駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13286992A JP2783395B2 (ja) | 1992-05-25 | 1992-05-25 | 液晶表示装置の駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05323279A JPH05323279A (ja) | 1993-12-07 |
| JP2783395B2 true JP2783395B2 (ja) | 1998-08-06 |
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ID=15091457
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13286992A Expired - Fee Related JP2783395B2 (ja) | 1992-05-25 | 1992-05-25 | 液晶表示装置の駆動回路 |
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| Country | Link |
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| JP (1) | JP2783395B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3488054B2 (ja) | 1997-09-12 | 2004-01-19 | Ｎｅｃエレクトロニクス株式会社 | 液晶駆動用装置 |
-
1992
- 1992-05-25 JP JP13286992A patent/JP2783395B2/ja not_active Expired - Fee Related
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| Publication number | Publication date |
|---|---|
| JPH05323279A (ja) | 1993-12-07 |
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