JP2663796B2 - 表示装置 - Google Patents
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- JP2663796B2 JP2663796B2 JP4177049A JP17704992A JP2663796B2 JP 2663796 B2 JP2663796 B2 JP 2663796B2 JP 4177049 A JP4177049 A JP 4177049A JP 17704992 A JP17704992 A JP 17704992A JP 2663796 B2 JP2663796 B2 JP 2663796B2
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- JP
- Japan
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- signal
- display
- circuit
- data
- display device
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/12—Picture reproducers
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/14—Digital output to display device ; Cooperation and interconnection of the display device with other functional units
- G06F3/1423—Digital output to display device ; Cooperation and interconnection of the display device with other functional units controlling a plurality of local displays, e.g. CRT and flat panel display
- G06F3/1446—Digital output to display device ; Cooperation and interconnection of the display device with other functional units controlling a plurality of local displays, e.g. CRT and flat panel display display composed of modules, e.g. video walls
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S345/00—Computer graphics processing and selective visual display systems
- Y10S345/903—Modular display
Description
【０００１】
【産業上の利用分野】本発明は、複数個の表示器を接続
して一連の表示を行なわせることのできる表示装置に関
するものである。
して一連の表示を行なわせることのできる表示装置に関
するものである。
【０００２】
【従来の技術】図４は、従来の表示装置のブロック図を
示している。複数個（図では５個）の表示器１００は、
ホストコンピュータ１０１にそれぞれ接続されており、
所定の通信フォーマットによって表示データを送信され
るようになっている。各表示器１００にはそれぞれディ
ップスイッチが設けられており、このディップスイッチ
で各表示器ごとに番号を設定する。そして、ホストコン
ピュータ１０１から表示データを送信すると、個々の表
示器１００は送信されてきた表示データが自己のデータ
か否かディップスイッチによる設定と比較し、必要な表
示データのみを取り込んで表示を行なう。
示している。複数個（図では５個）の表示器１００は、
ホストコンピュータ１０１にそれぞれ接続されており、
所定の通信フォーマットによって表示データを送信され
るようになっている。各表示器１００にはそれぞれディ
ップスイッチが設けられており、このディップスイッチ
で各表示器ごとに番号を設定する。そして、ホストコン
ピュータ１０１から表示データを送信すると、個々の表
示器１００は送信されてきた表示データが自己のデータ
か否かディップスイッチによる設定と比較し、必要な表
示データのみを取り込んで表示を行なう。
【０００３】例えば図４に示す表示装置において、「あ
いうえお」と表示する場合、Ｎｏ．１に「あ」、Ｎｏ．
２に「い」、Ｎｏ．３に「う」、Ｎｏ．４に「え」、Ｎ
ｏ．５に「お」を通信して表示する。
いうえお」と表示する場合、Ｎｏ．１に「あ」、Ｎｏ．
２に「い」、Ｎｏ．３に「う」、Ｎｏ．４に「え」、Ｎ
ｏ．５に「お」を通信して表示する。
【０００４】
【発明が解決しようとする課題】従来の表示装置によれ
ば、各表示器の番号を判断するために、個々の表示器に
ディップスイッチを設けなければならず、製造コストが
上昇した。
ば、各表示器の番号を判断するために、個々の表示器に
ディップスイッチを設けなければならず、製造コストが
上昇した。
【０００５】またディップスイッチによって各表示器ご
とに番号を設定しなければならないという手間がかかる
とともに、設定ミスがあると正常な表示が行なえないと
いう問題があった。
とに番号を設定しなければならないという手間がかかる
とともに、設定ミスがあると正常な表示が行なえないと
いう問題があった。
【０００６】さらに表示器の移動等により表示器の配列
を変更した場合、各表示器の設定番号を切り換える必要
がある。
を変更した場合、各表示器の設定番号を切り換える必要
がある。
【０００７】さらにホストコンピュータ側において、現
在接続されている表示器の個数を知ることができなかっ
た。これを検知するためには、複数台の表示器のうち、
最終段の表示器においてディップスイッチで設定された
番号をホストコンピュータ側へデータとして送信しなけ
ればならなかった。
在接続されている表示器の個数を知ることができなかっ
た。これを検知するためには、複数台の表示器のうち、
最終段の表示器においてディップスイッチで設定された
番号をホストコンピュータ側へデータとして送信しなけ
ればならなかった。
【０００８】本発明は、複数台の表示器を接続してホス
トコンピュータで一連の表示を行なう表示装置におい
て、個々の表示器に自動的に番号を付すことができ、表
示器の位置をを移動しても、各表示器に一連の接続番号
を自動的に設定できるようにすることを目的としてい
る。
トコンピュータで一連の表示を行なう表示装置におい
て、個々の表示器に自動的に番号を付すことができ、表
示器の位置をを移動しても、各表示器に一連の接続番号
を自動的に設定できるようにすることを目的としてい
る。
【０００９】
【課題を解決するための手段】本発明の表示装置は、カ
スケード接続された複数の表示器と前記各表示器へデー
タ信号を与える制御部とを有し、トリガ信号に同期して
前記制御部から第１段の前記表示器に与えられ、順次次
段の前記表示器に送られるとともに最終段の前記表示器
から前記制御部に回帰するコントロール信号により、前
記各表示器の段数を判断するように構成したことを特徴
としている。
スケード接続された複数の表示器と前記各表示器へデー
タ信号を与える制御部とを有し、トリガ信号に同期して
前記制御部から第１段の前記表示器に与えられ、順次次
段の前記表示器に送られるとともに最終段の前記表示器
から前記制御部に回帰するコントロール信号により、前
記各表示器の段数を判断するように構成したことを特徴
としている。
【００１０】また、本発明によれば、前記表示装置の各
表示器が、入力された前記コントロール信号の状態を検
出するＨ・Ｌ判別回路と、入力された前記コントロール
信号を保持するホールド回路と、前記ホールド回路から
次段の表示装置に出力されたデータがＬ信号の時にこれ
をカウントするＬカウンタ回路と、トリガ信号をカウン
トして検出ＥＮＤ信号を出力するトリガカウンタ回路
と、前記検出ＥＮＤ信号が入力された時に前記Ｌカウン
タ回路によってカウントされたカウント数のデータをホ
ールドするカウントデータホールド回路と、前記カウン
トデータホールド回路からのデータを演算して当該表示
器の段数を判断する演算回路とを備えた自動判別回路を
有していてもよい。
表示器が、入力された前記コントロール信号の状態を検
出するＨ・Ｌ判別回路と、入力された前記コントロール
信号を保持するホールド回路と、前記ホールド回路から
次段の表示装置に出力されたデータがＬ信号の時にこれ
をカウントするＬカウンタ回路と、トリガ信号をカウン
トして検出ＥＮＤ信号を出力するトリガカウンタ回路
と、前記検出ＥＮＤ信号が入力された時に前記Ｌカウン
タ回路によってカウントされたカウント数のデータをホ
ールドするカウントデータホールド回路と、前記カウン
トデータホールド回路からのデータを演算して当該表示
器の段数を判断する演算回路とを備えた自動判別回路を
有していてもよい。
【００１１】
【作用】制御部は、コントロール信号であるＨ信号をト
リガ信号に同期して表示器の第１段目に出力し続ける。
カスケード接続された複数の表示器は、入力信号として
Ｈ信号が入力されるまで次段の表示器にＬ信号を出力し
続け、Ｈ信号が入力された場合には次のトリガ信号でＨ
信号を次段の表示器に出力する。あらかじめ定めておい
た個数のトリガ信号が出力された時点で、各表示器にお
いて入力したＬ信号の数に基づいて演算を行ない、その
段の表示器の番号を算出する。また、最終段の表示器か
ら出力されたコントロール信号が制御部に戻ることによ
り、現在接続されている表示器の全段数を制御部におい
て検出できる。
リガ信号に同期して表示器の第１段目に出力し続ける。
カスケード接続された複数の表示器は、入力信号として
Ｈ信号が入力されるまで次段の表示器にＬ信号を出力し
続け、Ｈ信号が入力された場合には次のトリガ信号でＨ
信号を次段の表示器に出力する。あらかじめ定めておい
た個数のトリガ信号が出力された時点で、各表示器にお
いて入力したＬ信号の数に基づいて演算を行ない、その
段の表示器の番号を算出する。また、最終段の表示器か
ら出力されたコントロール信号が制御部に戻ることによ
り、現在接続されている表示器の全段数を制御部におい
て検出できる。
【００１２】
【実施例】本発明の一実施例を図１〜図３によって説明
する。図１に示す表示装置１は、制御部２と、複数台
（ここでは６台）の表示器３（以下、モジュール３と呼
ぶ。）を有している。各モジュール３は、表示素子と回
路部を有している。そして、各モジュール３は、コント
ロール信号線４によってカスケード接続され、制御部２
に接続されている。即ち、コントロール信号を出力する
制御部２の出力端子が第１段のモジュール３の入力端子
に接続され、複数のモジュール３は入出力端子を順次接
続され、最終段のモジュール３の出力端子が制御部２の
入力端子に接続されてコントロール信号を制御部２にリ
ターン信号として戻せるようになっている。
する。図１に示す表示装置１は、制御部２と、複数台
（ここでは６台）の表示器３（以下、モジュール３と呼
ぶ。）を有している。各モジュール３は、表示素子と回
路部を有している。そして、各モジュール３は、コント
ロール信号線４によってカスケード接続され、制御部２
に接続されている。即ち、コントロール信号を出力する
制御部２の出力端子が第１段のモジュール３の入力端子
に接続され、複数のモジュール３は入出力端子を順次接
続され、最終段のモジュール３の出力端子が制御部２の
入力端子に接続されてコントロール信号を制御部２にリ
ターン信号として戻せるようになっている。
【００１３】また前記制御部２は、表示データとトリガ
信号を、各モジュール３に与えるように構成されてい
る。
信号を、各モジュール３に与えるように構成されてい
る。
【００１４】前述した構成において、各モジュール３の
番号（又は段数）を検出するためのトリガ信号出力数Ｎ
をあらかじめ定め、制御部２に設定しておく。本実施例
ではモジュール３が６台であるから、Ｎ＝６と設定す
る。
番号（又は段数）を検出するためのトリガ信号出力数Ｎ
をあらかじめ定め、制御部２に設定しておく。本実施例
ではモジュール３が６台であるから、Ｎ＝６と設定す
る。
【００１５】各モジュール３の番号を検出するため、ト
リガ信号に同期して、コントロール信号としてのＨ信号
を制御部２が第１段目のモジュールに出力する。
リガ信号に同期して、コントロール信号としてのＨ信号
を制御部２が第１段目のモジュールに出力する。
【００１６】各モジュール３は、トリガ信号に同期して
Ｈ信号が入力されるまで、次段のモジュール３にＬ信号
を出力し続けるように構成されている。そして、Ｈ信号
が入力された時点で、次のトリガ信号によってＨ信号を
出力する。
Ｈ信号が入力されるまで、次段のモジュール３にＬ信号
を出力し続けるように構成されている。そして、Ｈ信号
が入力された時点で、次のトリガ信号によってＨ信号を
出力する。
【００１７】このような、トリガ信号の出力個数Ｎに対
し、制御部２及び各モジュール３におけるコントロール
信号の入出力状況を示したのが図２の表である。この表
からわかるように、コントロール信号としてのＨ信号を
トリガ信号に同期して制御部２がＮｏ．１のモジュール
３に出力する。このモジュール３はＨ信号の入力を検出
した後、トリガ信号の次のタイミングでＮｏ．２のモジ
ュール３にＨ信号を出力する。以下、同様にＨ信号が次
段のモジュール３に伝達されていく。
し、制御部２及び各モジュール３におけるコントロール
信号の入出力状況を示したのが図２の表である。この表
からわかるように、コントロール信号としてのＨ信号を
トリガ信号に同期して制御部２がＮｏ．１のモジュール
３に出力する。このモジュール３はＨ信号の入力を検出
した後、トリガ信号の次のタイミングでＮｏ．２のモジ
ュール３にＨ信号を出力する。以下、同様にＨ信号が次
段のモジュール３に伝達されていく。
【００１８】ここで、各モジュール３は、Ｈ信号が入力
されるまではＬ信号を出力しているので、Ｎ＝６のトリ
ガ信号が出力された時点で、各モジュール３ごとに入力
されたＬ信号の数に１を加えれば、当該モジュール３の
番号（又は段数）が得られる。また、制御部２において
は最終段のモジュール３から入力されたＬ信号の数が全
モジュールの数（全段数）を表わしている。なお、この
例では、各モジュール３においては入力されたＬ信号の
数を基準に演算を行なったが、出力したＬ信号の数であ
れば＋１の演算を行なう必要はない。
されるまではＬ信号を出力しているので、Ｎ＝６のトリ
ガ信号が出力された時点で、各モジュール３ごとに入力
されたＬ信号の数に１を加えれば、当該モジュール３の
番号（又は段数）が得られる。また、制御部２において
は最終段のモジュール３から入力されたＬ信号の数が全
モジュールの数（全段数）を表わしている。なお、この
例では、各モジュール３においては入力されたＬ信号の
数を基準に演算を行なったが、出力したＬ信号の数であ
れば＋１の演算を行なう必要はない。
【００１９】次に、前記モジュール３の回路部が含むコ
ントロール信号の自動判断回路を図３によって説明す
る。前記のモジュール３又は制御部２からのコントロー
ル信号はトリガ信号に同期してＨ・Ｌ判別回路１０に入
力され、コントロール信号の状態（Ｈ又はＬ）が判別さ
れる。そして、このコントロール信号はホールド回路１
１に保持され、次のトリガ信号に同期して次段のモジュ
ール３に出力される。
ントロール信号の自動判断回路を図３によって説明す
る。前記のモジュール３又は制御部２からのコントロー
ル信号はトリガ信号に同期してＨ・Ｌ判別回路１０に入
力され、コントロール信号の状態（Ｈ又はＬ）が判別さ
れる。そして、このコントロール信号はホールド回路１
１に保持され、次のトリガ信号に同期して次段のモジュ
ール３に出力される。
【００２０】Ｌカウンタ回路１２は、コントロール信号
が“Ｌ”状態の時、トリガ信号に同期してＬ信号の入力
をカウントアップする。
が“Ｌ”状態の時、トリガ信号に同期してＬ信号の入力
をカウントアップする。
【００２１】トリガカウンタ回路１３には、制御部２に
設定したトリガ信号の出力回数が自動的に設定され、ト
リガ信号が入力される毎にカウントダウンして０となっ
た時に検出ＥＮＤ信号を出力する。
設定したトリガ信号の出力回数が自動的に設定され、ト
リガ信号が入力される毎にカウントダウンして０となっ
た時に検出ＥＮＤ信号を出力する。
【００２２】カウントデータホールド回路１４は、前記
検出ＥＮＤ信号を受けた時に、前記Ｌカウント回路１２
のカウントデータをホールドする。その時、カウンタデ
ータホールド回路１４は、ホールドしたデータを自動的
に＋１だけカウントを増加させる回路構成となってい
る。
検出ＥＮＤ信号を受けた時に、前記Ｌカウント回路１２
のカウントデータをホールドする。その時、カウンタデ
ータホールド回路１４は、ホールドしたデータを自動的
に＋１だけカウントを増加させる回路構成となってい
る。
【００２３】演算回路１５は、前記カウントデータホー
ルド回路１４でホールドされたデータを検討し、モジュ
ール番号を確認する。
ルド回路１４でホールドされたデータを検討し、モジュ
ール番号を確認する。
【００２４】リセット回路１６は、電源をＯＮとした時
にトリガカウンタ回路１３、Ｌカウンタ回路１２、カウ
ントデータホールド回路１４をリセットし、モジュール
番号を自動判断できる状態とする。
にトリガカウンタ回路１３、Ｌカウンタ回路１２、カウ
ントデータホールド回路１４をリセットし、モジュール
番号を自動判断できる状態とする。
【００２５】
【発明の効果】本発明によれば、次のような効果が得ら
れる。 従来モジュールごとに設けていたディップスイッチが
不要となり、製造コストが低下する。 モジュール番号を自動的に設定できるため、設定の手
間が省け、設定ミスもなくなる。また、モジュールの位
置を移動しても、番号の重複・欠番が生じることがな
く、連続した番号を付けることができる。 現在接続しているモジュールの個数を制御部側で自動
的に検出することができる。
れる。 従来モジュールごとに設けていたディップスイッチが
不要となり、製造コストが低下する。 モジュール番号を自動的に設定できるため、設定の手
間が省け、設定ミスもなくなる。また、モジュールの位
置を移動しても、番号の重複・欠番が生じることがな
く、連続した番号を付けることができる。 現在接続しているモジュールの個数を制御部側で自動
的に検出することができる。
【図１】本発明の一実施例のブロック図である。
【図２】本発明の一実施例におけるコントロール信号の
状態を示す表図である。
状態を示す表図である。
【図３】本発明の一実施例における各モジュールの自動
判断回路を示す図である。
判断回路を示す図である。
【図４】従来の表示装置の一例を示すブロック図であ
る。
る。
１ 表示装置 ２ 制御部 ３ 表示器（モジュール） １０ Ｈ・Ｌ判別回路 １１ ホールド回路 １２ Ｌカウンタ回路 １３ トリガカウンタ回路 １４ カウントデータホールド回路 １５ 演算回路
───────────────────────────────────────────────────── フロントページの続き (72)発明者 加瀬 克紀 千葉県茂原市大芝629 双葉電子工業株 式会社内 (56)参考文献 特開 平５−303360（ＪＰ，Ａ)
Claims (2)
- 【請求項１】 カスケード接続された複数の表示器と前
記各表示器へデータ信号を与える制御部とを有し、トリ
ガ信号に同期して前記制御部から第１段の前記表示器に
与えられ、順次次段の前記表示器に送られるとともに最
終段の前記表示器から前記制御部に回帰するコントロー
ル信号により、前記各表示器の段数を判断するように構
成したことを特徴とする表示装置。 - 【請求項２】 前記各表示器が、入力された前記コント
ロール信号の状態を検出するＨ・Ｌ判別回路と、入力さ
れた前記コントロール信号を保持するホールド回路と、
前記ホールド回路から次段の表示装置に出力されたデー
タがＬ信号の時にこれをカウントするＬカウンタ回路
と、トリガ信号をカウントして検出ＥＮＤ信号を出力す
るトリガカウンタ回路と、前記検出ＥＮＤ信号から入力
された時に前記Ｌカウンタ回路によってカウントされた
カウント数のデータをホールドするカウントデータホー
ルド回路と、前記カウントデータホールド回路からのデ
ータを演算して当該表示器の段数を判断する演算回路と
を備えた自動判別回路を有する請求項１記載の表示装
置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4177049A JP2663796B2 (ja) | 1992-07-03 | 1992-07-03 | 表示装置 |
| US08/084,964 US5465101A (en) | 1992-07-03 | 1993-07-02 | Display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4177049A JP2663796B2 (ja) | 1992-07-03 | 1992-07-03 | 表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0619424A JPH0619424A (ja) | 1994-01-28 |
| JP2663796B2 true JP2663796B2 (ja) | 1997-10-15 |
Family
ID=16024247
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4177049A Expired - Fee Related JP2663796B2 (ja) | 1992-07-03 | 1992-07-03 | 表示装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5465101A (ja) |
| JP (1) | JP2663796B2 (ja) |
Families Citing this family (14)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0608436A4 (en) * | 1992-08-20 | 1995-02-01 | Nippon Steel Corp | DEVICE AND METHOD FOR PRODUCING SINTERED ORE. |
| US6025840A (en) * | 1995-09-27 | 2000-02-15 | Cirrus Logic, Inc. | Circuits, systems and methods for memory mapping and display control systems using the same |
| WO2001009664A1 (en) * | 1999-08-01 | 2001-02-08 | Deep Video Imaging Limited | Interactive three dimensional display with layered screens |
| US7724208B1 (en) | 1999-08-19 | 2010-05-25 | Puredepth Limited | Control of depth movement for visual display with layered screens |
| EP1212744A4 (en) * | 1999-08-19 | 2006-06-14 | Pure Depth Ltd | DISPLAY PROCESS FOR MULTILAYER SCREENS |
| JP2003507774A (ja) * | 1999-08-19 | 2003-02-25 | ディープ ヴィデオ イメイジング リミテッド | 多層スクリーンのデータ表示 |
| NZ511444A (en) | 2001-05-01 | 2004-01-30 | Deep Video Imaging Ltd | Information display |
| NZ514119A (en) | 2001-09-11 | 2004-06-25 | Deep Video Imaging Ltd | Improvement to instrumentation |
| JP2003330438A (ja) * | 2002-05-15 | 2003-11-19 | Nec Mitsubishi Denki Visual Systems Kk | 画像信号出力装置と画像信号分配器、および画像信号の制御方法 |
| NZ521505A (en) | 2002-09-20 | 2005-05-27 | Deep Video Imaging Ltd | Multi-view display |
| NZ525956A (en) | 2003-05-16 | 2005-10-28 | Deep Video Imaging Ltd | Display control system for use with multi-layer displays |
| JP4783253B2 (ja) * | 2006-09-27 | 2011-09-28 | パナソニック株式会社 | パネル表示装置 |
| JP2009186895A (ja) * | 2008-02-08 | 2009-08-20 | Panasonic Corp | 表示ユニット |
| US10803833B1 (en) * | 2019-11-25 | 2020-10-13 | Himax Technologies Limited | Display systems and integrated source driver circuits |
Family Cites Families (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3657706A (en) * | 1969-11-12 | 1972-04-18 | Inforex | Keyboard digital data entry system |
| JPS5415164B2 (ja) * | 1974-05-20 | 1979-06-13 | ||
| US4660141A (en) * | 1983-12-06 | 1987-04-21 | Tri Sigma Corporation | Self configuring computer network with automatic bus exchange of module identification numbers and processor assigned module numbers |
| US4617566A (en) * | 1983-12-15 | 1986-10-14 | Teleplex Corporation | Addressable-port, daisy chain telemetry system with self-test capability |
| IT1182613B (it) * | 1985-10-15 | 1987-10-05 | Olivetti & Co Spa | Tasto con visualizzatore attivabile selettivamente e tastiera utilizzante tale tasto |
| ATE68058T1 (de) * | 1987-05-14 | 1991-10-15 | Siemens Ag | Verfahren zum einleiten des konfigurierens nach dem unterbrechen mindestens zweier parallel angeordneter, ringfoermiger netze. |
| JPH0740319B2 (ja) * | 1988-02-17 | 1995-05-01 | ニッタン株式会社 | 端末器 |
| JPH0758458B2 (ja) * | 1988-07-21 | 1995-06-21 | 三菱電機株式会社 | データ転送装置及びそれを使用したパイプライン処理装置 |
-
1992
- 1992-07-03 JP JP4177049A patent/JP2663796B2/ja not_active Expired - Fee Related
-
1993
- 1993-07-02 US US08/084,964 patent/US5465101A/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| US5465101A (en) | 1995-11-07 |
| JPH0619424A (ja) | 1994-01-28 |
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