JP2637438B2 - 画像処理装置 - Google Patents
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- H04N19/00—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals
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- H04N19/89—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using pre-processing or post-processing specially adapted for video compression involving methods or arrangements for detection of transmission errors at the decoder
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
- Color Television Systems (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は画像データ処理システム、特に符号誤りの発
生に伴い、ライン間補間を行う画像データ処理システム
に関するものである。
生に伴い、ライン間補間を行う画像データ処理システム
に関するものである。
一般に画像信号は単位時間当りの情報量が多く、これ
をデジタル信号として伝送しようとすると伝送ビツトレ
ートは極めて高くなる。そこでこの伝送ビツトレートを
低くするために様々な帯域圧縮技術が提案されている。
この帯域圧縮技術の１つとしてDPCM等の予測差分符号化
によりデータ量を削減する手法が知られている。例えば
フイールド内前値予測DPCM等の簡易な予測法はハードウ
エア的にも簡易であるにも係らず、比較的大きなデータ
圧縮率が得らえるため有効な手法であるといえる。
をデジタル信号として伝送しようとすると伝送ビツトレ
ートは極めて高くなる。そこでこの伝送ビツトレートを
低くするために様々な帯域圧縮技術が提案されている。
この帯域圧縮技術の１つとしてDPCM等の予測差分符号化
によりデータ量を削減する手法が知られている。例えば
フイールド内前値予測DPCM等の簡易な予測法はハードウ
エア的にも簡易であるにも係らず、比較的大きなデータ
圧縮率が得らえるため有効な手法であるといえる。
一方、上述の如きデータを伝送路を介して伝送した場
合、種々の要因にて符号誤りが生じることが知られてい
る。特に伝送路として磁気記録再生系を想定した場合、
記録媒体上のキズ、ヘツドの目づまり等によるドロツプ
アウトの発生に伴い誤り訂正の不能な大きな符号誤りが
発生し易い。誤り訂正が不能な場合には一般に画像の相
関性を用いてデータの補間を行うことになるが、このデ
ータ補間についても様々な手法が提案されている。
合、種々の要因にて符号誤りが生じることが知られてい
る。特に伝送路として磁気記録再生系を想定した場合、
記録媒体上のキズ、ヘツドの目づまり等によるドロツプ
アウトの発生に伴い誤り訂正の不能な大きな符号誤りが
発生し易い。誤り訂正が不能な場合には一般に画像の相
関性を用いてデータの補間を行うことになるが、このデ
ータ補間についても様々な手法が提案されている。
ところでデータ補間については、前後の数画素を利用
して高次の演算を行い、最適な補間データを算出するこ
とが考えられている。しかしながら、この手法は補間し
ようとする画素が連続して発生する場合には効果が小さ
い。
して高次の演算を行い、最適な補間データを算出するこ
とが考えられている。しかしながら、この手法は補間し
ようとする画素が連続して発生する場合には効果が小さ
い。
一方、予測符号化を行いデータを伝送する場合には１
つのデータが誤り訂正不能になると、このデータに基い
て復号される全てのデータに誤りが発生する所謂誤りの
伝播が生じるため、補間をしようとする画素が画像の水
平方向に連続することが多い。
つのデータが誤り訂正不能になると、このデータに基い
て復号される全てのデータに誤りが発生する所謂誤りの
伝播が生じるため、補間をしようとする画素が画像の水
平方向に連続することが多い。
補間しようとする画素に対し水平方向に並ぶ画素のデ
ータが連続して信頼性のないデータであれば、画像の垂
直方向の相関性を利用して補間データを作成することに
なる。画像の垂直方向の相関性を利用した補間について
も、前ラインの画素による置換，前後ラインの画素のよ
る線形補間等が考えられている。しかし、複数ラインに
渡って連続して補間すべきデータが発生した場合には対
応がとれないものであった。
ータが連続して信頼性のないデータであれば、画像の垂
直方向の相関性を利用して補間データを作成することに
なる。画像の垂直方向の相関性を利用した補間について
も、前ラインの画素による置換，前後ラインの画素のよ
る線形補間等が考えられている。しかし、複数ラインに
渡って連続して補間すべきデータが発生した場合には対
応がとれないものであった。
本発明は上述の如き問題点に鑑み、画像の垂直方向の
相関性を利用するライン間補間の手法を改良し、水平方
向の相関性を利用した補間が行えない場合でも良好な補
間データを形成することのできる画像処理装置を提供す
ることを目的とする。
相関性を利用するライン間補間の手法を改良し、水平方
向の相関性を利用した補間が行えない場合でも良好な補
間データを形成することのできる画像処理装置を提供す
ることを目的とする。
補間しようとする注目画素に対し画面の垂直方向に整
列する複数の画素データが並列に供給され、前記複数の
画素のデータ中の１つを選択する第１の選択手段と、前
記第１の選択手段に供給される複数の画素のデータが並
列に供給され、前記複数の画素のデータ中の１つを選択
する第２の選択手段と、前記複数の画素のデータをそれ
ぞれについてのエラーフラグを並列に受け、前記複数の
エラーフラグの状態に応じた前記第１及び第２の選択手
段の選択動作を制御するための制御信号を出力するメモ
リと、前記メモリより出力された制御信号に従って前記
第１及び第２の選択手段により選択された２つのデータ
を用いて補間データを生成する手段とを備える構成とし
た。
列する複数の画素データが並列に供給され、前記複数の
画素のデータ中の１つを選択する第１の選択手段と、前
記第１の選択手段に供給される複数の画素のデータが並
列に供給され、前記複数の画素のデータ中の１つを選択
する第２の選択手段と、前記複数の画素のデータをそれ
ぞれについてのエラーフラグを並列に受け、前記複数の
エラーフラグの状態に応じた前記第１及び第２の選択手
段の選択動作を制御するための制御信号を出力するメモ
リと、前記メモリより出力された制御信号に従って前記
第１及び第２の選択手段により選択された２つのデータ
を用いて補間データを生成する手段とを備える構成とし
た。
前述の如く構成することにより、周囲の画素のデータ
の誤り状態に応じて、メモリにより各選択手段の動作を
制御するための制御信号を出力するので、補間データを
高速に得ることができる。
の誤り状態に応じて、メモリにより各選択手段の動作を
制御するための制御信号を出力するので、補間データを
高速に得ることができる。
以下、本発明の実施例について説明する。
第１図は本発明の一実施例としての補間回路の構成を
示す図であり、図中１は補間処理前の画像データが供給
される端子、11は端子１に入力されている画像データが
誤りであるか否かを示す１ビツトのエラーフラグが入力
される端子である。2,3,4,5,12,13,15,16は夫々入力さ
れたデータを１水平走査期間（1H）遅延する1H遅延線
（1HDL）である。
示す図であり、図中１は補間処理前の画像データが供給
される端子、11は端子１に入力されている画像データが
誤りであるか否かを示す１ビツトのエラーフラグが入力
される端子である。2,3,4,5,12,13,15,16は夫々入力さ
れたデータを１水平走査期間（1H）遅延する1H遅延線
（1HDL）である。
本例では符号誤りの生じていない画素のデータについ
ては、1HDL2,3、スイツチ９のＢ側端子を介してそのま
ま出力される。即ち、1HDL12,13を介してROM（リードオ
ンリメモリ）14に入力されているエラーフラグが「０」
で（符号誤りが生じていないことを示す）の場合には、
ROM14から出力される制御信号S3によりスイツチ９はＢ
側に接続される。一方、1HDL13から出力されるエラーフ
ラグが「１」の場合には、制御信号S3はスイツチ９をＡ
側に接続せしめ、補間データを端子10に出力する。補間
データとしてはスイツチ６で選択されたデータと、スイ
ツチ７で選択されたデータとを平均値演算回路８に供給
して得たこれらの平均値のデータを用いる。この補間デ
ータは1HDL4に入力される。
ては、1HDL2,3、スイツチ９のＢ側端子を介してそのま
ま出力される。即ち、1HDL12,13を介してROM（リードオ
ンリメモリ）14に入力されているエラーフラグが「０」
で（符号誤りが生じていないことを示す）の場合には、
ROM14から出力される制御信号S3によりスイツチ９はＢ
側に接続される。一方、1HDL13から出力されるエラーフ
ラグが「１」の場合には、制御信号S3はスイツチ９をＡ
側に接続せしめ、補間データを端子10に出力する。補間
データとしてはスイツチ６で選択されたデータと、スイ
ツチ７で選択されたデータとを平均値演算回路８に供給
して得たこれらの平均値のデータを用いる。この補間デ
ータは1HDL4に入力される。
従って、1HDL3の出力している画素（以下注目画素と
称す）のデータに対し、1HDL2,1HDL3への入力データは
２ライン下,1ライン下に位置する画素のデータであり、
1HDL4,1HDL5からの出力データは注目画素の１ライン上,
2ライン上に位置する画素のデータとなる。スイツチ6,7
はこれら４つのデータをROM14の出力する制御信号S1,S2
に従い択一的に出力する構成となっている。
称す）のデータに対し、1HDL2,1HDL3への入力データは
２ライン下,1ライン下に位置する画素のデータであり、
1HDL4,1HDL5からの出力データは注目画素の１ライン上,
2ライン上に位置する画素のデータとなる。スイツチ6,7
はこれら４つのデータをROM14の出力する制御信号S1,S2
に従い択一的に出力する構成となっている。
他方、1HDL12,1HDL13への入力は注目画素の２ライン
下,1ライン下に位置する画素に関するエラーフラグであ
る。また1HDL15,1HDL16の出力データは注目画素の１ラ
イン上,2ライン上の画素の出力状態を示す２ビツトデー
タである。この２ビツトデータは、ROM14により発生さ
れ、例えばエラーフラグが「１」の場合に補間により良
好なデータが得られた場合と、補間が不能であった場合
とを区別することができる。
下,1ライン下に位置する画素に関するエラーフラグであ
る。また1HDL15,1HDL16の出力データは注目画素の１ラ
イン上,2ライン上の画素の出力状態を示す２ビツトデー
タである。この２ビツトデータは、ROM14により発生さ
れ、例えばエラーフラグが「１」の場合に補間により良
好なデータが得られた場合と、補間が不能であった場合
とを区別することができる。
ROM14はこれら５系統７ビツトの入力データ及び後述
するY/C識別データを受けて、所定の論理によって定め
られた制御信号S1,S2,S3,を出力する。S1,S2は夫々２ビ
ツト、S3は１ビツトのデータである。これらのデータと
共にROM14は注目画素の出力状態を示す２ビツトデータ
を出力する。
するY/C識別データを受けて、所定の論理によって定め
られた制御信号S1,S2,S3,を出力する。S1,S2は夫々２ビ
ツト、S3は１ビツトのデータである。これらのデータと
共にROM14は注目画素の出力状態を示す２ビツトデータ
を出力する。
本実施例に於いて端子１に入力される画像データは輝
度信号のデータと、線順次色差信号のデータとを1H単位
で時分割多重したデータであるとしている。ここで線順
次色差信号を補間する場合には上下に隣接する画素につ
いては種類が異なるため相関がなく、補間データの演算
に用いることができない。従って輝度信号と線順次色差
信号とで補間データの演算式を変化させる必要があるた
め、ROM14には出力しようとするデータが輝度信号であ
るか線順次色差信号であるかを示すY/C識別用の１ビツ
トデータが入力されている。
度信号のデータと、線順次色差信号のデータとを1H単位
で時分割多重したデータであるとしている。ここで線順
次色差信号を補間する場合には上下に隣接する画素につ
いては種類が異なるため相関がなく、補間データの演算
に用いることができない。従って輝度信号と線順次色差
信号とで補間データの演算式を変化させる必要があるた
め、ROM14には出力しようとするデータが輝度信号であ
るか線順次色差信号であるかを示すY/C識別用の１ビツ
トデータが入力されている。
次に上記回路の具体的な動作について例をとって説明
する。
する。
注目画素のエラーフラグが「１」で、その上下に隣接
する画素のエラーフラグが「０」である場合には、上下
画素による線形補間が可能であるので、スイツチ６をb,
スイツチ７をｃ端子に接続するべくS1,S2のデータを決
定し、スイツチ９はＡ側に接続する。また、1HDL15には
エラーフラグは「１」であるが補間データが得られた旨
を示す２ビツトデータを供給する。
する画素のエラーフラグが「０」である場合には、上下
画素による線形補間が可能であるので、スイツチ６をb,
スイツチ７をｃ端子に接続するべくS1,S2のデータを決
定し、スイツチ９はＡ側に接続する。また、1HDL15には
エラーフラグは「１」であるが補間データが得られた旨
を示す２ビツトデータを供給する。
また、注目画素及びその１ライン下,2ライン下の画素
のエラーフラグが全て「１」で、１ライン上の画素のエ
ラーフラグが「０」である場合は、S1,S2はスイツチ6,7
を共にｂ端子に接続して、注目画素の上に隣接する画素
のデータそのものを補間データとするのが好ましい。
のエラーフラグが全て「１」で、１ライン上の画素のエ
ラーフラグが「０」である場合は、S1,S2はスイツチ6,7
を共にｂ端子に接続して、注目画素の上に隣接する画素
のデータそのものを補間データとするのが好ましい。
この様に、画像の垂直方向に整列する画素についての
エラーフラグの発生パターンを検討し、所望する画像を
設定することにより、ROM14の入出力の関係を決定すれ
ば、所望の設計条件に応じた理想的なライン間補間が行
える。
エラーフラグの発生パターンを検討し、所望する画像を
設定することにより、ROM14の入出力の関係を決定すれ
ば、所望の設計条件に応じた理想的なライン間補間が行
える。
上述した実施例の構成によれば、ライン間補間を適応
的に行うことができ、ライン間補間のみでも良好な補間
データの作成が可能となった。また入力信号として輝度
信号と線順次色差信号を1H単位で時間軸多重した所謂TC
I信号が入力された場合に於いても、いずれの信号に対
しても適応的に補間データを生成することができる。そ
のため輝度信号と線順次色差信号とで別の補間回路を設
ける必要がなく、全く同じ回路を兼用できる。更に、平
均値補間，前置補間スイツチ6,7の制御により選択で
き、加算器８以上の回路構成を極めて簡略化できた。
的に行うことができ、ライン間補間のみでも良好な補間
データの作成が可能となった。また入力信号として輝度
信号と線順次色差信号を1H単位で時間軸多重した所謂TC
I信号が入力された場合に於いても、いずれの信号に対
しても適応的に補間データを生成することができる。そ
のため輝度信号と線順次色差信号とで別の補間回路を設
ける必要がなく、全く同じ回路を兼用できる。更に、平
均値補間，前置補間スイツチ6,7の制御により選択で
き、加算器８以上の回路構成を極めて簡略化できた。
尚、上記実施例に於いては注目画素を含む前後５ライ
ンの画素を補間データの生成に用いる構成としたが、必
要に応じてこのライン数は任意に決定できる。
ンの画素を補間データの生成に用いる構成としたが、必
要に応じてこのライン数は任意に決定できる。
以上説明したように、本発明によれば、周囲の画素の
エラー状態に適応し、且つ、高速にデータ補間を行うこ
とができる。
エラー状態に適応し、且つ、高速にデータ補間を行うこ
とができる。
第１図は本発明の一実施例としての補間回路の構成を示
す図である。 図中、2,3,4,5,12,13,15,16は夫々１水平走査期間遅延
線、6,7,9は夫々スイツチ、８は平均値演算回路、14は
リードオンリメモリである。
す図である。 図中、2,3,4,5,12,13,15,16は夫々１水平走査期間遅延
線、6,7,9は夫々スイツチ、８は平均値演算回路、14は
リードオンリメモリである。
Claims (1)
- 【請求項１】補間しようとする注目画素に対し画面の垂
直方向に整列する複数の画素のデータが並列に供給さ
れ、前記複数の画素のデータ中の１つを選択する第１の
選択手段と、 前記第１の選択手段に供給される複数の画素のデータが
並列に供給され、前記複数の画素のデータ中の１つを選
択する第２の選択手段と、 前記複数の画素のデータそれぞれについてのエラーフラ
グを並列に受け、前記複数のエラーフラグの状態に応じ
た前記第１及び第２の選択手段の選択動作を制御するた
めの制御信号を出力するメモリと、 前記メモリより出力された制御信号に従って前記第１及
び第２の選択手段により選択された２つのデータを用い
て補間データを生成する手段と を備える画像処理装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27228587A JP2637438B2 (ja) | 1987-10-27 | 1987-10-27 | 画像処理装置 |
| US07/260,571 US4975866A (en) | 1987-10-27 | 1988-10-21 | Interpolation system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27228587A JP2637438B2 (ja) | 1987-10-27 | 1987-10-27 | 画像処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01114180A JPH01114180A (ja) | 1989-05-02 |
| JP2637438B2 true JP2637438B2 (ja) | 1997-08-06 |
Family
ID=17511727
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27228587A Expired - Lifetime JP2637438B2 (ja) | 1987-10-27 | 1987-10-27 | 画像処理装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4975866A (ja) |
| JP (1) | JP2637438B2 (ja) |
Families Citing this family (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0408343B1 (en) | 1989-07-13 | 1998-11-04 | Canon Kabushiki Kaisha | Encoding device and decoding device suitable for dubbing |
| JP2821223B2 (ja) * | 1990-02-20 | 1998-11-05 | キヤノン株式会社 | 再生装置 |
| US5177698A (en) * | 1990-07-09 | 1993-01-05 | Eastman Kodak Company | Selectable power of two coefficient signal combining circuit |
| ES2143136T3 (es) * | 1990-12-28 | 2000-05-01 | Canon Kk | Aparato para el proceso de imagenes. |
| US5191546A (en) * | 1991-01-22 | 1993-03-02 | The United States Of America As Represented By The Secretary Of The Navy | Time-interpolation method for digital beamformers |
| US5146325A (en) * | 1991-04-29 | 1992-09-08 | Rca Thomson Licensing Corporation | Video signal decompression apparatus for independently compressed even and odd field data |
| US6073151A (en) * | 1998-06-29 | 2000-06-06 | Motorola, Inc. | Bit-serial linear interpolator with sliced output |
| AU2002245609A1 (en) * | 2001-03-05 | 2002-09-19 | Intervideo, Inc. | Systems and methods of error resilience in a video decoder |
| JP3879741B2 (ja) * | 2004-02-25 | 2007-02-14 | ソニー株式会社 | 画像情報符号化装置および画像情報符号化方法 |
Family Cites Families (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3996456A (en) * | 1975-02-13 | 1976-12-07 | Armco Steel Corporation | Recursive interpolation |
| JPS5596745A (en) * | 1979-01-17 | 1980-07-23 | Nec Corp | Signal discrimination unit |
| US4402012A (en) * | 1981-11-16 | 1983-08-30 | General Electric Company | Two-dimensional digital linear interpolation system |
| JPS59157811A (ja) * | 1983-02-25 | 1984-09-07 | Nec Corp | デ−タ補間回路 |
| US4803684A (en) * | 1984-02-07 | 1989-02-07 | Canon Kabushiki Kaisha | Apparatus for data error correction using rounding technique |
| US4763293A (en) * | 1984-02-27 | 1988-08-09 | Canon Kabushiki Kaisha | Data processing device for interpolation |
| US4837722A (en) * | 1986-05-14 | 1989-06-06 | Massachusetts Institute Of Technology | Digital high speed 3-dimensional interpolation machine |
-
1987
- 1987-10-27 JP JP27228587A patent/JP2637438B2/ja not_active Expired - Lifetime
-
1988
- 1988-10-21 US US07/260,571 patent/US4975866A/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01114180A (ja) | 1989-05-02 |
| US4975866A (en) | 1990-12-04 |
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