JP2612688B2 - 情報記録再生方式 - Google Patents
情報記録再生方式Info
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- JP2612688B2 JP2612688B2 JP60228431A JP22843185A JP2612688B2 JP 2612688 B2 JP2612688 B2 JP 2612688B2 JP 60228431 A JP60228431 A JP 60228431A JP 22843185 A JP22843185 A JP 22843185A JP 2612688 B2 JP2612688 B2 JP 2612688B2
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は光ディスク等の記録媒体にディジタルデータ
信号を記録再生する情報記録再生方式に関する。
信号を記録再生する情報記録再生方式に関する。
本発明は、アドレス情報を含むIDフィールドと、所定
のデータ情報に対して訂正のためのパリティ符号を付加
して構成したデータフィールドとによってセクタを構成
し、 前記データフィールドのデータ情報を、相互に独立し
た積符号を構成する複数のプレーンに分割し、当該プレ
ーンにおいて、第１の方向に第１符号を形成し、当該第
１の方向と垂直な第２の方向に第２符号を形成し、前記
第１符号と前記第２符号の長さが等しくなる様にメモリ
に記憶し、前記第１の方向の前記パリティ符号を含む前
記データ情報の長さと、前記第２の方向の前記パリティ
符号を含む前記データ情報の長さとが等しいフォーマッ
トで、記録媒体にディジタル信号を記録し、該記録媒体
から該記録情報を再生する情報記録再生方式において、 前記記録媒体に１つの前記セクタの前記データフィー
ルドを構成する前記データ情報を記録する場合、前記メ
モリに記憶されている前記各プレーンの記第１の方向又
は第２の方向に、その１行分又は１列分の偶数番目のデ
ータを前記複数のプレーン全てから読み出して得られた
前記データ情報からなるブロックと、その１行分又は１
列分の奇数番目のデータを前記複数のプレーン全てから
読み出して得られた前記データ情報からなるブロックに
分割し、前記各ブロックの先頭にそれぞれブロックシン
クを付加してフォーマットを形成し、もってバーストエ
ラーに対する訂正能力をより高くしたものである。
のデータ情報に対して訂正のためのパリティ符号を付加
して構成したデータフィールドとによってセクタを構成
し、 前記データフィールドのデータ情報を、相互に独立し
た積符号を構成する複数のプレーンに分割し、当該プレ
ーンにおいて、第１の方向に第１符号を形成し、当該第
１の方向と垂直な第２の方向に第２符号を形成し、前記
第１符号と前記第２符号の長さが等しくなる様にメモリ
に記憶し、前記第１の方向の前記パリティ符号を含む前
記データ情報の長さと、前記第２の方向の前記パリティ
符号を含む前記データ情報の長さとが等しいフォーマッ
トで、記録媒体にディジタル信号を記録し、該記録媒体
から該記録情報を再生する情報記録再生方式において、 前記記録媒体に１つの前記セクタの前記データフィー
ルドを構成する前記データ情報を記録する場合、前記メ
モリに記憶されている前記各プレーンの記第１の方向又
は第２の方向に、その１行分又は１列分の偶数番目のデ
ータを前記複数のプレーン全てから読み出して得られた
前記データ情報からなるブロックと、その１行分又は１
列分の奇数番目のデータを前記複数のプレーン全てから
読み出して得られた前記データ情報からなるブロックに
分割し、前記各ブロックの先頭にそれぞれブロックシン
クを付加してフォーマットを形成し、もってバーストエ
ラーに対する訂正能力をより高くしたものである。
近年ディジタル信号を光ディスク等に記録再生する情
報記録再生装置が普及しつつある。第７図は斯かる情報
記録再生装置のブロック図である。すなわち本体１はホ
ストコンピュータ３により制御され、光ディスク（オプ
ティカルメモリディスク）２に情報を記録再生するよう
になっている。
報記録再生装置が普及しつつある。第７図は斯かる情報
記録再生装置のブロック図である。すなわち本体１はホ
ストコンピュータ３により制御され、光ディスク（オプ
ティカルメモリディスク）２に情報を記録再生するよう
になっている。
ホストコンピュータ３からの指令はスモールコンピュ
ータシステムインターフェースバス（SCSI BUS）を介し
てホストインターフェース（I/F）７に入力され、さら
に種々の装置、手段等を制御するメインコントローラ
４、DMA装置（ダイレクトメモリアクセス装置）６等に
伝達される。メインコントローラ４は種々の装置、手段
等を制御する。またDMA装置６はバッファメモリ５等を
制御し、データをメモリ間同志で直接送受させる。デー
タはインターフェース（I/F）８を介してエラー訂正回
路９に入力され、エラー検出訂正のための符号の付加等
の信号処理がなされた後、変調復調回路10により変調さ
れる。この信号がさらにRF信号処理回路11において処理
された後、光学式ピックアップサーボコントロール回路
12に入力され、光ディスク２に記録される。またデータ
の再生は上記と反対の経路により行われる。
ータシステムインターフェースバス（SCSI BUS）を介し
てホストインターフェース（I/F）７に入力され、さら
に種々の装置、手段等を制御するメインコントローラ
４、DMA装置（ダイレクトメモリアクセス装置）６等に
伝達される。メインコントローラ４は種々の装置、手段
等を制御する。またDMA装置６はバッファメモリ５等を
制御し、データをメモリ間同志で直接送受させる。デー
タはインターフェース（I/F）８を介してエラー訂正回
路９に入力され、エラー検出訂正のための符号の付加等
の信号処理がなされた後、変調復調回路10により変調さ
れる。この信号がさらにRF信号処理回路11において処理
された後、光学式ピックアップサーボコントロール回路
12に入力され、光ディスク２に記録される。またデータ
の再生は上記と反対の経路により行われる。
エラー検出訂正のための符号としては例えば積符号、
隣接符号等が用いられる。第８図は積符号を用いてエラ
ーを検出訂正するときのデータの処理経路を表してい
る。すなわち入力されたデータは第９図に示すように、
先ずk2ディジットの行、K1ディジットの列のマトリック
ス状に配置される。そして符号器21によりそのうちの一
方の方向（図にいては列方向）にm1ディジットの符号を
付加して符号CIを構成し、符号器22により他方の方向
（図においては行方向）にm2ディジットの符号を付加し
て符号C2を構成し、n1×n2（n1＝k1＋m1，n2＝k2＋m2）
ディジットの積符号を構成する。この信号を変調器23に
より変調し、通信路24に伝送する（光ディスク２に記録
する）。
隣接符号等が用いられる。第８図は積符号を用いてエラ
ーを検出訂正するときのデータの処理経路を表してい
る。すなわち入力されたデータは第９図に示すように、
先ずk2ディジットの行、K1ディジットの列のマトリック
ス状に配置される。そして符号器21によりそのうちの一
方の方向（図にいては列方向）にm1ディジットの符号を
付加して符号CIを構成し、符号器22により他方の方向
（図においては行方向）にm2ディジットの符号を付加し
て符号C2を構成し、n1×n2（n1＝k1＋m1，n2＝k2＋m2）
ディジットの積符号を構成する。この信号を変調器23に
より変調し、通信路24に伝送する（光ディスク２に記録
する）。
通信路24からの信号は復調器25により復調された後復
号器26に入力され、先ずC2方向のエラーが訂正される。
その後復調器27によりC1方向のエラー訂正が行われ、図
示せぬ回路等に出力される。
号器26に入力され、先ずC2方向のエラーが訂正される。
その後復調器27によりC1方向のエラー訂正が行われ、図
示せぬ回路等に出力される。
斯かる経路によりエラーの検出訂正を行うためのハー
ドウェアとしての装置は、例えば第10図に示すように構
成される。すなわちC1方向の符号器21、C2方向の符号器
22、C1方向の復号器27、C2方向の復号器26を、各々デー
タバスを介して第７図におけるバッファメモリ５を構成
するメモリ28に接続するとともに、データバスをインタ
ーフェース（I/F）29、入出力（I/O）ポート30を介して
図示せぬ外部の装置に接続することになる。
ドウェアとしての装置は、例えば第10図に示すように構
成される。すなわちC1方向の符号器21、C2方向の符号器
22、C1方向の復号器27、C2方向の復号器26を、各々デー
タバスを介して第７図におけるバッファメモリ５を構成
するメモリ28に接続するとともに、データバスをインタ
ーフェース（I/F）29、入出力（I/O）ポート30を介して
図示せぬ外部の装置に接続することになる。
ところで本出願人は第９図に示す如き積符号を構成す
るプレーンにおいて、その２つの符号C1とC2の長さを等
しくするとともに（n1＝n2、k1＝k2）、そのプレーンの
数を４つにして情報を記録再生することを試みた。すな
わち第11図に示すように、積符号を構成するプレーンを
４つ（a,b,c,d）メモリ28内に設け、ホストコンピュー
タ３より出力される１バイト単位のデータD0、D1、D2等
を先ずプレーンａの第１行目に32バイト順次書き込み、
次にプレーンｂの第１行目に32バイト書き込み、以下同
様にしてプレンｃとプレーンｄの第１行目に書き込み、
それが終了したらプレーンａの第２行目に移行し、以下
同様に書き込みを行った。そして第12図に示すように、
32バイトの行と32バイトの列よりなる1024バイトのマト
リックスを形成し、符号器21、22により各行と各列に各
々２バイトのパリティ（P,Q）を付加した。
るプレーンにおいて、その２つの符号C1とC2の長さを等
しくするとともに（n1＝n2、k1＝k2）、そのプレーンの
数を４つにして情報を記録再生することを試みた。すな
わち第11図に示すように、積符号を構成するプレーンを
４つ（a,b,c,d）メモリ28内に設け、ホストコンピュー
タ３より出力される１バイト単位のデータD0、D1、D2等
を先ずプレーンａの第１行目に32バイト順次書き込み、
次にプレーンｂの第１行目に32バイト書き込み、以下同
様にしてプレンｃとプレーンｄの第１行目に書き込み、
それが終了したらプレーンａの第２行目に移行し、以下
同様に書き込みを行った。そして第12図に示すように、
32バイトの行と32バイトの列よりなる1024バイトのマト
リックスを形成し、符号器21、22により各行と各列に各
々２バイトのパリティ（P,Q）を付加した。
光ディスク２へ記録するときは、第13図に示すよう
に、プレーンａの最初の１バイトのデータD0a、プレー
ンｂの最初の１バイトのデータD0b、プレーンｃの最初
の１バイトのデータD0c、プレーンｄの最初の１バイト
のデータD0dの順に読出し、以下プレーンａの次の１バ
イトのデータD1aに移行し、以下同様にして各プレーン
ａ乃至ｄの第１行目のデータを全部読出したとき、そこ
までのデータを１ブロックとした。そして各ブロックの
先頭に各々１バイトのブロックシンク（BS）を付加し、
第14図に示すようなフォーマットを形成し、これを１セ
クタのデータフィールドに記録した。尚１セクタはアド
レス情報等を含むIDフィールドとこのデータフィールド
とにより構成されている。
に、プレーンａの最初の１バイトのデータD0a、プレー
ンｂの最初の１バイトのデータD0b、プレーンｃの最初
の１バイトのデータD0c、プレーンｄの最初の１バイト
のデータD0dの順に読出し、以下プレーンａの次の１バ
イトのデータD1aに移行し、以下同様にして各プレーン
ａ乃至ｄの第１行目のデータを全部読出したとき、そこ
までのデータを１ブロックとした。そして各ブロックの
先頭に各々１バイトのブロックシンク（BS）を付加し、
第14図に示すようなフォーマットを形成し、これを１セ
クタのデータフィールドに記録した。尚１セクタはアド
レス情報等を含むIDフィールドとこのデータフィールド
とにより構成されている。
このようにして情報を記録すると、各行と各列に各々
２パリティ（P,Q）が記録されているので、各行と各列
において各々１つのエラー訂正が可能である。従ってこ
のフォーマットは第15図に示すように、バーストエラー
に対して１ブロックの訂正能力を有することになる。し
かしながら例えば第16図に示すように、ドロップアウト
がブロックシンク（BS）にまたがって発生し、さらに読
出しクロックのずれによりビットスリップが発生する
と、区間Ａが訂正不能のエラーとなる問題点があった。
２パリティ（P,Q）が記録されているので、各行と各列
において各々１つのエラー訂正が可能である。従ってこ
のフォーマットは第15図に示すように、バーストエラー
に対して１ブロックの訂正能力を有することになる。し
かしながら例えば第16図に示すように、ドロップアウト
がブロックシンク（BS）にまたがって発生し、さらに読
出しクロックのずれによりビットスリップが発生する
と、区間Ａが訂正不能のエラーとなる問題点があった。
本発明の情報記録再生方式を実施する装置の概略は第
７図に示した場合と同様であり、またそのエラー検出訂
正の際のデータの処理経路も第８図に示した場合と同様
である。しかしながらそのエラー検出訂正のための装置
は第２図に示すように構成されている。すなわちデータ
を記憶するメモリ41（第７図におけるバッファメモリ５
に対応する）と、アドレスバスを介してメモリ41に所定
のアドレスを出力するアドレス発生器42と、データバス
を介してメモリ41との間でデータを送受する符号復号器
43とが設けられている。アドレス発生器42はC1方向とC2
方向を訂正する場合に切り換えられるようになってい
る。また符号復号器43は符号器として動作する場合と、
復号器として動作する場合とで切り換えられるようにな
っている。
７図に示した場合と同様であり、またそのエラー検出訂
正の際のデータの処理経路も第８図に示した場合と同様
である。しかしながらそのエラー検出訂正のための装置
は第２図に示すように構成されている。すなわちデータ
を記憶するメモリ41（第７図におけるバッファメモリ５
に対応する）と、アドレスバスを介してメモリ41に所定
のアドレスを出力するアドレス発生器42と、データバス
を介してメモリ41との間でデータを送受する符号復号器
43とが設けられている。アドレス発生器42はC1方向とC2
方向を訂正する場合に切り換えられるようになってい
る。また符号復号器43は符号器として動作する場合と、
復号器として動作する場合とで切り換えられるようにな
っている。
しかしてその作用を説明する。ホストコンピュータ３
から出力されたデータはメモリ41に記憶される。メモリ
41は第３図に示すように、４つの積符号を形成するプレ
ーンａ乃至ｄを有している。そして各々１バイトに単位
のデータD0、D1、D2等は先ずプレーンａの第１行目に32
バイト順次書き込まれ、次にプレーンｂの第１行目に32
バイト書き込まれる。以下同様にしてプレーンｃとプレ
ーンｄの第１行目に書き込みが行われ、それが終了した
らプレーンａの第２行目に移行し、以下同様に書き込み
が行われる。その結果第４図に示すように、各プレーン
ａ乃至ｄにおいて、32バイトの行と32バイトの列よりな
る1024バイトのマトリックスが形成される。
から出力されたデータはメモリ41に記憶される。メモリ
41は第３図に示すように、４つの積符号を形成するプレ
ーンａ乃至ｄを有している。そして各々１バイトに単位
のデータD0、D1、D2等は先ずプレーンａの第１行目に32
バイト順次書き込まれ、次にプレーンｂの第１行目に32
バイト書き込まれる。以下同様にしてプレーンｃとプレ
ーンｄの第１行目に書き込みが行われ、それが終了した
らプレーンａの第２行目に移行し、以下同様に書き込み
が行われる。その結果第４図に示すように、各プレーン
ａ乃至ｄにおいて、32バイトの行と32バイトの列よりな
る1024バイトのマトリックスが形成される。
次にホストコンピュータ３からの制御信号によりアド
レス発生器42が切り換えられ、C1方向（第５図）の符号
を生成するためのアドレスが発生される。すわなち各プ
レーンａ乃至ｄの列の方向のアドレスが発生され、その
アドレスに記憶されているデータが符号復号器43に入力
され、２バイトのパリティ（P,Q）が生成される。そし
てこのパリティ（P,Q）が各プレーンａ乃至ｄの対応す
る列の末端に付加され、メモリ41に記憶される。次にア
ドレス発生器42が切り換えられ、C2方向（第５図）の符
号を生成するためのアドレスが発生される。すなわち各
プレーンａ乃至ｄの行の方向のアドレスが発生され、そ
のアドレスに記憶されているデータが符号復号器43に入
力され、２バイトのパリティ（P,Q）が生成される。そ
してこのパリティ（P,Q）が各プレーンａ乃至ｄの対応
する行の末端に付加され、メモリ41に記憶される。
レス発生器42が切り換えられ、C1方向（第５図）の符号
を生成するためのアドレスが発生される。すわなち各プ
レーンａ乃至ｄの列の方向のアドレスが発生され、その
アドレスに記憶されているデータが符号復号器43に入力
され、２バイトのパリティ（P,Q）が生成される。そし
てこのパリティ（P,Q）が各プレーンａ乃至ｄの対応す
る列の末端に付加され、メモリ41に記憶される。次にア
ドレス発生器42が切り換えられ、C2方向（第５図）の符
号を生成するためのアドレスが発生される。すなわち各
プレーンａ乃至ｄの行の方向のアドレスが発生され、そ
のアドレスに記憶されているデータが符号復号器43に入
力され、２バイトのパリティ（P,Q）が生成される。そ
してこのパリティ（P,Q）が各プレーンａ乃至ｄの対応
する行の末端に付加され、メモリ41に記憶される。
このように各プレーンａ乃至ｄにおいて、２つの符号
C1とC2の長さが等しくなるようにしたので、２つの方向
の符号器としての符号復号器43を１つのもので兼用する
ことができる。
C1とC2の長さが等しくなるようにしたので、２つの方向
の符号器としての符号復号器43を１つのもので兼用する
ことができる。
次に斯かるメモリ41に記憶したデータを光ディスク２
へ記憶するときは、第６図に示すように、各プレーンａ
乃至ｄから、最初の偶数番目の１バイトのデータD0a、D
0b、D0c、D0dが順次読み出される。次に１バイト飛び越
して、次の偶数番目の１バイトのデータD2a、D2b、D
2c、D2dが順次読み出される。以下同様にして各プレー
ンａ乃至ｄの第１行目の偶数番目のデータ（パリティを
含む）を全部読出したとき、そこまでのデータが１ブロ
ックとされる。次に同様にして各プレーンａ乃至ｄの第
１行目の奇数番目のデータ（パリティを含む）を全部読
出したとき、そこまでのデータが１ブロックとされる。
第２行目以下の各行についても同様の動作処理が行われ
る。そして各ブロックの先頭に各々１バイトよりなるブ
ロックシンク（BS）が付加される。その結果第１図に示
すようなフォーマットが形成される。このフォーマット
に示されるデータを、アドレス情報等を含むIDフィール
ドとともに１セクタを構成するデータフィールドに記録
する。
へ記憶するときは、第６図に示すように、各プレーンａ
乃至ｄから、最初の偶数番目の１バイトのデータD0a、D
0b、D0c、D0dが順次読み出される。次に１バイト飛び越
して、次の偶数番目の１バイトのデータD2a、D2b、D
2c、D2dが順次読み出される。以下同様にして各プレー
ンａ乃至ｄの第１行目の偶数番目のデータ（パリティを
含む）を全部読出したとき、そこまでのデータが１ブロ
ックとされる。次に同様にして各プレーンａ乃至ｄの第
１行目の奇数番目のデータ（パリティを含む）を全部読
出したとき、そこまでのデータが１ブロックとされる。
第２行目以下の各行についても同様の動作処理が行われ
る。そして各ブロックの先頭に各々１バイトよりなるブ
ロックシンク（BS）が付加される。その結果第１図に示
すようなフォーマットが形成される。このフォーマット
に示されるデータを、アドレス情報等を含むIDフィール
ドとともに１セクタを構成するデータフィールドに記録
する。
第１図より明らかな如く、このフォーマットにおいて
は、ブロックシンクを除くと、各列の長さと各行の長さ
が等しく（68バイト）形成されている。従ってバースト
エラーの訂正能力は２ブロックになり、前述したような
ブロックシンクにまたがって２ブロックにドロップアウ
トが発生し、ビットスリップが発生しても、そのエラー
を訂正することができる。
は、ブロックシンクを除くと、各列の長さと各行の長さ
が等しく（68バイト）形成されている。従ってバースト
エラーの訂正能力は２ブロックになり、前述したような
ブロックシンクにまたがって２ブロックにドロップアウ
トが発生し、ビットスリップが発生しても、そのエラー
を訂正することができる。
復号の際は符号復号器43が復号器として動作するよう
に切り換えられる他、前述した場合と同様の動作が行わ
れる。
に切り換えられる他、前述した場合と同様の動作が行わ
れる。
尚データを変調する方式として例えばMFM方式（Modif
ied FM方式）を採用する場合、MFM方式において現出し
ない（イレギュラの）パターンを形成し、これをブロッ
クシンクとすることもできる。
ied FM方式）を採用する場合、MFM方式において現出し
ない（イレギュラの）パターンを形成し、これをブロッ
クシンクとすることもできる。
本発明によれば、アドレス情報を含むIDフィールド
と、所定のデータ情報に対して訂正のためのパリティ符
号を付加して構成したデータフィールドとによってセク
タを構成し、 前記データフィールドのデータ情報を、相互に独立し
た積符号を構成する複数のプレーンに分割し、当該プレ
ーンにおいて、第１の方向に第１符号を形成し、当該第
１の方向と垂直な第２の方向に第２符号を形成し、前記
第１符号と前記第２符号の長さが等しくなる様にメモリ
に記憶し、前記第１の方向の前記パリティ符号を含む前
記データ情報の長さと、前記第２の方向の前記パリティ
符号を含む前記データ情報の長さとが等しいフォーマッ
トで、記録媒体にディジタル信号を記録し、該記録媒体
から該記録情報を再生する情報記録再生方式において、 前記記録媒体に１つの前記セクタの前記データフィー
ルドを構成する前記データ情報を記録する場合、前記メ
モリに記憶されている前記各プレーンの記第１の方向又
は第２の方向に、その１行分又は１列分の偶数番目のデ
ータを前記複数のプレーン全てから読み出して得られた
前記データ情報からなるブロックと、その１行分又は１
列分の奇数番目のデータを前記複数のプレーン全てから
読み出して得られた前記データ情報からなるブロックに
分割し、前記各ブロックの先頭にそれぞれブロックシン
クを付加してフォーマットを形成を形成するので、バー
ストエラーに対する訂正能力をより高くすることができ
る。また２つの訂正方向の符号器、復号器を１つのもの
で兼用することが可能になる。
と、所定のデータ情報に対して訂正のためのパリティ符
号を付加して構成したデータフィールドとによってセク
タを構成し、 前記データフィールドのデータ情報を、相互に独立し
た積符号を構成する複数のプレーンに分割し、当該プレ
ーンにおいて、第１の方向に第１符号を形成し、当該第
１の方向と垂直な第２の方向に第２符号を形成し、前記
第１符号と前記第２符号の長さが等しくなる様にメモリ
に記憶し、前記第１の方向の前記パリティ符号を含む前
記データ情報の長さと、前記第２の方向の前記パリティ
符号を含む前記データ情報の長さとが等しいフォーマッ
トで、記録媒体にディジタル信号を記録し、該記録媒体
から該記録情報を再生する情報記録再生方式において、 前記記録媒体に１つの前記セクタの前記データフィー
ルドを構成する前記データ情報を記録する場合、前記メ
モリに記憶されている前記各プレーンの記第１の方向又
は第２の方向に、その１行分又は１列分の偶数番目のデ
ータを前記複数のプレーン全てから読み出して得られた
前記データ情報からなるブロックと、その１行分又は１
列分の奇数番目のデータを前記複数のプレーン全てから
読み出して得られた前記データ情報からなるブロックに
分割し、前記各ブロックの先頭にそれぞれブロックシン
クを付加してフォーマットを形成を形成するので、バー
ストエラーに対する訂正能力をより高くすることができ
る。また２つの訂正方向の符号器、復号器を１つのもの
で兼用することが可能になる。
第１図は本発明の情報記録再生方式のフォーマットの説
明図、第２図はそのエラー検出訂正の装置のブロック
図、第３図乃至第６図はそのプレーンの模式的説明図、
第７図は従来の情報記録再生装置の全体のブロック図、
第８図はそのエラー検出訂正の際のデータの処理経路を
表すブロック図、第９図はその積符号を形成するプレー
ンの説明図、第10図はそのエラー検出訂正の装置のブロ
ック図、第11図乃至第13図はそのプレーンの模式的説明
図、第14図乃至第16図はそのフォーマットの説明図であ
る。 １……本体、２……光ディスク ３……ホストコンピュータ ４……メインコントローラ ５……バッファメモリ、６……DMA装置 ７……ホストインターフェース ８……インターフェース ９……エラー訂正回路 10……変調復調回路 11……RF信号処理回路 12……光学式ピックアップサーボコントール回路 21、22……符号器、23……変調器 24……通信路、25……復調器 26、27……復号器、28……メモリ 29……インターフェース 30……入出力ポート、41……メモリ 42……アドレス発生器 43……符号復号器
明図、第２図はそのエラー検出訂正の装置のブロック
図、第３図乃至第６図はそのプレーンの模式的説明図、
第７図は従来の情報記録再生装置の全体のブロック図、
第８図はそのエラー検出訂正の際のデータの処理経路を
表すブロック図、第９図はその積符号を形成するプレー
ンの説明図、第10図はそのエラー検出訂正の装置のブロ
ック図、第11図乃至第13図はそのプレーンの模式的説明
図、第14図乃至第16図はそのフォーマットの説明図であ
る。 １……本体、２……光ディスク ３……ホストコンピュータ ４……メインコントローラ ５……バッファメモリ、６……DMA装置 ７……ホストインターフェース ８……インターフェース ９……エラー訂正回路 10……変調復調回路 11……RF信号処理回路 12……光学式ピックアップサーボコントール回路 21、22……符号器、23……変調器 24……通信路、25……復調器 26、27……復号器、28……メモリ 29……インターフェース 30……入出力ポート、41……メモリ 42……アドレス発生器 43……符号復号器
Claims (1)
- 【請求項１】アドレス情報を含むIDフィールドと、所定
のデータ情報に対して訂正のためのパリティ符号を付加
して構成したデータフィールドとによってセクタを構成
し、 前記データフィールドのデータ情報を、相互に独立した
積符号を構成する複数のプレーンに分割し、当該プレー
ンにおいて、第１の方向に第１符号を形成し、当該第１
の方向と垂直な第２の方向に第２符号を形成し、前記第
１符号と前記第２符号の長さが等しくなる様にメモリに
記憶し、前記第１の方向の前記パリティ符号を含む前記
データ情報の長さと、前記第２の方向の前記パリティ符
号を含む前記データ情報の長さとが等しいフォーマット
で、記録媒体にディジタル信号を記録し、該記録媒体か
ら該記録情報を再生する情報記録再生方式において、 前記記録媒体に１つの前記セクタの前記データフィール
ドを構成する前記データ情報を記録する場合、前記メモ
リに記憶されている前記各プレーンの記第１の方向又は
第２の方向に、その１行分又は１列分の偶数番目のデー
タを前記複数のプレーン全てから読み出して得られた前
記データ情報からなるブロックと、その１行分または１
列分の奇数番目のデータを前記複数のプレーン全てから
読み出して得られた前記データ情報からなるブロックに
分割し、前記各ブロックの先頭にそれぞれブロックシン
クを付加してフォーマットを形成することを特徴とする
情報記録再生方式
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60228431A JP2612688B2 (ja) | 1985-10-14 | 1985-10-14 | 情報記録再生方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60228431A JP2612688B2 (ja) | 1985-10-14 | 1985-10-14 | 情報記録再生方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6288172A JPS6288172A (ja) | 1987-04-22 |
| JP2612688B2 true JP2612688B2 (ja) | 1997-05-21 |
Family
ID=16876375
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60228431A Expired - Lifetime JP2612688B2 (ja) | 1985-10-14 | 1985-10-14 | 情報記録再生方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2612688B2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60160068A (ja) * | 1984-01-31 | 1985-08-21 | Toshiba Corp | 記録方法 |
-
1985
- 1985-10-14 JP JP60228431A patent/JP2612688B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6288172A (ja) | 1987-04-22 |
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