JP2560883B2 - 活線挿抜構造 - Google Patents
活線挿抜構造Info
- Publication number
- JP2560883B2 JP2560883B2 JP2082165A JP8216590A JP2560883B2 JP 2560883 B2 JP2560883 B2 JP 2560883B2 JP 2082165 A JP2082165 A JP 2082165A JP 8216590 A JP8216590 A JP 8216590A JP 2560883 B2 JP2560883 B2 JP 2560883B2
- Authority
- JP
- Japan
- Prior art keywords
- package
- electronic circuit
- hot
- cage
- power supply
- Prior art date
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- Expired - Lifetime
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- Coupling Device And Connection With Printed Circuit (AREA)
- Details Of Connecting Devices For Male And Female Coupling (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明はパッケージの活線挿抜構造に関する。
従来、この種のパッケージの活線挿抜構造は第３図の
ように、電源供給状態すなわち活線状態においてケージ
30のコネクタ31にパッケージ32を挿抜する際に急激な電
圧変動を防ぐため、パッケージ32のコネクタ33とパッケ
ージ32に実装した電子回路34との間にインダクタンス35
が設けられていた。また、レール36,レール37はパッケ
ージ32をケージ30内に実装するものである。
ように、電源供給状態すなわち活線状態においてケージ
30のコネクタ31にパッケージ32を挿抜する際に急激な電
圧変動を防ぐため、パッケージ32のコネクタ33とパッケ
ージ32に実装した電子回路34との間にインダクタンス35
が設けられていた。また、レール36,レール37はパッケ
ージ32をケージ30内に実装するものである。
上述した従来の活線挿抜構造は、パッケージ32内の電
子回路30の消費電流が比較的小さいときは電源からコネ
クタ33、インダクタンス35を通して電子回路30へ流れ込
む電流も小さく、したがって、電源における電圧変化も
小さかった。しかし、電子回路の消費電流が大きくなる
と、電子回路へ流れ込む電流が大きくなり、このため、
電源における電圧変動が大きくなり、これを小さくする
ためにはインダクタンス35の値が大きくなり、パッケー
ジ32の物理寸法も大きくなるという欠点があった。
子回路30の消費電流が比較的小さいときは電源からコネ
クタ33、インダクタンス35を通して電子回路30へ流れ込
む電流も小さく、したがって、電源における電圧変化も
小さかった。しかし、電子回路の消費電流が大きくなる
と、電子回路へ流れ込む電流が大きくなり、このため、
電源における電圧変動が大きくなり、これを小さくする
ためにはインダクタンス35の値が大きくなり、パッケー
ジ32の物理寸法も大きくなるという欠点があった。
本発明の目的は前記課題を解決した活線挿抜構造を提
供することにある。
供することにある。
前記目的を達成するため、本発明に係る活線挿抜構造
は、パッケージと、該パッケージが挿抜されるケージと
を含み、前記パッケージに実装された電子回路と前記ケ
ージから前記電子回路に供給される電源との間の接続ま
たは切断のいずれか一方を活線状態で行う活線挿抜構造
であって、 前記ケージは、前記パッケージを実装するレールに設
けられるとともに前記電源と接続された帯状の電極を含
み、 前記パッケージは、前記パッケージにおいて挿抜方向
と平行な縁に設けられた複数の接続端子と、この複数の
接続端子毎にインダクタンスを介して前記複数の接続端
子と前記電子回路とを接続する複数の第１のパスと、前
記電子回路と前記電源とを直接接続する第２のパスとを
含むものである。
は、パッケージと、該パッケージが挿抜されるケージと
を含み、前記パッケージに実装された電子回路と前記ケ
ージから前記電子回路に供給される電源との間の接続ま
たは切断のいずれか一方を活線状態で行う活線挿抜構造
であって、 前記ケージは、前記パッケージを実装するレールに設
けられるとともに前記電源と接続された帯状の電極を含
み、 前記パッケージは、前記パッケージにおいて挿抜方向
と平行な縁に設けられた複数の接続端子と、この複数の
接続端子毎にインダクタンスを介して前記複数の接続端
子と前記電子回路とを接続する複数の第１のパスと、前
記電子回路と前記電源とを直接接続する第２のパスとを
含むものである。
また本発明に係る活線挿抜構造は、パッケージと、該
パッケージが挿抜されるケージとを含み、前記パッケー
ジに実装された電子回路と前記ケージから前記電子回路
に供給される電源との間の接続または切断のいずれか一
方を活線状態で行う活線挿抜構造であって、 前記ケージは、前記パッケージを実装するレールに設
けられるとともに前記電源と接続された帯状の電極を含
み、 前記パッケージは、前記パッケージにおいて挿抜方向
と平行な縁に設けられた複数の接続端子と、この複数の
接続端子毎に段階的に電圧降下率を変化させて設定され
たダイオードを介して前記複数の接続端子と前記電子回
路とを接続する複数の第１のパスと、前記電子回路と前
記電源とを直接接続する第２のパスとを含むものであ
る。
パッケージが挿抜されるケージとを含み、前記パッケー
ジに実装された電子回路と前記ケージから前記電子回路
に供給される電源との間の接続または切断のいずれか一
方を活線状態で行う活線挿抜構造であって、 前記ケージは、前記パッケージを実装するレールに設
けられるとともに前記電源と接続された帯状の電極を含
み、 前記パッケージは、前記パッケージにおいて挿抜方向
と平行な縁に設けられた複数の接続端子と、この複数の
接続端子毎に段階的に電圧降下率を変化させて設定され
たダイオードを介して前記複数の接続端子と前記電子回
路とを接続する複数の第１のパスと、前記電子回路と前
記電源とを直接接続する第２のパスとを含むものであ
る。
以下、本発明の実施例を図により説明する。
（実施例１） 第１図は本発明の実施例１を示す構成図である。
図において、本発明に係るパッケージの活線挿抜構造
は、実装部１と、突入電流制限回路４と、第１及び第２
のコネクタ5,6とを有し、パッケージ２に実装された電
子回路３の電源Vccに対する接続及び切離しを活線状態
で行うものである。
は、実装部１と、突入電流制限回路４と、第１及び第２
のコネクタ5,6とを有し、パッケージ２に実装された電
子回路３の電源Vccに対する接続及び切離しを活線状態
で行うものである。
前記実装部１は、ケージ1aと、ケージ1a内に平行に敷
設されたレール1b,1bと、レール1bの内方終端位置に設
けられた信号線接続用のコネクタ1cとからなり、レール
1b,1bにパッケージ２の上下縁を嵌合保持してパッケー
ジ２を挿抜可能に実装するものである。
設されたレール1b,1bと、レール1bの内方終端位置に設
けられた信号線接続用のコネクタ1cとからなり、レール
1b,1bにパッケージ２の上下縁を嵌合保持してパッケー
ジ２を挿抜可能に実装するものである。
前記パッケージ２は挿入前端に、コネクタ1cに接続さ
れる信号線接続用のコネクタ2aを備えている。
れる信号線接続用のコネクタ2aを備えている。
前記突入電流制限回路４は、電子回路３の電源入力端
子部に設けられており、インダクタンス41,42…4nをも
つ複数のパスP1,P2…Pnを並列に備えており、各パスP1,
P2…Pnの電源接続端子4a,4a…がパッケージ２の上縁2b
上に挿入方向に沿って一列に配列されている。
子部に設けられており、インダクタンス41,42…4nをも
つ複数のパスP1,P2…Pnを並列に備えており、各パスP1,
P2…Pnの電源接続端子4a,4a…がパッケージ２の上縁2b
上に挿入方向に沿って一列に配列されている。
前記第１のコネクタ５は電子回路３を電源Vccにイン
ダクタンスをもつパスを介して接続するものである。実
施例での第１のコネクタは、ケージ1a内に敷設した一方
のレール1aを帯状の電極として用い、パッケージ２の挿
入量に対応して電極としてのレール1aに、インダクタン
ス41,42…4nをもつ各パスP1,P2…Pnの電源接続端子4aを
段階的に接続し、電源Vccと電子回路３の電源入力端子
部との間に、パスP1,P2…Pnにより複数のインダクタン
ス41,42…4nを並列に段階的に増加させて接続する。
ダクタンスをもつパスを介して接続するものである。実
施例での第１のコネクタは、ケージ1a内に敷設した一方
のレール1aを帯状の電極として用い、パッケージ２の挿
入量に対応して電極としてのレール1aに、インダクタン
ス41,42…4nをもつ各パスP1,P2…Pnの電源接続端子4aを
段階的に接続し、電源Vccと電子回路３の電源入力端子
部との間に、パスP1,P2…Pnにより複数のインダクタン
ス41,42…4nを並列に段階的に増加させて接続する。
前記第２のコネクタ６は、並列に配列した最終段のイ
ンダクタンス4nをもつパスPnに並列に配列した零抵抗パ
ス6aを備えているとともに、パス6aの電源接続端子6bを
最終段の電源接続端子4aの後段に設けており、パッケー
ジ２が実装部１内に完全に挿入されたときにパス6aの電
源接続端子6bを電極としてのレール1aに接触させて電子
回路３に電源Vccをインダクタンスを介さずに直接接続
する。
ンダクタンス4nをもつパスPnに並列に配列した零抵抗パ
ス6aを備えているとともに、パス6aの電源接続端子6bを
最終段の電源接続端子4aの後段に設けており、パッケー
ジ２が実装部１内に完全に挿入されたときにパス6aの電
源接続端子6bを電極としてのレール1aに接触させて電子
回路３に電源Vccをインダクタンスを介さずに直接接続
する。
すなわち、第１のコネクタ５と第２のコネクタ６と
は、電子回路３に時間差をもって、接続，切離しされる
機能を備えており、第１のコネクタ５は、実装部１への
パッケージ２の挿入量に対応して突入電流制限回路４の
インダクタンス41〜4nをもつパスP1〜Pnに段階的に接続
されるものであり、第２のコネクタ６は、実装部１への
パッケージ２の挿入完了時に電子回路３に接続されるも
のである。
は、電子回路３に時間差をもって、接続，切離しされる
機能を備えており、第１のコネクタ５は、実装部１への
パッケージ２の挿入量に対応して突入電流制限回路４の
インダクタンス41〜4nをもつパスP1〜Pnに段階的に接続
されるものであり、第２のコネクタ６は、実装部１への
パッケージ２の挿入完了時に電子回路３に接続されるも
のである。
また、パッケージ２の下縁2cを導体で構成し、電子回
路３のグランド端子をケージ1a内の下縁レール1bを介し
て電源Vccのグランド端子に接続する。
路３のグランド端子をケージ1a内の下縁レール1bを介し
て電源Vccのグランド端子に接続する。
実施例において、パッケージ２を実装部１に挿入する
と、第１のコネクタ５は、まず１番目のインダクタンス
41をもつパスP1を介して電子回路３を電源Vccに接続す
る。さらにパッケージ２を実装部１に挿入すると、第１
のコネクタ５は段階的にインダクタンス42,43…4nをも
つパスP2,P3…Pnを介して電子回路３を電源Vccに接続
し、それにより電子回路３と電源Vccとの間に並列に接
続されるインダクタンス41〜4nの数が多くなり、より大
きな電源電圧は電子回路３に供給されて定常状態に移行
する。パッケージ２が完全に挿入されたときに第２のコ
ネクタ６が零抵抗パス6aを介して電子回路３と電源Vcc
とがインダクタンスを介さずに直接接続され必要な電源
電圧が供給されることとなる。その後、信号線用コネク
タ2a,1c同士が接続されて、電子回路３の信号端子が信
号線に接続される。
と、第１のコネクタ５は、まず１番目のインダクタンス
41をもつパスP1を介して電子回路３を電源Vccに接続す
る。さらにパッケージ２を実装部１に挿入すると、第１
のコネクタ５は段階的にインダクタンス42,43…4nをも
つパスP2,P3…Pnを介して電子回路３を電源Vccに接続
し、それにより電子回路３と電源Vccとの間に並列に接
続されるインダクタンス41〜4nの数が多くなり、より大
きな電源電圧は電子回路３に供給されて定常状態に移行
する。パッケージ２が完全に挿入されたときに第２のコ
ネクタ６が零抵抗パス6aを介して電子回路３と電源Vcc
とがインダクタンスを介さずに直接接続され必要な電源
電圧が供給されることとなる。その後、信号線用コネク
タ2a,1c同士が接続されて、電子回路３の信号端子が信
号線に接続される。
（実施例２） 第２図は本発明の実施例２を示す構成図である。
本実施例は突入電流制限回路４をダイオードにより構
成したものである。すなわち、突入電流制限回路４は、
電圧降下率が異なるダイオードD1〜Dnをもつ複数のパス
P1〜Pnの並列に備えている。
成したものである。すなわち、突入電流制限回路４は、
電圧降下率が異なるダイオードD1〜Dnをもつ複数のパス
P1〜Pnの並列に備えている。
本実施例によれば、第１のコネクタ５はパッケージ２
の挿入量に応じて電圧降下率が異なるダイオードD1〜Dn
をもつパスP1〜Pnに段階的に接続し、ダイオードを介し
て電子回路３に電源電圧を供給する。
の挿入量に応じて電圧降下率が異なるダイオードD1〜Dn
をもつパスP1〜Pnに段階的に接続し、ダイオードを介し
て電子回路３に電源電圧を供給する。
以上説明したように本発明はパッケージの挿抜具合に
応じてパッケージ内の電子回路に供給される供給電圧を
調整するため、急激な電圧変動を防止することができ
る。また供給電圧の調整は、並列接続のインダクタンス
あるいはダイオードにより行うため、個々のインダクタ
ンスはダイオードの容量を大きくする必要がなく、イン
ダクタンス，ダイオードの物理的寸法を小さく抑えてパ
ッケージの大型化を防止できる効果を有する。
応じてパッケージ内の電子回路に供給される供給電圧を
調整するため、急激な電圧変動を防止することができ
る。また供給電圧の調整は、並列接続のインダクタンス
あるいはダイオードにより行うため、個々のインダクタ
ンスはダイオードの容量を大きくする必要がなく、イン
ダクタンス，ダイオードの物理的寸法を小さく抑えてパ
ッケージの大型化を防止できる効果を有する。
第１図は本発明の実施例１を示す構成図、第２図は本発
明の実施例２を示す構成図、第３図は従来例を示す構成
図である。 １……実装部、２……パッケージ ３……電子回路、４……突入電流制限回路 41〜4n……インダクタンス、D1〜Dn……ダイオード P1〜Pn……パス、５……第１のコネクタ ６……第２のコネクタ、Vcc……電源
明の実施例２を示す構成図、第３図は従来例を示す構成
図である。 １……実装部、２……パッケージ ３……電子回路、４……突入電流制限回路 41〜4n……インダクタンス、D1〜Dn……ダイオード P1〜Pn……パス、５……第１のコネクタ ６……第２のコネクタ、Vcc……電源
Claims (2)
- 【請求項１】パッケージと、該パッケージが挿抜される
ケージとを含み、前記パッケージに実装された電子回路
と前記ケージから前記電子回路に供給される電源との間
の接続または切断のいずれか一方を活線状態で行う活線
挿抜構造であって、 前記ケージは、前記パッケージを実装するレールに設け
られるとともに前記電源と接続された帯状の電極を含
み、 前記パッケージは、前記パッケージにおいて挿抜方向と
平行な縁に設けられた複数の接続端子と、この複数の接
続端子毎にインダクタンスを介して前記複数の接続端子
と前記電子回路とを接続する複数の第１のパスと、前記
電子回路と前記電源とを直接接続する第２のパスとを含
むことを特徴とする活線挿抜構造。 - 【請求項２】パッケージと、該パッケージが挿抜される
ケージとを含み、前記パッケージに実装された電子回路
と前記ケージから前記電子回路に供給される電源との間
の接続または切断のいずれか一方を活線状態で行う活線
挿抜構造であって、 前記ケージは、前記パッケージを実装するレールに設け
られるとともに前記電源と接続された帯状の電極を含
み、 前記パッケージは、前記パッケージにおいて挿抜方向と
平行な縁に設けられた複数の接続端子と、この複数の接
続端子毎に段階的に電圧降下率を変化させて設定された
ダイオードを介して前記複数の接続端子と前記電子回路
とを接続する複数の第１のパスと、前記電子回路と前記
電源とを直接接続する第２のパスとを含むことを特徴と
する活線挿抜構造。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2082165A JP2560883B2 (ja) | 1990-03-29 | 1990-03-29 | 活線挿抜構造 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2082165A JP2560883B2 (ja) | 1990-03-29 | 1990-03-29 | 活線挿抜構造 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03283279A JPH03283279A (ja) | 1991-12-13 |
| JP2560883B2 true JP2560883B2 (ja) | 1996-12-04 |
Family
ID=13766818
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2082165A Expired - Lifetime JP2560883B2 (ja) | 1990-03-29 | 1990-03-29 | 活線挿抜構造 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2560883B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP6491344B2 (ja) | 2015-09-17 | 2019-03-27 | 富士通フロンテック株式会社 | 紙葉類取扱装置及び紙葉類取扱装置の制御方法 |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS515656U (ja) * | 1974-06-28 | 1976-01-16 | ||
| JPS51108519A (ja) * | 1975-03-19 | 1976-09-25 | Hitachi Ltd | Katsusensobatsukanona puraguin patsukeeji |
-
1990
- 1990-03-29 JP JP2082165A patent/JP2560883B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH03283279A (ja) | 1991-12-13 |
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