JP2546843Y2 - スイッチング電源 - Google Patents
スイッチング電源Info
- Publication number
- JP2546843Y2 JP2546843Y2 JP1995003400U JP340095U JP2546843Y2 JP 2546843 Y2 JP2546843 Y2 JP 2546843Y2 JP 1995003400 U JP1995003400 U JP 1995003400U JP 340095 U JP340095 U JP 340095U JP 2546843 Y2 JP2546843 Y2 JP 2546843Y2
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- JP
- Japan
- Prior art keywords
- voltage
- capacitor
- semiconductor switching
- switching element
- scr1
- Prior art date
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Description
【０００１】
【考案の属する分野の説明】本考案はスイッチング電源
の保護回路に関するものである。
の保護回路に関するものである。
【０００２】
【従来技術】従来の回路を図１、その動作波形を図２に
示す。図１において、Ｄ１は入力整流用ダイオ−ドブリ
ッジ、ＳＣＲ１はサイリスタ又はトライアック、Ｒ１は
電流制限抵抗、Ｃ１は入力平滑コンデンサであり、Ｖｉ
ｎは入力電圧、Ｉｉｎは入力電流である。ＳＣＲ１のゲ
−トトリガ信号はスイッチングレギュレ−タの出力ト
（２）ランスＴ1から供給する。図２は第１図の動作波
形であり、Ｖｉｎは入力電圧、Ｖc1はＣ１の端子間電
圧、Ｉｉｎは入力電流を示す。
示す。図１において、Ｄ１は入力整流用ダイオ−ドブリ
ッジ、ＳＣＲ１はサイリスタ又はトライアック、Ｒ１は
電流制限抵抗、Ｃ１は入力平滑コンデンサであり、Ｖｉ
ｎは入力電圧、Ｉｉｎは入力電流である。ＳＣＲ１のゲ
−トトリガ信号はスイッチングレギュレ−タの出力ト
（２）ランスＴ1から供給する。図２は第１図の動作波
形であり、Ｖｉｎは入力電圧、Ｖc1はＣ１の端子間電
圧、Ｉｉｎは入力電流を示す。
【０００３】図１において、入力電圧が印加されるとＣ
１はまずＤ１、Ｒ１を通して充電され、Ｉｉｎは図２
（ハ）−（ａ）に示す様に最大値がＲ１で制限される電
流が流れる。スイッチングレギュレ−タが動作するとＴ
１からＳＣＲ１のゲ−トにトリガ信号が供給されＳＣＲ
１がＯＮし、Ｄ１、ＳＣＲ１を通してＣ１が充電される。
１はまずＤ１、Ｒ１を通して充電され、Ｉｉｎは図２
（ハ）−（ａ）に示す様に最大値がＲ１で制限される電
流が流れる。スイッチングレギュレ−タが動作するとＴ
１からＳＣＲ１のゲ−トにトリガ信号が供給されＳＣＲ
１がＯＮし、Ｄ１、ＳＣＲ１を通してＣ１が充電される。
【０００４】
【従来技術の問題点】この回路は図２（イ）のＶｉｎに
示すような入力電圧に瞬断が生じ、図２(ロ)に示すＶc1
がスイッチングレギュレ−タの動作可能限界である電圧
まで下がり、そこで入力電圧Ｖｉｎが復帰した場合、Ｓ
ＣＲ１のゲ−トトリガ信号は供給されたままなので、Ｉ
inはＤ１、ＳＣＲ１を通して図２（ハ）−（ｂ）に示す
様な過大電流が流れる欠点があった。さらにＳＣＲ１の
ゲ−トトリガ信号用の巻線ｎＴを設ける必要もある。ま
た入力整流部を共通に持つ複数個のスイッチングレギュ
レ−タを運転する場合には個別にＳＣＲのゲ−トトリガ
信号を取り出しておかないと各々のスイッチングレギュ
レ−タを自由に入、切することができないなどの欠点が
ある。
示すような入力電圧に瞬断が生じ、図２(ロ)に示すＶc1
がスイッチングレギュレ−タの動作可能限界である電圧
まで下がり、そこで入力電圧Ｖｉｎが復帰した場合、Ｓ
ＣＲ１のゲ−トトリガ信号は供給されたままなので、Ｉ
inはＤ１、ＳＣＲ１を通して図２（ハ）−（ｂ）に示す
様な過大電流が流れる欠点があった。さらにＳＣＲ１の
ゲ−トトリガ信号用の巻線ｎＴを設ける必要もある。ま
た入力整流部を共通に持つ複数個のスイッチングレギュ
レ−タを運転する場合には個別にＳＣＲのゲ−トトリガ
信号を取り出しておかないと各々のスイッチングレギュ
レ−タを自由に入、切することができないなどの欠点が
ある。
【０００５】
【考案の目的】本考案は上記の従来回路の欠点を解消す
ると共に入力電流の大きいスイッチング電源に好適な突
入防止回路を提供する。
ると共に入力電流の大きいスイッチング電源に好適な突
入防止回路を提供する。
【０００６】
【課題を解決するための本考案の手段】商用入力電圧Ｖ
inを並列接続された２組の整流用ダイオ−ドＤ1、Ｄ6、
Ｄ7で整流し、一方の整流ダイオ−ドＤ1の出力を平滑用
コンデンサＣ１を介してスイッチング回路Ｑ1、Ｔ1に供
給すると共に、該平滑用コンデンサＣ１の突入電流を制
限するためのサイリスタＳＣＲ１と電流制限Ｒ１の並列
回路を設け、又他方の（３）整流用ダイオ−ドＤ6、Ｄ7
の出力を分圧抵抗Ｒ2、Ｒ3により分圧し、遅延用コンデ
ンサＣ２と共に時限回路を形成し、この時限出力により
サイリスタＳＣＲ１のゲ−トを制御する。
inを並列接続された２組の整流用ダイオ−ドＤ1、Ｄ6、
Ｄ7で整流し、一方の整流ダイオ−ドＤ1の出力を平滑用
コンデンサＣ１を介してスイッチング回路Ｑ1、Ｔ1に供
給すると共に、該平滑用コンデンサＣ１の突入電流を制
限するためのサイリスタＳＣＲ１と電流制限Ｒ１の並列
回路を設け、又他方の（３）整流用ダイオ−ドＤ6、Ｄ7
の出力を分圧抵抗Ｒ2、Ｒ3により分圧し、遅延用コンデ
ンサＣ２と共に時限回路を形成し、この時限出力により
サイリスタＳＣＲ１のゲ−トを制御する。
【０００７】
【実施例】図３は本考案の一実施例回路図、図４はその
各部動作波形図で従来例と同一符号は同等部分を示す。
図中Ｄ１は整流用ブリッジダイオ−ド、Ｃ１は前記ダイ
オ−ドＤ１の出力脈流電圧を平滑するコンデンサ、ＳＣ
Ｒ１はサイリスタ又はトライアック、Ｒ１は突入電流制
限抵抗、Ｄ６、Ｄ７は前記ダイオ−ドＤ１と並列接続さ
れた整流用ダイオ−ドで、その脈流出力電圧は分圧抵抗
Ｒ２、Ｒ３により分割される。Ｃ２は遅延用コンデンサ
で前記抵抗Ｒ３に並列接続され、前記抵抗Ｒ2、Ｒ3と共に
サイリスタＳＣＲ１のゲ−ト遅延用の時限回路を形成す
る。
各部動作波形図で従来例と同一符号は同等部分を示す。
図中Ｄ１は整流用ブリッジダイオ−ド、Ｃ１は前記ダイ
オ−ドＤ１の出力脈流電圧を平滑するコンデンサ、ＳＣ
Ｒ１はサイリスタ又はトライアック、Ｒ１は突入電流制
限抵抗、Ｄ６、Ｄ７は前記ダイオ−ドＤ１と並列接続さ
れた整流用ダイオ−ドで、その脈流出力電圧は分圧抵抗
Ｒ２、Ｒ３により分割される。Ｃ２は遅延用コンデンサ
で前記抵抗Ｒ３に並列接続され、前記抵抗Ｒ2、Ｒ3と共に
サイリスタＳＣＲ１のゲ−ト遅延用の時限回路を形成す
る。
【０００８】次に本回路の動作を説明すると、図４で時
間ｔ＝ｔ1の時入力電圧Ｖinが印加されるとＩinはＣ１
の充電電荷がないのでＲ１で制限される図４（ニ）−
（ａ）の様な電流が流れる。ＳＣＲ１のゲ−ト電圧は図
４（ハ）のＶG1に示す様に入力電圧Ｖin、印加後数サイ
クルしてからＯＮ電圧に達する様Ｒ２、Ｒ３とＣ１の定
数が選ばれているので、入力電圧印加時ＳＣＲ１はＯＮ
せずＲ１を通してＣ１が充分充電され数サイクル後にＳ
ＣＲ１は導通する。以降はＳＣＲ１のゲ−トには整流ダ
イオ−ドＤ６、Ｄ７の脈流電圧が加わるので半周期毎に
ＯＮ状態を繰り返す。次に時間ｔがｔ2からｔ3の間、入
力電圧が瞬断するとＣ１の電圧ＶC1は図４（ロ）の様に
低下するがＳＣＲ１のゲ−ト電圧ＶG1も同様に低下し図
４（ハ）、ｔ＝ｔ3で入力電圧が復帰しても直ぐＳＣＲ
１はＯＮしない。従ってこの時のＣ１の充電々流はＲ１
を通して流れ、図４（ニ）の入力電流Ｉinは（ｂ′）の
ようにピ−ク値を小さく押えることができる。
間ｔ＝ｔ1の時入力電圧Ｖinが印加されるとＩinはＣ１
の充電電荷がないのでＲ１で制限される図４（ニ）−
（ａ）の様な電流が流れる。ＳＣＲ１のゲ−ト電圧は図
４（ハ）のＶG1に示す様に入力電圧Ｖin、印加後数サイ
クルしてからＯＮ電圧に達する様Ｒ２、Ｒ３とＣ１の定
数が選ばれているので、入力電圧印加時ＳＣＲ１はＯＮ
せずＲ１を通してＣ１が充分充電され数サイクル後にＳ
ＣＲ１は導通する。以降はＳＣＲ１のゲ−トには整流ダ
イオ−ドＤ６、Ｄ７の脈流電圧が加わるので半周期毎に
ＯＮ状態を繰り返す。次に時間ｔがｔ2からｔ3の間、入
力電圧が瞬断するとＣ１の電圧ＶC1は図４（ロ）の様に
低下するがＳＣＲ１のゲ−ト電圧ＶG1も同様に低下し図
４（ハ）、ｔ＝ｔ3で入力電圧が復帰しても直ぐＳＣＲ
１はＯＮしない。従ってこの時のＣ１の充電々流はＲ１
を通して流れ、図４（ニ）の入力電流Ｉinは（ｂ′）の
ようにピ−ク値を小さく押えることができる。
【０００９】又この実施例では整流用ダイオ−ドＤ６、
Ｄ７により、時限回路（Ｒ２、Ｒ３、Ｃ２）の電源部を
整流用ダイオ−ドＤ１の出力と独立して形成しておりこ
の結（４）果、平滑用コンデンサＣ１の充放電電圧の影
響を受けることなく安定した時限設定できるためサイリ
スタの誤点弧動作を防止できる。更に入力電流Ｉinが大
きな回路に適用する場合に整流用ダイオ−ドＤ６、Ｄ７
により整流用ダイオ−ドＤ１の容量軽減を図れる利点が
ある。
Ｄ７により、時限回路（Ｒ２、Ｒ３、Ｃ２）の電源部を
整流用ダイオ−ドＤ１の出力と独立して形成しておりこ
の結（４）果、平滑用コンデンサＣ１の充放電電圧の影
響を受けることなく安定した時限設定できるためサイリ
スタの誤点弧動作を防止できる。更に入力電流Ｉinが大
きな回路に適用する場合に整流用ダイオ−ドＤ６、Ｄ７
により整流用ダイオ−ドＤ１の容量軽減を図れる利点が
ある。
【００１０】図５は本発明の他の実施例回路図で上記実
施例（図３）と相違する所は半導体スイッチング素子Ｓ
ＣＲ１のアノ−ド、ゲ−ト間に第２の半導体スイッチン
グ素子ＳＣＲ２のアノ−ド、カソ−ドを接続し、前記半
導体スイッチング素子ＳＣＲ２のゲ−ト・カソ−ド間に
分圧抵抗Ｒ２、Ｒ３と第２のコンデンサＣ2より成る時
限回路を接続したことである。この実施例では入力電流
Ｉinが更に大きい回路に適用する場合、大容量のサイリ
スタＳＣＲ１を使うとゲ−ト電流も大きくなりゲ−ト回
路の電力損失が増加するのでゲ−ト感度の良いサイリス
タＳＣＲ2を補助的に使って損失を低減している。
施例（図３）と相違する所は半導体スイッチング素子Ｓ
ＣＲ１のアノ−ド、ゲ−ト間に第２の半導体スイッチン
グ素子ＳＣＲ２のアノ−ド、カソ−ドを接続し、前記半
導体スイッチング素子ＳＣＲ２のゲ−ト・カソ−ド間に
分圧抵抗Ｒ２、Ｒ３と第２のコンデンサＣ2より成る時
限回路を接続したことである。この実施例では入力電流
Ｉinが更に大きい回路に適用する場合、大容量のサイリ
スタＳＣＲ１を使うとゲ−ト電流も大きくなりゲ−ト回
路の電力損失が増加するのでゲ−ト感度の良いサイリス
タＳＣＲ2を補助的に使って損失を低減している。
【００１１】
【考案の効果】本考案は入力電圧の瞬断に対して過大電
流が流れることを防ぐと共に、入力整流部を共通化した
複数個のスイッチングレギュレ−タを使った分散給電方
式にも有効であり、又、スイッチングレギュレ−タの動
作に関係なくＳＣＲ１が動作するため、入力整流部を共
通化した複数個のスイッチングレギュレ−タを使った分
散給電方式に有効な方法である。又、スイッチングレギ
ュレ−タに限らず、コンデンサインプット型の電源を有
する機器に対しても有効である。
流が流れることを防ぐと共に、入力整流部を共通化した
複数個のスイッチングレギュレ−タを使った分散給電方
式にも有効であり、又、スイッチングレギュレ−タの動
作に関係なくＳＣＲ１が動作するため、入力整流部を共
通化した複数個のスイッチングレギュレ−タを使った分
散給電方式に有効な方法である。又、スイッチングレギ
ュレ−タに限らず、コンデンサインプット型の電源を有
する機器に対しても有効である。
【図面の簡単な説明】
【図１】従来回路図
【図２】従来回路の各部動作波形図
【図３】本考案の一実施例回路図 （５）
【図４】本考案実施例回路の各部動作波形図
【図５】本考案の他の実施例回路図
【符号の説明】 Ｄ１ 整流用ダイオ−ドブリッジ Ｄ６、Ｄ７ 整流用ダイオ−ド Ｃ１、Ｃ２ コンデンサ ＳＣＲ１、ＳＣＲ２ スイッチング素子（サイリスタ） Ｒ１ 電流制限抵抗 Ｒ２、Ｒ３ 分圧抵抗
Claims (2)
- 【請求項１】 整流ダイオ−ドＤ１の出力脈流電圧を平
滑する第１のコンデンサＣ１の間に接続された半導体ス
イッチング電源に於いて、前記整流ダイオ−ドＤ１と並
列に第２の整流ダイオ−ドＤ６（Ｄ７）を設け、前記半
導体スイッチング素子ＳＣＲ１を点弧するために、前記
第２整流ダイオ−ドＤ６（Ｄ７）の脈流出力電圧を第
２、第３の抵抗器Ｒ２、Ｒ３により分圧すると共に、前
記分圧出力を前記第３の抵抗器Ｒ３と並列に接続された
第２のコンデンサＣ２を介して、前記半導体スイッチン
グ素子ＳＣＲ１のゲ−ト・カソ−ド間に印加入力電圧Ｖ
ｉｎを印加してから該半導体スイッチング素子ＳＣＲ１
を点弧するまでの時限を前記第２のコンデンサＣ２及び
第２、第３の抵抗Ｒ２、Ｒ３により設定する事を特徴と
したスイッチング電源。 - 【請求項２】 半導体スイッチング素子ＳＣＲ１のアノ
−ド・ゲ−ト間に第２の半導体スイッチング素子ＳＣＲ
２のアノ−ド・カソ−ドを接続し、半導体スイッチング
素子ＳＣＲ２のゲ−ト・カソ−ド間に分圧抵抗Ｒ２、Ｒ
３と第２のコンデンサＣ２より成る時限回路を接続した
ことを特徴とする請求項１のスイッチング電源。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1995003400U JP2546843Y2 (ja) | 1995-03-23 | 1995-03-23 | スイッチング電源 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1995003400U JP2546843Y2 (ja) | 1995-03-23 | 1995-03-23 | スイッチング電源 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0744880U JPH0744880U (ja) | 1995-11-28 |
| JP2546843Y2 true JP2546843Y2 (ja) | 1997-09-03 |
Family
ID=18333673
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1995003400U Expired - Lifetime JP2546843Y2 (ja) | 1995-03-23 | 1995-03-23 | スイッチング電源 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2546843Y2 (ja) |
-
1995
- 1995-03-23 JP JP1995003400U patent/JP2546843Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0744880U (ja) | 1995-11-28 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |