JP2022521192A - 平行板導波路 - Google Patents
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Abstract
Description
虚像表示には、拡張現実のプレゼンテーションに固有の利点がいくつかある。例えば、虚像の見かけの大きさは、表示面の大きさや位置によって制限されない。さらに、虚像のソースオブジェクトは小さくてもよく、例えば、虫眼鏡はオブジェクトの虚像を提供する。実像を投影するシステムと比較して、ある程度離れているように見える虚像を形成することにより、より現実的な視聴体験を提供することが可能である。 虚像を提供することで、実像を投影するときに必要になる、スクリーン製品(screen artifact)を補正する必要もなくなる。
Claims (22)
- 導波路アセンブリであって、
第1の表面及び第2の表面を有するブランクであって上記第2の表面が上記第1の表面から距離を置いて配置され上記ブランクの厚みを形成するブランクと、
上記第1の表面と結合され第3の表面を形成する第1のコーティングと、
上記第2の表面と結合され第4の表面を形成する第2のコーティングとを備え、
上記第3及び第4の表面が、上記ブランクを動作可能に透過する画像担持光ビームの波長の4分の1以内の範囲で平坦であることを特徴とする導波路アセンブリ。 - 請求項1に記載の導波路アセンブリであって、
上記第3の表面は、上記第4の表面との平行からの偏差が6秒未満であることを特徴とする導波路アセンブリ。 - 請求項1に記載の導波路アセンブリであって、
上記第1及び第2のコーティングは光学接着剤で構成されることを特徴とする請求項1に記載の導波路アセンブリ。 - 請求項3に記載の導波路アセンブリであって、
上記第1の光学接着剤は、上記ブランクの屈折率の5%以内の屈折率を有する屈折率整合光学エポキシで構成されることを特徴とする導波路アセンブリ。 - 請求項1に記載の導波路アセンブリであって、
上記第4の表面に1又は複数の回折格子が配置されていることを特徴とする導波路アセンブリ。 - 請求項1に記載の導波路アセンブリであって、
上記第3の表面に1又は複数の回折格子が配置されていることを特徴とする導波路アセンブリ。 - 請求項1に記載の導波路アセンブリであって、
1又は複数の回折格子が上記第2のコーティングと上記ブランクの間に位置する副層で構成されることを特徴とする導波路アセンブリ。 - 請求項7に記載の導波路アセンブリであって、
上記1又は複数の回折格子が体積ホログラムで構成されることを特徴とする導波路アセンブリ。 - 請求項7に記載の導波路アセンブリであって、
上記1又は複数の回折格子が、ホログラフ的に形成されたポリマー分散型液晶で構成されることを特徴とする導波路アセンブリ。 - 導波路アセンブリの製造方法であって、
第1の表面及び第2の表面を有するブランクを提供する工程と、
平坦面を提供する工程と、
上記平坦面に離型剤をつける工程と、
上記離型剤の上にコーティングをつける工程と、
上記コーティングに上記ブランクの上記第1の表面をつけ、上記第1の表面が上記平坦面から所定の距離に配置される工程と、
上記コーティングを硬化させ、これにより上記コーティングが上記第1の表面と結合される工程と、
を含むことを特徴とする導波路アセンブリの製造方法。 - 請求項10に記載の導波路アセンブリの製造方法であって、
上記ブランクと上記平坦面との間の上記距離を測定する工程をさらに含むことを特徴とする導波路アセンブリの製造方法。 - 請求項10に記載の導波路アセンブリの製造方法であって、
上記平坦面から上記ブランクを取り除く工程と、
上記平坦面に上記離型剤をつける工程と、
上記離型剤の上に第2のコーティングをつける工程と、
上記第2のコーティングに上記ブランクの上記第2の表面をつけ、上記第2の表面が上記平坦面から所定の距離に配置される工程と、
上記第2のコーティングを硬化し、これにより上記第2のコーティングは上記第2の表面と結合される工程と、
をさらに含むことを特徴とする導波路アセンブリの製造方法。 - 請求項12に記載の導波路アセンブリの製造方法であって、
上記第1のコーティングが第1の屈折率で構成され、上記第2のコーティングが第2の屈折率で構成されることを特徴とする導波路アセンブリの製造方法。 - 請求項12に記載の導波路アセンブリの製造方法であって、
上記第1の屈折率が上記第2の屈折率に等しいことを特徴とする導波路アセンブリの製造方法。 - 請求項12に記載の導波路アセンブリの製造方法であって、
上記第1及び第2のコーティングが光学接着剤で構成されることを特徴とする導波路アセンブリの製造方法。 - 請求項12に記載の導波路アセンブリの製造方法であって、
上記第2の表面に1又は複数の回折格子が配置されていることを特徴とする請求項12に記載の導波路アセンブリの製造方法。 - 請求項10に記載の導波路アセンブリの製造方法であって、
上記平坦面を回転させ、これにより上記コーティングを硬化させる前に上記コーティングが上記ブランクの上記第1の表面上に均一に分散される工程をさらに含むことを特徴とする導波路アセンブリの製造方法。 - 請求項10に記載の導波路アセンブリの製造方法であって、
上記ブランクを少なくとも部分的な真空にさらし、これにより上記コーティングを硬化させる前に上記ブランクの第1の表面が上記平坦面に対してより平行に近い位置に配置される工程をさらに含むことを特徴とする導波路アセンブリの製造方法。 - 導波路アセンブリの製造方法であって、
第1の表面及び第2の表面を有するブランクを提供する工程と、
平坦面を提供する工程と、
上記平坦面に離型剤をつける工程と、
上記ブランクの第1の表面にコーティングをつける工程と、
上記平坦面を上記コーティング中に降ろし、上記ブランクの第1の表面が上記平坦面から所定の距離に配置される工程と、
上記ブランクが上記コーティングを介して上記平坦面から吊り下げられる工程と、
上記コーティングを硬化させ、これにより上記コーティングが上記ブランクの第1の表面と結合される工程と、
を含むことを特徴とする導波路アセンブリの製造方法。 - 請求項19に記載の導波路アセンブリの製造方法であって、
上記コーティングを硬化させる前に、上記ブランクを少なくとも部分的に液体中に降ろす工程をさらに含むことを特徴とする導波路アセンブリの製造方法。 - 請求項19に記載の導波路アセンブリの製造方法であって、
上記ブランクの上記第1の表面の周縁に上記コーティングを毛管力により引き寄せる工程を含むことを特徴とする導波路アセンブリの製造方法。 - 請求項19に記載の導波路アセンブリの製造方法であって、
上記ブランクの第2の表面に対向する第2の平坦面を提供する工程と、
上記第2の平坦面に上記離型剤をつける工程と、
上記離型剤の上に第2のコーティングをつける工程と、
上記第2のコーティングに上記ブランクの第2の表面をつけ、上記ブランクの第2の表面が上記第2の平坦面から所定の距離に配置される工程と、
上記第2のコーティングを硬化させ、これにより上記第2のコーティングが上記ブランクの第2の表面と結合される工程と、
をさらに含むことを特徴とする導波路アセンブリの製造方法。
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