JP2022179479A - ローカルパッシブマトリクスディスプレイ - Google Patents
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Abstract
Description
本出願は、2018年5月9日に出願された米国特許仮出願第62/669,293号の優先権の利益を主張し、同文献は本明細書において参照により援用されている。
いくつかの構成では、画素ドライバチップ110からなる行は、プライマリ画素ドライバチップ110Aからなる行と冗長画素ドライバチップ110Bからなる行とに配置される。
Claims (30)
- ディスプレイパネルのローカルパッシブマトリクス(LPM)を操作する方法であって、
画素ドライバチップでデータを受信することであって、前記画素ドライバチップがディスプレイ基板の表示領域内に散在する複数の画素ドライバチップのうちの1つであり、かつ前記画素ドライバチップが、複数の表示行に配置されたLEDからなるLPMグループに結合されている、受信することと、
前記LEDからなるLPMグループを一度に1表示行ずつ駆動することと、
を含む、方法。 - 単一の表示行の出射中に複数の表示行が更新される、請求項1に記載の方法。
- 前記各画素ドライバチップが、第1のLPMグループに結合された第1のドライバスライスと、前記画素ドライバチップの前記第1のLPMグループとは反対側の第2のLPMグループに結合された第2のドライバスライスとを含み、前記第1のドライバスライスが第1の出射クロック位相を受信し、前記第2のドライバスライスが第2の出射クロック位相を受信する、請求項2に記載の方法。
- 各LPMグループのためのデータ更新時間が、前記第1の出射クロック位相と前記第2の出射クロック位相の間のタイミング遅延(toffset)によって区切られる、請求項3に記載の方法。
- 各画素ドライバチップが、第1のLPMグループに結合された第1のドライバスライスと、前記画素ドライバチップの前記第1のLPMグループとは反対側の第2のLPMグループに結合された第2のドライバスライスとを含み、前記第1及び第2のドライバスライスが同じ出射クロック位相を受信する、請求項2に記載の方法。
- マトリクス行N+1の出射中に、画素ドライバチップN+1のスライス0のデータ更新を完了することと、
画素ドライバチップN+2の状態をチェックすることと、
画素ドライバチップN+2の状態がアクティブであれば、次いで、
マトリクス行N+1の出射中に、画素ドライバチップN+2のスライス0のデータ更新を開始することと、
マトリクス行N+2の出射中に、画素ドライバチップN+2のスライス0のデータ更新を完了することと、を更に含み、
画素ドライバチップN+2の状態が非アクティブであれば、次いで、
マトリクス行N+1の出射中に、画素ドライバチップN+1のスライス1のデータ更新を開始することと、
マトリクス行N+2の出射中に、画素ドライバチップN+1のスライス1のデータ更新を完了することと
を更に含む、請求項1に記載の方法。 - 前記画素ドライバチップN+2の状態が非アクティブであり、
前記画素ドライバチップN+1のスライス0のデータ更新の完了とマトリクス行N+1の出射開始の間の時間ギャップが、前記画素ドライバチップN+1のスライス1のデータ更新の完了とマトリクス行N+2の出射開始の間の時間ギャップよりも小さくなるように、マトリクス行N+2の第1のエミッタ行の出射を遅延させることを更に含む、請求項6に記載の方法。 - マトリクス行Nに対して画素ドライバチップNのスライス0のデータ更新を開始することと、
マトリクス行Nの出射中に、画素ドライバチップNのスライス0のデータ更新を完了することと、
マトリクス行N+1に対して画素ドライバチップNのスライス1のデータ更新を開始することと、
マトリクス行Nの出射中に、画素ドライバチップNのスライス1のデータ更新を完了することとを更に含み、
前記画素ドライバチップNのスライス0のデータ更新の完了とマトリクス行Nの出射開始の間の第1の時間ギャップが、前記画素ドライバチップNのスライス1のデータ更新の完了とマトリクス行N+1の出射開始の間の第2の時間ギャップよりも小さくなるように、マトリクス行N+1の第1のエミッタ列の出射を遅延させることを更に含む、
請求項1に記載の方法。 - 画素ドライバチップN+2の状態をチェックすることを更に含み、前記画素ドライバチップN+2の状態がアクティブであれば、次いで、
マトリクス行N+2に対して画素ドライバチップのN+2のスライス0のデータ更新を開始することと、
マトリクス行N+2の出射中に、画素ドライバチップのN+2のスライス0のデータ更新を完了することと、を更に含む、
請求項8に記載の方法。 - 画素ドライバチップN+2の状態をチェックすることを更に含み、画素ドライバチップN+2の状態がアクティブであれば、次いで、
マトリクス行N+2に対して画素ドライバチップN+1のスライス1のデータ更新を開始することと、
マトリクス行N+2の出射中に、画素ドライバチップN+1のスライス1のデータ更新を完了することと、を更に含む、
請求項8に記載の方法。 - 前記LEDからなるLPMグループを一度に1表示行ずつ駆動することが、第1の表示行内の第1のLED色、第2のLED色、及び第3のLED色を駆動しながら第2の表示行内の前記第3のLED色も駆動することを更に含み、前記第1及び第2の表示行内の前記第3のLED色が、前記第1の表示行内の前記第1のLED色及び前記第2のLED色よりも長い期間駆動される、請求項1に記載の方法。
- 第1の画素ドライバチップ行に配置された第1の画素ドライバチップと、
第2の画素ドライバチップ行に配置された第2の画素ドライバチップと、
前記第1の画素ドライバチップ行及び前記第2の画素ドライバチップ行の間に分散された複数のプライマリ行ドライバチップと、を含む、
ローカルパッシブマトリクスディスプレイ。 - 前記プライマリ行ドライバチップの第1の部分が、前記ドライバチップの前記第1の行を操作し、前記プライマリ行ドライバチップの第2の部分が、前記第2の行の画素ドライバチップを操作する、請求項12に記載のディスプレイ。
- 前記プライマリ行ドライバチップの前記第1の部分が、第1の出射クロックライン及び第1のデータクロックラインに結合されており、前記プライマリ行ドライバチップの前記第2の部分が、第2の出射クロックライン及び第2のデータクロックラインに結合されている、請求項13に記載のディスプレイ。
- 前記第1の出射クロックライン及び第2の出射クロックラインが、出射クロックバスラインに結合されており、前記第1のデータクロックライン及び第2のデータクロックラインがデータクロックバスラインに結合されている、請求項14に記載のディスプレイ。
- 前記第1の画素ドライバチップ行と第2の画素ドライバチップ行の間に分散された複数の冗長行ドライバチップを更に含む、請求項15に記載のディスプレイ。
- 前記冗長行ドライバチップの第1の部分が、前記第1の出射クロックライン及び前記第1のデータクロックラインに結合されており、前記冗長行ドライバチップの第2の部分が、前記第2の出射クロックライン及び前記第2のデータクロックラインに結合されている、請求項13に記載のディスプレイ。
- 外部制御回路と、
隣り合って配置された複数のタイルとを含み、各タイルが、
前記タイルの長さにわたるバスラインと、
前記バスラインから対応する複数の行ドライバチップ行へ延びる複数行の結束信号ラインとを含み、
各タイルのバスラインが外部制御回路に結合されている、
ローカルパッシブマトリクス型タイルドディスプレイ。 - 前記タイルのうち1つに切り抜きを更に含む、請求項18に記載のタイルドディスプレイ。
- 複数のタイルにわたって広がる切り抜きを更に含む、請求項18に記載のタイル表示ディスプレイ。
- 前記複数行の結束信号ラインが、複数行の出射クロックラインと、複数行のデータクロックラインとを含む、請求項18に記載のタイルドディスプレイ。
- ディスプレイ基板の表示領域内に散在する複数の画素ドライバチップであって、
前記複数の画素ドライバチップ内の画素ドライバチップが、複数の表示行に配置された、対応する複数の画素に隣接している、複数の画素ドライバチップと、
前記複数の画素の第1の発光ダイオード(LED)行に結合された前記画素ドライバチップの第1の端子と、
前記複数の画素の第2のLED行に結合された前記画素ドライバチップの第2の端子と、
前記複数の画素の第1のLED列に結合された第3の端子であって、前記第1のLED列が、前記第1のLED行の第1のLED及び前記第2のLED行の第1のLEDを含む、第3の端子と、
前記複数の画素の第2のLED列に結合された第4の端子であって、前記第2のLED列が、前記第1のLED行の第2のLED及び前記第2のLED行の第2のLEDを含む、第4の端子と
を含む、ローカルパッシブマトリクスディスプレイ。 - 前記第3の端子が、前記画素ドライバチップの第1の出力ドライバに結合されており、前記第4の端子が、前記画素ドライバチップの第2の出力ドライバに結合されている、請求項22に記載のディスプレイ。
- 前記画素ドライバチップが、複数のLED列に結合された複数の出力ドライバを含む、請求項23に記載のディスプレイ。
- 前記画素ドライバチップが画素ドライバチップ行の中にあり、前記画素ドライバチップ行が、前記ディスプレイ基板を横切る線内にある、請求項22に記載のディスプレイ。
- 前記画素ドライバチップが画素ドライバチップ行の中にあり、前記画素ドライバチップ行が、前記表示領域の縁部に沿って曲線状である、請求項22に記載のディスプレイ。
- ディスプレイ基板の表示領域内に散在する複数の画素ドライバチップであって、
前記複数の画素ドライバチップ内の画素ドライバチップが、複数の表示行に配置された対応する複数の画素に隣接している、複数の画素ドライバチップと、
第1の表示行内の第1の出射色の第1のLEDグループ及び第2の出射色の第2のLEDグループに結合された、前記画素ドライバチップの第1の端子と、
前記第1の表示行内の第3の出射色の第3のLEDグループに結合された、前記画素ドライバチップの第2の端子とを含む、
ローカルパッシブマトリクスディスプレイ。 - 前記第1の出射色の第1のLED列に結合された第3の端子であって、前記第1のLED列が前記第1のLEDグループと重なり合っている、第3の端子と、
前記第2の出射色の第2のLED列に結合された第4の端子であって、前記第2のLED列が前記第2のLEDグループと重なり合っている、第4の端子と、
前記第3の出射色の第3のLED列に結合された第5の端子であって、前記第3のLED列が前記第3のLEDグループと重なり合っている、第5の端子と
を更に含む、請求項27に記載のディスプレイ。 - 前記第1の出射色の第4のLEDグループ及び前記第2の出射色の第5のLEDグループに結合された前記画素ドライバチップの第6の端子を更に含み、
前記画素ドライバチップの前記第2の端子が、前記第2の表示行の前記第3の出射色の第6のLEDグループに結合されている、
請求項28に記載のディスプレイ。 - 前記複数の画素ドライバチップが、前記ディスプレイ基板内に埋め込まれている、請求項27に記載のディスプレイ。
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