JP2021145283A - 高周波モジュールおよび通信装置 - Google Patents

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秀享 高橋
聡 後藤
Satoshi Goto
聡 後藤
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Yoshiki Yasutomo
佳樹 安友
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Daerok Oh
デロク オ
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勇人 青木
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義弘 大門
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Abstract

【課題】差動増幅型の電力増幅器から出力される高周波信号の信号品質の劣化が抑制された小型の高周波モジュールを提供する。【解決手段】高周波モジュール1Aは、互いに対向する主面91aおよび91bを有するモジュール基板91と、電力増幅器10と、第1回路部品と、電力増幅器10を制御するPA制御回路80と、を備え、電力増幅器10は、入力端子115および出力端子116と、入力端子115に対して並列配置された増幅素子12および13と、増幅素子12の出力端子および増幅素子13の出力端子と出力端子116との間に接続された出力トランス15とを有し、制御回路80は91bに配置されており、増幅素子12および13は主面91aに配置されている。【選択図】図3A

Description

本発明は、高周波モジュールおよび通信装置に関する。
携帯電話などの移動体通信機器には、高周波送信信号を増幅する電力増幅器が搭載される。
特許文献1には、非反転入力信号が入力される第1トランジスタと、反転入力信号が入力される第2トランジスタと、第1トランジスタおよび第2トランジスタの出力端子側に配置されたトランスフォーマ(以下、トランスと記す)とで構成された、差動増幅型の電力増幅器が開示されている。トランスは、磁気的に結合した2つの一次側コイルと、1つの二次側コイルと、で構成されている。2つの一次側コイルは互いに並列接続され、それぞれが二次側コイルと磁気的に結合することで、Qファクタを低下させることなく一次側コイルの入力インピーダンスを低減できる。これにより、電力利得(パワーゲイン)を向上させることが可能となる。
特開2010−118916号公報
しかしながら、特許文献1に開示された差動増幅型の電力増幅器を1つの高周波モジュールで構成する場合、電力増幅器を構成する回路素子数が多いため、高周波モジュールが大型化してしまう。
本発明は、上記課題を解決するためになされたものであって、差動増幅型の電力増幅器を有する小型の高周波モジュールおよびそれを備えた通信装置を提供することを目的とする。
上記目的を達成するために、本発明の一態様に係る高周波モジュールは、互いに対向する第1主面および第2主面を有するモジュール基板と、送信信号を増幅する電力増幅器と、第1回路部品と、前記電力増幅器を制御する制御回路と、を備え、前記電力増幅器は、第1増幅素子および第2増幅素子と、第1コイルおよび第2コイルを有する出力トランスと、を有し、前記第1コイルの一端は前記第1増幅素子の出力端子に接続され、前記第1コイルの他端は前記第2増幅素子の出力端子に接続され、前記第2コイルの一端は、前記電力増幅器の出力端子に接続されており、前記制御回路は、前記第1主面に配置されており、前記第1増幅素子および前記第2増幅素子、または、前記第1回路部品は、前記第2主面に配置されている。
本発明によれば、差動増幅型の電力増幅器を有する小型の高周波モジュールおよび通信装置を提供することが可能となる。
実施の形態に係る高周波モジュールおよび通信装置の回路構成図である。 差動増幅型の電力増幅器の回路構成図である。 実施例1に係る高周波モジュールの平面構成概略図である。 実施例1に係る高周波モジュールの断面構成概略図である。 変形例1に係る高周波モジュールの断面構成概略図である。 変形例2に係る高周波モジュールの断面構成概略図である。 実施例2に係る高周波モジュールの平面構成概略図である。 実施例2に係る高周波モジュールの断面構成概略図である。
以下、本発明の実施の形態について詳細に説明する。なお、以下で説明する実施の形態は、いずれも包括的又は具体的な例を示すものである。以下の実施の形態で示される数値、形状、材料、構成要素、構成要素の配置及び接続形態等は、一例であり、本発明を限定する主旨ではない。以下の実施例及び変形例における構成要素のうち、独立請求項に記載されていない構成要素については、任意の構成要素として説明される。また、図面に示される構成要素の大きさ又は大きさの比は、必ずしも厳密ではない。各図において、実質的に同一の構成については同一の符号を付し、重複する説明は省略又は簡略化する場合がある。
また、以下において、平行及び垂直等の要素間の関係性を示す用語、及び、矩形状等の要素の形状を示す用語、並びに、数値範囲は、厳格な意味のみを表すのではなく、実質的に同等な範囲、例えば数%程度の差異をも含むことを意味する。
また、以下において、基板に実装されたA、B及びCにおいて、「基板(又は基板の主面)の平面視において、AとBとの間にCが配置されている」とは、基板の平面視においてA内の任意の点とB内の任意の点とを結ぶ複数の線分の少なくとも1つがCの領域を通ることを意味する。また、基板の平面視とは、基板および基板に実装された回路素子を基板の主面に平行な平面に正投影して見ることを意味する。
また、以下において、「送信経路」とは、高周波送信信号が伝搬する配線、当該配線に直接接続された電極、および当該配線または当該電極に直接接続された端子等で構成された伝送線路であることを意味する。また、「受信経路」とは、高周波受信信号が伝搬する配線、当該配線に直接接続された電極、および当該配線または当該電極に直接接続された端子等で構成された伝送線路であることを意味する。また、「送受信経路」とは、高周波送信信号および高周波受信信号が伝搬する配線、当該配線に直接接続された電極、および当該配線または当該電極に直接接続された端子等で構成された伝送線路であることを意味する。
また、以下において、「AとBとが接続されている」とは、AとBとが物理的に接続されている場合に適用されるだけでなく、AとBとが電気的に接続されている場合にも適用される。
(実施の形態)
[1.高周波モジュール1および通信装置5の回路構成]
図1は、実施の形態に係る高周波モジュール1および通信装置5の回路構成図である。同図に示すように、通信装置5は、高周波モジュール1と、アンテナ2と、RF信号処理回路(RFIC)3と、ベースバンド信号処理回路(BBIC)4と、を備える。
RFIC3は、アンテナ2で送受信される高周波信号を処理するRF信号処理回路である。具体的には、RFIC3は、高周波モジュール1の受信経路を介して入力された受信信号を、ダウンコンバートなどにより信号処理し、当該信号処理して生成された受信信号をBBIC4へ出力する。また、RFIC3は、BBIC4から入力された送信信号をアップコンバートなどにより信号処理し、当該信号処理して生成された送信信号を、高周波モジュール1の送信経路に出力する。
BBIC4は、高周波モジュール1を伝送する高周波信号よりも低周波の中間周波数帯域を用いて信号処理する回路である。BBIC4で処理された信号は、例えば、画像表示のための画像信号として使用され、または、スピーカを介した通話のために音声信号として使用される。
また、RFIC3は、使用される通信バンド(周波数帯域)に基づいて、高周波モジュール1が有するスイッチ51、52および53の接続を制御する制御部としての機能も有する。具体的には、RFIC3は、制御信号(図示せず)により高周波モジュール1が有するスイッチ51〜53の接続を切り替える。具体的には、RFIC3は、スイッチ51〜53を制御するためのディジタル制御信号をPA制御回路80に出力する。高周波モジュール1のPA制御回路80は、RFIC3から入力されたディジタル制御信号によって、スイッチ51〜53にディジタル制御信号を出力することで、スイッチ51〜53の接続および非接続を制御する。
また、RFIC3は、高周波モジュール1が有する電力増幅器10の利得、電力増幅器10に供給される電源電圧Vccおよびバイアス電圧Vbiasを制御する制御部としての機能も有する。具体的には、RFIC3は、MIPIおよびGPIOなどのディジタル制御信号を高周波モジュール1の制御信号端子130に出力する。高周波モジュール1のPA制御回路80は、制御信号端子130を介して入力されたディジタル制御信号によって、電力増幅器10に制御信号、電源電圧Vccまたはバイアス電圧Vbiasを出力することで、電力増幅器10の利得を調整する。なお、電力増幅器10の利得を制御するディジタル制御信号をRFIC3から受ける制御信号端子と、電力増幅器10に供給される電源電圧Vccおよびバイアス電圧Vbiasを制御するディジタル制御信号をRFIC3から受ける制御信号端子とは、異なっていてもよい。また、制御部は、RFIC3の外部に設けられていてもよく、例えば、BBIC4に設けられていてもよい。
アンテナ2は、高周波モジュール1のアンテナ接続端子100に接続され、高周波モジュール1から出力された高周波信号を放射し、また、外部からの高周波信号を受信して高周波モジュール1へ出力する。
なお、本実施の形態に係る通信装置5において、アンテナ2およびBBIC4は、必須の構成要素ではない。
次に、高周波モジュール1の詳細な構成について説明する。
図1に示すように、高周波モジュール1は、アンテナ接続端子100と、電力増幅器10と、低雑音増幅器20と、送信フィルタ30Tおよび40Tと、受信フィルタ30Rおよび40Rと、PA制御回路80と、整合回路61、62および63と、スイッチ51、52および53と、ダイプレクサ35と、を備える。
アンテナ接続端子100は、入出力端子の一例であり、アンテナ2に接続されるアンテナ共通端子である。
電力増幅器10は、送信入力端子110から入力された通信バンドAおよび通信バンドBの高周波信号を増幅する差動増幅型の増幅回路である。
PA制御回路80は、制御信号端子130を介して入力されたディジタル制御信号MIPIおよびGPIOなどによって、電力増幅器10の利得を調整する。PA制御回路80は、半導体IC(Integrated Circuit)で形成されていてもよい。半導体ICは、例えば、CMOS(Complementary Metal Oxide Semiconductor)で構成されている。具体的には、SOI(Silicon On Insulator)プロセスにより形成されている。これにより、半導体ICを安価に製造することが可能となる。なお、半導体ICは、GaAs、SiGeおよびGaNの少なくともいずれかで構成されていてもよい。これにより、高品質な増幅性能および雑音性能を有する高周波信号を出力することが可能となる。
低雑音増幅器20は、通信バンドAおよび通信バンドBの高周波信号を低雑音で増幅し、受信出力端子120へ出力する増幅器である。
送信フィルタ30Tは、電力増幅器10とアンテナ接続端子100とを結ぶ送信経路ATに配置され、電力増幅器10で増幅された送信信号のうち、通信バンドAの送信帯域の送信信号を通過させる。また、送信フィルタ40Tは、電力増幅器10とアンテナ接続端子100とを結ぶ送信経路BTに配置され、電力増幅器10で増幅された送信信号のうち、通信バンドBの送信帯域の送信信号を通過させる。
受信フィルタ30Rは、低雑音増幅器20とアンテナ接続端子100とを結ぶ受信経路ARに配置され、アンテナ接続端子100から入力された受信信号のうち、通信バンドAの受信帯域の受信信号を通過させる。また、受信フィルタ40Rは、低雑音増幅器20とアンテナ接続端子100とを結ぶ受信経路BRに配置され、アンテナ接続端子100から入力された受信信号のうち、通信バンドBの受信帯域の受信信号を通過させる。
送信フィルタ30Tおよび受信フィルタ30Rは、通信バンドAを通過帯域とするデュプレクサ30を構成している。デュプレクサ30は、通信バンドAの送信信号と受信信号とを、周波数分割複信(FDD:Frequency Division Duplex)方式で伝送する。また、送信フィルタ40Tおよび受信フィルタ40Rは、通信バンドBを通過帯域とするデュプレクサ40を構成している。デュプレクサ40は、通信バンドBの送信信号と受信信号とを、FDD方式で伝送する。
なお、デュプレクサ30および40のそれぞれは、複数の送信フィルタのみで構成されたマルチプレクサ、複数の受信フィルタのみで構成されたマルチプレクサ、または複数のデュプレクサで構成されたマルチプレクサであってもよい。また、送信フィルタ30Tおよび受信フィルタ30Rは、デュプレクサ30を構成していなくてもよく、時分割複信(TDD:Time Division Duplex)方式で伝送するフィルタであってもよい。この場合には、送信フィルタ30Tおよび受信フィルタ30Rの前段および後段の少なくとも一方に、送信および受信を切り替えるスイッチが配置される。
整合回路61は、スイッチ53とデュプレクサ30とを結ぶ経路に配置され、ダイプレクサ35およびスイッチ53と、デュプレクサ30とのインピーダンス整合をとる。整合回路62は、スイッチ53とデュプレクサ40とを結ぶ経路に配置され、ダイプレクサ35およびスイッチ53と、デュプレクサ40とのインピーダンス整合をとる。
整合回路63は、低雑音増幅器20と受信フィルタ30Rおよび40Rとを結ぶ受信経路に配置され、低雑音増幅器20と受信フィルタ30Rおよび40Rとのインピーダンス整合をとる。
なお、電力増幅器10と送信フィルタ30Tおよび40Tとを結ぶ送信経路に、電力増幅器10と送信フィルタ30Tおよび40Tとのインピーダンス整合をとる整合回路が配置されていてもよい。
スイッチ51は、共通端子、および2つの選択端子を有する。スイッチ51の共通端子は、電力増幅器10の出力端子116に接続されている。スイッチ51の一方の選択端子は送信フィルタ30Tに接続され、スイッチ51の他方の選択端子は送信フィルタ40Tに接続されている。この接続構成において、スイッチ51は、電力増幅器10と送信フィルタ30Tとの接続、および、電力増幅器10と送信フィルタ40Tとの接続、を切り替える。スイッチ51は、例えば、SPDT(Single Pole Double Throw)型のスイッチ回路で構成される。
スイッチ52は、共通端子および2つの選択端子を有する。スイッチ52の共通端子は、整合回路63を介して低雑音増幅器20の入力端子に接続されている。スイッチ52の一方の選択端子は受信フィルタ30Rに接続され、スイッチ52の他方の選択端子は受信フィルタ40Rに接続されている。この接続構成において、スイッチ52は、低雑音増幅器20と受信フィルタ30Rとの接続および非接続を切り替え、低雑音増幅器20と受信フィルタ40Rとの接続および非接続を切り替える。スイッチ52は、例えば、SPDT型のスイッチ回路で構成される。
スイッチ53は、アンテナスイッチの一例であり、ダイプレクサ35を介してアンテナ接続端子100に接続され、(1)アンテナ接続端子100と送信経路ATおよび受信経路ARとの接続、ならびに(2)アンテナ接続端子100と送信経路BTおよび受信経路BRとの接続、を切り替える。なお、スイッチ53は、上記(1)および(2)の接続を同時に行うことが可能なマルチ接続型のスイッチ回路で構成される。
ダイプレクサ35は、マルチプレクサの一例であり、フィルタ35Lおよび35Hで構成されている。フィルタ35Lは、通信バンドAおよびBを含む周波数範囲を通過帯域とするフィルタであり、フィルタ35Hは、通信バンドAおよびBを含む周波数範囲と異なる他の周波数範囲を通過帯域とするフィルタである。フィルタ35Lの一方の端子とフィルタ35Hの一方の端子とは、アンテナ接続端子100に共通接続されている。フィルタ35Lおよび35Hのそれぞれは、例えば、チップ状のインダクタおよびキャパシタの少なくとも一方で構成されたLCフィルタである。なお、通信バンドAおよびBを含む周波数範囲が上記他の周波数範囲より低周波数側に位置する場合には、フィルタ35Lはローパスフィルタであってもよく、また、フィルタ35Hはハイパスフィルタであってもよい。
なお、上記の送信フィルタ30T、40T、受信フィルタ30R、および40Rは、例えば、SAW(Surface Acoustic Wave)を用いた弾性波フィルタ、BAW(Bulk Acoustic Wave)を用いた弾性波フィルタ、LC共振フィルタ、および誘電体フィルタのいずれかであってもよく、さらには、これらには限定されない。
また、整合回路61〜63は、本発明に係る高周波モジュールに必須の構成要素ではない。
高周波モジュール1の構成において、電力増幅器10、スイッチ51、送信フィルタ30T、整合回路61、スイッチ53、およびフィルタ35Lは、アンテナ接続端子100に向けて通信バンドAの送信信号を伝送する第1送信回路を構成する。また、フィルタ35L、スイッチ53、整合回路61、受信フィルタ30R、スイッチ52、整合回路63、および低雑音増幅器20は、アンテナ2からアンテナ接続端子100を介して通信バンドAの受信信号を伝送する第1受信回路を構成する。
また、電力増幅器10、スイッチ51、送信フィルタ40T、整合回路62、スイッチ53、およびフィルタ35Lは、アンテナ接続端子100に向けて通信バンドBの送信信号を伝送する第2送信回路を構成する。また、フィルタ35L、スイッチ53、整合回路62、受信フィルタ40R、スイッチ52、整合回路63、および低雑音増幅器20は、アンテナ2からアンテナ接続端子100を介して通信バンドBの受信信号を伝送する第2受信回路を構成する。
上記回路構成によれば、高周波モジュール1は、通信バンドAおよび通信バンドBのいずれかの高周波信号を、送信、受信、および送受信の少なくともいずれかで実行することが可能である。さらに、高周波モジュール1は、通信バンドAおよび通信バンドBの高周波信号を、同時送信、同時受信、および同時送受信の少なくともいずれかで実行することも可能である。
なお、本発明に係る高周波モジュールでは、上記2つの送信回路および上記2つの受信回路がスイッチ53を介してアンテナ接続端子100に接続されていなくてもよく、上記2つの送信回路および上記2つの受信回路が、異なる端子を介してアンテナ2に接続されていてもよい。また、本発明に係る高周波モジュールは、第1送信回路および第2送信回路の少なくとも1つを有していればよい。
また、本発明に係る高周波モジュールにおいて、第1送信回路は、電力増幅器10と、送信フィルタ30T、スイッチ51、53および整合回路61の少なくとも1つと、を有していればよい。また、第2送信回路は、電力増幅器10と、送信フィルタ40T、スイッチ51、53および整合回路62の少なくとも1つと、を有していればよい。
また、低雑音増幅器20およびスイッチ51〜53は、1つの半導体ICに形成されていてもよい。半導体ICは、例えば、CMOSで構成されている。具体的には、SOIプロセスにより形成されている。これにより、半導体ICを安価に製造することが可能となる。なお、半導体ICは、GaAs、SiGeおよびGaNの少なくともいずれかで構成されていてもよい。これにより、高品質な増幅性能および雑音性能を有する高周波信号を出力することが可能となる。
ここで、電力増幅器10の回路構成について、詳細に説明する。
図2は、電力増幅器10の回路構成図である。同図に示すように、電力増幅器10は、入力端子115および出力端子116と、増幅素子12(第1増幅素子)および13(第2増幅素子)と、増幅素子11と、段間トランス(変圧器)14と、キャパシタ16と、出力トランス(バラン:非平衡−平衡変換素子)15と、を有している。
増幅素子11の入力端子は入力端子115に接続され、増幅素子11の出力端子は段間トランス14の非平衡端子に接続されている。段間トランス14の一方の平衡端子は増幅素子12の入力端子に接続されており、段間トランス14の他方の平衡端子は増幅素子13の入力端子に接続されている。
入力端子115から入力された高周波信号は、増幅素子11にバイアス電圧Vcc1が印加された状態で増幅素子11にて増幅される。増幅された高周波信号は、段間トランス14により非平衡−平衡変換される。このとき、段間トランス14の一方の平衡端子から非反転入力信号が出力され、段間トランス14の他方の平衡端子から反転入力信号が出力される。
出力トランス15は、一次側コイル(第1コイル)15aと二次側コイル(第2コイル)15bとで構成されている。一次側コイル15aの一端は増幅素子12の出力端子に接続されており、一次側コイル15aの他端は増幅素子13の出力端子に接続されている。また、一次側コイル15aの中点にはバイアス電圧Vcc2が供給される。二次側コイル15bの一端は出力端子116に接続され、二次側コイル15bの他端はグランドに接続されている。言い換えると、出力トランス15は、増幅素子12の出力端子および増幅素子13の出力端子と、出力端子116との間に接続されている。
キャパシタ16は、増幅素子12の出力端子と増幅素子13の出力端子との間に接続されている。
増幅素子12にて増幅された非反転入力信号と、増幅素子13にて増幅された反転入力信号とは、逆位相を維持したまま、出力トランス15およびキャパシタ16にてインピーダンス変換される。つまり、出力端子116における電力増幅器10の出力インピーダンスは、出力トランス15およびキャパシタ16により、図1に示されたスイッチ51、送信フィルタ30Tおよび40Tの入力インピーダンスとインピーダンス整合される。なお、出力端子116と二次側コイル15bとを結ぶ経路とグランドとの間に接続された容量素子も、上記インピーダンス整合に寄与している。なお、上記容量素子は、出力端子116と二次側コイル15bとを結ぶ経路に直列配置されていてもよいし、また、上記容量素子はなくてもよい。
ここで、増幅素子11〜13、段間トランス14、およびキャパシタ16は、差動増幅回路10Aを形成している。特に、増幅素子11〜13および段間トランス14は、1チップ化、または、同一基板上に実装など、一体形成される場合が多い。これに対して、出力トランス15は、高出力の送信信号に対応して高いQ値を必要とするため、増幅素子11〜13および段間トランス14などとは、一体形成されない。つまり、電力増幅器10を構成する回路部品のうち、出力トランス15を除く回路部品が、差動増幅回路10Aを構成している。
なお、増幅素子11およびキャパシタ16は、差動増幅回路10Aに含まれなくてもよい。
電力増幅器10の回路構成によれば、増幅素子12および13が反転位相にて動作する。このとき、増幅素子12および13の基本波での電流が反転位相、つまり逆方向に流れるため、増幅素子12および13から略等距離に配置されたグランド配線および電源配線へは基本波の電流は流れなくなる。このため、上記配線への不要な電流の流れこみが無視できるので、従来の電力増幅器に見られる電力利得(パワーゲイン)の低下を抑制することが可能となる。また、増幅素子12および13で増幅された非反転信号と反転信号とが合成されるので、両信号に同様に重畳されたノイズ成分を相殺でき、例えば高調波成分などの不要波を低減できる。
なお、増幅素子11は電力増幅器10に必須の構成要素ではない。また、非平衡入力信号を、非反転入力信号および反転入力信号に変換する手段は、段間トランス14に限られない。また、キャパシタ16は、インピーダンス整合において必須の構成要素ではない。
また、増幅素子11〜13および低雑音増幅器20は、例えば、Si系のCMOS(Complementary Metal Oxide Semiconductor)またはGaAsを材料とした、電界効果型トランジスタ(FET)またはヘテロバイポーラトランジスタ(HBT)などで構成されている。
ここで、上記高周波モジュール1を、1つの実装基板上に実装する場合、電力増幅器10を構成する回路素子(増幅素子11〜13、段間トランス14、出力トランス15、キャパシタ16)の点数が多いため、高周波モジュール1が大型化してしまう。また、小型化すべく高密度実装すると、電力増幅器10から出力された高出力の送信信号およびPA制御回路80から出力された制御信号が、高周波モジュール1を構成する回路部品に干渉し、高周波モジュール1から出力される高周波信号の信号品質が劣化するという問題が発生する。
これに対して、本実施の形態に係る高周波モジュール1では、高周波モジュール1から出力される高周波信号の信号品質の劣化を抑制しつつ、高周波モジュール1を小型化する構成を有している。以下では、信号品質の劣化抑制と小型化とを両立させた高周波モジュール1の構成について説明する。
[2.実施例1に係る高周波モジュール1Aの回路素子配置構成]
図3Aは、実施例1に係る高周波モジュール1Aの平面構成概略図である。また、図3Bは、実施例1に係る高周波モジュール1Aの断面構成概略図であり、具体的には、図3AのIIIB−IIIB線における断面図である。なお、図3Aの(a)には、モジュール基板91の互いに対向する主面91aおよび91bのうち、主面91aをz軸正方向側から見た場合の回路素子の配置図が示されている。一方、図3Aの(b)には、主面91bをz軸正方向側から見た場合の回路素子の配置を透視した図が示されている。また、図3Aには、モジュール基板91内に形成された出力トランス15が破線で示されている。
実施例1に係る高周波モジュール1Aは、実施の形態に係る高周波モジュール1を構成する各回路素子の配置構成を具体的に示したものである。
図3Aおよび図3Bに示すように、本実施例に係る高周波モジュール1Aは、図1に示された回路構成に加えて、さらに、モジュール基板91と、樹脂部材92および93と、外部接続端子150と、を有している。
モジュール基板91は、互いに対向する主面91a(第2主面)および主面91b(第1主面)を有し、上記送信回路および上記受信回路を実装する基板である。モジュール基板91としては、例えば、複数の誘電体層の積層構造を有する低温同時焼成セラミックス(Low Temperature Co−fired Ceramics:LTCC)基板、高温同時焼成セラミックス(High Temperature Co−fired Ceramics:HTCC)基板、部品内蔵基板、再配線層(Redistribution Layer:RDL)を有する基板、または、プリント基板等が用いられる。
樹脂部材92は、モジュール基板91の主面91aに配置され、上記送信回路の一部、上記受信回路の一部、およびモジュール基板91の主面91aを覆っており、上記送信回路および上記受信回路を構成する回路素子の機械強度および耐湿性などの信頼性を確保する機能を有している。樹脂部材93は、モジュール基板91の主面91bに配置され、上記送信回路の一部、上記受信回路の一部、およびモジュール基板91の主面91bを覆っており、上記送信回路および上記受信回路を構成する回路素子の機械強度および耐湿性などの信頼性を確保する機能を有している。なお、樹脂部材92および93は、本発明に係る高周波モジュールに必須の構成要素ではない。
図3Aおよび図3Bに示すように、本実施例に係る高周波モジュール1Aでは、差動増幅回路10A、デュプレクサ30、40、整合回路61、62、63、およびスイッチ53は、モジュール基板91の主面91a(第2主面)に表面実装されている。一方、PA制御回路80、低雑音増幅器20、スイッチ51、52、およびダイプレクサ35は、モジュール基板91の主面91b(第1主面)に表面実装されている。また、出力トランス15は、モジュール基板91に内蔵形成されている。
本実施例では、増幅素子12および13は、主面91a(第2主面)に実装されている。一方、PA制御回路80は、主面91b(第1主面)に実装されている。また、低雑音増幅器20は、第1回路部品であり、主面91b(第1主面)に実装されている。
なお、デュプレクサ30、40、スイッチ53、整合回路61、62および63は、主面91a(第2主面)に実装されているが、主面91b(第1主面)に実装されていてもよい。また、スイッチ51、52、およびダイプレクサ35は、主面91b(第1主面)に実装されているが、主面91a(第2主面)に実装されていてもよい。
電力増幅器10は、少なくとも増幅素子12、13、段間トランス14および出力トランス15を有し、回路素子数が多くなり実装面積が大きくなるため、高周波モジュールが大型化する傾向にある。
これに対して、本実施例に係る高周波モジュール1Aの上記構成によれば、電力増幅器10を制御するPA制御回路80と差動増幅回路10Aとが両面実装されるので、高周波モジュール1を小型化できる。
また、ディジタル制御信号を入出力するPA制御回路80と、差動増幅回路10Aとが、モジュール基板91を挟んで配置されるので、差動増幅回路10Aがディジタルノイズを受けることを抑制できる。よって、電力増幅器10から出力される高周波信号の信号品質の劣化を抑制できる。
なお、モジュール基板91は、複数の誘電体層が積層された多層構造を有し、当該複数の誘電体層の少なくとも1つには、グランド電極パターンが形成されていることが望ましい。これにより、モジュール基板91の電磁界遮蔽機能が向上する。
また、本実施例に係る高周波モジュール1Aでは、モジュール基板91の主面91b(第1主面)側に、複数の外部接続端子150が配置されている。高周波モジュール1Aは、高周波モジュール1Aのz軸負方向側に配置される外部基板と、複数の外部接続端子150を経由して、電気信号のやりとりを行う。図3Aの(b)に示すように、複数の外部接続端子には、アンテナ接続端子100、送信入力端子110、および受信出力端子120が含まれる。また、複数の外部接続端子150のいくつかは、外部基板のグランド電位に設定される。主面91aおよび91bのうち、外部基板と対向する主面91bには、低背化が困難な差動増幅回路10Aが配置されず、低背化が容易な低雑音増幅器20が配置されているので、高周波モジュール1A全体を低背化することが可能となる。また、受信回路の受信感度に大きく影響する低雑音増幅器20の周囲に、グランド電極として適用される外部接続端子150が複数配置されるので、受信回路の受信感度の劣化を抑制できる。
なお、図3Aの(b)および図3Bに示すように、モジュール基板91を平面視した場合に、PA制御回路80と低雑音増幅器20との間に、複数の外部接続端子150のうちグランド電位に設定された外部接続端子150が配置されていることが望ましい。
これにより、低雑音増幅器20とPA制御回路80との間に、グランド電極として適用される外部接続端子150が配置されるので、受信感度の劣化を、より一層抑制できる。
また、本実施例において、整合回路63は少なくともインダクタを有し、当該インダクタは主面91a(第2主面)に配置されている。
これにより、受信回路の受信感度に大きく影響する上記インダクタとPA制御回路80とが、モジュール基板91を挟んで配置されるので、PA制御回路80に接続されたディジタル制御配線と上記インダクタとが電磁界結合することを抑制できる。よって、ディジタルノイズによる受信感度の劣化を抑制できる。
また、差動増幅回路10Aは、高周波モジュール1Aが有する回路部品のなかで発熱量が大きい部品である。高周波モジュール1Aの放熱性を向上させるには、差動増幅回路10Aの発熱を、小さな熱抵抗を有する放熱経路で外部基板に放熱することが重要である。仮に、差動増幅回路10Aを主面91bに実装した場合、差動増幅回路10Aに接続される電極配線は主面91b上に配置される。このため、放熱経路としては、主面91b上の(xy平面方向に沿う)平面配線パターンのみを経由した放熱経路を含むこととなる。上記平面配線パターンは、金属薄膜で形成されるため熱抵抗が大きい。このため、差動増幅回路10Aを主面91b上に配置した場合には、放熱性が低下してしまう。
これに対して、本実施例に係る高周波モジュール1Aは、図3Bに示すように、主面91aにて差動増幅回路10Aのグランド電極に接続され、主面91aから主面91bに到る放熱用ビア導体95Vをさらに備える。また、放熱用ビア導体95Vは、主面91bにて複数の外部接続端子150のうちグランド電位に設定された外部接続端子150と接続されている。
これによれば、差動増幅回路10Aを主面91aに実装した場合、放熱用ビア導体95Vを介して、差動増幅回路10Aと外部接続端子150とを接続できる。よって、差動増幅回路10Aの放熱経路として、モジュール基板91内の配線のうち熱抵抗の大きいxy平面方向に沿う平面配線パターンのみを経由した放熱経路を排除できる。よって、差動増幅回路10Aからの外部基板への放熱性が向上した小型の高周波モジュール1Aを提供することが可能となる。
なお、本実施例に係る高周波モジュール1Aでは、低雑音増幅器20、スイッチ51および52は、1つの半導体IC70に含まれていてもよい。これにより、高周波モジュール1Aを小型化できる。
また、本実施例に係る高周波モジュール1Aでは、出力トランス15は、モジュール基板91に内蔵されているが、チップ状の回路部品として主面91aまたは91bに表面実装されていてもよい。
なお、モジュール基板91を平面視した場合に、出力トランス15の形成領域と重なる領域には、回路部品が形成されていないことが望ましい。出力トランス15は、高出力の送信信号に対応して高いQ値を必要とするため、他の回路部品が近接することで出力トランス15により形成される磁界が変化しないことが望ましい。上記領域に回路部品が形成されていないことにより、出力トランス15を構成するインダクタの高Q値を維持できる。
さらに、モジュール基板91を平面視した場合、モジュール基板91における領域であって出力トランス15の形成領域と重なる領域には、グランド電極層は形成されていないことが望ましい。これによれば、出力トランス15とグランド電極との距離を大きく確保することが可能となるため、出力トランス15を構成するインダクタの高Q値を維持できる。
なお、出力トランス15の形成領域は、以下のように定義される。出力トランス15の形成領域とは、モジュール基板91を平面視した場合、一次側コイル15aの形成領域と二次側コイル15bの形成領域とを包含する最小領域である。
ここで、二次側コイル15bは、一次側コイル15aに沿って設けられ、一次側コイル15aとの第1距離が略一定の区間に配置された配線導体と定義される。このとき、上記区間の両側に位置する配線導体は、一次側コイル15aとの距離が第1距離よりも大きい第2距離であり、二次側コイル15bの一端および他端は、配線導体の一次側コイル15aまでの距離が第1距離から第2距離へ変化する地点である。また、一次側コイル15aは、二次側コイル15bに沿って設けられ、二次側コイル15bとの第1距離が略一定の区間に配置された配線導体と定義される。このとき、上記区間の両側に位置する配線導体は、二次側コイル15bとの距離が第1距離よりも大きい第2距離であり、一次側コイル15aの一端および他端は、配線導体の二次側コイル15bまでの距離が第1距離から第2距離へ変化する地点である。
あるいは、二次側コイル15bは、一次側コイル15aに沿って設けられ、線幅が略一定の第1幅を有する第1区間に配置された配線導体と定義される。また、一次側コイル15aは、二次側コイル15bに沿って設けられ、線幅が略一定の第1幅を有する第1区間に配置された配線導体と定義される。
あるいは、二次側コイル15bは、一次側コイル15aに沿って設けられ、膜厚が略一定の第1膜厚を有する第1区間に配置された配線導体と定義される。また、一次側コイル15aは、二次側コイル15bに沿って設けられ、膜厚が略一定の第1膜厚を有する第1区間に配置された配線導体と定義される。
あるいは、二次側コイル15bは、一次側コイル15aに沿って設けられ、一次側コイル15aとの結合度が略一定の第1結合度を有する第1区間に配置された配線導体と定義される。また、一次側コイル15aは、二次側コイル15bに沿って設けられ、二次側コイル15bとの結合度が略一定の第1結合度を有する第1区間に配置された配線導体と定義される。
なお、実施例1に係る高周波モジュール1Aにおいて、電力増幅器10の出力端子に接続され、電力増幅器10と送信フィルタ30Tおよび40Tとのインピーダンス整合をとる送信整合回路を備えてもよい。この送信整合回路は、例えば、インダクタおよびキャパシタなどの受動素子がSi基板の内部または表面に集積実装された集積型受動素子(IPD:Integrated Passive Device)であってもよい。上記送信整合回路がIPDである場合には、当該IPDが、主面91bに配置されたPA制御回路80上に積層されていてもよい。この構成によれば、PA制御回路80と送信整合用のIPDとが、主面91b上で積層されているので、高周波モジュール1Aの大型化を抑制できる。
なお、本実施例に係る高周波モジュール1Aでは、差動増幅回路10Aが主面91a(第2主面)に配置され、PA制御回路80が主面91b(第1主面)に配置されたが、差動増幅回路10Aが主面91b(第1主面)に配置され、PA制御回路80が主面91a(第2主面)に配置されてもよい。
図3Cは、変形例1に係る高周波モジュール1Bの断面構成概略図である。本変形例に係る高周波モジュール1Bは、実施例1に係る高周波モジュール1Aと比較して、差動増幅回路10AおよびPA制御回路80が配置される主面が逆になっている点である。なお、差動増幅回路10AおよびPA制御回路80以外の回路部品の配置については、実施例1に係る高周波モジュール1Aと同様である。
つまり、本変形例に係る高周波モジュール1Bでは、モジュール基板91の主面91b(第1主面)側に、複数の外部接続端子150が配置され、差動増幅回路10Aが主面91b(第1主面)に配置され、PA制御回路80が主面91a(第2主面)に配置されている。
本変形例に係る高周波モジュール1Bの上記構成によれば、電力増幅器10を制御するPA制御回路80と差動増幅回路10Aとが両面実装されるので、高周波モジュール1を小型化できる。また、ディジタル制御信号を入出力するPA制御回路80と、差動増幅回路10Aとが、モジュール基板91を挟んで配置されるので、差動増幅回路10Aがディジタルノイズを受けることを抑制できる。よって、電力増幅器10から出力される高周波信号の信号品質の劣化を抑制できる。
なお、外部接続端子150は、図3A、図3Bおよび図3Cに示すように、樹脂部材93をz軸方向に貫通する柱状電極であってもよいし、また、図3Dに示された、変形例2に係る高周波モジュール1Cのように、外部接続端子150は、主面91b上に形成されたバンプ電極160であってもよい。この場合には、主面91b側の樹脂部材93はなくてもよい。
また、実施例1に係る高周波モジュール1Aおよび変形例1に係る高周波モジュール1Bにおいて、外部接続端子150は、主面91aに配置されていてもよい。また、変形例2に係る高周波モジュール1Cにおいて、バンプ電極160は、主面91aに配置されていてもよい。
[3.実施例2に係る高周波モジュール1Dの回路素子配置構成]
図4Aは、実施例2に係る高周波モジュール1Dの平面構成概略図である。また、図4Bは、実施例2に係る高周波モジュール1Dの断面構成概略図であり、具体的には、図4AのIVB−IVB線における断面図である。なお、図4Aの(a)には、モジュール基板91の互いに対向する主面91aおよび91bのうち、主面91aをz軸正方向側から見た場合の回路素子の配置図が示されている。一方、図4Aの(b)には、主面91bをz軸正方向側から見た場合の回路素子の配置を透視した図が示されている。また、図4Aには、モジュール基板91内に形成された出力トランス15が破線で示されている。
実施例2に係る高周波モジュール1Dは、実施の形態に係る高周波モジュール1を構成する各回路素子の配置構成を具体的に示したものである。
本実施例に係る高周波モジュール1Dは、実施例1に係る高周波モジュール1Aと比較して、高周波モジュール1Dを構成する回路部品の配置構成のみが異なる。以下、本実施例に係る高周波モジュール1Dについて、実施例1に係る高周波モジュール1Aと同じ点は説明を省略し、異なる点を中心に説明する。
モジュール基板91は、互いに対向する主面91a(第1主面)および主面91b(第2主面)を有し、上記送信回路および上記受信回路を実装する基板である。モジュール基板91としては、例えば、複数の誘電体層の積層構造を有するLTCC基板、HTCC基板、部品内蔵基板、RDLを有する基板、または、プリント基板等が用いられる。
図4Aおよび図4Bに示すように、本実施例に係る高周波モジュール1Dでは、差動増幅回路10A、PA制御回路80、デュプレクサ30、40、整合回路61、62、63、およびスイッチ53は、モジュール基板91の主面91a(第1主面)に表面実装されている。一方、低雑音増幅器20、スイッチ51、52、およびダイプレクサ35は、モジュール基板91の主面91b(第2主面)に表面実装されている。また、出力トランス15は、モジュール基板91に内蔵形成されている。
本実施例では、増幅素子12および13は、主面91a(第1主面)に実装されている。また、PA制御回路80も、主面91a(第1主面)に実装されている。また、低雑音増幅器20は、第1回路部品であり、主面91b(第2主面)に実装されている。
なお、デュプレクサ30、40、スイッチ53、整合回路61、62および63は、主面91a(第1主面)に実装されているが、主面91b(第2主面)に実装されていてもよい。また、スイッチ51、52、およびダイプレクサ35は、主面91b(第2主面)に実装されているが、主面91a(第1主面)に実装されていてもよい。
電力増幅器10は、少なくとも増幅素子12、13、段間トランス14および出力トランス15を有し、回路素子数が多くなり実装面積が大きくなるため、高周波モジュールが大型化する傾向にある。
これに対して、本実施例に係る高周波モジュール1Dの上記構成によれば、電力増幅器10を制御するPA制御回路80と低雑音増幅器20とが両面実装されるので、高周波モジュール1を小型化できる。また、受信回路の受信感度に大きく影響する低雑音増幅器20とPA制御回路80とが、モジュール基板91を挟んで配置されるので、ディジタルノイズによる受信感度の劣化を抑制できる。
また、差動増幅回路10Aと低雑音増幅器20とが、モジュール基板91を挟んで配置されるので、送受信間のアイソレーションを大きく確保できる。
なお、モジュール基板91は、複数の誘電体層が積層された多層構造を有し、当該複数の誘電体層の少なくとも1つには、グランド電極パターンが形成されていることが望ましい。これにより、モジュール基板91の電磁界遮蔽機能が向上する。
また、本実施例に係る高周波モジュール1Dでは、モジュール基板91の主面91b(第2主面)側に、複数の外部接続端子150が配置されている。高周波モジュール1Dは、高周波モジュール1Dのz軸負方向側に配置される外部基板と、複数の外部接続端子150を経由して、電気信号のやりとりを行う。また、複数の外部接続端子150のいくつかは、外部基板のグランド電位に設定される。主面91aおよび91bのうち、外部基板と対向する主面91bには、低背化が困難な差動増幅回路10Aが配置されず、低背化が容易な低雑音増幅器20が配置されているので、高周波モジュール1D全体を低背化することが可能となる。また、受信回路の受信感度に大きく影響する低雑音増幅器20の周囲に、グランド電極として適用される外部接続端子150が複数配置されるので、受信回路の受信感度の劣化を抑制できる。
また、本実施例に係る高周波モジュール1Dは、図4Bに示すように、主面91aにて差動増幅回路10Aのグランド電極に接続され、主面91aから主面91bに到る放熱用ビア導体95Vをさらに備える。また、放熱用ビア導体95Vは、主面91bにて複数の外部接続端子150のうちグランド電位に設定された外部接続端子150と接続されている。
これによれば、差動増幅回路10Aを主面91aに実装した場合、放熱用ビア導体95Vを介して、差動増幅回路10Aと外部接続端子150とを接続できる。よって、差動増幅回路10Aの放熱経路として、モジュール基板91内の配線のうち熱抵抗の大きいxy平面方向に沿う平面配線パターンのみを経由した放熱経路を排除できる。よって、差動増幅回路10Aからの外部基板への放熱性が向上した小型の高周波モジュール1Dを提供することが可能となる。
また、図3Bに示すように、モジュール基板91を平面視した場合に、差動増幅回路10Aが配置された領域と重複する主面91b上の領域には、グランド電位に設定された外部接続端子150以外の回路部品は配置されていないことが望ましい。
これによれば、差動増幅回路10Aの放熱経路に回路部品が配置されていないので、高周波モジュール1Dが有する回路部品が、差動増幅回路10Aの発熱により、特性劣化してしまうことを回避できる。
なお、本実施例に係る高周波モジュール1Dでは、低雑音増幅器20、スイッチ51および52は、1つの半導体IC70に含まれていてもよい。これにより、高周波モジュール1Dを小型化できる。
また、本実施例に係る高周波モジュール1Dでは、出力トランス15は、モジュール基板91に内蔵形成されているが、チップ状の回路部品として主面91aまたは91bに表面実装されていてもよい。
また、本実施例に係る高周波モジュール1Dにおいて、外部接続端子150は、主面91aに配置されていてもよい。
[4.効果など]
以上、本実施の形態に係る高周波モジュール1は、互いに対向する主面91aおよび91bを有するモジュール基板91と、電力増幅器10と、第1回路部品と、電力増幅器10を制御するPA制御回路80と、を備え、電力増幅器10は、増幅素子12および13と、一次側コイル15aおよび二次側コイル15bを有する出力トランス15と、を有し、一次側コイル15aの一端は増幅素子12の出力端子に接続され、一次側コイル15aの他端は増幅素子13の出力端子に接続され、二次側コイル15bの一端は、電力増幅器10の出力端子に接続されており、PA制御回路80は主面91aおよび91bの一方に配置されており、増幅素子12および13、または、第1回路部品は、主面91aおよび91bの他方に配置されている。
これにより、PA制御回路80と差動増幅回路10Aまたは第1回路部品とが両面実装されるので、高周波モジュール1を小型化できる。また、PA制御回路80と差動増幅回路10Aとが異なる主面に配置された場合には、差動増幅回路10Aがディジタルノイズを受けることを抑制できる。よって、電力増幅器10から出力される高周波信号の信号品質の劣化を抑制できる。また、PA制御回路80と第1回路部品とが異なる主面に配置された場合には、第1回路部品がディジタルノイズにより特性劣化することを抑制できる。よって、差動増幅型の電力増幅器10から出力される高周波信号の信号品質の劣化が抑制された小型の高周波モジュール1を提供できる。
また、実施例1に係る高周波モジュール1Aにおいて、増幅素子12および13は主面91aに配置されていてもよい。
これによれば、差動増幅回路10AとPA制御回路80とがモジュール基板91を挟んで配置されるので、差動増幅回路10Aがディジタルノイズを受けることを抑制できる。
また、実施例1に係る高周波モジュール1Aは、さらに、主面91bに配置された複数の外部接続端子150を備え、第1回路部品は、主面91bに配置された低雑音増幅器20であり、モジュール基板91を平面視した場合に、PA制御回路80と低雑音増幅器20との間に、グランド電位に設定された外部接続端子150が配置されていてもよい。
これにより、外部基板と対向する主面91bには、低背化が困難な差動増幅回路10Aが配置されず、低背化が容易な低雑音増幅器20が配置されるので、高周波モジュール1Aを低背化することが可能となる。また、受信回路の受信感度に大きく影響する低雑音増幅器20とPA制御回路80との間に、グランド電極として適用される外部接続端子150が配置されるので、受信感度の劣化を抑制できる。
また、実施例1に係る高周波モジュール1Aは、さらに、低雑音増幅器20の入力端子に接続されたインダクタを備え、当該インダクタは主面91aに配置されていてもよい。
これにより、受信回路の受信感度に大きく影響する上記インダクタとPA制御回路80とが、モジュール基板91を挟んで配置されるので、PA制御回路80の制御配線と上記インダクタとが電磁界結合することを抑制できるので、ディジタルノイズによる受信感度の劣化を抑制できる。
また、実施例1に係る高周波モジュール1Aは、さらに、差動増幅回路10Aのグランド電極に接続され、主面91aから主面91bに到る放熱用ビア導体95Vを備え、放熱用ビア導体95Vは、主面91bにてグランド電位に設定された外部接続端子150と接続されていてもよい。
これにより、差動増幅回路10Aの放熱経路として、モジュール基板91内の配線のうち熱抵抗の大きいxy平面方向に沿う平面配線パターンのみを経由した放熱経路を排除できる。よって、差動増幅回路10Aからの外部基板への放熱性が向上した小型の高周波モジュール1Aを提供できる。
また、実施例2に係る高周波モジュール1Dにおいて、第1回路部品は、主面91bに配置された低雑音増幅器20である。
これにより、受信回路の受信感度に大きく影響する低雑音増幅器20とPA制御回路80とが、モジュール基板91を挟んで配置されるので、ディジタルノイズによる受信感度の劣化を抑制できる。
また、実施例2に係る高周波モジュール1Dは、さらに、主面91bに配置された複数の外部接続端子150を備え、増幅素子12および13は主面91aに配置されていてもよい。
これにより、差動増幅回路10Aと低雑音増幅器20とが、モジュール基板91を挟んで配置されるので、送受信間のアイソレーションを大きく確保できる。
また、実施例2に係る高周波モジュール1Dは、さらに、差動増幅回路10Aのグランド電極に接続され、主面91aから主面91bに到る放熱用ビア導体95Vを備え、放熱用ビア導体95Vは、主面91bにてグランド電位に設定された外部接続端子150と接続されていてもよい。
これにより、差動増幅回路10Aからの外部基板への放熱性が向上した小型の高周波モジュール1Dを提供できる。
また、実施例2に係る高周波モジュール1Dにおいて、モジュール基板91を平面視した場合に、増幅素子12および13が配置された領域と重複する主面91b上の領域には、グランド電位に設定された外部接続端子150以外の回路部品は配置されていないことが望ましい。
これによれば、差動増幅回路10Aの放熱経路に回路部品が配置されていないので、高周波モジュール1Dが有する回路部品が、差動増幅回路10Aの発熱により特性劣化してしまうことを回避できる。
また、通信装置5は、アンテナ2と、アンテナ2で送受信される高周波信号を処理するRFIC3と、アンテナ2とRFIC3との間で高周波信号を伝送する高周波モジュール1と、を備える。
これにより、差動増幅型の電力増幅器10から出力される高周波信号の信号品質の劣化が抑制された小型の通信装置5を提供することが可能となる。
(その他の実施の形態など)
以上、本発明の実施の形態に係る高周波モジュールおよび通信装置について、実施の形態、実施例および変形例を挙げて説明したが、本発明に係る高周波モジュールおよび通信装置は、上記実施の形態、実施例および変形例に限定されるものではない。上記実施の形態、実施例および変形例における任意の構成要素を組み合わせて実現される別の実施の形態や、上記実施の形態、実施例および変形例に対して本発明の主旨を逸脱しない範囲で当業者が思いつく各種変形を施して得られる変形例や、上記高周波モジュールおよび通信装置を内蔵した各種機器も本発明に含まれる。
例えば、上記実施の形態、実施例および変形例に係る高周波モジュールおよび通信装置において、図面に開示された各回路素子および信号経路を接続する経路の間に、別の回路素子および配線などが挿入されていてもよい。
本発明は、マルチバンド対応のフロントエンド部に配置される高周波モジュールとして、携帯電話などの通信機器に広く利用できる。
1、1A、1B、1C、1D 高周波モジュール
2 アンテナ
3 RF信号処理回路(RFIC)
4 ベースバンド信号処理回路(BBIC)
5 通信装置
10 電力増幅器
10A 差動増幅回路
11、12、13 増幅素子
14 段間トランス
14a、15a 一次側コイル
14b、15b 二次側コイル
15 出力トランス
16 キャパシタ
20 低雑音増幅器
30、40 デュプレクサ
30R、40R 受信フィルタ
30T、40T 送信フィルタ
35 ダイプレクサ
35H、35L フィルタ
51、52、53 スイッチ
61、62、63 整合回路
70 半導体IC
80 PA制御回路
91 モジュール基板
91a、91b 主面
92、93 樹脂部材
95V 放熱用ビア導体
100 アンテナ接続端子
110 送信入力端子
115 入力端子
116 出力端子
120 受信出力端子
130 制御信号端子
150 外部接続端子
160 バンプ電極

Claims (10)

  1. 互いに対向する第1主面および第2主面を有するモジュール基板と、
    送信信号を増幅する電力増幅器と、
    第1回路部品と、
    前記電力増幅器を制御する制御回路と、を備え、
    前記電力増幅器は、
    第1増幅素子および第2増幅素子と、
    第1コイルおよび第2コイルを有する出力トランスと、を有し、
    前記第1コイルの一端は前記第1増幅素子の出力端子に接続され、前記第1コイルの他端は前記第2増幅素子の出力端子に接続され、前記第2コイルの一端は、前記電力増幅器の出力端子に接続されており、
    前記制御回路は、前記第1主面に配置されており、
    前記第1増幅素子および前記第2増幅素子、または、前記第1回路部品は、前記第2主面に配置されている、
    高周波モジュール。
  2. 前記第1増幅素子および前記第2増幅素子は、前記第2主面に配置されている、
    請求項1に記載の高周波モジュール。
  3. さらに、
    前記第1主面に配置された複数の外部接続端子を備え、
    前記第1回路部品は、前記第1主面に配置された、受信信号を増幅する低雑音増幅器であり、
    前記モジュール基板を平面視した場合に、前記制御回路と前記低雑音増幅器との間に、前記複数の外部接続端子のうちグランド電位に設定された外部接続端子が配置されている、
    請求項2に記載の高周波モジュール。
  4. さらに、
    前記低雑音増幅器の入力端子に接続されたインダクタを備え、
    前記インダクタは、前記第2主面に配置されている、
    請求項3に記載の高周波モジュール。
  5. さらに、
    前記第1増幅素子または前記第2増幅素子のグランド電極に接続され、前記第2主面から前記第1主面に到る放熱用ビア導体を備え、
    前記放熱用ビア導体は、前記第1主面にて前記複数の外部接続端子のうちグランド電位に設定された外部接続端子と接続されている、
    請求項3または4に記載の高周波モジュール。
  6. 前記第1回路部品は、前記第2主面に配置された、受信信号を増幅する低雑音増幅器である、
    請求項1に記載の高周波モジュール。
  7. さらに、
    前記第2主面に配置された複数の外部接続端子を備え、
    前記第1増幅素子および前記第2増幅素子は、前記第1主面に配置されている、
    請求項6に記載の高周波モジュール。
  8. さらに、
    前記第1増幅素子または前記第2増幅素子のグランド電極に接続され、前記第1主面から前記第2主面に到る放熱用ビア導体を備え、
    前記放熱用ビア導体は、前記第2主面にて前記複数の外部接続端子のうちグランド電位に設定された外部接続端子と接続されている、
    請求項7に記載の高周波モジュール。
  9. 前記モジュール基板を平面視した場合に、前記第1増幅素子および前記第2増幅素子と重複する前記第2主面上の領域には、前記グランド電位に設定された外部接続端子以外の回路部品は配置されていない、
    請求項8に記載の高周波モジュール。
  10. アンテナと、
    前記アンテナで送受信される高周波信号を処理するRF信号処理回路と、
    前記アンテナと前記RF信号処理回路との間で前記高周波信号を伝送する請求項1〜9のいずれか1項に記載の高周波モジュールと、を備える、
    通信装置。
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