JP2019145682A - 誘電体素子の製造方法、および、誘電体素子 - Google Patents
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Abstract
Description
本発明は、絶縁体層の積層に起因した誘電特性の劣化を軽減可能にした誘電体素子の製造方法、および、誘電体素子を提供することを目的とする。
[誘電体素子]
図1が示すように、誘電体素子は、下地層11の上に位置し、酸化物誘電体層12、上部電極13、および、上部絶縁体層14を備える。
上部電極13は、酸化物誘電体層12の表面に位置する。上部電極13は、酸化物誘電体層12の表面に接し、酸化物誘電体層12に電圧を印加する。
下地層11が下部電極である例を用いて、誘電体素子の製造方法を説明する。
図2が示すように、誘電体素子の製造方法は、下部電極(下地層11)を形成すること(ステップS11)、酸化物誘電体層12を形成すること(ステップS12)、上部電極13を形成すること(ステップS13)、および、上部絶縁体層14を形成すること(ステップS14)を含む。
下部電極の形成では、例えば、スパッタリング法を用いて、基板の表面に金属膜を形成し、下部電極の形状に合わせて金属膜をパターニングする。
上部電極13の形成では、例えば、スパッタリング法を用いて、基板の表面に金属膜を形成し、下部電極の形状に合わせて金属膜をパターニングする。
誘電体素子の製造方法に用いられるプラズマCVD装置を説明する。
図3が示すように、プラズマCVD装置20は、絶縁体層を形成するための成膜空間を区画する真空槽21を備える。真空槽21は、支持部22を収容する。支持部22は、酸化物誘電体層が形成された基板Sなどの成膜対象を支持する。真空槽21のなかで、支持部22と対向する位置には、拡散部23が位置している。拡散部23は、絶縁体層を形成するためのガスを成膜空間に拡散する。拡散部23は、例えば、金属製のシャワープレートである。拡散部23は、プラズマCVD装置20が備える電極として機能する。
上部絶縁体層14に関わる試験例を以下に説明する。
上記プラズマCVD装置を用いた下記成膜条件による成膜によって、試験例の上部絶縁体層14を得た。この際、高周波電力の値を400W以上4000W以下の間で変更し、上部絶縁体層14の形成時における高周波電力の値が互いに異なる複数の上部絶縁体層14を得た。そして、各試験例の上部絶縁体層14について、構成原子の濃度、屈折率、および、膜ストレスを測定した。各上部絶縁体層14に対する測定の結果を、表1から表3に示す。
<成膜条件>
・成膜材料M :TICS
・成膜材料Mの流量 :55sccm
・酸素含有ガス :O2
・酸素含有ガスの流量 :2500sccm
・成膜空間の圧力 :175Pa
・高周波電力 :400W以上4000W以下
・拡散部23における電極面積:2700cm2
測定対象原子 :水素、炭素、酸素
原子濃度測定機:二次イオン質量分析機(ADEPT1010、アルバック・ファイ(株)製) 屈折率測定機 :分光エリプソメーター(M-2000V、ジェー・エー・ウーラム社製)
ストレス測定機:薄膜応力測定装置(FLX-2000-A、東邦テクノロジー(株)製)
表1が示すように、上部絶縁体層14の形成時での高周波電力が大きいほど、水素原子の濃度が小さいことが認められた。そして、高周波電力が1000W以上であるとき、上部絶縁体層14での水素原子の濃度が1×1021個/cm3以下であることが認められた。また、高周波電力に対する成膜ガスの流量の比が18W/sccm以上であるとき、上部絶縁体層14での水素原子の濃度が1×1021個/cm3以下であることが認められた。
酸化物誘電体層12の分極率に関わる試験例を説明する。図4は、分極率の測定に用いた試験例の第1層構造を示し、図5は、分極率の測定に用いた試験例の第2層構造を示す。
図4が示すように、第1層構造を備える誘電体素子は、基板S、下地層11、酸化物誘電体層12、上部電極13、および、上部絶縁体層14を備える。
下地層11、酸化物誘電体層12、および、上部電極13を備えた基板Sに、上記プラズマCVD装置を用いた下記成膜条件1による絶縁膜を形成し、その絶縁膜にプローブ孔を形成することによって、上部絶縁体層14を形成した。これによって、第1層構造を備えた試験例1の誘電体素子を得た。
また、上部絶縁体層14を形成せず、それ以外を試験例1と同じくして、第2層構造を備えた試験例2の誘電体素子を得た。
また、上記プラズマCVD装置における第1ガス供給部25を、SiH4を供給するガス供給系に変更し、下記成膜条件2による絶縁膜を形成した。すなわち、第1ガス供給部25以外の点を試験例1と同じくして、第1層構造を備えた試験例3の誘電体素子を得た。そして、試験例1〜3の上部絶縁体層14について、上部絶縁体層14に形成された2つの貫通孔にプローブを押し当て、分極率のヒステリシスカーブを測定した。ヒステリシスカーブの測定の結果を、図6から図8に示す。
<成膜条件1>
・成膜材料M TICS
・成膜材料Mの流量 55sccm
・酸素含有ガス O2
・酸素含有ガスの流量 2500sccm
・成膜空間の圧力 175Pa
・高周波電力 1600W
・拡散部23における電極面積 2700cm2
<成膜条件2>
・成膜材料 SiH4
・成膜材料の流量 70sccm
・酸素含有ガス N20
・酸素含有ガスの流量 3500sccm
・成膜空間の圧力 200Pa
・高周波電力 800W
・拡散部23における電極面積 2700cm2
<測定条件>
分極ヒステリシス測定機:強誘電体特性評価システム(FCE−1A、東洋テクニカ社製)
図6が示すように、試験例1の酸化物誘電体層12では、自発分極P1,P2と、残留分極P3とが認められた。すなわち、上部絶縁体層14での水素原子の濃度が1×1021個/cm3以下である酸化物誘電体層12では、誘電体素子に求められる自発分極P1,P2と、誘電体素子に求められる残留分極P3とが認められた。なお、図7が示すように、試験例2の酸化物誘電体層12では、試験例1と同じ程度に、自発分極P1,P2と、残留分極P3とが認められた。
以上、上記一実施形態によれば、以下に列挙する効果を得ることができる。
・上部絶縁体層は、単層構造に限らず、例えば、多層構造に変更することも可能である。この際、酸化物誘電体層12の表面に位置する絶縁体層において、ケイ素酸化物が主成分であり、かつ、水素原子の濃度が1×1021個/cm3以下であればよい。
Claims (7)
- 表面を含む酸化物誘電体層を形成することと、
前記酸化物誘電体層の前記表面に、ケイ素酸化物が主成分であり、かつ、水素原子の濃度が1×1021個/cm3以下である絶縁体層を形成することと、
を含む
誘電体素子の製造方法。 - 前記絶縁体層を形成することは、水素を含まないシリルイソシアネート化合物からなる原料ガスと、水素を含まない酸素含有ガスとを用いたプラズマCVD法によって前記絶縁体層を形成することである
請求項1に記載の誘電体素子の製造方法。 - 前記シリルイソシアネート化合物は、Si(NCO)4、Si(NCO)3Cl、Si(NCO)2Cl2、および、Si(NCO)Cl3からなる群から選択されるいずれか1種類である
請求項2に記載の誘電体素子の製造方法。 - 前記酸素含有ガスは、O2、O3、N2O、CO、および、CO2からなる群から選択されるいずれか1種類である
請求項2または3に記載の誘電体素子の製造方法。 - 前記絶縁体層を形成することは、
前記原料ガスと、前記酸素含有ガスとを前記絶縁体層を形成するための成膜空間に供給して混合ガスを生成することと、
前記成膜空間に位置する電極に電力を供給して前記混合ガスからプラズマを生成することと、を含む
請求項2から4のいずれか一項に記載の誘電体素子の製造方法。 - 前記シリルイソシアネート化合物は、Si(NCO)4であり、
前記酸素含有ガスは、O2であり、
Si(NCO)4の単位流量に対する、成膜空間に供給する電力の比が、18W/sccm以上である
請求項2から5のいずれか一項に記載の誘電体素子の製造方法。 - 表面を含む酸化物誘電体層と、
前記酸化物誘電体層の前記表面に位置する絶縁体層であって、ケイ素酸化物が主成分であり、かつ、水素原子の濃度が1×1021個/cm3以下である前記絶縁体層と、
を備える
誘電体素子。
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JPH104089A (ja) * | 1996-06-17 | 1998-01-06 | Sony Corp | 低誘電率酸化シリコン系絶縁膜の形成方法およびこれを用いた半導体装置 |
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