JP2019041062A - リードフレームおよび半導体装置の製造方法 - Google Patents
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Abstract
Description
まず、図1乃至図4により、本実施の形態によるリードフレームの概略について説明する。図1は、本実施の形態によるリードフレームの一部を示す平面図であり、図2は、本実施の形態によるリードフレームの一部を示す底面図であり、図3は、本実施の形態によるリードフレームを示す断面図であり、図4(a)−(c)は、それぞれコネクティングバーを示す拡大平面図である。
次に、図5および図6により、本実施の形態による半導体装置について説明する。図5および図6は、本実施の形態による半導体装置(QFNタイプ)を示す図である。
次に、図1乃至図4に示すリードフレーム10の製造方法について、図7(a)−(e)を用いて説明する。なお、図7(a)−(e)は、リードフレーム10の製造方法を示す断面図(図3に対応する図)である。
次に、図5および図6に示す半導体装置20の製造方法について、図8(a)−(d)及び図9(a)−(c)を用いて説明する。
次に、図11乃至図15により、本実施の形態によるリードフレームの各変形例について説明する。図11乃至図15に示す変形例は、深さ確認マークの構成が異なるものであり、他の構成は、図1乃至図10に示す実施の形態と略同一である。図11乃至図15において、図1乃至図10と同一部分には同一の符号を付して詳細な説明は省略する。
図11に示すリードフレーム10Aにおいて、コネクティングバー13に深さ確認マーク40Aが設けられている。この場合、深さ確認マーク40Aは、表面側から薄肉化された一対の薄肉部47と、一対の薄肉部47の間に位置し、薄肉化されていない中間部48とを有している。
図13に示すリードフレーム10Bにおいて、深さ確認マーク40Bは、表面側から薄肉化された一対の薄肉部47と、一対の薄肉部47の間に位置し、薄肉化されていない中間部48とを有している。
図14に示すリードフレーム10Cにおいて、深さ確認マーク40Cは、ステップカット領域45上であって、コネクティングバー13同士を互いに連結する連結部19に設けられている。深さ確認マーク40Cは、平面視で略正方形形状を有している。各深さ確認マーク40Cは、連結部19の中央部に形成されている。各深さ確認マーク40Cの一辺の長さL3は、コネクティングバー13の幅W2の30%以上70%以下としても良い。
図15に示すリードフレーム10Dにおいて、深さ確認マーク40Dは、ステップカット領域45上であって、外周領域18に設けられている。深さ確認マーク40Dは、平面視で略長方形形状を有している。各深さ確認マーク40Dは、ステップカット領域45の幅方向中央部に形成されている。
10a パッケージ領域
11 ダイパッド
12 リード部
13 コネクティングバー
14 吊りリード
15 内部端子
17 外部端子
18 外周領域
19 連結部
20 半導体装置
21 半導体素子
22 ボンディングワイヤ
23 封止樹脂
40 深さ確認マーク
45 ステップカット領域
46 切断領域
Claims (7)
- リードフレームにおいて、
外周領域と、
前記外周領域内に配置されたパッケージ領域と、
前記パッケージ領域の周囲から前記外周領域に延びるとともに、裏面側から前記リードフレームの厚み方向の一部を切除する領域である、ステップカット領域とを備え、
前記ステップカット領域上に、表面側から薄肉化されることにより深さ確認マークが形成されている、リードフレーム。 - 前記パッケージ領域の周囲にコネクティングバーが配置され、前記深さ確認マークは、前記コネクティングバーに設けられている、請求項1記載のリードフレーム。
- 前記深さ確認マークは、表面側から薄肉化された一対の薄肉部と、前記一対の薄肉部の間に位置し、薄肉化されていない中間部とを有する、請求項1又は2記載のリードフレーム。
- 前記中間部の側面に、テーパー面が形成されている、請求項3記載のリードフレーム。
- 前記パッケージ領域の周囲に、互いに直交する2つのコネクティングバーと、前記2つのコネクティングバーを互いに連結する連結部とが配置され、前記深さ確認マークは、前記連結部に設けられている、請求項1記載のリードフレーム。
- 前記深さ確認マークは、前記外周領域に設けられている、請求項1記載のリードフレーム。
- 半導体装置の製造方法において、
請求項1乃至6のいずれか一項記載のリードフレームを準備する工程と、
前記リードフレームを封止樹脂により封止する工程と、
前記ステップカット領域に沿って、前記リードフレームの厚み方向の一部を切除する工程と、
前記パッケージ領域毎に前記リードフレーム及び前記封止樹脂を切断する工程とを備えた、半導体装置の製造方法。
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