JP2014160341A - データ処理装置およびデータ処理方法 - Google Patents
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Abstract
【解決手段】メモリに記憶されたデータにアクセスする第1マスタおよび第2マスタによるアクセスを調停する第1サブアービタと、第1マスタおよび第2マスタ以外の複数のマスタによるメモリに対するアクセスを調停する第2サブアービタと、第1サブアービタからメモリに対するアクセスを、第2サブアービタからメモリに対するアクセスより優先させるメインアービタと、第2マスタによるメモリに対するアクセス量を予め設定された範囲内に制限する制限部と、を備えるデータ処理装置を提供する。
【選択図】図1
Description
20 プロッタエンジン
30 メモリ
40 ディスク記憶装置
50 データ処理装置
51 デバイスインターフェイス
52 出力用DMA
53 デコーダ用読出DMA
54 デコーダ
55 デコーダ用書込DMA
61 ディスクコントローラ
62 エンコーダ
63 グラフィックコントローラ
64 CPU
65 GPU
71 第1アービタ
72 第2アービタ
73 第3アービタ
74 メモリコントローラ
81 制限部
82 セレクタ
101 クロックカウンタ
102 範囲記憶部
103 抑制部
104 モード設定部
105 範囲設定部
111 転送帯域検出部
112 上限記憶部
113 抑制部
114 モード設定部
115 上限設定部
121 データ転送サイクル数カウンタ
122 レジスタ
Claims (9)
- メモリに記憶されたデータにアクセスする第1マスタおよび第2マスタによる前記アクセスを調停する第1サブアービタと、
前記第1マスタおよび前記第2マスタ以外の複数のマスタによる前記メモリに対するアクセスを調停する第2サブアービタと、
前記第1サブアービタから前記メモリに対するアクセスを、前記第2サブアービタから前記メモリに対するアクセスより優先させるメインアービタと、
前記第2マスタによる前記メモリに対するアクセス量を予め設定された範囲内に制限する制限部と、
を備えるデータ処理装置。 - 前記第1マスタは、前記メモリに記憶された画像データを1ライン単位でのリアルタイム性を確保して読み出し、
前記第2マスタは、画像処理がされた画像データを前記メモリに書き込み、
前記制限部は、前記第2マスタによる前記画像データの前記メモリに対する書き込みアクセスのアクセス量を所定の帯域の範囲内に制限する
請求項1に記載のデータ処理装置。 - 前記制限部は、前記第1サブアービタにおける前記第2マスタとの間のバス接続ポートに設けられる請求項1または2に記載のデータ処理装置。
- 前記制限部は、前記第2マスタにおける前記第1サブアービタとの間のバス接続ポートに設けられる請求項1または2に記載のデータ処理装置。
- 前記制限部は、
前記第1サブアービタと前記第2マスタとの間のバスクロックをカウントするクロックカウンタと、
前記クロックカウンタのカウント値の範囲を予め記憶する範囲記憶部と、
前記クロックカウンタのカウント値が前記範囲記憶部に記憶された範囲内の場合に、前記第2マスタによる前記メモリへのアクセスを遮断する抑制部と、
を有する請求項3または4に記載のデータ処理装置。 - 前記制限部は、
前記第1サブアービタと前記第2マスタとの間のデータの転送帯域を検出する転送帯域検出部と、
前記転送帯域の上限を予め記憶する上限記憶部と、
前記転送帯域検出部により検出された前記転送帯域が前記上限記憶部に記憶された前記上限を超えた場合に、前記第2マスタによる前記メモリへのアクセスを遮断する抑制部と、
を有する請求項3または4に記載のデータ処理装置。 - 前記制限部による制限を有効とするか否かを設定するモード設定部
をさらに備える請求項1から6の何れか1項に記載のデータ処理装置。 - 前記モード設定部は、外部のデバイスが動作しているか否かを示すモード信号を受け取り、受け取ったモード信号に応じて前記制限部による制限を有効とするか否かを設定する
請求項7に記載のデータ処理装置。 - メモリに記憶されたデータにアクセスする第1マスタおよび第2マスタによる前記アクセスを調停する第1サブアービタと、前記第1マスタおよび前記第2マスタ以外の複数のマスタによる前記メモリに対するアクセスを調停する第2サブアービタとを備えたデータ処理装置におけるデータ処理方法であって、
前記第1サブアービタから前記メモリに対するアクセスを、前記第2サブアービタから前記メモリに対するアクセスより優先させ、
前記第2マスタによる前記メモリに対するアクセス量を予め設定された範囲内に制限する
データ処理方法。
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