JP2014120973A - 電流帰還型出力回路 - Google Patents
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Abstract
【解決手段】電流帰還型出力回路は、第1、第2のトランジスタを備える。電流帰還型出力回路は、非反転入力端子、反転入力端子、第1の出力端子、及び第2の出力端子を有し、非反転入力端子の入力インピーダンスが反転入力端子の入力インピーダンスよりも高くなっており、非反転入力端子に入力される入力信号の電流と反転入力端子に入力される電流の差を増幅した電流を第1の出力端子と第2の出力端子との間に流す電流アンプを備える。電流帰還型出力回路は、第1から第6のカレントミラー回路を備える。電流帰還型出力回路は、信号出力端子の電圧に応じた電流を、反転入力端子に供給する電流帰還回路を備える。
【選択図】図1
Description
VL1 第1の電源レール
VL2 第2の電源レール
TOUT 信号出力端子
M1 第1のトランジスタ(pMOSトランジスタ)
M2 第2のトランジスタ(nMOSトランジスタ)
CA1 第1のカレントミラー回路
CA2 第2のカレントミラー回路
CA3 第3のカレントミラー回路
CA4 第4のカレントミラー回路
CA5 第5のカレントミラー回路
CA6 第6のカレントミラー回路
101 電流帰還回路
102 電流アンプ
Claims (5)
- 出力信号を出力する信号出力端子と、
前記信号出力端子と第1の電圧が印加される第1の電源レールとの間に接続された第1導電型の第1のトランジスタと、
前記信号出力端子と前記第1の電圧よりも低い第2の電圧が印加される第2の電源レールとの間に接続され、第1導電型と異なる第2導電型の第2のトランジスタと、
非反転入力端子、反転入力端子、第1の出力端子、及び第2の出力端子を有し、前記非反転入力端子の入力インピーダンスが前記反転入力端子の入力インピーダンスよりも高くなっており、前記非反転入力端子に入力される入力信号の電流と前記反転入力端子に入力される電流の差を増幅した電流を前記第1の出力端子と前記第2の出力端子との間に流す電流アンプと、
前記第1の電源レールと前記第1の出力端子との間に流れる電流をカレントミラーした第1のミラー電流を、前記第1の電源レールと第1のノードとの間に流す第1のカレントミラー回路と、
前記第2の電源レールと前記第2の出力端子との間に流れる電流をカレントミラーした第2のミラー電流を、前記第2の電源レールと第2のノードとの間に流す第2のカレントミラー回路と、
前記第1の電源レールと第3のノードとの間に流れる電流をカレントミラーした第3のミラー電流を、前記第1の電源レールと、前記第1のトランジスタの制御端子に接続された第4のノードとの間に流す第3のカレントミラー回路と、
前記第2の電源レールと第5のノードとの間に流れる電流をカレントミラーした第3のミラー電流を、前記第1の電源レールと、前記第2のトランジスタの制御端子に接続された第6のノードとの間に流す第4のカレントミラー回路と、
前記第3のノードと前記第2のノードとの間に流れる電流をカレントミラーした第5のミラー電流を、前記第4のノードと前記第6のノードとの間に流す第5のカレントミラー回路と、
前記第5のノードと前記第1のノードとの間に流れる電流をカレントミラーした第6のミラー電流を、前記第6のノードと前記第4のノードとの間に流す第6のカレントミラー回路と、
前記信号出力端子の電圧に応じた電流を、前記反転入力端子に供給する電流帰還回路と、を備える
ことを特徴とする電流帰還型出力回路。 - 前記電流アンプは、
前記第1の電源レールに一端が接続され、電流を出力する電流源と、
前記電流源の他端に一端が接続され、ダイオード接続された第2導電型の第3のトランジスタと、
前記第3のトランジスタの他端に一端が接続され、前記非反転入力端子に他端が接続され、ダイオード接続された第1導電型の第4のトランジスタと、
前記第1の出力端子に一端が接続され、前記反転入力端子に他端が接続され、前記第3のトランジスタの制御端子に制御端子が接続された第2導電型の第5のトランジスタと、
前記反転入力端子に一端が接続され、前記第2の出力端子に他端が接続され、前記第4のトランジスタの制御端子に制御端子が接続された第1導電型の第6のトランジスタと、を備える
ことを特徴とする請求項1に記載の電流帰還型出力回路。 - 前記第1のカレントミラー回路の第1のミラー比は、前記第2のカレントミラー回路の第2のミラー比と等しく設定されており、
前記第3のカレントミラー回路の第3のミラー比は、前記第4のカレントミラー回路の第4のミラー比と等しく設定されており、
前記第5のカレントミラー回路の第5のミラー比は、前記第6のカレントミラー回路の第6のミラー比と等しく設定されており、
前記第3、第4のミラー比は、前記第5、第6のミラー比の2倍であることを特徴とする請求項1または2に記載の電流帰還型出力回路。 - 前記第1のカレントミラー回路は、
前記第1の電源レールに一端が接続され、前記第1の出力端子に他端が接続され、ダイオード接続された第1導電型の第7のトランジスタと、
前記第1の電源レールに一端が接続され、前記第1のノードに他端が接続され、前記第7のトランジスタの制御端子に制御端子が接続された第1導電型の第8のトランジスタと、を備え、
前記第2のカレントミラー回路は、
前記第2の電源レールに一端が接続され、前記第2の出力端子に他端が接続され、ダイオード接続された第2導電型の第9のトランジスタと、
前記第2の電源レールに一端が接続され、前記第2のノードに他端が接続され、前記第9のトランジスタの制御端子に制御端子が接続された第2導電型の第10のトランジスタと、を備え、
前記第3のカレントミラー回路は、
前記第1の電源レールに一端が接続され、前記第3のノードに他端が接続され、ダイオード接続された第1導電型の第11のトランジスタと、
前記第1の電源レールに一端が接続され、前記第4のノードに他端が接続され、前記第11のトランジスタの制御端子に制御端子が接続された第1導電型の第12のトランジスタと、を備え、
前記第4のカレントミラー回路は、
前記第2の電源レールに一端が接続され、前記第5のノードに他端が接続され、ダイオード接続された第2導電型の第13のトランジスタと、
前記第2の電源レールに一端が接続され、前記第6のノードに他端が接続され、前記第13のトランジスタの制御端子に制御端子が接続された第2導電型の第14のトランジスタと、を備え、
前記第5のカレントミラー回路は、
前記第3のノードに一端が接続され、前記第2のノードに他端が接続され、ダイオード接続された第1導電型の第15のトランジスタと、
前記第4のノードに一端が接続され、前記第6のノードに他端が接続され、前記第15のトランジスタの制御端子に制御端子が接続された第1導電型の第16のトランジスタと、を備え、
前記第6のカレントミラー回路は、
前記第5のノードに一端が接続され、前記第1のノードに他端が接続され、ダイオード接続された第2導電型の第17のトランジスタと、
前記第6のノードに一端が接続され、前記第4のノードに他端が接続され、前記第17のトランジスタの制御端子に制御端子が接続された第2導電型の第18のトランジスタと、を備える
ことを特徴とする請求項1から3のいずれか一項に記載の電流帰還型出力回路。 - 前記電流帰還回路は、
前記反転入力端子に一端が接続され、前記信号出力端子に他端が接続された第1の抵抗と、
前記反転入力端子に一端が接続され、基準電圧が印加される基準端子に他端が接続された第2の抵抗と、を備える
ことを特徴とする請求項1から4のいずれか一項に記載の電流帰還型出力回路。
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