JP2014099465A - Method for manufacturing epitaxial silicon wafer, epitaxial silicon wafer, and method for manufacturing solid state image sensor - Google Patents

Method for manufacturing epitaxial silicon wafer, epitaxial silicon wafer, and method for manufacturing solid state image sensor Download PDF

Info

Publication number
JP2014099465A
JP2014099465A JP2012249437A JP2012249437A JP2014099465A JP 2014099465 A JP2014099465 A JP 2014099465A JP 2012249437 A JP2012249437 A JP 2012249437A JP 2012249437 A JP2012249437 A JP 2012249437A JP 2014099465 A JP2014099465 A JP 2014099465A
Authority
JP
Japan
Prior art keywords
silicon wafer
epitaxial
layer
epitaxial silicon
oxygen
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2012249437A
Other languages
Japanese (ja)
Other versions
JP6280301B2 (en
Inventor
Takeshi Kadono
武 門野
Kazunari Kurita
一成 栗田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sumco Corp
Original Assignee
Sumco Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sumco Corp filed Critical Sumco Corp
Priority to JP2012249437A priority Critical patent/JP6280301B2/en
Publication of JP2014099465A publication Critical patent/JP2014099465A/en
Application granted granted Critical
Publication of JP6280301B2 publication Critical patent/JP6280301B2/en
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Landscapes

  • Chemical Vapour Deposition (AREA)
  • Solid State Image Pick-Up Elements (AREA)
  • Recrystallisation Techniques (AREA)

Abstract

PROBLEM TO BE SOLVED: To provide a method for manufacturing an epitaxial silicon wafer capable of suppressing metal pollution by exerting higher gettering capability, and capable of reducing diffusion of oxygen from the silicon wafer to an epitaxial layer.SOLUTION: A method for manufacturing an epitaxial silicon wafer 100 comprises: a first step for forming an oxygen outward diffusion layer 11 on a surface layer of the silicon wafer 10 by performing an oxygen outward diffusion heat process to the silicon wafer 10; a second step for forming a modified layer 18 in which composing elements of a cluster ion 16 are solidly solved therein, on the surface 10A at the oxygen outward diffusion layer 11 side of the silicon wafer 10 by irradiating the cluster ion 16 to the silicon wafer 10 after the first step; and a third step for forming the epitaxial silicon layer 20 on the modified layer 18 of the silicon wafer 10.

Description

本発明は、エピタキシャルシリコンウェーハの製造方法、エピタキシャルシリコンウェーハ、および固体撮像素子の製造方法に関する。本発明は特に、より高いゲッタリング能力を発揮することで金属汚染を抑制することができ、かつ、シリコンウェーハからエピタキシャル層への酸素拡散を低減できるエピタキシャルシリコンウェーハを製造する方法に関する。   The present invention relates to an epitaxial silicon wafer manufacturing method, an epitaxial silicon wafer, and a solid-state imaging device manufacturing method. In particular, the present invention relates to a method of manufacturing an epitaxial silicon wafer that can suppress metal contamination by exhibiting higher gettering ability and can reduce oxygen diffusion from the silicon wafer to the epitaxial layer.

半導体デバイスの特性を劣化させる要因として、金属汚染が挙げられる。例えば、裏面照射型固体撮像素子では、この素子の基板となるエピタキシャルシリコンウェーハに混入した金属は、固体撮像素子の暗電流を増加させる要因となり、白傷欠陥と呼ばれる欠陥を生じさせる。裏面照射型固体撮像素子は、配線層などをセンサー部よりも下層に配置することで、外からの光をセンサーに直接取り込み、暗所などでもより鮮明な画像や動画を撮影することができるため、近年、デジタルビデオカメラやスマートフォンなどの携帯電話に広く用いられている。そのため、白傷欠陥を極力減らすことが望まれている。   Metal contamination is a factor that degrades the characteristics of semiconductor devices. For example, in a back-illuminated solid-state imaging device, metal mixed in an epitaxial silicon wafer serving as the substrate of the device causes a dark current of the solid-state imaging device to increase, and causes a defect called a white defect. The back-illuminated solid-state image sensor has a wiring layer, etc., placed below the sensor part, so that external light can be taken directly into the sensor and clearer images and videos can be taken even in dark places. In recent years, it has been widely used in mobile phones such as digital video cameras and smartphones. Therefore, it is desired to reduce white defect as much as possible.

ウェーハへの金属の混入は、主にエピタキシャルシリコンウェーハの製造工程および固体撮像素子の製造工程(デバイス製造工程)において生じる。前者のエピタキシャルシリコンウェーハの製造工程における金属汚染は、エピタキシャル成長炉の構成材からの重金属パーティクルによるもの、あるいは、エピタキシャル成長時の炉内ガスとして塩素系ガスを用いるために、その配管材料が金属腐食して発生する重金属パーティクルによるものなどが考えられる。近年、これら金属汚染は、エピタキシャル成長炉の構成材を耐腐食性に優れた材料に交換するなどにより、ある程度は改善されてきているが、十分ではない。一方、後者の固体撮像素子の製造工程においては、イオン注入、拡散および酸化熱処理などの各処理中で、半導体基板の重金属汚染が懸念される。   Metal contamination in the wafer mainly occurs in the manufacturing process of the epitaxial silicon wafer and the manufacturing process (device manufacturing process) of the solid-state imaging device. Metal contamination in the former epitaxial silicon wafer manufacturing process is caused by heavy metal particles from the components of the epitaxial growth furnace, or because the chlorine gas is used as the furnace gas during epitaxial growth, the piping material is corroded by metal. The thing by the heavy metal particle to generate | occur | produce is considered. In recent years, these metal contaminations have been improved to some extent by replacing the constituent materials of the epitaxial growth furnace with materials having excellent corrosion resistance, but are not sufficient. On the other hand, in the latter manufacturing process of the solid-state imaging device, there is a concern about heavy metal contamination of the semiconductor substrate during each process such as ion implantation, diffusion and oxidation heat treatment.

そのため、従来は、エピタキシャルシリコンウェーハに金属を捕獲するためのゲッタリングシンクを形成するか、あるいは高濃度ボロン基板などの金属の捕獲能力(ゲッタリング能力)が高い基板を用いて、シリコンウェーハへの金属汚染を回避していた。   For this reason, conventionally, a gettering sink for capturing metal on an epitaxial silicon wafer is formed, or a substrate having a high metal capture capability (gettering capability) such as a high-concentration boron substrate is used. The metal contamination was avoided.

シリコンウェーハにゲッタリングシンクを形成する方法としては、シリコンウェーハの内部に結晶欠陥である酸素析出物(シリコン酸化物析出物の通称であり、BMD:Bulk Micro Defectともいう。)や転位を形成するイントリンシックゲッタリング(IG)法と、シリコンウェーハの裏面にゲッタリングシンクを形成するエクストリンシックゲッタリング(EG)法が一般的である。   As a method for forming a gettering sink on a silicon wafer, oxygen precipitates (commonly called silicon oxide precipitates, also called BMD: Bulk Micro Defect) or dislocations, which are crystal defects, are formed inside the silicon wafer. An intrinsic gettering (IG) method and an extrinsic gettering (EG) method in which a gettering sink is formed on the back surface of a silicon wafer are generally used.

ここで、重金属のゲッタリング法の一手法として、シリコンウェーハ中にモノマーイオン(シングルイオン)注入によりゲッタリングサイトを形成する技術がある。特許文献1には、シリコンウェーハの一面から炭素イオンを注入して、炭素イオン注入領域を形成した後、この表面にエピタキシャル層を形成し、エピタキシャルシリコンウェーハとする製造方法が記載されている。この技術では、炭素イオン注入領域がゲッタリングサイトとして機能する。   Here, there is a technique of forming a gettering site by injecting monomer ions (single ions) into a silicon wafer as one technique for gettering heavy metals. Patent Document 1 describes a manufacturing method in which carbon ions are implanted from one surface of a silicon wafer to form a carbon ion implanted region, and then an epitaxial layer is formed on this surface to form an epitaxial silicon wafer. In this technique, the carbon ion implantation region functions as a gettering site.

また、特許文献2には、シリコンウェーハに炭素イオンを注入して炭素注入層を形成し、その後、イオン注入により乱れたウェーハの結晶性を回復させるための熱処理(以下、「回復熱処理」という。)をRTA(Rapid Thermal Annealing)装置で行うことで、この回復熱処理工程を短縮させ、その後にエピタキシャル層を形成する技術が記載されている。   In Patent Document 2, carbon ions are implanted into a silicon wafer to form a carbon implanted layer, and then heat treatment for recovering the crystallinity of the wafer disturbed by the ion implantation (hereinafter referred to as “recovery heat treatment”). ) Is performed with an RTA (Rapid Thermal Annealing) apparatus, thereby shortening the recovery heat treatment step and then forming a epitaxial layer.

特開平6−338507号公報JP-A-6-338507 特開2008−294245号公報JP 2008-294245 A

特許文献1および特許文献2に記載された技術は、いずれもエピタキシャル層形成前にモノマーイオンをシリコンウェーハに注入するものである。しかしながら、本発明者らの検討によれば、モノマーイオン注入を施した半導体エピタキシャルウェーハではゲッタリング能力が不十分であり、より強力なゲッタリング能力が求められることがわかった。   In the techniques described in Patent Document 1 and Patent Document 2, monomer ions are implanted into a silicon wafer before forming an epitaxial layer. However, according to the study by the present inventors, it has been found that a semiconductor epitaxial wafer subjected to monomer ion implantation has insufficient gettering capability and a stronger gettering capability is required.

ここで、撮像素子(CCD、CIS)のデバイス動作に影響する要因の一つとして、Vth(しきい値電圧:Threshold Voltage)の変化が挙げられる。エピタキシャルシリコンウェーハのバルクの単結晶ウェーハ(シリコンウェーハ)中の酸素がエピタキシャル層に拡散すると、サーマルドナー(酸素ドナー)が発生してしまい、これがVthを変化させてしまう原因となる。そのため、エピタキシャル層への酸素の拡散を低減させたエピタキシャルシリコンウェーハの提供が求められている。   Here, as one of the factors affecting the device operation of the image sensor (CCD, CIS), there is a change in Vth (Threshold Voltage). When oxygen in the bulk single crystal wafer (silicon wafer) of the epitaxial silicon wafer diffuses into the epitaxial layer, a thermal donor (oxygen donor) is generated, which causes a change in Vth. Therefore, there is a demand for providing an epitaxial silicon wafer in which the diffusion of oxygen into the epitaxial layer is reduced.

そこで本発明は、上記課題に鑑み、より高いゲッタリング能力を発揮することで金属汚染を抑制することができ、かつ、シリコンウェーハからエピタキシャル層への酸素拡散を低減できるエピタキシャルシリコンウェーハおよびその製造方法、並びに、このエピタキシャルシリコンウェーハから固体撮像素子を形成する固体撮像素子の製造方法を提供することを目的とする。   Accordingly, in view of the above problems, the present invention provides an epitaxial silicon wafer capable of suppressing metal contamination by exhibiting higher gettering capability and reducing oxygen diffusion from the silicon wafer to the epitaxial layer, and a method for manufacturing the same. And it aims at providing the manufacturing method of the solid-state image sensor which forms a solid-state image sensor from this epitaxial silicon wafer.

本発明者らの検討によれば、シリコンウェーハにクラスターイオンを照射することにより、モノマーイオンを注入する場合に比べて、以下の有利な点があることを知見した。すなわち、クラスターイオンを照射した場合、モノマーイオンと同等の加速電圧で照射しても、1原子または1分子あたりのエネルギーは、モノマーイオンの場合より小さくしてシリコンウェーハに衝突し、一度に複数の原子を照射できるため、照射した元素の深さ方向プロファイルのピーク濃度を高濃度とすることができ、ピーク位置をよりシリコンウェーハ表面に近い位置に位置させることができる。その結果エピタキシャルシリコンウェーハのゲッタリング能力が十分に得られることを知見した。また、シリコンウェーハに酸素外方拡散熱処理を施すことで、シリコンウェーハ中の酸素がエピタキシャル層に拡散する現象を抑制できることを知見した。   According to the study by the present inventors, it has been found that by irradiating cluster ions on a silicon wafer, there are the following advantages compared to the case of injecting monomer ions. That is, when irradiating with cluster ions, even when accelerating at the same acceleration voltage as that of monomer ions, the energy per atom or molecule is smaller than that of monomer ions and collides with a silicon wafer, Since atoms can be irradiated, the peak concentration of the profile in the depth direction of the irradiated element can be made high, and the peak position can be located closer to the silicon wafer surface. As a result, it was found that the gettering ability of the epitaxial silicon wafer can be sufficiently obtained. In addition, it has been found that by performing oxygen outward diffusion heat treatment on a silicon wafer, the phenomenon that oxygen in the silicon wafer diffuses into the epitaxial layer can be suppressed.

すなわち、本発明のエピタキシャルシリコンウェーハの製造方法は、シリコンウェーハに酸素外方拡散熱処理を施して、前記シリコンウェーハの表層部に酸素外方拡散層を形成する第1工程と、前記第1工程の後、前記シリコンウェーハにクラスターイオンを照射して、前記シリコンウェーハの前記酸素外方拡散層側の表面に、前記クラスターイオンの構成元素が固溶してなる改質層を形成する第2工程と、前記シリコンウェーハの改質層上にエピタキシャルシリコン層を形成する第3工程と、を有することを特徴とする。   That is, the epitaxial silicon wafer manufacturing method of the present invention includes a first step of performing an oxygen outward diffusion heat treatment on the silicon wafer to form an oxygen outward diffusion layer on the surface layer portion of the silicon wafer, and the first step Then, a second step of irradiating the silicon wafer with cluster ions to form a modified layer in which the constituent elements of the cluster ions are dissolved on the surface of the silicon wafer on the oxygen outward diffusion layer side; And a third step of forming an epitaxial silicon layer on the modified layer of the silicon wafer.

ここで、前記第1工程を行う前の前記シリコンウェーハの酸素濃度が8×1017〜18×1017atoms/cm(ASTM F121−1979)とすることが好ましい。 Here, it is preferable that the oxygen concentration of the silicon wafer before the first step is 8 × 10 17 to 18 × 10 17 atoms / cm 3 (ASTM F121-1979).

本発明では、前記第2工程の後、前記シリコンウェーハに対して結晶性回復のための熱処理を行うことなく、前記シリコンウェーハをエピタキシャル成長装置に搬送して前記第3工程を行うことができる。ただし、前記第2工程の後、前記第3工程の前に、前記シリコンウェーハに対して結晶性回復のための熱処理を行うことも好ましい。   In the present invention, after the second step, the third step can be performed by transporting the silicon wafer to an epitaxial growth apparatus without performing a heat treatment for recovering crystallinity on the silicon wafer. However, it is also preferable to perform heat treatment for crystallinity recovery on the silicon wafer after the second step and before the third step.

ここで、前記クラスターイオンが、構成元素として炭素を含むことが好ましく、構成元素として炭素を含む2種以上の元素を含むことがより好ましい。   Here, the cluster ions preferably include carbon as a constituent element, and more preferably include two or more elements including carbon as a constituent element.

さらに、前記クラスターイオンの照射条件は、炭素1原子あたり加速電圧が50keV/atom以下、クラスターサイズが100個以下、炭素のドーズ量が1×1016atoms/cm以下であることが好ましい。 Further, the irradiation conditions of the cluster ions are preferably that the acceleration voltage per carbon atom is 50 keV / atom or less, the cluster size is 100 or less, and the carbon dose is 1 × 10 16 atoms / cm 2 or less.

次に、本発明のエピタキシャルシリコンウェーハは、表層部に酸素外方拡散層を備えたシリコンウェーハと、該シリコンウェーハの前記酸素外方拡散層側の表面に形成された、該シリコンウェーハ中に所定元素が固溶してなる改質層と、該改質層上のエピタキシャル層と、を有し、前記改質層における、前記所定元素の濃度プロファイルの半値幅が100nm以下であることを特徴とする。   Next, an epitaxial silicon wafer according to the present invention includes a silicon wafer provided with an oxygen outward diffusion layer in a surface layer portion, and a predetermined surface in the silicon wafer formed on the surface of the silicon wafer on the oxygen outward diffusion layer side. A modified layer formed by dissolving the element in solid solution and an epitaxial layer on the modified layer, wherein a half-value width of the concentration profile of the predetermined element in the modified layer is 100 nm or less. To do.

また、前記シリコンウェーハの前記酸素外方拡散層側の表面からの深さが150nm以下の範囲内に、前記改質層における前記濃度プロファイルのピークが位置することが好ましい。   Moreover, it is preferable that the peak of the concentration profile in the modified layer is located within a range where the depth from the surface on the oxygen outward diffusion layer side of the silicon wafer is 150 nm or less.

さらに、前記改質層における前記濃度プロファイルのピーク濃度が、1×1015atoms/cm以上であることが好ましい。 Furthermore, the peak concentration of the concentration profile in the modified layer is preferably 1 × 10 15 atoms / cm 3 or more.

ここで、前記所定元素が炭素を含むことが好ましく、炭素を含む2種以上の元素を含むことがより好ましい。   Here, the predetermined element preferably includes carbon, and more preferably includes two or more elements including carbon.

そして、本発明の固体撮像素子の製造方法は、上記いずれか1つの製造方法で製造されたエピタキシャルシリコンウェーハまたは上記いずれか1つのエピタキシャルシリコンウェーハの、酸素外方拡散層側の表面に位置するエピタキシャルシリコン層に、固体撮像素子を形成することを特徴とする。   And the manufacturing method of the solid-state image sensor of this invention is the epitaxial located in the surface by the side of an oxygen outward diffusion layer of the epitaxial silicon wafer manufactured by any one said manufacturing method, or the said any one epitaxial silicon wafer. A solid-state imaging device is formed on the silicon layer.

本発明によれば、酸素外方拡散熱処理を施して、シリコンウェーハの表層部に酸素外方拡散層を形成し、このシリコンウェーハにクラスターイオンを照射して、このシリコンウェーハの酸素外方拡散層側の表面に前記クラスターイオンの構成元素からなる改質層を形成したので、この改質層がより高いゲッタリング能力を発揮することで、金属汚染を抑制することができ、かつ、シリコンウェーハからエピタキシャル層への酸素拡散を低減できるエピタキシャルシリコンウェーハを得ることができ、また、このエピタキシャルシリコンウェーハから高品質の固体撮像素子を形成することができる。   According to the present invention, an oxygen outward diffusion heat treatment is performed to form an oxygen outward diffusion layer on the surface layer portion of the silicon wafer, and this silicon wafer is irradiated with cluster ions, so that the oxygen outward diffusion layer of the silicon wafer is irradiated. Since the modified layer composed of the constituent elements of the cluster ions is formed on the surface on the side, the modified layer exhibits higher gettering ability, so that metal contamination can be suppressed, and from the silicon wafer An epitaxial silicon wafer that can reduce oxygen diffusion into the epitaxial layer can be obtained, and a high-quality solid-state imaging device can be formed from the epitaxial silicon wafer.

本発明の一実施形態によるエピタキシャルシリコンウェーハ100の製造方法を説明する摸式断面図である。It is a model cross section explaining the manufacturing method of epitaxial silicon wafer 100 by one embodiment of the present invention. (A)はクラスターイオンを照射する場合の照射メカニズムを説明する模式図、(B)はモノマーイオンを注入する場合の注入メカニズムを説明する模式図である。(A) is a schematic diagram explaining the irradiation mechanism in the case of irradiating cluster ions, (B) is a schematic diagram explaining the injection mechanism in the case of injecting monomer ions. 参考例1,2におけるSIMS測定で得られた炭素の濃度プロファイルである。It is a carbon concentration profile obtained by SIMS measurement in Reference Examples 1 and 2. (A)は実施例1について、(B)は比較例1について、エピタキシャルシリコンウェーハの炭素濃度プロファイルと、ゲッタリング能力評価後のCu濃度プロファイルとを併せて示したグラフである。(A) is the graph which combined the carbon concentration profile of the epitaxial silicon wafer, and the Cu concentration profile after gettering ability evaluation about Example 1 and (B) about the comparative example 1. 実施例1,2および比較例3について、エピタキシャルシリコンウェーハの酸素濃度を示したグラフである。6 is a graph showing oxygen concentrations of epitaxial silicon wafers in Examples 1 and 2 and Comparative Example 3.

以下、図面を参照しつつ本発明の実施形態を詳細に説明する。なお、図1では説明の便宜上、実際の厚さの割合とは異なり、シリコンウェーハ10に対してエピタキシャルシリコン層20の厚さを誇張して示す。   Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. For convenience of explanation, FIG. 1 exaggerates the thickness of the epitaxial silicon layer 20 relative to the silicon wafer 10, unlike the actual thickness ratio.

(エピタキシャルシリコンウェーハの製造方法)
本発明の一実施形態によるエピタキシャルシリコンウェーハ100の製造方法を図1に示す。まず、シリコンウェーハ10に酸素外方拡散熱処理を施して、シリコンウェーハ10の表層部に酸素外方拡散層11を形成する第1工程(図1(A),(B))を行う。次に、このシリコンウェーハ10にクラスターイオン16を照射して、シリコンウェーハ10の酸素外方拡散層11側の表面10Aに、このクラスターイオン16の構成元素が固溶してなる改質層18を形成する第2工程(図1(C),(D))を行う。その後、シリコンウェーハ10の改質層18上に、エピタキシャルシリコン層20を形成する第3工程(図1(F))を行う。図1(F)は、この製造方法の結果得られたエピタキシャルシリコンウェーハ100の模式断面図である。
(Epitaxial silicon wafer manufacturing method)
A method for manufacturing an epitaxial silicon wafer 100 according to an embodiment of the present invention is shown in FIG. First, the silicon wafer 10 is subjected to an oxygen outward diffusion heat treatment to perform a first step (FIGS. 1A and 1B) in which the oxygen outward diffusion layer 11 is formed on the surface layer portion of the silicon wafer 10. Next, this silicon wafer 10 is irradiated with cluster ions 16, and a modified layer 18 in which the constituent elements of the cluster ions 16 are dissolved in the surface 10 A on the oxygen outward diffusion layer 11 side of the silicon wafer 10. A second step (FIGS. 1C and 1D) to be formed is performed. Thereafter, a third step (FIG. 1F) for forming the epitaxial silicon layer 20 on the modified layer 18 of the silicon wafer 10 is performed. FIG. 1F is a schematic cross-sectional view of an epitaxial silicon wafer 100 obtained as a result of this manufacturing method.

第1工程における酸素外方拡散熱処理は、任意の手法を用いることができ、シリコンウェーハ10表層部の酸素濃度を低減して酸素外方拡散層11を形成する熱処理であればよい。ここで、酸素外方拡散層11とは、熱処理によってシリコン中の格子間酸素が外方拡散され、シリコンウェーハ10の表層部に低酸素濃度層が形成され、酸素析出物などの微小欠陥の発生が抑えられた層である。すなわち、酸素外方拡散熱処理を行うことにより、シリコンウェーハ10の表層部の酸素が外方(シリコンウェーハ10の外部)に拡散され、シリコンウェーハ10中心部の酸素濃度よりも酸素濃度が低下した酸素外方拡散層11がシリコンウェーハ10の表層部に形成される。この酸素外方拡散層11は、低酸素濃度であるために、エピタキシャルシリコン層20への酸素拡散を抑制することができる。後述する第3工程でのエピタキシャル成長処理時の加熱によりシリコンウェーハ10中の酸素が外方拡散する領域深さに相当する厚さとなるまで、酸素外方拡散熱処理を施して酸素外方拡散層11を形成することが望ましく、概ね酸素外方拡散層11の厚さを1〜10μmの範囲内に調整するように熱処理すればよい。   Any method may be used for the oxygen outward diffusion heat treatment in the first step as long as the oxygen outward diffusion layer 11 is formed by reducing the oxygen concentration in the surface layer portion of the silicon wafer 10. Here, the oxygen outward diffusion layer 11 means that interstitial oxygen in silicon is outwardly diffused by heat treatment, a low oxygen concentration layer is formed in the surface layer portion of the silicon wafer 10, and micro defects such as oxygen precipitates are generated. This is a layer in which is suppressed. That is, by performing oxygen outward diffusion heat treatment, oxygen in the surface layer portion of the silicon wafer 10 is diffused outward (outside of the silicon wafer 10), and the oxygen concentration is lower than the oxygen concentration in the center portion of the silicon wafer 10. An outward diffusion layer 11 is formed on the surface layer portion of the silicon wafer 10. Since the oxygen outward diffusion layer 11 has a low oxygen concentration, oxygen diffusion into the epitaxial silicon layer 20 can be suppressed. The oxygen outer diffusion layer 11 is subjected to an oxygen outward diffusion heat treatment until a thickness corresponding to the depth of the region in which oxygen in the silicon wafer 10 diffuses outwardly by heating during the epitaxial growth process in the third step described later. It is desirable to form it, and heat treatment may be performed so that the thickness of the oxygen outward diffusion layer 11 is generally adjusted within the range of 1 to 10 μm.

この酸素外方拡散熱処理は、例えば、縦型熱処理炉や横型熱処理炉を用いて、シリコンウェーハに対して、1000〜1250℃の温度範囲で1〜5時間の熱処理を施すことにより行うことができる。この場合、熱処理中のガス雰囲気としては、窒素含有ガス雰囲気、水素ガス雰囲気、アルゴンガス雰囲気もしくは酸素ガス雰囲気、またはこれらの混合ガス雰囲気で行うことができる。この酸素外方拡散熱処理であれば、複数枚のシリコンウェーハを一度に処理できるため、生産性に優れる。   This oxygen outward diffusion heat treatment can be performed, for example, by performing heat treatment for 1 to 5 hours in a temperature range of 1000 to 1250 ° C. using a vertical heat treatment furnace or a horizontal heat treatment furnace. . In this case, the gas atmosphere during the heat treatment can be a nitrogen-containing gas atmosphere, a hydrogen gas atmosphere, an argon gas atmosphere or an oxygen gas atmosphere, or a mixed gas atmosphere thereof. This oxygen outward diffusion heat treatment is excellent in productivity because a plurality of silicon wafers can be processed at one time.

また、上述の高温長時間の熱処理に替えて、急速昇降温熱処理(RTA:Rapid Thermal Anneal)により、酸素外方拡散熱処理を行うこともできる。ランプアニールとも呼ばれるこのRTA処理は、非常に短時間でシリコンウェーハ表層部の酸素を外方拡散(シリコンウェーハ外部に拡散)させて、酸素外方拡散層を形成することができる。RTA処理の条件としては、1000〜1300℃,10分以下であることが好ましい。1000℃よりも低い温度では、シリコンウェーハ表層部に十分な酸素外方拡散層を形成することが困難となる。1300℃超であると、熱処理時にシリコンウェーハにスリップ転位が発生してしまい、デバイス特性に支障をきたす恐れがある。熱処理中のガス雰囲気としては、窒素含有ガス雰囲気、水素ガス雰囲気、アルゴンガス雰囲気もしくは酸素ガス雰囲気、またはこれらの混合ガス雰囲気で行うことができる。   Further, instead of the above-described high-temperature and long-time heat treatment, oxygen outward diffusion heat treatment can also be performed by rapid thermal annealing (RTA: Rapid Thermal Annealing). This RTA process, also called lamp annealing, can form an oxygen outward diffusion layer by diffusing oxygen on the surface of the silicon wafer in an extremely short time (diffusing outside the silicon wafer). The conditions for the RTA treatment are preferably 1000 to 1300 ° C. and 10 minutes or less. If the temperature is lower than 1000 ° C., it is difficult to form a sufficient oxygen outward diffusion layer on the surface layer of the silicon wafer. If it exceeds 1300 ° C., slip dislocation occurs in the silicon wafer during the heat treatment, which may impair device characteristics. As the gas atmosphere during the heat treatment, a nitrogen-containing gas atmosphere, a hydrogen gas atmosphere, an argon gas atmosphere, an oxygen gas atmosphere, or a mixed gas atmosphere thereof can be used.

なお、上述の第1工程において、図1(B)で形成される酸素外方拡散層は、表面10Aの反対側の面の表層部にも形成される場合があるが、表面10Aの反対側の酸素外方拡散層の記載を説明の便宜上省略し、酸素外方拡散層11側の表面10Aにクラスターイオン16を照射するものとする。また、酸素外方拡散熱処理によって、シリコンウェーハ10の両面の表層部に酸素外方拡散層が形成される場合は、少なくとも片面にクラスターイオン16を照射すればよく、また両面にクラスターイオン16を照射してもよい。   In the first step described above, the oxygen outward diffusion layer formed in FIG. 1B may also be formed on the surface layer portion on the surface opposite to the surface 10A, but on the opposite side of the surface 10A. The description of the oxygen outward diffusion layer is omitted for convenience of explanation, and the surface 10A on the oxygen outward diffusion layer 11 side is irradiated with cluster ions 16. In addition, when oxygen outward diffusion layers are formed on the surface layers of both surfaces of the silicon wafer 10 by the oxygen outward diffusion heat treatment, at least one surface may be irradiated with the cluster ions 16, and both surfaces may be irradiated with the cluster ions 16. May be.

ここで、一実施形態で使用するシリコンウェーハ10の酸素濃度は、8×1017〜18×1017atoms/cm(ASTM F121−1979)であることが好ましく、10×1017〜16×1017atoms/cm(ASTM F121−1979)であることがより好ましい。シリコンウェーハ10の酸素濃度が18×1017atoms/cm超であると、酸素濃度が高すぎるために、酸素析出過多によりシリコンウェーハそのものの強度低下を招く。その結果、デバイス熱処理工程においてシリコンウェーハの反りやスリップの発生などの問題を生じる恐れがある。一方、シリコンウェーハ10の酸素濃度が8×1017atoms/cm以上であれば、後述するクラスターイオン照射によるゲッタリング能力に加えて、BMDによるイントリンシックゲッタリング(IG)能力を備えることができる。 Here, the oxygen concentration of the silicon wafer 10 used in an embodiment is preferably 8 × 10 17 to 18 × 10 17 atoms / cm 3 (ASTM F121-1979), and is preferably 10 × 10 17 to 16 × 10. More preferably, it is 17 atoms / cm 3 (ASTM F121-1979). If the oxygen concentration of the silicon wafer 10 is more than 18 × 10 17 atoms / cm 3 , the oxygen concentration is too high, and thus the strength of the silicon wafer itself is reduced due to excessive oxygen precipitation. As a result, problems such as warpage of the silicon wafer and occurrence of slip may occur in the device heat treatment process. On the other hand, if the oxygen concentration of the silicon wafer 10 is 8 × 10 17 atoms / cm 3 or more, in addition to the gettering capability by cluster ion irradiation described later, the intrinsic gettering (IG) capability by BMD can be provided. .

酸素濃度が8×1017〜18×1017atoms/cm(ASTM F121−1979)であるシリコンウェーハ10は、一般的なCZ法(Czochralski法:チョクラルスキ法)を用いて得たシリコン単結晶インゴットをワイヤーソー等でスライスして作製することができる。一般的なCZ法により得られる低酸素単結晶シリコンインゴットの酸素濃度は3×1017atoms/cm以上であり、この濃度範囲のシリコンウェーハを作製できる。酸素濃度の調整はシリコン単結晶インゴット育成時に設定するルツボ回転速度、チャンバー内の圧力やArガス流量などを調整することにより制御することができる。 A silicon wafer 10 having an oxygen concentration of 8 × 10 17 to 18 × 10 17 atoms / cm 3 (ASTM F121-1979) is a silicon single crystal ingot obtained using a general CZ method (Czochralski method: Czochralski method). Can be sliced with a wire saw or the like. The oxygen concentration of a low oxygen single crystal silicon ingot obtained by a general CZ method is 3 × 10 17 atoms / cm 3 or more, and a silicon wafer in this concentration range can be produced. The oxygen concentration can be controlled by adjusting the crucible rotation speed, the pressure in the chamber, the Ar gas flow rate, and the like set during the growth of the silicon single crystal ingot.

ここで、本発明の特徴的工程は、図1(C)に示すクラスターイオンを照射する第2工程である。この工程を採用することの技術的意義を、作用効果とともに説明する。クラスターイオン16を照射した結果形成される改質層18は、クラスターイオン16の構成元素がシリコンウェーハの表面10Aの結晶の格子間位置または置換位置に固溶して局所的に存在する領域であり、ゲッタリングサイトとして働く。その理由は、以下のように推測される。すなわち、クラスターイオンの形態で照射された炭素やボロンなどの元素は、シリコン単結晶の置換位置・格子間位置に高密度で局在する。そして、シリコン単結晶の平衡濃度以上にまで炭素やボロンを固溶すると、重金属の固溶度(遷移金属の飽和溶解度)が極めて増加することが実験的に確認された。つまり、平衡濃度以上にまで固溶した炭素やボロンにより重金属の固溶度が増加し、これにより重金属に対する捕獲率が顕著に増加したものと考えられる。   Here, the characteristic process of the present invention is the second process of irradiating the cluster ions shown in FIG. The technical significance of adopting this process will be described together with the effects. The modified layer 18 formed as a result of the irradiation of the cluster ions 16 is a region where the constituent elements of the cluster ions 16 are locally present as a solid solution in the interstitial position or substitution position of the crystal on the surface 10A of the silicon wafer. Work as a gettering site. The reason is presumed as follows. That is, elements such as carbon and boron irradiated in the form of cluster ions are localized at a high density in the substitution position / interstitial position of the silicon single crystal. It was experimentally confirmed that the solid solubility of heavy metals (saturated solubility of transition metals) greatly increases when carbon or boron is dissolved to a level equal to or higher than the equilibrium concentration of the silicon single crystal. In other words, it is considered that the solid solubility of heavy metals is increased by carbon and boron dissolved to an equilibrium concentration or higher, and the capture rate for heavy metals is thereby remarkably increased.

ここで、本発明ではクラスターイオン16を照射するため、モノマーイオンを注入する場合に比べて、より高いゲッタリング能力を得ることができ、さらに回復熱処理も省略することができる。そのため、より高いゲッタリング能力を有するエピタキシャルシリコンウェーハ100を製造することが可能となり、本製法により得られるエピタキシャルシリコンウェーハ100から製造した裏面照射型固体撮像素子は、従来に比べ白傷欠陥発生の抑制が期待できる。   Here, in the present invention, since the cluster ions 16 are irradiated, higher gettering ability can be obtained as compared with the case where monomer ions are implanted, and further, the recovery heat treatment can be omitted. Therefore, it becomes possible to manufacture the epitaxial silicon wafer 100 having higher gettering ability, and the back-illuminated solid-state imaging device manufactured from the epitaxial silicon wafer 100 obtained by this manufacturing method suppresses the generation of white defect as compared with the conventional case. Can be expected.

なお、本明細書において「クラスターイオン」とは、原子または分子が複数集合して塊となったクラスターに正電荷または負電荷を与え、イオン化したものを意味する。クラスターは、複数(通常2〜2000個程度)の原子または分子が互いに結合した塊状の集団である。   In the present specification, the “cluster ion” means an ionized product in which a plurality of atoms or molecules are aggregated to give a cluster having a lump to give a positive charge or a negative charge. A cluster is a massive group in which a plurality (usually about 2 to 2000) of atoms or molecules are bonded to each other.

本発明者らは、クラスターイオンを照射することにより、高いゲッタリング能力が得られる作用を以下のように考えている。   The present inventors consider the action of obtaining high gettering ability by irradiating cluster ions as follows.

シリコンウェーハに、例えば炭素のモノマーイオンを注入する場合、図2(B)に示すように、モノマーイオンは、シリコンウェーハを構成するシリコン原子を弾き飛ばし、シリコンウェーハ中の所定深さ位置に注入される。注入深さは、注入イオンの構成元素の種類およびイオンの加速電圧に依存する。この場合、シリコンウェーハの深さ方向における炭素の濃度プロファイルは、比較的ブロードになり、注入された炭素の存在領域は概ね0.5〜1μm程度となる。複数種のイオンを同一エネルギーで同時照射した場合には、軽い元素ほど深く注入され、すなわち、それぞれの元素の質量に応じた異なる位置に注入されるため、注入元素の濃度プロファイルはよりブロードになる。   For example, when carbon monomer ions are implanted into a silicon wafer, as shown in FIG. 2B, the monomer ions are blown off silicon atoms constituting the silicon wafer and implanted at a predetermined depth in the silicon wafer. The The implantation depth depends on the type of constituent elements of the implanted ions and the acceleration voltage of the ions. In this case, the concentration profile of carbon in the depth direction of the silicon wafer is relatively broad, and the region where the implanted carbon is present is approximately 0.5 to 1 μm. When multiple types of ions are simultaneously irradiated with the same energy, lighter elements are implanted deeper, that is, implanted at different positions according to the mass of each element, so the concentration profile of the implanted elements becomes broader. .

さらに、モノマーイオンは一般的に150〜2000keV程度の加速電圧で注入するが、各イオンがそのエネルギーをもってシリコン原子と衝突するため、モノマーイオンが注入されたシリコンウェーハ表面部の結晶性が乱れ、その後にウェーハ表面上に成長させるエピタキシャル層の結晶性を乱す。また、加速電圧が大きいほど、結晶性が大きく乱れる。そのため、イオン注入後に乱れた結晶性を回復させるための熱処理(回復熱処理)を高温かつ長時間で行う必要がある。   Furthermore, the monomer ions are generally implanted at an acceleration voltage of about 150 to 2000 keV. Since each ion collides with a silicon atom with its energy, the crystallinity of the surface portion of the silicon wafer into which the monomer ions are implanted is disturbed. The crystallinity of the epitaxial layer grown on the wafer surface is disturbed. Also, the higher the acceleration voltage, the more the crystallinity is disturbed. Therefore, it is necessary to perform heat treatment (recovery heat treatment) for recovering disordered crystallinity after ion implantation at a high temperature for a long time.

一方、シリコンウェーハに、例えば炭素とボロンからなるクラスターイオンを照射する場合、図2(A)に示すように、クラスターイオン16は、シリコンウェーハに照射されるとそのエネルギーで瞬間的に1350〜1400℃程度の高温状態となり、シリコンが融解する。その後、シリコンは急速に冷却され、シリコンウェーハ中の表面10A近傍に炭素およびボロンが固溶する。すなわち、照射するイオンの構成元素が半導体ウェーハ表面の結晶の格子間位置または置換位置に固溶した層を意味する。シリコンウェーハの深さ方向における炭素およびホウ素の濃度プロファイルは、クラスターイオンの加速電圧およびクラスターサイズに依存するが、モノマーイオンの場合に比べてシャープになり、照射された炭素およびホウ素が局所的に存在する領域(すなわち、改質層)の厚みは概ね500nm以下の領域(例えば50〜400nm程度)となる。なお、クラスターイオンの形態で照射された元素は、エピタキシャル層20の形成過程で多少の熱拡散は起こる。このため、エピタキシャル層20形成後の炭素およびホウ素の濃度プロファイルは、これらの元素が局所的に存在するピークの両側に、ブロードな拡散領域が形成される。しかし、改質層の厚みは大きく変化しない(後述の図4(A)参照)。その結果、炭素およびボロンの析出領域を局所的にかつ高濃度にすることができる。また、シリコンウェーハの表面10A近傍に改質層18が形成されるため、より近接ゲッタリングが可能となる。その結果、モノマーイオンを注入する場合よりも高いゲッタリング能力を得ることができ、さらに一度のクラスターイオン照射で十分高いゲッタリング能力を得ることができるものと考えられる。なお、クラスターイオンの形態であれば、複数種のイオンを同時に照射することができる。   On the other hand, when irradiating the silicon wafer with cluster ions made of, for example, carbon and boron, as shown in FIG. 2A, when the silicon ion is irradiated onto the silicon wafer, the energy is instantaneously 1350 to 1400. It becomes a high temperature of about ℃ and silicon melts. Thereafter, the silicon is rapidly cooled, and carbon and boron are dissolved in the vicinity of the surface 10A in the silicon wafer. That is, it means a layer in which constituent elements of ions to be irradiated are solid-solved at interstitial positions or substitution positions of crystals on the semiconductor wafer surface. The concentration profile of carbon and boron in the depth direction of the silicon wafer depends on the acceleration voltage and cluster size of cluster ions, but is sharper than that of monomer ions, and the irradiated carbon and boron exist locally. The thickness of the region (that is, the modified layer) is approximately 500 nm or less (for example, about 50 to 400 nm). Note that the elements irradiated in the form of cluster ions undergo some thermal diffusion during the formation process of the epitaxial layer 20. For this reason, in the concentration profile of carbon and boron after the formation of the epitaxial layer 20, broad diffusion regions are formed on both sides of the peak where these elements exist locally. However, the thickness of the modified layer does not change greatly (see FIG. 4A described later). As a result, the carbon and boron precipitation regions can be locally and highly concentrated. Further, since the modified layer 18 is formed in the vicinity of the surface 10A of the silicon wafer, closer gettering is possible. As a result, it is considered that a higher gettering ability can be obtained than in the case of injecting monomer ions, and a sufficiently high gettering ability can be obtained by one-time cluster ion irradiation. In addition, if it is a form of cluster ion, multiple types of ions can be irradiated simultaneously.

また、クラスターイオン16は一般的に10〜100keV/Cluster程度の加速電圧で照射するが、クラスターは複数の原子または分子の集合体であるため、1原子または1分子あたりのエネルギーを小さくして打ち込むことができるため、シリコンウェーハの結晶へ与えるダメージは小さい。さらに、上記のような注入メカニズムの相違にも起因して、クラスターイオン照射の方がモノマーイオン注入よりもシリコンウェーハ10の結晶性を乱さない。そのため、第2工程の後、シリコンウェーハ10に対して回復熱処理を行うことなく、シリコンウェーハ10をエピタキシャル成長装置に搬送して第3工程を行うことができる(図1(E))。   The cluster ions 16 are generally irradiated at an acceleration voltage of about 10 to 100 keV / Cluster. Since the cluster is an aggregate of a plurality of atoms or molecules, it is implanted with a small energy per atom or molecule. Therefore, the damage to the crystal of the silicon wafer is small. Furthermore, due to the difference in the implantation mechanism as described above, the cluster ion irradiation does not disturb the crystallinity of the silicon wafer 10 more than the monomer ion implantation. Therefore, after the second step, the third step can be performed by transferring the silicon wafer 10 to the epitaxial growth apparatus without performing the recovery heat treatment on the silicon wafer 10 (FIG. 1E).

なお、改質層18は、重金属を固溶するだけでなく、酸素も捕獲することができ、エピタキシャルシリコン層20への酸素拡散を抑制することができる。そのため、改質層18の酸素拡散抑制効果により、撮像素子を形成した場合に、Vthの変動を抑制することもできる。   The modified layer 18 not only dissolves heavy metals but also captures oxygen, and can suppress oxygen diffusion into the epitaxial silicon layer 20. Therefore, the variation in Vth can also be suppressed when the imaging element is formed due to the oxygen diffusion suppressing effect of the modified layer 18.

クラスターイオン16は結合様式によって多種のクラスターが存在し、例えば以下の文献に記載されるような公知の方法で生成することができる。ガスクラスタービームの生成法として、(1)特開平9−41138号公報、(2)特開平4−354865号公報、イオンビームの生成法として、(1)荷電粒子ビーム工学:石川順三:ISBN978−4−339−00734−3:コロナ社、(2)電子・イオンビーム工学:電気学会:ISBN4−88686−217−9:オーム社、(3)クラスターイオンビーム基礎と応用:ISBN4−526−05765−7:日刊工業新聞社。また、一般的に、正電荷のクラスターイオンの発生にはニールセン型イオン源あるいはカウフマン型イオン源が用いられ、負電荷のクラスターイオンの発生には体積生成法を用いた大電流負イオン源が用いられる。   The cluster ion 16 has various clusters depending on the binding mode, and can be generated by a known method as described in the following document, for example. As a method for generating a gas cluster beam, (1) JP-A-9-41138, (2) JP-A-4-354865, and as an ion beam generation method, (1) charged particle beam engineering: Junzo Ishikawa: ISBN978 -4-339-00734-3: Corona, (2) Electron and ion beam engineering: The Institute of Electrical Engineers of Japan: ISBN4-88686-217-9: Ohm, (3) Cluster ion beam basics and applications: ISBN4-526-05765 -7: Nikkan Kogyo Shimbun. In general, a Nielsen ion source or a Kaufman ion source is used to generate positively charged cluster ions, and a large current negative ion source using a volume generation method is used to generate negatively charged cluster ions. It is done.

以下で、クラスターイオンの照射条件について説明する。まず、照射する元素は特に限定されず、炭素、ボロン、リン、砒素などを挙げることができる。しかし、より高いゲッタリング能力を得る観点から、クラスターイオンが、構成元素として炭素を含むことが好ましい。格子位置の炭素原子は共有結合半径がシリコン単結晶と比較して小さいため、シリコン結晶格子の収縮場が形成されるため、格子間の不純物を引き付けるゲッタリング能力が高い。   Hereinafter, irradiation conditions of cluster ions will be described. First, the irradiation element is not particularly limited, and examples thereof include carbon, boron, phosphorus, and arsenic. However, from the viewpoint of obtaining higher gettering ability, the cluster ions preferably contain carbon as a constituent element. Since the carbon atom at the lattice position has a smaller covalent bond radius than that of the silicon single crystal, a contraction field of the silicon crystal lattice is formed, so that the gettering ability to attract impurities between the lattices is high.

また、構成元素として炭素を含む2種以上の元素を含むことがより好ましい。析出元素の種類により効率的にゲッタリング可能な金属の種類が異なるため、2種以上の元素を固溶させることにより、より幅広い金属汚染に対応できるからである。例えば、炭素の場合、ニッケルを効率的にゲッタリングすることができ、ボロンの場合、銅、鉄を効率的にゲッタリングすることができる。   Moreover, it is more preferable to include two or more elements including carbon as a constituent element. This is because the types of metals that can be efficiently gettered differ depending on the types of deposited elements, so that two or more types of elements can be dissolved to cope with a wider range of metal contamination. For example, in the case of carbon, nickel can be efficiently gettered, and in the case of boron, copper and iron can be efficiently gettered.

イオン化させる化合物も特に限定されないが、イオン化が可能な炭素源化合物としては、エタン、メタン、二酸化炭素(CO)などを用いることができ、イオン化が可能なボロン源化合物としては、ジボラン、デカボラン(B1014)などを用いることができる。例えば、ベンジルとデカボランを混合したガスを材料ガスとした場合、炭素、ボロンおよび水素が集合した水素化合物クラスターを生成することができる。また、シクロヘキサン(C12)を材料ガスとすれば、炭素および水素からなるクラスターイオンを生成することができる。炭素源化合物としては特に、プロパン、ジベンジル(C1414)などより生成したクラスターC(3≦n≦16,3≦m≦10を用いることが好ましい。小サイズのクラスターイオンビームを形成し易い為である。 The compound to be ionized is not particularly limited, and ethane, methane, carbon dioxide (CO 2 ), or the like can be used as a carbon source compound that can be ionized, and diborane, decaborane ( B 10 H 14 ) or the like can be used. For example, when a gas in which benzyl and decaborane are mixed is used as a material gas, a hydrogen compound cluster in which carbon, boron, and hydrogen are aggregated can be generated. If cyclohexane (C 6 H 12 ) is used as a material gas, cluster ions composed of carbon and hydrogen can be generated. As the carbon source compound, it is particularly preferable to use a cluster C n H m (3 ≦ n ≦ 16, 3 ≦ m ≦ 10) formed from propane, dibenzyl (C 14 H 14 ), etc. A small-sized cluster ion beam is used. This is because it is easy to form.

イオン化させる化合物としては、炭素およびドーパント元素(ボロン、リン、砒素、アンチモンなど)の両方を含む化合物とすることも好ましい。このような化合物をクラスターイオンとして照射すれば、1回の照射で炭素およびドーパント元素の両方を固溶させることができるからである。   The compound to be ionized is preferably a compound containing both carbon and a dopant element (boron, phosphorus, arsenic, antimony, etc.). This is because if such a compound is irradiated as cluster ions, both carbon and the dopant element can be dissolved in a single irradiation.

また、クラスターイオンの加速電圧およびクラスターサイズを制御することにより、改質層18における構成元素の深さ方向の濃度プロファイルのピークの位置を制御することができる。本明細書において「クラスターサイズ」とは、1つのクラスターを構成する原子または分子の個数を意味する。   Further, by controlling the acceleration voltage and cluster size of cluster ions, the position of the peak of the concentration profile of the constituent elements in the modified layer 18 can be controlled. In this specification, “cluster size” means the number of atoms or molecules constituting one cluster.

本実施形態の第2工程では、高いゲッタリング能力を得る観点から、シリコンウェーハ10の酸素外方拡散層側の表面10Aからの深さが150nm以下の範囲内に、改質層18における構成元素の深さ方向の濃度プロファイルのピークが位置するように、クラスターイオン16を照射する。なお、本明細書において、「構成元素の深さ方向の濃度プロファイル」は、構成元素が2種以上の元素を含む場合は、合計ではなく、それぞれ単独の元素についてのプロファイルを意味するものとする。   In the second step of the present embodiment, from the viewpoint of obtaining high gettering capability, the constituent elements in the modified layer 18 are within a range where the depth from the surface 10A on the oxygen outward diffusion layer side of the silicon wafer 10 is 150 nm or less. The cluster ions 16 are irradiated so that the peak of the concentration profile in the depth direction is located. In this specification, the “concentration profile in the depth direction of the constituent element” means not a total but a profile of each single element when the constituent element includes two or more elements. .

ピーク位置を当該深さの範囲に設定するために必要な条件として、クラスターイオンとしてC(3≦n≦16,3≦m≦10)を用いる場合、炭素1原子あたりの加速電圧は、0keV/atom超え50keV/atom以下とし、好ましくは、40keV/atom以下が望ましい。また、クラスターサイズは2〜100個、好ましくは60個以下、より好ましくは50個以下とする。 When C n H m (3 ≦ n ≦ 16, 3 ≦ m ≦ 10) is used as a cluster ion as a necessary condition for setting the peak position within the depth range, the acceleration voltage per carbon atom is 0 keV / atom and 50 keV / atom or less, preferably 40 keV / atom or less. The cluster size is 2 to 100, preferably 60 or less, more preferably 50 or less.

なお、加速電圧の調整には、(1)静電加速、(2)高周波加速の2方法が一般的に用いられる。前者の方法としては、複数の電極を等間隔に並べ、それらの間に等しい電圧を印加して、軸方向に等加速電界を作る方法がある。後者の方法としては、イオンを直線状に走らせながら高周波を用いて加速する線形ライナック法がある。また、クラスターサイズの調整は、ノズルから噴出されるガスのガス圧力および真空容器の圧力、イオン化する際のフィラメントへ印加する電圧などを調整することにより行うことができる。なお、クラスターサイズは、四重極高周波電界による質量分析またはタイムオブフライト質量分析によりクラスター個数分布を求め、クラスター個数の平均値をとることにより求めることができる。   For adjusting the acceleration voltage, two methods of (1) electrostatic acceleration and (2) high frequency acceleration are generally used. As the former method, there is a method in which a plurality of electrodes are arranged at equal intervals and an equal voltage is applied between them to create an equal acceleration electric field in the axial direction. As the latter method, there is a linear linac method in which ions are accelerated using a high frequency while running linearly. The cluster size can be adjusted by adjusting the gas pressure of the gas ejected from the nozzle, the pressure of the vacuum vessel, the voltage applied to the filament during ionization, and the like. The cluster size can be obtained by obtaining a cluster number distribution by mass spectrometry using a quadrupole high-frequency electric field or time-of-flight mass spectrometry and taking an average value of the number of clusters.

また、クラスターイオンのドーズ量は、イオン照射時間を制御することにより調整することができる。本実施形態では、クラスターイオン16の炭素のドーズ量は1×1013〜1×1016atoms/cmとし、1×1014〜5×1015atoms/cm以下であることがより好ましい。1×1013atoms/cm未満の場合、ゲッタリング能力を十分に得ることができない可能性があり、1×1016atoms/cm超えの場合、エピタキシャル表面に大きなダメージを与えるおそれがあるからである。 Moreover, the dose amount of cluster ions can be adjusted by controlling the ion irradiation time. In this embodiment, the carbon dose of the cluster ions 16 is 1 × 10 13 to 1 × 10 16 atoms / cm 2, and more preferably 1 × 10 14 to 5 × 10 15 atoms / cm 2 or less. If it is less than 1 × 10 13 atoms / cm 2 , the gettering ability may not be sufficiently obtained, and if it exceeds 1 × 10 16 atoms / cm 2 , the epitaxial surface may be greatly damaged. It is.

本発明によれば、既述のとおり、RTAやRTOなどの、エピタキシャル装置とは別個の急速昇降温熱処理装置などを用いて回復熱処理を行う必要がない。それは、以下に述べるエピタキシャルシリコン層20を形成するためのエピタキシャル装置内で、エピタキシャル成長に先立ち行われる水素ベーク処理によって、シリコンウェーハ10の結晶性を十分回復させることができるからである。水素ベーク処理の一般的な条件は、エピタキシャル成長装置内を水素雰囲気とし、600℃以上900℃以下の炉内温度でシリコンウェーハ10を炉内に投入し、1℃/秒以上15℃/秒以下の昇温レートで1100℃以上1200℃以下の温度範囲にまで昇温させ、その温度で30秒以上1分以下の間保持するものである。この水素ベーク処理は、本来はエピタキシャル層成長前の洗浄処理によりウェーハ表面に形成された自然酸化膜を除去するためのものであるが、上記条件の水素ベークによりシリコンウェーハ10の結晶性を十分回復させることができる。   According to the present invention, as described above, there is no need to perform the recovery heat treatment using a rapid heating / cooling heat treatment device such as RTA or RTO that is separate from the epitaxial device. This is because the crystallinity of the silicon wafer 10 can be sufficiently recovered by a hydrogen baking process prior to epitaxial growth in an epitaxial apparatus for forming the epitaxial silicon layer 20 described below. The general conditions for the hydrogen baking are as follows: the inside of the epitaxial growth apparatus is in a hydrogen atmosphere, the silicon wafer 10 is placed in the furnace at a furnace temperature of 600 ° C. or higher and 900 ° C. or lower, and 1 ° C./second or higher and 15 ° C./second or lower The temperature is raised to a temperature range of 1100 ° C. or higher and 1200 ° C. or lower at a temperature rising rate, and the temperature is maintained for 30 seconds or longer and 1 minute or shorter. This hydrogen baking process is originally intended to remove the natural oxide film formed on the wafer surface by the cleaning process before the epitaxial layer growth, but the crystallinity of the silicon wafer 10 is sufficiently restored by the hydrogen baking under the above conditions. Can be made.

もちろん第2工程の後、第3工程の前に、エピタキシャル装置とは別個の熱処理装置を用いて回復熱処理を行ってもよい(図1(E))。この回復熱処理は、900℃以上1200℃以下で10秒以上1時間以下行えばよい。ここで、熱処理温度を900℃以上1200℃以下とするのは、900℃未満では、結晶性の回復効果が得られにくいためであり、一方、1200℃を超えると、高温での熱処理に起因するスリップが発生し、また、装置への熱負荷が大きくなるためである。また、熱処理時間を10秒以上1時間以下とするのは、10秒未満では回復効果が得られにくいためであり、一方、1時間超えでは、生産性の低下を招き、装置への熱負荷が大きくなるためである。   Of course, recovery heat treatment may be performed after the second step and before the third step by using a heat treatment apparatus separate from the epitaxial apparatus (FIG. 1E). This recovery heat treatment may be performed at 900 ° C. to 1200 ° C. for 10 seconds to 1 hour. Here, the reason why the heat treatment temperature is set to 900 ° C. or more and 1200 ° C. or less is that if the temperature is less than 900 ° C., it is difficult to obtain the crystallinity recovery effect. This is because slip occurs and the heat load on the apparatus increases. Moreover, the heat treatment time is set to 10 seconds or more and 1 hour or less because a recovery effect is difficult to be obtained if the heat treatment time is less than 10 seconds. This is because it becomes larger.

このような回復熱処理は、例えば、RTAやRTOなどの急速昇降温熱処理装置や、バッチ式熱処理装置(縦型熱処理装置、横型熱処理装置)を用いて行うことができる。前者は、ランプ照射加熱方式のため、装置構造的に長時間処理には適しておらず、15分以内の熱処理に適している。一方、後者は、所定温度までに温度上昇させるために時間がかかるものの、一度に多数枚のウェーハを同時に処理できる。また、抵抗加熱方式のため、長時間の熱処理が可能である。使用する熱処理装置は、クラスターイオン16の照射条件を考慮して適切なものを選択すればよい。   Such recovery heat treatment can be performed using, for example, a rapid heating / cooling heat treatment apparatus such as RTA or RTO, or a batch heat treatment apparatus (vertical heat treatment apparatus, horizontal heat treatment apparatus). Since the former is a lamp irradiation heating method, it is not suitable for long-time treatment in terms of the device structure, and is suitable for heat treatment within 15 minutes. On the other hand, in the latter, although it takes time to raise the temperature to a predetermined temperature, a large number of wafers can be processed simultaneously. In addition, because of the resistance heating method, long-time heat treatment is possible. An appropriate heat treatment apparatus may be selected in consideration of the irradiation conditions of the cluster ions 16.

本実施形態の第3工程において、改質層18上に形成するエピタキシャルシリコン層20は、一般的な条件により形成することができる。例えば、水素をキャリアガスとして、ジクロロシラン、トリクロロシランなどのソースガスをチャンバー内に導入し、使用するソースガスによっても成長温度は異なるが、概ね1000〜1200℃の温度範囲の温度でCVD法によりシリコンウェーハ10上にエピタキシャル成長させることができる。エピタキシャルシリコン層20は、厚さが1〜15μmの範囲内とすることが好ましい。1μm未満の場合、シリコンウェーハ10からのドーパントの外方拡散によりエピタキシャルシリコン層20の抵抗率が変化してしまう可能性があり、また、15μm超えの場合、固体撮像素子の分光感度特性に影響が生じるおそれがあるからである。エピタキシャルシリコン層20は裏面照射型固体撮像素子を製造するためのデバイス層となる。   In the third step of this embodiment, the epitaxial silicon layer 20 formed on the modified layer 18 can be formed under general conditions. For example, hydrogen is used as a carrier gas and a source gas such as dichlorosilane or trichlorosilane is introduced into the chamber, and the growth temperature varies depending on the source gas used, but it is approximately 1000 to 1200 ° C. by the CVD method. It can be epitaxially grown on the silicon wafer 10. The epitaxial silicon layer 20 preferably has a thickness in the range of 1 to 15 μm. If the thickness is less than 1 μm, the resistivity of the epitaxial silicon layer 20 may change due to the out-diffusion of dopant from the silicon wafer 10, and if it exceeds 15 μm, the spectral sensitivity characteristics of the solid-state imaging device are affected. This is because it may occur. The epitaxial silicon layer 20 becomes a device layer for manufacturing a back-illuminated solid-state imaging device.

(エピタキシャルシリコンウェーハ)
次に、上記製造方法により得られるエピタキシャルシリコンウェーハ100について説明する。一実施形態によるエピタキシャルシリコンウェーハ100は、図1(F)に示すように、表層部に酸素外方拡散層11を備えたシリコンウェーハ10と、このシリコンウェーハ10の酸素外方拡散層側の表面10Aに形成された、シリコンウェーハ10中に所定元素が固溶してなる改質層18と、改質層18上のエピタキシャルシリコン層20と、を有する。そして、改質層18における所定元素の深さ方向の濃度プロファイルの半値幅Wが100nm以下であることを特徴とする。
(Epitaxial silicon wafer)
Next, the epitaxial silicon wafer 100 obtained by the above manufacturing method will be described. As shown in FIG. 1F, an epitaxial silicon wafer 100 according to an embodiment includes a silicon wafer 10 having an oxygen outward diffusion layer 11 in the surface layer portion, and a surface of the silicon wafer 10 on the oxygen outward diffusion layer side. The silicon wafer 10 has a modified layer 18 formed by dissolving a predetermined element in the silicon wafer 10 and an epitaxial silicon layer 20 on the modified layer 18. The half width W of the concentration profile in the depth direction of the predetermined element in the modified layer 18 is 100 nm or less.

すなわち、本発明の製造方法によれば、モノマーイオン注入に比べて、クラスターイオンを構成する元素の析出領域を局所的かつ高濃度にすることができるため、上記半値幅Wを100nm以下とすることが可能となった。下限としては10nmと設定することができる。なお、本明細書における「深さ方向の濃度プロファイル」は、二次イオン質量分析法(SIMS:Secondary Ion Mass Spectrometry)にて測定した深さ方向の濃度分布を意味する。また、「改質層における所定元素の深さ方向の濃度プロファイルの半値幅」は、測定精度を考慮して、エピタキシャル層の厚さが1μm超の場合は、エピタキシャル層を1μmに薄膜化した状態で、SIMSにて所定元素の濃度プロファイルを測定したときの半値幅とする。   That is, according to the manufacturing method of the present invention, the precipitation region of the elements constituting the cluster ions can be locally and highly concentrated as compared with the monomer ion implantation, so that the half width W is set to 100 nm or less. Became possible. The lower limit can be set to 10 nm. Note that the “concentration profile in the depth direction” in this specification means a concentration distribution in the depth direction measured by secondary ion mass spectrometry (SIMS: Secondary Ion Mass Spectrometry). In addition, the “half-value width of the concentration profile in the depth direction of the predetermined element in the modified layer” is a state in which the epitaxial layer is thinned to 1 μm when the thickness of the epitaxial layer exceeds 1 μm in consideration of measurement accuracy. Thus, the half width when the concentration profile of the predetermined element is measured by SIMS is used.

また、既述のとおり、エピタキシャルシリコンウェーハ100には、酸素外方拡散層11が存在するために、シリコンウェーハ10表層部の酸素濃度がシリコンウェーハ10中心部の酸素濃度に比べて低下している。さらに、エピタキシャルシリコンウェーハ100において、改質層18は重金属の捕獲に加えて、酸素を捕獲するため、エピタキシャルシリコン層20への酸素の拡散を抑制する。そのため、エピタキシャルシリコン層20中の酸素濃度を低下することができ、したがってエピタキシャルシリコン層20中におけるサーマルドナーの形成を低減することができる。このため、このエピタキシャルシリコンウェーハ100による固体撮像素子のVthの変動を抑制することができる。   As described above, since the oxygen outward diffusion layer 11 is present in the epitaxial silicon wafer 100, the oxygen concentration in the surface layer portion of the silicon wafer 10 is lower than the oxygen concentration in the central portion of the silicon wafer 10. . Further, in the epitaxial silicon wafer 100, the modified layer 18 captures oxygen in addition to capturing heavy metals, thereby suppressing oxygen diffusion into the epitaxial silicon layer 20. As a result, the oxygen concentration in the epitaxial silicon layer 20 can be lowered, and therefore the formation of thermal donors in the epitaxial silicon layer 20 can be reduced. For this reason, the fluctuation | variation of Vth of the solid-state image sensor by this epitaxial silicon wafer 100 can be suppressed.

また、所定元素としては、シリコン以外の元素であれば特に限定されないが、炭素または炭素を含む2種以上の元素とすることが好ましいのは既述のとおりである。   The predetermined element is not particularly limited as long as it is an element other than silicon, but as described above, it is preferable to use carbon or two or more elements containing carbon.

より高いゲッタリング能力を得る観点から、エピタキシャルシリコンウェーハ100は、シリコンウェーハ10の酸素外方拡散層側の表面10Aからの深さが150nm以下の範囲内に、改質層18における濃度プロファイルのピークが位置することが好ましい。また、濃度プロファイルのピーク濃度が、1×1015〜1×1022atoms/cmが好ましく、1×1017〜1×1021atoms/cmの範囲内がより好ましい。 From the viewpoint of obtaining a higher gettering capability, the epitaxial silicon wafer 100 has a peak concentration profile in the modified layer 18 within a depth of 150 nm or less from the surface 10A on the oxygen outward diffusion layer side of the silicon wafer 10. Is preferably located. Further, the peak concentration of the concentration profile is preferably 1 × 10 15 to 1 × 10 22 atoms / cm 3 , and more preferably in the range of 1 × 10 17 to 1 × 10 21 atoms / cm 3 .

また、改質層18の深さ方向厚みは、概ね30〜400nmの範囲内とすることができる。   Moreover, the depth direction thickness of the modified layer 18 can be in the range of approximately 30 to 400 nm.

本実施形態のエピタキシャルシリコンウェーハ100によれば、従来に比べ高いゲッタリング能力を発揮することで、金属汚染をより抑制することができ、かつ、シリコンウェーハからエピタキシャル層への酸素拡散を低減することができる。   According to the epitaxial silicon wafer 100 of the present embodiment, the metal contamination can be further suppressed by exhibiting higher gettering capability than conventional, and oxygen diffusion from the silicon wafer to the epitaxial layer can be reduced. Can do.

(固体撮像素子の製造方法)
本発明の実施形態による固体撮像素子の製造方法は、上記の製造方法で製造されたエピタキシャルシリコンウェーハまたは上記のエピタキシャルシリコンウェーハ、すなわちエピタキシャルシリコンウェーハ100の酸素外方拡散層側の表面10Aに位置するエピタキシャルシリコン層20に、固体撮像素子を形成することを特徴とする。この製造方法により得られる固体撮像素子は、従来に比べ製造工程の各処理中で発生する重金属汚染の影響を低減でき、従来に比べ白傷欠陥の発生の抑制が期待できる。また、この固体撮像素子は、エピタキシャルシリコン層20の酸素拡散が抑制されているため、Vthの変化を抑制することができる。
(Method for manufacturing solid-state imaging device)
The manufacturing method of the solid-state imaging device according to the embodiment of the present invention is located on the surface of the epitaxial silicon wafer manufactured by the above manufacturing method or the above epitaxial silicon wafer, that is, the surface 10A on the oxygen outward diffusion layer side of the epitaxial silicon wafer 100. A solid-state imaging device is formed on the epitaxial silicon layer 20. The solid-state imaging device obtained by this manufacturing method can reduce the influence of heavy metal contamination generated during each process of the manufacturing process as compared with the conventional method, and can be expected to suppress the occurrence of white defect as compared with the conventional method. Further, this solid-state imaging device can suppress the change in Vth because the oxygen diffusion of the epitaxial silicon layer 20 is suppressed.

以上、本発明の代表的な実施形態を説明したが、本発明はこれらの実施形態に限定されるものではない。   The exemplary embodiments of the present invention have been described above, but the present invention is not limited to these embodiments.

(参考実験例)
まず、クラスターイオン照射とモノマーイオン注入の相違を明らかにするため、以下の実験を行った。
(Reference experiment example)
First, the following experiment was conducted to clarify the difference between cluster ion irradiation and monomer ion implantation.

(参考例1)
CZ単結晶シリコンインゴットから得た、酸素濃度が15×1017atoms/cm(ASTM F121−1979)であるn型シリコンウェーハ(直径:300mm、厚さ:725μm、結晶方位:<100>、ドーパント:リン、ドーパント濃度:4×1014atoms/cm)を用意した。次に、縦型熱処理装置(日立国際電気製)を使用して、アルゴンガス雰囲気下で、1200℃,1時間の条件で酸素外方拡散熱処理をシリコンウェーハに施して酸素外方拡散層(厚さ:10μm)を形成した。その後、クラスターイオン発生装置(日新イオン機器社製、型番:CLARIS)を用いて、ジベンジル(C1414)より生成、イオン化させたCクラスターイオンを、ドーズ量9.0×1013Clusters/cm(炭素のドーズ量4.5×1014atoms/cm)、炭素1原子あたりの加速電圧14.8keV/atomの条件で、シリコンウェーハに照射した。
(Reference Example 1)
N-type silicon wafer (diameter: 300 mm, thickness: 725 μm, crystal orientation: <100>, dopant, obtained from CZ single crystal silicon ingot and having an oxygen concentration of 15 × 10 17 atoms / cm 3 (ASTM F121-1979) : Phosphorus, dopant concentration: 4 × 10 14 atoms / cm 3 ). Next, using a vertical heat treatment apparatus (manufactured by Hitachi Kokusai Electric), an oxygen outward diffusion heat treatment (thickness) is performed by subjecting the silicon wafer to an oxygen outward diffusion heat treatment under an argon gas atmosphere at 1200 ° C. for 1 hour. S: 10 μm) was formed. Thereafter, using a cluster ion generator (manufactured by Nissin Ion Instruments Co., Ltd., model number: CLARIS), the C 5 H 5 cluster ions generated and ionized from dibenzyl (C 14 H 14 ) are dosed 9.0 × 10 The silicon wafer was irradiated under conditions of 13 Clusters / cm 2 (carbon dose amount 4.5 × 10 14 atoms / cm 2 ) and an acceleration voltage of 14.8 keV / atom per carbon atom.

(参考例2)
参考例1と同じシリコンウェーハに対して、クラスターイオン照射に替えて、COを材料ガスとして、炭素のモノマーイオンを生成し、ドーズ量9.0×1013atoms/cm、加速電圧300keV/atomの条件とした以外は、参考例1と同じ条件で、シリコンウェーハに照射した。
(Reference Example 2)
For the same silicon wafer as in Reference Example 1, instead of cluster ion irradiation, carbon monomer ions are generated using CO 2 as a material gas, a dose amount of 9.0 × 10 13 atoms / cm 2 , an acceleration voltage of 300 keV / The silicon wafer was irradiated under the same conditions as in Reference Example 1 except that the atom conditions were used.

上記参考例1,2で作製したサンプルについて、SIMSにより測定を行い、図3に示す炭素の濃度プロファイルを得た。なお、横軸の深さはシリコンウェーハの、イオン照射/注入した側の表面をゼロとしている。この図3から明らかなように、クラスターイオン照射をした参考例1では、炭素濃度プロファイルがシャープであるが、モノマーイオン注入をした参考例2では、炭素濃度プロファイルがブロードである。また、参考例2に比べて参考例1では、炭素の濃度プロファイルのピーク濃度が高く、ピーク位置もよりシリコンウェーハ表面近傍に位置している。このことから、エピタキシャル層形成後も、炭素の濃度プロファイルの傾向は同様となることが推定される。   About the sample produced by the said reference examples 1 and 2, it measured by SIMS and obtained the carbon concentration profile shown in FIG. The depth on the horizontal axis is zero on the surface of the silicon wafer on the side irradiated with / implanted ions. As is clear from FIG. 3, the carbon concentration profile is sharp in Reference Example 1 where cluster ion irradiation is performed, but the carbon concentration profile is broad in Reference Example 2 where monomer ions are implanted. Further, in Reference Example 1, the peak concentration of the carbon concentration profile is higher than that in Reference Example 2, and the peak position is located closer to the silicon wafer surface. From this, it is presumed that the tendency of the carbon concentration profile remains the same after the formation of the epitaxial layer.

(実施例1)
CZ単結晶シリコンインゴットから得た、酸素濃度が15×1017atoms/cm(ASTM F121−1979)であるn型シリコンウェーハ(直径:300mm、厚さ:725μm、結晶方位:<100>、ドーパント:リン、ドーパント濃度:4×1014atoms/cm)を用意した。次に、縦型熱処理装置(日立国際電気社製)を使用して、アルゴンガス雰囲気下で、1200℃,1時間の条件で酸素外方拡散熱処理をシリコンウェーハに施して酸素外方拡散層(厚さ:10μm)を形成した。さらに、クラスターイオン発生装置(日新イオン機器社製、型番:CLARIS)を用いて、表1に記載の条件で、シリコンウェーハに照射した。その後、シリコンウェーハをHF洗浄処理した後、枚葉式エピタキシャル成長装置(アプライドマテリアルズ社製)内に搬送し、装置内で1120℃の温度で30秒の水素ベーク処理を施した後、水素をキャリアガス、トリクロロシランをソースガス、ホスフィン(PH)をドーパントガスとして1150℃でCVD法により、シリコンウェーハ上にシリコンのエピタキシャル層(厚さ:6μm、ドーパント種類:リン、ドーパント濃度:1×1015atoms/cm)をエピタキシャル成長させ、本発明に従うエピタキシャルシリコンウェーハを作製した。
Example 1
N-type silicon wafer (diameter: 300 mm, thickness: 725 μm, crystal orientation: <100>, dopant, obtained from CZ single crystal silicon ingot and having an oxygen concentration of 15 × 10 17 atoms / cm 3 (ASTM F121-1979) : Phosphorus, dopant concentration: 4 × 10 14 atoms / cm 3 ). Next, using a vertical heat treatment apparatus (manufactured by Hitachi Kokusai Electric Inc.), an oxygen outward diffusion heat treatment was performed on the silicon wafer under an argon gas atmosphere at 1200 ° C. for 1 hour by applying oxygen outward diffusion heat treatment to the silicon wafer. (Thickness: 10 μm) was formed. Furthermore, it irradiated to the silicon wafer on the conditions of Table 1 using the cluster ion generator (the Nissin ion equipment company make, model number: CLARIS). Then, after the silicon wafer is subjected to HF cleaning treatment, it is transferred into a single wafer epitaxial growth apparatus (Applied Materials) and subjected to hydrogen baking treatment at a temperature of 1120 ° C. for 30 seconds in the apparatus, followed by hydrogen carrier A silicon epitaxial layer (thickness: 6 μm, dopant type: phosphorus, dopant concentration: 1 × 10 15 ) on a silicon wafer by a CVD method at 1150 ° C. using a gas, trichlorosilane as a source gas, and phosphine (PH 3 ) as a dopant gas atoms / cm 3 ) was epitaxially grown to produce an epitaxial silicon wafer according to the present invention.

(実施例2)
シリコンウェーハへの酸素外方拡散熱処理を、縦型熱処理装置の使用に替えて、RTA装置(マトソンサーマルプロダクト社製)を使用し、表1の熱処理条件に変更した以外は、実施例1と同じ条件で、本発明に従うエピタキシャルシリコンウェーハを作製した。
(Example 2)
The oxygen outward diffusion heat treatment to the silicon wafer was the same as in Example 1 except that the RTA apparatus (manufactured by Matson Thermal Products) was used instead of the vertical heat treatment apparatus and the heat treatment conditions in Table 1 were changed. Under conditions, an epitaxial silicon wafer according to the present invention was produced.

(比較例1,2)
シリコンウェーハへの酸素外方拡散熱処理条件を表1に記載のとおりとし、さらに、クラスターイオン照射に替えて、表1に記載の条件で、炭素のモノマーイオン注入とした以外は、実施例1と同じ条件で、比較例にかかるシリコンエピタキシャルシリコンウェーハを作製した。
(Comparative Examples 1 and 2)
Example 1 except that the oxygen outward diffusion heat treatment conditions for the silicon wafer are as shown in Table 1 and that carbon ion implantation is performed under the conditions shown in Table 1 instead of the cluster ion irradiation. Under the same conditions, a silicon epitaxial silicon wafer according to the comparative example was produced.

(比較例3)
酸素外方拡散熱処理を行わず、かつ、クラスターイオンの照射を行わなかった以外は、実施例1と同じ条件で、比較例にかかるエピタキシャルシリコンウェーハを作製した。
(Comparative Example 3)
An epitaxial silicon wafer according to a comparative example was produced under the same conditions as in Example 1 except that the oxygen outward diffusion heat treatment was not performed and the cluster ion irradiation was not performed.

Figure 2014099465
Figure 2014099465

(評価方法および評価結果)
(1)SIMS測定
代表例として、実施例1および比較例1で作製した各サンプルについてSIMS測定を行い、図4(A),(B)に示す炭素の濃度プロファイルを得た。なお、横軸の深さはエピタキシャル層の表面をゼロとしている。さらに、実施例1,2および比較例1,2で作製した各サンプルについて、エピタキシャル層を1μmまで薄膜化した後にSIMS測定を行った。このとき得られた炭素の濃度プロファイルの半値幅、ピーク濃度、およびピーク位置(エピタキシャル層を除いたイオン照射/注入した側の表面からのピーク深さ)を表1に示す。
(Evaluation method and evaluation results)
(1) SIMS Measurement As a representative example, SIMS measurement was performed on each sample produced in Example 1 and Comparative Example 1, and carbon concentration profiles shown in FIGS. 4A and 4B were obtained. The depth of the horizontal axis is zero on the surface of the epitaxial layer. Further, for each sample produced in Examples 1 and 2 and Comparative Examples 1 and 2, SIMS measurement was performed after the epitaxial layer was thinned to 1 μm. Table 1 shows the half-value width, peak concentration, and peak position (peak depth from the surface of the ion-irradiated / implanted side excluding the epitaxial layer) of the carbon concentration profile obtained at this time.

(2)ゲッタリング能力評価
実施例1,2および比較例1,2で作製した各サンプルのエピタキシャルシリコンウェーハ表面を、Cu汚染液(1.0×1012/cm)で、スピンコート汚染法を用いて故意に汚染し、引き続き900℃、30分の熱処理を施した。その後、SIMS測定を行った。代表例として、実施例1および比較例1についてのCu濃度プロファイルを、それぞれ炭素濃度プロファイルとともに示す(図4(A),(B))。他の実施例および比較例については、ゲッタリング能力評価の結果を表1に示す。Cuの濃度プロファイルのピーク濃度を以下のようにそれぞれ分類して、評価基準とした。
◎:1×1017atoms/cm以上
○:7.5×1016atoms/cm以上〜1×1017atoms/cm未満
△:7.5×1016atoms/cm未満
(2) Evaluation of gettering capability The surface of the epitaxial silicon wafer of each sample prepared in Examples 1 and 2 and Comparative Examples 1 and 2 was subjected to spin coating contamination using a Cu contamination liquid (1.0 × 10 12 / cm 2 ). Was deliberately contaminated with a heat treatment, followed by heat treatment at 900 ° C. for 30 minutes. Thereafter, SIMS measurement was performed. As representative examples, the Cu concentration profiles for Example 1 and Comparative Example 1 are shown together with the carbon concentration profiles (FIGS. 4A and 4B). Table 1 shows the results of gettering ability evaluation for other examples and comparative examples. The peak concentrations in the Cu concentration profile were classified as follows and used as evaluation criteria.
◎: 1 × 10 17 atoms / cm 3 or more ○: 7.5 × 10 16 atoms / cm 3 or more to less than 1 × 10 17 atoms / cm 3 Δ: less than 7.5 × 10 16 atoms / cm 3

(3)酸素濃度測定
作製した実施例1,2および比較例3で作製した各サンプルについてSIMS測定を行い、図5に示すエピタキシャル層における酸素濃度を得た。なお、横軸の深さはエピタキシャル層の表面をゼロとしている。
(3) Oxygen Concentration Measurement Each of the samples prepared in Examples 1 and 2 and Comparative Example 3 was subjected to SIMS measurement to obtain the oxygen concentration in the epitaxial layer shown in FIG. The depth of the horizontal axis is zero on the surface of the epitaxial layer.

(4)エピタキシャルシリコンウェーハのBMD評価
実施例1,2で作製した各サンプルのエピタキシャルウェーハついて、イントリンシックゲッタリング能力をそれぞれ評価した。具体的には、顕微鏡観察を行うためにBMDを顕在化させ、かつ、BMDの検出性を高めるために、まず、実施例1,2のエピタキシャルシリコンウェーハを800℃,4時間の熱処理を行った後、引き続き1000℃,16時間の熱処理を行う。その後、各エピタキシャルシリコンウェーハを劈開し、劈開断面を2μmエッチングするようにWrightエッチング溶液により選択エッチングを行った。その後、光学顕微鏡を用いて、基板であるシリコンウェーハ断面の酸素析出物密度を測定した。その結果、シリコンウェーハ内部に1×10個/cm以上のBMDが形成されていた。
(4) BMD Evaluation of Epitaxial Silicon Wafer The intrinsic gettering ability of each sample epitaxial wafer produced in Examples 1 and 2 was evaluated. Specifically, in order to reveal BMD for microscopic observation and improve the detectability of BMD, first, the epitaxial silicon wafers of Examples 1 and 2 were heat-treated at 800 ° C. for 4 hours. Thereafter, heat treatment is continuously performed at 1000 ° C. for 16 hours. Thereafter, each epitaxial silicon wafer was cleaved, and selective etching was performed with a Wright etching solution so that the cleaved cross section was etched by 2 μm. Then, the oxygen precipitate density of the silicon wafer cross section which is a board | substrate was measured using the optical microscope. As a result, BMD of 1 × 10 6 pieces / cm 2 or more was formed inside the silicon wafer.

(評価結果の考察)
図4(A),(B)から、クラスターイオン照射により、実施例1では、モノマーイオン注入を施した比較例1と比べて、炭素が局所的かつ高濃度に固溶した改質層が形成されることがわかる。そして、表1に示すように、実施例1,2は、炭素の濃度プロファイルの半値幅がいずれも100nm以下であるために、Cuに対して、比較例1,2よりも優れたゲッタリング能力を発揮していることがわかる。
(Consideration of evaluation results)
4A and 4B, the modified layer in which carbon is locally dissolved at a high concentration is formed in Example 1 by cluster ion irradiation as compared with Comparative Example 1 in which monomer ion implantation is performed. You can see that And as shown in Table 1, in Examples 1 and 2, the half-value width of the carbon concentration profile is 100 nm or less, and therefore, gettering ability superior to Comparative Examples 1 and 2 with respect to Cu. It can be seen that

また、図5から、酸素外方拡散熱処理およびクラスターイオン照射の両方を行った実施例1,2は、それら両方を行っていない比較例3と比べて、エピタキシャル層への酸素拡散量が少ないことがわかった。   In addition, from FIG. 5, Examples 1 and 2 in which both the oxygen outward diffusion heat treatment and the cluster ion irradiation were performed had a smaller amount of oxygen diffusion into the epitaxial layer than Comparative Example 3 in which both were not performed I understood.

また、実施例1,2で用いたシリコンウェーハ内部に1×10個/cm以上のBMDが形成されていたのは、シリコンウェーハの酸素濃度が高かったためであると考えられる。このBMD評価の結果から、実施例1,2のエピタキシャルシリコンウェーハには、十分なイントリンシックゲッタリング(IG)能があることがわかる。 Moreover, it is considered that the BMD of 1 × 10 6 pieces / cm 2 or more was formed inside the silicon wafer used in Examples 1 and 2 because the oxygen concentration of the silicon wafer was high. From the results of this BMD evaluation, it can be seen that the epitaxial silicon wafers of Examples 1 and 2 have sufficient intrinsic gettering (IG) capability.

本発明によれば、より高いゲッタリング能力を発揮することで、金属汚染を抑制することができ、かつ、シリコンウェーハからエピタキシャル層への酸素拡散を低減できるエピタキシャルシリコンウェーハを得ることができ、また、このエピタキシャルシリコンウェーハから高品質の固体撮像素子を形成することができる。   According to the present invention, by exhibiting higher gettering ability, it is possible to obtain an epitaxial silicon wafer that can suppress metal contamination and reduce oxygen diffusion from the silicon wafer to the epitaxial layer. A high-quality solid-state imaging device can be formed from this epitaxial silicon wafer.

10 シリコンウェーハ
10A (酸素外方拡散層側の)表面
11 酸素外方拡散層
16 クラスターイオン
18 改質層
20 エピタキシャルシリコン層
100 エピタキシャルシリコンウェーハ
10 Silicon wafer 10A Surface 11 (on the oxygen outward diffusion layer side) 11 Oxygen outward diffusion layer 16 Cluster ion 18 Modified layer 20 Epitaxial silicon layer 100 Epitaxial silicon wafer

Claims (13)

シリコンウェーハに酸素外方拡散熱処理を施して、前記シリコンウェーハの表層部に酸素外方拡散層を形成する第1工程と、
前記第1工程の後、前記シリコンウェーハにクラスターイオンを照射して、前記シリコンウェーハの前記酸素外方拡散層側の表面に、前記クラスターイオンの構成元素が固溶してなる改質層を形成する第2工程と、
前記シリコンウェーハの改質層上にエピタキシャルシリコン層を形成する第3工程と、
を有することを特徴とするエピタキシャルシリコンウェーハの製造方法。
A first step of performing oxygen outward diffusion heat treatment on the silicon wafer to form an oxygen outward diffusion layer on a surface layer portion of the silicon wafer;
After the first step, the silicon wafer is irradiated with cluster ions to form a modified layer in which the constituent elements of the cluster ions are dissolved in the surface of the silicon wafer on the oxygen outward diffusion layer side. A second step of
A third step of forming an epitaxial silicon layer on the modified layer of the silicon wafer;
A method for producing an epitaxial silicon wafer, comprising:
前記第1工程を行う前の前記シリコンウェーハの酸素濃度が8×1017〜18×1017atoms/cm以下である請求項1に記載のエピタキシャルシリコンウェーハの製造方法。 2. The method for producing an epitaxial silicon wafer according to claim 1, wherein an oxygen concentration of the silicon wafer before the first step is 8 × 10 17 to 18 × 10 17 atoms / cm 3 or less. 前記第2工程の後、前記シリコンウェーハに対して結晶性回復のための熱処理を行うことなく、前記シリコンウェーハをエピタキシャル成長装置に搬送して前記第3工程を行う請求項1または2に記載のエピタキシャルシリコンウェーハの製造方法。   3. The epitaxial according to claim 1, wherein, after the second step, the third step is performed by transferring the silicon wafer to an epitaxial growth apparatus without performing a heat treatment for recovering crystallinity on the silicon wafer. Silicon wafer manufacturing method. 前記第2工程の後、前記第3工程の前に、前記シリコンウェーハに対して結晶性回復のための熱処理を行う請求項1または2に記載のエピタキシャルシリコンウェーハの製造方法。   The method for manufacturing an epitaxial silicon wafer according to claim 1 or 2, wherein a heat treatment for recovering crystallinity is performed on the silicon wafer after the second step and before the third step. 前記クラスターイオンが、構成元素として炭素を含む請求項1〜4のいずれか1項に記載のエピタキシャルシリコンウェーハの製造方法。   The manufacturing method of the epitaxial silicon wafer of any one of Claims 1-4 in which the said cluster ion contains carbon as a structural element. 前記クラスターイオンが、構成元素として炭素を含む2種以上の元素を含む請求項5に記載のエピタキシャルシリコンウェーハの製造方法。   The manufacturing method of the epitaxial silicon wafer of Claim 5 in which the said cluster ion contains 2 or more types of elements containing carbon as a structural element. 前記クラスターイオンの照射条件は、炭素1原子あたり加速電圧が50keV/atom以下、クラスターサイズが100個以下、炭素のドーズ量が1×1016atoms/cm以下である請求項5または6に記載のエピタキシャルシリコンウェーハの製造方法。 The irradiation condition of the cluster ions is an acceleration voltage of 50 keV / atom or less per carbon atom, a cluster size of 100 or less, and a carbon dose of 1 × 10 16 atoms / cm 2 or less. Of manufacturing an epitaxial silicon wafer. 表層部に酸素外方拡散層を備えたシリコンウェーハと、該シリコンウェーハの前記酸素外方拡散層側の表面に形成された、該シリコンウェーハ中に所定元素が固溶してなる改質層と、該改質層上のエピタキシャル層と、を有し、
前記改質層における、前記所定元素の濃度プロファイルの半値幅が100nm以下であることを特徴とするエピタキシャルシリコンウェーハ。
A silicon wafer provided with an oxygen outward diffusion layer in a surface layer portion, and a modified layer formed on a surface of the silicon wafer on the oxygen outward diffusion layer side, in which a predetermined element is dissolved in the silicon wafer; And an epitaxial layer on the modified layer,
An epitaxial silicon wafer, wherein a half-value width of a concentration profile of the predetermined element in the modified layer is 100 nm or less.
前記シリコンウェーハの前記酸素外方拡散層側の表面からの深さが150nm以下の範囲内に、前記改質層における前記濃度プロファイルのピークが位置する請求項8に記載のエピタキシャルシリコンウェーハ。   The epitaxial silicon wafer according to claim 8, wherein a peak of the concentration profile in the modified layer is located within a depth of 150 nm or less from the surface of the silicon wafer on the oxygen outward diffusion layer side. 前記改質層における前記濃度プロファイルのピーク濃度が1×1015atoms/cm以上である請求項8または9に記載のエピタキシャルシリコンウェーハ。 10. The epitaxial silicon wafer according to claim 8, wherein a peak concentration of the concentration profile in the modified layer is 1 × 10 15 atoms / cm 3 or more. 前記所定元素が炭素を含む請求項8〜10のいずれか1項に記載のエピタキシャルシリコンウェーハ。   The epitaxial silicon wafer according to claim 8, wherein the predetermined element includes carbon. 前記所定元素が炭素を含む2種以上の元素を含む請求項11に記載のエピタキシャルシリコンウェーハ。   The epitaxial silicon wafer according to claim 11, wherein the predetermined element includes two or more elements including carbon. 請求項1〜7のいずれか1項に記載の製造方法で製造されたエピタキシャルシリコンウェーハまたは請求項8〜12のいずれか1項に記載のエピタキシャルシリコンウェーハの、酸素外方拡散層側の表面に位置するエピタキシャル層に、固体撮像素子を形成することを特徴とする固体撮像素子の製造方法。   The epitaxial silicon wafer manufactured by the manufacturing method according to any one of claims 1 to 7 or the surface of the epitaxial silicon wafer according to any one of claims 8 to 12 on the oxygen outward diffusion layer side. A method for manufacturing a solid-state imaging device, comprising forming a solid-state imaging device in an epitaxial layer located.
JP2012249437A 2012-11-13 2012-11-13 Epitaxial silicon wafer manufacturing method, epitaxial silicon wafer, and solid-state imaging device manufacturing method Active JP6280301B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2012249437A JP6280301B2 (en) 2012-11-13 2012-11-13 Epitaxial silicon wafer manufacturing method, epitaxial silicon wafer, and solid-state imaging device manufacturing method

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2012249437A JP6280301B2 (en) 2012-11-13 2012-11-13 Epitaxial silicon wafer manufacturing method, epitaxial silicon wafer, and solid-state imaging device manufacturing method

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2017091475A Division JP6361779B2 (en) 2017-05-01 2017-05-01 Epitaxial silicon wafer manufacturing method, epitaxial silicon wafer, and solid-state imaging device manufacturing method

Publications (2)

Publication Number Publication Date
JP2014099465A true JP2014099465A (en) 2014-05-29
JP6280301B2 JP6280301B2 (en) 2018-02-14

Family

ID=50941257

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2012249437A Active JP6280301B2 (en) 2012-11-13 2012-11-13 Epitaxial silicon wafer manufacturing method, epitaxial silicon wafer, and solid-state imaging device manufacturing method

Country Status (1)

Country Link
JP (1) JP6280301B2 (en)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2017112181A (en) * 2015-12-15 2017-06-22 株式会社Sumco Method of manufacturing semiconductor epitaxial wafer and method of manufacturing solid state imaging device
JPWO2019167901A1 (en) * 2018-03-01 2020-12-03 株式会社Sumco Manufacturing method of epitaxial silicon wafer and epitaxial silicon wafer
JP7143805B2 (en) 2019-04-02 2022-09-29 株式会社Sumco Evaluation Method of Impurity Gettering Ability of Epitaxial Silicon Wafer

Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002012496A (en) * 1999-10-19 2002-01-15 Shin Etsu Handotai Co Ltd Silicon epitaxial wafer and method for producing the same
JP2003163216A (en) * 2001-09-12 2003-06-06 Wacker Nsce Corp Epitaxial silicon wafer and its manufacturing method
JP2008294245A (en) * 2007-05-25 2008-12-04 Shin Etsu Handotai Co Ltd Method of manufacturing epitaxial wafer, and epitaxial wafer
JP2009518869A (en) * 2005-12-09 2009-05-07 セムイクウィップ・インコーポレーテッド System and method for manufacturing semiconductor devices by implantation of carbon clusters
JP2009540531A (en) * 2006-06-13 2009-11-19 セムイクウィップ・インコーポレーテッド Ion beam apparatus and ion implantation method
JP2010062529A (en) * 2008-08-04 2010-03-18 Toshiba Corp Method of manufacturing semiconductor device
JP2011151318A (en) * 2010-01-25 2011-08-04 Renesas Electronics Corp Semiconductor device and method of manufacturing the same
WO2011125305A1 (en) * 2010-04-08 2011-10-13 信越半導体株式会社 Silicon epitaxial wafer, method for manufacturing silicon epitaxial wafer, and method for manufacturing semiconductor element or integrated circuit
JP2012059849A (en) * 2010-09-08 2012-03-22 Shin Etsu Handotai Co Ltd Silicon epitaxial wafer and manufacturing method thereof

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002012496A (en) * 1999-10-19 2002-01-15 Shin Etsu Handotai Co Ltd Silicon epitaxial wafer and method for producing the same
JP2003163216A (en) * 2001-09-12 2003-06-06 Wacker Nsce Corp Epitaxial silicon wafer and its manufacturing method
JP2009518869A (en) * 2005-12-09 2009-05-07 セムイクウィップ・インコーポレーテッド System and method for manufacturing semiconductor devices by implantation of carbon clusters
JP2009540531A (en) * 2006-06-13 2009-11-19 セムイクウィップ・インコーポレーテッド Ion beam apparatus and ion implantation method
JP2008294245A (en) * 2007-05-25 2008-12-04 Shin Etsu Handotai Co Ltd Method of manufacturing epitaxial wafer, and epitaxial wafer
JP2010062529A (en) * 2008-08-04 2010-03-18 Toshiba Corp Method of manufacturing semiconductor device
JP2011151318A (en) * 2010-01-25 2011-08-04 Renesas Electronics Corp Semiconductor device and method of manufacturing the same
WO2011125305A1 (en) * 2010-04-08 2011-10-13 信越半導体株式会社 Silicon epitaxial wafer, method for manufacturing silicon epitaxial wafer, and method for manufacturing semiconductor element or integrated circuit
JP2012059849A (en) * 2010-09-08 2012-03-22 Shin Etsu Handotai Co Ltd Silicon epitaxial wafer and manufacturing method thereof

Cited By (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2017112181A (en) * 2015-12-15 2017-06-22 株式会社Sumco Method of manufacturing semiconductor epitaxial wafer and method of manufacturing solid state imaging device
WO2017104584A1 (en) * 2015-12-15 2017-06-22 株式会社Sumco Method for producing semiconductor epitaxial wafer and method for manufacturing solid-state imaging element
KR20180073658A (en) * 2015-12-15 2018-07-02 가부시키가이샤 사무코 Method for producing semiconductor epitaxial wafer and method for manufacturing solid-state imaging element
CN108496239A (en) * 2015-12-15 2018-09-04 胜高股份有限公司 The manufacturing method of semiconductor epitaxial wafer and the manufacturing method of solid-state imager
TWI648769B (en) * 2015-12-15 2019-01-21 日商Sumco股份有限公司 Manufacturing method of semiconductor epitaxial wafer and manufacturing method of solid-state imaging element
US10396120B2 (en) 2015-12-15 2019-08-27 Sumco Corporation Method for producing semiconductor epitaxial wafer and method of producing solid-state imaging device
KR102063638B1 (en) * 2015-12-15 2020-01-08 가부시키가이샤 사무코 Method for producing semiconductor epitaxial wafer and method for manufacturing solid-state imaging element
CN108496239B (en) * 2015-12-15 2022-10-21 胜高股份有限公司 Method for manufacturing semiconductor epitaxial wafer and method for manufacturing solid-state imaging element
JPWO2019167901A1 (en) * 2018-03-01 2020-12-03 株式会社Sumco Manufacturing method of epitaxial silicon wafer and epitaxial silicon wafer
JP7143805B2 (en) 2019-04-02 2022-09-29 株式会社Sumco Evaluation Method of Impurity Gettering Ability of Epitaxial Silicon Wafer

Also Published As

Publication number Publication date
JP6280301B2 (en) 2018-02-14

Similar Documents

Publication Publication Date Title
JP5673811B2 (en) Manufacturing method of semiconductor epitaxial wafer, semiconductor epitaxial wafer, and manufacturing method of solid-state imaging device
JP6278591B2 (en) Manufacturing method of semiconductor epitaxial wafer, semiconductor epitaxial wafer, and manufacturing method of solid-state imaging device
JP5799936B2 (en) Manufacturing method of semiconductor epitaxial wafer, semiconductor epitaxial wafer, and manufacturing method of solid-state imaging device
JP6065848B2 (en) Manufacturing method of semiconductor epitaxial wafer, semiconductor epitaxial wafer, and manufacturing method of solid-state imaging device
JP5799935B2 (en) Manufacturing method of semiconductor epitaxial wafer, semiconductor epitaxial wafer, and manufacturing method of solid-state imaging device
TWI611482B (en) Method for manufacturing semiconductor epitaxial wafer and method for manufacturing solid-state imaging device
JP6427946B2 (en) Epitaxial silicon wafer manufacturing method, epitaxial silicon wafer, and solid-state imaging device manufacturing method
JP6107068B2 (en) Epitaxial silicon wafer manufacturing method, epitaxial silicon wafer, and solid-state imaging device manufacturing method
JP6280301B2 (en) Epitaxial silicon wafer manufacturing method, epitaxial silicon wafer, and solid-state imaging device manufacturing method
JP6535432B2 (en) Method of manufacturing semiconductor epitaxial wafer, semiconductor epitaxial wafer, and method of manufacturing solid-state imaging device
JP2017112276A (en) Method of manufacturing semiconductor epitaxial wafer and method of manufacturing solid state imaging device
JP2015216296A (en) Method for manufacturing semiconductor epitaxial wafer, and method for manufacturing solid-state imaging device
JP6361779B2 (en) Epitaxial silicon wafer manufacturing method, epitaxial silicon wafer, and solid-state imaging device manufacturing method
JP6278592B2 (en) Manufacturing method of semiconductor epitaxial wafer, semiconductor epitaxial wafer, and manufacturing method of solid-state imaging device
JP6289805B2 (en) Manufacturing method of semiconductor epitaxial wafer, semiconductor epitaxial wafer, and manufacturing method of solid-state imaging device
JP2017175145A (en) Semiconductor epitaxial wafer manufacturing method, semiconductor epitaxial wafer, and solid-state imaging element manufacturing method
JP2017123477A (en) Method for manufacturing semiconductor epitaxial wafer, semiconductor epitaxial wafer, and method for manufacturing solid-state imaging device
JP2015220242A (en) Semiconductor epitaxial wafer manufacturing method and solid state image pickup element manufacturing method
JP6318728B2 (en) Manufacturing method of semiconductor epitaxial wafer, semiconductor epitaxial wafer, and manufacturing method of solid-state imaging device
JP2017175143A (en) Semiconductor epitaxial wafer manufacturing method, semiconductor epitaxial wafer, and solid-state imaging element manufacturing method
JP2017183736A (en) Method for manufacturing semiconductor epitaxial wafer, semiconductor epitaxial wafer, and method for manufacturing solid state image sensor

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20150811

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20160530

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20160607

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20170207

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20180119

R150 Certificate of patent or registration of utility model

Ref document number: 6280301

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250