JP2013168497A - 窒化物半導体装置 - Google Patents

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Abstract

【課題】窒化物半導体層とオーミック電極とのコンタクト抵抗を低減できる窒化物半導体装置を提供する。
【解決手段】このGaN系HFETは、Si基板10上に形成されたアンドープGaN層1,アンドープAlGaN層2による窒化物半導体積層体20に凹部106,109が形成され、この凹部106,109にオーミック電極(ソース電極11,ドレイン電極12)が形成されている。このTiAl系材料からなるオーミック電極とGaN層1との界面S1よりも深い領域において、界面近傍の第1の酸素濃度ピークと、第1の酸素濃度ピークよりも深い位置に酸素濃度が3×1017cm−3〜1.2×1018cm−3以下の第2の酸素濃度ピークを有する。
【選択図】図1

Description

この発明は、窒化物半導体装置に関する。
従来、窒化物半導体装置としては、n型GaNコンタクト層の表面に酸素プラズマ処理を行って酸素ドープ層を形成した後に、そのn型GaNコンタクト層上にオーミック電極を形成することによって、n型GaNコンタクト層とオーミック電極とのコンタクト抵抗を低減するものがある(特許第2967743号公報(特許文献1)参照)。
ところが、上記窒化物半導体装置について、本発明者が実際に実験を行ってGaN層に酸素プラズマ処理を行った後にオーミック電極を形成した場合、オーミック電極のコンタクト抵抗が高く、十分に低いコンタクト抵抗を得ることはどうしてもできなかった。
特許第2967743号公報
そこで、この発明の課題は、窒化物半導体層とオーミック電極とのコンタクト抵抗を低減できる窒化物半導体装置を提供することにある。
本発明者は、窒化物半導体層上に形成されたオーミック電極のコンタクト抵抗について鋭意検討した結果、TiAl系材料からなるオーミック電極と窒化物半導体層との界面の基板側の領域において上記界面近傍に発生する第1の酸素濃度ピークと第1の酸素濃度ピークよりも深い位置の第2の酸素濃度ピークを発生させた場合に、上記第2の酸素濃度ピークの酸素濃度に応じて窒化物半導体層とオーミック電極とのコンタクト抵抗の特性が変化することを発見した。
さらに、本発明者は、上記界面より基板側の第2の酸素濃度ピークの酸素濃度が特定の範囲内であるときにコンタクト抵抗が大幅に減少することを実験により初めて見出した。
上記発見に基づき、この発明の窒化物半導体装置は、
基板と、
上記基板上に形成されていると共にヘテロ界面を有する窒化物半導体積層体と、
上記窒化物半導体積層体上または上記窒化物半導体積層体内に少なくとも一部が形成されたTiAl系材料からなるオーミック電極と
を備え、
上記窒化物半導体積層体は、
上記基板上に形成された第1の窒化物半導体層と、
上記第1の窒化物半導体層上に形成されていると共に上記第1の窒化物半導体層とヘテロ界面を形成する第2の窒化物半導体層と
を有し、
上記TiAl系材料からなるオーミック電極から上記窒化物半導体積層体に亘る深さ方向の酸素濃度分布において、
上記オーミック電極と上記窒化物半導体積層体との界面よりも上記基板側の領域の上記界面近傍の位置に第1の酸素濃度ピークを有し、
上記第1の酸素濃度ピークよりも深い位置に第2の酸素濃度ピークを有し、
上記第2の酸素濃度ピークの酸素濃度は、
3×1017cm−3以上かつ1.2×1018cm−3以下であることを特徴としている。
この発明の窒化物半導体装置によれば、上記TiAl系材料からなるオーミック電極と上記窒化物半導体積層体との界面の上記基板側の領域において、上記界面近傍の上記第1の酸素濃度ピークの位置よりも深い位置に、酸素濃度が3×1017cm−3以上かつ1.2×1018cm−3以下の第2の酸素濃度ピークを有することによって、上記窒化物半導体積層体と上記オーミック電極とのコンタクト抵抗を低減できる。
また、一実施形態の窒化物半導体装置では、上記第2の酸素濃度ピークの位置が、上記界面から65nm以上かつ110nm以下の深さである。
この実施形態によれば、上記界面から65nm以上かつ110nm以下の深さに上記第2の酸素濃度ピークが位置することによって、上記窒化物半導体積層体と上記オーミック電極とのコンタクト抵抗を低減できる。
また、一実施形態の窒化物半導体装置では、上記窒化物半導体積層体は、
上記第2の窒化物半導体層を貫通して上記ヘテロ界面近傍の2次元電子ガス層に達する凹部を有し、
上記凹部に上記オーミック電極の少なくとも一部が埋め込まれている。
この実施形態によれば、リセス構造の窒化物半導体装置において、上記ヘテロ界面近傍の2次元電子ガス層とオーミック電極とのコンタクト抵抗を低減できる。
この発明の窒化物半導体装置によれば、TiAl系材料からなるオーミック電極と窒化物半導体積層体との界面の基板側の領域において、上記界面近傍の第1の酸素濃度ピークの位置よりも深い位置に、酸素濃度が3×1017cm−3以上かつ1.2×1018cm−3以下の第2の酸素濃度ピークを有するので、上記窒化物半導体積層体とオーミック電極とのコンタクト抵抗を低減できる。
この発明の実施形態の窒化物半導体装置の断面図である。 上記窒化物半導体装置の製造方法を説明するための工程断面図である。 図2に続く工程断面図である。 図3に続く工程断面図である。 図4に続く工程断面図である。 オーミック電極とGaN層との界面のオーミック電極側からGaN層側へ亘る深さ方向における酸素の濃度分布を示すグラフである。 オーミック電極とGaN層との界面のオーミック電極側からGaN層側へ亘る深さ方向における酸素,Al,Ti,Gaの濃度分布を示すグラフである。 上記実施形態の第2の酸素濃度ピークP2の酸素濃度(cm−3)とソース,ドレイン電極のコンタクト抵抗との関係を示すグラフである。 上記実施形態の製造工程のドライエッチングにおける自己バイアス電位Vdcとソース,ドレイン電極のコンタクト抵抗との関係を示すグラフである。 上記実施形態の第2の酸素濃度ピークP2の深さとソース,ドレイン電極のコンタクト抵抗との関係を示すグラフである。 比較例におけるオーミック電極とGaN層との界面のオーミック電極側からGaN層側へ亘る深さ方向における酸素の濃度分布を示すグラフである。
以下、この発明を図示の実施の形態により詳細に説明する。
図1は、この発明の実施形態の窒化物半導体装置の断面図を示しており、この窒化物半導体装置はGaN系HFET(Hetero-junction Field Effect Transistor;ヘテロ接合電界効果トランジスタ)である。
この半導体装置は、図1に示すように、Si基板10上に、アンドープAlGaNバッファ層15、第1の窒化物半導体層の一例としてのアンドープGaN層1と、第2の窒化物半導体層の一例としてのアンドープAlGaN層2からなる窒化物半導体積層体20を形成している。このアンドープGaN層1とアンドープAlGaN層2との界面近傍に2DEG層(2次元電子ガス層)3が発生する。
なお、上記GaN層1に替えて、上記AlGaN層2よりもバンドギャップの小さい組成を有するAlGaN層としてもよい。また、上記AlGaN層2上にキャップ層として例えばGaNからなる約1nmの厚さの層を設けてもよい。
また、ソース電極11とドレイン電極12とを、上記AlGaN層2と2DEG層3を貫通してGaN層1まで達する凹部106と凹部109に互いに間隔をあけて形成している。また、AlGaN層2上に、ソース電極11とドレイン電極12との間かつソース電極11側にゲート電極13を形成している。ソース電極11とドレイン電極12はオーミック電極であり、ゲート電極13はショットキー電極である。上記ソース電極11と、ドレイン電極12と、ゲート電極13と、そのソース電極11,ドレイン電極12,ゲート電極13が形成されたGaN層1,AlGaN層2の活性領域でHFETを構成している。
ここで、活性領域とは、AlGaN層2上のソース電極11とドレイン電極12との間に配置されたゲート電極13に印加される電圧によって、ソース電極11とドレイン電極12との間でキャリアが流れる窒化物半導体積層体20(GaN層1,AlGaN層2)の領域である。
そして、ソース電極11とドレイン電極12とゲート電極13が形成された領域を除くAlGaN層2上に、AlGaN層2を保護するため、SiOからなる絶縁膜30を形成している。また、ソース電極11とドレイン電極12とゲート電極13とが形成されたSi基板10上に、ポリイミドからなる層間絶縁膜40を形成している。また、図1において、41はコンタクト部としてのビア、42はドレイン電極パッドである。なお、絶縁膜は、SiOに限らず、SiNやAlなどを用いてもよい。特に、絶縁膜として、コラプス抑制のために半導体層表面にストイキオメトリックを崩したSiN膜と表面保護のためのSiOやSiNの多層膜構造とするのが好ましい。また、層間絶縁膜は、ポリイミドに限らず、p−CVD(プラズマCVD)で製造したSiO膜やSOG(Spin On Glass)やBPSG(ホウ素・リン・シリケート・ガラス)などの絶縁材料を用いてもよい。
上記構成の窒化物半導体装置において、GaN層1とAlGaN層2との界面近傍に発生した2次元電子ガス層(2DEG層)3でチャネルが形成され、このチャネルをゲート電極13に電圧を印加することにより制御して、ソース電極11とドレイン電極12とゲート電極13を有するHFETをオンオフさせる。このHFETは、ゲート電極13に負電圧が印加されているときにゲート電極13下のGaN層1に空乏層が形成されてオフ状態となる一方、ゲート電極13の電圧がゼロのときにゲート電極13下のGaN層1に空乏層がなくなってオン状態となるノーマリーオンタイプのトランジスタである。
次に、上記窒化物半導体装置の製造方法を図2〜図5に従って説明する。なお、図2〜図5では、図を見やすくするためにSi基板やアンドープAlGaNバッファ層を図示せず、また、ソース電極とドレイン電極の大きさや間隔を変えている。
まず、図2に示すように、Si基板(図示せず)上に、MOCVD(Metal Organic Chemical Vapor Deposition:有機金属気相成長)法を用いて、アンドープAlGaNバッファ層(図示せず)、アンドープGaN層101とアンドープAlGaN層102を順に形成する。アンドープGaN層101の厚さは例えば1μm、アンドープAlGaN層102の厚さは例えば30nmとする。このGaN層101とAlGaN層102が窒化物半導体積層体120を構成している。
次に、AlGaN層102上に絶縁膜130(例えばSiO)を例えばプラズマCVD(Chemical Vapor Deposition:化学的気相成長))法により200nmの厚さに成膜する。図2において、103は、GaN層101とAlGaN層102とのヘテロ界面近傍に形成される2次元電子ガス層(2DEG層)である。
次に、絶縁膜130上にフォトレジスト(図示せず)を塗布してパターニングした後、ドライエッチングにより、図3に示すように、オーミック電極を形成すべき部分を除去して、AlGaN層102を貫通してGaN層101の上側の一部に2DEG層103よりも深い凹部106,109を形成する。上記ドライエッチングでは、塩素系のガスを用いる。この凹部106,109の深さはAlGaN層102の表面から2DEG層103までの深さ以上であればよく、例えば50nmとする。
また、この実施形態では、上記ドライエッチングにおいて、RIE(reactive ion etching:リアクティブイオンエッチング)装置の自己バイアス電位Vdcを180V以上かつ240V以下に設定した。
次に、順次、Oプラズマ処理、HCl/Hによる洗浄、BHF(バッファードフッ酸)もしくは1%のHF(フッ酸)による洗浄を行なう。そして、上記ドライエッチングによるエッチングダメージを低減するためのアニールを行う(例えば500〜850℃)。
次に、図4に示すように、絶縁膜130上および凹部106,109にスパッタリングにより、Ti,Al,TiNを順に積層することで、Ti/Al/TiNを積層して、オーミック電極となる積層金属膜107を形成する。ここで、TiN層は、後工程からTi/Al層を保護するためのキャップ層である。
上記スパッタリングで上記積層金属膜107を形成する時に、Ti成膜中に少量(例えば5sccm)の酸素をチャンバー内に流す。ここで、上記酸素の流量は、Tiの酸化物が生成されない量とする。なお、上記Ti成膜中に少量の酸素をチャンバー内に流すことに替えて、上記Ti成膜前にチャンバー内に酸素を例えば50sccmで5分間流してもよい。
尚、上記スパッタリングにおいて、TiとAlの両方を同時にスパッタリングしてもよい。また、スパッタリングに替えて上記Ti,Alを蒸着してもよい。
次に、図5に示すように、通常のフォトリソグラフィおよびドライエッチングを用いて、オーミック電極111,112のパターンを形成する。
そして、オーミック電極111,112が形成された基板を例えば400℃以上かつ500℃以下で10分以上アニールすることによって、2次元電子ガス層(2DEG層)103とオーミック電極111,112との間にオーミックコンタクトが得られる。この場合、500℃を超える高温でアニールした場合に比べてコンタクト抵抗を大幅に低減できる。また、400℃以上かつ500℃以下の低温でアニールすることにより絶縁膜130への電極金属の拡散を抑制でき、の特性に悪影響を与えることがない。また、上記低温のアニールにより、GaN層101からの窒素抜けによる電流コラプスの悪化や特性変動を防ぐことができる。なお、「電流コラプス」とは、低電圧動作でのトランジスタのオン抵抗と比べて高電圧動作でのトランジスタのオン抵抗が高くなってしまう現象である。
このオーミック電極111,112がソース電極11とドレイン電極12となり、後の工程でオーミック電極111,112の間にTiNまたはWNなどからなるゲート電極が形成される。
上記実施形態の窒化物半導体装置の製造方法によれば、上記オーミック電極としてのソース電極11,ドレイン電極12から上記GaN層1に亘る深さ方向の酸素濃度分布において、上記ソース電極11,ドレイン電極12と上記GaN層1との界面S1,S2の上記アンドープGaN層1側の上記界面S1,S2近傍の位置に第1の酸素濃度ピークP1が形成される。また、上記第1の酸素濃度ピークP1よりも深い位置に第2の酸素濃度ピークP2が形成される。また、上記製造方法により、第2の酸素濃度ピークP2の酸素濃度を、3×1017cm−3以上かつ1.2×1018cm−3以下にできる。また、上記第1の酸素濃度ピークの酸素濃度は、上記第2の酸素濃度ピークの酸素濃度よりも高い。上記第1の酸素濃度ピークの酸素濃度は、例えば、1×1018(cm−3)以上かつ7×1018(cm−3)以下になる。
図6は、上記ソース電極11とアンドープGaN層1との界面S1のソース電極11側から上記GaN層1側へ亘る深さ方向における酸素の濃度分布の一例を示すグラフである。図6において、縦軸目盛の1.E+00、1.E+01、…、1.E+06は、それぞれ、1.0、1.0×10、…、1.0×10を表す。このグラフは、TEG(テスト・エレメント・グループ)を用い、SIMS(2次イオン質量分析法)により測定した結果を表し、横軸に深さ(nm)を取り、縦軸に相対2次イオン強度(counts)を取ったものである。図6では、一例として、上記界面S1から上記GaN層1側へ約8nmの深さに、第1の酸素濃度ピークP1が位置し、上記界面S1から上記GaN層1側へ約108nmの深さに、第2の酸素濃度ピークP2が位置している。図6の一例では、上記第2の酸素濃度ピークP2の酸素濃度は、約8×1017cm−3であり、オーミック電極(ソース電極11)とGaN層1とのコンタクト抵抗を1.4Ωmmにできた。
尚、上記界面S1は、カーボンCの相対2次イオン強度(counts)のピークの位置に対応している。また、上記ドレイン電極12とアンドープGaN層1との界面S2のドレイン電極12側から上記GaN層1側へ亘る深さ方向における酸素の濃度分布も、図6のグラフと同様であり、オーミック電極(ドレイン電極12)とGaN層1とのコンタクト抵抗を1.4Ωmmにできた。
図7は、上記ソース電極11とアンドープGaN層1との界面S1のソース電極側から上記GaN層1側へ亘る深さ方向における酸素の濃度分布、およびAl,Ti,Gaの濃度分布を示すグラフである。図7において、縦軸目盛の1.E+00、1.E+01、…、1.E+07は、それぞれ、1.0、1.0×10、…、1.0×10を表す。このグラフは、図6と同様、TEG(テスト・エレメント・グループ)を用い、SIMS(2次イオン質量分析法)により測定した結果を表し、横軸に深さ(nm)を取り、縦軸に相対2次イオン強度(counts)を取ったものである。上記界面S1は、カーボンCの相対2次イオン強度(counts)のピークの位置に対応している。図7のグラフでは、一例として、深さ約378nmから深さ約438nmの領域が界面近傍の領域R1であり、界面S1よりも浅い側へ約27nmと界面S1よりも深い側へ約33nmの範囲が界面近傍の領域R1である。
尚、上記ドレイン電極12とアンドープGaN層1との界面S2のドレイン電極12側から上記GaN層1側へ亘る深さ方向におけるAl,Ti,Gaの濃度分布も、図7のグラフと同様であった。
次に、図8に、上記窒化物半導体積層体20の2DEG層3と上記ソース電極11,ドレイン電極12とのコンタクト抵抗(Ωmm)と、上記第2の酸素濃度ピークP2の酸素濃度(cm−3)との関係を示す。図8において、横軸目盛のE+17、E+18、E+19は、それぞれ、×1017、×1018、×1019を表す。
図8から分かるように、上記第2の酸素濃度ピークP2の酸素濃度(cm−3)を、3×1017cm−3以上かつ1.2×1018cm−3以下にすることで、上記コンタクト抵抗を約2Ωmm以下に低減できる。
一方、上記第2の酸素濃度ピークP2の酸素濃度が、3×1017cm−3を下回ると、コンタクト抵抗が急増している。これは、上記第2の酸素濃度ピークP2の酸素濃度が低過ぎると、オーミックコンタクト形成に必要なGaN層側の反応である酸素の活性化が不足するからであると考えられる。また、上記第2の酸素濃度ピークP2の酸素濃度が、1.2×1018cm−3を上回ると、コンタクト抵抗が急増している。これは、上記第2の酸素濃度ピークP2の酸素濃度が高過ぎると、過剰な酸素がTiと反応し、オーミックコンタクト形成に必要なGaN層1側の反応であるTiによるGaNからのNの引き抜き反応が十分に行なわれないからであると考えられる。
すなわち、この実施形態によれば、第2の酸素濃度ピークP2の酸素濃度を、3×1017cm−3〜1.2×1018cm−3の範囲内に設定することで、オーミックコンタクト形成に必要なGaN層側の酸素の活性化,GaNからのNの引き抜き反応を促進できるので、約2Ωmm以下の低抵抗のオーミックコンタクトを形成できると考えられる。
図11は、上記実施形態の窒化物半導体装置(GaN系HFET)の比較例におけるオーミック電極(ソース電極,ドレイン電極)とアンドープGaN層との界面S0のオーミック電極側からGaN層側へ亘る深さ方向における酸素の濃度分布を示すグラフである。図11において、縦軸目盛の1.E+00、1.E+01、…、1.E+06は、それぞれ、1.0、1.0×10、…、1.0×10を表す。この比較例の断面構造は、図1に示す上記実施形態の断面構造と同様であるが、上記グラフに示す酸素濃度分布が上記実施形態と異なる。
図11のグラフは、TEG(テスト・エレメント・グループ)を用い、SIMS(2次イオン質量分析法)により測定した結果を表し、横軸に深さ(nm)を取り、縦軸に相対2次イオン強度(counts)を取ったものである。図11では、上記界面S0から上記GaN層側へ約15nmの深さに、第1の酸素濃度ピークP10が位置し、上記界面S0から上記GaN層側へ約115nmの深さに、第2の酸素濃度ピークP20が位置している。この比較例では、上記第2の酸素濃度ピークP20での酸素濃度は、2.0×1017cm−3であり、3×1017cm−3を下回っていて、第2の酸素濃度ピークP20が濃度ピークを形成しなくなりかけている。このため、この比較例では、上記オーミック電極のコンタクト抵抗が70Ωmmと高く、上記実施形態のオーミック電極のコンタクト抵抗(約2Ωmm以下)に比べて、大幅に増大していた。
次に、図9を参照して、上記凹部106,109を形成するためのドライエッチングにおいて、RIE装置の自己バイアス電位Vdcと、上記ソース電極11,ドレイン電極12のコンタクト抵抗(Ωmm)との関係を説明する。図9から分かるように、上記ドライエッチング時の自己バイアス電位Vdcを、180V以上かつ240V以下に設定することにより、上記窒化物半導体積層体20の2DEG層3と上記ソース電極11,ドレイン電極12とのコンタクト抵抗(Ωmm)を、2Ωmm以下にできる。
一方、上記自己バイアス電位Vdcが180Vを下回ると、上記コンタクト抵抗(Ωmm)が急増している。これは、上記自己バイアス電位Vdcが小さすぎると第2の酸素濃度ピークP2の酸素濃度が低くなり過ぎる(3×1017cm−3を下回る)、あるいは、第2の酸素濃度ピークP2が形成されなくなるからと考えられる。前述の如く、第2の酸素濃度ピークP2の酸素濃度が低いと、オーミックコンタクト形成に必要なGaN層側の反応である酸素の活性化が不足すると考えられる。
また、上記電位Vdcが240Vを上回ると、上記コンタクト抵抗(Ωmm)が急増している。これは、上記電位Vdcが大き過ぎるとGaN層1側にダメージが深く入り過ぎて酸素濃度が高くなり過ぎる(1.2×1018cm−3を上回る)からと考えられる。前述の如く、第2の酸素濃度ピークP2の酸素濃度が高いと、オーミックコンタクト形成に必要なGaN層1側の反応であるTiによるGaNからのNの引き抜き反応が十分に行なわれないと考えられる。
次に、図10に、上記界面S1からの第2の酸素濃度ピークP2の深さ(nm)と、上記ソース電極11,ドレイン電極12のコンタクト抵抗(Ωmm)との関係を説明する。図10から分かるように、上記第2の酸素濃度ピークP2の界面S1からの深さ(nm)が、65nm以上かつ110nm以下の深さであれば、上記コンタクト抵抗(Ωmm)を、2Ωmm以下にできる。上記第2の酸素濃度ピークP2の界面S1からの深さ(nm)が65nmを下回ると、第1の酸素濃度ピークP1と第2の酸素濃度ピークP2との区別が明確でなくなる。また、上記第2の酸素濃度ピークP2の界面S1からの深さ(nm)が110nmを上回ると、上記第2の酸素濃度ピークP2が殆ど形成されなくなる。
前述した上記実施形態の製造方法によれば、上記第2の酸素濃度ピークP2の酸素濃度を、3×1017cm−3〜1.2×1018cm−3の範囲内の値にできると共に、上記界面S1からの第2の酸素濃度ピークP2の深さ(nm)を、65nm以上かつ110nm以下の深さ(例えば108nm)にできて、上記コンタクト抵抗(Ωmm)を2Ωmm以下にできる。
界面S1からの第2の酸素濃度ピークP2の深さが、65nm〜110nmであることで、低温下(400℃〜500℃のアニール)における基板側のオーミック形成に必要な反応(酸素の活性化、TiによるNの引き抜き等)の起こる深さが最適化され、オーミック形成反応が促進されると考えられる。
なお、上記実施形態の窒化物半導体装置の製造方法によれば、絶縁膜130、AlGaN層102、GaN層101をドライエッチングにより除去し、凹部106,109を形成したが、絶縁膜130をウェットエッチングにより除去し、その後AlGaN層102、GaN層101をドライエッチングにより除去することにより、凹部106,109を形成してもよい。
また、上記実施形態の窒化物半導体装置の製造方法によれば、Ti/Al/TiNを積層してオーミック電極としたが、これに限らず、TiNはなくともよく、また、Ti/Alを積層した後、その上にAu,Ag,Ptなどを積層してもよい。
また、上記実施形態では、Si基板を用いた窒化物半導体装置について説明したが、Si基板に限らず、サファイヤ基板やSiC基板を用いてもよく、サファイヤ基板やSiC基板上に窒化物半導体層を成長させてもよいし、GaN基板にAlGaN層を成長させる等のように、窒化物半導体からなる基板上に窒化物半導体層を成長させてもよい。また、基板と窒化物半導体層との間にバッファ層を形成してもよいし、窒化物半導体積層体の第1の窒化物半導体層と第2の窒化物半導体層との間にヘテロ改善層を形成してもよい。
また、上記実施形態では、オーミック電極がGaN層に達するリセス構造のHFETについて説明したが、リセスを形成せずにアンドープAlGaN層上にソース電極およびドレイン電極となるオーミック電極を形成したHFETにこの発明を適用してもよい。また、この発明の窒化物半導体装置は、2DEGを利用するHFETに限らず、他の構成の電界効果トランジスタであっても同様の効果が得られる。
また、上記実施形態では、ノーマリーオンタイプのHFETについて説明したが、ノーマリーオフタイプの窒化物半導体装置にこの発明を適用してもよい。また、ショットキー電極に限らず、絶縁ゲート構造の電界効果トランジスタにこの発明を適用してもよい。
この発明の窒化物半導体装置の窒化物半導体は、AlxInyGa1−x−yN(x≦0、y≦0、0≦x+y≦1)で表されるものであればよい。
この発明の具体的な実施の形態について説明したが、この発明は上記実施形態に限定されるものではなく、この発明の範囲内で種々変更して実施することができる。
1,101 GaN層
2,102 AlGaN層
3,103 2DEG層
10 Si基板
11 ソース電極
12 ドレイン電極
13 ゲート電極
15 AlGaNバッファ層
20,120 窒化物半導体積層体
30,130 絶縁膜
40 層間絶縁膜
41 ビア
42 ドレイン電極パッド
106,109 凹部
111,112 オーミック電極
P1 第1の酸素濃度ピーク
P2 第2の酸素濃度ピーク
S1 界面

Claims (3)

  1. 基板と、
    上記基板上に形成されていると共にヘテロ界面を有する窒化物半導体積層体と、
    上記窒化物半導体積層体上または上記窒化物半導体積層体内に少なくとも一部が形成されたTiAl系材料からなるオーミック電極と
    を備え、
    上記窒化物半導体積層体は、
    上記基板上に形成された第1の窒化物半導体層と、
    上記第1の窒化物半導体層上に形成されていると共に上記第1の窒化物半導体層とヘテロ界面を形成する第2の窒化物半導体層と
    を有し、
    上記TiAl系材料からなるオーミック電極から上記窒化物半導体積層体に亘る深さ方向の酸素濃度分布において、
    上記オーミック電極と上記窒化物半導体積層体との界面よりも上記基板側の領域の上記界面近傍の位置に第1の酸素濃度ピークを有し、
    上記第1の酸素濃度ピークよりも深い位置に第2の酸素濃度ピークを有し、
    上記第2の酸素濃度ピークの酸素濃度は、
    3×1017cm−3以上かつ1.2×1018cm−3以下であることを特徴とする窒化物半導体装置。
  2. 請求項1に記載の窒化物半導体装置において、
    上記第2の酸素濃度ピークの位置が、上記界面から65nm以上かつ110nm以下の深さであることを特徴とする窒化物半導体装置。
  3. 請求項1または2に記載の窒化物半導体装置において、
    上記窒化物半導体積層体は、
    上記第2の窒化物半導体層を貫通して上記ヘテロ界面近傍の2次元電子ガス層に達する凹部を有し、
    上記凹部に上記オーミック電極の少なくとも一部が埋め込まれていることを特徴とする窒化物半導体装置。
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Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2016031953A (ja) 2014-07-25 2016-03-07 株式会社タムラ製作所 半導体素子及びその製造方法、半導体基板、並びに結晶積層構造体
US9577048B1 (en) * 2015-09-24 2017-02-21 Epistar Corporation Heterostructure field-effect transistor
US10822129B2 (en) * 2017-06-07 2020-11-03 Automated Packaging Systems, Llc Tear open bag
JP2020061442A (ja) * 2018-10-09 2020-04-16 パナソニック株式会社 太陽電池セル

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005260052A (ja) * 2004-03-12 2005-09-22 Mitsubishi Electric Corp 半導体装置およびその製造方法
JP2010232503A (ja) * 2009-03-27 2010-10-14 Furukawa Electric Co Ltd:The 半導体装置および半導体装置の製造方法

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5818078A (en) * 1994-08-29 1998-10-06 Fujitsu Limited Semiconductor device having a regrowth crystal region
JP2967743B2 (ja) 1997-01-14 1999-10-25 日本電気株式会社 n型窒化ガリウム系半導体のコンタクト電極及びその形成方法
US7419892B2 (en) * 2005-12-13 2008-09-02 Cree, Inc. Semiconductor devices including implanted regions and protective layers and methods of forming the same
FR2914500B1 (fr) * 2007-03-30 2009-11-20 Picogiga Internat Dispositif electronique a contact ohmique ameliore
US8309987B2 (en) * 2008-07-15 2012-11-13 Imec Enhancement mode semiconductor device
CN101685844A (zh) * 2008-09-27 2010-03-31 中国科学院物理研究所 GaN基单芯片白光发光二极管外延材料
JP5737948B2 (ja) * 2008-12-26 2015-06-17 ルネサスエレクトロニクス株式会社 ヘテロ接合電界効果トランジスタ、ヘテロ接合電界トランジスタの製造方法、および電子装置
JP5457046B2 (ja) * 2009-02-13 2014-04-02 パナソニック株式会社 半導体装置
JP5715588B2 (ja) * 2012-03-28 2015-05-07 株式会社東芝 半導体装置およびその製造方法
WO2013153927A1 (ja) * 2012-04-11 2013-10-17 シャープ株式会社 窒化物半導体装置

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005260052A (ja) * 2004-03-12 2005-09-22 Mitsubishi Electric Corp 半導体装置およびその製造方法
JP2010232503A (ja) * 2009-03-27 2010-10-14 Furukawa Electric Co Ltd:The 半導体装置および半導体装置の製造方法

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