JP2013070321A - 画像圧縮装置及び画像処理システム - Google Patents
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Abstract
【解決手段】本発明の実施形態の画像圧縮装置10は、圧縮画像データをメモリ20に書き込む。画像圧縮装置10は、圧縮部12と、書込アドレス決定部14と、メモリ制御部16と、を備える。圧縮部12は、複数の画素を含む元画像データを複数のブロックラインに分割し、各ブロックラインを複数のサブブロックラインに分割し、サブブロックライン毎に元画像データを圧縮し、複数の圧縮サブブロックラインを生成する。書込アドレス決定部14は、サブブロックラインの数と、元画像データの元画像データサイズと、画像圧縮率と、に基づいて、圧縮サブブロックライン毎にメモリ20の書込アドレスを決定する。メモリ制御部16は、複数の圧縮サブブロックラインを、各圧縮サブブロックラインに対応する書込アドレスに書き込む。
【選択図】図2
Description
図3及び図4は、第1実施形態の圧縮部12の動作の説明図である。圧縮部12は、元画像データIMGoを、N個のブロックラインBL(n)に分割する。例えば、N=8の場合、圧縮部12は、8×8個の画素PXから構成される元画像データIMGoを、X方向に8画素且つY方向に1画素の8個のブロックラインBL(1)〜BL(8)に分割する(図3(A))。
Sbl = (Simgo * P) *1/M …(式2)
ADDe = ADDh + M * Sbl …(式3)
ADDw(m) = ADDh + (m - 1) * Sbl …(式4)
第2実施形態について説明する。第2実施形態では、2つの前提条件(第1前提条件及び第2前提条件)が成立する場合に、2つの書込領域WA(1)及びWA(2)に、元画像データIMGoに対応する2個の圧縮サブブロックラインSBLc(1)及びSBLc(2)を書き込む例について説明する。なお、第1実施形態と同様の説明は省略する。
ADDw’ = ADDe - WU …(式5)
第3実施形態について説明する。第3実施形態の画像圧縮装置は、メモリ20の書込単位WU(例えば、1メモリライン)分のデータを記憶可能なレジスタREGを有する。第3実施形態では、第1前提条件及び第2前提条件が成立する場合に、2つの書込領域WA(1)及びWA(2)に、元画像データIMGoに対応する2個の圧縮サブブロックラインSBLc(1)及びSBLc(2)を書き込む例について説明する。なお、第1実施形態及び第2実施形態と同様の説明は省略する。
10 画像圧縮装置
12 圧縮部
14 書込アドレス決定部
16 メモリ制御部
20 メモリ
30 画像伸張装置
Claims (6)
- 圧縮画像データをメモリに書き込む画像圧縮装置であって、
複数の画素を含む元画像データを複数のブロックラインに分割し、各ブロックラインを複数のサブブロックラインに分割し、前記サブブロックライン毎に前記元画像データを圧縮し、複数の圧縮サブブロックラインを生成する、圧縮部と、
前記サブブロックラインの数と、前記元画像データの元画像データサイズと、画像圧縮率と、に基づいて、前記圧縮サブブロックライン毎に前記メモリの書込アドレスを決定する、書込アドレス決定部と、
前記複数の圧縮サブブロックラインを、各圧縮サブブロックラインに対応する前記書込アドレスに書き込む、メモリ制御部と、を備え、
前記複数の圧縮サブブロックラインは、少なくとも、前記ブロックラインの先頭画素を含む第1圧縮サブブロックラインと、前記第1圧縮サブブロックラインに続く第2圧縮サブブロックラインと、を含み、
前記メモリ制御部は、
前記メモリにおいて、前記第1圧縮サブブロックライン及び前記第2圧縮サブブロックラインを記憶可能な容量を有する、記憶領域を画定する先頭アドレス及び終端アドレスを決定し、
前記先頭アドレスを、第1書込アドレスとして決定し、前記先頭アドレスから、前記サブブロックラインのサブブロックラインサイズ分だけ隔てたアドレスを、第2書込アドレスとして決定し、
前記第1書込アドレスを始点とする第1書込領域に前記第1圧縮サブブロックラインを書き込み、
前記第2書込アドレスを始点とする第2書込領域に前記第2圧縮サブブロックラインを書き込む、ことを特徴とする画像圧縮装置。 - 圧縮画像データをメモリに書き込む画像圧縮装置であって、
複数の画素を含む元画像データを複数のブロックラインに分割し、各ブロックラインを複数のサブブロックラインに分割し、前記サブブロックライン毎に前記元画像データを圧縮し、複数の圧縮サブブロックラインを生成する、圧縮部と、
前記サブブロックラインの数と、前記元画像データの元画像データサイズと、画像圧縮率と、に基づいて、前記圧縮サブブロックライン毎に前記メモリの書込アドレスを決定する、書込アドレス決定部と、
前記複数の圧縮サブブロックラインを、各圧縮サブブロックラインに対応する前記書込アドレスに書き込む、メモリ制御部と、を備えることを特徴とする画像圧縮装置。 - 圧縮画像データをメモリに書き込む画像圧縮装置であって、
複数の画素を含む元画像データを複数のブロックラインに分割し、各ブロックラインを複数のサブブロックラインに分割し、前記サブブロックライン毎に前記元画像データを圧縮し、複数の圧縮サブブロックラインを生成する、圧縮部と、
前記サブブロックラインの数と、前記元画像データの元画像データサイズと、画像圧縮率と、に基づいて、前記圧縮サブブロックライン毎に前記メモリの書込アドレスを決定する、書込アドレス決定部と、
前記複数の圧縮サブブロックラインを、各圧縮サブブロックラインに対応する前記書込アドレスに書き込む、メモリ制御部と、を備え、
前記複数の圧縮サブブロックラインは、前記ブロックラインの先頭画素を含む第1圧縮サブブロックラインと、前記第1圧縮サブブロックラインに続く第2圧縮サブブロックラインと、を含み、
前記メモリ制御部は、
前記メモリにおいて、前記第1圧縮サブブロックライン及び前記第2圧縮サブブロックラインを記憶可能な容量を有する、記憶領域を画定する先頭アドレス及び終端アドレスを決定し、
前記先頭アドレスを第1書込アドレスとして決定し、
前記終端アドレスから、前記メモリの書込単位分だけ戻ったアドレスを、第2書込アドレスとして決定し、
前記第1書込アドレスを始点とする第1書込領域に前記第1圧縮サブブロックラインを書き込み、
前記第2書込アドレスを始点とする第2書込領域に前記第2圧縮サブブロックラインを書き込む、ことを特徴とする画像圧縮装置。 - 圧縮画像データをメモリに書き込む画像圧縮装置であって、
複数の画素を含む元画像データを複数のブロックラインに分割し、各ブロックラインを複数のサブブロックラインに分割し、前記サブブロックライン毎に前記元画像データを圧縮し、複数の圧縮サブブロックラインを生成する、圧縮部と、
前記サブブロックラインの数と、前記元画像データの元画像データサイズと、画像圧縮率と、に基づいて、前記圧縮サブブロックライン毎に前記メモリの書込アドレスを決定する、書込アドレス決定部と、
前記複数の圧縮サブブロックラインを、各圧縮サブブロックラインに対応する前記書込アドレスに書き込む、メモリ制御部と、を備え、
前記複数の圧縮サブブロックラインは、第1圧縮サブブロックラインと、前記第1圧縮サブブロックラインに続く第2圧縮サブブロックラインと、を含み、
前記メモリ制御部は、
前記メモリにおいて、前記第1圧縮サブブロックライン及び前記第2圧縮サブブロックラインを記憶可能な容量を有する、記憶領域を画定する先頭アドレス及び終端アドレスを決定し、
前記先頭アドレスを第1書込アドレスとして決定し、
前記先頭アドレスから、前記サブブロックラインのサブブロックラインサイズ分だけ隔てたアドレスを、第2書込アドレスとして決定し、
前記第1書込アドレスから前記第2書込アドレスまでの第1書込領域に、前記第1圧縮サブブロックラインの少なくとも一部を書き込み、
前記第2書込アドレスから前記終端アドレスまでの第2書込領域に、前記第2圧縮サブブロックラインの少なくとも一部を書き込み、
前記第1圧縮サブブロックラインのサイズが前記第1書込領域のサイズより大きい場合には、前記第1書込領域に記憶されていない前記第1圧縮サブブロックラインの残留部分を、前記第2書込領域に書き込み、
前記第2圧縮サブブロックラインのサイズが前記第2書込領域のサイズより大きい場合には、前記第2書込領域に記憶されていない前記第2圧縮サブブロックラインの残留部分を、前記第1書込領域に書き込む、ことを特徴とする画像圧縮装置。 - 圧縮画像データをメモリに書き込む画像圧縮装置であって、
複数の画素を含む元画像データを複数のブロックラインに分割し、各ブロックラインを複数のサブブロックラインに分割し、前記サブブロックライン毎に前記元画像データを圧縮し、複数の圧縮サブブロックラインを生成する、圧縮部と、
前記サブブロックラインの数と、前記元画像データの元画像データサイズと、画像圧縮率と、に基づいて、前記圧縮サブブロックライン毎に前記メモリの書込アドレスを決定する、書込アドレス決定部と、
前記複数の圧縮サブブロックラインを、各圧縮サブブロックラインに対応する前記書込アドレスに書き込む、メモリ制御部と、を備え、
前記複数の圧縮サブブロックラインは、第1圧縮サブブロックラインと、前記第1圧縮サブブロックラインに続く第2圧縮サブブロックラインと、を含み、
前記第1圧縮サブブロックラインは、第1部分と、前記第1部分に続く第2部分と、を含み、
前記第2圧縮サブブロックラインは、第1部分と、前記第1部分に続く第2部分と、を含み、
前記メモリ制御部は、
前記第1圧縮サブブロックラインの第2部分と、前記第2圧縮サブブロックラインの第2部分と、を含むラインデータを記憶可能なレジスタを備え、
前記メモリにおいて、前記第1圧縮サブブロックライン及び前記第2圧縮サブブロックラインを記憶可能な容量を有する、記憶領域を画定する先頭アドレス及び終端アドレスを決定し、
前記先頭アドレスを第1書込アドレスとして決定し、
前記終端アドレスを第2書込アドレスとして決定し、
前記第1書込アドレスを始点とする領域に、前記第1圧縮サブブロックラインの第1部分を書き込み、
前記第1圧縮サブブロックラインの第2部分を、前記レジスタに書き込み、
前記第2書込アドレスを始点とする領域に、前記第2圧縮サブブロックラインの第1部分を書き込み、
前記第2圧縮サブブロックラインの第2部分を、前記レジスタに書き込み、
前記レジスタに記憶された前記第1圧縮サブブロックラインの第2部分と、前記第2圧縮サブブロックラインの第2部分と、を含む前記ラインデータを、前記第1圧縮サブブロックラインの第1部分が記憶された領域に続く重複メモリラインに書き込む、ことを特徴とする画像圧縮装置。 - データを記憶可能なメモリと、
複数の画素を含む元画像データを複数のブロックラインに分割し、各ブロックラインを複数のサブブロックラインに分割し、前記サブブロックライン毎に前記元画像データを圧縮し、複数の圧縮サブブロックラインを生成する、圧縮部と、
前記サブブロックラインの数と、前記元画像データの元画像データサイズと、画像圧縮率と、に基づいて、前記圧縮サブブロックライン毎に前記メモリの書込アドレスを決定する、書込アドレス決定部と、
前記複数の圧縮サブブロックラインを、各圧縮サブブロックラインに対応する前記書込アドレスに書き込む、メモリ制御部と、
前記メモリに記憶された複数の圧縮サブブロックラインを、前記書込アドレスに基づいて個別に読み出す画像伸張装置と、を備えることを特徴とする画像処理システム。
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