JP2012198287A - 集積回路装置、電気光学装置及び電子機器 - Google Patents
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Abstract
【解決手段】 集積回路装置100は、電気光学パネルの画像を更新駆動する駆動電圧出力部150と、第1の表示データCIを記憶する第1記憶部111と第2の表示データNIを記憶する第2記憶部112とを含む表示データ記憶部110と、駆動波形情報を記憶する波形情報記憶部120と、波形情報記憶部から選択される駆動波形情報を駆動電圧出力部に出力する駆動波形情報出力部130,140と、駆動電圧出力部に駆動電圧を供給する駆動電源回路180と、内部クロックを発生する内部クロック発生回路190と、を有する。駆動電源回路をパワーオフし内部クロック発生回路をパワーオンするスタンバイモードにて、ホスト装置から送信される第2の表示データが表示データ記憶部の第2記憶部に記憶される。
【選択図】 図5
Description
電気光学パネル上または前記電気光学パネルに接続されるフレキシブル基板上に実装されて、前記電気光学パネルを駆動する集積回路装置であって、
前記電気光学パネルの複数の画素電極に供給される駆動電圧を出力して画像を更新する駆動電圧出力部と、
第1の表示データを記憶する第1記憶部と、第2の表示データを記憶する第2記憶部とを含み、前記第2の表示データがホスト装置から送信されて記憶される表示データ記憶部と、
画素での表示状態を前記第1の表示データに対応する第1の表示状態から前記第2の表示データに対応する第2の表示状態に変化させる駆動波形情報を記憶する波形情報記憶部と、
前記第1の表示データ及び前記第2の表示データに基づいて前記波形情報記憶部から選択される前記駆動波形情報を、前記駆動電圧出力部に出力する駆動波形情報出力部と、
前記駆動電圧出力部に前記駆動電圧を供給する駆動電源回路と、
内部クロックを発生する内部クロック発生回路と、
を有し、
前記集積回路装置は、前記駆動電源回路及び前記内部クロック発生回路をパワーオンするランモードと、前記駆動電源回路及び前記内部クロック発生回路をパワーオフするスリープモードと、前記駆動電源回路をパワーオフし前記内部クロック発生回路をパワーオンするスタンバイモードを有し、
前記スタンバイモードでは、前記ホスト装置から送信される前記第2の表示データが前記表示データ記憶部の前記第2記憶部に記憶される集積回路装置に関する。
図1に電気光学装置であるEPDを示す。図1に示すEPDパネル(電気光学パネル)10は、複数の走査線14と複数のデータ線16と複数の画素20が形成されたアクティブマトリクス基板(第1基板)12を有する。画素20には、図2に示すように、画素選択トランジスター22と、保持容量24と画素電極26が設けられている。画素選択トランジスター22は、走査線14がゲートに接続され、データ線16がソースに接続され、ドレインが保持容量24及び画素電極26に接続されている。
図1に示すアクティブマトリクス基板(ガラス基板)12には、走査線14を駆動する走査線駆動部40と、データ線16を駆動するデータ線駆動部100と、データ線駆動部100に接続された温度センサー200とが設けられている。両駆動部40,100は集積回路装置(IC)にて形成され、アクティブマトリクス基板12上にCOG実装することができる。あるいは、アクティブマトリクス基板12にフレキシブルフィルム基板が接続される場合、そのフィルム基板上にデータ線駆動部100をCOF実装しても良い。走査線駆動部40は、アクティブマトリクス基板(ガラス基板)12上に形成されるTFT(薄膜トランジスタ)により構成しても良いし、データ線駆動部100内に収容されても良い。データ線駆動部100は、スレーブである走査線駆動部40を制御するマスターとして機能することができる。
データ線駆動部100は、コントローラー機能を有するドライバーICである。図5に示すように、データ線駆動部100は、ホスト装置50と接続されるホストインターフェース101と、ホストインターフェース101に接続されたレジスター102及びメモリーインターフェース103を有する。レジスター102には、ホスト装置50から送出される制御データ等の各種情報が記憶される。メモリーインターフェース103には、ディスプレイメモリー(表示データ記憶部)110と、波形デコーダー(復号部)121及び波形メモリー(波形情報記憶部)120が接続されている。
図1に示すホスト波形メモリー53に採用される波形フォーマットを図6〜図9に示す。波形フォーマットは、図6に示すように、情報ヘッダー53Aに加えて、大区分情報記憶部53B、中区分情報記憶部53C及び小区分情報記憶部53Dを含む。図6に示す情報ヘッダー53Aは、図7に示す16×3=48バイトの情報である。この中で、温度LUT(ルック・アップ・テーブル)の数Nと、波形モードの数Mと、波形深さが、下位の記憶部53B〜53Dに記憶された波形を確定する情報に関係する。波形深さとは、図4に一例を示す駆動波形の単位パルスが取り得る波高値の数であり、本実施形態は+Vs,0,−Vsの3値であり、本実施形態では2ビット(1,0)で示される。
データ線駆動部100の波形RAM120には、ホスト波形メモリー53の一部の情報が記憶される。一部の情報とは、中区分情報記憶部53C及び小区分情報記憶部53D内の各N個の大区分LD1〜LDNに属する記憶情報(全温度領域)のうち、温度検出部170で取得された温度(温度帯域)と対応する各一つの大区分LDn(nは1≦n≦Nを満たす一つの整数)内に記憶された情報である。
図15は、図5に示すデータ線駆動部100中のディスプレイエンジン130の具体例を示している。図15において、ディスプレイエンジン130は、パイプライン制御部131と、画像データリード制御部132と、波形データリード制御部133と、波形データバッファー134と、とを含むことができる。
パイプライン制御部131中に設けられるパイプラインが1つであっても複数であっても、現在更新制御中のパイプラインは使用することができない。また、ディスプレイメモリー110のCIバッファー111及びNIバッファー112は全てのパイプラインに共用される。その際、ホスト装置50から更新要求のあった画像領域が、現在更新制御中のパイプラインでの画像更新領域とオーバーラップしている事態も想定される。この場合には、たとえ他のパイプラインが空いていたとしても、ホスト装置50からの更新要求を受け付けることはできない。なぜなら、一のパイプラインで更新制御しているNIバッファー112の画素が、他のパイプラインでも重複して更新制御されることになり、更新動作が競合するからである。ホスト装置50からの更新要求を受け付けるには、CIバッファー111及びNIバッファー112に追加して、ホスト装置50からの更新画像の書き込みバッファーを増設し、トリプルバッファー構成としなければならない。しかし、トリプルバッファーを内蔵するドライバーICは、EPDパネル10側にて実装されるのに必要な小型化の要求に反する。
次に、図17も参照して実施形態に係る装置のパワーオンから画像表示に至る動作について説明する。図17は、ホスト装置50のCPU51の動作と、データ線駆動部(ドライバーIC)100の動作とを示している。
図18は、ドライバーIC100のランモード、スタンバイモード及びスリープモードを示している。ドライバーIC100は、駆動電源回路180及び内部クロック発生回路190をパワーオンするランモードと、駆動電源回路180及び内部クロック発生回路190をパワーオフするスリープモードと、駆動電源回路180をパワーオフし内部クロック発生回路190をパワーオンするスタンバイモードとを有する。
図22に本実施形態の電気光学装置を含む電子機器300の構成例を示す。この電子機器300は、電気光学パネル10、ホスト装置50、集積回路装置100、操作部310、記憶部320、通信部330を含む。なおこれらの一部の構成要素を省略し、他の構成要素を追加するなどの種々の変形実施が可能である。
Claims (8)
- 電気光学パネル上または前記電気光学パネルに接続されるフレキシブル基板上に実装されて、前記電気光学パネルを駆動する集積回路装置であって、
前記電気光学パネルの複数の画素電極に供給される駆動電圧を出力して画像を更新する駆動電圧出力部と、
第1の表示データを記憶する第1記憶部と、第2の表示データを記憶する第2記憶部とを含み、前記第2の表示データがホスト装置から送信されて記憶される表示データ記憶部と、
画素での表示状態を前記第1の表示データに対応する第1の表示状態から前記第2の表示データに対応する第2の表示状態に変化させる駆動波形情報を記憶する波形情報記憶部と、
前記第1の表示データ及び前記第2の表示データに基づいて前記波形情報記憶部から選択される前記駆動波形情報を、前記駆動電圧出力部に出力する駆動波形情報出力部と、
前記駆動電圧出力部に前記駆動電圧を供給する駆動電源回路と、
内部クロックを発生する内部クロック発生回路と、
を有し、
前記集積回路装置は、前記駆動電源回路及び前記内部クロック発生回路をパワーオンするランモードと、前記駆動電源回路及び前記内部クロック発生回路をパワーオフするスリープモードと、前記駆動電源回路をパワーオフし前記内部クロック発生回路をパワーオンするスタンバイモードを有し、
前記スタンバイモードでは、前記ホスト装置から送信される前記第2の表示データが前記表示データ記憶部の前記第2記憶部に記憶されることを特徴とする集積回路装置。 - 請求項1において、
前記表示データ記憶部はSRAMにて形成されていることを特徴とする集積回路装置。 - 請求項2において、
前記スタンバイモードにて前記第2記憶部への書き込みが終了した後であって、前記ホスト装置から画像更新コマンドが受信された後に前記スタンバイモードから前記ランモードに設定されることを特徴とする集積回路装置。 - 請求項3において、
前記ランモードにて前記駆動電圧出力部により前記電気光学パネルが前記第2の表示状態に駆動された後に、前記第2記憶部の前記第2の表示データを、前記第1の記憶部に転送して前記第1の表示データとして前記第1の記憶部に書き込む転送制御部をさらに有し、
前記第1の記憶部への書き込みが終了した後に、前記ホスト装置からのコマンドに基づいて前記スタンバイモードまたは前記スリープモードに設定されることを特徴とする集積回路装置。 - 請求項1乃至4のいずれかにおいて、
環境情報を取得する取得部をさらに有し、
前記スタンバイモードでは、前記取得部にて前記環境情報が取得され、前記ホスト装置から送信される複数の環境情報にそれぞれ対応する前記駆動波形情報のうち、前記取得部にて取得された環境情報に対応する前記駆動波形情報が前記波形情報記憶部に記憶されることを特徴とする集積回路装置。 - 請求項5において、
前記ホスト装置から符号化されて送出された前記複数の駆動波形情報のうち、前記取得部にて取得された環境情報に対応する前記駆動波形情報を復号する復号部をさらに有することを特徴とする集積回路装置。 - 請求項1乃至6のいずれかに記載の集積回路装置と、
前記集積回路装置により駆動される前記電気光学パネルと、
前記集積回路装置に接続された前記ホスト装置と、
を有することを特徴とする電気光学装置。 - 請求項7に記載の電気光学装置を有することを特徴とする電子機器。
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