JP5640451B2 - 表示装置の制御方法、表示装置、及び表示装置の制御装置 - Google Patents
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Description
これにより、書き込み動作が進行中か否かを容易に判断することができる。
これにより、新規の書き込みが必要か否かを容易に判断することができる。また、表示画像データと予定画像データが一致している限り、新規の書き込みが必要な画素として検出されることがないので、不要な書き込み動作を排除することができる。
これにより、書き込み動作が進行中か否かを容易に判断することができる。
これにより、簡易な処理で書き込み情報を得ることができる。
これにより、書き込み動作が進行中か否かを容易に判断することができる。
これにより、新規の書き込みが必要か否かを容易に判断することができる。また、表示画像データと予定画像データが一致している限り、新規の書き込みが必要な画素として検出されることがないので、不要な書き込み動作を排除することができる。
これにより、書き込み動作が進行中か否かを容易に判断することができる。
これにより、簡易な処理で書き込み情報を得ることができる。
これにより、書き込み動作が進行中か否かを容易に判断することができる。
図1は、本実施形態による電気泳動表示装置(表示装置)100の構成を示すブロック図である。
図1に示すように、電気泳動表示装置100は、表示部1、コントローラ(制御装置)2、CPU(表示画像データ更新部)3、VRAM(第2の記憶領域)4、RAM(第1の記憶領域、第3の記憶領域)5を備えている。
図2は、表示部1の断面を示す図である。図に示されるように、表示部1は、大別して第1基板10、電気泳動層20、第2基板30、によって構成される。
なお、可撓性基板11に代えて、可撓性をもたないガラス基板等を用いてもよい。この場合は、基板上に接着層を介さず直接半導体回路層12が形成される。
コントローラ2は、画像表示領域55に表示させる画像を示す画像信号、画像書き換え時のリセットを行うためのリセットデータ、その他各種信号(クロック信号等)を生成し、走査線駆動回路53又はデータ線駆動回路54へ出力する。
データ線駆動回路54は、表示領域55の各データ線と接続されており、走査線駆動回路53によって選択された各画素駆動回路に対してデータ信号X1、X2、…、Xnを供給する。選択状態となっている走査線に接続された画素には、データ線からトランジスタ61を介してデータ信号が供給される。画素に含まれる保持容量63には、画素に供給されたデータ信号に応じて電荷が蓄積され、画素電極13aの電位は、当該電荷に応じた電位となる。この画素電極13aの電位と、透明電極層32の電位との電位差(電圧)に応じて電気泳動粒子が両電極間を移動し、表示が行われる。
走査線駆動回路53が、各走査線を1回ずつ選択する期間を「フレーム期間」と呼ぶ(又は単に「フレーム」とも呼ぶ)。したがって、各走査線は、1フレームに1回ずつ選択され、各画素には1フレームに1回ずつデータ信号が供給される。
CPU3は、表示部1に表示させる表示画像データをVRAM4に保存する(ステップS1)。
ここでは、書き込み情報記憶領域6には各画素の表示状態を黒(第1の表示状態)から白(第2の表示状態)へ変化させるための書き込み動作が進行中か否かを示す第1の書き込み情報と、各画素の表示状態を白から黒へ変化させるための書き込み動作が進行中か否かを示す第2の書き込み情報を含んでいる。
また、各画素の表示状態を白から黒、又は黒から白へ変化させるための書き込み動作は、複数のフレームを含んでいるものとする。よって、例えば表示状態を白から黒へ変化させるための書き込み動作は、画素に対し、黒を表示するためのデータ信号を複数回供給する動作(すなわち複数のフレームの各々においてデータ信号を供給する動作)を含む。図7は、このうち1つのフレームにおける動作を示している。
図8〜15において、Aは、表示部1に現時点で実際に表示されている画像の状態を示している。Pij(iは行番号、jは列番号を表す。)は一画素を示している。各画素Pijには0(黒)から7(白)の8段階で表される階調が表示されている。
また、上記では表示装置として電気泳動方式による表示部1を備えた電気泳動表示装置100を例に説明したが、表示部1の表示方式は電気泳動方式に限られない。表示部1の表示方式は、比較的低速な表示方式であって、表示完了までに複数フレームで電圧を印加する方法により制御されるものであればよく、例えば、コレステリック液晶、エレクトロクロミック、電子粉流体等を用いることもできる。
書き込み情報記憶領域6の電圧印加回数が全て0となり、VRAM4の内容と予定画像データ記憶領域7の内容とが一致したとき、即ち当分電圧印加の必要がなくなったとき、外部からの新たな画像データが送られてくるまで、例えば省電力状態のような、別の状態に移行しても良い。
新規書き込みが行われるごとに(例えばCPU3によりVRAM4の画像データが変更されるごとに)、フラグがONとなった画素が含まれる矩形領域の座標を記憶しておき、記憶した矩形領域に対応する書き込みが終了したときに、その後の新規書き込みによって新たに設定された矩形領域と重複しない部分だけフラグをOFFにリセットするようにしてもよい。ここで、矩形領域は、円形領域や楕円領域等、他の形状であってもよい。
1フレームの書き込みが終了するごとにデクリメントを行わず、1回のデクリメントにつき規定回数分(規定フレーム分)同じ駆動を繰り返しても良い。これによれば、メモリ通信帯域を節約することができる。
片極駆動において、1フレームの書き込みが終了するごとにデクリメントを行わず、1回のデクリメントにつき規定回数分(規定フレーム分)同じ駆動を繰り返してもよい。白書き込み用の電圧を規定回数印加した後に黒書き込み用の電圧を規定回数印加しても良いし、白黒の電圧を交互に規定回数だけ印加しても良い。また、白書き込み用の電圧の印加回数と黒書き込み用の電圧の印加回数の比率を変えても良い。
外部からの新たな画像データが送られてきたとき(例えばCPU3によりVRAM4の画像データが変更されたときに)、フレームごとに書き込み回数や予定画像の計算を行わず、規定回数のフレームごとに計算を行っても良い。
上記実施形態では、書き込み情報記憶領域6、予定画像データ記憶領域7を独立した異なる面として構成しているが(プレーナ方式)、書き込み情報記憶領域6、予定画像データ記憶領域7は、それぞれ別の面として扱わず、全てをひとまとめにした状態で1面を構成しても良い(パックトピクセル方式)。
図16(A)は、電子ブックを示す斜視図である。この電子ブック1000は、ブック形状のフレーム1001と、このフレーム1001に対して回動自在に設けられた(開閉可能な)カバー1002と、操作部1003と、本発明の表示装置によって構成された表示部1004と、を備えている。
Claims (14)
- 複数の走査線と、複数のデータ線と、複数の画素とを含む表示部を備え、前記複数の画素のうちの一の画素の表示状態を第1の表示状態から第2の表示状態へ変化させるための書き込みが、各画素に表示される表示状態を示す表示画像データの更新タイミングと非同期に行われる動作であって駆動電圧をnフレームにn回印加する動作(ただし、n≧2)によって行われる表示装置の制御方法であって、
前記一の画素に対して新規の書き込みが必要か否かを判断する書き換え判断工程と、
前記新規の書き込みが必要と判断された場合に、前記一の画素に対して前回の書き込み動作が進行中か否かを判断する書き込み状態判断工程と、
前記書き込み状態判断工程において、前記一の画素に対する書き込み動作が進行中ではないと判断された場合には、前記一の画素に対して前記新規の書き込みを開始し、
前記書き込み状態判断工程において、前記一の画素に対して書き込み動作が進行中であると判断された場合には、進行中の書き込み動作を継続し、前記前回の書き込み動作が終了した後、前記一の画素に対して前記新規の書き込みを開始する書き込み制御工程と、を備えた表示装置の制御方法。 - 前記一の画素に対して書き込み動作が進行中か否かを示す書き込み情報を第1の記憶領域に保存する書き込み情報更新工程をさらに備え、
前記書き込み状態判断工程では、前記第1の記憶領域に保存されている前記書き込み情報に基づいて、前記一の画素に対して書き込み動作が進行中か否かが判断される、請求項1に記載の表示装置の制御方法。 - 入力された表示画像データに基づいて、前記表示部に表示させる前記表示画像データを第2の記憶領域に保存する表示画像データ更新工程と、
進行中の書き込み動作によって前記表示部に表示される予定画像のデータを第3の記憶領域に保存する予定画像データ更新工程と、をさらに備え、
前記予定画像データ更新工程では、前記一の画素に対して前記新規の書き込みが開始されるタイミングで、前記一の画素の画素データを前記表示画像データの対応する画素データに置換し、
前記書き換え判断工程では、前記第2の記憶領域に保存されている前記表示画像の画素データと前記第3の記憶領域に保存されている前記予定画像の画素データが異なる場合には、前記一の画素に対して前記新規の書き込みが必要と判断する、請求項1または2に記載の表示装置の制御方法。 - 前記第1の記憶領域に保存されている前記書き込み情報は、
前記一の画素に対して書き込み動作が進行中であることを示す第1のデータ、または前記一の画素に対して書き込み動作が進行中ではないことを示す第2のデータのいずれかである、請求項2または3に記載の表示装置の制御方法。 - 前記第1の記憶領域に保存されている前記書き込み情報は、
前記一の画素の表示状態を前記第1の表示状態から前記第2の表示状態へ変化させるための書き込み動作が進行中か否かを示す第1の書き込み情報と、
前記一の画素の表示状態を前記第2の表示状態から前記第1の表示状態へ変化させるための書き込み動作が進行中か否かを示す第2の書き込み情報と、を含み、
前記書き込み情報は、書き込み動作が進行中の場合、その書き込み動作において既に前記駆動電圧が印加された回数に伴って変動する値であり、その書き込みにおける最後の前記駆動電圧印加後には、前記書き込み情報が、前記一の画素に対して書き込み動作が進行中ではないことを示す値になっている、請求項2または3に記載の表示装置の制御方法。 - 複数の走査線と、複数のデータ線と、複数の画素とを含む表示部を備え、前記複数の画素のうちの一の画素の表示状態を第1の表示状態から第2の表示状態へ変化させるための書き込みが、各画素に表示される表示状態を示す表示画像データの更新タイミングと非同期に行われる動作であって駆動電圧をnフレームにn回印加する動作(ただし、n≧2)によって行われる表示装置であって、
前記一の画素に対して新規の書き込みが必要か否かを判断する書き換え判断部と、
前記新規の書き込みが必要と判断された場合に、前記一の画素に対して前回の書き込み動作が進行中か否かを判断する書き込み状態判断部と、
前記書き込み状態判断部において、前記一の画素に対する書き込み動作が進行中ではないと判断された場合には、前記一の画素に対して前記新規の書き込みを開始し、
前記書き込み状態判断部において、前記一の画素に対して書き込み動作が進行中であると判断された場合には、進行中の書き込み動作を継続し、前記前回の書き込み動作が終了した後、前記一の画素に対して前記新規の書き込みを開始する書き込み制御部と、を備えた表示装置。 - 前記一の画素に対して書き込み動作が進行中か否かを示す書き込み情報を第1の記憶領域に保存する書き込み情報更新部をさらに備え、
前記書き込み状態判断部は、前記第1の記憶領域に保存されている前記書き込み情報に基づいて、前記一の画素に対して書き込み動作が進行中か否かが判断される、請求項6に記載の表示装置。 - 前記表示部に表示させる表示画像データを第2の記憶領域に保存する表示画像データ更新部と、
進行中の書き込み動作によって前記表示部に表示される予定画像のデータを第3の記憶領域に保存する予定画像データ更新部と、をさらに備え、
前記予定画像データ更新部は、前記一の画素に対して前記新規の書き込みが開始されるタイミングで、前記一の画素の画素データを前記表示画像データの対応する画素データに置換し、
前記書き換え判断部は、前記第2の記憶領域に保存されている前記表示画像の画素データと前記第3の記憶領域に保存されている前記予定画像の画素データが異なる場合には、前記一の画素に対して前記新規の書き込みが必要と判断する、請求項6または7に記載の表示装置。 - 前記第1の記憶領域に保存されている前記書き込み情報は、
前記一の画素に対して書き込み動作が進行中であることを示す第1のデータ、または前記一の画素に対して書き込み動作が進行中ではないことを示す第2のデータのいずれかである、請求項7または8に記載の表示装置。 - 前記第1の記憶領域に保存されている前記書き込み情報は、
前記一の画素の表示状態を前記第1の表示状態から前記第2の表示状態へ変化させるための書き込み動作が進行中か否かを示す第1の書き込み情報と、
前記一の画素の表示状態を前記第2の表示状態から前記第1の表示状態へ変化させるための書き込み動作が進行中か否かを示す第2の書き込み情報と、を含み、
前記書き込み情報は、書き込み動作が進行中の場合、その書き込み動作において既に前記駆動電圧が印加された回数に伴って変動する値であり、その書き込みにおける最後の前記駆動電圧印加後には、前記書き込み情報が、前記一の画素に対して書き込み動作が進行中ではないことを示す値になっている、請求項7または8に記載の表示装置。 - 前記表示部は、メモリ性を有する表示素子を備えることを特徴とする請求項6ないし10のいずれか一項に記載の表示装置。
- 前記表示素子は電気泳動素子であることを特徴とする請求項11に記載の表示装置。
- 複数の走査線と、複数のデータ線と、複数の画素とを含む表示部を備え、前記複数の画素のうちの一の画素の表示状態を第1の表示状態から第2の表示状態へ変化させるための書き込みが、各画素に表示される表示状態を示す表示画像データの更新タイミングと非同期に行われる動作であって駆動電圧をnフレームにn回印加する動作(ただし、n≧2)によって行われる表示装置の制御装置であって、
前記一の画素に対して新規の書き込みが必要な場合に、前記一の画素に対して前回の書き込み動作が進行中か否かを判断する書き込み状態判断部と、
前記書き込み状態判断部において、前記一の画素に対する書き込み動作が進行中ではないと判断された場合には、前記一の画素に対して前記新規の書き込みを開始し、
前記書き込み状態判断部において、前記一の画素に対して書き込み動作が進行中であると判断された場合には、進行中の書き込み動作を継続し、前記前回の書き込み動作が終了した後、前記一の画素に対して前記新規の書き込みを開始する書き込み制御部と、を備えた制御装置。 - 前記一の画素に対して書き込み動作が進行中か否かを示す書き込み情報を第1の記憶領域に保存する書き込み情報更新部をさらに備え、
前記書き込み状態判断部は、前記第1の記憶領域に保存されている前記書き込み情報に基づいて、前記一の画素に対して書き込み動作が進行中か否かが判断される、請求項13に記載の制御装置。
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