JP2011071966A - パイプライン型アナログデジタル変換装置 - Google Patents
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Abstract
【解決手段】本発明は、各パイプラインステージそれぞれの入力端子に接続されて、前段のパイプラインステージの出力端子に接続されるか、あるいは外部信号入力に接続するかを選択するスイッチと、外部からの制御信号により、スイッチを制御する信号及び動作させるべきパイプラインステージを再構成する信号を生成する再構成制御論理部と、各パイプラインステージからのサブデジタル出力を所定の規則で足し合わせて、出力デジタル信号を出力するデータ処理論理部とから構成される。
【選択図】 図1
Description
Claims (13)
- 複数のパイプラインステージを結合して構成され、各パイプラインステージは、入力端子に入力されるアナログ信号をAD変換してこの変換結果をサブデジタル出力として出力すると共に、最終段に配置されるパイプラインステージを除いて、次段のパイプラインステージに、前記アナログ信号と前記変換結果との差の信号を出力端子に出力するパイプライン型アナログデジタル変換装置において、
各パイプラインステージそれぞれの入力端子に接続されて、外部信号入力に接続するか、或いは第1段のパイプラインステージを除いて前段のパイプラインステージの出力端子に接続するかを選択するスイッチと、
外部からの制御信号により、前記スイッチを制御する信号及び動作させるべきパイプラインステージを再構成する信号を生成する再構成制御論理部と、
各パイプラインステージからの前記サブデジタル出力を所定の規則で足し合わせて、出力デジタル信号を出力するデータ処理論理部とから成る再構成可能なパイプライン型アナログデジタル変換装置。 - アナログ入力信号の変化率を検出する手段を備え、検出された変化率に応じて、前記複数のパイプラインステージの一部の動作をオフさせるか、或いは、間欠動作により消費電力を低減させた請求項1に記載のパイプライン型アナログデジタル変換装置。
- 前記複数のパイプラインステージをスケーリングして、消費電力を低減させた請求項1に記載のパイプライン型アナログデジタル変換装置。
- 前記外部信号入力は選択可能の複数であり、かつ、各段ステージを分割動作させて、それぞれデジタルデータが出力される複数個の独立したアナログデジタル変換器として動作させる請求項1に記載のパイプライン型アナログデジタル変換装置。
- 前記再構成制御論理部は、外部からの制御信号により決定される動作モードに応じて前記データ処理論理部を制御して、前記出力デジタル信号のAD変換の分解能或いは変換速度を変更する請求項1に記載のパイプライン型アナログデジタル変換装置。
- 前記再構成制御論理部は、外部からの制御信号により決定される動作モードに応じて前記パイプラインステージにクロック信号を加える請求項5に記載のパイプライン型アナログデジタル変換装置。
- 前記データ処理論理部は、データアライメント用の記憶手段及びデータ演算部を有し、かつ、該データ演算部は、複数の加算器を結合した加算器組を複数組有する請求項1に記載のパイプライン型アナログデジタル変換装置。
- 前記記憶手段は、遅延素子列或いはRAM、若しくはRAMと遅延素子列の混載によって構成される請求項7に記載のパイプライン型アナログデジタル変換装置。
- 前記外部信号入力を途中のパイプラインステージに入力する割り込み動作を行う際に、パイプライン上を流れているデータの処理か、或いは途中のステージに入力する前記外部信号入力の処理のいずれかを優先するために、優先しない方の信号を保持するためのサンプルホールド回路を設けた請求項1に記載のパイプライン型アナログデジタル変換装置。
- アナログ入力信号の変化率を検出して、必要なステージを決定する変化率検出・動作ステージ決定手段を備えて、検出したアナログ入力信号の変化率に応じて、パイプラインステージを再構成する請求項2に記載のパイプライン型アナログデジタル変換装置。
- アナログ入力信号を遅延させる遅延手段を備えて、アナログ入力信号を遅延させて、変化率を検出した後に過去に遡ってAD変換する請求項10に記載のパイプライン型アナログデジタル変換装置。
- 複数の入力タップ及び複数の出力タップを有するアナログスイッチマトリックスを備え、前記遅延手段の各タップからの信号を各入力タップに入力し、かつ、その各出力タップからの信号をAD変換することにより、前記遅延手段の各タップから任意の信号を取り出して、入力信号された信号の順番によらず任意の時点での信号をAD変換する請求項11に記載のパイプライン型アナログデジタル変換装置。
- 前記遅延手段を、複数個の単位遅延素子を縦続接続することにより構成し、かつ、アナログ入力信号の変化率を、各遅延素子の出力タップの信号の差分をとることで検出する請求項11に記載のパイプライン型アナログデジタル変換装置。
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JP2010178573A JP2011071966A (ja) | 2009-08-24 | 2010-08-09 | パイプライン型アナログデジタル変換装置 |
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KR101933569B1 (ko) * | 2011-06-10 | 2018-12-28 | 마이크로칩 테크놀로지 인코포레이티드 | 파이프라인형 아날로그 디지털 변환기에서 지연 시간 감소를 위해 수정된 동적 요소 정합 |
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