JP2010203968A - 波形測定器 - Google Patents
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Abstract
【課題】イベント信号の格納にあたりメモリを効率よく利用しながら、イベント信号も波形情報として高速に表示できる波形測定器を提供すること。
【解決手段】アナログ信号とイベント信号を同時に波形として記録表示するように構成された波形測定器において、前記アナログ信号の波形データを格納する波形メモリと、前記イベント信号に関連したデータを格納するイベントメモリとを備え、前記イベントメモリには、前記イベント信号を取り込んだ時点における前記波形メモリへの前記アナログ信号の波形データの書き込みアドレスが格納されることを特徴とするもの。
【選択図】図１
【解決手段】アナログ信号とイベント信号を同時に波形として記録表示するように構成された波形測定器において、前記アナログ信号の波形データを格納する波形メモリと、前記イベント信号に関連したデータを格納するイベントメモリとを備え、前記イベントメモリには、前記イベント信号を取り込んだ時点における前記波形メモリへの前記アナログ信号の波形データの書き込みアドレスが格納されることを特徴とするもの。
【選択図】図１
Description
本発明は波形測定器に関し、詳しくは、アナログ信号波形と同時に入力されるイベント信号の表示の改善に関するものである。
波形測定器の一種に、たとえば非特許文献１に記載されているように、測定したアナログ信号波形と同時に音声メモを取り込むとともに、低速サンプリングでアナログ信号波形を取り込みながら過渡現象でトリガが発生すると高速サンプリングを行って高速サンプリングの開始位置情報を波形データとともにイベント信号として取り込み、これらのイベント発生位置を、格納されたイベント信号に基づきイベント波形として表示するように構成されたものがある。
図４は、このような従来の波形測定器の一例を示すブロック図である。アナログ信号は入力アンプ１によりＡ／Ｄ変換器２の適正な入力範囲レベルに正規化されてＡ／Ｄ変換器２に入力され、デジタル信号に変換される。
Ａ／Ｄ変換器２でデジタルに変換されたデータは、メモリ制御部３を介して、波形メモリ４へ格納される。この一連の動作は、タイミング発生器５から生成出力されるタイミング信号に基づき実行される。
イベント信号は、デジタルデータ変換器６でデジタル化される。たとえば、アナログ信号の波形メモリ４への書き込みデータが１６ビット長とすると、それに合わせて１６ビット中のある任意のビットをイベント信号とする。たとえばビット０をイベントデータに割り当てるとすれば、イベント信号が入力されたときは「０００１ｈ」、イベント信号がないときは「００００ｈ」となる。
このようにデジタル化されたイベント信号は、タイミング発生器５から生成出力されるタイミング信号に基づき、メモリ制御部３を介して、波形メモリ４のアナログデータとは異なる領域にイベントデータとして格納される。波形メモリ４に格納されたイベントデータは表示制御部７に送られ、表示部８には、図５に示すようにイベント信号に応じた位置にイベント波形ＥＷが表示される。
中山 悦郎 外3名、「スコープコーダ DL750」、横河技報、横河電機株式会社、2003年7月22日発行、Vol.47、No.3、27−30頁
特許文献１には、アナログ信号波形とイベント信号波形を同時に記録表示するように構成された波形測定器が記載されている。
ところで、イベント信号波形は、アナログ信号波形と同じようにイベントが入ったときを１、イベント信号がないときを０として、アナログ信号波形の時系列で扱われていることから、アナログ信号波形データを格納するメモリ領域と同様なメモリ領域を必要としている。
しかし、このようなイベント信号の発生頻度は、その情報の性質上、１回の測定で、数回から数１０回程度が一般的である。これらのイベント信号を格納するために、アナログ信号波形データを格納するのと同様なロングメモリ領域を別途確保しておくことは、メモリの利用面からも非効率的である。
また、イベント信号を別途メモリに格納することも考えられるが、表示にあたってはたとえばＣＰＵを用いて波形を生成しなければならないのでＣＰＵの負荷が増大することになり、高速表示が困難になる。
本発明は、これらの問題を解決するものであり、その目的は、イベント信号の格納にあたりメモリを効率よく利用しながら、イベント信号も波形情報として高速に表示できる波形測定器を提供することにある。
このような課題を達成するために、本発明のうち請求項１記載の発明は、
アナログ信号とイベント信号を同時に波形として記録表示するように構成された波形測定器において、
前記アナログ信号の波形データを格納する波形メモリと、前記イベント信号に関連したデータを格納するイベントメモリとを備え、
前記イベントメモリには、前記イベント信号を取り込んだ時点における前記波形メモリへの前記アナログ信号の波形データの書き込みアドレスが格納されることを特徴とする。
アナログ信号とイベント信号を同時に波形として記録表示するように構成された波形測定器において、
前記アナログ信号の波形データを格納する波形メモリと、前記イベント信号に関連したデータを格納するイベントメモリとを備え、
前記イベントメモリには、前記イベント信号を取り込んだ時点における前記波形メモリへの前記アナログ信号の波形データの書き込みアドレスが格納されることを特徴とする。
請求項２記載の発明は、請求項１記載の波形測定器において、
前記イベントメモリに格納された前記イベント信号に関連したデータを波形データに変換する波形データ変換部と、
この波形データ変換部で変換された前記イベント信号に関連した波形データと前記波形メモリから読み出される波形データを同一画面に表示する表示画面を生成する表示制御部を設けたことを特徴とする。
前記イベントメモリに格納された前記イベント信号に関連したデータを波形データに変換する波形データ変換部と、
この波形データ変換部で変換された前記イベント信号に関連した波形データと前記波形メモリから読み出される波形データを同一画面に表示する表示画面を生成する表示制御部を設けたことを特徴とする。
請求項３記載の発明は、請求項２記載の波形測定器において、
前記波形データ変換部は、
前記イベントメモリから読み出されるアドレスと前記波形メモリの読み出しアドレスとを比較するアドレス比較部と、
このアドレス比較部の一致出力に基づき前記イベント信号に関連した波形データを生成するイベント波形生成部と、
前記アドレス比較部の一致出力に基づき前記イベントメモリにアクセスするアドレスを更新するイベントメモリアクセス部、
を有することを特徴とする。
前記波形データ変換部は、
前記イベントメモリから読み出されるアドレスと前記波形メモリの読み出しアドレスとを比較するアドレス比較部と、
このアドレス比較部の一致出力に基づき前記イベント信号に関連した波形データを生成するイベント波形生成部と、
前記アドレス比較部の一致出力に基づき前記イベントメモリにアクセスするアドレスを更新するイベントメモリアクセス部、
を有することを特徴とする。
本発明によれば、イベント信号の格納にあたりメモリを効率よく利用でき、イベント信号も波形情報として高速に表示できる。
以下、本発明について、図面を用いて詳細に説明する。図１は本発明の一実施例を示すブロック図、図２は図１のメモリからのデータ読み出しに関連した主要部のブロック図であり、図４と共通する部分には同一の符号を付けている。
図１では、イベント信号の系統に、図４のデジタルデータ変換器６に代えて、イベントデータ変換器９とイベントメモリ１０と波形データ変換部１１を設けている。
そして図２では、表示制御部７のうち表示波形生成部７ａと波形メモリアクセス部７ｂを示し、波形データ変換部１１のうちアドレス比較部１１ａとイベント波形生成部１１ｂとイベントメモリアクセス部１１ｃを示している。
これら図１および図２において、アナログ信号は入力アンプ１によりＡ／Ｄ変換器２の適正な入力範囲レベルに正規化されてＡ／Ｄ変換器２に入力され、タイミング発生器５からのタイミング信号に基づきデジタル信号に変換される。
タイミング発生器５のタイミング信号はメモリ制御部３にも入力され、このタイミング信号に基づき波形メモリ４のアドレスを１つずつインクリメントしながら、Ａ／Ｄ変換器２の出力データを順次波形メモリ４に格納していく。
イベントデータ変換器９は、イベント信号が入力されると、イベントメモリ１０に対して、その時点におけるメモリ制御部３の波形メモリ４への書き込みアドレスを取り込むように制御信号を出力する。これにより、イベントメモリ１０には、イベント信号が入力された時点における波形メモリ４への書き込みアドレスが格納される。
波形メモリ４に格納されたアナログ波形データは、メモリ制御部３から入力される読み出しアドレスに基づき、波形メモリアクセス部７ｂを介して順次表示波形生成部７ａに読み出され、図３に示すように、表示部８に順次アナログ波形ＡＷとして表示される。なお、メモリ制御部３から表示波形生成部７ａを介して波形メモリアクセス部７ｂに入力される読み出しアドレスは、アドレス比較部１１ａの一方の入力端子にも入力される。
一方、イベントメモリ１０に格納されているイベント信号に関連した波形メモリ４への書き込みアドレスは、イベントメモリアクセス部１１ｃから入力されるアドレスに基づきアドレス比較部１１ａの他方の入力端子に読み出され、メモリ制御部３から入力される読み出しアドレスと比較される。
アドレス比較部１１ａは、表示波形生成部７ａを介して波形メモリアクセス部７ｂに入力される読み出しアドレスとイベントメモリ１０から読み出されるアドレスとを比較し、それらの比較結果をイベント波形生成部１１ｂおよびイベントメモリアクセス部１１ｃに出力する。
イベント波形生成部１１ｂは、アドレス比較部１１ａに入力されたアドレスが一致すると、図３に示すようなイベント波形ＥＷを作成して表示波形生成部７ａに出力する。
また、イベントメモリアクセス部１１ｃは、アドレス比較部１１ａに入力されたアドレスが一致すると、イベントメモリ１０にアクセスするアドレスをインクリメントし、イベントメモリ１０の次のアドレスに格納されているイベント信号に関連した波形メモリ４への書き込みアドレスをアドレス比較部１１ａに読み出す。
このようにして、波形データ変換部１１は、表示波形生成部７ａを介して波形メモリアクセス部７ｂに入力される読み出しアドレスとイベントメモリ１０から読み出されるアドレスとを順次比較しながらイベント波形ＥＷを作成していく。
このような構成によれば、イベント信号は波形メモリ４への書き込みアドレスデータとしてイベントメモリ１０に格納されているので、イベント信号を格納するために必要なメモリ領域を従来に比べて大幅に削減できる。
そして、波形表示処理をハードウェアで行うので、従来のソフトウェア処理に比べて高速に表示できる。
なお、図２では、イベント信号が１系統の例を示したが、複数のアドレス比較器を設けて、複数系統のイベント信号を処理するようにしてもよい。
以上説明したように、本発明によれば、メモリを効率よく利用してイベント信号を格納できるとともに、イベント信号も波形情報として高速に表示できる波形測定器が実現できる。
１ アンプ
２ Ａ／Ｄ変換器
３ メモリ制御部
４ 波形メモリ
５ タイミング発生器
７ 表示制御部
７ａ 表示波形生成部
７ｂ 波形メモリアクセス部
８ 表示部
９ イベントデータ変換器
１０ イベントメモリ
１１ 波形データ変換器
１１ａ アドレス比較部
１１ｂ イベント波形生成部
１１ｃ イベントメモリアクセス部
２ Ａ／Ｄ変換器
３ メモリ制御部
４ 波形メモリ
５ タイミング発生器
７ 表示制御部
７ａ 表示波形生成部
７ｂ 波形メモリアクセス部
８ 表示部
９ イベントデータ変換器
１０ イベントメモリ
１１ 波形データ変換器
１１ａ アドレス比較部
１１ｂ イベント波形生成部
１１ｃ イベントメモリアクセス部
Claims (3)
- アナログ信号とイベント信号を同時に波形として記録表示するように構成された波形測定器において、
前記アナログ信号の波形データを格納する波形メモリと、前記イベント信号に関連したデータを格納するイベントメモリとを備え、
前記イベントメモリには、前記イベント信号を取り込んだ時点における前記波形メモリへの前記アナログ信号の波形データの書き込みアドレスが格納されることを特徴とすることを特徴とする波形測定器。 - 前記イベントメモリに格納された前記イベント信号に関連したデータを波形データに変換する波形データ変換部と、
この波形データ変換部で変換された前記イベント信号に関連した波形データと前記波形メモリから読み出される波形データを同一画面に表示する表示画面を生成する表示制御部を設けたことを特徴とする請求項１記載の波形測定器。 - 前記波形データ変換部は、
前記イベントメモリから読み出されるアドレスと前記波形メモリの読み出しアドレスとを比較するアドレス比較部と、
このアドレス比較部の一致出力に基づき前記イベント信号に関連した波形データを生成するイベント波形生成部と、
前記アドレス比較部の一致出力に基づき前記イベントメモリにアクセスするアドレスを更新するイベントメモリアクセス部、
を有することを特徴とする請求項２記載の波形測定器。
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| JP2002250745A (ja) * | 2001-02-23 | 2002-09-06 | Yokogawa Electric Corp | 波形記録装置 |
| JP2004144492A (ja) * | 2002-10-22 | 2004-05-20 | Yokogawa Electric Corp | 波形記録装置 |
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