JP2010146592A - テストプログラムデバッグ装置、半導体試験装置、テストプログラムデバッグ方法、及び試験方法 - Google Patents
テストプログラムデバッグ装置、半導体試験装置、テストプログラムデバッグ方法、及び試験方法 Download PDFInfo
- Publication number
- JP2010146592A JP2010146592A JP2010043436A JP2010043436A JP2010146592A JP 2010146592 A JP2010146592 A JP 2010146592A JP 2010043436 A JP2010043436 A JP 2010043436A JP 2010043436 A JP2010043436 A JP 2010043436A JP 2010146592 A JP2010146592 A JP 2010146592A
- Authority
- JP
- Japan
- Prior art keywords
- test
- range
- instruction
- setting
- pattern
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Images
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/28—Error detection; Error correction; Monitoring by checking the correct order of processing
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/22—Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing
- G06F11/26—Functional testing
- G06F11/263—Generation of test inputs, e.g. test vectors, patterns or sequences ; with adaptation of the tested hardware for testability with external testers
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R31/00—Arrangements for testing electric properties; Arrangements for locating electric faults; Arrangements for electrical testing characterised by what is being tested not provided for elsewhere
- G01R31/28—Testing of electronic circuits, e.g. by signal tracer
- G01R31/317—Testing of digital circuits
- G01R31/3181—Functional testing
- G01R31/3183—Generation of test inputs, e.g. test vectors, patterns or sequences
- G01R31/318314—Tools, e.g. program interfaces, test suite, test bench, simulation hardware, test compiler, test program languages
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/22—Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing
Landscapes
- Engineering & Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Quality & Reliability (AREA)
- Computer Hardware Design (AREA)
- Test And Diagnosis Of Digital Computers (AREA)
- Tests Of Electronic Circuits (AREA)
- Debugging And Monitoring (AREA)
Abstract
【解決手段】本発明のテストプログラムデバッグ装置は、被試験デバイスシミュレータ及び半導体試験装置シミュレータとを備える。そして、半導体試験装置シミュレータは、テストプログラムのうちの検証すべき命令の範囲である検証範囲を取得する検証範囲取得部と、テストプログラムのうちの検証範囲以外の範囲である非検証範囲に含まれる非検証範囲命令のうち、被試験デバイスシミュレータの設定を行うための設定命令以外の非設定命令を単純化する命令単純化部と、検証範囲に含まれる検証範囲命令、設定命令、及び命令単純化部によって単純化された非設定命令を実行する命令実行部とを有する。
【選択図】図1
Description
特許文献1 特開2001−51025号公報
102 半導体試験装置シミュレータ
104 被試験デバイスシミュレータ
106 エミュレータ制御部
108 テストモジュールエミュレータ
110 テストプログラム
112 アプリケーションプログラム
114 言語解析実行部
116 テスタライブラリ
118 テスタバスエミュレータ
120 検証範囲取得部
122 命令単純化部
124 仮想テスタバス
126 仮想レジスタ
128 仮想メモリ
130 仮想試験実行部
136 試験結果解析判定部
138 出力パターンテーブル
200 半導体試験装置
202 被試験デバイス
204 テストモジュール制御部
206 テストモジュール
210 アプリケーションプログラム
212 言語解析実行部
214 テスタライブラリ
216 テスタバスドライバ
218 試験範囲取得部
220 命令単純化部
222 テスタバス
224 レジスタ
226 メモリ
228 試験実行部
300 パターンプログラム
302 テスト番号
304 試験条件命令群
306 測定命令群
308 設定命令
310 パターン生成命令
312 パターン比較命令
314 テストパターンのアドレス
316 パターンデータ
Claims (9)
- 半導体試験装置用のテストプログラムのデバッグを行うテストプログラムデバッグ装置であって、
被試験デバイスをシミュレートする被試験デバイスシミュレータと、
前記テストプログラムを実行して前記半導体試験装置をシミュレートし、前記被試験デバイスシミュレータにテストパターンを供給する半導体試験装置シミュレータと
を備え、
前記半導体試験装置シミュレータは、
前記テストプログラムのうちの検証すべき命令の範囲である検証範囲を取得する検証範囲取得部と、
前記テストプログラムのうちの前記検証範囲以外の範囲である非検証範囲に含まれる非検証範囲命令のうち、前記被試験デバイスシミュレータの設定を行うための設定命令以外の非設定命令を単純化する命令単純化部と、
前記検証範囲に含まれる検証範囲命令、前記設定命令、及び前記命令単純化部によって単純化された前記非設定命令を実行する命令実行部と
を有するテストプログラムデバッグ装置。 - 前記非設定命令は、前記非設定命令として、前記テストパターンの生成を行うためのパターン生成命令、及び前記テストパターンに対して前記被試験デバイスシミュレータから出力された出力パターンを期待値と比較するパターン比較命令を含み、
前記命令単純化部は、前記パターン生成命令及び前記パターン比較命令を単純化し、
前記命令実行部は、前記検証範囲命令及び前記設定命令、並びに前記単純化された前記パターン生成命令及び前記パターン比較命令を実行する請求項1に記載のテストプログラムデバッグ装置。 - 前記命令単純化部は、前記非設定命令を前記命令実行部によって実行されない命令として設定し、
前記命令実行部は、前記検証範囲命令及び前記設定命令を実行し、前記非設定命令を実行しない請求項1に記載のテストプログラムデバッグ装置。 - 半導体試験装置用のテストプログラムのデバッグを行うテストプログラムデバッグ装置であって、
被試験デバイスをシミュレートする被試験デバイスシミュレータと、
前記テストプログラムを実行して前記半導体試験装置をシミュレートし、前記被試験デバイスシミュレータにテストパターンの受け渡しを行う半導体試験装置シミュレータと
を備え、
前記半導体試験装置シミュレータは、前記テストプログラムのうちの検証すべき命令の範囲である検証範囲を取得し、
前記被試験デバイスシミュレータは、前記テストプログラムのうちの前記検証範囲以外の範囲である非検証範囲に含まれる非検証範囲命令のうち、前記被試験デバイスシミュレータの設定を行うための設定命令以外の非設定命令に基づくシミュレートを単純化して実行するテストプログラムデバッグ装置。 - 前記被試験デバイスシミュレータは、前記半導体試験装置シミュレータから供給された前記テストパターンに対する出力パターンを予め保持しており、前記非設定命令に基づく前記半導体試験装置シミュレータからの前記テストパターンに対して、予め保持している前記出力パターンを出力する請求項4に記載のテストプログラムデバッグ装置。
- テストプログラムを実行することにより被試験デバイスを試験する半導体試験装置であって、
前記テストプログラムのうちの前記被試験デバイスの試験に用いるべき命令の範囲である試験範囲を取得する試験範囲取得部と、
前記テストプログラムのうちの前記試験範囲以外の範囲である非試験範囲に含まれる非試験範囲命令のうち、前記被試験デバイスの設定を行うための設定命令以外の非設定命令を単純化する命令単純化部と、
前記試験範囲に含まれる試験範囲命令、前記設定命令、及び前記命令単純化部によって単純化された前記非設定命令を実行する命令実行部と
を備える半導体試験装置。 - 前記非設定命令は、前記非設定命令として、テストパターンの生成を行うためのパターン生成命令、及び前記テストパターンに対して前記被試験デバイスから出力されたテストパターンを期待値と比較するパターン比較命令を含み、
前記命令単純化部は、前記パターン生成命令及び前記パターン比較命令を単純化し、
前記命令実行部は、前記試験範囲命令及び前記設定命令、並びに前記単純化された前記パターン生成命令及び前記パターン比較命令を実行する請求項6に記載の半導体試験装置。 - 被試験デバイスをシミュレートする被試験デバイスシミュレータと、半導体試験装置用のテストプログラムを実行して前記半導体試験装置をシミュレートし、前記被試験デバイスシミュレータにテストパターンを供給する半導体試験装置シミュレータとを備えるテストプログラムデバッグ装置によるテストプログラムデバッグ方法であって、
前記テストプログラムのうちの検証すべき命令の範囲である検証範囲を取得する段階と、
前記テストプログラムのうちの前記検証範囲以外の範囲である非検証範囲に含まれる非検証範囲命令のうち、前記被試験デバイスシミュレータの設定を行うための設定命令以外の非設定命令を単純化する段階と、
前記検証範囲に含まれる検証範囲命令、前記設定命令、及び単純化された前記非設定命令を実行する段階と
を備えるテストプログラムデバッグ方法。 - テストプログラムを実行することにより被試験デバイスを試験する試験方法であって、
前記テストプログラムのうちの前記被試験デバイスの試験に用いるべき命令の範囲である試験範囲を取得する段階と、
前記テストプログラムのうちの前記試験範囲以外の範囲である非試験範囲に含まれる非試験範囲命令のうち、前記被試験デバイスの設定を行うための設定命令以外の非設定命令を単純化する段階と、
前記試験範囲に含まれる試験範囲命令、前記設定命令、及び単純化された前記非設定命令を実行する段階と
を備える試験方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2010043436A JP2010146592A (ja) | 2003-10-07 | 2010-02-26 | テストプログラムデバッグ装置、半導体試験装置、テストプログラムデバッグ方法、及び試験方法 |
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003348617 | 2003-10-07 | ||
JP2010043436A JP2010146592A (ja) | 2003-10-07 | 2010-02-26 | テストプログラムデバッグ装置、半導体試験装置、テストプログラムデバッグ方法、及び試験方法 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005514571A Division JPWO2005036402A1 (ja) | 2003-10-07 | 2004-10-05 | テストプログラムデバッグ装置、半導体試験装置、テストプログラムデバッグ方法、及び試験方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2010146592A true JP2010146592A (ja) | 2010-07-01 |
Family
ID=34430970
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005514571A Pending JPWO2005036402A1 (ja) | 2003-10-07 | 2004-10-05 | テストプログラムデバッグ装置、半導体試験装置、テストプログラムデバッグ方法、及び試験方法 |
JP2010043436A Pending JP2010146592A (ja) | 2003-10-07 | 2010-02-26 | テストプログラムデバッグ装置、半導体試験装置、テストプログラムデバッグ方法、及び試験方法 |
Family Applications Before (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005514571A Pending JPWO2005036402A1 (ja) | 2003-10-07 | 2004-10-05 | テストプログラムデバッグ装置、半導体試験装置、テストプログラムデバッグ方法、及び試験方法 |
Country Status (7)
Country | Link |
---|---|
US (1) | US7269773B2 (ja) |
EP (1) | EP1672508A4 (ja) |
JP (2) | JPWO2005036402A1 (ja) |
KR (1) | KR20060108662A (ja) |
CN (1) | CN100412811C (ja) |
TW (1) | TWI334489B (ja) |
WO (1) | WO2005036402A1 (ja) |
Families Citing this family (17)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7970594B2 (en) * | 2005-06-30 | 2011-06-28 | The Mathworks, Inc. | System and method for using model analysis to generate directed test vectors |
US8874425B2 (en) | 2007-03-22 | 2014-10-28 | The Invention Science Fund I, Llc | Implementing performance-dependent transfer or execution decisions from service emulation indications |
US9558019B2 (en) | 2007-03-22 | 2017-01-31 | Invention Science Fund I, Llc | Coordinating instances of a thread or other service in emulation |
US9378108B2 (en) * | 2007-03-22 | 2016-06-28 | Invention Science Fund I, Llc | Implementing performance-dependent transfer or execution decisions from service emulation indications |
US8438609B2 (en) | 2007-03-22 | 2013-05-07 | The Invention Science Fund I, Llc | Resource authorizations dependent on emulation environment isolation policies |
US8495708B2 (en) * | 2007-03-22 | 2013-07-23 | The Invention Science Fund I, Llc | Resource authorizations dependent on emulation environment isolation policies |
WO2008120389A1 (ja) * | 2007-03-29 | 2008-10-09 | Fujitsu Limited | メモリテスト回路、半導体集積回路およびメモリテスト方法 |
US20090119542A1 (en) * | 2007-11-05 | 2009-05-07 | Advantest Corporation | System, method, and program product for simulating test equipment |
US20090119084A1 (en) * | 2007-11-05 | 2009-05-07 | Advantest Corporation | System, method, and program product for simulating test equipment |
US8132052B2 (en) * | 2008-06-12 | 2012-03-06 | Csr Technology Inc. | System and method for locating a fault on a device under test |
US7984353B2 (en) * | 2008-08-29 | 2011-07-19 | Advantest Corporation | Test apparatus, test vector generate unit, test method, program, and recording medium |
WO2011001462A1 (ja) * | 2009-06-29 | 2011-01-06 | 株式会社アドバンテスト | 試験装置 |
CN102006183A (zh) * | 2010-11-12 | 2011-04-06 | 百度在线网络技术(北京)有限公司 | 一种用于基于配置参数配置网络设备的方法与配置设备 |
US9959186B2 (en) * | 2012-11-19 | 2018-05-01 | Teradyne, Inc. | Debugging in a semiconductor device test environment |
CN203117963U (zh) * | 2012-12-17 | 2013-08-07 | 新唐科技股份有限公司 | 提供图形化接脚接口的调试系统与装置 |
US20170023920A1 (en) * | 2014-03-10 | 2017-01-26 | Mhwirth As | Improved method for testing a control system |
US11513781B2 (en) * | 2020-08-07 | 2022-11-29 | International Business Machines Corporation | Simulating container deployment |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0749797A (ja) * | 1993-08-06 | 1995-02-21 | Mitsubishi Electric Corp | プログラム作成装置 |
JP2001051025A (ja) * | 1999-08-12 | 2001-02-23 | Advantest Corp | 半導体試験用プログラムデバッグ装置 |
Family Cites Families (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3959047A (en) * | 1974-09-30 | 1976-05-25 | International Business Machines Corporation | Method for constructing a rom for redundancy and other applications |
US5206582A (en) * | 1988-05-18 | 1993-04-27 | Hewlett-Packard Company | Control system for automated parametric test equipment |
DE19650293C1 (de) * | 1996-12-04 | 1998-04-09 | Siemens Ag | Verfahren zum Testen von Systemkomponenten eines objektorientierten Programms |
JPH119797A (ja) * | 1997-06-24 | 1999-01-19 | Toyomaru Sangyo Kk | 遊技機用制御装置 |
US6167545A (en) * | 1998-03-19 | 2000-12-26 | Xilinx, Inc. | Self-adaptive test program |
DE10036387A1 (de) * | 1999-08-16 | 2001-03-01 | Advantest Corp | Halbleitertestprogramm-Diagnosevorrichtung |
US6434503B1 (en) * | 1999-12-30 | 2002-08-13 | Infineon Technologies Richmond, Lp | Automated creation of specific test programs from complex test programs |
US7047463B1 (en) * | 2003-08-15 | 2006-05-16 | Inovys Corporation | Method and system for automatically determining a testing order when executing a test flow |
-
2004
- 2004-10-05 EP EP04792070A patent/EP1672508A4/en not_active Withdrawn
- 2004-10-05 WO PCT/JP2004/014659 patent/WO2005036402A1/ja active Application Filing
- 2004-10-05 CN CNB2004800288761A patent/CN100412811C/zh not_active Expired - Fee Related
- 2004-10-05 JP JP2005514571A patent/JPWO2005036402A1/ja active Pending
- 2004-10-05 KR KR1020067008833A patent/KR20060108662A/ko not_active Application Discontinuation
- 2004-10-07 TW TW093130319A patent/TWI334489B/zh not_active IP Right Cessation
-
2005
- 2005-08-24 US US11/211,162 patent/US7269773B2/en not_active Expired - Fee Related
-
2010
- 2010-02-26 JP JP2010043436A patent/JP2010146592A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0749797A (ja) * | 1993-08-06 | 1995-02-21 | Mitsubishi Electric Corp | プログラム作成装置 |
JP2001051025A (ja) * | 1999-08-12 | 2001-02-23 | Advantest Corp | 半導体試験用プログラムデバッグ装置 |
Also Published As
Publication number | Publication date |
---|---|
CN1864143A (zh) | 2006-11-15 |
CN100412811C (zh) | 2008-08-20 |
WO2005036402A1 (ja) | 2005-04-21 |
TWI334489B (en) | 2010-12-11 |
US7269773B2 (en) | 2007-09-11 |
US20060248390A1 (en) | 2006-11-02 |
JPWO2005036402A1 (ja) | 2007-11-22 |
TW200513660A (en) | 2005-04-16 |
KR20060108662A (ko) | 2006-10-18 |
EP1672508A1 (en) | 2006-06-21 |
EP1672508A4 (en) | 2010-06-30 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP2010146592A (ja) | テストプログラムデバッグ装置、半導体試験装置、テストプログラムデバッグ方法、及び試験方法 | |
CN107463473B (zh) | 基于uvm和fpga的芯片软硬件仿真环境 | |
JP3942765B2 (ja) | 半導体デバイスシミュレート装置及びそれを用いた半導体試験用プログラムデバッグ装置 | |
JP3383562B2 (ja) | 半導体試験装置 | |
US20040210798A1 (en) | Test emulator, test module emulator, and record medium storing program therein | |
JP2009116876A (ja) | 試験装置のシミュレーションシステム、方法、及びプログラム製品 | |
JP2009116878A (ja) | 試験装置のシミュレーションシステム、方法、及びプログラム製品 | |
JP4959941B2 (ja) | ソフトウェアの双方向プロービング | |
CN114325333A (zh) | 一种高效率规范化的soc系统级验证方法及装置 | |
CN117787155B (zh) | 一种芯片可测性代码动态仿真测试系统及测试方法 | |
CA2176748A1 (en) | Atg test station | |
US7313729B2 (en) | Low-cost debugging system with a ROM or RAM emulator | |
JP4213306B2 (ja) | 半導体試験用プログラムデバッグ装置 | |
JP4574894B2 (ja) | 半導体試験用プログラムデバッグ装置 | |
JP2011248597A (ja) | テスタシミュレーション装置、テスタシミュレーションプログラムおよびテスタシミュレーション方法 | |
US6718498B2 (en) | Method and apparatus for the real time manipulation of a test vector to access the microprocessor state machine information using the integrated debug trigger | |
JP4132499B2 (ja) | 半導体試験用プログラムデバッグ装置 | |
JP2004348596A (ja) | Icテスタ用プログラムのデバッグ装置、方法、及びプログラム | |
El-Kharashy et al. | A novel assertions-based code coverage automatic cad tool | |
US20230315598A1 (en) | Automatic Functional Test Pattern Generation based on DUT Reference Model and Unique Scripts | |
Steininger et al. | Built-in fault injectors-the logical continuation of bist? | |
US6961887B1 (en) | Streamlined LASAR-to-L200 post-processing for CASS | |
Kirkland et al. | Chip Behavior Realities Detected by Using Actual Automatic Test Equipment for Simulations | |
Widhalm et al. | A common platform for bridging pre-and post-silicon verification in mixed-signal designs | |
Tuna et al. | STESI: a new software-based strategy for testing socs containing wrapped IP cores |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20100326 |
|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20100326 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20110524 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20120525 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20120605 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20120802 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20130312 |