JP2010041478A - パルス幅変調方式のデジタル/アナログ変換器 - Google Patents
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Abstract
【課題】ノイズ強度が低減されてノイズ除去回路を削減したパルス幅変調方式のデジタル/アナログ変換器を提供する。
【解決手段】パルス幅変調方式のデジタル/アナログ変換器は、周波数の異なる複数のクロックを時系列的に選択して得られる選択クロックに基づいてパルス幅を変調することによりパルスを平滑して得られる直流出力の電圧を調整する。また、上記周波数の異なる複数のクロックを所定の時間毎に切り替えて選択し、上記周波数の異なる複数のクロックはプログラマブルロジック内のDelay Locked Loopを使用して生成される。
【選択図】図1
【解決手段】パルス幅変調方式のデジタル/アナログ変換器は、周波数の異なる複数のクロックを時系列的に選択して得られる選択クロックに基づいてパルス幅を変調することによりパルスを平滑して得られる直流出力の電圧を調整する。また、上記周波数の異なる複数のクロックを所定の時間毎に切り替えて選択し、上記周波数の異なる複数のクロックはプログラマブルロジック内のDelay Locked Loopを使用して生成される。
【選択図】図1
Description
この発明はパルス幅変調方式を用いたデジタル/アナログ変換器に関するものである。
従来、基本的なパルス幅変調方式ではパルスを生成するために単一の固定周波数の基本クロックを用いている。そして、この基本クロックに基づいて生成されたパルスをカウントし、カウント値が制御部からの指示に達したときパルスを変化させてパルスのデューティ比を変化している。パルスのデューティ比を変化することにより、パルスを平滑フィルタで平滑して得る直流出力の電圧を調整することができる。このように簡易な構成で任意の電圧を得ることが可能なので、ロジック回路やマイクロコンピュータを用いたデジタル/アナログコンバータとして使用されている(例えば、特許文献1参照)。
しかし、単一周波数の基本クロックを用いてパルス幅が変調されたパルスを生成しているので、ノイズの周波数成分がこの周波数成分に集中するためノイズ強度が増大し、周辺回路の動作に影響するなどの問題がある。このためノイズ除去回路の追加など回路規模が増大するという問題がある。
この発明の目的は、ノイズ強度が低減されてノイズ除去回路を削減したパルス幅変調方式のデジタル/アナログ変換器を提供することである。
この発明に係るパルス幅変調方式のデジタル/アナログ変換器は、周波数の異なる複数のクロックを時系列的に選択して得られる選択クロックに基づいてパルス幅を変調することによりパルスを平滑して得られる直流出力の電圧を調整する。
この発明に係るパルス幅変調方式のデジタル/アナログ変換器では、周波数の異なる複数のクロックを時系列的に切り替えて得られる選択クロックをカウントしてパルス幅を変調するので、生成パルスを平滑して出力される直流電圧に含まれるノイズ成分が複数のクロックの周波数に分散される。そして、複数の周波数にノイズが分散されることによりノイズ強度が低減される。従って、ノイズ除去回路の削減が可能となるという効果を奏する。
図1は、この発明におけるパルス幅変調方式のデジタル/アナログ変換器の回路構成図である。
この発明を実施するための最良の形態のパルス幅変調方式のデジタル/アナログ変換器(以下、D/Aコンバータと称す)をFPGA(Field Programmable Gate Array)などのプログラマブルロジック回路を用いて構成した。
このD/Aコンバータは、入力する基本クロックから数種類の周波数のクロックを生成するDelay Locked Loop(以下、DLLと称す)部1、DLL部1で生成された数種類の周波数のクロックから1つのクロックを選択するSEL部2、SEL部2から出力される選択クロックをカウントしてパルス幅を定めて生成パルスを出力するカウンタ部3、カウンタ部3から出力される生成パルスを平滑し直流電圧を得る平滑フィルタ4、SEL部2でクロックを切り替えるクロック切替えタイミングを生成するとともに生成する電圧に対応するパルス幅に該当する制御値を生成する制御部5、から構成される。
この発明を実施するための最良の形態のパルス幅変調方式のデジタル/アナログ変換器(以下、D/Aコンバータと称す)をFPGA(Field Programmable Gate Array)などのプログラマブルロジック回路を用いて構成した。
このD/Aコンバータは、入力する基本クロックから数種類の周波数のクロックを生成するDelay Locked Loop(以下、DLLと称す)部1、DLL部1で生成された数種類の周波数のクロックから1つのクロックを選択するSEL部2、SEL部2から出力される選択クロックをカウントしてパルス幅を定めて生成パルスを出力するカウンタ部3、カウンタ部3から出力される生成パルスを平滑し直流電圧を得る平滑フィルタ4、SEL部2でクロックを切り替えるクロック切替えタイミングを生成するとともに生成する電圧に対応するパルス幅に該当する制御値を生成する制御部5、から構成される。
次に、図2に示すD/Aコンバータ内の信号の時系列データを参照して動作を説明する。
DLL部1は、入力される周波数f0の基本クロックから周波数f1、f2、・・・、fxのクロックを生成する。そして、周波数f1、f2、・・・、fxの最大公約数をGとする。
制御部5は、周波数f1、f2、・・・、fxのクロックに同期して周期1/Gのクロック切替え信号をSEL部2に入力する。
SEL部2は、入力する周波数f1、f2、・・・、fxのクロックを周期1/Gのクロック切替え信号に同期して順次選択する。このように周期1/Gでクロックを選択すると、周期1/G内には整数個の周期1/f1、1/f2、・・・、1/fxが含まれるので、クロックを切り替えて選択するときに発生する可能性のあるグリッジを抑制することができる。
DLL部1は、入力される周波数f0の基本クロックから周波数f1、f2、・・・、fxのクロックを生成する。そして、周波数f1、f2、・・・、fxの最大公約数をGとする。
制御部5は、周波数f1、f2、・・・、fxのクロックに同期して周期1/Gのクロック切替え信号をSEL部2に入力する。
SEL部2は、入力する周波数f1、f2、・・・、fxのクロックを周期1/Gのクロック切替え信号に同期して順次選択する。このように周期1/Gでクロックを選択すると、周期1/G内には整数個の周期1/f1、1/f2、・・・、1/fxが含まれるので、クロックを切り替えて選択するときに発生する可能性のあるグリッジを抑制することができる。
制御部5は、図示しない直流電圧の指令値に基づいて生成パルスのデューティ比率を指定する制御値dを算出しカウンタ部3に送る。出力される生成パルスのデューティ比率は、分解能mとカウント数が制御値dとなったとき、d/(m−d)となる。
カウンタ部3は、選択クロックをカウントし、カウント値がdに達したときパルスを「HIGH」レベルから「LOW」レベルに変化させ、カウント値が分解能mに達したときパルスを「LOW」レベルから「HIGH」レベルに変化する。このとき同時にカウント値をリセットして0にする。
平滑フィルタ4は、パルス幅が変調されたパルスを平滑することにより直流電圧を出力する。なお、直流電圧は、デューティ比率と基準電圧を掛けた値である。
カウンタ部3は、選択クロックをカウントし、カウント値がdに達したときパルスを「HIGH」レベルから「LOW」レベルに変化させ、カウント値が分解能mに達したときパルスを「LOW」レベルから「HIGH」レベルに変化する。このとき同時にカウント値をリセットして0にする。
平滑フィルタ4は、パルス幅が変調されたパルスを平滑することにより直流電圧を出力する。なお、直流電圧は、デューティ比率と基準電圧を掛けた値である。
このように周波数の異なる複数のクロックを時系列的に切り替えて得られる選択クロックをカウントしてパルス幅を変調するので、図3に示すように、生成パルスを平滑して出力される直流電圧に含まれるノイズ成分が複数のクロックの周波数に分散される。そして、複数の周波数にノイズが分散されることによりノイズ強度が低減される。従って、ノイズ除去回路の削減が可能となる。
1 DLL部、2 SEL部、3 カウンタ部、4 平滑フィルタ、5 制御部。
Claims (4)
- 周波数の異なる複数のクロックを時系列的に選択して得られる選択クロックに基づいてパルス幅を変調することによりパルスを平滑して得られる直流出力の電圧を調整することを特徴とするパルス幅変調方式のデジタル/アナログ変換器。
- 上記周波数の異なる複数のクロックを所定の時間毎に切り替えて選択することを特徴とする請求項1に記載のパルス幅変調方式のデジタル/アナログ変換器。
- 上記周波数の異なる複数のクロックはプログラマブルロジック内のDelay Locked Loopを使用して生成されることを特徴とする請求項1に記載のパルス幅変調方式のデジタル/アナログ変換器。
- 上記周波数の異なる複数のクロックを切り替えて選択するタイミングは、上記複数のクロックの周波数の最大公約数の周期であることを特徴とする請求項1に記載のパルス幅変調方式のデジタル/アナログ変換器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2008202999A JP2010041478A (ja) | 2008-08-06 | 2008-08-06 | パルス幅変調方式のデジタル/アナログ変換器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2008202999A JP2010041478A (ja) | 2008-08-06 | 2008-08-06 | パルス幅変調方式のデジタル/アナログ変換器 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2010041478A true JP2010041478A (ja) | 2010-02-18 |
Family
ID=42013531
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2008202999A Pending JP2010041478A (ja) | 2008-08-06 | 2008-08-06 | パルス幅変調方式のデジタル/アナログ変換器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2010041478A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2471287C1 (ru) * | 2011-11-07 | 2012-12-27 | Российская Федерация, от имени которой выступает Государственная корпорация по атомной энергии "Росатом" - Госкорпорация "Росатом" | Многоканальный преобразователь аналоговых сигналов в импульсную последовательность, модулированную по времени |
JPWO2014065408A1 (ja) * | 2012-10-25 | 2016-09-08 | 株式会社 Trigence Semiconductor | 変換器 |
-
2008
- 2008-08-06 JP JP2008202999A patent/JP2010041478A/ja active Pending
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